JP2015060863A - 半導体装置およびその製造方法 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 78
- 238000004519 manufacturing process Methods 0.000 title claims description 11
- 239000011229 interlayer Substances 0.000 claims abstract description 74
- 238000000034 method Methods 0.000 claims description 54
- 238000005530 etching Methods 0.000 claims description 33
- 239000000758 substrate Substances 0.000 claims description 21
- 230000001681 protective effect Effects 0.000 claims description 10
- 230000003068 static effect Effects 0.000 claims description 5
- 239000004020 conductor Substances 0.000 claims 6
- 229910021420 polycrystalline silicon Inorganic materials 0.000 abstract description 97
- 229920005591 polysilicon Polymers 0.000 abstract description 97
- 238000009413 insulation Methods 0.000 abstract description 4
- 239000010408 film Substances 0.000 description 185
- 101150069942 ATR2 gene Proteins 0.000 description 30
- 101100459266 Arabidopsis thaliana MYC3 gene Proteins 0.000 description 30
- 101100194350 Mus musculus Rere gene Proteins 0.000 description 30
- 230000015572 biosynthetic process Effects 0.000 description 18
- 229910052581 Si3N4 Inorganic materials 0.000 description 17
- HQVNEWCFYHHQES-UHFFFAOYSA-N silicon nitride Chemical compound N12[Si]34N5[Si]62N3[Si]51N64 HQVNEWCFYHHQES-UHFFFAOYSA-N 0.000 description 17
- 101100025355 Oryza sativa subsp. japonica MYB4 gene Proteins 0.000 description 12
- 239000003990 capacitor Substances 0.000 description 12
- 230000000052 comparative effect Effects 0.000 description 10
- GHAFORRTMVIXHS-UHFFFAOYSA-L bromosulfophthalein sodium Chemical compound [Na+].[Na+].C1=C(S([O-])(=O)=O)C(O)=CC=C1C1(C=2C=C(C(O)=CC=2)S([O-])(=O)=O)C(C(Br)=C(Br)C(Br)=C2Br)=C2C(=O)O1 GHAFORRTMVIXHS-UHFFFAOYSA-L 0.000 description 9
- 101150035405 SWF1 gene Proteins 0.000 description 7
- 239000010410 layer Substances 0.000 description 7
- 239000010936 titanium Substances 0.000 description 7
- 238000000206 photolithography Methods 0.000 description 6
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 5
- 239000000463 material Substances 0.000 description 5
- 229910052719 titanium Inorganic materials 0.000 description 5
- QRABSTLMZWUWIQ-UHFFFAOYSA-N CSCP Chemical compound CSCP QRABSTLMZWUWIQ-UHFFFAOYSA-N 0.000 description 4
- 101000907912 Homo sapiens Pre-mRNA-splicing factor ATP-dependent RNA helicase DHX16 Proteins 0.000 description 4
- 101000798532 Homo sapiens Transmembrane protein 171 Proteins 0.000 description 4
- 101150101414 PRP1 gene Proteins 0.000 description 4
- 102100023390 Pre-mRNA-splicing factor ATP-dependent RNA helicase DHX16 Human genes 0.000 description 4
- 101100368710 Rattus norvegicus Tacstd2 gene Proteins 0.000 description 4
- 101100342406 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) PRS1 gene Proteins 0.000 description 4
- BOTDANWDWHJENH-UHFFFAOYSA-N Tetraethyl orthosilicate Chemical compound CCO[Si](OCC)(OCC)OCC BOTDANWDWHJENH-UHFFFAOYSA-N 0.000 description 4
- 238000010292 electrical insulation Methods 0.000 description 4
- 230000006870 function Effects 0.000 description 4
- 239000000126 substance Substances 0.000 description 4
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 4
- 229910052721 tungsten Inorganic materials 0.000 description 4
- 239000010937 tungsten Substances 0.000 description 4
- 101100125371 Caenorhabditis elegans cil-1 gene Proteins 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 238000002955 isolation Methods 0.000 description 3
- 239000011368 organic material Substances 0.000 description 3
- 239000005360 phosphosilicate glass Substances 0.000 description 3
- 239000010409 thin film Substances 0.000 description 3
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 2
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 2
- NRTOMJZYCJJWKI-UHFFFAOYSA-N Titanium nitride Chemical compound [Ti]#N NRTOMJZYCJJWKI-UHFFFAOYSA-N 0.000 description 2
- 238000010030 laminating Methods 0.000 description 2
- 238000000059 patterning Methods 0.000 description 2
- 229920002120 photoresistant polymer Polymers 0.000 description 2
- 238000007517 polishing process Methods 0.000 description 2
- 229910052710 silicon Inorganic materials 0.000 description 2
- 239000010703 silicon Substances 0.000 description 2
- 229910052814 silicon oxide Inorganic materials 0.000 description 2
- WQJQOUPTWCFRMM-UHFFFAOYSA-N tungsten disilicide Chemical compound [Si]#[W]#[Si] WQJQOUPTWCFRMM-UHFFFAOYSA-N 0.000 description 2
- 229910021342 tungsten silicide Inorganic materials 0.000 description 2
- 101100274567 Arabidopsis thaliana CLE3 gene Proteins 0.000 description 1
- 101100384011 Arabidopsis thaliana CLE4 gene Proteins 0.000 description 1
- 101100384014 Arabidopsis thaliana CLE6 gene Proteins 0.000 description 1
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical group [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 1
- 101150045501 CLE1 gene Proteins 0.000 description 1
- 101150117071 CLE2 gene Proteins 0.000 description 1
- 102100032182 Crooked neck-like protein 1 Human genes 0.000 description 1
- 101000921063 Homo sapiens Crooked neck-like protein 1 Proteins 0.000 description 1
- -1 Phospho Chemical class 0.000 description 1
- 239000002253 acid Substances 0.000 description 1
- RICLFGYGYQXUFH-UHFFFAOYSA-N buspirone hydrochloride Chemical compound [H+].[Cl-].C1C(=O)N(CCCCN2CCN(CC2)C=2N=CC=CN=2)C(=O)CC21CCCC2 RICLFGYGYQXUFH-UHFFFAOYSA-N 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 238000001459 lithography Methods 0.000 description 1
- 229910044991 metal oxide Inorganic materials 0.000 description 1
- 150000004706 metal oxides Chemical class 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
- 238000005498 polishing Methods 0.000 description 1
- 239000011347 resin Substances 0.000 description 1
- 229920005989 resin Polymers 0.000 description 1
- 239000005368 silicate glass Substances 0.000 description 1
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/70—Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
- H01L21/71—Manufacture of specific parts of devices defined in group H01L21/70
- H01L21/768—Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
- H01L21/76897—Formation of self-aligned vias or contact plugs, i.e. involving a lithographically uncritical step
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/482—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body
- H01L23/485—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body consisting of layered constructions comprising conductive layers and insulating layers, e.g. planar contacts
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/02—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
- H01L27/0203—Particular design considerations for integrated circuits
- H01L27/0207—Geometrical layout of the components, e.g. computer aided design; custom LSI, semi-custom LSI, standard cell technique
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- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10B—ELECTRONIC MEMORY DEVICES
- H10B10/00—Static random access memory [SRAM] devices
- H10B10/12—Static random access memory [SRAM] devices comprising a MOSFET load element
- H10B10/125—Static random access memory [SRAM] devices comprising a MOSFET load element the MOSFET being a thin film transistor [TFT]
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
- H01L23/5226—Via connections in a multilevel interconnection structure
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
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- Engineering & Computer Science (AREA)
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- Physics & Mathematics (AREA)
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- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Manufacturing & Machinery (AREA)
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- Semiconductor Memories (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Abstract
【解決手段】層間絶縁膜IL3、IL2、IL1に、2つの配線部WEによって挟まれた部分と2つのゲート配線部GEによって挟まれた部分とを貫いて、ポリシリコンプラグBSPに達するコンタクトホールSCHが自己整合的に形成されている。そのコンタクトホールSCH内に、ポリシリコンプラグBSPに接触するポリシリコンプラグSCPが形成されている。
【選択図】図3
Description
他の実施の形態によれば、コンタクト抵抗の変動を抑制することができる。
ここでは、半導体装置の一例として、アドバンストSRAMメモリセルを備えた半導体装置について説明する。まず、そのアドバンストSRAMメモリセルの等価回路について説明する。
その後、ローカル配線2G1、2G2を覆う層間絶縁膜(図示せず)、ロードトランジスタLTR1、LTR2およびキャパシタC1、C2(図3参照)等が形成されて、SRAMメモリセルSMCを備えた半導体装置の主要部分が完成する。
ここでは、半導体装置の他の例として、ポリシリコンプラグと、配線部またはゲート配線部との電気的な絶縁性をさらに高めることができる、SRAMメモリセルを備えた半導体装置について説明する。
その後、ローカル配線2G1、2G2を覆う層間絶縁膜、ロードトランジスタLTR1、LTR2およびキャパシタC1、C2(図3参照)等が形成されて、SRAMメモリセルSMCを備えた半導体装置の主要部分が完成する。
Claims (8)
- 半導体基板と、
前記半導体基板上に形成され、第1間隔を隔てられてそれぞれ第1方向に延在する第1配線部および第2配線部と、
前記第1配線部および前記第2配線部より上方に形成され、第2間隔を隔てられてそれぞれ前記第1方向と交差する第2方向に延在する第3配線部および第4配線部と、
前記第3配線部および前記第4配線部の上方から、前記第3配線部と前記第4配線部との間および前記第1配線部と前記第2配線部との間を経て、前記半導体基板に達するように形成されたコンタクトプラグと
を備え、
前記コンタクトプラグでは、前記第3配線部と前記第4配線部との間に位置する部分から、前記第3配線部および前記第4配線部の少なくとも一方の配線部の直上に向かってオーバーハングしているとともに、前記第1配線部と前記第2配線部との間に位置する部分から、前記第1配線部および前記第2配線部の少なくとも一方の配線部の直上に向かってオーバーハングしている、半導体装置。 - 前記コンタクトプラグは、
前記半導体基板に接触する下部コンタクトプラグと、
前記下部コンタクトプラグに接触する上部コンタクトプラグと
を含み、
前記下部コンタクトプラグは、前記第1配線部および前記第2配線部よりも低く形成された、請求項1記載の半導体装置。 - 前記コンタクトプラグの側面を覆う絶縁性の保護膜を備えた、請求項1または2に記載の半導体装置。
- アクセストランジスタ、ドライブトランジスタおよびロードトランジスタを含むスタティック・ランダム・アクセス・メモリセルを備え、
前記第1配線部は、前記アクセストランジスタのゲート電極を含み、
前記第2配線部は、前記ドライブトランジスタのゲート電極を含み、
前記第3配線部は、前記スタティック・ランダム・アクセス・メモリセルに電気的に接続されるビット線を含み、
前記第4配線部は、前記スタティック・ランダム・アクセス・メモリセルに電気的に接続される接地配線を含み、
前記第1配線部と前記第2配線部との間に位置する前記半導体基板の領域に、前記アクセストランジスタのソース領域および前記ドライブトランジスタのドレイン領域が形成され、
前記ソース領域および前記ドレイン領域は、前記コンタクトプラグを介して前記ロードトランジスタに電気的に接続された、請求項1〜3のいずれかに記載の半導体装置。 - 半導体基板と、
前記半導体基板上に形成され、第1間隔を隔てられてそれぞれ第1方向に延在する第1配線部および第2配線部と、
前記第1配線部および前記第2配線部を覆うように形成された第1層間絶縁膜と、
前記第1層間絶縁膜上に形成され、第2間隔を隔てられてそれぞれ前記第1方向と交差する第2方向に延在する第3配線部および第4配線部と、
前記第3配線部および前記第4配線部を覆うように形成された第2層間絶縁膜と、
前記第3配線部と前記第4配線部との間および前記第1配線部と前記第2配線部との間を貫いて、前記半導体基板に達するように形成されたコンタクトプラグと、
を備え、
前記第1配線部、前記第2配線部、前記第3配線部および前記第4配線部のそれぞれは、
配線としての導電体部と、
前記導電体部の側方と上方とから前記導電体部を覆う被覆絶縁膜と
を含み、
前記コンタクトプラグは、前記第3配線部および前記第4配線部と前記第1配線部および前記第2配線部とに対して前記第2層間絶縁膜および前記第1層間絶縁膜に自己整合的に形成されたコンタクトホール内に形成された、半導体装置。 - 半導体基板上に、第1間隔を隔てられてそれぞれ第1方向に延在する第1配線部および第2配線部を形成する工程と、
前記第1配線部および前記第2配線部を覆うように第1層間絶縁膜を形成する工程と、
前記第1層間絶縁膜上に、第2間隔を隔てられてそれぞれ前記第1方向と交差する第2方向に延在する第3配線部および第4配線部を形成する工程と、
前記第3配線部および前記第4配線部を覆うように第2層間絶縁膜を形成する工程と、
前記第2層間絶縁膜および前記第1層間絶縁膜を貫通して前記半導体基板に達するコンタクトプラグを形成する工程と
を備え、
前記第1配線部、前記第2配線部、前記第3配線部および前記第4配線部のそれぞれを形成する工程は、
配線としての導電体部を形成する工程と、
前記導電体部の側方と上方とから前記導電体部を覆う被覆絶縁膜を形成する工程と
を含み、
前記第1層間絶縁膜と前記第2層間絶縁膜をそれぞれ形成する工程は、前記第1層間絶縁膜および前記第2層間絶縁膜として、前記被覆絶縁膜とはエッチング特性の異なる膜をそれぞれ形成する工程を含み、
前記コンタクトプラグを形成する工程は、
前記被覆絶縁膜を実質的に残しながら前記第2層間絶縁膜と前記第1層間絶縁膜とにそれぞれエッチング処理を施すことによって、前記第3配線部と前記第4配線部との間および前記第1配線部と前記第2配線部との間に、コンタクトホールを自己整合的に形成する工程と、
前記コンタクトホール内に、前記コンタクトプラグとなる導電性膜を形成する工程と
を備えた、半導体装置の製造方法。 - 前記コンタクトプラグを形成する工程は、
前記被覆絶縁膜を実質的に残しながら前記第1層間絶縁膜にエッチング処理を施すことによって、前記第1配線部と前記第2配線部との間に、第1コンタクトホールを自己整合的に形成する工程と、
前記第1コンタクトホール内に、前記導電性膜の一部としての第1導電性膜を埋め込む工程と、
前記第1導電性膜にエッチング処理を施して、前記第1導電性膜の上面を、前記第1配線部および前記第2配線部よりも低くすることによって、第1コンタクトプラグを形成する工程と、
前記第1コンタクトホール内に、前記第1コンタクトプラグを覆うように、前記第1層間絶縁膜の一部としての埋め込み絶縁膜を形成する工程と、
前記被覆絶縁膜を実質的に残しながら、前記第2層間絶縁膜および前記埋め込み絶縁膜にエッチング処理を施すことによって、前記第3配線部と前記第4配線部との間および前記第1配線部と前記第2配線部との間に、前記第1コンタクトプラグを露出する第2コンタクトホールを自己整合的に形成する工程と、
前記第1コンタクトプラグに接触するように、前記第2コンタクトホール内に前記導電性膜の他の一部としての第2導電性膜を形成することにより、第2コンタクトプラグを形成する工程と
を含む、請求項6記載の半導体装置の製造方法。 - 前記コンタクトホールを形成した後、前記コンタクトプラグを形成する前に、前記コンタクトホールの側壁面に絶縁性の保護膜を形成する工程を備えた、請求項6または7に記載の半導体装置の製造方法。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013191924A JP6199670B2 (ja) | 2013-09-17 | 2013-09-17 | 半導体装置およびその製造方法 |
US14/459,478 US9368504B2 (en) | 2013-09-17 | 2014-08-14 | Semiconductor device and manufacturing method thereof |
CN201410474809.8A CN104465660B (zh) | 2013-09-17 | 2014-09-17 | 半导体器件及其制造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2013191924A JP6199670B2 (ja) | 2013-09-17 | 2013-09-17 | 半導体装置およびその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2015060863A true JP2015060863A (ja) | 2015-03-30 |
JP6199670B2 JP6199670B2 (ja) | 2017-09-20 |
Family
ID=52667219
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2013191924A Active JP6199670B2 (ja) | 2013-09-17 | 2013-09-17 | 半導体装置およびその製造方法 |
Country Status (3)
Country | Link |
---|---|
US (1) | US9368504B2 (ja) |
JP (1) | JP6199670B2 (ja) |
CN (1) | CN104465660B (ja) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10163649B2 (en) * | 2015-12-17 | 2018-12-25 | Taiwan Semiconductor Manufacturing Company, Ltd. | Semiconductor structure and manufacturing method thereof |
US10411022B1 (en) | 2018-06-14 | 2019-09-10 | Taiwan Semiconductor Manufacturing Co., Ltd. | SRAM structure |
US20230106517A1 (en) * | 2021-10-04 | 2023-04-06 | Invention And Collaboration Laboratory Pte. Ltd. | Sram cell structure |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2002110647A (ja) * | 2000-09-29 | 2002-04-12 | Hitachi Ltd | 半導体集積回路装置の製造方法 |
JP2004228580A (ja) * | 2003-01-22 | 2004-08-12 | Samsung Electronics Co Ltd | 半導体装置及びその製造方法 |
US20050224854A1 (en) * | 2003-05-26 | 2005-10-13 | Samsung Electronics Co., Ltd. | Semiconductor memory device and method of manufacturing the same |
JP2009016596A (ja) * | 2007-07-05 | 2009-01-22 | Elpida Memory Inc | 半導体装置及び半導体装置の製造方法 |
JP2013016581A (ja) * | 2011-07-01 | 2013-01-24 | Renesas Electronics Corp | 半導体装置およびその製造方法 |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3403231B2 (ja) * | 1993-05-12 | 2003-05-06 | 三菱電機株式会社 | 半導体装置およびその製造方法 |
JP2004079696A (ja) | 2002-08-14 | 2004-03-11 | Renesas Technology Corp | 半導体記憶装置 |
KR100505667B1 (ko) * | 2003-01-16 | 2005-08-03 | 삼성전자주식회사 | 스토리지 전극과 접촉하기 위해 비트 라인 방향으로확장된 콘택체를 포함하는 반도체 소자 제조 방법 |
JP2010118597A (ja) * | 2008-11-14 | 2010-05-27 | Nec Electronics Corp | 半導体装置 |
-
2013
- 2013-09-17 JP JP2013191924A patent/JP6199670B2/ja active Active
-
2014
- 2014-08-14 US US14/459,478 patent/US9368504B2/en active Active
- 2014-09-17 CN CN201410474809.8A patent/CN104465660B/zh active Active
Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2002110647A (ja) * | 2000-09-29 | 2002-04-12 | Hitachi Ltd | 半導体集積回路装置の製造方法 |
JP2004228580A (ja) * | 2003-01-22 | 2004-08-12 | Samsung Electronics Co Ltd | 半導体装置及びその製造方法 |
US20050224854A1 (en) * | 2003-05-26 | 2005-10-13 | Samsung Electronics Co., Ltd. | Semiconductor memory device and method of manufacturing the same |
JP2009016596A (ja) * | 2007-07-05 | 2009-01-22 | Elpida Memory Inc | 半導体装置及び半導体装置の製造方法 |
JP2013016581A (ja) * | 2011-07-01 | 2013-01-24 | Renesas Electronics Corp | 半導体装置およびその製造方法 |
Also Published As
Publication number | Publication date |
---|---|
US9368504B2 (en) | 2016-06-14 |
US20150076619A1 (en) | 2015-03-19 |
JP6199670B2 (ja) | 2017-09-20 |
CN104465660B (zh) | 2019-02-19 |
CN104465660A (zh) | 2015-03-25 |
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