JP2014026457A - ボルテージレギュレータ - Google Patents
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Abstract
【解決手段】過電流保護回路は、ゲートが誤差増幅回路の出力端子と接続され、ドレインがセンス抵抗に接続された第一のセンストランジスタと、ゲートが誤差増幅回路の出力端子と接続された第二のセンストランジスタと、ゲートが制御回路の出力端子と接続され、ソースが前記第二のセンストランジスタのドレインと接続され、ドレインがセンス抵抗に接続された制御トランジスタと、を備え、制御トランジスタは、基準電圧が所定の電圧を超えるまで制御回路が出力する検出信号を受けてオンする、構成とした。
【選択図】図1
Description
従来のボルテージレギュレータは、出力トランジスタM1、ONOFF回路11、カウンタ回路12、基準電圧回路である定電流源Q1と抵抗R3、誤差増幅回路A1、短絡電流制限回路MB、出力電流制限回路MA、スイッチ13、トランジスタM2、M3を備える。
また、誤差増幅回路の差動対をなすトランジスタと同じ構成のトランジスタを使用することによって、製造バラツキを抑制できる。
本実施形態のボルテージレギュレータは、誤差増幅回路1と、制御回路2と、過電流保護回路3と、基準電圧回路4と、出力トランジスタ5と、分圧抵抗6と、を備えている。
誤差増幅回路1は、基準電圧回路4が出力する基準電圧Vrefと分圧抵抗6が出力する帰還電圧Vfbを入力し、その差を増幅して、制御電圧として出力端子から出力する。
出力トランジスタ5は、ボルテージレギュレータの出力端子の電圧が一定になるように、誤差増幅回路1の出力する制御電圧でゲートを制御される。過電流保護回路3は、誤差増幅回路1の出力する制御電圧を監視し、ボルテージレギュレータの出力端子に過電流が流れたことを検出すると、出力トランジスタ5のゲート電圧を高くして、出力電流が小さくなるように制御する。
電源投入時、出力トランジスタ5はオフしているので、ボルテージレギュレータの出力端子の電圧Voutは接地電圧に等しい。即ち、帰還電圧Vfbは接地電圧に等しい。そして、基準電圧VrefがトランジスタM12の閾値電圧を越えると、誤差増幅回路1の出力する制御電圧はロウレベルになって、出力トランジスタ5はオンする。この時、出力トランジスタ5は急峻にオンするので、ボルテージレギュレータの出力端子に突入電流が発生する。
2 制御回路
3 過電流保護回路
Claims (3)
- 制御電圧に応じた電流を出力端子に出力する出力トランジスタと、
基準電圧回路から出力される基準電圧と前記出力端子の出力電圧を抵抗分圧した分圧電圧とを比較し、前記出力トランジスタへ前記制御電圧を出力する誤差増幅回路と、
前記出力トランジスタが出力する出力電流が所定の電流制限値に達した時、前記出力トランジスタへ制御信号を出力する過電流保護回路と、
前記基準電圧が所定の電圧を超えるまで、前記過電流保護回路に検出信号を出力する制御回路と、を備え、
前記過電流保護回路は、
ゲートが前記誤差増幅回路の出力端子と接続され、ドレインがセンス抵抗に接続された第一のセンストランジスタと、
ゲートが前記誤差増幅回路の出力端子と接続された第二のセンストランジスタと、
ゲートが前記制御回路の出力端子と接続され、ソースが前記第二のセンストランジスタのドレインと接続され、ドレインが前記センス抵抗に接続された制御トランジスタと、を備え、
前記制御トランジスタは、前記制御回路が出力する前記検出信号を受けてオンする、ことを特徴とするボルテージレギュレータ。 - 前記制御回路は、
ソースが接地され、ゲートが前記基準電圧回路の出力端子に接続されたトランジスタと、
一端が電源電圧に接続され、他端が前記トランジスタのドレインと接続された抵抗素子と、
入力端子が前記トランジスタと前記抵抗素子の接続ノードと接続されたインバータと、を備え、
前記トランジスタの閾値電圧は、前記誤差増幅回路の差動対をなす前記基準電圧回路の出力端子に接続されたトランジスタの閾値電圧より高い、ことを特徴とする請求項1に記載のボルテージレギュレータ。 - 前記過電流保護回路は、垂下型の過電流保護回路、またはフの字型の過電流保護回路、または垂下型の過電流保護回路とフの字型の過電流保護回路である、ことを特徴とする請求項1または2に記載のボルテージレギュレータ。
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