JP2013125891A - Photoelectric conversion element and manufacturing method of the same - Google Patents
Photoelectric conversion element and manufacturing method of the same Download PDFInfo
- Publication number
- JP2013125891A JP2013125891A JP2011274370A JP2011274370A JP2013125891A JP 2013125891 A JP2013125891 A JP 2013125891A JP 2011274370 A JP2011274370 A JP 2011274370A JP 2011274370 A JP2011274370 A JP 2011274370A JP 2013125891 A JP2013125891 A JP 2013125891A
- Authority
- JP
- Japan
- Prior art keywords
- type
- type amorphous
- films
- film
- photoelectric conversion
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Images
Classifications
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02E—REDUCTION OF GREENHOUSE GAS [GHG] EMISSIONS, RELATED TO ENERGY GENERATION, TRANSMISSION OR DISTRIBUTION
- Y02E10/00—Energy generation through renewable energy sources
- Y02E10/50—Photovoltaic [PV] energy
Landscapes
- Photovoltaic Devices (AREA)
Abstract
Description
この発明は、光電変換素子およびその製造方法に関するものである。 The present invention relates to a photoelectric conversion element and a manufacturing method thereof.
バックコンタクト型太陽電池は、従来、受光面側にあったpn接合および電極を裏面側に形成することで、受光面側の電極による影を無くし、太陽光をより吸収させることで、高効率を得る太陽電池である。 The back contact solar cell has a high efficiency by forming a pn junction and an electrode on the light receiving surface side on the back surface, thereby eliminating shadows from the electrode on the light receiving surface side and absorbing more sunlight. Solar cell to get.
そして、この太陽電池においては、pn接合は、熱拡散によって形成されている(特許文献1)。 In this solar cell, the pn junction is formed by thermal diffusion (Patent Document 1).
また、熱拡散以外の方法によって、pn接合を裏面に形成した太陽電池も提案されている(特許文献2)。この太陽電池は、半導体基板の裏面にi型アモルファスシリコン(a−Si)およびn型a−Siを順次積層し、その積層したi型a−Siおよびn型a−Siの一部分を除去し、その除去した一部分にi型a−Siおよびp型a−Siを順次積層した構造からなる。そして、この太陽電池においては、p型a−Siは、i型a−Siによってn型a−Siから分離されている。 A solar cell in which a pn junction is formed on the back surface by a method other than thermal diffusion has also been proposed (Patent Document 2). In this solar cell, i-type amorphous silicon (a-Si) and n-type a-Si are sequentially laminated on the back surface of the semiconductor substrate, and a part of the laminated i-type a-Si and n-type a-Si is removed. The removed part has a structure in which i-type a-Si and p-type a-Si are sequentially laminated. In this solar cell, p-type a-Si is separated from n-type a-Si by i-type a-Si.
しかし、特許文献2に記載された太陽電池においては、p型a−Siとn型a−Siとの分離は、i型a−Siによって行われ、i型a−Siの膜厚が非常に薄いため、絶縁性が低いという問題がある。
However, in the solar cell described in
そこで、この発明の実施の形態によれば、絶縁性を向上可能な光電変換素子を提供する。 Therefore, according to the embodiment of the present invention, a photoelectric conversion element capable of improving insulation is provided.
また、この発明の実施の形態によれば、絶縁性を向上可能な光電変換素子の製造方法を提供する。 Moreover, according to this Embodiment, the manufacturing method of the photoelectric conversion element which can improve insulation is provided.
この発明の実施の形態によれば、光電変換素子は、半導体基板と、第1および第2の非晶質膜と、半導体薄膜とを備える。半導体基板は、第1の導電型を有する単結晶シリコンからなる。第1の非晶質膜は、半導体基板の一方の表面側に設けられ、第1の導電型と反対の第2の導電型を有する。第2の非晶質膜は、半導体基板の面内方向において第1の非晶質膜に隣接して半導体基板の一方の表面側に設けられ、第1の導電型を有する。半導体薄膜は、第1の非晶質膜と第2の非晶質膜との間に設けられ、第1および第2の非晶質膜の両方よりも大きい光学バンドギャップを有する。 According to the embodiment of the present invention, the photoelectric conversion element includes a semiconductor substrate, first and second amorphous films, and a semiconductor thin film. The semiconductor substrate is made of single crystal silicon having the first conductivity type. The first amorphous film is provided on one surface side of the semiconductor substrate and has a second conductivity type opposite to the first conductivity type. The second amorphous film is provided on one surface side of the semiconductor substrate adjacent to the first amorphous film in the in-plane direction of the semiconductor substrate, and has the first conductivity type. The semiconductor thin film is provided between the first amorphous film and the second amorphous film, and has a larger optical band gap than both the first and second amorphous films.
また、この発明の実施の形態によれば、光電変換素子の製造方法は、第1の導電型を有する単結晶シリコンからなる半導体基板の一方の表面上に第1の導電型と反対の第2の導電型を有する第1の非晶質膜を堆積する第1の工程と、半導体基板の面内方向における第1の非晶質膜の両端部を覆うように半導体薄膜を形成する第2の工程と、半導体基板の面内方向において第1の非晶質膜に隣接して半導体薄膜および半導体基板の一方の表面上に第1の導電型を有する第2の非晶質膜を堆積する第3の工程とを備え、半導体薄膜は、第1および第2の非晶質膜の両方よりも大きい光学バンドギャップを有する。 In addition, according to the embodiment of the present invention, a method for manufacturing a photoelectric conversion element includes a second opposite to the first conductivity type on one surface of a semiconductor substrate made of single crystal silicon having the first conductivity type. And a second step of forming a semiconductor thin film so as to cover both ends of the first amorphous film in the in-plane direction of the semiconductor substrate. A step of depositing a semiconductor thin film and a second amorphous film having a first conductivity type on one surface of the semiconductor substrate adjacent to the first amorphous film in an in-plane direction of the semiconductor substrate; The semiconductor thin film has an optical band gap larger than both the first and second amorphous films.
この発明の実施の形態による光電変換素子においては、第1および第2の非晶質膜よりも大きい光学バンドギャップを有する半導体薄膜が第1の非晶質膜と第2の非晶質膜との間に設けられる。その結果、キャリアが第1の非晶質膜と第2の非晶質膜との間を流れ難くなる。 In the photoelectric conversion element according to the embodiment of the present invention, the semiconductor thin film having an optical band gap larger than that of the first and second amorphous films includes the first amorphous film and the second amorphous film. Between. As a result, it becomes difficult for carriers to flow between the first amorphous film and the second amorphous film.
従って、絶縁性を向上できる。 Therefore, insulation can be improved.
また、この発明の実施の形態による光電変換素子の製造方法においては、第1の非晶質膜の両端部を覆うように半導体薄膜を形成し、半導体薄膜上に第2の非晶質膜を堆積する。その結果、第2の非晶質膜が第1の非晶質膜に接することはなく、キャリアが第1の非晶質膜と第2の非晶質膜との間を流れ難くなる。 In the method of manufacturing a photoelectric conversion element according to the embodiment of the present invention, a semiconductor thin film is formed so as to cover both ends of the first amorphous film, and the second amorphous film is formed on the semiconductor thin film. accumulate. As a result, the second amorphous film does not come into contact with the first amorphous film, and carriers hardly flow between the first amorphous film and the second amorphous film.
従って、絶縁性を向上できる。 Therefore, insulation can be improved.
本発明の実施の形態について図面を参照しながら詳細に説明する。なお、図中同一または相当部分には同一符号を付してその説明は繰返さない。 Embodiments of the present invention will be described in detail with reference to the drawings. In the drawings, the same or corresponding parts are denoted by the same reference numerals and description thereof will not be repeated.
この明細書において、「非晶質相」とは、シリコン(Si)原子等がランダムに配列された状態を言う。また、アモルファスシリコンを「a−Si」と表記するが、この表記は、実際には、水素(H)原子が含まれていることを意味する。アモルファスシリコンカーバイド(a−SiC)、アモルファスシリコンオキサイド(a−SiO)、アモルファスシリコンナイトライド(a−SiN)、アモルファスシリコンカーボンナイトライド(a−SiCN)、アモルファスシリコンゲルマニウム(a−SiGe)およびアモルファスゲルマニウム(a−Ge)についても、同様に、H原子が含まれていることを意味する。 In this specification, the “amorphous phase” refers to a state in which silicon (Si) atoms and the like are randomly arranged. Moreover, although amorphous silicon is described as “a-Si”, this notation actually means that hydrogen (H) atoms are included. Amorphous silicon carbide (a-SiC), amorphous silicon oxide (a-SiO), amorphous silicon nitride (a-SiN), amorphous silicon carbon nitride (a-SiCN), amorphous silicon germanium (a-SiGe) and amorphous germanium Similarly, (a-Ge) means that an H atom is contained.
[実施の形態1]
図1は、この発明の実施の形態1による光電変換素子の構成を示す断面図である。図1を参照して、この発明の実施の形態1による光電変換素子100は、n型単結晶シリコン基板1と、パッシベーション膜2と、p型非晶質膜11〜1m(mは2以上の整数)と、n型非晶質膜21〜2m−1と、半導体薄膜31〜3n(nはn=2(m−1)を満たす整数)と、電極41〜4m,51〜5m−1とを備える。
[Embodiment 1]
1 is a cross-sectional view showing a configuration of a photoelectric conversion element according to
n型単結晶シリコン基板1は、例えば、(100)の面方位および0.1〜1.0Ω・cmの比抵抗を有する。また、n型単結晶シリコン基板1は、例えば、100〜300μmの厚みを有し、好ましくは、100〜200μmの厚みを有する。
The n-type single
パッシベーション膜2は、例えば、二酸化シリコン(SiO2)からなり、n型単結晶シリコン基板1の光入射側の表面に接して設けられる。そして、パッシベーション膜2は、例えば、100nmの膜厚を有する。
The
p型非晶質膜11〜1mの各々は、非晶質相からなり、n型単結晶シリコン基板1の光入射側と反対側の表面に接して設けられる。そして、p型非晶質膜11〜1mの各々は、例えば、p型a−Siからなり、膜厚は、例えば、10nmである。また、p型非晶質膜11〜1mは、n型単結晶シリコン基板1の面内方向において所望の間隔で配置される。更に、p型非晶質膜11〜1mの各々におけるボロン(B)濃度は、例えば、5×1019cm−3である。
Each of p-type
n型非晶質膜21〜2m−1は、非晶質相からなり、それぞれ、p型非晶質膜11,12間、p型非晶質膜12,13間、・・・、およびp型非晶質膜1m−1,1m間において、半導体薄膜31,32;33,34;・・・;3n−1,3nに接して配置される。そして、n型非晶質膜21〜2m−1の各々は、例えば、n型a−Siからなり、膜厚は、例えば、10nmである。また、n型非晶質膜21〜2m−1の各々におけるリン(P)濃度は、例えば、5×1019cm−3である。
The n-type
半導体薄膜31〜3nの各々は、例えば、i型a−SiCからなる。また、半導体薄膜31〜3nの各々は、例えば、数十nm以上の膜厚を有し、一般的には、キャリア(電子および正孔)がトンネルできない膜厚を有する。そして、半導体薄膜31は、p型非晶質膜11、n型非晶質膜21およびn型単結晶シリコン基板1に接して配置され、半導体薄膜32,33は、p型非晶質膜12、n型非晶質膜21,22およびn型単結晶シリコン基板1に接して配置され、半導体薄膜34,35は、p型非晶質膜13、n型非晶質膜22,23およびn型単結晶シリコン基板1に接して配置され、以下、同様にして、半導体薄膜3n−2,3n−1は、p型非晶質膜1m−1、n型非晶質膜2m−2,2m−1およびn型単結晶シリコン基板1に接して配置され、半導体薄膜3nは、p型非晶質膜1m、n型非晶質膜2m−1およびn型単結晶シリコン基板1に接して配置される。
Each of the semiconductor
電極41〜4mは、それぞれ、p型非晶質膜11〜1mに接して設けられる。電極51〜5m−1は、それぞれ、n型非晶質膜21〜2m−1に接して設けられる。そして、電極41〜4m,51〜5m−1の各々は、例えば、銀(Ag)からなる。
The
p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1は、図1の紙面に垂直な方向において同じ長さを有する。そして、p型非晶質膜11〜1mの全体の面積がn型単結晶シリコン基板1の面積に占める割合である面積占有率は、60〜93%であり、n型非晶質膜21〜2m−1の全体の面積がn型単結晶シリコン基板1の面積に占める割合である面積占有率は、5〜20%である。
The p-type amorphous films 11-1m and the n-type amorphous films 21-2m-1 have the same length in the direction perpendicular to the paper surface of FIG. The area occupation ratio, which is the ratio of the entire area of the p-type
このように、p型非晶質膜11〜1mの面積占有率をn型非晶質膜21〜2m−1の面積占有率よりも大きくするのは、n型単結晶シリコン基板1中で光励起された電子および正孔がpn接合(p型非晶質膜11〜1m/n型単結晶シリコン基板1)によって分離され易くし、光励起された電子および正孔の発電への寄与率を高くするためである。
As described above, the area occupancy of the p-type
図2〜図4は、それぞれ、図1に示す光電変換素子100の製造方法を示す第1〜第3の工程図である。
2-4 is a 1st-3rd process drawing which respectively shows the manufacturing method of the
光電変換素子100の製造方法について説明する。光電変換素子100は、プラズマ装置を主に用いてプラズマCVD法によって製造される。
A method for manufacturing the
プラズマ装置は、仕込室と、反応室CB1〜CB3と、取出室と、整合器と、RF電源とを備える。仕込室、反応室CB1〜CB3および取出室は、直列に配置されている。そして、仕込室と反応室CB1との間、反応室CB1と反応室CB2との間、反応室CB2と反応室CB3との間、および反応室CB3と取出室との間は、仕切バルブで仕切られている。また、仕込室から反応室CB1、反応室CB2、反応室CB3および取出室へ単結晶シリコン基板を順次搬送する搬送機構がプラズマ装置に備えられている。 The plasma apparatus includes a preparation chamber, reaction chambers CB1 to CB3, an extraction chamber, a matching unit, and an RF power source. The charging chamber, the reaction chambers CB1 to CB3, and the take-out chamber are arranged in series. A partition valve is used to partition between the charging chamber and the reaction chamber CB1, between the reaction chamber CB1 and the reaction chamber CB2, between the reaction chamber CB2 and the reaction chamber CB3, and between the reaction chamber CB3 and the take-out chamber. It has been. Further, the plasma apparatus is provided with a transport mechanism for sequentially transporting the single crystal silicon substrate from the preparation chamber to the reaction chamber CB1, the reaction chamber CB2, the reaction chamber CB3, and the take-out chamber.
仕込室は、加熱機構と排気機構とを備える。加熱機構は、単結晶シリコン基板を所定の温度に昇温する。排気機構は、仕込室内のガスを排気し、仕込室の到達圧力を、例えば、1×10−5Pa以下に設定する。 The charging chamber includes a heating mechanism and an exhaust mechanism. The heating mechanism raises the temperature of the single crystal silicon substrate to a predetermined temperature. The exhaust mechanism exhausts the gas in the preparation chamber, and sets the ultimate pressure in the preparation chamber to, for example, 1 × 10 −5 Pa or less.
反応室CB1〜CB3の各々は、平行平板電極と、加熱機構と、排気機構とを備える。加熱機構は、単結晶シリコン基板を所定の温度に昇温する。排気機構は、反応室CB1〜CB3内のガスを排気し、反応室CB1〜CB3の到達圧力を、例えば、1×10−5Pa以下に設定する。平行平板電極は、整合器を介してRF電源に接続される。なお、反応室CB1は、p型a−Siを堆積するための反応室であり、反応室CB2は、i型a−SiCを堆積するための反応室であり、反応室CB3は、n型a−Siを堆積するための反応室である。 Each of the reaction chambers CB1 to CB3 includes a parallel plate electrode, a heating mechanism, and an exhaust mechanism. The heating mechanism raises the temperature of the single crystal silicon substrate to a predetermined temperature. The exhaust mechanism exhausts the gases in the reaction chambers CB1 to CB3, and sets the ultimate pressure in the reaction chambers CB1 to CB3 to, for example, 1 × 10 −5 Pa or less. The parallel plate electrodes are connected to an RF power source through a matching unit. The reaction chamber CB1 is a reaction chamber for depositing p-type a-Si, the reaction chamber CB2 is a reaction chamber for depositing i-type a-SiC, and the reaction chamber CB3 is an n-type a-a. A reaction chamber for depositing Si.
取出室は、排気機構を備える。排気機構は、取出室内のガスを排気し、取出室の到達圧力を、例えば、1×10−5Pa以下に設定する。 The take-out chamber includes an exhaust mechanism. The exhaust mechanism exhausts the gas in the extraction chamber and sets the ultimate pressure in the extraction chamber to, for example, 1 × 10 −5 Pa or less.
仕込室、反応室CB1〜CB3および取出室の各排気機構は、ターボ分子ポンプ、メカニカルブースタポンプおよびロータリーポンプからなる。ターボ分子ポンプ、メカニカルブースタポンプおよびロータリーポンプは、ターボ分子ポンプが仕込室、反応室CB1〜CB3および取出室に最も近くなるように、それぞれ、仕込室、反応室CB1〜CB3および取出室に直列的に連結されている。そして、各排気機構は、ターボ分子ポンプ、メカニカルブースタポンプおよびロータリーポンプによって、それぞれ、仕込室、反応室CB1〜CB3および取出室内のガスを排気し、またはメカニカルブースタポンプおよびロータリーポンプによって、それぞれ、仕込室、反応室CB1〜CB3および取出室内のガスを排気する。 Each exhaust mechanism of the charging chamber, the reaction chambers CB1 to CB3, and the take-out chamber includes a turbo molecular pump, a mechanical booster pump, and a rotary pump. The turbo molecular pump, the mechanical booster pump and the rotary pump are serially connected to the charging chamber, the reaction chambers CB1 to CB3 and the extraction chamber, respectively, so that the turbo molecular pump is closest to the charging chamber, the reaction chambers CB1 to CB3 and the extraction chamber. It is connected to. Each exhaust mechanism exhausts the gas in the charging chamber, reaction chambers CB1 to CB3, and the extraction chamber with a turbo molecular pump, a mechanical booster pump, and a rotary pump, respectively, or is charged with a mechanical booster pump and a rotary pump, respectively. The gases in the chamber, reaction chambers CB1 to CB3 and the extraction chamber are exhausted.
RF電源は、例えば、13.56MHzのRF電力を整合器を介して反応室CB1〜CB3の平行平板電極に印加する。 The RF power source applies, for example, RF power of 13.56 MHz to the parallel plate electrodes of the reaction chambers CB1 to CB3 via the matching unit.
光電変換素子100の製造が開始されると、n型単結晶シリコン基板1をエタノール等で超音波洗浄して脱脂し、その後、n型単結晶シリコン基板1をフッ酸中に浸漬してn型単結晶シリコン基板1の表面に形成された自然酸化膜を除去するとともに、n型単結晶シリコン基板1の表面を水素で終端する(図2の工程(a)参照)。
When the manufacture of the
n型単結晶シリコン基板1の洗浄が終了すると、n型単結晶シリコン基板1を酸化炉に入れ、1000℃の温度で酸素雰囲気中でn型単結晶シリコン基板1を熱酸化する。この場合、酸化時間は、例えば、30分である。そして、n型単結晶シリコン基板1の片側の表面および端面に形成されたSiO2をフッ酸によって除去し、n型単結晶シリコン基板1の一方の表面にSiO2からなるパッシベーション膜2を形成する(図2の工程(b)参照)。
When the cleaning of the n-type single
そして、n型単結晶シリコン基板1/パッシベーション膜2をプラズマ装置の仕込室の基板ホルダー上に配置する。
Then, the n-type single
そして、仕込室の排気機構は、1×10−5Pa以下に仕込室内のガスを排気し、仕込室の加熱機構は、n型単結晶シリコン基板1/パッシベーション膜2の温度を200℃に設定するように基板ホルダーを加熱する。また、反応室CB1〜CB3の加熱機構も、n型単結晶シリコン基板1/パッシベーション膜2の温度を200℃に設定するように基板ホルダーを加熱する。
And the exhaust mechanism of the preparation chamber exhausts the gas in the preparation chamber to 1 × 10 −5 Pa or less, and the heating mechanism of the preparation chamber sets the temperature of the n-type single
n型単結晶シリコン基板1/パッシベーション膜2の温度が200℃に達すると、仕込室と反応室CB1との間の仕切バルブが開けられ、n型単結晶シリコン基板1/パッシベーション膜2は、仕込室から反応室CB1へ搬送される。
When the temperature of the n-type single
p型非晶質膜11〜1m、n型非晶質膜21〜2m−1および半導体薄膜31〜3nを形成するときの材料ガスの流量を表1に示す。
Table 1 shows the flow rates of the material gases when forming the p-type
n型単結晶シリコン基板1/パッシベーション膜2が反応室CB1へ搬送されると、2sccmのシラン(SiH4)ガスと、42sccmの水素(H2)ガスと、水素希釈された12sccmのジボラン(B2H6)ガスとを反応室CB1に流し、反応室CB1の圧力を13.3Pa〜665Paの範囲に設定する。そして、RF電源は、16〜80mW/cm2の範囲のRFパワーを整合器を介して平行平板電極に印加する。これによって、反応室CB1内でプラズマが発生し、p型a−Siからなるp型非晶質膜20がn型単結晶シリコン基板1の表面(=パッシベーション膜2が形成された面と反対側の表面)に堆積される(図2の工程(c)参照)。なお、水素希釈されたB2H6ガスの濃度は、0.1%である。
When the n-type single
p型非晶質膜20の膜厚が10nmになると、反応室CB1の平行平板電極へのRFパワーの印加を停止するとともに、SiH4ガス、H2ガスおよびB2H6ガスの反応室CB1への供給を停止し、排気機構によって1×10−5Pa以下に反応室CB1を真空引きする。そして、仕切バルブを開け、p型非晶質膜20/n型単結晶シリコン基板1/パッシベーション膜2を反応室CB1から取出室へ搬送し、p型非晶質膜20/n型単結晶シリコン基板1/パッシベーション膜2を室温まで冷却した後、取り出す。
When the thickness of the p-type
そして、取り出したp型非晶質膜20/n型単結晶シリコン基板1/パッシベーション膜2のp型非晶質膜20の全面にレジストを塗布し、その塗布したレジストをフォトリソグラフィによってパターンニングしてレジストパターン30を形成する(図2の工程(d)参照)。
Then, a resist is applied to the entire surface of the p-type
その後、レジストパターン30をマスクとしてp型非晶質膜20をドライエッチングまたはウェットエッチングによってエッチングし、p型非晶質膜11〜1mを形成する(図2の工程(e)参照)。
Thereafter, the p-type
p型非晶質膜11〜1mを形成すると、p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2のp型非晶質膜11〜1m側をフッ酸で洗浄し、p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2をプラズマ装置の仕込室の基板ホルダー上に配置する。
When the p-type
そして、仕込室の排気機構は、1×10−5Pa以下に仕込室内のガスを排気し、仕込室の加熱機構は、p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2の温度を200℃に設定するように基板ホルダーを加熱する。
And the exhaust mechanism of the preparation chamber exhausts the gas in the preparation chamber to 1 × 10 −5 Pa or less, and the heating mechanism of the preparation chamber is the p-type
p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2の温度が200℃に達すると、p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2を仕込室から反応室CB2へ搬送する。
When the temperature of the p-type
p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2が反応室CB2へ搬送されると、2sccmのSiH4ガスと、42sccmのH2ガスと、1.6sccmのメタン(CH4)ガスとを反応室CB2に流し(表1参照)、反応室CB2の圧力を13.3Pa〜665Paの範囲に設定する。そして、RF電源は、16〜80mW/cm2の範囲のRFパワーを整合器を介して平行平板電極に印加する。これによって、反応室CB2内でプラズマが発生し、i型a−SiCからなる半導体薄膜40がp型非晶質膜11〜1mおよびn型単結晶シリコン基板1の表面に堆積される(図3の工程(f)参照)。
When the p-type
半導体薄膜40の膜厚が数十nm以上になると、反応室CB2の平行平板電極へのRFパワーの印加を停止するとともに、SiH4ガス、H2ガスおよびCH4ガスの反応室CB2への供給を停止し、排気機構によって1×10−5Pa以下に反応室CB2を真空引きする。そして、仕切バルブを開け、半導体薄膜40/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2を反応室CB2から取出室へ搬送する。そして、半導体薄膜40/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2を室温まで冷却し、取出室から取出す。
When the thickness of the semiconductor
その後、半導体薄膜40/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2の半導体薄膜40上にレジストを塗布し、その塗布したレジストをフォトリソグラフィによってパターンニングしてレジストパターン50を形成する(図3の工程(g)参照)。
Thereafter, a resist is applied on the semiconductor
その後、レジストパターン50をマスクとして半導体薄膜40をドライエッチングまたはウェットエッチングによってエッチングし、半導体薄膜31〜3nを形成する(図3の工程(h)参照)。
Thereafter, the semiconductor
そして、半導体薄膜31〜3n/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2の半導体薄膜31〜3n側をフッ酸で洗浄し、半導体薄膜31〜3n/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2をプラズマ装置の仕込室の基板ホルダー上に配置する。
The semiconductor
その後、仕込室の排気機構は、1×10−5Pa以下に仕込室内のガスを排気し、仕込室の加熱機構は、半導体薄膜31〜3n/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2の温度を200℃に設定するように基板ホルダーを加熱する。
After that, the evacuation mechanism of the preparation chamber exhausts the gas in the preparation chamber to 1 × 10 −5 Pa or less, and the heating mechanism of the preparation chamber is the semiconductor
半導体薄膜31〜3n/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2の温度が200℃に達すると、半導体薄膜31〜3n/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2を仕込室から反応室CB3へ搬送する。
When the temperature of the semiconductor
半導体薄膜31〜3n/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2が反応室CB3へ搬送されると、20sccmのSiH4ガスと、150sccmのH2ガスと、水素希釈された50sccmのフォスフィン(PH3)ガスとを反応室CB3に流し(表1参照)、反応室CB3の圧力を13.3Pa〜665Paの範囲に設定する。そして、RF電源は、16〜80mW/cm2の範囲のRFパワーを整合器を介して平行平板電極に印加する。これによって、反応室CB3内でプラズマが発生し、n型a−Siからなるn型非晶質膜60が半導体薄膜31〜3n、p型非晶質膜11〜1mおよびn型単結晶シリコン基板1の表面に堆積される(図3の工程(i)参照)。なお、水素希釈されたPH3ガスの濃度は、0.2%である。
When the semiconductor
n型非晶質膜60の膜厚が10nmになると、反応室CB3の平行平板電極へのRFパワーの印加を停止するとともに、SiH4ガス、H2ガスおよびPH3ガスの反応室CB3への供給を停止し、排気機構によって1×10−5Pa以下に反応室CB3を真空引きする。そして、仕切バルブを開け、n型非晶質膜60/半導体薄膜31〜3n/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2を反応室CB3から取出室へ搬送する。そして、n型非晶質膜60/半導体薄膜31〜3n/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2を室温まで冷却し、取出室から取出す。
When the thickness of the n-type
その後、n型非晶質膜60/半導体薄膜31〜3n/p型非晶質膜11〜1m/n型単結晶シリコン基板1/パッシベーション膜2のn型非晶質膜60上にレジストを塗布し、その塗布したレジストをフォトリソグラフィによってパターンニングしてレジストパターン70を形成する(図4の工程(j)参照)。
Thereafter, a resist is applied on the n-type
その後、レジストパターン70をマスクとしてn型非晶質膜60をドライエッチングまたはウェットエッチングによってエッチングし、n型非晶質膜21〜2m−1を形成する(図4の工程(k)参照)。
Thereafter, the n-type
引き続いて、n型非晶質膜21〜2m−1およびp型非晶質膜11〜1m側にAgを蒸着し、その蒸着したAgをフォトリソグラフィおよびエッチングによってパターンニングし、電極41〜4m,51〜5m−1を形成する。これによって、光電変換素子100が完成する(図4の工程(l)参照)。
Subsequently, Ag is vapor-deposited on the n-type
光電変換素子100において、太陽光がパッシベーション膜2側から光電変換素子100に照射されると、n型単結晶シリコン基板1中で電子および正孔が光励起される。
In the
光励起された電子および正孔は、パッシベーション膜2側へ拡散しても、パッシベーション膜2によるn型単結晶シリコン基板1のパッシベーション効果によって再結合し難く、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1側へ拡散する。
Even if the photoexcited electrons and holes are diffused to the
そして、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1側へ拡散した電子および正孔は、p型非晶質膜11〜1m/n型単結晶シリコン基板1(=pn接合)による内部電界によって分離され、正孔は、p型非晶質膜11〜1mを介して電極41〜4mへ到達し、電子は、n型非晶質膜21〜2m−1を介して電極51〜5m−1へ到達する。
Then, the electrons and holes diffused toward the p-type
電極51〜5m−1へ到達した電子は、電極41〜4mと電極51〜5m−1との間に接続された負荷を介して電極41〜4mへ到達し、正孔と再結合する。
The electrons that have reached the
このように、光電変換素子100は、n型単結晶シリコン基板1中で光励起された電子および正孔をn型単結晶シリコン基板1の裏面(=パッシベーション膜2が形成されたn型単結晶シリコン基板1の表面と反対側の面)から取り出すバックコンタクト型の光電変換素子である。
As described above, the
そして、光電変換素子100においては、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1は、直接接することはなく、p型非晶質膜11〜1mとn型非晶質膜21〜2m−1との間には、i型a−SiCからなる半導体薄膜31〜3nが存在する。i型a−SiCの光学バンドギャップは、約2.0eVであり、p型非晶質膜11〜1mを構成するp型a−Siの光学バンドギャップは、約1.7eVであり、n型非晶質膜21〜2m−1を構成するn型a−Siの光学バンドギャップも、約1.7eVである。また、p型a−Siは、約1×10−3(Ω・cm)−1の導電率を有し、n型a−Siは、約1×10−2(Ω・cm)−1の導電率を有する。一方、i型a−SiCは、約1×10−12(Ω・cm)−1の導電率を有する。その結果、p型非晶質膜11〜1mとn型非晶質膜21〜2m−1との間には、キャリア(電子および正孔)に対する障壁が存在し、キャリア(電子および正孔)は、i型a−SiCを介してp型非晶質膜11〜1mとn型非晶質膜21〜2m−1との間を流れ難くなる。従って、絶縁性を向上できる。
In the
図5は、実施の形態1による他の光電変換素子の構成を示す断面図である。実施の形態1による光電変換素子は、図5に示す光電変換素子100Aであってもよい。
FIG. 5 is a cross-sectional view showing the configuration of another photoelectric conversion element according to the first embodiment. The photoelectric conversion element according to
図5を参照して、光電変換素子100Aは、図1に示す光電変換素子100にi型非晶質膜61〜6mを追加したものであり、その他は、光電変換素子100と同じである。
Referring to FIG. 5, the
i型非晶質膜61〜6mは、非晶質相からなり、それぞれ、n型単結晶シリコン基板1およびp型非晶質膜11〜1mに接し、n型単結晶シリコン基板1とp型非晶質膜11〜1mとの間に配置される。そして、i型非晶質膜61〜6mの各々は、例えば、i型a−Siからなり、膜厚は、例えば、10nmである。また、i型非晶質膜61〜6mは、n型単結晶シリコン基板1の面内方向(図5の紙面における左右方向)において、それぞれ、p型非晶質膜11〜1mと同じ幅を有する。更に、i型非晶質膜61〜6mは、図5の紙面に垂直な方向において、それぞれ、p型非晶質膜11〜1mと同じ長さを有する。
The i-type amorphous films 61 to 6m are made of an amorphous phase and are in contact with the n-type single
光電変換素子100Aにおいては、n型非晶質膜21〜2m−1の各々の膜厚は、p型非晶質膜11〜1mの膜厚とi型非晶質膜61〜6mの膜厚との合計膜厚からなる。
In the
また、光電変換素子100Aにおいては、半導体薄膜31は、p型非晶質膜11の一部の表面および端面と、i型非晶質膜61の端面と、n型非晶質膜21の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接し、半導体薄膜32,33は、p型非晶質膜12の一部の表面および端面と、i型非晶質膜62の端面と、n型非晶質膜21,22の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接し、半導体薄膜34,35は、p型非晶質膜13の一部の表面および端面と、i型非晶質膜63の端面と、n型非晶質膜22,23の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接する。以下、同様にして、半導体薄膜3n−2,3n−1は、p型非晶質膜1m−1の一部の表面および端面と、i型非晶質膜6m−1の端面と、n型非晶質膜2m−2,2m−1の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接し、半導体薄膜3nは、p型非晶質膜1mの一部の表面および端面と、i型非晶質膜6mの端面と、n型非晶質膜2m−1の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接する。
In the
光電変換素子100Aは、図2〜図4に示す工程(a)〜工程(l)によって製造される。この場合、図2の工程(c)において、i型非晶質膜61〜6m用のi型非晶質膜がプラズマCVD法によってn型単結晶シリコン基板1上に堆積され、その後、p型非晶質膜11〜1m用のp型非晶質膜20がプラズマCVD法によってi型非晶質膜61〜6m用のi型非晶質膜上に堆積される。そして、i型非晶質膜61〜6m用のi型非晶質膜を堆積するときのガス流量は、表1に示すとおりである。
100 A of photoelectric conversion elements are manufactured by the process (a)-process (l) shown in FIGS. In this case, in step (c) of FIG. 2, an i-type amorphous film for the i-type amorphous films 61 to 6m is deposited on the n-type single
光電変換素子100Aにおける発電機構は、光電変換素子100の発電機構と概ね同じであり、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1側へ拡散した電子および正孔は、p型非晶質膜11〜1m/i型非晶質膜61〜6m/n型単結晶シリコン基板1(=pin接合)による内部電界によって分離され、正孔は、i型非晶質膜61〜6mおよびp型非晶質膜11〜1mを介して電極41〜4mへ到達し、電子は、n型非晶質膜21〜2m−1を介して電極51〜5m−1へ到達する。
The power generation mechanism in the
電極51〜5m−1へ到達した電子は、電極41〜4mと電極51〜5m−1との間に接続された負荷を介して電極41〜4mへ到達し、正孔と再結合する。
The electrons that have reached the
このように、光電変換素子100Aは、n型単結晶シリコン基板1中で光励起された電子および正孔をn型単結晶シリコン基板1の裏面(=パッシベーション膜2が形成されたn型単結晶シリコン基板1の表面と反対側の面)から取り出すバックコンタクト型の光電変換素子である。
As described above, the
そして、光電変換素子100Aにおいては、p型非晶質膜11〜1mおよびi型非晶質膜61〜6mとn型非晶質膜21〜2m−1との間には、n型非晶質膜21〜2m−1がp型非晶質膜11〜1mおよびi型非晶質膜61〜6mに接しないように半導体薄膜31〜3nが存在する。従って、光電変換素子100において説明したように、絶縁性を向上できる。
In the
また、光電変換素子100Aにおいては、n型単結晶シリコン基板1とp型非晶質膜11〜1mとの間にi型非晶質膜61〜6mが存在するので、n型単結晶シリコン基板1とp型非晶質膜11〜1mとの界面における正孔の再結合が抑制される。その結果、短絡光電流が増加し、光電変換素子100Aの変換効率を向上できる。
In the
光電変換素子100Aについてのその他の説明は、光電変換素子100についての説明と同じである。
The other description of the
図6は、実施の形態1による更に他の光電変換素子の構成を示す断面図である。実施の形態1による光電変換素子は、図6に示す光電変換素子100Bであってもよい。
FIG. 6 is a cross-sectional view showing a configuration of still another photoelectric conversion element according to
図6を参照して、光電変換素子100Bは、図1に示す光電変換素子100にi型非晶質膜71〜7m−1を追加したものであり、その他は、光電変換素子100と同じである。
Referring to FIG. 6,
i型非晶質膜71〜7m−1は、非晶質相からなり、それぞれ、n型単結晶シリコン基板1およびn型非晶質膜21〜2m−1に接し、n型単結晶シリコン基板1とn型非晶質膜21〜2m−1との間に配置される。そして、i型非晶質膜71〜7m−1の各々は、例えば、i型a−Siからなり、膜厚は、例えば、10nmである。また、i型非晶質膜71〜7m−1は、図6の紙面に垂直な方向において、それぞれ、n型非晶質膜21〜2m−1と同じ長さを有する。
The i-type
光電変換素子100Bにおいては、p型非晶質膜11〜1mの各々の膜厚は、n型非晶質膜21〜2m−1の膜厚とi型非晶質膜71〜7m−1の膜厚との合計膜厚からなる。
In the
また、光電変換素子100Bにおいては、半導体薄膜31は、p型非晶質膜11の一部の表面および端面と、i型非晶質膜71の端面と、n型非晶質膜21の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接し、半導体薄膜32,33は、p型非晶質膜12の一部の表面および端面と、i型非晶質膜71,72の端面と、n型非晶質膜21,22の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接し、半導体薄膜34,35は、p型非晶質膜13の一部の表面および端面と、i型非晶質膜72,73の端面と、n型非晶質膜22,23の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接する。以下、同様にして、半導体薄膜3n−2,3n−1は、p型非晶質膜1m−1の一部の表面および端面と、i型非晶質膜7m−2,7m−1の端面と、n型非晶質膜2m−2,2m−1の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接し、半導体薄膜3nは、p型非晶質膜1mの一部の表面および端面と、i型非晶質膜7m−1の端面と、n型非晶質膜2m−1の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接する。
Further, in the
光電変換素子100Bは、図2〜図4に示す工程(a)〜工程(l)によって製造される。この場合、図3の工程(i)において、i型非晶質膜71〜7m−1用のi型非晶質膜がプラズマCVD法によってp型非晶質膜11〜1m、半導体薄膜31〜3nおよびn型単結晶シリコン基板1上に堆積され、その後、n型非晶質膜60がプラズマCVD法によってi型非晶質膜71〜7m−1用のi型非晶質膜上に堆積される。そして、i型非晶質膜71〜7m−1用のi型非晶質膜を堆積するときのガス流量は、表1に示すi型非晶質膜61〜6mのガス流量と同じである。
The
光電変換素子100Bにおける発電機構は、光電変換素子100の発電機構と概ね同じであり、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1側へ拡散した電子および正孔は、p型非晶質膜11〜1m/n型単結晶シリコン基板1(=pn接合)による内部電界によって分離され、正孔は、p型非晶質膜11〜1mを介して電極41〜4mへ到達し、電子は、i型非晶質膜71〜7m−1およびn型非晶質膜21〜2m−1を介して電極51〜5m−1へ到達する。
The power generation mechanism in the
電極51〜5m−1へ到達した電子は、電極41〜4mと電極51〜5m−1との間に接続された負荷を介して電極41〜4mへ到達し、正孔と再結合する。
The electrons that have reached the
このように、光電変換素子100Bは、n型単結晶シリコン基板1中で光励起された電子および正孔をn型単結晶シリコン基板1の裏面(=パッシベーション膜2が形成されたn型単結晶シリコン基板1の表面と反対側の面)から取り出すバックコンタクト型の光電変換素子である。
As described above, the
そして、光電変換素子100Bにおいては、p型非晶質膜11〜1mとi型非晶質膜71〜7m−1およびn型非晶質膜21〜2m−1との間には、p型非晶質膜11〜1mがi型非晶質膜71〜7m−1およびn型非晶質膜21〜2m−1に接しないように半導体薄膜31〜3nが存在する。従って、光電変換素子100において説明したように、絶縁性を向上できる。
In the
また、光電変換素子100Bにおいては、n型単結晶シリコン基板1とn型非晶質膜21〜2m−1との間にi型非晶質膜71〜7m−1が存在するので、n型単結晶シリコン基板1とn型非晶質膜21〜2m−1との界面における電子の再結合が抑制される。その結果、短絡光電流が増加し、光電変換素子100Bの変換効率を向上できる。
In the
光電変換素子100Bについてのその他の説明は、光電変換素子100についての説明と同じである。
The other description of the
図7は、実施の形態1による更に他の光電変換素子の構成を示す断面図である。実施の形態1による光電変換素子は、図7に示す光電変換素子100Cであってもよい。
FIG. 7 is a cross-sectional view showing a configuration of still another photoelectric conversion element according to the first embodiment. The photoelectric conversion element according to
図7を参照して、光電変換素子100Cは、図1に示す光電変換素子100にi型非晶質膜61〜6m,71〜7m−1を追加したものであり、その他は、光電変換素子100と同じである。
Referring to FIG. 7, a
i型非晶質膜61〜6m,71〜7m−1については、上述したとおりである。 The i-type amorphous films 61-6m and 71-7m-1 are as described above.
光電変換素子100Cにおいては、半導体薄膜31は、p型非晶質膜11の一部の表面および端面と、i型非晶質膜61,71の端面と、n型非晶質膜21の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接し、半導体薄膜32,33は、p型非晶質膜12の一部の表面および端面と、i型非晶質膜62,71,72の端面と、n型非晶質膜21,22の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接し、半導体薄膜34,35は、p型非晶質膜13の一部の表面および端面と、i型非晶質膜63,72,73の端面と、n型非晶質膜22,23の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接する。以下、同様にして、半導体薄膜3n−2,3n−1は、p型非晶質膜1m−1の一部の表面および端面と、i型非晶質膜6m−1,7m−2,7m−1の端面と、n型非晶質膜2m−2,2m−1の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接し、半導体薄膜3nは、p型非晶質膜1mの一部の表面および端面と、i型非晶質膜6m,7m−1の端面と、n型非晶質膜2m−1の表面および端面と、n型単結晶シリコン基板1の一部の表面とに接する。
In the
光電変換素子100Cは、図2〜図4に示す工程(a)〜工程(l)によって製造される。この場合、図2の工程(c)において、i型非晶質膜61〜6m用のi型非晶質膜がプラズマCVD法によってn型単結晶シリコン基板1上に堆積され、その後、p型非晶質膜11〜1m用のp型非晶質膜20がプラズマCVD法によってi型非晶質膜61〜6m用のi型非晶質膜上に堆積される。また、図3の工程(i)において、i型非晶質膜71〜7m−1用のi型非晶質膜がプラズマCVD法によってn型単結晶シリコン基板1、p型非晶質膜11〜1mおよび半導体薄膜31〜3n上に堆積され、その後、n型非晶質膜21〜2m−1用のn型非晶質膜60がプラズマCVD法によってi型非晶質膜71〜7m−1用のi型非晶質膜上に堆積される。そして、i型非晶質膜61〜6m用のi型非晶質膜およびi型非晶質膜71〜7m−1用のi型非晶質膜を堆積するときのガス流量は、同じであり、表1に示すとおりである。
The
光電変換素子100Cにおける発電機構は、光電変換素子100の発電機構と概ね同じであり、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1側へ拡散した電子および正孔は、p型非晶質膜11〜1m/i型非晶質膜61〜6m/n型単結晶シリコン基板1(=pin接合)による内部電界によって分離され、正孔は、i型非晶質膜61〜6mおよびp型非晶質膜11〜1mを介して電極41〜4mへ到達し、電子は、i型非晶質膜71〜7m−1およびn型非晶質膜21〜2m−1を介して電極51〜5m−1へ到達する。
The power generation mechanism in the
電極51〜5m−1へ到達した電子は、電極41〜4mと電極51〜5m−1との間に接続された負荷を介して電極41〜4mへ到達し、正孔と再結合する。
The electrons that have reached the
このように、光電変換素子100Cは、n型単結晶シリコン基板1中で光励起された電子および正孔をn型単結晶シリコン基板1の裏面(=パッシベーション膜2が形成されたn型単結晶シリコン基板1の表面と反対側の面)から取り出すバックコンタクト型の光電変換素子である。
As described above, the
そして、光電変換素子100Cにおいては、i型非晶質膜61〜6mおよびp型非晶質膜11〜1mとi型非晶質膜71〜7m−1およびn型非晶質膜21〜2m−1との間には、i型非晶質膜61〜6mおよびp型非晶質膜11〜1mがi型非晶質膜71〜7m−1およびn型非晶質膜21〜2m−1に接しないように半導体薄膜31〜3nが存在する。従って、光電変換素子100において説明したように絶縁性を向上できる。
In the
また、光電変換素子100Cにおいては、n型単結晶シリコン基板1とp型非晶質膜11〜1mとの間にi型非晶質膜61〜6mが存在するので、n型単結晶シリコン基板1とp型非晶質膜11〜1mとの界面における正孔の再結合が抑制される。更に、光電変換素子100Cにおいては、n型単結晶シリコン基板1とn型非晶質膜21〜2m−1との間にi型非晶質膜71〜7m−1が存在するので、n型単結晶シリコン基板1とn型非晶質膜21〜2m−1との界面における電子の再結合が抑制される。
In the
その結果、短絡光電流が増加し、光電変換素子100Cの変換効率を向上できる。
As a result, the short-circuit photocurrent increases and the conversion efficiency of the
光電変換素子100Cについてのその他の説明は、光電変換素子100についての説明と同じである。
The other description of the
光電変換素子100,100A,100B,100Cにおいては、n型単結晶シリコン基板1の光入射側の表面(=パッシベーション膜2が形成された表面)がテクスチャ構造になっていてもよい。この場合、図2の工程(a)において、n型単結晶シリコン基板1をエタノール等で超音波洗浄した後、n型単結晶シリコン基板1の表面をアルカリを用いて化学的に異方性エッチングし、n型単結晶シリコン基板1の表面をテクスチャ化する。その後、上述したようにフッ酸を用いて自然酸化膜を除去するとともに、n型単結晶シリコン基板1の表面を水素で終端する。
In the
また、光電変換素子100,100A,100B,100Cにおいては、半導体薄膜31〜3nは、i型a−SiCからなると説明したが、実施の形態1においては、これに限らず、半導体薄膜31〜3nは、i型a−SiO,i型a−SiN,i型a−SiCNのいずれかからなっていてもよく、一般的には、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1の両方よりも光学バンドギャップが大きい半導体材料からなっていればよい。この場合、p型非晶質膜11〜1m、n型非晶質膜21〜2m−1および半導体薄膜31〜3nの全てが同じ材料(例えば、a−SiC)からなる場合もあるが、半導体薄膜31〜3nは、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1を構成するa−SiCにおけるカーボン(C)量よりも多いCを含むことによって、半導体薄膜31〜3nの光学バンドギャップは、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1の光学バンドギャップよりも大きく設定される。p型非晶質膜11〜1m、n型非晶質膜21〜2m−1および半導体薄膜31〜3nの全てがa−SiC以外の同じ材料からなる場合も同様である。
In the
更に、光電変換素子100,100A,100B,100Cにおいては、半導体薄膜31〜3nは、i型の導電型を有していなくてもよく、p型非晶質膜11〜1mに含まれるB濃度よりも低いBを含んでいてもよく、n型非晶質膜21〜2m−1に含まれるP濃度よりも低いPを含んでいてもよい。このように、半導体薄膜31〜3n中におけるドーパント濃度がp型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1中におけるドーパント濃度よりも低ければ、半導体薄膜31〜3nの導電率がp型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1の導電率よりも低くなり、キャリア(電子および正孔)がp型非晶質膜11〜1mとn型非晶質膜21〜2m−1との間を流れ難くなるからである。
Furthermore, in the
更に、光電変換素子100,100A,100B,100Cにおいては、半導体薄膜31〜3nは、p型非晶質膜11〜1mおよびn型非晶質膜21〜2m−1の両方よりも大きい光学バンドギャップを有する2種以上の半導体材料を積層した構造からなっていてもよい。そして、半導体薄膜31〜3nが半導体材料Aと半導体材料Bとを積層した構造からなり、半導体材料Aの光学バンドギャップが半導体材料Bの光学バンドギャップよりも大きい場合、半導体薄膜31〜3nを半導体材料A/半導体材料B/半導体材料Aの積層構造によって構成してもよい。このような積層構造であれば、半導体薄膜31〜3n中へキャリアが注入されても、その注入されたキャリアは、半導体材料B中に閉じ込められ、p型非晶質膜11〜1mとn型非晶質膜21〜2m−1との間を流れ難くなるからである。
Furthermore, in the
更に、光電変換素子100,100A,100B,100Cにおいては、p型非晶質膜11〜1mは、p型a−Siからなると説明したが、実施の形態1においては、これに限らず、p型非晶質膜11〜1mは、p型a−SiC、p型a−SiO、p型a−SiN、p型a−SiCN、p型a−SiGeおよびp型a−Geのいずれかからなっていてもよい。
Further, in the
更に、光電変換素子100,100A,100B,100Cにおいては、n型非晶質膜21〜2m−1は、n型a−Siからなると説明したが、実施の形態1においては、これに限らず、n型非晶質膜21〜2m−1は、n型a−SiC、n型a−SiO、n型a−SiN、n型a−SiCN、n型a−SiGeおよびn型a−Geのいずれかからなっていてもよい。
Furthermore, in the
更に、光電変換素子100A,100Cにおいては、i型非晶質膜61〜6mは、i型a−Siからなると説明したが、実施の形態1においては、これに限らず、i型非晶質膜61〜6mは、i型a−SiC、i型a−SiO、i型a−SiN、i型a−SiCNおよびi型a−SiGeのいずれかからなっていてもよい。
Further, in the
更に、光電変換素子100B,100Cにおいては、i型非晶質膜71〜7m−1は、i型a−Siからなると説明したが、実施の形態1においては、これに限らず、i型非晶質膜71〜7m−1は、i型a−SiC、i型a−SiO、i型a−SiN、i型a−SiCNおよびi型a−SiGeのいずれかからなっていてもよい。
Further, in the
即ち、光電変換素子100,100A,100B,100Cにおいては、p型非晶質膜11〜1m、n型非晶質膜21〜2m−1および半導体薄膜31〜3nは、それぞれ、表2に示す材料のいずれかからなっていてもよく、光電変換素子100A,100B,100Cにおいては、i型非晶質膜61〜6mおよび/またはi型非晶質膜71〜7m−1は、それぞれ、表2に示す材料のいずれかからなっていてもよい。
That is, in the
この場合、p型a−SiCは、SiH4ガス、CH4ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。p型a−SiOは、SiH4ガス、酸素(O2)ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。p型a−SiNは、SiH4ガス、NH3ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。p型a−SiCNは、SiH4ガス、CH4ガス、NH3ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。p型a−SiGeは、SiH4ガス、ゲルマン(GeH4)ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。p型a−Geは、GeH4ガス、B2H6ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。 In this case, p-type a-SiC is formed by the above-described plasma CVD method using SiH 4 gas, CH 4 gas, B 2 H 6 gas, and H 2 gas as material gases. The p-type a-SiO is formed by the above-described plasma CVD method using SiH 4 gas, oxygen (O 2 ) gas, B 2 H 6 gas and H 2 gas as material gases. The p-type a-SiN is formed by the above-described plasma CVD method using SiH 4 gas, NH 3 gas, B 2 H 6 gas and H 2 gas as material gases. The p-type a-SiCN is formed by the above-described plasma CVD method using SiH 4 gas, CH 4 gas, NH 3 gas, B 2 H 6 gas and H 2 gas as material gases. The p-type a-SiGe is formed by the above-described plasma CVD method using SiH 4 gas, germane (GeH 4 ) gas, B 2 H 6 gas and H 2 gas as material gases. The p-type a-Ge is formed by the above-described plasma CVD method using GeH 4 gas, B 2 H 6 gas, and H 2 gas as material gases.
また、n型a−SiCは、SiH4ガス、CH4ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。n型a−SiOは、SiH4ガス、O2ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。n型a−SiNは、SiH4ガス、NH3ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。n型a−SiCNは、SiH4ガス、CH4ガス、NH3ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。n型a−SiGeは、SiH4ガス、GeH4ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。n型a−Geは、GeH4ガス、PH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。 The n-type a-SiC is formed by the above-described plasma CVD method using SiH 4 gas, CH 4 gas, PH 3 gas, and H 2 gas as material gases. The n-type a-SiO is formed by the above-described plasma CVD method using SiH 4 gas, O 2 gas, PH 3 gas, and H 2 gas as material gases. The n-type a-SiN is formed by the above-described plasma CVD method using SiH 4 gas, NH 3 gas, PH 3 gas, and H 2 gas as material gases. The n-type a-SiCN is formed by the above-described plasma CVD method using SiH 4 gas, CH 4 gas, NH 3 gas, PH 3 gas, and H 2 gas as material gases. The n-type a-SiGe is formed by the above-described plasma CVD method using SiH 4 gas, GeH 4 gas, PH 3 gas, and H 2 gas as material gases. The n-type a-Ge is formed by the above-described plasma CVD method using GeH 4 gas, PH 3 gas, and H 2 gas as material gases.
更に、i型a−SiCは、SiH4ガス、CH4ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。i型a−SiOは、SiH4ガス、O2ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。i型a−SiNは、SiH4ガス、NH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。i型a−SiCNは、SiH4ガス、CH4ガス、NH3ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。i型a−SiGeは、SiH4ガス、GeH4ガスおよびH2ガスを材料ガスとして、上述したプラズマCVD法によって形成される。 Furthermore, i-type a-SiC is formed by the above-described plasma CVD method using SiH 4 gas, CH 4 gas, and H 2 gas as material gases. i-type a-SiO is formed by the above-described plasma CVD method using SiH 4 gas, O 2 gas, and H 2 gas as material gases. i-type a-SiN is formed by the above-described plasma CVD method using SiH 4 gas, NH 3 gas, and H 2 gas as material gases. The i-type a-SiCN is formed by the above-described plasma CVD method using SiH 4 gas, CH 4 gas, NH 3 gas, and H 2 gas as material gases. i-type a-SiGe is formed by the above-described plasma CVD method using SiH 4 gas, GeH 4 gas, and H 2 gas as material gases.
なお、i型非晶質膜61〜6m,71〜7m−1としては、i型a−Geも想定されるが、i型a−Geは、n型単結晶シリコン基板1よりも光学バンドギャップが小さいので、i型a−Geをi型非晶質膜61〜6m,71〜7m−1として用いた場合、開放電圧Vocの向上が困難である。光電変換素子100,100A,100B,100Cにおいては、i型非晶質膜61〜6m,71〜7m−1の光学バンドギャップが開放電圧Vocを支配的に決定するからである。
Note that i-type a-Ge is also assumed as the i-type amorphous films 61 to 6m and 71 to 7m-1, but the i-type a-Ge has an optical band gap larger than that of the n-type single
そこで、実施の形態1においては、n型単結晶シリコン基板1の光学バンドギャップよりも大きいi型a−SiC,i型a−SiO,i型a−SiN,i型a−SiCN,i型a−Si,i型a−SiGeをi型非晶質膜61〜6m,71〜7m−1として用いることにした。
Therefore, in the first embodiment, i-type a-SiC, i-type a-SiO, i-type a-SiN, i-type a-SiCN, and i-type a that are larger than the optical band gap of the n-type single
[実施の形態2]
図8は、実施の形態2による光電変換素子の構成を示す断面図である。図8を参照して、実施の形態2による光電変換素子200は、p型単結晶シリコン基板101と、パッシベーション膜102と、n型非晶質膜111〜11mと、p型非晶質膜121〜12m−1と、半導体薄膜131〜13nと、電極141〜14m,151〜15m−1とを備える。
[Embodiment 2]
FIG. 8 is a cross-sectional view showing the configuration of the photoelectric conversion element according to the second embodiment. Referring to FIG. 8,
p型単結晶シリコン基板101は、例えば、(100)の面方位および0.1〜1.0Ω・cmの比抵抗を有する。また、p型単結晶シリコン基板101は、例えば、100〜300μmの厚みを有し、好ましくは、100〜200μmの厚みを有する。
The p-type single
パッシベーション膜102は、例えば、SiO2からなり、p型単結晶シリコン基板101の光入射側の表面に接して設けられる。そして、パッシベーション膜102は、例えば、100nmの膜厚を有する。
The
n型非晶質膜111〜11mの各々は、非晶質相からなり、p型単結晶シリコン基板101の光入射側と反対側の表面に接して設けられる。そして、n型非晶質膜111〜11mの各々は、例えば、n型a−Siからなり、膜厚は、例えば、10nmである。また、n型非晶質膜111〜11mは、p型単結晶シリコン基板101の面内方向において所望の間隔で配置される。更に、n型非晶質膜111〜11mの各々におけるP濃度は、例えば、5×1019cm−3である。
Each of n-type
p型非晶質膜121〜12m−1は、非晶質相からなり、それぞれ、n型非晶質膜111,112間、n型非晶質膜112,113間、・・・、およびn型非晶質膜11m−1,11m間において、半導体薄膜131,132;133,134;・・・;13n−1,13nに接して配置される。そして、p型非晶質膜121〜12m−1の各々は、例えば、p型a−Siからなり、膜厚は、例えば、10nmである。また、p型非晶質膜121〜12m−1の各々におけるB濃度は、例えば、5×1019cm−3である。
The p-type
半導体薄膜131〜13nの各々は、例えば、i型a−SiCからなる。また、半導体薄膜131〜13nの各々は、例えば、数十nm以上の膜厚を有し、一般的には、キャリア(電子および正孔)がトンネルできない膜厚を有する。そして、半導体薄膜131は、n型非晶質膜111、p型非晶質膜121およびp型単結晶シリコン基板101に接して配置され、半導体薄膜132は、n型非晶質膜112、p型非晶質膜121およびp型単結晶シリコン基板101に接して配置され、半導体薄膜133は、n型非晶質膜112、p型非晶質膜122およびp型単結晶シリコン基板101に接して配置され、半導体薄膜134は、n型非晶質膜113、p型非晶質膜122およびp型単結晶シリコン基板101に接して配置され、半導体薄膜135は、n型非晶質膜113、p型非晶質膜123およびp型単結晶シリコン基板101に接して配置され、以下、同様にして、半導体薄膜13n−1は、n型非晶質膜11m−1、p型非晶質膜12m−1およびp型単結晶シリコン基板101に接して配置され、半導体薄膜13nは、n型非晶質膜11m、p型非晶質膜12m−1およびp型単結晶シリコン基板101に接して配置される。
Each of the semiconductor
電極141〜14mは、それぞれ、n型非晶質膜111〜11mに接して設けられる。電極151〜15m−1は、それぞれ、p型非晶質膜121〜12m−1に接して設けられる。そして、電極141〜14m,151〜15m−1の各々は、例えば、銀(Ag)からなる。
The
n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1は、図8の紙面に垂直な方向において同じ長さを有する。そして、n型非晶質膜111〜11mの全体の面積がp型単結晶シリコン基板101の面積に占める割合である面積占有率は、60〜93%であり、p型非晶質膜121〜12m−1の全体の面積がp型単結晶シリコン基板101の面積に占める割合である面積占有率は、5〜20%である。
The n-type
このように、n型非晶質膜111〜11mの面積占有率をp型非晶質膜121〜12m−1の面積占有率よりも大きくするのは、p型単結晶シリコン基板101中で光励起された電子および正孔がpn接合(n型非晶質膜111〜11m/p型単結晶シリコン基板101)によって分離され易くし、光励起された電子および正孔の発電への寄与率を高くするためである。
As described above, the area occupation ratio of the n-type
光電変換素子200は、図2から図4に示す工程(a)〜工程(l)に従って製造される。この場合、p型非晶質膜11〜1m、n型非晶質膜21〜2m−1、半導体薄膜31〜3nおよび電極41〜4m,51〜5m−1をそれぞれn型非晶質膜111〜11m、p型非晶質膜121〜12m−1、半導体薄膜131〜13nおよび電極141〜14m,151〜15m−1に読み替えればよい。そして、n型非晶質膜111〜11mは、表1に示すn型非晶質膜21〜2m−1と同じ材料ガスおよびn型非晶質膜21〜2m−1の条件と同じ条件を用いてプラズマCVD法によって形成され、p型非晶質膜121〜12m−1は、表1に示すp型非晶質膜11〜1mと同じ材料ガスおよびp型非晶質膜11〜1mの条件と同じ条件を用いてプラズマCVD法によって形成される。また、半導体薄膜131〜13nは、表1に示す半導体薄膜31〜3nと同じ材料ガスおよび半導体薄膜31〜3nの条件と同じ条件を用いてプラズマCVD法によって形成される。
The
光電変換素子200において、太陽光がパッシベーション膜102側から光電変換素子200に照射されると、p型単結晶シリコン基板101中で電子および正孔が光励起される。
In the
光励起された電子および正孔は、パッシベーション膜102側へ拡散しても、パッシベーション膜102によるp型単結晶シリコン基板101のパッシベーション効果によって再結合し難く、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1側へ拡散する。
Even if the photoexcited electrons and holes diffuse to the
そして、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1側へ拡散した電子および正孔は、n型非晶質膜111〜11m/p型単結晶シリコン基板101(=pn接合)による内部電界によって分離され、電子は、n型非晶質膜111〜11mを介して電極141〜14mへ到達し、正孔は、p型非晶質膜121〜12m−1を介して電極151〜15m−1へ到達する。
Then, the electrons and holes diffused toward the n-type
電極141〜14mへ到達した電子は、電極141〜14mと電極151〜15m−1との間に接続された負荷を介して電極151〜15m−1へ到達し、正孔と再結合する。
The electrons that have reached the
このように、光電変換素子200は、p型単結晶シリコン基板101中で光励起された電子および正孔をp型単結晶シリコン基板101の裏面(=パッシベーション膜102が形成されたp型単結晶シリコン基板101の表面と反対側の面)から取り出すバックコンタクト型の光電変換素子である。
As described above, the
そして、光電変換素子200においては、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1は、直接接することはなく、n型非晶質膜111〜11mとp型非晶質膜121〜12m−1との間には、半導体薄膜131〜13nが存在する。従って、光電変換素子100において説明したように、絶縁性を向上できる。
In the
図9は、実施の形態2による他の光電変換素子の構成を示す断面図である。実施の形態2による光電変換素子は、図9に示す光電変換素子200Aであってもよい。
FIG. 9 is a cross-sectional view showing a configuration of another photoelectric conversion element according to the second embodiment. The photoelectric conversion element according to
図9を参照して、光電変換素子200Aは、図8に示す光電変換素子200にi型非晶質膜161〜16mを追加したものであり、その他は、光電変換素子200と同じである。
Referring to FIG. 9,
i型非晶質膜161〜16mは、非晶質相からなり、それぞれ、p型単結晶シリコン基板101およびn型非晶質膜111〜11mに接し、p型単結晶シリコン基板101とn型非晶質膜111〜11mとの間に配置される。そして、i型非晶質膜161〜16mの各々は、例えば、i型a−Siからなり、膜厚は、例えば、10nmである。また、i型非晶質膜161〜16mは、p型単結晶シリコン基板101の面内方向(図9の紙面における左右方向)において、それぞれ、n型非晶質膜111〜11mと同じ幅を有する。更に、i型非晶質膜161〜16mは、図9の紙面に垂直な方向において、それぞれ、n型非晶質膜111〜11mと同じ長さを有する。
The i-type
光電変換素子200Aにおいては、p型非晶質膜121〜12m−1の各々の膜厚は、n型非晶質膜111〜11mの膜厚とi型非晶質膜161〜16mの膜厚との合計膜厚からなる。
In the
また、光電変換素子200Aにおいては、半導体薄膜131は、n型非晶質膜111の一部の表面および端面と、i型非晶質膜161の端面と、p型非晶質膜121の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接し、半導体薄膜132,133は、n型非晶質膜112の一部の表面および端面と、i型非晶質膜162の端面と、p型非晶質膜121,122の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接し、半導体薄膜134,135は、n型非晶質膜113の一部の表面および端面と、i型非晶質膜163の端面と、p型非晶質膜122,123の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接する。以下、同様にして、半導体薄膜13n−2,13n−1は、n型非晶質膜11m−1の一部の表面および端面と、i型非晶質膜16m−1の端面と、p型非晶質膜12m−2,12m−1の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接し、半導体薄膜13nは、n型非晶質膜11mの一部の表面および端面と、i型非晶質膜16mの端面と、p型非晶質膜12m−1の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接する。
In the
光電変換素子200Aは、図2〜図4に示す工程(a)〜工程(l)によって製造される。この場合、図2の工程(c)において、i型非晶質膜161〜16m用のi型非晶質膜がプラズマCVD法によってp型単結晶シリコン基板101上に堆積され、その後、n型非晶質膜111〜11m用のn型非晶質膜がプラズマCVD法によってi型非晶質膜161〜16m用のi型非晶質膜上に堆積される。そして、i型非晶質膜161〜16m用のi型非晶質膜を堆積するときのガス流量は、表1に示すi型非晶質膜61〜6mのガス流量と同じであり、n型非晶質膜111〜11m用のn型非晶質膜を堆積するときのガス流量は、表1に示すn型非晶質膜21〜2m−1のガス流量と同じである。
200 A of photoelectric conversion elements are manufactured by the process (a)-process (l) shown in FIGS. In this case, in the step (c) of FIG. 2, an i-type amorphous film for the i-type
光電変換素子200Aにおける発電機構は、光電変換素子200の発電機構と概ね同じであり、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1側へ拡散した電子および正孔は、n型非晶質膜111〜11m/i型非晶質膜161〜16m/p型単結晶シリコン基板101(=pin接合)による内部電界によって分離され、電子は、i型非晶質膜161〜16mおよびn型非晶質膜111〜11mを介して電極141〜14mへ到達し、正孔は、p型非晶質膜121〜12m−1を介して電極151〜15m−1へ到達する。
The power generation mechanism in the
電極141〜14mへ到達した電子は、電極141〜14mと電極151〜15m−1との間に接続された負荷を介して電極151〜15m−1へ到達し、正孔と再結合する。
The electrons that have reached the
このように、光電変換素子200Aは、p型単結晶シリコン基板101中で光励起された電子および正孔をp型単結晶シリコン基板101の裏面(=パッシベーション膜102が形成されたp型単結晶シリコン基板101の表面と反対側の面)から取り出すバックコンタクト型の光電変換素子である。
As described above, the
そして、光電変換素子200Aにおいては、n型非晶質膜111〜11mおよびi型非晶質膜161〜16mとp型非晶質膜121〜12m−1との間には、n型非晶質膜111〜11mおよびi型非晶質膜161〜16mがp型非晶質膜121〜12m−1に接しないように半導体薄膜131〜13nが存在する。従って、光電変換素子100において説明したように、絶縁性を向上できる。
In the
また、光電変換素子200Aにおいては、p型単結晶シリコン基板101とn型非晶質膜111〜11mとの間にi型非晶質膜161〜16mが存在するので、p型単結晶シリコン基板101とn型非晶質膜111〜11mとの界面における電子の再結合が抑制される。その結果、短絡光電流が増加し、光電変換素子200Aの変換効率を向上できる。
In the
光電変換素子200Aについてのその他の説明は、光電変換素子200についての説明と同じである。
The other description of the
図10は、実施の形態2による更に他の光電変換素子の構成を示す断面図である。実施の形態2による光電変換素子は、図10に示す光電変換素子200Bであってもよい。
FIG. 10 is a cross-sectional view illustrating a configuration of still another photoelectric conversion element according to the second embodiment. The photoelectric conversion element according to
図10を参照して、光電変換素子200Bは、図8に示す光電変換素子200にi型非晶質膜171〜17m−1を追加したものであり、その他は、光電変換素子200と同じである。
Referring to FIG. 10,
i型非晶質膜171〜17m−1は、非晶質相からなり、それぞれ、p型単結晶シリコン基板101およびp型非晶質膜121〜12m−1に接し、p型単結晶シリコン基板101とp型非晶質膜121〜12m−1との間に配置される。そして、i型非晶質膜171〜17m−1の各々は、例えば、i型a−Siからなり、膜厚は、例えば、10nmである。また、i型非晶質膜171〜17m−1は、図10の紙面に垂直な方向において、それぞれ、p型非晶質膜121〜12m−1と同じ長さを有する。
The i-type
光電変換素子200Bにおいては、n型非晶質膜111〜11mの各々の膜厚は、p型非晶質膜121〜12m−1の膜厚とi型非晶質膜171〜17m−1の膜厚との合計膜厚からなる。
In the
また、光電変換素子200Bにおいては、半導体薄膜131は、n型非晶質膜111の一部の表面および端面と、i型非晶質膜171の端面と、p型非晶質膜121の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接し、半導体薄膜132,133は、n型非晶質膜112の一部の表面および端面と、i型非晶質膜171,172の端面と、p型非晶質膜121,122の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接し、半導体薄膜134,135は、n型非晶質膜113の一部の表面および端面と、i型非晶質膜172,173の端面と、p型非晶質膜122,123の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接する。以下、同様にして、半導体薄膜13n−2,13n−1は、n型非晶質膜11m−1の一部の表面および端面と、i型非晶質膜17m−2,17m−1の端面と、p型非晶質膜12m−2,12m−1の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接し、半導体薄膜13nは、n型非晶質膜11mの一部の表面および端面と、i型非晶質膜17m−1の端面と、p型非晶質膜12m−1の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接する。
In the
光電変換素子200Bは、図2〜図4に示す工程(a)〜工程(l)によって製造される。この場合、図3の工程(i)において、i型非晶質膜171〜17m−1用のi型非晶質膜がプラズマCVD法によってp型単結晶シリコン基板101、n型非晶質膜111〜11mおよび半導体薄膜131〜13n上に堆積され、その後、p型非晶質膜121〜12m−1用のp型非晶質膜がプラズマCVD法によってi型非晶質膜171〜17m−1用のi型非晶質膜上に堆積される。そして、i型非晶質膜171〜17m−1用のi型非晶質膜を堆積するときのガス流量は、表1に示すi型非晶質膜61〜6mのガス流量と同じであり、p型非晶質膜121〜12m−1用のp型非晶質膜を堆積するときのガス流量は、表1に示すp型非晶質膜11〜1mのガス流量と同じである。
The
光電変換素子200Bにおける発電機構は、光電変換素子200の発電機構と概ね同じであり、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1側へ拡散した電子および正孔は、n型非晶質膜111〜11m/p型単結晶シリコン基板101(=pn接合)による内部電界によって分離され、電子は、n型非晶質膜111〜11mを介して電極141〜14mへ到達し、正孔は、i型非晶質膜171〜17m−1およびp型非晶質膜121〜12m−1を介して電極151〜15m−1へ到達する。
The power generation mechanism in the
電極141〜14m−1へ到達した電子は、電極141〜14m−1と電極151〜15m−1との間に接続された負荷を介して電極151〜15m−1へ到達し、正孔と再結合する。
The electrons that have reached the
このように、光電変換素子200Bは、p型単結晶シリコン基板101中で光励起された電子および正孔をp型単結晶シリコン基板101の裏面(=パッシベーション膜102が形成されたp型単結晶シリコン基板101の表面と反対側の面)から取り出すバックコンタクト型の光電変換素子である。
As described above, the
そして、光電変換素子200Bにおいては、n型非晶質膜111〜11mとi型非晶質膜171〜17m−1およびp型非晶質膜121〜12m−1との間には、n型非晶質膜111〜11mがi型非晶質膜171〜17m−1およびp型非晶質膜121〜12m−1に接しないように半導体薄膜131〜13nが存在する。従って、光電変換素子100において説明したように、絶縁性を向上できる。
In the
また、光電変換素子200Bにおいては、p型単結晶シリコン基板101とp型非晶質膜121〜12m−1との間にi型非晶質膜171〜17m−1が存在するので、p型単結晶シリコン基板101とp型非晶質膜121〜12m−1との界面における正孔の再結合が抑制される。その結果、短絡光電流が増加し、光電変換素子200Bの変換効率を向上できる。
Moreover, in the
光電変換素子200Bについてのその他の説明は、光電変換素子200についての説明と同じである。
The other description of the
図11は、実施の形態2による更に他の光電変換素子の構成を示す断面図である。実施の形態2による光電変換素子は、図11に示す光電変換素子200Cであってもよい。
FIG. 11 is a cross-sectional view illustrating a configuration of still another photoelectric conversion element according to the second embodiment. The photoelectric conversion element according to
図11を参照して、光電変換素子200Cは、図8に示す光電変換素子200にi型非晶質膜161〜16m,171〜17m−1を追加したものであり、その他は、光電変換素子200と同じである。
Referring to FIG. 11,
i型非晶質膜161〜16m,171〜17m−1については、上述したとおりである。
The i-type
光電変換素子200Cにおいては、半導体薄膜131は、n型非晶質膜111の一部の表面および端面と、i型非晶質膜161,171の端面と、p型非晶質膜121の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接し、半導体薄膜132,133は、n型非晶質膜112の一部の表面および端面と、i型非晶質膜162,171,172の端面と、p型非晶質膜121,122の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接し、半導体薄膜134,135は、n型非晶質膜113の一部の表面および端面と、i型非晶質膜163,172,173の端面と、p型非晶質膜122,123の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接する。以下、同様にして、半導体薄膜13n−2,13n−1は、n型非晶質膜11m−1の一部の表面および端面と、i型非晶質膜16m−1,17m−2,17m−1の端面と、p型非晶質膜12m−2,12m−1の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接し、半導体薄膜13nは、n型非晶質膜11mの一部の表面および端面と、i型非晶質膜16m,17m−1の端面と、p型非晶質膜12m−1の表面および端面と、p型単結晶シリコン基板101の一部の表面とに接する。
In the
光電変換素子200Cは、図2〜図4に示す工程(a)〜工程(l)によって製造される。この場合、図2の工程(c)において、i型非晶質膜161〜16m用のi型非晶質膜がプラズマCVD法によってp型単結晶シリコン基板101上に堆積され、その後、n型非晶質膜111〜11m用のn型非晶質膜がプラズマCVD法によってi型非晶質膜161〜16m用のi型非晶質膜上に堆積される。また、図3の工程(i)において、i型非晶質膜171〜17m−1用のi型非晶質膜がプラズマCVD法によってp型単結晶シリコン基板101、n型非晶質膜111〜11mおよび半導体薄膜131〜13n上に堆積され、その後、p型非晶質膜121〜12m−1用のp型非晶質膜がプラズマCVD法によってi型非晶質膜171〜17m−1用のi型非晶質膜上に堆積される。そして、i型非晶質膜161〜16m用のi型非晶質膜と、i型非晶質膜171〜17m−1用のi型非晶質膜とを堆積するときのガス流量は、表1に示すi型非晶質膜61〜6mを堆積するときのガス流量と同じであり、n型非晶質膜111〜11m用のn型非晶質膜を堆積するときのガス流量は、表1に示すn型非晶質膜21〜2m−1を堆積するときのガス流量と同じであり、p型非晶質膜121〜12m−1用のp型非晶質膜を堆積するときのガス流量は、表1に示すp型非晶質膜11〜1mを堆積するときのガス流量と同じである。
The
光電変換素子200Cにおける発電機構は、光電変換素子200の発電機構と概ね同じであり、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1側へ拡散した電子および正孔は、n型非晶質膜111〜11m/i型非晶質膜161〜16m/p型単結晶シリコン基板101(=pin接合)による内部電界によって分離され、電子は、i型非晶質膜161〜16mおよびn型非晶質膜111〜11mを介して電極141〜14mへ到達し、正孔は、i型非晶質膜171〜17m−1およびp型非晶質膜121〜12m−1を介して電極151〜15m−1へ到達する。
The power generation mechanism in the
電極141〜14mへ到達した電子は、電極141〜14mと電極151〜15m−1との間に接続された負荷を介して電極151〜15m−1へ到達し、正孔と再結合する。
The electrons that have reached the
このように、光電変換素子200Cは、p型単結晶シリコン基板101中で光励起された電子および正孔をp型単結晶シリコン基板101の裏面(=パッシベーション膜102が形成されたp型単結晶シリコン基板101の表面と反対側の面)から取り出すバックコンタクト型の光電変換素子である。
As described above, the
そして、光電変換素子200Cにおいては、i型非晶質膜161〜16mおよびn型非晶質膜111〜11mとi型非晶質膜171〜17m−1およびp型非晶質膜121〜12m−1との間には、i型非晶質膜161〜16mおよびn型非晶質膜111〜11mがi型非晶質膜171〜17m−1およびp型非晶質膜121〜12m−1に接しないように半導体薄膜131〜13nが存在する。従って、光電変換素子100において説明したように、絶縁性を向上できる。
In the
また、光電変換素子200Cにおいては、p型単結晶シリコン基板101とn型非晶質膜111〜11mとの間にi型非晶質膜161〜16mが存在するので、p型単結晶シリコン基板101とn型非晶質膜111〜11mとの界面における電子の再結合が抑制される。更に、光電変換素子200Cにおいては、p型単結晶シリコン基板101とp型非晶質膜121〜12m−1との間にi型非晶質膜171〜17m−1が存在するので、p型単結晶シリコン基板101とp型非晶質膜121〜12m−1との界面における正孔の再結合が抑制される。
In the
その結果、短絡光電流が増加し、光電変換素子200Cの変換効率を向上できる。
As a result, the short-circuit photocurrent increases and the conversion efficiency of the
光電変換素子200Cについてのその他の説明は、光電変換素子200についての説明と同じである。
The other description of the
光電変換素子200,200A,200B,200Cにおいては、p型単結晶シリコン基板101の光入射側の表面(=パッシベーション膜102が形成された表面)がテクスチャ構造になっていてもよい。この場合、図2の工程(a)において、p型単結晶シリコン基板101をエタノール等で超音波洗浄した後、p型単結晶シリコン基板101の表面をアルカリを用いて化学的に異方性エッチングし、p型単結晶シリコン基板101の表面をテクスチャ化する。その後、上述したようにフッ酸を用いて自然酸化膜を除去するとともに、p型単結晶シリコン基板101の表面を水素で終端する。
In the
また、光電変換素子200,200A,200B,200Cにおいては、半導体薄膜131〜13nは、i型a−SiCからなると説明したが、実施の形態2においては、これに限らず、半導体薄膜131〜13nは、i型a−SiO、i型a−SiNおよびi型a−SiCNのいずれかからなっていてもよく、一般的には、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1の両方よりも光学バンドギャップが大きい半導体材料からなっていればよい。この場合、n型非晶質膜111〜11m、p型非晶質膜121〜12m−1および半導体薄膜131〜13nの全てが同じ材料(例えば、a−SiC)からなる場合もあるが、半導体薄膜131〜13nは、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1を構成するa−SiCにおけるカーボン(C)量よりも多いCを含むことによって、半導体薄膜131〜13nの光学バンドギャップは、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1の光学バンドギャップよりも大きく設定される。n型非晶質膜111〜11m、p型非晶質膜121〜12m−1および半導体薄膜131〜13nの全てがa−SiC以外の同じ材料からなる場合も同様である。
In the
更に、光電変換素子200,200A,200B,200Cにおいては、半導体薄膜131〜13nは、i型の導電型を有していなくてもよく、n型非晶質膜111〜11mに含まれるP濃度よりも低いPを含んでいてもよく、p型非晶質膜121〜12m−1に含まれるB濃度よりも低いBを含んでいてもよい。このように、半導体薄膜131〜13n中におけるドーパント濃度がn型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1中におけるドーパント濃度よりも低ければ、半導体薄膜131〜13nの導電率がn型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1の導電率よりも低くなり、キャリア(電子および正孔)がn型非晶質膜111〜11mとp型非晶質膜121〜12m−1との間を流れ難くなるからである。
Furthermore, in the
更に、光電変換素子200,200A,200B,200Cにおいては、半導体薄膜131〜13nは、n型非晶質膜111〜11mおよびp型非晶質膜121〜12m−1の両方よりも大きい光学バンドギャップを有する2種以上の半導体材料を積層した構造からなっていてもよい。そして、半導体薄膜131〜13nが半導体材料Aと半導体材料Bとを積層した構造からなり、半導体材料Aの光学バンドギャップが半導体材料Bの光学バンドギャップよりも大きい場合、半導体薄膜131〜13nを半導体材料A/半導体材料B/半導体材料Aの積層構造によって構成してもよい。このような積層構造であれば、半導体薄膜131〜13n中へキャリアが注入されても、その注入されたキャリアは、半導体材料B中に閉じ込められ、n型非晶質膜111〜11mとp型非晶質膜121〜12m−1との間を流れ難くなるからである。
Further, in the
更に、光電変換素子200,200A,200B,200Cにおいては、n型非晶質膜111〜11m−1は、n型a−Siからなると説明したが、実施の形態2においては、これに限らず、n型非晶質膜111〜11m−1は、n型a−SiC、n型a−SiO、n型a−SiN、n型a−SiCN、n型a−SiGeおよびn型a−Geのいずれかからなっていてもよい。
Further, in the
更に、光電変換素子200,200A,200B,200Cにおいては、p型非晶質膜121〜12mは、p型a−Siからなると説明したが、実施の形態2においては、これに限らず、p型非晶質膜121〜12mは、p型a−SiC、p型a−SiO、p型a−SiN、p型a−SiCN、p型a−SiGeおよびp型a−Geのいずれかからなっていてもよい。
Furthermore, in the
更に、光電変換素子200A,200Cにおいては、i型非晶質膜161〜16mは、i型a−Siからなると説明したが、実施の形態2においては、これに限らず、i型非晶質膜161〜16mは、i型a−SiC、i型a−SiO、i型a−SiN、i型a−SiCN、およびi型a−SiGeのいずれかからなっていてもよい。
Further, in the
更に、光電変換素子200B,200Cにおいては、i型非晶質膜171〜17m−1は、i型a−Siからなると説明したが、実施の形態2においては、これに限らず、i型非晶質膜171〜17m−1は、i型a−SiC、i型a−SiO、i型a−SiN、i型a−SiCN、およびi型a−SiGeのいずれかからなっていてもよい。
Furthermore, in the
即ち、光電変換素子200,200A,200B,200Cにおいては、n型非晶質膜111〜11m、p型非晶質膜121〜12m−1および半導体薄膜131〜13nは、それぞれ、表2に示すn型非晶質膜21〜2m−1、p型非晶質膜11〜1mおよび半導体薄膜31〜3nを構成する材料のいずれかからなっていてもよく、光電変換素子200A,200B,200Cにおいては、i型非晶質膜161〜16mおよび/またはi型非晶質膜171〜17m−1は、それぞれ、表2に示すi型非晶質膜61〜6m,71〜7m−1を構成する材料のいずれかからなっていてもよい。
That is, in the
そして、n型a−SiC、n型a−SiO、n型a−SiN、n型a−SiCN、n型a−SiGe、n型a−Ge、p型a−SiC、p型a−SiO、p型a−SiN、p型a−SiCN、p型a−SiGe、p型a−Ge、i型a−SiC、i型a−SiO、i型a−SiN、i型a−SiCN、およびi型a−SiGeは、上述した材料ガスを用いてプラズマCVD法によって形成される。 N-type a-SiC, n-type a-SiO, n-type a-SiN, n-type a-SiCN, n-type a-SiGe, n-type a-Ge, p-type a-SiC, p-type a-SiO, p-type a-SiN, p-type a-SiCN, p-type a-SiGe, p-type a-Ge, i-type a-SiC, i-type a-SiO, i-type a-SiN, i-type a-SiCN, and i The type a-SiGe is formed by the plasma CVD method using the material gas described above.
なお、i型非晶質膜161〜16m,171〜17m−1用の材料としてi型a−Geが除外されるのは、上述したi型非晶質膜61〜6m,71〜7m−1用の材料としてi型a−Geが除外される理由と同じである。
Note that i-type a-Ge is excluded as a material for the i-type
上述したように、実施の形態1においては、n型単結晶シリコン基板1の裏面(=光入射側の表面と反対の表面)側にp型非晶質膜11〜1mと、n型非晶質膜21〜2m−1と、半導体薄膜31〜3nとを配置した構成からなる光電変換素子100について説明した。また、実施の形態2においては、p型単結晶シリコン基板101の裏面(=光入射側の表面と反対の表面)側にn型非晶質膜111〜11mと、p型非晶質膜121〜12m−1と、半導体薄膜131〜13nとを配置した構成からなる光電変換素子200について説明した。
As described above, in the first embodiment, the p-type
従って、この発明の実施の形態による光電変換素子は、第1の導電型を有する単結晶シリコン基板と、単結晶シリコン基板の一方の表面側に設けられ、第1の導電型と反対の第2の導電型を有する第1の非晶質膜と、単結晶シリコン基板の面内方向において第1の非晶質膜に隣接して単結晶シリコン基板の一方の表面側に設けられ、第1の導電型を有する第2の非晶質膜と、第1の非晶質膜と第2の非晶質膜との間に設けられ、第1および第2の非晶質膜の両方よりも大きい光学バンドギャップを有する半導体薄膜とを備えていればよい。 Therefore, the photoelectric conversion element according to the embodiment of the present invention is provided with a single crystal silicon substrate having the first conductivity type and a second surface opposite to the first conductivity type, provided on one surface side of the single crystal silicon substrate. A first amorphous film having the conductivity type and a first crystal film provided on one surface side of the single crystal silicon substrate adjacent to the first amorphous film in the in-plane direction of the single crystal silicon substrate, Provided between the second amorphous film having the conductivity type, the first amorphous film, and the second amorphous film, and larger than both the first and second amorphous films What is necessary is just to provide the semiconductor thin film which has an optical band gap.
また、実施の形態1においては、n型単結晶シリコン基板1とp型非晶質膜11〜1mとの間に配置されたi型非晶質膜61〜6mを備える光電変換素子100A、n型単結晶シリコン基板1とn型非晶質膜21〜2m−1との間に配置されたi型非晶質膜71〜7m−1を備える光電変換素子100B、およびn型単結晶シリコン基板1とp型非晶質膜11〜1mとの間に配置されたi型非晶質膜61〜6mと、n型単結晶シリコン基板1とn型非晶質膜21〜2m−1との間に配置されたi型非晶質膜71〜7m−1とを備える光電変換素子100Cについて説明した。
In the first embodiment, the
更に、実施の形態2においては、p型単結晶シリコン基板101とn型非晶質膜111〜11mとの間に配置されたi型非晶質膜161〜16mを備える光電変換素子200A、p型単結晶シリコン基板101とp型非晶質膜121〜12m−1との間に配置されたi型非晶質膜171〜17m−1を備える光電変換素子200B、およびp型単結晶シリコン基板101とn型非晶質膜111〜11mとの間に配置されたi型非晶質膜161〜16mと、p型単結晶シリコン基板101とp型非晶質膜121〜12m−1との間に配置されたi型非晶質膜171〜17m−1とを備える光電変換素子200Cについて説明した。
Furthermore, in the second embodiment, the
従って、この発明の実施の形態による光電変換素子は、第1の導電型を有する単結晶シリコン基板と、単結晶シリコン基板の一方の表面側に設けられ、第1の導電型と反対の第2の導電型を有する第1の非晶質膜と、単結晶シリコン基板の面内方向において第1の非晶質膜に隣接して単結晶シリコン基板の一方の表面側に設けられ、第1の導電型を有する第2の非晶質膜と、第1の非晶質膜と第2の非晶質膜との間に設けられ、第1および第2の非晶質膜の両方よりも大きい光学バンドギャップを有する半導体薄膜と、単結晶シリコン基板と第1および第2の非晶質膜の少なくとも一方との間に設けられ、i型の導電型を有する非晶質膜とを備えていればよい。そして、単結晶シリコン基板と第1および第2の非晶質膜の両方との間にi型の導電型を有する非晶質膜が設けられる場合、i型の導電型を有する非晶質膜は、単結晶シリコン基板と第1の非晶質膜との間に設けられ、i型の導電型を有する第3の非晶質膜と、単結晶シリコン基板と第2の非晶質膜との間に設けられ、i型の導電型を有する第4の非晶質膜とからなる。 Therefore, the photoelectric conversion element according to the embodiment of the present invention is provided with a single crystal silicon substrate having the first conductivity type and a second surface opposite to the first conductivity type, provided on one surface side of the single crystal silicon substrate. A first amorphous film having the conductivity type and a first crystal film provided on one surface side of the single crystal silicon substrate adjacent to the first amorphous film in the in-plane direction of the single crystal silicon substrate, Provided between the second amorphous film having the conductivity type, the first amorphous film, and the second amorphous film, and larger than both the first and second amorphous films A semiconductor thin film having an optical band gap; and an amorphous film having an i-type conductivity type provided between the single crystal silicon substrate and at least one of the first and second amorphous films. That's fine. When an amorphous film having i-type conductivity is provided between the single crystal silicon substrate and both the first and second amorphous films, the amorphous film having i-type conductivity is used. Is provided between the single crystal silicon substrate and the first amorphous film, and has a third amorphous film having i-type conductivity, the single crystal silicon substrate, and the second amorphous film. And a fourth amorphous film having i-type conductivity.
更に、この発明の実施の形態による光電変換素子の製造方法は、p型非晶質膜11〜1mとn型非晶質膜21〜2m−1との間(またはn型非晶質膜111〜11mとp型非晶質膜121〜12m−1との間)に半導体薄膜31〜3n(または半導体薄膜131〜13n)が配置された構成を製造する方法であればよい。従って、この発明の実施の形態による光電変換素子の製造方法は、第1の導電型を有する単結晶シリコンからなる半導体基板の一方の表面上に第1の導電型と反対の第2の導電型を有する第1の非晶質膜を堆積する第1の工程と、半導体基板の面内方向における第1の非晶質膜の両端部を覆うように半導体薄膜を形成する第2の工程と、半導体基板の面内方向において第1の非晶質膜に隣接して半導体薄膜および半導体基板の一方の表面上に第1の導電型を有する第2の非晶質膜を堆積する第3の工程とを備え、半導体薄膜は、第1および第2の非晶質膜の両方よりも大きい光学バンドギャップを有していればよい。
Furthermore, the method for manufacturing the photoelectric conversion element according to the embodiment of the present invention is provided between the p-type amorphous films 11-1m and the n-type amorphous films 21-2m-1 (or the n-type amorphous film 111). ˜11 m and the p-type
なお、実施の形態1においては、第1の導電型は、n型であり、第2の導電型は、p型である。また、実施の形態2においては、第1の導電型は、p型であり、第2の導電型は、n型である。 In the first embodiment, the first conductivity type is n-type, and the second conductivity type is p-type. In the second embodiment, the first conductivity type is p-type, and the second conductivity type is n-type.
今回開示された実施の形態はすべての点で例示であって制限的なものではないと考えられるべきである。本発明の範囲は、上記した実施の形態の説明ではなくて特許請求の範囲によって示され、特許請求の範囲と均等の意味および範囲内でのすべての変更が含まれることが意図される。 The embodiment disclosed this time should be considered as illustrative in all points and not restrictive. The scope of the present invention is shown not by the above description of the embodiments but by the scope of claims for patent, and is intended to include meanings equivalent to the scope of claims for patent and all modifications within the scope.
この発明は、光電変換素子およびその製造方法に適用される。 The present invention is applied to a photoelectric conversion element and a manufacturing method thereof.
1 n型単結晶シリコン基板、2,102 パッシベーション膜、11〜1m,20,121〜12m−1 p型非晶質膜、21〜2m−1,60,111〜11m n型非晶質膜、30,50,70 レジストパターン、31〜3n,40,131〜13n 半導体薄膜、41〜4m,51〜5m−1,141〜14m,151〜15m−1 電極、100,100A,100B,100C,200,200A,200B,200C,200C 光電変換素子、61〜6m,71〜7m−1,161〜16m,171〜17m−1 i型非晶質膜、101 p型単結晶シリコン基板。 1 n-type single crystal silicon substrate, 2,102 passivation film, 11-1m, 20, 121-12m-1 p-type amorphous film, 21-2m-1, 60, 111-11m n-type amorphous film, 30, 50, 70 Resist pattern, 31-3n, 40, 131-13n Semiconductor thin film, 41-4m, 51-5m-1, 141-14m, 151-15m-1 Electrode, 100, 100A, 100B, 100C, 200 , 200A, 200B, 200C, 200C photoelectric conversion element, 61-6m, 71-7m-1, 161-16m, 171-17m-1 i-type amorphous film, 101 p-type single crystal silicon substrate.
Claims (13)
前記半導体基板の一方の表面側に設けられ、前記第1の導電型と反対の第2の導電型を有する第1の非晶質膜と、
前記半導体基板の面内方向において前記第1の非晶質膜に隣接して前記半導体基板の一方の表面側に設けられ、前記第1の導電型を有する第2の非晶質膜と、
前記第1の非晶質膜と前記第2の非晶質膜との間に設けられ、前記第1および第2の非晶質膜の両方よりも大きい光学バンドギャップを有する半導体薄膜とを備える光電変換素子。 A semiconductor substrate made of single crystal silicon having a first conductivity type;
A first amorphous film provided on one surface side of the semiconductor substrate and having a second conductivity type opposite to the first conductivity type;
A second amorphous film having the first conductivity type, provided on one surface side of the semiconductor substrate adjacent to the first amorphous film in an in-plane direction of the semiconductor substrate;
A semiconductor thin film provided between the first amorphous film and the second amorphous film and having an optical band gap larger than both of the first and second amorphous films. Photoelectric conversion element.
前記半導体基板と前記第2の非晶質層との間に設けられ、i型の導電型を有する第4の非晶質膜とを更に備える、請求項1に記載の光電変換素子。 A third amorphous film provided between the semiconductor substrate and the first amorphous layer and having an i-type conductivity;
The photoelectric conversion element according to claim 1, further comprising a fourth amorphous film that is provided between the semiconductor substrate and the second amorphous layer and has an i-type conductivity type.
前記第1の非晶質膜は、p型非晶質膜からなり、
前記第2の非晶質膜は、n型非晶質膜からなる、請求項1から請求項7のいずれか1項に記載の光電変換素子。 The semiconductor substrate is made of n-type single crystal silicon,
The first amorphous film is a p-type amorphous film,
The photoelectric conversion element according to claim 1, wherein the second amorphous film is an n-type amorphous film.
前記第2の非晶質膜は、n型アモルファスシリコンカーバイド、n型アモルファスシリコンナイトライド、n型アモルファスシリコンカーボンナイトライド、n型アモルファスシリコンオキサイド、n型アモルファスシリコン、n型アモルファスシリコンゲルマニウムおよびn型アモルファスゲルマニウムのいずれかからなる、請求項8に記載の光電変換素子。 The first amorphous film includes p-type amorphous silicon carbide, p-type amorphous silicon nitride, p-type amorphous silicon carbon nitride, p-type amorphous silicon oxide, p-type amorphous silicon, p-type amorphous silicon germanium, and p-type. Made of either amorphous germanium,
The second amorphous film includes n-type amorphous silicon carbide, n-type amorphous silicon nitride, n-type amorphous silicon carbon nitride, n-type amorphous silicon oxide, n-type amorphous silicon, n-type amorphous silicon germanium, and n-type. The photoelectric conversion element according to claim 8, comprising any one of amorphous germanium.
前記第1の非晶質膜は、n型非晶質膜からなり、
前記第2の非晶質膜は、p型非晶質膜からなる、請求項1から請求項7のいずれか1項に記載の光電変換素子。 The semiconductor substrate is made of p-type single crystal silicon,
The first amorphous film is an n-type amorphous film,
The photoelectric conversion element according to claim 1, wherein the second amorphous film is a p-type amorphous film.
前記第2の非晶質膜は、p型アモルファスシリコンカーバイド、p型アモルファスシリコンナイトライド、p型アモルファスシリコンカーボンナイトライド、p型アモルファスシリコンオキサイド、p型アモルファスシリコン、p型アモルファスシリコンゲルマニウムおよびp型アモルファスゲルマニウムのいずれかからなる、請求項10に記載の光電変換素子。 The first amorphous film includes n-type amorphous silicon carbide, n-type amorphous silicon nitride, n-type amorphous silicon carbon nitride, n-type amorphous silicon oxide, n-type amorphous silicon, n-type amorphous silicon germanium, and n-type. Made of either amorphous germanium,
The second amorphous film includes p-type amorphous silicon carbide, p-type amorphous silicon nitride, p-type amorphous silicon carbon nitride, p-type amorphous silicon oxide, p-type amorphous silicon, p-type amorphous silicon germanium, and p-type. The photoelectric conversion element according to claim 10, comprising any of amorphous germanium.
前記半導体基板の面内方向における前記第1の非晶質膜の両端部を覆うように半導体薄膜を形成する第2の工程と、
前記半導体基板の面内方向において前記第1の非晶質膜に隣接して前記半導体薄膜および前記半導体基板の一方の表面上に前記第1の導電型を有する第2の非晶質膜を堆積する第3の工程とを備え、
前記半導体薄膜は、前記第1および第2の非晶質膜の両方よりも大きい光学バンドギャップを有する、光電変換素子の製造方法。 A first step of depositing a first amorphous film having a second conductivity type opposite to the first conductivity type on one surface of a semiconductor substrate made of single crystal silicon having a first conductivity type. When,
A second step of forming a semiconductor thin film so as to cover both end portions of the first amorphous film in the in-plane direction of the semiconductor substrate;
Depositing the semiconductor thin film and the second amorphous film having the first conductivity type on one surface of the semiconductor substrate adjacent to the first amorphous film in the in-plane direction of the semiconductor substrate And a third step to
The method for manufacturing a photoelectric conversion element, wherein the semiconductor thin film has an optical band gap larger than both of the first and second amorphous films.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011274370A JP2013125891A (en) | 2011-12-15 | 2011-12-15 | Photoelectric conversion element and manufacturing method of the same |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2011274370A JP2013125891A (en) | 2011-12-15 | 2011-12-15 | Photoelectric conversion element and manufacturing method of the same |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2013125891A true JP2013125891A (en) | 2013-06-24 |
JP2013125891A5 JP2013125891A5 (en) | 2015-01-22 |
Family
ID=48776963
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2011274370A Pending JP2013125891A (en) | 2011-12-15 | 2011-12-15 | Photoelectric conversion element and manufacturing method of the same |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP2013125891A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2016140309A1 (en) * | 2015-03-04 | 2016-09-09 | シャープ株式会社 | Photoelectric conversion element and method for manufacturing same |
Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62115785A (en) * | 1985-11-14 | 1987-05-27 | Kanegafuchi Chem Ind Co Ltd | Semiconductor device |
WO2008050889A1 (en) * | 2006-10-27 | 2008-05-02 | Kyocera Corporation | Solar cell element manufacturing method and solar cell element |
JP2008529265A (en) * | 2005-01-20 | 2008-07-31 | コミツサリア タ レネルジー アトミーク | Semiconductor device having heterojunction and interfinger structure |
JP2010021490A (en) * | 2008-07-14 | 2010-01-28 | Kobe Steel Ltd | Semiconductor wiring |
JP2010183080A (en) * | 2009-02-04 | 2010-08-19 | Lg Electronics Inc | Solar cell and method for manufacturing the same |
US20110056545A1 (en) * | 2009-09-07 | 2011-03-10 | Kwangsun Ji | Solar cell |
-
2011
- 2011-12-15 JP JP2011274370A patent/JP2013125891A/en active Pending
Patent Citations (6)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS62115785A (en) * | 1985-11-14 | 1987-05-27 | Kanegafuchi Chem Ind Co Ltd | Semiconductor device |
JP2008529265A (en) * | 2005-01-20 | 2008-07-31 | コミツサリア タ レネルジー アトミーク | Semiconductor device having heterojunction and interfinger structure |
WO2008050889A1 (en) * | 2006-10-27 | 2008-05-02 | Kyocera Corporation | Solar cell element manufacturing method and solar cell element |
JP2010021490A (en) * | 2008-07-14 | 2010-01-28 | Kobe Steel Ltd | Semiconductor wiring |
JP2010183080A (en) * | 2009-02-04 | 2010-08-19 | Lg Electronics Inc | Solar cell and method for manufacturing the same |
US20110056545A1 (en) * | 2009-09-07 | 2011-03-10 | Kwangsun Ji | Solar cell |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
WO2016140309A1 (en) * | 2015-03-04 | 2016-09-09 | シャープ株式会社 | Photoelectric conversion element and method for manufacturing same |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP6404825B2 (en) | Photoelectric conversion element | |
KR20140040121A (en) | Graphene-based multi-junctions flexible solar cell | |
JP2013191656A (en) | Photoelectric conversion element and manufacturing method thereof | |
CN113644142A (en) | Solar cell with passivation contact and preparation method thereof | |
JP6032911B2 (en) | Photoelectric conversion element and manufacturing method thereof | |
WO2015060013A1 (en) | Photoelectric conversion element | |
JP2013115262A (en) | Photoelectric conversion element | |
JP2013214672A (en) | Photoelectric conversion element | |
JP2013191657A (en) | Photoelectric conversion element and manufacturing method thereof | |
JP2013125890A (en) | Photoelectric conversion element and manufacturing method of the same | |
US20140048130A1 (en) | Crystalline silicon solar cell water, and solar cell employing the same | |
JP2013125891A (en) | Photoelectric conversion element and manufacturing method of the same | |
WO2014162979A1 (en) | Photoelectric conversion device | |
JP5956742B2 (en) | Photoelectric conversion element | |
JP2013197158A (en) | Photoelectric conversion element and manufacturing method thereof | |
CN114038932A (en) | Single crystalline silicon solar cell with back containing silicon oxide-titanium nitride double-layer contact structure and preparation method thereof | |
CN112382680A (en) | HJT battery and preparation method thereof based on laser induction | |
WO2013168515A1 (en) | Photovoltaic device and method for producing same | |
WO2006049003A1 (en) | Process for producing thin-film photoelectric converter | |
JP2013021239A (en) | Photoelectric conversion element | |
CN214753786U (en) | Solar cell with passivation contact | |
JP2013110187A (en) | Photoelectric conversion element and manufacturing method thereof | |
JP2004335733A (en) | Thin film solar cell | |
JP2013125879A (en) | Photoelectric conversion element and manufacturing method for photoelectric conversion element | |
JP2004335734A (en) | Thin film solar cell |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20141202 |
|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20141202 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20150826 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20150908 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20151102 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20151208 |
|
A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20160127 |
|
A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20160216 |