JP2012093436A - ディスプレイ装置及びこれを備える電子機器 - Google Patents
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Abstract
【解決手段】ディスプレイ装置は、マトリクス状に配置された複数の画素を有する。各画素Pjiは、第1の電極20と第2の電極24との間の電位差に応じて透過可能な光量が変化する光透過素子22と、第1の電極20にある電位を記憶しておくメモリ回路25とを有する。ディスプレイ装置は、更に、周期的にメモリ回路25をリフレッシュするコントローラを有する。コントローラは、リフレッシュタイミングで第1の電極20が第2の電極24に対して正の電位を有する場合に、メモリ回路25に第1の電極20での電位を記憶させ、第2の電極24に第1の所定電圧を印加して第1の電極20での電位を第1の所定電圧の分だけ増大させ、第1の電極20にある電荷を放電させて第1の電極20が第2の電極24に対して負の電位を有するようにする。
【選択図】図2
Description
11 表示パネル
12 ソースドライバ
13 ゲートドライバ
14 コモンドライバ
15 コントローラ
20 画素電極
21,26〜28 スイッチング素子
22 光透過素子(液晶セル)
23 保持キャパシタ
24 共通電極
25,25’,25” メモリ回路
29 サンプリングキャパシタ
100 電子機器
P11〜Pnm,Pji,P’ji,P”ji 画素
S1〜Sm,Si ソースライン
G1〜Gn,Gj ゲートライン
CE1〜CEn,CEj 共通電極ライン
REj リフレッシュライン
SMj サンプリングライン
Vpix 画素電圧
VCE コモン電圧
Vs サンプリング電圧
Claims (10)
- マトリクス状に配置された複数の画素を有し、夫々の画素は、第1及び第2の電極と、前記第1の電極と前記第2の電極との間の電位差に応じて透過可能な光量が変化する光透過素子と、前記第1の電極にある電位を記憶しておくメモリ回路とを有するディスプレイ装置であって、
周期的に前記メモリ回路をリフレッシュするコントローラを有し、
前記コントローラは、リフレッシュタイミングで前記第1の電極が前記第2の電極に対して正の電位を有する場合に、前記メモリ回路に前記第1の電極での電位を記憶させ、前記第2の電極に第1の所定電圧を印加して前記第1の電極での電位を前記第1の所定電圧の分だけ増大させ、前記第1の電極にある電荷を放電させて前記第1の電極が前記第2の電極に対して負の電位を有するようにする、ディスプレイ装置。 - 前記コントローラは、リフレッシュタイミングで前記第1の電極が前記第2の電極に対して負の電位を有する場合に、前記メモリ回路に前記第1の電極にある電位を記憶させ、前記第2の電極に前記第1の所定電圧より低い第2の所定電圧を印加し且つ前記第1の電極に前記第1の所定電圧を印加して前記光透過素子をプリチャージし、前記第1の電極が前記第2の電極に対して正の電位を有するようにする、請求項1に記載のディスプレイ装置。
- 前記メモリ回路はDRAMを有する、請求項1又は2に記載のディスプレイ装置。
- 前記複数の画素の各列ごとに夫々設けられ該複数の画素の夫々に給電する複数のソースラインと、
前記画素の各行ごとに夫々設けられ該複数の画素の夫々に前記給電を制御する制御信号を供給する複数のゲートラインと
を更に有し、
各画素は、対応するソースラインと前記第1の電極との間に配置され、対応するゲートライン上の制御信号に応答して前記第1の電極を前記対応するソースラインに接続する第1のスイッチング素子を有し、
各画素のメモリ回路は、
前記第1の電極での電位を記憶するキャパシタと、
前記第1の電極と前記キャパシタとの間に配置され、前記第1の電極を前記キャパシタに接続するよう前記コントローラによって制御される第2のスイッチング素子と、
前記第1の電極と前記対応するソースラインとの間に配置され、前記第1の電極を前記対応するソースラインに接続して前記第1の電極にある電荷を放電させるよう前記コントローラによって制御される第3のスイッチング素子と、
前記キャパシタと前記第2のスイッチング素子との間に接続されている制御端子を有し、前記第1の画素電極と前記第3のスイッチング素子との間に配置され、前記第3のスイッチング素子を介して接続される前記対応するソースラインと前記制御端子との間の電位差に応じて導通する第4のスイッチング素子と
を有する、請求項3に記載のディスプレイ装置。 - 前記複数の画素の各列ごとに夫々設けられ該複数の画素の夫々に給電する複数のソースラインと、
前記画素の各行ごとに夫々設けられ該複数の画素の夫々に前記給電を制御する制御信号を供給する複数のゲートラインと
を更に有し、
各画素のメモリ回路は、
対応するゲートライン上の制御信号に応答して前記第1の電極を対応するソースラインに接続する第1のスイッチング素子と、
前記第1の電極での電位を記憶するキャパシタと、
前記第1の電極と前記キャパシタとの間に配置され、前記第1の電極を前記キャパシタに接続するよう前記コントローラによって制御される第2のスイッチング素子と、
前記第1の電極と前記対応するソースラインとの間に配置され、前記第1の電極を前記対応するソースラインに接続して前記第1の電極にある電荷を放電させるよう前記コントローラによって制御される第3のスイッチング素子と、
前記キャパシタと前記第2のスイッチング素子との間に接続されている制御端子を有し、前記第1の画素電極と前記第3のスイッチング素子との間に配置され、前記第3のスイッチング素子を介して接続される前記対応するソースラインと前記制御端子との間の電位差に応じて導通する第4のスイッチング素子と
を有し、
前記第1のスイッチング素子は、前記第4のスイッチング素子と並列に配置され、前記第3のスイッチング素子は、前記ソースライン上の電圧が前記第1の電極に印加されるように前記第1の電極を前記第1のスイッチング素子を介して前記ソースラインに接続するよう前記コントローラによって制御される、請求項3に記載のディスプレイ装置。 - 前記複数の画素の各列ごとに夫々設けられ該複数の画素の夫々に給電する複数のソースラインと、
前記画素の各行ごとに夫々設けられ該複数の画素の夫々に前記給電を制御する制御信号を供給する複数のゲートラインと
を更に有し、
各画素のメモリ回路は、
対応するゲートライン上の制御信号に応答して前記第1の電極を対応するソースラインに接続する第1のスイッチング素子と、
前記第1の電極での電位を記憶するキャパシタと、
前記第1の電極と前記キャパシタとの間に配置され、前記第1の電極を前記キャパシタに接続するよう前記コントローラによって制御される第2のスイッチング素子と、
前記第1の電極と前記対応するソースラインとの間に配置され、前記第1の電極を前記対応するソースラインに接続して前記第1の電極にある電荷を放電させるよう前記コントローラによって制御される第3のスイッチング素子と、
前記キャパシタと前記第2のスイッチング素子との間に接続されている制御端子を有し、前記第3のスイッチング素子と前記対応するソースラインとの間に配置され、該対応するソースラインと前記制御端子との間の電位差に応じて導通して前記第3のスイッチング素子を前記対応するソースラインに接続する第4のスイッチング素子と
を有し、
前記第1のスイッチング素子は、前記第4のスイッチング素子と並列に配置され、前記第3のスイッチング素子は、前記ソースライン上の電圧が前記第1の電極に印加されるように前記第1の電極を前記第1のスイッチング素子を介して前記ソースラインに接続するよう前記コントローラによって制御される、請求項3に記載のディスプレイ装置。 - 前記第1のスイッチング素子、前記第2のスイッチング素子、前記第3のスイッチング素子及び前記第4のスイッチング素子は薄膜トランジスタである、請求項4乃至6のうちいずれか一項に記載のディスプレイ装置。
- 前記光透過素子は液晶セルである、請求項1乃至7のうちいずれか一項記載のディスプレイ装置。
- 前記液晶セルは、前記第1の電極と前記第2の電極との間の電位差が零である場合に光を透過しない、請求項8に記載のディスプレイ装置。
- 請求項1乃至9のうちいずれか一項記載のディスプレイ装置を備える電子機器。
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