JP2011145622A - 表示装置および表示装置の駆動方法 - Google Patents
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Abstract
【解決手段】 画素回路は、リセット電源線Vrst毎に設けられ、第1端子がリセット電源VRSTに接続され、第2端子がリセット電源配線Vrstに接続され、制御端子が走査線Sgに接続された複数のリセットスイッチRSTと、初期化用電源配線Vini毎に設けられ、第1端子が初期化電源VINIに接続され、第2端子が初期化用電源配線Viniに接続され、制御端子が走査線Sgに接続された複数の第1初期化スイッチIST1と、初期化電源線Vini毎に設けられ、第1端子がオフリーク制御電源VOCTに接続され、第2端子が初期化用電源配線Viniに接続され、制御端子が走査線Sgに接続された複数の第2初期化スイッチIST2を有する表示装置。
【選択図】図2
Description
Iel=β×{(Vsig−VINI−ΔV1)×Cel/(Cs+Cel)}2、
β=μ・CoxW/2L、(W:チャネル幅、L:チャネル長)
となり、駆動トランジスタDRTの閾値Vthに依存しない値となる。そのため、駆動トランジスタの閾値のばらつきによる影響を排除することができる。
Iel=β×{(Vsig−VINI−ΔV1)×(Cel+Cad)/(Cs+Cel+Cad)}2、
β=μ・CoxW/2L、(W:チャネル幅、L:チャネル長)
となる。上記のように、補助容量Cadにより電流Ielの調整が行われている。以上のことから、本実施形態に係る表示装置および表示装置の駆動方法によれば、クロストークやフリッカの無い、高精細で表示品位の向上したアクティブマトリクス型の表示装置およびその駆動方法を提供することができる。
Iel=β×{(Vsig−VINI−ΔV1)×(Cel+Cad)/(Cs+Cel+Cad)}2、
β=μ・CoxW/2L、(W:チャネル幅、L:チャネル長)
となる。上記のように、補助容量Cadにより電流Ielの調整が行われている。以上のことから、本実施形態に係る表示装置および表示装置の駆動方法によれば、クロストークやフリッカの無い、高精細で表示品位の向上したアクティブマトリクス型の表示装置およびその駆動方法を提供することができる。
Iel=β×{(Vsig−VINI−ΔV1)×(Cel+Cad)/(Cs+Cel+Cad)}2、
β=μ・CoxW/2L、(W:チャネル幅、L:チャネル長)
となる。補助容量Cadにより、電流Ielの調整が行われている。
Iel=β×{(Vsig−VINI−ΔV1)×(Cel+Cad)/(Cs+Cel+Cad)}2、
β=μ・CoxW/2L、(W:チャネル幅、L:チャネル長)
となる。補助容量Cadにより、Iel電流の調整が行われている。
Iel=β×{(Vsig−VINI−ΔV1)×(Cel+Cad)/(Cs+Cel+Cad)}2、
β=μ・CoxW/2L、(W:チャネル幅、L:チャネル長)
となる。補助容量Cadにより、電流Ielの調整が行われている。
Iel=β×{(Vsig−VINI−ΔV1)×(Cel+Cad)/(Cs+Cel+Cad)}2、
β=μ・CoxW/2L、(W:チャネル幅、L:チャネル長)
となる。補助容量Cadにより、電流Ielの調整が行われている。
Iel=β×{(Vsig−VINI−ΔV1)×(Cel+Cad)/(Cs+Cel+Cad)}2、
β=μ・CoxW/2L、(W:チャネル幅、L:チャネル長)
となる。上記のように補助容量Cadにより、電流Ielの調整が行われている。
Iel=β×{(Vsig−VINI−ΔV1)×(Cel+Cad)/(Cs+Cel+Cad)}2、
β=μ・CoxW/2L、(W:チャネル幅、L:チャネル長)
となる。補助容量Cadにより、電流Ielの調整が行われている。
Claims (11)
- 発光素子と、前記発光素子に駆動電流を供給する画素回路とを含み、基板上にマトリクス状に配設された複数の画素部と、
前記画素部の配列する行に沿って配置された複数の走査線と、
前記画素部の配列する列に沿って配置された複数の映像信号配線と、
前記画素部の配列する行または列に沿って配置された複数のリセット電源配線と、
前記画素部の配列する行または列に沿って配置された複数の初期化用電源配線と、
高電位電圧電源線および低電位電圧電源線と、
前記複数の走査線に順次制御信号を供給して画素部を行単位で線順次走査する走査線駆動回路と、
前記映像信号配線に前記線順次走査に合せて映像電圧信号を供給する信号線駆動回路と、を具備し、
前記複数の走査線は、第1乃至第7走査線を備え、
前記画素回路は、前記低電位電圧電源線と前記高電位電圧電源線との間で前記表示素子と直列に接続され、第1端子が前記表示素子に接続され第2端子が前記リセット電源配線に接続された駆動トランジスタと、
第1端子が前記高電位電圧電源に接続され、第2端子が前記駆動トランジスタの第2端子に接続され、制御端子が前記第1走査線に接続された出力スイッチと、
前記駆動トランジスタの第1端子と制御端子との間に接続された保持容量と、
第1端子が前記初期化用電源配線に接続され、制御端子が前記第4走査線に接続されたオフリークコントロールスイッチと、
第1端子が前記映像信号配線に接続され、第2端子が前記オフリークコントロールスイッチの第2端子に接続され、制御端子が前記第2走査線に接続され、前記映像信号配線から映像電圧信号を取り込み前記保持容量に保持する第1画素スイッチと、
第1端子が前記オフリークコントロールスイッチの第2端子に接続され、第2端子が前記駆動トランジスタの制御端子に接続され、制御端子が前記第3走査線に接続された第2画素スイッチと、を備え、
前記走査線駆動回路は、前記リセット電源配線毎に設けられ、第1端子がリセット電源に接続され、第2端子が前記リセット電源配線に接続され、制御端子が前記第5走査線に接続された複数のリセットスイッチと、
前記初期化用電源配線毎に設けられ、第1端子が初期化電源に接続され、第2端子が前記初期化用電源配線に接続され、制御端子が前記第6走査線に接続された複数の第1初期化スイッチと、
前記初期化用電源配線毎に設けられ、第1端子がオフリーク制御電源に接続され、第2端子が前記初期化用電源配線に接続され、制御端子が前記第7走査線に接続された複数の第2初期化スイッチを有する表示装置。 - 前記第1初期化スイッチと前記第2初期化スイッチとは極性が異なるトランジスタで形成され、前記第1初期化スイッチの制御端子に接続された前記第6走査線と前記第2初期化スイッチの制御端子に接続された前記第7走査線とは共通である請求項1に記載の表示装置。
- 前記リセットスイッチの制御端子に接続された前記第5走査線と前記出力スイッチの制御端子に接続された前記第1走査線とは共通である請求項1または請求項2に記載の表示装置。
- 前記オフリークコントロールスイッチと第1画素スイッチとは極性が異なるトランジスタで形成され、前記オフリークコントロールスイッチの制御端子に接続された前記第4走査線と前記第1画素スイッチの制御端子に接続された前記第2走査線とは共通である請求項1乃至請求項3のいずれか1項に記載の表示装置。
- 前記第1初期化スイッチ、前記第2初期化スイッチ、および前記第2画素スイッチの制御端子に接続された前記第6走査線、前記第7走査線、および前記第3走査線は共通である請求項1乃至請求項4のいずれか1項に記載の表示装置。
- 前記出力スイッチは複数の前記画素部に共有されている請求項1乃至請求項5のいずれか1項に記載の表示装置。
- 複数の前記画素部は、各行に沿って交互に並んで設けられた赤表示用の画素部、緑表示用の画素部、青表示用の画素部を含み、
前記出力スイッチは、赤表示用の画素部、緑表示用の画素部、青表示用の画素部の3つの画素部に共有されている請求項1乃至請求項6のいずれか1項に記載の表示装置。 - 前記初期化用電源配線から前記駆動トランジスタの制御端子に初期化電位を印加し、前記リセット電源配線から前記駆動トランジスタの第1端子にリセット電位を印加して駆動トランジスタを初期化し、
前記駆動トランジスタの制御端子に前記映像信号配線から初期化電位を印加した状態で、前記高電位電圧電源から前記駆動トランジスタに電流を流し、
前記駆動トランジスタの制御端子に前記初期化用電源配線から初期化電位を印加した状態で、前記高電位電圧電源から前記駆動トランジスタに電流を流し、前記駆動トランジスタの閾値オフセットをキャンセルし、
前記映像信号配線から前記駆動トランジスタの制御端子に前記映像電圧信号を書き込むとともに、前記高電位電圧電源線から前記駆動トランジスタを通して前記低電位電圧電源線に電流を流し、
第2画素スイッチの第1端子にオフリーク制御電源からオフリーク制御電位を印加した状態で、前記高電位電圧電源線から前記駆動トランジスタを通して前記映像電圧信号に応じた駆動電流を前記表示素子に供給する、表示装置の駆動方法。 - 1水平期間内に、前記信号線駆動回路から初期化用電圧信号、赤用映像電圧信号、緑用映像電圧信号、青用映像電圧信号を順次出力する請求項8項に記載の表示装置の駆動方法。
- 陰極が低電位電源配線に接続された発光素子と、ソース電極が高電位電源配線に接続された駆動トランジスタと、ソース電極が前記駆動トランジスタのドレイン電極に接続され、ドレイン電極が前記発光素子の陽極に接続された出力スイッチと、を含む画素回路と、前記画素回路の動作を制御する制御手段と、を備えた表示装置の駆動方法であって、
前記制御手段は、前記発光素子の発光期間を複数の期間に分割し、
複数の期間のそれぞれにおいて前記出力スイッチをオンおよびオフする動作を制御して前記発光素子の発光時間を制御し、
前記複数の期間数がブランキング期間を加えた1垂直期間内の全水平期間数とゲートライン数との公約数である表示装置の駆動方法。 - 前記発光期間分割数の2倍の値は、ブランキング期間を加えた1垂直期間内の全水平期間数とゲートライン数との公約数でない請求項10記載の表示装置の駆動方法。
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