JP2011112722A - 表示装置およびその駆動方法ならびに電子機器 - Google Patents
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Abstract
【課題】移動度μの補正に適した時間ｔを過度に短くすることなく、高輝度化を実現することの可能な表示装置およびその駆動方法ならびに電子機器を提供する。
【解決手段】有機ＥＬ素子１１と直列に接続された駆動トランジスタＴｒ1として、デュアルゲート型のトランジスタが用いられている。有機ＥＬ素子１１を発光させる時、または有機ＥＬ素子１１を発光させている時に、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている時とは異なる所定の値の電圧がバックゲートＧ２に印加される。これにより、トップゲートＧ１に書き込む信号電圧Ｖsigの大きさを大きくする代わりに、バックゲートＧ２に印加する電圧を適切に調整することにより、有機ＥＬ素子１１に流れる電流Ｉdを大きくすることができる。
【選択図】図２
【解決手段】有機ＥＬ素子１１と直列に接続された駆動トランジスタＴｒ1として、デュアルゲート型のトランジスタが用いられている。有機ＥＬ素子１１を発光させる時、または有機ＥＬ素子１１を発光させている時に、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている時とは異なる所定の値の電圧がバックゲートＧ２に印加される。これにより、トップゲートＧ１に書き込む信号電圧Ｖsigの大きさを大きくする代わりに、バックゲートＧ２に印加する電圧を適切に調整することにより、有機ＥＬ素子１１に流れる電流Ｉdを大きくすることができる。
【選択図】図２
Description
本発明は、画素ごとに配置した発光素子で画像を表示する表示装置およびその駆動方法に関する。また、本発明は、上記表示装置を備えた電子機器に関する。
近年、画像表示を行う表示装置の分野では、画素の発光素子として、流れる電流値に応じて発光輝度が変化する電流駆動型の光学素子、例えば有機ＥＬ(electro luminescence)素子を用いた表示装置が開発され、商品化が進められている。
有機ＥＬ素子は、液晶素子などと異なり自発光素子である。そのため、有機ＥＬ素子を用いた表示装置（有機ＥＬ表示装置）では、光源（バックライト）が必要ないので、光源を必要とする液晶表示装置と比べて画像の視認性が高く、消費電力が低く、かつ素子の応答速度が速い。
有機ＥＬ表示装置では、液晶表示装置と同様、その駆動方式として単純（パッシブ）マトリクス方式とアクティブマトリクス方式とがある。前者は、構造が単純であるものの、大型かつ高精細の表示装置の実現が難しいなどの問題がある。そのため、現在では、アクティブマトリクス方式の開発が盛んに行なわれている。この方式は、画素ごとに配した有機ＥＬ素子に流れる電流を、有機ＥＬ素子ごとに設けた画素回路内に設けた能動素子（一般にはＴＦＴ(Thin Film Transistor;薄膜トランジスタ)）によって制御するものである。
一般的に、有機ＥＬ素子の電流−電圧（Ｉ−Ｖ）特性は、時間の経過に従って劣化（経時劣化）する。有機ＥＬ素子を電流駆動する画素回路では、有機ＥＬ素子のＩ−Ｖ特性が経時変化すると、有機ＥＬ素子と、有機ＥＬ素子に直列に接続されたＴＦＴとの分圧比が変化するので、ＴＦＴのゲート−ソース間電圧Ｖgsも変化する。その結果、ＴＦＴに流れる電流値が変化するので、有機ＥＬ素子に流れる電流値も変化し、その電流値に応じて発光輝度も変化する。
また、ＴＦＴにおいて、閾値電圧Ｖthや移動度μが経時的に変化したり、製造プロセスのばらつきによって画素回路ごとに異なったりする場合がある。ＴＦＴの閾値電圧Ｖthや移動度μが画素回路ごとに異なる場合には、ＴＦＴに流れる電流値が画素回路ごとにばらつく。その結果、ＴＦＴのゲートに同じ電圧を印加しても、有機ＥＬ素子の発光輝度がばらつき、画面の一様性（ユニフォーミティ）が損なわれる。
そこで、有機ＥＬ素子のＩ−Ｖ特性が経時変化したり、ＴＦＴの閾値電圧Ｖthや移動度μが経時変化したりしても、それらの影響を受けることなく、有機ＥＬ素子の発光輝度を一定に保つようにするために、ＴＦＴの閾値電圧Ｖthや移動度μを補正する方策が提案されている（例えば、特許文献１参照）。
ところで、有機ＥＬ表示装置の分野では、高輝度化および高精細化が強く要求されている。そのため、例えば、信号電圧Ｖsigを大きくしたり、画素サイズを小さくしたりする方策が一般に採られている。しかし、そのようにした結果、移動度μの補正に適した時間ｔ（以下の数１、数２参照）が短くなり、実際に移動度μを補正したときの補正時間がばらつくので、そのばらつきに起因して画面にスジムラが生じ、画質が低下してしまうという問題があった。なお、数１において、ｋは、（１／２）（Ｗ／Ｌ）Ｃｏｘである。Ｗはトランジスタのチャネル幅、Ｌはトランジスタのチャネル長、Ｃｏｘはゲート容量をそれぞれ表している。数２において、Ｃsは画素回路内の保持容量、Ｃsubは補助容量、Ｃoledは有機ＥＬ素子の容量をそれぞれ表している。
本発明はかかる問題点に鑑みてなされたもので、その目的は、移動度μの補正に適した時間ｔを過度に短くすることなく、高輝度化を実現することの可能な表示装置およびその駆動方法ならびに電子機器を提供することにある。
本発明の表示装置は、一組の発光素子および画素回路が２次元配置された表示部と、映像信号に基づいて画素回路を駆動する駆動部とを備えたものである。画素回路は、２つのトランジスタ（第１トランジスタ，第２トランジスタ）を有している。第１トランジスタは、第１ゲートおよび第２ゲートを含んでおり、発光素子に流れる電流を制御するデュアルゲート型のトランジスタである。一方、第２トランジスタは、映像信号に応じた信号電圧を第１ゲートに書き込むトランジスタである。駆動部は、第１トランジスタの閾値補正および移動度補正を行っている時と、発光素子を発光させている時とで、第２ゲートに印加する電圧を異ならせるようになっている。
本発明の電子機器は、上記表示装置を備えたものである。
本発明の表示装置の駆動方法は、以下の２つのステップを含むものである。
（Ａ）以下の構成を備えた表示装置を用意するステップ
（Ｂ）駆動部を用いて、第１トランジスタの閾値補正および移動度補正を行っている時に第２ゲートに第１電圧を印加したのち、発光素子を発光させている時に第２ゲートに第１電圧とは大きさの異なる第２電圧を印加するステップ
（Ａ）以下の構成を備えた表示装置を用意するステップ
（Ｂ）駆動部を用いて、第１トランジスタの閾値補正および移動度補正を行っている時に第２ゲートに第１電圧を印加したのち、発光素子を発光させている時に第２ゲートに第１電圧とは大きさの異なる第２電圧を印加するステップ
上記駆動方法が用いられる表示装置は、一組の発光素子および画素回路が２次元配置された表示部と、映像信号に基づいて画素回路を駆動する駆動部とを備えたものである。画素回路は、２つのトランジスタ（第１トランジスタ，第２トランジスタ）を有している。第１トランジスタは、第１ゲートおよび第２ゲートを含んでおり、発光素子に流れる電流を制御するデュアルゲート型のトランジスタである。一方、第２トランジスタは、映像信号に応じた信号電圧を第１ゲートに書き込むトランジスタである。
本発明の表示装置およびその駆動方法ならびに電子機器では、第１トランジスタの閾値補正および移動度補正を行っている時と、発光素子を発光させている時とで、第１トランジスタの第２ゲートに印加する電圧が異なっている。これにより、第１ゲートに書き込む信号電圧の大きさを大きくする代わりに、第２ゲートに印加する電圧を適切に調整することにより、発光素子に流れる電流を大きくすることができる。
本発明の表示装置およびその駆動方法ならびに電子機器によれば、第１ゲートに書き込む信号電圧の大きさを大きくする代わりに、第２ゲートに印加する電圧を適切に調整することにより、発光素子に流れる電流を大きくすることができるようにした。これにより、第１ゲートに書き込む信号電圧を大きくしなくても、高輝度を得ることができるので、移動度μの補正に適した時間ｔを過度に短くすることなく、高輝度化を実現することができる。
以下、発明を実施するための形態について、図面を参照して詳細に説明する。なお、説明は以下の順序で行う。
１．第１の実施の形態（図１〜図４）
○バックゲートが常にトップゲートおよびソースから独立している例
２．第２の実施の形態（図５〜図９）
○バックゲートが常にトップゲートから独立している例
○バックゲートが所定の期間の間だけソースと同電圧となる例
３．モジュールおよび適用例（図１０〜図１５）
１．第１の実施の形態（図１〜図４）
○バックゲートが常にトップゲートおよびソースから独立している例
２．第２の実施の形態（図５〜図９）
○バックゲートが常にトップゲートから独立している例
○バックゲートが所定の期間の間だけソースと同電圧となる例
３．モジュールおよび適用例（図１０〜図１５）
＜第１の実施の形態＞
（表示装置の概略構成）
図１は、本発明の第１の実施の形態に係る表示装置１の概略構成を表したものである。この表示装置１は、表示パネル１０（表示部）と、駆動回路２０（駆動部）とを備えている。表示パネル１０は、例えば、複数の有機ＥＬ素子１１Ｒ，１１Ｇ，１１Ｂ（発光素子）が２次元配置された画素回路アレイ部１３を有している。本実施の形態では、例えば、互いに隣り合う３つの有機ＥＬ素子１１Ｒ，１１Ｇ，１１Ｂが１つの画素１２を構成している。なお、以下では、有機ＥＬ素子１１Ｒ，１１Ｇ，１１Ｂの総称として有機ＥＬ素子１１を適宜、用いるものとする。駆動回路２０は、画素回路アレイ部１３を駆動するものであり、例えば、映像信号処理回路２１、タイミング生成回路２２、信号線駆動回路２３、書込線駆動回路２４、電源線駆動回路２５およびバックゲート線駆動回路２６を有している。
（表示装置の概略構成）
図１は、本発明の第１の実施の形態に係る表示装置１の概略構成を表したものである。この表示装置１は、表示パネル１０（表示部）と、駆動回路２０（駆動部）とを備えている。表示パネル１０は、例えば、複数の有機ＥＬ素子１１Ｒ，１１Ｇ，１１Ｂ（発光素子）が２次元配置された画素回路アレイ部１３を有している。本実施の形態では、例えば、互いに隣り合う３つの有機ＥＬ素子１１Ｒ，１１Ｇ，１１Ｂが１つの画素１２を構成している。なお、以下では、有機ＥＬ素子１１Ｒ，１１Ｇ，１１Ｂの総称として有機ＥＬ素子１１を適宜、用いるものとする。駆動回路２０は、画素回路アレイ部１３を駆動するものであり、例えば、映像信号処理回路２１、タイミング生成回路２２、信号線駆動回路２３、書込線駆動回路２４、電源線駆動回路２５およびバックゲート線駆動回路２６を有している。
［画素回路アレイ部］
図２は、画素回路アレイ部１３の回路構成の一例を表したものである。画素回路アレイ部１３は、表示パネル１０の表示領域に形成されている。画素回路アレイ部１３は、例えば、図１、図２に示したように、行状に配置された複数の書込線ＷＳＬと、列状に配置された複数の信号線ＤＴＬと、書込線ＷＳＬに沿って行状に配置された複数の電源線ＰＳＬおよび複数のバックゲート線ＢＧＬとを有している。各書込線ＷＳＬと各信号線ＤＴＬとの交差部に対応して、一組の有機ＥＬ素子１１および画素回路１４が行列状に配置（２次元配置）されている。画素回路１４は、例えば、駆動トランジスタＴｒ1（第１トランジスタ）、書き込みトランジスタＴｒ2（第２トランジスタ）および保持容量Ｃsによって構成されたものであり、２Ｔｒ１Ｃの回路構成となっている。
図２は、画素回路アレイ部１３の回路構成の一例を表したものである。画素回路アレイ部１３は、表示パネル１０の表示領域に形成されている。画素回路アレイ部１３は、例えば、図１、図２に示したように、行状に配置された複数の書込線ＷＳＬと、列状に配置された複数の信号線ＤＴＬと、書込線ＷＳＬに沿って行状に配置された複数の電源線ＰＳＬおよび複数のバックゲート線ＢＧＬとを有している。各書込線ＷＳＬと各信号線ＤＴＬとの交差部に対応して、一組の有機ＥＬ素子１１および画素回路１４が行列状に配置（２次元配置）されている。画素回路１４は、例えば、駆動トランジスタＴｒ1（第１トランジスタ）、書き込みトランジスタＴｒ2（第２トランジスタ）および保持容量Ｃsによって構成されたものであり、２Ｔｒ１Ｃの回路構成となっている。
駆動トランジスタＴｒ1は、トップゲートＧ１（第１ゲート）およびバックゲートＧ２（第２ゲート）を有するデュアルゲート型のトランジスタにより形成されている。駆動トランジスタＴｒ1は、例えば、ｎチャネルＭＯＳ型の薄膜トランジスタ（ＴＦＴ（Thin Film Transistor））により形成されている。書き込みトランジスタＴｒ2は、例えば、デュアルゲート型、トップゲート型、またはボトムゲート型のトランジスタにより形成されている。書き込みトランジスタＴｒ2は、例えば、ｎチャネルＭＯＳ型のＴＦＴにより形成されている。なお、駆動トランジスタＴｒ1または書き込みトランジスタＴｒ2は、ｐチャネルＭＯＳ型のＴＦＴにより形成されていてもよい。
画素回路アレイ部１３において、各信号線ＤＴＬは、信号線駆動回路２３の出力端（図示せず）と、書き込みトランジスタＴｒ2のドレイン電極（図示せず）に接続されている。各書込線ＷＳＬは、書込線駆動回路２４の出力端（図示せず）と、書き込みトランジスタＴｒ2のゲート電極（図示せず）に接続されている。各電源線ＰＳＬは、電源線駆動回路２５の出力端（図示せず）と、駆動トランジスタＴｒ1のドレイン電極（図示せず）に接続されている。書き込みトランジスタＴｒ2のソース電極（図示せず）は、駆動トランジスタＴｒ1のトップゲート電極（図示せず）と、保持容量Ｃsの一端に接続されている。駆動トランジスタＴｒ1のソース電極（図示せず）と保持容量Ｃsの他端とが、有機ＥＬ素子１１のアノード電極（図示せず）に接続されている。有機ＥＬ素子１１のカソード電極（図示せず）は、例えばグラウンド線ＧＮＤに接続されている。駆動トランジスタＴｒ1のバックゲート電極（図示せず）は、バックゲート線ＢＧＬに接続されている。なお、カソード電極は、各有機ＥＬ素子１１の共通電極として用いられており、例えば、表示パネル１０の表示領域全体に渡って連続して形成され、平板状となっている。
［駆動回路］
次に、画素回路アレイ部１３の周辺に設けられた駆動回路２０内の各回路について、図１を参照して説明する。
次に、画素回路アレイ部１３の周辺に設けられた駆動回路２０内の各回路について、図１を参照して説明する。
映像信号処理回路２１は、外部から入力されたデジタルの映像信号２０Ａに対して所定の補正を行うと共に、補正した後の映像信号２１Ａを信号線駆動回路２３に出力するようになっている。所定の補正としては、例えば、ガンマ補正や、オーバードライブ補正などが挙げられる。
タイミング生成回路２２は、信号線駆動回路２３、書込線駆動回路２４、電源線駆動回路２５およびバックゲート線駆動回路２６が連動して動作するように制御するものである。タイミング生成回路２２は、例えば、外部から入力された同期信号２０Ｂに応じて（同期して）、これらの回路に対して制御信号２２Ａを出力するようになっている。
信号線駆動回路２３は、制御信号２２Ａの入力に応じて（同期して）、映像信号２１Ａに対応するアナログの映像信号を各信号線ＤＴＬに印加して、アナログの映像信号またはそれに対応する信号を選択対象の画素回路１４に書き込むものである。具体的には、信号線駆動回路２３は、映像信号２１Ａに対応する信号電圧Ｖsigを各信号線ＤＴＬに印加して、選択対象の画素回路１４への書き込みを行うものである。なお、書き込みとは、駆動トランジスタＴｒ1のトップゲートＧ１に所定の電圧を印加することを指している。
信号線駆動回路２３は、例えば、信号電圧Ｖsigと、有機ＥＬ素子１１の消光時に駆動トランジスタＴｒ1のトップゲートＧ１に印加する電圧Ｖofsとを出力することが可能となっている。ここで、電圧Ｖofsは、有機ＥＬ素子１１の閾値電圧Ｖelよりも低い電圧値（一定値）である。
書込線駆動回路２４は、制御信号２２Ａの入力に応じて（同期して）、複数の書込線ＷＳＬに選択パルスを順次印加して、複数の有機ＥＬ素子１１および複数の画素回路１４を順次選択するものである。書込線駆動回路２４は、例えば、書き込みトランジスタＴｒ2をオンさせるときに印加する電圧Ｖon1と、書き込みトランジスタＴｒ2をオフさせるときに印加する電圧Ｖoff1とを出力することが可能となっている。
電源線駆動回路２５は、制御信号２２Ａの入力に応じて（同期して）、複数の電源線ＰＳＬに制御パルスを順次印加して、有機ＥＬ素子１１の発光および消光を制御するものである。電源線駆動回路２５は、例えば、駆動トランジスタＴｒ1に電流を流すときに印加する電圧ＶccHと、駆動トランジスタＴｒ1に電流を流さないときに印加する電圧ＶccLとを出力することが可能となっている。ここで、電圧ＶccLは、有機ＥＬ素子１１の閾値電圧Ｖelと、有機ＥＬ素子１１のカソードの電圧Ｖcaとを足し合わせた電圧（Ｖel＋Ｖca）よりも低い電圧値（一定値）である。ＶccHは、電圧（Ｖel＋Ｖca）以上の電圧値（一定値）である。
バックゲート線駆動回路２６は、制御信号２２Ａの入力に応じて（同期して）、複数のバックゲート線ＢＧＬに制御パルスを順次印加して、選択対象の有機ＥＬ素子１１に流れている電流Ｉdを所望の大きさにまで増大させるものである。バックゲート線駆動回路２６は、例えば、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている時に印加する電圧Ｖb1（第１電圧）と、有機ＥＬ素子１１を発光させている時に印加する電圧Ｖb2（第２電圧）とを出力することが可能となっている。電圧Ｖb1および電圧Ｖb2は、互いに異なる電圧値となっている。電圧Ｖb1は、例えば０Ｖ（ゼロボルト）である。電圧Ｖb2は、駆動トランジスタＴｒ1がｎチャネル型である場合には、電圧Ｖb1よりも高くなっており、例えば、＋２．０Ｖである。また、電圧Ｖb2は、駆動トランジスタＴｒ1がｐチャネル型である場合には、電圧Ｖb1よりも低くなっており、例えば、−２．０Ｖである。
（表示装置１の動作）
図３は、表示装置１を駆動させたときの各種波形の一例を表したものである。図３（Ａ），（Ｂ）には、信号線ＤＴＬにＶsig、Ｖofsが周期的に印加され、書込線ＷＳＬにＶon1、Ｖoff1が所定のタイミングで印加されている様子がそれぞれ示されている。図３（Ｃ），（Ｄ）には、電源線ＰＳＬにＶccL、ＶccHが所定のタイミングで印加され、バックゲート線ＢＧＬにＶb1、Ｖb2が所定のタイミングで印加されている様子がそれぞれ示されている。なお、図３（Ｄ）には、電圧Ｖb2が電圧Ｖb1よりも高くなっている場合、すなわち、駆動トランジスタＴｒ1がｐチャネル型である場合の波形が例示されている。図３（Ｅ），（Ｆ）には、信号線ＤＴＬ、書込線ＷＳＬ、電源線ＰＳＬおよびバックゲート線ＢＧＬへの電圧印加に応じて、駆動トランジスタＴｒ1のゲート電圧Ｖgおよびソース電圧Ｖsが時々刻々変化している様子が示されている。図３（Ｇ）には、有機ＥＬ素子１１に流れる電流Ｉdが時々刻々変化している様子が示されている。
図３は、表示装置１を駆動させたときの各種波形の一例を表したものである。図３（Ａ），（Ｂ）には、信号線ＤＴＬにＶsig、Ｖofsが周期的に印加され、書込線ＷＳＬにＶon1、Ｖoff1が所定のタイミングで印加されている様子がそれぞれ示されている。図３（Ｃ），（Ｄ）には、電源線ＰＳＬにＶccL、ＶccHが所定のタイミングで印加され、バックゲート線ＢＧＬにＶb1、Ｖb2が所定のタイミングで印加されている様子がそれぞれ示されている。なお、図３（Ｄ）には、電圧Ｖb2が電圧Ｖb1よりも高くなっている場合、すなわち、駆動トランジスタＴｒ1がｐチャネル型である場合の波形が例示されている。図３（Ｅ），（Ｆ）には、信号線ＤＴＬ、書込線ＷＳＬ、電源線ＰＳＬおよびバックゲート線ＢＧＬへの電圧印加に応じて、駆動トランジスタＴｒ1のゲート電圧Ｖgおよびソース電圧Ｖsが時々刻々変化している様子が示されている。図３（Ｇ）には、有機ＥＬ素子１１に流れる電流Ｉdが時々刻々変化している様子が示されている。
［Ｖth補正準備期間］
まず、Ｖth補正の準備を行う。具体的には、電源線駆動回路２５が電源線ＰＳＬの電圧をＶccHからＶccLに下げる（Ｔ1）。すると、ソース電圧ＶsがＶccLとなり、有機ＥＬ素子１１が消光すると共に、ゲート電圧ＶgがＶofsに下がる。次に、バックゲート線駆動回路２６は、Ｖth補正が開始されるまでの間に、具体的には、電源線ＰＳＬの電圧がＶccLとなっている間に、バックゲート線ＢＧＬの電圧をＶb2からＶb1に変更する（Ｔ2）。バックゲート線駆動回路２６は、その後、引き続き、駆動トランジスタＴｒ1の閾値補正および移動度補正が終わり、有機ＥＬ素子１１の発光が開始されるまでの間、バックゲート線ＢＧＬの電圧をＶb1に維持する。つまり、バックゲート線駆動回路２６は、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている間、バックゲート線ＢＧＬにＶb1を印加する。
まず、Ｖth補正の準備を行う。具体的には、電源線駆動回路２５が電源線ＰＳＬの電圧をＶccHからＶccLに下げる（Ｔ1）。すると、ソース電圧ＶsがＶccLとなり、有機ＥＬ素子１１が消光すると共に、ゲート電圧ＶgがＶofsに下がる。次に、バックゲート線駆動回路２６は、Ｖth補正が開始されるまでの間に、具体的には、電源線ＰＳＬの電圧がＶccLとなっている間に、バックゲート線ＢＧＬの電圧をＶb2からＶb1に変更する（Ｔ2）。バックゲート線駆動回路２６は、その後、引き続き、駆動トランジスタＴｒ1の閾値補正および移動度補正が終わり、有機ＥＬ素子１１の発光が開始されるまでの間、バックゲート線ＢＧＬの電圧をＶb1に維持する。つまり、バックゲート線駆動回路２６は、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている間、バックゲート線ＢＧＬにＶb1を印加する。
［最初のＶth補正期間］
次に、Ｖthの補正を行う。具体的には、信号線ＤＴＬの電圧がＶofsとなっており、かつ書込線ＷＳＬの電圧がＶon1となっている間に、電源線駆動回路２５が電源線ＰＳＬの電圧をＶccLからＶccHに上げる（Ｔ3）。すると、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れ、ソース電圧Ｖsが上昇する。なお、図３（Ｇ）では、縦軸のスケールの関係で、電流Ｉdの変化がほとんど見られない。その後、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える前に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ4）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなり、Ｖthの補正が一旦停止する。
次に、Ｖthの補正を行う。具体的には、信号線ＤＴＬの電圧がＶofsとなっており、かつ書込線ＷＳＬの電圧がＶon1となっている間に、電源線駆動回路２５が電源線ＰＳＬの電圧をＶccLからＶccHに上げる（Ｔ3）。すると、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れ、ソース電圧Ｖsが上昇する。なお、図３（Ｇ）では、縦軸のスケールの関係で、電流Ｉdの変化がほとんど見られない。その後、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える前に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ4）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなり、Ｖthの補正が一旦停止する。
［最初のＶth補正休止期間］
Ｖth補正が休止している期間中は、先のＶth補正を行った行（画素）とは異なる他の行（画素）において、信号線ＤＴＬの電圧のサンプリングが行われる。なお、Ｖth補正が不十分である場合、すなわち、駆動トランジスタＴｒ1のゲート−ソース間の電位差Ｖgsが駆動トランジスタＴｒ1の閾値電圧Ｖthよりも大きい場合には、以下のようになる。すなわち、Ｖth補正休止期間中にも、先のＶth補正を行った行（画素）において、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れ、ソース電圧Ｖsが上昇し、保持容量Ｃsを介したカップリングによりゲート電圧Ｖgも上昇する。
Ｖth補正が休止している期間中は、先のＶth補正を行った行（画素）とは異なる他の行（画素）において、信号線ＤＴＬの電圧のサンプリングが行われる。なお、Ｖth補正が不十分である場合、すなわち、駆動トランジスタＴｒ1のゲート−ソース間の電位差Ｖgsが駆動トランジスタＴｒ1の閾値電圧Ｖthよりも大きい場合には、以下のようになる。すなわち、Ｖth補正休止期間中にも、先のＶth補正を行った行（画素）において、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れ、ソース電圧Ｖsが上昇し、保持容量Ｃsを介したカップリングによりゲート電圧Ｖgも上昇する。
［２回目のＶth補正期間］
Ｖth補正休止期間が終了した後、Ｖthの補正を再び行う。具体的には、信号線ＤＴＬの電圧がＶofsとなっており、Ｖth補正が可能となっている時に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶoff1からＶon1に上げ（Ｔ5）、駆動トランジスタＴｒ1のゲートを信号線ＤＴＬに接続する。このとき、ソース電圧Ｖsが（Ｖofs−Ｖth）よりも低い場合（Ｖth補正がまだ完了していない場合）には、駆動トランジスタＴｒ1がカットオフするまで（電位差ＶgsがＶthになるまで）、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れる。その結果、保持容量ＣsがＶthに充電され、電位差ＶgsがＶthとなる。なお、図３（Ｇ）では、縦軸のスケールの関係で、電流Ｉdの変化はほんのわずかである。その後、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える前に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ6）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなるので、電位差Ｖgsを信号線ＤＴＬの電圧の大きさに拘わらずＶthのままで維持することができる。このように、電位差ＶgsをＶthに設定することにより、駆動トランジスタＴｒ1の閾値電圧Ｖthが画素回路１４ごとにばらついた場合であっても、有機ＥＬ素子１１の発光輝度がばらつくのをなくすることができる。
Ｖth補正休止期間が終了した後、Ｖthの補正を再び行う。具体的には、信号線ＤＴＬの電圧がＶofsとなっており、Ｖth補正が可能となっている時に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶoff1からＶon1に上げ（Ｔ5）、駆動トランジスタＴｒ1のゲートを信号線ＤＴＬに接続する。このとき、ソース電圧Ｖsが（Ｖofs−Ｖth）よりも低い場合（Ｖth補正がまだ完了していない場合）には、駆動トランジスタＴｒ1がカットオフするまで（電位差ＶgsがＶthになるまで）、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れる。その結果、保持容量ＣsがＶthに充電され、電位差ＶgsがＶthとなる。なお、図３（Ｇ）では、縦軸のスケールの関係で、電流Ｉdの変化はほんのわずかである。その後、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える前に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ6）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなるので、電位差Ｖgsを信号線ＤＴＬの電圧の大きさに拘わらずＶthのままで維持することができる。このように、電位差ＶgsをＶthに設定することにより、駆動トランジスタＴｒ1の閾値電圧Ｖthが画素回路１４ごとにばらついた場合であっても、有機ＥＬ素子１１の発光輝度がばらつくのをなくすることができる。
［２回目のＶth補正休止期間］
その後、Ｖth補正の休止期間中に、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える。
その後、Ｖth補正の休止期間中に、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える。
［書き込み・μ補正期間］
Ｖth補正休止期間が終了した後、書き込みとμ補正を行う。具体的には、信号線ＤＴＬの電圧がＶsigとなっている間に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶoff1からＶon1に上げ（Ｔ7）、駆動トランジスタＴｒ1のゲートを信号線ＤＴＬに接続する。すると、駆動トランジスタＴｒ1のゲート電圧がＶsigとなる。このとき、有機ＥＬ素子１１のアノード電圧はこの段階ではまだ有機ＥＬ素子１１の閾値電圧Ｖelよりも小さく、有機ＥＬ素子１１はカットオフしている。そのため、電流Ｉdは有機ＥＬ素子１１の素子容量（図示せず）に流れ、素子容量が充電されるので、ソース電圧ＶsがΔＶだけ上昇し、やがて電位差ＶgsがＶsig＋Ｖth−ΔＶとなる。このようにして、書き込みと同時にμ補正が行われる。ここで、駆動トランジスタＴｒ1の移動度μが大きい程、ΔＶも大きくなるので、電位差Ｖgsを発光前にΔＶだけ小さくすることにより、画素回路１４ごとの移動度μのばらつきを取り除くことができる。
Ｖth補正休止期間が終了した後、書き込みとμ補正を行う。具体的には、信号線ＤＴＬの電圧がＶsigとなっている間に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶoff1からＶon1に上げ（Ｔ7）、駆動トランジスタＴｒ1のゲートを信号線ＤＴＬに接続する。すると、駆動トランジスタＴｒ1のゲート電圧がＶsigとなる。このとき、有機ＥＬ素子１１のアノード電圧はこの段階ではまだ有機ＥＬ素子１１の閾値電圧Ｖelよりも小さく、有機ＥＬ素子１１はカットオフしている。そのため、電流Ｉdは有機ＥＬ素子１１の素子容量（図示せず）に流れ、素子容量が充電されるので、ソース電圧ＶsがΔＶだけ上昇し、やがて電位差ＶgsがＶsig＋Ｖth−ΔＶとなる。このようにして、書き込みと同時にμ補正が行われる。ここで、駆動トランジスタＴｒ1の移動度μが大きい程、ΔＶも大きくなるので、電位差Ｖgsを発光前にΔＶだけ小さくすることにより、画素回路１４ごとの移動度μのばらつきを取り除くことができる。
［発光期間］
次に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ8）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなり、駆動トランジスタＴｒ1のゲート−ソース間の電圧Ｖgsを一定に維持した状態で、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れる。その結果、ソース電圧Ｖsが上昇し、それに連動して駆動トランジスタＴｒ1のゲートも上昇し、有機ＥＬ素子１１が所望の輝度よりも小さな輝度で発光し始める。
次に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ8）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなり、駆動トランジスタＴｒ1のゲート−ソース間の電圧Ｖgsを一定に維持した状態で、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れる。その結果、ソース電圧Ｖsが上昇し、それに連動して駆動トランジスタＴｒ1のゲートも上昇し、有機ＥＬ素子１１が所望の輝度よりも小さな輝度で発光し始める。
次に、バックゲート線駆動回路２６は、有機ＥＬ素子１１が発光を開始した直後に、バックゲート線ＢＧＬの電圧をＶb1からＶb2に変更する（Ｔ9）。すると、駆動トランジスタＴｒ1のＩd−Ｖgs特性が変化し、有機ＥＬ素子１１に流れる電流Ｉdが急激に大きくなる。その結果、有機ＥＬ素子１１が所望の輝度で発光するようになる。なお、有機ＥＬ素子１１に流れる電流Ｉdが急激に大きくなる理由については、後に詳述する。
本実施の形態の表示装置１では、上記のようにして、各画素１２において画素回路１４がオンオフ制御され、各画素１２の有機ＥＬ素子１１に駆動電流が注入されることにより、正孔と電子とが再結合して発光が起こる。この光は、有機ＥＬ素子１１の電極等を透過して外部に取り出される。その結果、表示パネル１０において画像が表示される。
（作用・効果）
ところで、従来の有機ＥＬ表示装置では、信号電圧Ｖsigを大きくしたり、画素１２のサイズを小さくしたりすることにより、高輝度化および高精細化への対応がなされてきた。しかし、そのようにした結果、移動度μの補正に適した時間ｔ（上述の数１、数２参照）が短くなり、実際に移動度μを補正したときの補正時間がばらつくので、そのばらつきに起因して画面にスジムラが生じ、画質が低下してしまうという問題があった。
ところで、従来の有機ＥＬ表示装置では、信号電圧Ｖsigを大きくしたり、画素１２のサイズを小さくしたりすることにより、高輝度化および高精細化への対応がなされてきた。しかし、そのようにした結果、移動度μの補正に適した時間ｔ（上述の数１、数２参照）が短くなり、実際に移動度μを補正したときの補正時間がばらつくので、そのばらつきに起因して画面にスジムラが生じ、画質が低下してしまうという問題があった。
一方、本実施の形態では、駆動トランジスタＴｒ1として、デュアルゲート型のトランジスタが用いられており、このデュアルゲート型のトランジスタにおける特異な特性を利用することにより、上記の問題を解決している。以下に、その特異な特性について説明する。
図４は、デュアルゲート型のトランジスタにおいて、バックゲートＧ２の電圧Ｖbgを０Ｖ、＋２．０Ｖ、または−２．０Ｖに設定したときの、飽和領域におけるＩd−Ｖgs特性の一例を表したものである。図４には、トランジスタがｎチャネル型である場合のＩd−Ｖgs特性が例示されている。図４から、トランジスタがｎチャネル型である場合には、例えば、バックゲートＧ２の電圧Ｖbgを０Ｖから＋２．０Ｖに変化させると、Ｖgsの上昇幅に対するＩdの上昇幅（Ｉd−Ｖgs特性の傾き）が大きくなることがわかる。これは、Ｖgsを一定としたときに、バックゲートＧ２の電圧Ｖbgを正の方向に変化させると、トランジスタに流れる電流Ｉdが増大することを意味している。同様のことは、トランジスタがｐチャネル型である場合にも言える。トランジスタがｐチャネル型である場合には、例えば、図示しないが、バックゲートＧ２の電圧Ｖbgを０Ｖから−２．０Ｖに変化させると、Ｖgsの上昇幅に対するＩdの上昇幅（Ｉd−Ｖgs特性の傾き）が大きくなる。これは、Ｖgsを一定としたときに、バックゲートＧ２の電圧Ｖbgを負の方向に変化させると、トランジスタに流れる電流Ｉdが増大することを意味している。
本実施の形態では、上述した特異な特性を利用するために、駆動トランジスタＴｒ1において、トップゲートＧ１と、バックゲートＧ２とが独立して駆動される。具体的には、トップゲートＧ１は書き込みトランジスタＴｒ2および信号線ＤＴＬを介して信号線駆動回路２３によって駆動され、バックゲートＧ２はバックゲート線ＢＧＬを介してバックゲート線駆動回路２６によって駆動される。
トップゲートＧ１とバックゲートＧ２との独立駆動は、例えば、以下のようにして行われる。まず、信号線駆動回路２３は、トップゲートＧ１（信号線ＤＴＬ）に印加する信号電圧Ｖsigを、移動度μを補正したときの補正時間のばらつきが問題とならない程度に小さく設定する。そして、信号線駆動回路２３は、そのように設定した信号電圧Ｖsigを移動度補正および発光に際してトップゲートＧ１（信号線ＤＴＬ）に印加する。一方、バックゲート線駆動回路２６は、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている時にバックゲートＧ２（バックゲート線ＢＧＬ）に所定の電圧Ｖb1を印加したのち、有機ＥＬ素子１１を発光させている時に電圧Ｖb1よりも大きな電圧Ｖb2をバックゲートＧ２（バックゲート線ＢＧＬ）に印加する。より詳細には、バックゲート線駆動回路２６は、消光時および発光初期（有機ＥＬ素子１１が発光を開始してからごく僅かな期間）にバックゲートＧ２（バックゲート線ＢＧＬ）に所定の電圧Ｖb1を印加し、続いて、電圧Ｖb1よりも大きな電圧Ｖb2をバックゲートＧ２（バックゲート線ＢＧＬ）に印加する。これにより、上述の信号電圧ＶsigをトップゲートＧ１（信号線ＤＴＬ）に印加したときに有機ＥＬ素子１１に通常流れる電流値よりも大きな電流Ｉdを有機ＥＬ素子１１に流すことができる。
なお、駆動トランジスタＴｒ1がｐチャネル型である場合には、バックゲート線駆動回路２６は、閾値補正および移動度補正を行っている時にバックゲートＧ２（バックゲート線ＢＧＬ）に所定の電圧Ｖb1を印加したのち、有機ＥＬ素子１１を発光させている時に電圧Ｖb1よりも小さな電圧Ｖb2をバックゲートＧ２（バックゲート線ＢＧＬ）に印加する。より詳細には、バックゲート線駆動回路２６は、消光時および発光初期（有機ＥＬ素子１１が発光を開始してからごく僅かな期間）にバックゲートＧ２（バックゲート線ＢＧＬ）に所定の電圧Ｖb1を印加し、続いて、電圧Ｖb1よりも小さな電圧Ｖb2をバックゲートＧ２（バックゲート線ＢＧＬ）に印加する。これにより、上述の信号電圧ＶsigをトップゲートＧ１（信号線ＤＴＬ）に印加したときに有機ＥＬ素子１１に通常流れる電流値よりも大きな電流Ｉdを有機ＥＬ素子１１に流すことができる。
このように、本実施の形態では、有機ＥＬ素子１１を発光させる時、または有機ＥＬ素子１１を発光させている時に、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている時とは異なる所定の値の電圧をバックゲートＧ２に印加することにより、上述の信号電圧ＶsigをトップゲートＧ１（信号線ＤＴＬ）に印加したときに有機ＥＬ素子１１に通常流れる電流値よりも大きな電流Ｉdを有機ＥＬ素子１１に流すことができる。つまり、トップゲートＧ１に書き込む信号電圧Ｖsigの大きさを大きくする代わりに、バックゲートＧ２に印加する電圧を適切に調整することにより、有機ＥＬ素子１１に流れる電流Ｉdを大きくすることができる。従って、本実施の形態では、移動度μの補正に適した時間ｔを過度に短くすることなく、高輝度化を実現することができる。
＜第２の実施の形態＞
図５は、本発明の第２の実施の形態に係る表示装置２の概略構成を表したものである。図６は、図５の表示装置２の画素回路アレイ部１３の回路構成を表したものである。この表示装置２は、駆動回路２０において制御線駆動回路２７がさらに設けられ、画素回路１４において制御トランジスタＴｒ3（スイッチング素子）および容量素子Ｃbがさらに設けられている点で、上記実施の形態の表示装置１の構成と主に相違する。そこで、以下では、表示装置１の構成と相違する点について主に説明し、表示装置１の構成と共通する点についての説明を適宜、省略するものとする。
図５は、本発明の第２の実施の形態に係る表示装置２の概略構成を表したものである。図６は、図５の表示装置２の画素回路アレイ部１３の回路構成を表したものである。この表示装置２は、駆動回路２０において制御線駆動回路２７がさらに設けられ、画素回路１４において制御トランジスタＴｒ3（スイッチング素子）および容量素子Ｃbがさらに設けられている点で、上記実施の形態の表示装置１の構成と主に相違する。そこで、以下では、表示装置１の構成と相違する点について主に説明し、表示装置１の構成と共通する点についての説明を適宜、省略するものとする。
画素回路１４は、上述したように、駆動トランジスタＴｒ1、書き込みトランジスタＴｒ2および保持容量Ｃsの他に、制御トランジスタＴｒ3および容量素子Ｃbをさらに有している。制御トランジスタＴｒ3は、例えば、デュアルゲート型、トップゲート型、またはボトムゲート型のトランジスタにより形成されている。制御トランジスタＴｒ3は、例えば、ｎチャネルＭＯＳ型のＴＦＴにより形成されている。なお、制御トランジスタＴｒ3は、ｐチャネルＭＯＳ型のＴＦＴにより形成されていてもよい。
制御トランジスタＴｒ3のドレイン電極（図示せず）は、駆動トランジスタＴｒ1のバックゲート電極（バックゲートＧ２）に接続されている。なお、図６には、制御トランジスタＴｒ3のドレイン電極と、駆動トランジスタＴｒ1のバックゲート電極との接続点がＰで表されている。制御トランジスタＴｒ3のソース電極（図示せず）は、有機ＥＬ素子１１のうち駆動トランジスタＴｒ1側の端子と、駆動トランジスタＴｒ1のソース電極とに接続されている。制御トランジスタＴｒ3のゲート電極（図示せず）は、制御線駆動回路２７から延在する制御線ＣＮＬに接続されている。接続点Ｐと、バックゲート線ＢＧＬとの間に容量素子Ｃbが設けられている。従って、本実施の形態では、駆動トランジスタＴｒ1のバックゲートＧ２は、容量素子Ｃbを介してバックゲート線ＢＧＬと接続されており、さらに、制御トランジスタＴｒ3を介して、駆動トランジスタＴｒ1のソース電極と接続されている。
制御線駆動回路２７は、制御信号２２Ａの入力に応じて（同期して）、複数の制御線ＣＮＬに制御パルスを順次印加して、選択対象の有機ＥＬ素子１１に接続された駆動トランジスタＴｒ1のバックゲートＧ２の電圧を制御するものである。制御線駆動回路２７は、例えば、制御トランジスタＴｒ3をオンさせるときに印加する電圧Ｖon2と、制御トランジスタＴｒ3をオフさせるときに印加する電圧Ｖoff2とを出力することが可能となっている。電圧Ｖon2は、主に、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている時に印加されるものである。一方、電圧Ｖoff2は、有機ＥＬ素子１１を発光させている時に印加されるものである。
（表示装置２の動作）
図７は、表示装置２を駆動させたときの各種波形の一例を表したものである。図７（Ａ），（Ｂ）には、信号線ＤＴＬにＶsig、Ｖofsが周期的に印加され、書込線ＷＳＬにＶon1、Ｖoff1が所定のタイミングで印加されている様子がそれぞれ示されている。図７（Ｃ），（Ｄ），（Ｅ）には、電源線ＰＳＬにＶccL、ＶccHが所定のタイミングで印加され、バックゲート線ＢＧＬにＶb1、Ｖb2が所定のタイミングで印加され、制御線ＣＮＬにＶon2、Ｖoff2が所定のタイミングで印加されている様子がそれぞれ示されている。なお、図３（Ｄ）には、電圧Ｖb2が電圧Ｖb1よりも高くなっている場合、すなわち、駆動トランジスタＴｒ1がｐチャネル型である場合の波形が例示されている。図３（Ｆ），（Ｇ）には、信号線ＤＴＬ、書込線ＷＳＬ、電源線ＰＳＬ、バックゲート線ＢＧＬおよび制御線ＣＮＬへの電圧印加に応じて、駆動トランジスタＴｒ1のゲート電圧Ｖgおよびソース電圧Ｖsが時々刻々変化している様子が示されている。図３（Ｈ）には、有機ＥＬ素子１１に流れる電流Ｉdが時々刻々変化している様子が示されている。
図７は、表示装置２を駆動させたときの各種波形の一例を表したものである。図７（Ａ），（Ｂ）には、信号線ＤＴＬにＶsig、Ｖofsが周期的に印加され、書込線ＷＳＬにＶon1、Ｖoff1が所定のタイミングで印加されている様子がそれぞれ示されている。図７（Ｃ），（Ｄ），（Ｅ）には、電源線ＰＳＬにＶccL、ＶccHが所定のタイミングで印加され、バックゲート線ＢＧＬにＶb1、Ｖb2が所定のタイミングで印加され、制御線ＣＮＬにＶon2、Ｖoff2が所定のタイミングで印加されている様子がそれぞれ示されている。なお、図３（Ｄ）には、電圧Ｖb2が電圧Ｖb1よりも高くなっている場合、すなわち、駆動トランジスタＴｒ1がｐチャネル型である場合の波形が例示されている。図３（Ｆ），（Ｇ）には、信号線ＤＴＬ、書込線ＷＳＬ、電源線ＰＳＬ、バックゲート線ＢＧＬおよび制御線ＣＮＬへの電圧印加に応じて、駆動トランジスタＴｒ1のゲート電圧Ｖgおよびソース電圧Ｖsが時々刻々変化している様子が示されている。図３（Ｈ）には、有機ＥＬ素子１１に流れる電流Ｉdが時々刻々変化している様子が示されている。
［Ｖth補正準備期間］
まず、Ｖth補正の準備を行う。具体的には、電源線駆動回路２５が電源線ＰＳＬの電圧をＶccHからＶccLに下げる（Ｔ1）。すると、ソース電圧ＶsがＶccLとなり、有機ＥＬ素子１１が消光すると共に、ゲート電圧ＶgがＶofsに下がる。このとき、制御線駆動回路２７が、制御線ＣＮＬの電圧をＶoff2からＶon2に上げる（Ｔ1）。すると、駆動トランジスタＴｒ1がオンし、トランジスタＴｒ1のバックゲートＧ２が駆動トランジスタＴｒ1のソースと電気的に接続され、バックゲートＧ２の電圧と、駆動トランジスタＴｒ1のソース電圧とが互いに等しくなる。なお、Ｖoff2からＶon2への変移は、ＶccHからＶccLへの変移と同時であってもよいし、ＶccHからＶccLへの変移が終わった後であってもよい。制御線駆動回路２７は、その後、引き続き、駆動トランジスタＴｒ1の閾値補正および移動度補正が終わり、有機ＥＬ素子１１の発光が開始されるまでの間、制御線ＣＮＬの電圧をＶon2に維持する。つまり、制御線駆動回路２７は、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている間、制御線ＣＮＬにＶon2を印加し続け、バックゲートＧ２の電圧を、駆動トランジスタＴｒ1のソース電圧に追従させる。
まず、Ｖth補正の準備を行う。具体的には、電源線駆動回路２５が電源線ＰＳＬの電圧をＶccHからＶccLに下げる（Ｔ1）。すると、ソース電圧ＶsがＶccLとなり、有機ＥＬ素子１１が消光すると共に、ゲート電圧ＶgがＶofsに下がる。このとき、制御線駆動回路２７が、制御線ＣＮＬの電圧をＶoff2からＶon2に上げる（Ｔ1）。すると、駆動トランジスタＴｒ1がオンし、トランジスタＴｒ1のバックゲートＧ２が駆動トランジスタＴｒ1のソースと電気的に接続され、バックゲートＧ２の電圧と、駆動トランジスタＴｒ1のソース電圧とが互いに等しくなる。なお、Ｖoff2からＶon2への変移は、ＶccHからＶccLへの変移と同時であってもよいし、ＶccHからＶccLへの変移が終わった後であってもよい。制御線駆動回路２７は、その後、引き続き、駆動トランジスタＴｒ1の閾値補正および移動度補正が終わり、有機ＥＬ素子１１の発光が開始されるまでの間、制御線ＣＮＬの電圧をＶon2に維持する。つまり、制御線駆動回路２７は、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている間、制御線ＣＮＬにＶon2を印加し続け、バックゲートＧ２の電圧を、駆動トランジスタＴｒ1のソース電圧に追従させる。
次に、バックゲート線駆動回路２６は、Ｖth補正が開始されるまでの間に、具体的には、電源線ＰＳＬの電圧がＶccLとなっている間に、バックゲート線ＢＧＬの電圧をＶb2からＶb1に変更する（Ｔ2）。バックゲート線駆動回路２６は、その後、引き続き、駆動トランジスタＴｒ1の閾値補正および移動度補正が終わり、有機ＥＬ素子１１の発光が開始されるまでの間、バックゲート線ＢＧＬの電圧をＶb1に維持する。つまり、バックゲート線駆動回路２６は、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている時に、バックゲート線ＢＧＬにＶb1を印加する。
［最初のＶth補正期間］
次に、Ｖthの補正を行う。具体的には、信号線ＤＴＬの電圧がＶofsとなっており、かつ書込線ＷＳＬの電圧がＶon1となっている間に、電源線駆動回路２５が電源線ＰＳＬの電圧をＶccLからＶccHに上げる（Ｔ3）。すると、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れ、ソース電圧Ｖsが上昇する。なお、図３（Ｇ）では、縦軸のスケールの関係で、電流Ｉdの変化がほとんど見られない。その後、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える前に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ4）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなり、Ｖthの補正が一旦停止する。
次に、Ｖthの補正を行う。具体的には、信号線ＤＴＬの電圧がＶofsとなっており、かつ書込線ＷＳＬの電圧がＶon1となっている間に、電源線駆動回路２５が電源線ＰＳＬの電圧をＶccLからＶccHに上げる（Ｔ3）。すると、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れ、ソース電圧Ｖsが上昇する。なお、図３（Ｇ）では、縦軸のスケールの関係で、電流Ｉdの変化がほとんど見られない。その後、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える前に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ4）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなり、Ｖthの補正が一旦停止する。
［最初のＶth補正休止期間］
Ｖth補正が休止している期間中は、先のＶth補正を行った行（画素）とは異なる他の行（画素）において、信号線ＤＴＬの電圧のサンプリングが行われる。なお、Ｖth補正が不十分である場合、すなわち、駆動トランジスタＴｒ1のゲート−ソース間の電位差Ｖgsが駆動トランジスタＴｒ1の閾値電圧Ｖthよりも大きい場合には、以下のようになる。すなわち、Ｖth補正休止期間中にも、先のＶth補正を行った行（画素）において、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れ、ソース電圧Ｖsが上昇し、保持容量Ｃsを介したカップリングによりゲート電圧Ｖgも上昇する。
Ｖth補正が休止している期間中は、先のＶth補正を行った行（画素）とは異なる他の行（画素）において、信号線ＤＴＬの電圧のサンプリングが行われる。なお、Ｖth補正が不十分である場合、すなわち、駆動トランジスタＴｒ1のゲート−ソース間の電位差Ｖgsが駆動トランジスタＴｒ1の閾値電圧Ｖthよりも大きい場合には、以下のようになる。すなわち、Ｖth補正休止期間中にも、先のＶth補正を行った行（画素）において、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れ、ソース電圧Ｖsが上昇し、保持容量Ｃsを介したカップリングによりゲート電圧Ｖgも上昇する。
［２回目のＶth補正期間］
Ｖth補正休止期間が終了した後、Ｖthの補正を再び行う。具体的には、信号線ＤＴＬの電圧がＶofsとなっており、Ｖth補正が可能となっている時に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶoff1からＶon1に上げ（Ｔ5）、駆動トランジスタＴｒ1のゲートを信号線ＤＴＬに接続する。このとき、ソース電圧Ｖsが（Ｖofs−Ｖth）よりも低い場合（Ｖth補正がまだ完了していない場合）には、駆動トランジスタＴｒ1がカットオフするまで（電位差ＶgsがＶthになるまで）、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れる。その結果、保持容量ＣsがＶthに充電され、電位差ＶgsがＶthとなる。なお、図３（Ｇ）では、縦軸のスケールの関係で、電流Ｉdの変化はほんのわずかである。その後、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える前に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ6）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなるので、電位差Ｖgsを信号線ＤＴＬの電圧の大きさに拘わらずＶthのままで維持することができる。このように、電位差ＶgsをＶthに設定することにより、駆動トランジスタＴｒ1の閾値電圧Ｖthが画素回路１４ごとにばらついた場合であっても、有機ＥＬ素子１１の発光輝度がばらつくのをなくすることができる。
Ｖth補正休止期間が終了した後、Ｖthの補正を再び行う。具体的には、信号線ＤＴＬの電圧がＶofsとなっており、Ｖth補正が可能となっている時に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶoff1からＶon1に上げ（Ｔ5）、駆動トランジスタＴｒ1のゲートを信号線ＤＴＬに接続する。このとき、ソース電圧Ｖsが（Ｖofs−Ｖth）よりも低い場合（Ｖth補正がまだ完了していない場合）には、駆動トランジスタＴｒ1がカットオフするまで（電位差ＶgsがＶthになるまで）、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れる。その結果、保持容量ＣsがＶthに充電され、電位差ＶgsがＶthとなる。なお、図３（Ｇ）では、縦軸のスケールの関係で、電流Ｉdの変化はほんのわずかである。その後、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える前に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ6）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなるので、電位差Ｖgsを信号線ＤＴＬの電圧の大きさに拘わらずＶthのままで維持することができる。このように、電位差ＶgsをＶthに設定することにより、駆動トランジスタＴｒ1の閾値電圧Ｖthが画素回路１４ごとにばらついた場合であっても、有機ＥＬ素子１１の発光輝度がばらつくのをなくすることができる。
［２回目のＶth補正休止期間］
その後、Ｖth補正の休止期間中に、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える。
その後、Ｖth補正の休止期間中に、信号線駆動回路２３が信号線ＤＴＬの電圧をＶofsからＶsigに切り替える。
［書き込み・μ補正期間］
Ｖth補正休止期間が終了した後、書き込みとμ補正を行う。具体的には、信号線ＤＴＬの電圧がＶsigとなっている間に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶoff1からＶon1に上げ（Ｔ7）、駆動トランジスタＴｒ1のゲートを信号線ＤＴＬに接続する。すると、駆動トランジスタＴｒ1のゲート電圧がＶsigとなる。このとき、有機ＥＬ素子１１のアノード電圧はこの段階ではまだ有機ＥＬ素子１１の閾値電圧Ｖelよりも小さく、有機ＥＬ素子１１はカットオフしている。そのため、電流Ｉdは有機ＥＬ素子１１の素子容量（図示せず）に流れ、素子容量が充電されるので、ソース電圧ＶsがΔＶだけ上昇し、やがて電位差ＶgsがＶsig＋Ｖth−ΔＶとなる。このようにして、書き込みと同時にμ補正が行われる。ここで、駆動トランジスタＴｒ1の移動度μが大きい程、ΔＶも大きくなるので、電位差Ｖgsを発光前にΔＶだけ小さくすることにより、画素回路１４ごとの移動度μのばらつきを取り除くことができる。
Ｖth補正休止期間が終了した後、書き込みとμ補正を行う。具体的には、信号線ＤＴＬの電圧がＶsigとなっている間に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶoff1からＶon1に上げ（Ｔ7）、駆動トランジスタＴｒ1のゲートを信号線ＤＴＬに接続する。すると、駆動トランジスタＴｒ1のゲート電圧がＶsigとなる。このとき、有機ＥＬ素子１１のアノード電圧はこの段階ではまだ有機ＥＬ素子１１の閾値電圧Ｖelよりも小さく、有機ＥＬ素子１１はカットオフしている。そのため、電流Ｉdは有機ＥＬ素子１１の素子容量（図示せず）に流れ、素子容量が充電されるので、ソース電圧ＶsがΔＶだけ上昇し、やがて電位差ＶgsがＶsig＋Ｖth−ΔＶとなる。このようにして、書き込みと同時にμ補正が行われる。ここで、駆動トランジスタＴｒ1の移動度μが大きい程、ΔＶも大きくなるので、電位差Ｖgsを発光前にΔＶだけ小さくすることにより、画素回路１４ごとの移動度μのばらつきを取り除くことができる。
［発光期間］
次に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ8）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなり、駆動トランジスタＴｒ1のゲート−ソース間の電圧Ｖgsを一定に維持した状態で、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れる。その結果、ソース電圧Ｖsが上昇し、それに連動して駆動トランジスタＴｒ1のゲートも上昇し、有機ＥＬ素子１１が所望の輝度よりも小さな輝度で発光し始める。
次に、書込線駆動回路２４が書込線ＷＳＬの電圧をＶon1からＶoff1に下げる（Ｔ8）。すると、駆動トランジスタＴｒ1のゲートがフローティングとなり、駆動トランジスタＴｒ1のゲート−ソース間の電圧Ｖgsを一定に維持した状態で、駆動トランジスタＴｒ1のドレイン−ソース間に電流Ｉdが流れる。その結果、ソース電圧Ｖsが上昇し、それに連動して駆動トランジスタＴｒ1のゲートも上昇し、有機ＥＬ素子１１が所望の輝度よりも小さな輝度で発光し始める。
次に、制御線駆動回路２７は、発光が開始された後、制御線ＣＮＬの電圧をＶon2からＶoff2に下げる（Ｔ9）。すると、駆動トランジスタＴｒ1がオフし、バックゲートＧ２が駆動トランジスタＴｒ1のソースと電気的に分離され、バックゲートＧ２がフローティングとなる。続いて、バックゲート線駆動回路２６が、バックゲート線ＢＧＬの電圧をＶb2からＶb1に変更する（Ｔ10）。すると、容量素子Ｃbを介したカップリングによりバックゲートＧ２の電圧が変動するので、バックゲートＧ２の電圧変動に起因して駆動トランジスタＴｒ1のＩd−Ｖgs特性が変化し、有機ＥＬ素子１１に流れる電流Ｉdが急激に大きくなる。その結果、有機ＥＬ素子１１が所望の輝度で発光するようになる。
（作用・効果）
ところで、本実施の形態では、第１の実施の形態と同様、駆動トランジスタＴｒ1として、デュアルゲート型のトランジスタが用いられており、駆動トランジスタＴｒ1において、トップゲートＧ１と、バックゲートＧ２とが独立して駆動される。具体的には、トップゲートＧ１は書き込みトランジスタＴｒ2および信号線ＤＴＬを介して信号線駆動回路２３によって駆動され、バックゲートＧ２はバックゲート線ＢＧＬを介してバックゲート線駆動回路２６によって駆動される。トップゲートＧ１とバックゲートＧ２との独立駆動は、第１の実施の形態と同様の方法で行われる。
ところで、本実施の形態では、第１の実施の形態と同様、駆動トランジスタＴｒ1として、デュアルゲート型のトランジスタが用いられており、駆動トランジスタＴｒ1において、トップゲートＧ１と、バックゲートＧ２とが独立して駆動される。具体的には、トップゲートＧ１は書き込みトランジスタＴｒ2および信号線ＤＴＬを介して信号線駆動回路２３によって駆動され、バックゲートＧ２はバックゲート線ＢＧＬを介してバックゲート線駆動回路２６によって駆動される。トップゲートＧ１とバックゲートＧ２との独立駆動は、第１の実施の形態と同様の方法で行われる。
従って、本実施の形態でも、有機ＥＬ素子１１を発光させる時、または有機ＥＬ素子１１を発光させている時に、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている時とは異なる所定の値の電圧をバックゲートＧ２に印加することにより、上述の信号電圧ＶsigをトップゲートＧ１（信号線ＤＴＬ）に印加したときに有機ＥＬ素子１１に通常流れる電流値よりも大きな電流Ｉdを有機ＥＬ素子１１に流すことができる。つまり、トップゲートＧ１に書き込む信号電圧Ｖsigの大きさを大きくする代わりに、バックゲートＧ２に印加する電圧を適切に調整することにより、有機ＥＬ素子１１に流れる電流Ｉdを大きくすることができる。従って、本実施の形態では、移動度μの補正に適した時間ｔを過度に短くすることなく、高輝度化を実現することができる。
ところで、第１の実施の形態では、発光前のソース電圧Ｖsは、Ｖｔｈ補正により、駆動トランジスタＴｒ1のＶｔｈばらつきを反映した値（Ｖofs＋Ｖth−ΔＶ）となっている（図８（Ａ）参照）。しかし、発光後は、ソース電圧Ｖsは、有機ＥＬ素子１１の動作点によって決定されるので、Ｖｔｈばらつきに拘わらず、ほぼ一定値（Ｖel）となる（図８（Ｂ）参照）。そのため、発光後に、バックゲートＧ２側のゲート−ソース間電圧Ｖgsb（図６参照）に、Ｖｔｈばらつきに対応する小さなばらつきが生じる場合がある。
一方、本実施の形態では、駆動トランジスタＴｒ1の閾値補正および移動度補正を行っている間、制御線ＣＮＬにＶon2が印加されており、バックゲートＧ２の電圧Ｖbgが、駆動トランジスタＴｒ1のソース電圧Ｖsと等しくなっている（図９（Ａ）参照）。さらに、発光が開始された後、制御線ＣＮＬにＶoff2が印加されており、バックゲートＧ２の電圧Ｖbgが、容量素子Ｃbを介したカップリングにより、駆動トランジスタＴｒ1のＶｔｈばらつきを反映した電圧Ｖbと、Ｖelとの和（Ｖel＋Ｖb）となる（図９（Ｂ）参照）。これにより、バックゲートＧ２側のゲート−ソース間電圧Ｖgsbに、Ｖｔｈばらつきに対応する小さなばらつきが生じる可能性をなくすることができる。従って、本実施の形態では、高輝度化と同時に高画質化を実現することができる。
＜モジュールおよび適用例＞
以下、上述した実施の形態で説明した表示装置の適用例について説明する。上記実施の形態の表示装置は、テレビジョン装置、デジタルカメラ、ノート型パーソナルコンピュータ、携帯電話等の携帯端末装置あるいはビデオカメラなど、外部から入力された映像信号あるいは内部で生成した映像信号を、画像あるいは映像として表示するあらゆる分野の電子機器の表示装置に適用することが可能である。
以下、上述した実施の形態で説明した表示装置の適用例について説明する。上記実施の形態の表示装置は、テレビジョン装置、デジタルカメラ、ノート型パーソナルコンピュータ、携帯電話等の携帯端末装置あるいはビデオカメラなど、外部から入力された映像信号あるいは内部で生成した映像信号を、画像あるいは映像として表示するあらゆる分野の電子機器の表示装置に適用することが可能である。
（モジュール）
上記実施の形態の表示装置１は、例えば、図１０に示したようなモジュールとして、後述する適用例１〜５などの種々の電子機器に組み込まれる。このモジュールは、例えば、基板３１の一辺に、封止用基板３２から露出した領域２１０を設け、この露出した領域２１０に、駆動回路２０の配線を延長して外部接続端子（図示せず）を形成したものである。外部接続端子には、信号の入出力のためのフレキシブルプリント配線基板（ＦＰＣ；Flexible Printed Circuit）２２０が設けられていてもよい。
上記実施の形態の表示装置１は、例えば、図１０に示したようなモジュールとして、後述する適用例１〜５などの種々の電子機器に組み込まれる。このモジュールは、例えば、基板３１の一辺に、封止用基板３２から露出した領域２１０を設け、この露出した領域２１０に、駆動回路２０の配線を延長して外部接続端子（図示せず）を形成したものである。外部接続端子には、信号の入出力のためのフレキシブルプリント配線基板（ＦＰＣ；Flexible Printed Circuit）２２０が設けられていてもよい。
（適用例１）
図１１は、上記実施の形態の表示装置１が適用されるテレビジョン装置の外観を表したものである。このテレビジョン装置は、例えば、フロントパネル３１０およびフィルターガラス３２０を含む映像表示画面部３００を有しており、この映像表示画面部３００は、上記各実施の形態に係る表示装置１により構成されている。
図１１は、上記実施の形態の表示装置１が適用されるテレビジョン装置の外観を表したものである。このテレビジョン装置は、例えば、フロントパネル３１０およびフィルターガラス３２０を含む映像表示画面部３００を有しており、この映像表示画面部３００は、上記各実施の形態に係る表示装置１により構成されている。
（適用例２）
図１２は、上記実施の形態の表示装置１が適用されるデジタルカメラの外観を表したものである。このデジタルカメラは、例えば、フラッシュ用の発光部４１０、表示部４２０、メニュースイッチ４３０およびシャッターボタン４４０を有しており、その表示部４２０は、上記実施の形態に係る表示装置１により構成されている。
図１２は、上記実施の形態の表示装置１が適用されるデジタルカメラの外観を表したものである。このデジタルカメラは、例えば、フラッシュ用の発光部４１０、表示部４２０、メニュースイッチ４３０およびシャッターボタン４４０を有しており、その表示部４２０は、上記実施の形態に係る表示装置１により構成されている。
（適用例３）
図１３は、上記実施の形態の表示装置１が適用されるノート型パーソナルコンピュータの外観を表したものである。このノート型パーソナルコンピュータは、例えば、本体５１０，文字等の入力操作のためのキーボード５２０および画像を表示する表示部５３０を有しており、その表示部５３０は、上記各実施の形態に係る表示装置１により構成されている。
図１３は、上記実施の形態の表示装置１が適用されるノート型パーソナルコンピュータの外観を表したものである。このノート型パーソナルコンピュータは、例えば、本体５１０，文字等の入力操作のためのキーボード５２０および画像を表示する表示部５３０を有しており、その表示部５３０は、上記各実施の形態に係る表示装置１により構成されている。
（適用例４）
図１４は、上記実施の形態の表示装置１が適用されるビデオカメラの外観を表したものである。このビデオカメラは、例えば、本体部６１０，この本体部６１０の前方側面に設けられた被写体撮影用のレンズ６２０，撮影時のスタート／ストップスイッチ６３０および表示部６４０を有しており、その表示部６４０は、上記各実施の形態に係る表示装置１により構成されている。
図１４は、上記実施の形態の表示装置１が適用されるビデオカメラの外観を表したものである。このビデオカメラは、例えば、本体部６１０，この本体部６１０の前方側面に設けられた被写体撮影用のレンズ６２０，撮影時のスタート／ストップスイッチ６３０および表示部６４０を有しており、その表示部６４０は、上記各実施の形態に係る表示装置１により構成されている。
（適用例５）
図１５は、上記実施の形態の表示装置１が適用される携帯電話機の外観を表したものである。この携帯電話機は、例えば、上側筐体７１０と下側筐体７２０とを連結部（ヒンジ部）７３０で連結したものであり、ディスプレイ７４０，サブディスプレイ７５０，ピクチャーライト７６０およびカメラ７７０を有している。そのディスプレイ７４０またはサブディスプレイ７５０は、上記各実施の形態に係る表示装置１により構成されている。
図１５は、上記実施の形態の表示装置１が適用される携帯電話機の外観を表したものである。この携帯電話機は、例えば、上側筐体７１０と下側筐体７２０とを連結部（ヒンジ部）７３０で連結したものであり、ディスプレイ７４０，サブディスプレイ７５０，ピクチャーライト７６０およびカメラ７７０を有している。そのディスプレイ７４０またはサブディスプレイ７５０は、上記各実施の形態に係る表示装置１により構成されている。
以上、実施の形態および適用例を挙げて本発明を説明したが、本発明は上記実施の形態等に限定されるものではなく、種々変形が可能である。
例えば、上記実施の形態等では、表示装置１，２がアクティブマトリクス型である場合について説明したが、アクティブマトリクス駆動のための画素回路１４の構成は上記実施の形態等で説明したものに限られず、必要に応じて容量素子やトランジスタを画素回路１４に追加してもよい。その場合、画素回路１４の変更に応じて、上述した信号線駆動回路２３、書込線駆動回路２４、電源線駆動回路２５およびバックゲート線駆動回路２６のほかに、必要な駆動回路を追加してもよい。
また、上記実施の形態等では、信号線駆動回路２３、書込線駆動回路２４、電源線駆動回路２５およびバックゲート線駆動回路２６の駆動をタイミング生成回路２２が制御していたが、他の回路がこれらの駆動を制御するようにしてもよい。また、信号線駆動回路２３、書込線駆動回路２４、電源線駆動回路２５およびバックゲート線駆動回路２６の制御は、ハードウェア（回路）で行われていてもよいし、ソフトウェア（プログラム）で行われていてもよい。
また、上記実施の形態等では、画素回路１４が、２Ｔｒ１Ｃの回路構成となっていたが、デュアルゲート型のトランジスタが有機ＥＬ素子１１に直列に接続された回路構成を含んでいるものであれば、２Ｔｒ１Ｃの回路構成以外の回路構成となっていてもよい。
また、上記実施の形態等では、駆動トランジスタＴｒ1，書き込みトランジスタＴｒ2は、ｎチャネルＭＯＳ型の薄膜トランジスタ（ＴＦＴ（Thin Film Transistor））により形成されている場合が例示されていたが、ｐチャネルトランジスタ（例えばｐチャネルＭＯＳ型のＴＦＴ）により形成されていてもよい。ただし、その場合には、トランジスタＴｒ2のソースおよびドレインのうち電源線ＰＳＬと未接続の方と保持容量Ｃsの他端とを有機ＥＬ素子１１のカソードに接続し、有機ＥＬ素子１１のアノードをＧＮＤなどに接続することが好ましい。
１，２…表示装置、１０…表示パネル、１１，１１Ｒ，１１Ｇ，１１Ｂ…有機ＥＬ素子、１２…画素、１３…画素回路アレイ部、１４…画素回路、２０…駆動回路、２１…映像信号処理回路、２０Ａ，２１Ａ…映像信号、２０Ｂ…同期信号、２２…タイミング生成回路、２２Ａ…制御信号、２３…信号線駆動回路、２４…書込線駆動回路、２５…電源線駆動回路、２６…バックゲート線駆動回路、２７…制御線駆動回路、ＢＧＬ…バックゲート線、Ｃs…保持容量、ＣＴＬ…制御線、ＤＴＬ…信号線、Ｉd…電流、ＧＮＤ…グラウンド線、Ｇ１…トップゲート、Ｇ２…バックゲート、ＰＳＬ…電源線、Ｔｒ1…駆動トランジスタ、Ｔｒ2…書き込みトランジスタ、Ｔｒ3…制御トランジスタ、Ｖg…ゲート電圧、Ｖgs,Ｖgsb…ゲート−ソース間電圧、Ｖs…ソース電圧、Ｖsig…信号電圧、Ｖb1，Ｖb2，ＶccH，ＶCCL，Ｖoff1，Ｖoff2，Ｖofs，Ｖon1，Ｖon2…電圧、Ｖth…閾値電圧、ＷＳＬ…書込線。
Claims (7)
- 一組の発光素子および画素回路が２次元配置された表示部と、
映像信号に基づいて前記画素回路を駆動する駆動部と
を備え、
前記画素回路は、第１ゲートおよび第２ゲートを含み、かつ前記発光素子に流れる電流を制御するデュアルゲート型の第１トランジスタと、前記映像信号に応じた信号電圧を前記第１ゲートに書き込む第２トランジスタとを有し、
前記駆動部は、前記第１トランジスタの閾値補正および移動度補正を行っている時と、前記発光素子を発光させている時とで、前記第２ゲートに印加する電圧を異ならせる
表示装置。 - 前記画素回路は、前記発光素子のうち前記第１トランジスタ側の端子と前記第２ゲートとの電気的な接続を制御するスイッチング素子を有すると共に、前記第１トランジスタと前記スイッチング素子との接続点と前記駆動部との間に容量素子を有する
請求項１に記載の表示装置。 - 前記駆動部は、少なくとも前記第１トランジスタの閾値補正および移動度補正を行っている間、前記スイッチング素子をオンし、発光が開始された後、前記スイッチング素子をオフする
請求項２に記載の表示装置。 - 前記駆動部は、前記第１トランジスタがｎチャネル型である場合には、前記発光素子を発光させている時に前記第２ゲートに印加する電圧を、前記第１トランジスタの閾値補正および移動度補正を行っている時に前記第２ゲートに印加する電圧よりも高くする
請求項１ないし請求項３のいずれか一項に記載の表示装置。 - 前記駆動部は、前記第１トランジスタがｐチャネル型である場合には、前記発光素子を発光させている時に前記第２ゲートに印加する電圧を、前記第１トランジスタの閾値補正および移動度補正を行っている時に前記第２ゲートに印加する電圧よりも低くする
請求項１ないし請求項３のいずれか一項に記載の表示装置。 - 一組の発光素子および画素回路が２次元配置された表示部と、映像信号に基づいて前記画素回路を駆動する駆動部とを備え、前記画素回路が、第１ゲートおよび第２ゲートを含み、かつ前記発光素子に流れる電流を制御するデュアルゲート型の第１トランジスタと、前記映像信号に応じた信号電圧を前記第１ゲートに書き込む第２トランジスタとを有する発光装置を用意するステップと、
前記駆動部を用いて、前記第１トランジスタの閾値補正および移動度補正を行っている時に前記第２ゲートに第１電圧を印加したのち、前記発光素子を発光させている時に前記第２ゲートに前記第１電圧とは大きさの異なる第２電圧を印加するステップと
を含む表示装置の駆動方法。 - 表示装置を備え、
前記表示装置は、
一組の発光素子および画素回路が２次元配置された表示部と、
映像信号に基づいて前記画素回路を駆動する駆動部と
を備え、
前記画素回路は、第１ゲートおよび第２ゲートを含み、かつ前記発光素子に流れる電流を制御するデュアルゲート型の第１トランジスタと、前記映像信号に応じた信号電圧を前記第１ゲートに書き込む第２トランジスタとを有し、
前記駆動部は、前記第１トランジスタの閾値補正および移動度補正を行っている時と、前記発光素子を発光させている時とで、前記第２ゲートに印加する電圧を異ならせる
電子機器。
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