JP2009290986A - 同期整流型dc−dcコンバータの逆流防止回路 - Google Patents
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Abstract
【解決手段】逆流防止回路100を、コンパレータ200、逆流検出回路300、メモリ400、フリップフロップ500及び同期整流素子Mn(110)で構成する。Mn(110)がターンオフした時点のインダクタ電流ILの値は、ターンオフ直後のスイッチング端子電圧Vswの大きな変化から判断できる。Mn(110)がオフした時、インダクタL(40)に逆方向電流が流れている(IL<0)/順方向電流が流れている(IL>0)に応じて、逆流検出回路300からメモリ400に出力信号370を加える。メモリ400はそれに応じてオフセット電圧を制御する制御信号Vctrl(450)をコンパレータ200に出力し、よりプラス側の電流/よりマイナス側の電流、でコンパレータ200が反応する方向に動作点を移動させる。
【選択図】図1
Description
図1は、本発明の実施形態に係る同期整流型DC-DCコンバータの逆流防止回路の構成を示す図である。図1に示す同期整流型DC-DCコンバータの逆流防止回路は、入力電圧端子Vin(2)とグランドとの間にPチャネルMOSFET (Metal Oxide Semiconductor Field Effect Transistor)で構成されるスイッチング素子Mp(30)とこれと相補的に動作するNチャネルMOSFETで構成される同期整流MOSFET Mn(以下、単に、Mnと記す)(110)を直列に接続するとともに、インダクタL(40)と出力キャパシタCout(50)との直列回路をMn(110)に並列に接続する。そしてインダクタL(40)と出力キャパシタCout(50)との接続点から得られる出力キャパシタCout(50)の両端電圧、すなわち出力電圧Vout(8)はフィードバックされてコントローラ(10)に印加される。コントローラ(10)はDC-DCコンバータに設けられたスイッチング素子の動作を制御して出力端に一定の出力電圧を得るためのものであり、フィードバックされた出力電圧Vout(8)に基づいて第1の制御信号(12)および第2の制御信号(14)を出力する。第1の制御信号(12)はドライバ(20)に印加され、ドライバ(20)はドライバ出力Vgp(25)をスイッチング素子Mp(30)のゲートに印加する。また、第2の制御信号(14)はアンド回路(60)の一方の入力端子とフリップフロップ(500)のセット端子に入力される。コントローラ(10)から出力される第1の制御信号(12)と第2の制御信号(14)とはMp(30)とMn(110)が同時に導通することを防止するために設けられたデットタイム期間を除いて同相の関係にあるデューティ比が出力電圧Vout(8)に応じて変化するパルス信号として出力される。アンド回路(60)の他方の入力にはフリップフロップ(500)のQ出力(550)が印加される。アンド回路(60)の出力はドライバ(70)に印加され、ドライバ(70)はドライバ出力Vgn(75)をMn(110)のゲートに印加する。コンパレータ(200)の非反転入力端子(V+)には、基準電圧(グランド電位)が印加される。また、コンパレータ(200)の反転入力端子(V−)には、Mn(110)のドレインとインダクタL(40)の接続点(4)の電位Vsw(スイッチング端子電圧)が接続点(6)を介して印加される。コンパレータ(200)はメモリ(400)にあらかじめ記憶された値(後述するように、この値は上記Vswと上記Vgnの電圧の状態に応じて逆流検出回路300から出力される出力信号により定まる)に基く、オフセット電圧を制御する制御信号Vctrl(450)を得ることでコンパレータの入力オフセット電圧を制御する。制御された入力オフセット電圧に基づいて動作するコンパレータ(200)から出力信号(250)を出力し、フリップフロップ(500)のリセット端子に印加する。なおコンパレータ(200)の詳細は後述する。なお、フリップフロップ(730)のセット入力およびリセット入力は負論理となっている。
次に本発明の同期整流型DC-DCコンバータの逆流防止回路の動作を説明すると、図1に示す逆流防止回路はその原理構成を示すものであって、Mn(110)がターンオフした時点のインダクタ電流ILの値は、ターンオフ直後のインダクタL(40)の接続点(4)の電位、すなわちスイッチング端子電圧Vswの大きな変化から判断することができる。なお同期整流型DC-DCコンバータのターンオフ直後のスイッチング端子電圧Vswが大きく変化すること自体は当業者に知られている(必要であれば、特開2002-281743号公報参照)。そして逆流検出回路(300)は、Mn(110)のゲートに印加されるドライバ出力Vgn(75)の論理Lレベルを検出し、さらに、ターンオフ直後、すなわちドライバ出力Vgn(75)が論理Lレベルになった直後(所定時間(以後、Tdと記す)後)の接続点(4)のVsw(スイッチング端子電圧)の電位を検出して、以下に説明する図2(a)〜(c)のいずれの状態にあるかを判定する。
4 スイッチング端子電圧Vsw
8 出力電圧(Vout)
10 コントローラ(Controller)
20 ドライバ(Driver)
30 スイッチング素子(Mp)
35 ボディダイオード
40 インダクタ(L)
50 出力キャパシタ(Cout)
60 AND回路
70 ドライバ(Driver)
100 逆流防止回路
110 同期整流MOSFET (Mn)
112 ボディダイオード
114 寄生容量
200 コンパレータ
210 オフセット・アジャスタ(Offset Adjustor)
220 差動部
230 出力部
300 逆流検出回路
310 RSラッチ
320 遅延回路
330 NAND回路
340 NOR回路
350 チャージポンプ
370 逆流検出回路の出力信号
400 メモリ
420 キャパシタ(Cm)
440 DA変換器
450 制御信号(Vctrl)
500 フリップフロップ
600 逆流検出回路
610 RSラッチ
620 遅延回路
630 アップダウンカウンタ
Claims (7)
- コンパレータを用いて同期整流素子のドレイン−ソース間電圧からインダクタ電流の逆流を検出し、前記コンパレータにより前記インダクタ電流の逆流を検出すると前記同期整流素子をターンオフさせる同期整流型DC-DCコンバータの逆流防止回路において、
前記同期整流素子がターンオフした時点の前記インダクタ電流の値を、ターンオフ直後のスイッチング端子電圧を検出することで、インダクタから前記同期整流素子に向かう逆方向に前記インダクタ電流が流れているか又はインダクタから出力端に向かう順方向に前記インダクタ電流が流れているかを判断し、それに応じて、所定の出力信号をメモリ手段に出力する逆流検出回路と、
前記出力信号に応じてオフセット電圧を制御する制御信号を前記コンパレータに出力するメモリ手段と、
を有し、
前記オフセット電圧を制御する制御信号に応じて前記コンパレータのオフセット電圧を変化させて、前記同期整流素子がターンオフする時点での前記インダクタ電流の値が0となるよう調整する、
ことを特徴とする同期整流型DC-DCコンバータの逆流防止回路。 - 前記メモリ手段は、キャパシタで構成され、前記逆流検出回路は、ロジック回路とチャージポンプを含み、前記同期整流素子のターンオフから前記スイッチング端子電圧が所定電圧に上昇するまでの時間と所定時間との長短を前記ロジック回路で検出し、その出力で前記チャージポンプを動作させて前記キャパシタへと電流を出力し、
前記キャパシタの電荷量を増減させる、
ことを特徴とする請求項1に記載の同期整流型DC-DCコンバータの逆流防止回路。 - 前記逆流検出回路は、アップダウンカウンタおよび前記アップダウンカウンタにカウントされたデジタル値をアナログ値に変換するDA変換器を含み、前記同期整流素子のターンオフから所定時間後の前記スイッチング端子電圧の値を所定電圧と比較し、その比較結果に応じて前記アップダウンカウンタにアップカウントもしくはダウンカウントを行わせて前記アップダウンカウンタにカウントされたデジタル値を増減する、
ことを特徴とする請求項1に記載の同期整流型DC-DCコンバータの逆流防止回路。 - 前記所定時間は、デッドタイム以上に設定されることを特徴とする請求項2又は3に記載の同期整流型DC-DCコンバータの逆流防止回路。
- 前記コンパレータは、オフセット・アジャスタと差動部を含み、
前記差動部は差動対を構成する第1のトランジスタと第2のトランジスタ、および前記第1のトランジスタを含む第1の電流経路と前記第2のトランジスタを含む第2の電流経路を有し、
前記オフセット・アジャスタは、前記第1の電流経路に第1の電流を加える第1の電流出力端子および前記第2の電流経路に第2の電流を加える第2の電流出力端子を有し、基準電圧と前記メモリ手段から出力されるオフセット電圧を制御する制御電圧との差に応じて前記第1の電流と前記第2の電流の差を調整することを特徴とする請求項1に記載の同期整流型DC-DCコンバータの逆流防止回路。 - 前記オフセット・アジャスタは、差動対を構成するPチャネルの第1と第2のMOSFETと、前記第1と第2のMOSFETのソース間に接続される抵抗と、前記第1と第2のMOSFETの各ソースにそれぞれ接続される第1と第2の電流源とを有し、前記第1と第2のMOSFETの各ドレインは前記第1の電流出力端子および前記第1の電流出力端子として前記差動部の差動対を構成する前記第1と第2のトランジスタの各ドレインに接続されることを特徴とする請求項5に記載の同期整流型DC-DCコンバータの逆流防止回路。
- 前記請求項1乃至6項のいずれか1項に記載の逆流防止回路を含んでなる同期整流型DC-DCコンバータ。
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