JP2007166119A - 光受信装置 - Google Patents
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Abstract
【解決手段】受信した光M進信号(Mは2以上の整数)が2系統の電気信号に光電気変換された後に、mビットの並列データに多重分離される。位相同期回路22は、この多重分離されたmビット並列データにて構成される伝送フレームの同期はずれに応じた同期制御を行い、フレーム同期回路21は、位相同期回路22から出力される伝送フレームの同期をとる。また、位相検索回路23は、フレーム同期回路21から出力される状態信号に基づいて伝送フレームの同期はずれが解除されるときの論理および信号順序を検索し、位相制御回路24は、位相検索回路23の制御指示に従って伝送フレームのビット列の奇数ビットおよび偶数ビットのそれぞれに対する論理の反転処理/非反転処理および奇数ビットと偶数ビットの間の入れ替え処理を制御する。
【選択図】 図10
Description
まず、実施の形態1にかかる光受信装置について説明する。図1は、本発明の実施の形態1にかかる光受信装置の構成を示す図である。同図に示す光受信装置は、伝送路1に接続されるDQPSK受信手段2と、DQPSK受信手段2の出力を入力信号とする多重分離手段3と、多重分離手段3の出力を入力信号とする受信位相同期手段4と、受信位相同期手段4の出力を入力信号とするフレーム処理手段5と、を備えるように構成されている。
例えば、3:m多重分離回路から、Vk,Uk,Wkの順序で出力される場合には、この場合に対応する、つぎの8つのフレームパターン検出回路を設けるようにすればよい。
(1)Vk正論理/Uk正論理/Wk正論理フレームパターン検出回路
(2)Vk正論理/Uk正論理/Wk反転論理フレームパターン検出回路
(3)Vk正論理/Uk反転論理/Wk正論理フレームパターン検出回路
(4)Vk正論理/Uk反転論理/Wk反転論理フレームパターン検出回路
(5)Vk反転論理/Uk正論理/Wk正論理フレームパターン検出回路
(6)Vk反転論理/Uk正論理/Wk反転論理フレームパターン検出回路
(7)Vk反転論理/Uk反転論理/Wk正論理フレームパターン検出回路
(8)Vk反転論理/Uk反転論理/Wk反転論理フレームパターン検出回路
以下、同様に、(Vk,Wk,Uk)、(Uk,Vk,Wk)、(Uk,Wk,Vk)、(Wk,Uk,Vk)、(Wk,Vk,Uk)の5つの順序パターンにおいて、それぞれの順序に対応する8つのフレームパターン検出回路を各順序パターンごとに設けるようにすればよい。
図8は、本発明の実施の形態2にかかる光受信装置の構成を示す図であり、OTNフレームを処理する構成を図5に対応してより具体化して示したものである。図8に示す光受信装置は、光受信信号を受信するDQPSK受信手段2と、DQPSK受信手段2の2系統の出力信号(Vk,Uk)を入力信号とするデシリアライザ13と、デシリアライザ13の出力信号を入力信号とするOTNフレーマ16と、を備えている。また、その細部構成として、デシリアライザ13は、DQPSK受信手段2の2系統の出力信号(Vk,Uk)が入力される2:16ビット多重分離回路14と、2:16ビット多重分離回路14の出力を入力信号とするSFI−5(SERDES(SERializer DESerializer)Framer Interface level−5)送信回路15とを備え、OTNフレーマ16は、SFI−5送信回路15の出力信号が入力されるSFI−5受信回路17と、SFI−5受信回路17の出力を入力信号とするフレーム同期回路12と、フレーム同期回路12の出力を入力信号とするOTNOH処理回路18と、OTNOH処理回路18の出力を入力信号とするSFI−5送信回路15と、をそれぞれ備えている。
図9は、本発明の実施の形態3にかかる光受信装置の構成を示す図である。同図の光受信装置では、図8に示したデシリアライザ13の構成に代えて、上記実施の形態1で示したフレーム同期回路12を具備するデシリアライザ19を備えるように構成される。また、この構成により、OTNフレーマ20には、一般的な2値伝送に使用される、通常のフレーム同期機能を有するフレーム同期回路21が具備されている。なお、その他の構成については、図8に示した実施の形態2の構成と同一または同等であり、これらの共通の構成部には、同一の符号を付してその説明を省略する。
図10は、本発明の実施の形態4にかかる光受信装置の構成を示す図である。同図に示す光受信装置は、実施の形態1にかかる図6の構成において、まず、フレーム同期回路としては、通常のフレーム同期機能を有するフレーム同期回路21を具備する一方で、このフレーム同期回路21と2:m多重分離回路11との間に位相同期回路22を具備するように構成されている。また、位相同期回路22は、フレーム同期回路21の出力を入力信号とする位相検索回路23と、位相検索回路23の出力を入力信号とする位相制御回路24と、を備えている。なお、その他の構成については、図6に示す構成と同一あるいは同等であり、これらの共通の構成部には、同一符号を付してその説明を省略する。
図12は、本発明の実施の形態5にかかる光受信装置の構成を示す図である。同図の光受信装置では、図8に示したOTNフレーマ16において、SFI−5受信回路17の出力側に、実施の形態4にかかる図10に示した位相同期回路22を備えるように構成される。この構成により、OTNフレーマ20には、一般的な2値伝送に使用される、通常のフレーム同期機能を有する簡易なフレーム同期回路21を具備させることができる。なお、その他の構成については、図8に示した実施の形態2の構成と同一または同等であり、これらの共通の構成部には、同一の符号を付してその説明を省略する。
図13は、本発明の実施の形態6にかかる光受信装置の構成を示す図である。同図の光受信装置では、図9に示したデシリアライザ13の構成に代えて、実施の形態4にかかる図10に示した位相同期回路22を具備するデシリアライザ26を備えるように構成される。すなわち、図9に示した実施の形態3にかかるデシリアライザ13に具備されていたフレーム同期回路12の機能を実施の形態4にかかる位相同期回路22の機能で置換している。なお、その他の構成については、図9に示した実施の形態3の構成と同一または同等であり、これらの共通の構成部には、同一の符号を付してその説明を省略する。
図14は、本発明の実施の形態7にかかる光受信装置のフレーム同期回路の構成を示す図である。同図のフレーム同期回路27では、図6に示したフレーム同期回路12の構成において、モード設定信号をフレーム同期回路27に入力するような構成とされている。なお、その他の構成については、図6に示したフレーム同期回路27の構成と同一であり、それらの共通の構成部には、同一の符号を付してその説明を省略する。
2 DQPSK受信手段
3 多重分離手段
4 受信位相同期手段
5 フレーム処理手段
6 光カプラ
7,8 1ビット遅延干渉計
9,10 差動受光器
11 2:m多重分離回路
12 フレーム同期回路
13 デシリアライザ
14 2:16ビット多重分離回路
15 SFI−5送信回路
16,20 OTNフレーマ
17 SFI−5受信回路
18 OTNOH処理回路
19,26 デシリアライザ
21,27 フレーム同期回路
22 位相同期回路
23 位相検索回路
24 位相制御回路
28 光源
29 集積型マッハツェンダ変調器
30 符号化器
34,36 導波路
1201〜1208 フレームパターン検出回路
1209 位相制御回路
1210 位相判定回路
1211 同期保護回路
1212 フレーム計数回路
Claims (13)
- 受信した光M進信号(M=2k:kは自然数)をk個の電気信号に光電気変換して自身の出力ポートからk系統の電気信号として出力するM進信号受信手段と、
前記k系統の電気信号をmビット(mは自然数)の並列データに多重分離する多重分離手段と、
前記多重分離されたmビット並列データを構成する各ビットごとの論理(正論理、反転論理)と、該mビット並列データを構成する各ビットが属する系統と、をそれぞれ識別した識別結果に基づいて該mビット並列データの位相同期をとる受信位相同期手段と、
前記受信位相同期手段から出力されるmビット並列データにて構成される伝送フレームの受信処理を行うフレーム処理手段と、
を備えたことを特徴とする光受信装置。 - 受信した光M進信号(Mは2以上の整数)を2個の電気信号に光電気変換して自身の出力ポートから2系統の電気信号として出力するM進信号受信手段と、
前記2系統の電気信号をmビット(mは自然数)の並列データに多重分離する多重分離手段と、
前記多重分離されたmビット並列データを構成する各ビットごとの論理(正論理、反転論理)と、該mビット並列データを構成するビット列における各ビットが属する系統と、をそれぞれ識別した識別結果に基づいて、該mビット並列データにて構成される伝送フレームの同期をとるフレーム同期手段と、
前記受信位相同期手段から出力される伝送フレームの受信処理を行うフレーム処理手段と、
を備え、
前記フレーム同期手段による前記伝送フレームの同期は、該伝送フレームを構成するビット列の奇数ビットおよび偶数ビットのそれぞれに対する論理の反転処理/非反転処理と、該奇数ビットと該偶数ビットの間の入れ替え処理と、を適宜選択することによって確保されることを特徴とする光受信装置。 - 前記多重分離手段は、2入力のデータ信号をmビットの並列データに変換する2:m多重分離回路にて構成され、
前記フレーム同期手段は、
前記2:m多重分離回路から出力されたmビット並列データにて構成される伝送フレームを入力として、該伝送フレームに含まれる所定のフレームパターンを検出するフレームパターン検出回路と、
前記フレームパターン検出回路が検出した所定のフレームパターンがいずれの位相で検出されたか否かを判定する位相判定回路と、
前記位相判定回路の判定結果に基づいて前記mビット並列データを構成するビット列の奇数ビットおよび偶数ビットのそれぞれに対する論理の反転処理/非反転処理および該奇数ビットと該偶数ビットの間の入れ替え処理を制御する位相制御回路と、
を備えたことを特徴とする請求項2に記載の光受信装置。 - 前記フレームパターン検出回路は、前記所定のフレームパターンを構成するビット列における奇数ビットの論理(正論理、反転論理)、偶数ビットの論理(正論理、反転論理)および奇数ビットと偶数ビットとの間の順序に対する8通りのフレームパターンの組合せに対応した8種類のフレームパターン検出回路にて構成されることを特徴とする請求項3に記載の光受信装置。
- 前記多重分離手段は、1入力のデータ信号をmビットの並列データに変換する1:m多重分離回路にて構成され、
前記フレーム同期手段は、
前記1:m多重分離回路から出力されたmビット並列データにて構成される伝送フレームを入力として、該伝送フレームに含まれる所定のフレームパターンを検出するフレームパターン検出回路と、
前記フレームパターン検出回路が検出した所定のフレームパターンがいずれの位相で検出されたか否かを判定する位相判定回路と、
前記位相判定回路の判定結果に基づいて前記mビット並列データを構成するビット列の論理を制御する位相制御回路と、
を備え、
前記フレームパターン検出回路は、前記所定のフレームパターンを構成するビット列における論理(正論理、反転論理)に対する2通りのフレームパターンの組合せに対応した2種類のフレームパターン検出回路にて構成されることを特徴とする請求項1に記載の光受信装置。 - 前記フレーム同期回路を構成する複数のフレームパターン検出回路のうちの特定のフレームパターン検出回路を有効とするか無効とするかを個別に設定可能としたことを特徴とする請求項3〜5のいずれか一つに記載の光受信装置。
- 前記多重分離手段は、2入力のデータ信号をmビットの並列データに変換する2:m多重分離回路にて構成され、
前記フレーム同期手段は、
前記2:m多重分離回路から出力されたmビット並列データにて構成される伝送フレームのフレーム同期はずれに応じた同期制御を行う位相同期回路と、
前記位相同期回路から出力される伝送フレームの同期をとるフレーム同期回路と、
を備え、
前記位相同期回路は、
前記フレーム同期回路から出力される状態信号に基づいて前記mビット並列データにて構成される伝送フレームのフレーム同期はずれが解除されるときの論理および信号順序を検索する位相検索回路と、
前記位相検索回路の制御指示に従って前記mビット並列データを構成するビット列の奇数ビットおよび偶数ビットのそれぞれに対する論理の反転処理/非反転処理および該奇数ビットと該偶数ビットの間の入れ替え処理を制御する位相制御回路と、
を備えたことを特徴とする請求項2に記載の光受信装置。 - 前記多重分離手段は、1入力のデータ信号をmビットの並列データに変換する1:m多重分離回路にて構成され、
前記フレーム同期手段は、
前記1:m多重分離回路から出力されたmビット並列データにて構成される伝送フレームのフレーム同期はずれに応じた同期制御を行う位相同期回路と、
前記位相同期回路から出力される伝送フレームの同期をとるフレーム同期回路と、
を備え、
前記位相同期回路は、
前記フレーム同期回路から出力される状態信号に基づいて前記mビット並列データにて構成される伝送フレームのフレーム同期はずれが解除されるときの論理および信号順序を検索する位相検索回路と、
前記位相検索回路の制御指示に従って前記mビット並列データを構成するビット列に対する論理の反転処理/非反転処理を制御する位相制御回路と、
を備えたことを特徴とする請求項1に記載の光受信装置。 - 前記位相制御回路に対して行われる前記位相検索回路からの制御指示は、所定の検索時間の間保持されることを特徴とする請求項7または8に記載の光受信装置。
- 前記位相検索回路は、前記フレーム同期はずれ時に該フレーム同期はずれが解除されるまでの間、前記mビット並列データを構成するビット列の奇数ビットおよび偶数ビットのそれぞれに対する論理の反転処理/非反転処理および該奇数ビットと該偶数ビットの間の入れ替え処理を所定の検索時間ごとに順次変更して行うことを特徴とする請求項7または9に記載の光受信装置。
- 前記位相検索回路は、前記フレーム同期はずれ時に該フレーム同期はずれが解除されるまでの間、前記mビット並列データを構成するビット列に対する論理の反転処理/非反転処理を所定の検索時間ごとに順次変更して行うことを特徴とする請求項8または9に記載の光受信装置。
- フレーム同期はずれか否かを検索するための検索時間は、前記mビット並列データにて構成される伝送フレームの平均同期確立時間のN倍(Nは正の整数)よりも大きな値に設定されることを特徴とする請求項7〜11のいずれか一つに記載の光受信装置。
- 前記フレーム同期回路には、モード設定信号が入力され、該モード設定信号に基づいて前記フレームパターン検出回路の有効/無効が制御されることを特徴とする請求項3〜12のいずれか一つに記載の光受信装置。
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