JP2009089578A - デジタルpwfmを備える変換回路、その方法、および、付随するコントローラ - Google Patents
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Abstract
【解決手段】コンバータにおいて、電圧変換ユニットは、入力電圧を受信し、かつ、制御クロック信号に基づき動作を切り替えることにより、入力電圧の大きさに従う出力電圧を出力する。比較回路は、出力電圧と基準電圧とを比較することにより、パワーグッドパルス信号を生成する。パルス幅周波数変調回路は、パワーグッドパルス信号および一のソースクロック信号を受信することにより、制御クロック信号を提供する。パワーグッドパルス信号が第1の論理状態のままである期間において、ソースクロック信号のパルス幅は、徐々に変更され、ソースクロック信号の周波数も、変更され、パルス幅周波数が変調されたソースクロック信号が制御クロック信号として出力される。
【選択図】図3A
Description
Claims (21)
- 変換回路であって、
一の入力電圧を受信し、かつ、一の制御クロック信号に基づき動作を切り替えることにより、前記入力電圧の大きさに従う一の出力電圧を出力する一の電圧変換ユニットと、
前記出力電圧と一の基準電圧とを比較することにより、一のパワーグッドパルス信号を生成する一の比較回路であって、前記パワーグッドパルス信号は、前記出力電圧が前記基準電圧より大きい場合に一の第1の論理状態になる比較回路と、
前記パワーグッドパルス信号と一のソースクロック信号とを受信することにより、前記制御クロック信号を生成する一のパルス幅周波数変調回路であって、前記ソースクロック信号のパルス幅は、一のステップサイズ機構により徐々に変化し、前記ソースクロック信号の周波数も前記パワーグッドパルス信号が前記第1の論理状態にある期間に変化し、前記パルス幅周波数が変調されたソースクロック信号は、前記制御クロック信号として出力されるパルス幅周波数変調回路と、
を含む変換回路。 - 前記パワーグッドパルス信号が前記第1の論理状態にある期間、前記ソースクロック信号の前記パルス幅は、前記ステップサイズ機構により徐々に変化し、前記ソースクロック信号の前記周波数も変化する、請求項1に記載の変換回路。
- 前記パルス幅周波数変調回路は、複数の直列接続遅延ユニットを含む一のパルス幅変調ユニットを含み、前記直列接続遅延ユニットの入力は、ソースクロック信号に結合され、該ソースクロック信号のパルス幅は、前記ソースクロック信号が通過する前記遅延ユニットの数だけ前記ステップサイズ機構により徐々に変更され、前記パルス幅変調ユニットから一のパルス変調信号が生成される、請求項1に記載の変換回路。
- 前記パルス幅変調ユニットは、複数のスイッチさらにを含み、該スイッチのそれぞれは、制御されることによって一の第1の論理ゲートを介し、前記遅延ユニットのそれぞれの出力と、前記パルス幅変調ユニットの前記出力との間に配置され、それによって異なるパルス幅を有する前記パルス変調された信号が生成される、請求項3に記載の変換回路。
- 前記パルス幅周波数変調回路は、複数の制御信号を提供することにより、スイッチのオンまたはオフを制御する一のシフト回路を含む、請求項4に記載の変換回路。
- 前記シフト回路は、一のトリガクロックパルスおよび一の指向性クロックパルスを受信し、前記シフト回路は、トリガされることにより前記トリガクロックパルスに基づき動作し、前記制御信号は、前記指向性クロックパルスに従いシフトされ、それによって前記パルス変調される信号のパルス幅が変化する、請求項5に記載の変換回路。
- 前記指向性クロックパルスは、一のステップサイズを有する前記パルス変調された信号の前記パルス幅を増大すべくアクティブにされ、前記指向性クロックパルスは、前記ステップサイズを有する前記パルス変調された信号の前記パルス幅を縮小すべく非アクティブにされ、前記パルス変調された信号の前記パルス幅は、一の予め決められた範囲を伴い変化する、請求項6に記載の変換回路。
- 前記ステップサイズは、2つの隣接する前記遅延ユニットの間の遅延時間に対応する一のパルス幅である、請求項7に記載の変換回路。
- 前記パルス幅周波数変調回路は、前記パワーグッドパルス信号が前記第1の論理状態のままであるときの回数をカウントし、かつ、該回数が一の予め決められた値に達したときはいつでも前記指向性クロックパルスおよび前記トリガクロックパルスを出力する一の計数回路を含み、該計数回路からの前記指向性クロックパルスは、アクティブにされる、請求項7に記載の変換回路。
- 前記入力電圧は、前記基準電圧と比較され、前記入力電圧が前記基準電圧より大きい場合は、前記電圧変換ユニットが一の逓降レギュレータとして動作することを示し、前記変換回路における動作を切り替える複数のスイッチの一部は、前記出力電圧を上昇させることを停止する、請求項1に記載の変換回路。
- 前記電圧変換ユニットが前記逓降レギュレータとして動作するとき、前記シフト回路により提供される前記制御信号の1つは、前記制御クロック信号が一のフルクロック幅モードで動作するかどうかを判断するのに用いられ、動作する場合、前記停止しているスイッチの一部は、再び動作するよう用いられる、請求項10に記載の変換回路。
- 前記変換回路が始動するたびに、前記出力電圧が検出され、前記ソースクロック信号の前記第1のクロックの前記パルス幅周波数が変調されたソースクロック信号は、最小のパルス幅に調整される、請求項1に記載の変換回路。
- 電圧変換方法であって、
一の入力電圧を受信し、かつ、一の制御クロック信号に基づき動作を切り替えることにより、前記入力電圧の大きさに従う一の出力電圧を出力する段階と、
前記出力電圧と、一の基準電圧とを比較することにより、一のパワーグッドパルス信号を生成する段階であって、前記パワーグッドパルス信号は、前記出力電圧が前記基準電圧より大きい場合、一の第1の論理状態にある段階と、
前記パワーグッドパルス信号と一のソースクロック信号とを受信することにより、前記制御クロック信号を生成する段階であって、前記ソースクロック信号のパルス幅は、一のステップサイズ機構により徐々に変化し、前記ソースクロック信号の周波数も、前記パワーグッドパルス信号が前記第1の論理状態のままである期間に変化し、前記パルス幅周波数が変調されたソースクロック信号は、前記制御クロック信号として出力される段階と、
を含む、電圧変換方法。 - 前記パワーグッドパルス信号が前記第1の論理状態のままである前記期間、前記ソースクロック信号の前記パルス幅は前記ステップサイズ機構により徐々に変化し、前記ソースクロック信号の前記周波数も変化する、請求項13に記載の電圧変換方法。
- 前記パワーグッドパルス信号が前記第1の論理状態のままである前記期間、前記パワーグッドパルス信号が前記第1の論理状態のままであるときの回数を一の計数クロックに基づきカウントすることにより、前記回数が一の予め決められた値に達したときはいつでも、前記ソースクロック信号の前記パルス幅は前記ステップサイズ機構により変更され、前記ソースクロック信号の前記周波数も変更される、請求項13に記載の電圧変換方法。
- 前記入力電圧と前記基準電圧とを比較する段階をさらに含み、前記入力電圧が前記基準電圧より大きい場合は、前記電圧変換は逓降調整の働きをし、前記出力電圧の上昇は停止する、請求項13に記載の電圧変換方法。
- 前記電圧変換が開始されるたびに、前記ソースクロック信号の前記第1のクロックに対応する前記ソースクロック信号の前記パルス幅は、最小のパルス幅に調整される、請求項13に記載の電圧変換方法。
- 一の入力電圧を受信し、かつ、一の制御クロック信号に基づき動作を切り替えることにより、前記入力電圧の大きさに従う一の出力電圧を出力する一の電圧変換ユニットと、
前記出力電圧と一の基準電圧とを比較することにより、一のパワーグッドパルス信号を生成する一の比較回路であって、前記出力電圧が前記基準電圧より大きい場合、前記パワーグッドパルス信号は、一の第1の論理状態にある比較回路と、
前記パワーグッドパルス信号と一のソースクロック信号とを受信することにより、前記制御クロック信号を生成する一のパルス幅周波数変調回路であって、前記パワーグッドパルス信号が前記第1の論理状態のままである期間、前記ソースクロック信号のパルス幅は、徐々に変更され、前記ソースクロック信号の周波数も変更され、前記パルス幅周波数が変調されたソースクロック信号は、前記制御クロック信号として出力されるパルス幅周波数変調回路と、を含む変換回路。 - 一のメモリ素子と一のホスト電力を提供する一のホストとの間に接続されるよう適合可能なコントローラであって、前記メモリ素子の動作に適合する一の電力に前記ホスト電力を調整する一の直流−直流電力マネージャを含み、
前記直流−直流電力マネージャは、
前記ホスト電力を受信し、かつ、一の制御クロック信号に基づき動作を切り替えることにより、前記ホスト電力の大きさに従う一の出力電圧を出力する一の電圧変換ユニットと、
前記出力電圧と一の基準電圧とを比較することにより、一のパワーグッドパルス信号を生成する一の比較回路であって、前記出力電圧が前記基準電圧より大きい場合、前記パワーグッドパルス信号は、一の第1の論理状態にある比較回路と、
前記パワーグッドパルス信号と一のソースクロック信号とを受信することにより、前記制御クロック信号を生成する一のパルス幅周波数変調回路であって、前記パワーグッドパルス信号が前記第1の論理状態のままである期間、前記ソースクロック信号のパルス幅は、一のステップサイズ機構により徐々に変更され、前記ソースクロック信号の周波数も変更され、前記パルス幅周波数が変調されたソースクロック信号は、前記制御クロック信号として出力されるパルス幅周波数変調回路と、を含むコントローラ。 - 前記パルス幅周波数変調回路は、複数の直列接続遅延ユニットを備える一のパルス幅変調ユニットを含み、前記直列接続遅延ユニットの入力は、前記ソースクロック信号に結合され、前記ソースクロック信号のパルス幅は、前記ステップサイズ機構により前記ソースクロック信号が通過する前記遅延ユニットの数だけ徐々に変更され、前記パルス幅変調ユニットから一のパルス変調された信号が生成される、請求項19に記載のコントローラ。
- 前記コントローラは、一のフラッシュメモリコントローラであり、前記メモリ素子は、一のフラッシュメモリ素子である、請求項19に記載のコントローラ。
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