JP2009021868A - 映像処理装置、映像処理方法、及びプログラム - Google Patents
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Abstract
【課題】動きベクトルを用いて映像信号の解像度変換をする映像処理装置を提供すること。
【解決手段】動きベクトルを用いて映像信号の解像度変換をする映像処理装置が提供される。当該映像処理装置は、一のフレームメモリを用いてフレーム巡回型のノイズ低減処理をするノイズ低減部と、前記一のフレームメモリを用いて映像信号の解像度変換をする解像度変換部とを備える。そして、前記ノイズ低減処理と前記解像度変換とで共通の前記一のフレームメモリが利用される点に特徴を有する。
【選択図】図3
【解決手段】動きベクトルを用いて映像信号の解像度変換をする映像処理装置が提供される。当該映像処理装置は、一のフレームメモリを用いてフレーム巡回型のノイズ低減処理をするノイズ低減部と、前記一のフレームメモリを用いて映像信号の解像度変換をする解像度変換部とを備える。そして、前記ノイズ低減処理と前記解像度変換とで共通の前記一のフレームメモリが利用される点に特徴を有する。
【選択図】図3
Description
本発明は、映像処理装置、映像処理方法、及びプログラムに関する。
近年、材料物性の制御技術が大きく向上し、液晶材料や有機電解発光材料等が表示デバイスとして利用されるようになってきている。その中でも、液晶材料を利用した表示デバイスは、コンピュータ用のディスプレイ装置に留まらず、大型のテレビジョン受像機として広く一般家庭にも普及してきている。今や、液晶テレビは、ほぼCRT(Cathode Ray Tube)に置き換わったのではないかとさえ思われる。
しかしながら、液晶テレビには、映像がボヤける現象が起きやすいという特性がある。そのため、液晶テレビに入力される映像信号のフレームレートを倍化してボヤケを抑制する技術が提案されている。例えば、NTSC(National Television Standard Commitee)方式の場合、通常の2倍のフレームレートである120Hzの映像信号に変換してから液晶テレビで表示することで、ボヤケを抑制することができる。同様に、PAL(Phase Alternate Line)方式の場合、映像信号のフレームレートを100Hzに変換してから液晶テレビで表示すればよい。このような映像信号のフレームレート変換は、フレーム間の動きベクトルに基づいて生成された補間フレームを元の映像信号に挿入することで実現される。
上記のフレームレート変換には、映像信号を変換するための映像処理装置又はその機能をコンピュータに実現させるためのプログラムが用いられる。そうした映像処理装置は、元の映像信号に内挿される補間フレームを生成する際にフレームメモリを利用する。例えば、映像処理装置は、連続する2枚のフレームに含まれる画素又は画素ブロックをフレームメモリに書き込み、それを参照しながら、フレーム間の動きベクトルを算出する。そして、映像処理装置は、その動きベクトルに対応する画素を2枚のフレームの中間位置に配置して補間フレームを生成する。その結果、フレーム間の動きがスムーズになるため、液晶テレビ等においても映像がスムーズになり、ボヤケが抑制されて高画質化される。例えば、下記の特許文献1には、こうしたフレームレート変換に関する技術が開示されている。
しかしながら、フレームレート変換には高価なフレームメモリが多数必要とされるため、フレームレート変換機能を搭載した機器自体の製品コストが高騰してしまう。また、映像信号に含まれるノイズが多い場合には動きベクトルが誤検出され、フレームレート変換後の映像信号が乱れてしまう。フレームメモリの使用量を節約しつつ、ノイズを低減させる手段として、フレーム巡回型のノイズ低減回路が知られている。例えば、このノイズ低減回路は、フレームメモリに蓄積して1フレーム分遅延させた映像データと、現時点の入力映像データとの差分を算出し、その差分データの一部を入力映像データから減算してノイズを低減させる。しかしながら、この方式のノイズ低減回路は、フレームに含まれる画素の移動に伴う信号変化をノイズとして検出してしまうため、移動する画素の映像がボヤケてしまう。そのため、1又は少数のフレームメモリを用いてフレームレート変換とノイズ低減とを同時に実現する技術が求められている。
そこで、本発明は、上記の問題に鑑みてなされたものであり、本発明の目的とするところは、必要なフレームメモリの容量を少なく抑えながら、フレームレート変換とノイズ低減処理とを実現することが可能な、新規かつ改良された映像処理装置、映像処理方法、及びプログラムを提供することにある。
上記課題を解決するために、本発明のある観点によれば、動きベクトルを用いて映像信号の解像度変換をする映像処理装置が提供される。当該映像処理装置は、一のフレームメモリを用いてフレーム巡回型のノイズ低減処理をするノイズ低減部と、前記一のフレームメモリを用いて映像信号の解像度変換をする解像度変換部と、を備え、前記ノイズ低減処理と前記解像度変換とで共通の前記一のフレームメモリが利用されることを特徴とする。
また、前記ノイズ低減部は、前記動きベクトルが検出される直前の段階で前記ノイズ低減処理をしてもよい。
また、前記映像処理装置は、前記動きベクトルの大きさに応じて、前記ノイズ低減処理の強度を設定するノイズ低減強度設定部をさらに備え、前記ノイズ低減部は、前記ノイズ低減強度設定部により設定された強度で前記ノイズ低減処理をしてもよい。
また、前記ノイズ低減強度設定部は、前記動きベクトルの大きさに基づいて算出される統計値に応じて、フレーム間の変化が少ない場合にノイズ低減処理の強度を強く設定してもよい。
また、前記ノイズ低減強度設定部は、前記動きベクトルの大きさが所定の範囲内に収まる画素の個数と前記統計値とに基づいて前記ノイズ低減処理の強度を設定してもよい。
また、前記ノイズ低減強度設定部は、フレーム間の差分から得られるノイズの比率に応じて、前記ノイズ低減処理の強度を設定してもよい。
また、前記ノイズ低減強度設定部は、前記ノイズの比率が小さい場合に前記ノイズ低減処理の強度を強く設定してもよい。
また、前記解像度変換部は、前記動きベクトルに基づいて生成された補間フレームを用いて、前記映像信号の時間解像度を向上させるフレームレート変換をしてもよい。
また、前記映像処理装置は、前記一のフレームメモリに対する映像データの読み出し処理又は書き込み処理のタイミングを制御するタイミング制御部をさらに備え、前記タイミング制御部は、前記ノイズ低減部及び前記解像度変換部による前記一のフレームメモリへのアクセスタイミングを制御してもよい。
また、前記タイミング制御部は、前記一のフレームメモリに対する映像データの読み出し処理が映像データの読み出し処理に先行するように制御してもよい。
また、上記課題を解決するために、本発明の別の観点によれば、動きベクトルを用いて映像信号の解像度変換をする映像処理装置による映像処理方法が提供される。当該映像処理方法は、一のフレームメモリを用いてフレーム巡回型のノイズ低減処理をするノイズ低減ステップと、前記一のフレームメモリを用いて映像信号の解像度変換をする解像度変換ステップと、を含み、前記ノイズ低減処理と前記解像度変換とで共通の前記一のフレームメモリが利用されることを特徴とする。
また、上記課題を解決するために、本発明の別の観点によれば、上記の映像処理装置が有する機能をコンピュータに実現させるためのプログラムが提供される。また、そのプログラムが記録された記録媒体が提供される。
以上説明したように本発明によれば、必要なフレームメモリの容量を少なく抑えながら、フレームレート変換とノイズ低減処理とを実現することが可能になる。
以下に添付図面を参照しながら、本発明の好適な実施の形態について詳細に説明する。なお、本明細書及び図面において、実質的に同一の機能構成を有する構成要素については、同一の符号を付することにより重複説明を省略する。
<第1実施形態>
まず、本発明の第1実施形態について詳細に説明する。本実施形態は、入力された映像信号のフレームレートを変換する処理とノイズを低減する処理とを行う際に、両処理に利用するフレームメモリを共通化する構成に一つの特徴がある。この構成により、使用されるフレームメモリの容量を削減することができる。また、本実施形態は、フレームレートを変換する際に、検出された動きベクトルの統計値を算出した上で、その統計値に基づいてノイズ低減処理の強弱を調整する構成にも特徴を有する。例えば、フレーム間で画面全体の動きが大きい場合にノイズ低減処理を弱めることで、ノイズ低減処理の誤動作によるボヤケを軽減させる効果が期待される。
まず、本発明の第1実施形態について詳細に説明する。本実施形態は、入力された映像信号のフレームレートを変換する処理とノイズを低減する処理とを行う際に、両処理に利用するフレームメモリを共通化する構成に一つの特徴がある。この構成により、使用されるフレームメモリの容量を削減することができる。また、本実施形態は、フレームレートを変換する際に、検出された動きベクトルの統計値を算出した上で、その統計値に基づいてノイズ低減処理の強弱を調整する構成にも特徴を有する。例えば、フレーム間で画面全体の動きが大きい場合にノイズ低減処理を弱めることで、ノイズ低減処理の誤動作によるボヤケを軽減させる効果が期待される。
[映像処理装置100の機能構成]
以下、本実施形態に係る映像処理装置100の構成について詳細に説明する。まず、図1を参照し、通常の映像処理装置10と対比しながら、本実施形態に係る映像処理装置100の機能構成について説明する。図1(A)は、通常の映像処理装置10が有する機能構成を示す説明図である。図1(B)は、本実施形態に係る映像処理装置100の機能構成を示す説明図である。
以下、本実施形態に係る映像処理装置100の構成について詳細に説明する。まず、図1を参照し、通常の映像処理装置10と対比しながら、本実施形態に係る映像処理装置100の機能構成について説明する。図1(A)は、通常の映像処理装置10が有する機能構成を示す説明図である。図1(B)は、本実施形態に係る映像処理装置100の機能構成を示す説明図である。
《映像処理装置10》
まず、通常の映像処理装置10が有する機能構成について簡単に説明する。図1(A)に示すように、映像処理装置10は、例えば、ノイズ低減部12と、順次走査変換部14と、スケーリング部16と、精細度補正部18と、フレーム倍速変換部20と、複数のフレームメモリ22、24、26とにより構成される。
まず、通常の映像処理装置10が有する機能構成について簡単に説明する。図1(A)に示すように、映像処理装置10は、例えば、ノイズ低減部12と、順次走査変換部14と、スケーリング部16と、精細度補正部18と、フレーム倍速変換部20と、複数のフレームメモリ22、24、26とにより構成される。
まず、ノイズ低減部12は、フレームメモリ22を用いて、入力端子から入力された映像信号に対するノイズ低減処理を実行する。次いで、順次走査変換部14は、フレームメモリ24を用いて、ノイズ低減処理が施された映像信号に対する順次走査変換(インターレース/プログレッシブ変換)を実行する。次いで、スケーリング部16は、順次走査変換部14により順次走査変換された映像信号をディスプレイ装置(図示せず)の画面サイズにスケーリングする。次いで、精細度補正部18は、スケーリング部16によりスケーリングされた映像信号に対してシャープネス等の処理を実行して精細度を補正する。次いで、フレーム倍速変換部20は、フレームメモリ26を用いて、精細度補正部18により精細度が補正された映像信号の垂直同期周波数を2倍に変換する(倍速変換処理)。その結果、ノイズ低減処理とフレームレート変換とが施された映像信号が出力端子に出力される。
《映像処理装置100》
次に、本実施形態に係る映像処理装置100の機能構成について説明する。図1(B)に示すように、映像処理装置100は、例えば、スケーリング部102と、順次走査変換部104と、精細度補正部106と、ノイズ低減部108と、フレーム倍速変換部110と、複数のフレームメモリ114、116とにより構成される。以下、ノイズ低減部108と、フレーム倍速変換部110と、フレームメモリ116とを含む構成要素をフレーム処理ブロック120と呼ぶことにする。
次に、本実施形態に係る映像処理装置100の機能構成について説明する。図1(B)に示すように、映像処理装置100は、例えば、スケーリング部102と、順次走査変換部104と、精細度補正部106と、ノイズ低減部108と、フレーム倍速変換部110と、複数のフレームメモリ114、116とにより構成される。以下、ノイズ低減部108と、フレーム倍速変換部110と、フレームメモリ116とを含む構成要素をフレーム処理ブロック120と呼ぶことにする。
まず、スケーリング部102は、入力端子から入力された映像信号をディスプレイ装置(図示せず)の画面サイズにスケーリングする。次いで、順次走査変換部104は、フレームメモリ114を用いて、スケーリング部102によりスケーリングされた映像信号を順次走査変換する。次いで、精細度補正部106は、順次走査変換部104により順次走査変換された映像信号に対してシャープネス等の処理を実行して精細度を補正する。次いで、ノイズ低減部108は、フレームメモリ116を用いて、精細度補正部106により精細度が補正された映像信号に対してノイズ低減処理を実行する。次いで、フレーム倍速変換部110は、ノイズ低減処理に利用されるフレームメモリ116を用いて、ノイズ低減部108によりノイズ低減処理された映像信号の垂直同期周波数を2倍に変換する。
(対比説明)
上記のように、通常の映像処理装置10は、順次走査変換、スケーリング、及び精細度補正の前段においてノイズ低減処理を施すために、ノイズ低減処理と倍速変換処理とで別々にフレームメモリが必要であった。しかし、本実施形態に係る映像処理装置100は、順次走査変換、スケーリング、及び精細度補正の各処理を行なった後にノイズ低減処理を実行するため、ノイズ低減処理と倍速変換処理とで共通のフレームメモリを使用することが可能になる。その結果、映像処理装置100の構成を適用すると、必要なフレームメモリの容量を抑制することができるという効果が得られる。以下、図1(B)に示した映像処理装置100の機能構成を実現させるための具体的な装置構成について説明する。
上記のように、通常の映像処理装置10は、順次走査変換、スケーリング、及び精細度補正の前段においてノイズ低減処理を施すために、ノイズ低減処理と倍速変換処理とで別々にフレームメモリが必要であった。しかし、本実施形態に係る映像処理装置100は、順次走査変換、スケーリング、及び精細度補正の各処理を行なった後にノイズ低減処理を実行するため、ノイズ低減処理と倍速変換処理とで共通のフレームメモリを使用することが可能になる。その結果、映像処理装置100の構成を適用すると、必要なフレームメモリの容量を抑制することができるという効果が得られる。以下、図1(B)に示した映像処理装置100の機能構成を実現させるための具体的な装置構成について説明する。
[フレームレート変換について]
上記の対比説明からも推察される通り、本実施形態に係る映像処理装置100は、フレーム処理ブロック120の機能構成に一つの特徴を有している。以下では、フレーム処理ブロック120の具体的な装置構成について詳細に説明するが、これに先立ち、図2を参照しながら、フレーム倍速変換部110によるフレームレート変換の原理について簡単に説明する。図2は、フレームレート変換の原理を示す説明図である。
上記の対比説明からも推察される通り、本実施形態に係る映像処理装置100は、フレーム処理ブロック120の機能構成に一つの特徴を有している。以下では、フレーム処理ブロック120の具体的な装置構成について詳細に説明するが、これに先立ち、図2を参照しながら、フレーム倍速変換部110によるフレームレート変換の原理について簡単に説明する。図2は、フレームレート変換の原理を示す説明図である。
図2(A)は、オリジナルの映像信号(以下、映像信号A)に含まれるフレームの遷移を示す。図2(B)は、フレームレート変換後の映像信号(以下、映像信号B)に含まれるフレームの遷移を示す。一例として、映像信号Aの垂直同期周波数を60Hz、映像信号Bの垂直同期周波数を120Hzと仮定する。つまり、2倍の垂直同期周波数にフレームレートを変換するケースを考える。
まず、フレーム倍速変換部110は、補間フレームの前後に位置するフレーム(以下、参照フレーム)を参照し、例えば、ブロックマッチング法等を用いて動きベクトルを推定する。例えば、フレーム倍速変換部110は、参照フレームとして、フレームT100とT110とを選択し、各参照フレームのブロックa(以下、参照ブロックa)を移動させながら、参照ブロックaに含まれる画素について差分絶対値和を算出する。そして、フレーム倍速変換部110は、最小の差分絶対値和に対応する参照ブロックaの位置を抽出し、それらの参照ブロックaを結ぶ動きベクトルを算出する。
次いで、フレーム倍速変換部110は、動きベクトルに沿って参照フレームT100の画素を1/120秒分だけ移動させ、補間フレームT105の画素を生成する。このとき、フレーム倍速変換部110は、補間フレームT105の前後に位置する参照フレームT100及びT110の画素値を平均して補間フレームT105の画素を生成してもよい。フレーム倍速変換部110は、上記の処理を映像信号Aの各フレームに対して実行し、2倍の時間解像度を有する映像信号Bを生成することができる。但し、本実施形態に適用可能な動きベクトルの検出方法、及び動き補償を利用した補間フレームの生成方法には、これに限定されず、現時点、又は将来的に公知となる種々の技術が適用されうる。
[フレーム処理ブロック120の装置構成]
上記を踏まえ、図3を参照しながら、フレーム処理ブロック120の具体的な装置構成について説明する。図3は、本実施形態に係るフレーム処理ブロック120の装置構成を示す説明図である。
上記を踏まえ、図3を参照しながら、フレーム処理ブロック120の具体的な装置構成について説明する。図3は、本実施形態に係るフレーム処理ブロック120の装置構成を示す説明図である。
図3に示すように、フレーム処理ブロック120は、主に、減算器122、144と、フレームメモリ124、134と、動き推定回路132と、統計算出回路136と、乗算器138、140と、帰還率算出回路142と、動き補償回路150とにより構成される。また、動き補償回路150は、データ選択回路152と、メモリ154とを含む。
まず、入力された映像信号は、分岐されて減算器122、及び減算器144にそれぞれ入力される。減算器122には、入力された映像信号に加え、後述するノイズ成分が入力される。そして、減算器122は、映像信号からノイズ成分を減算して出力する。次いで、減算器122から出力された映像信号は、分岐されてフレームメモリ124と動き推定回路132とにそれぞれ入力される。
フレームメモリ124に入力された映像信号は、例えば、フレームメモリ124内に蓄積されて1フレーム遅延した映像信号として読み出される。また、フレームメモリ124に入力された映像信号は、後述する動き補償回路150により倍速で読み出される。
(ノイズ低減処理について)
ここで、上記のノイズ低減部108の機能に相当する構成について説明する。ノイズ低減部108に相当する機能は、主に、減算器122、144によって実現される。減算器144には、入力端子から分岐して入力された映像信号(以下、現映像信号)と、フレームメモリ124から読み出された1フレーム遅延した映像信号(以下、遅延映像信号)とが入力される。そして、減算器144は、現映像信号から遅延映像信号を減算して差分信号を出力する。次いで、減算器144から出力された差分信号は、後述する乗算器140の処理を介して減算器122に入力される。そして、減算器122は、入力端子から入力された現映像信号から、減算器144により出力(実際は乗算器140の出力)された差分信号(ノイズ成分に相当)を減算することによって、ノイズが低減された映像信号を出力する。尚、減算器144により出力された差分信号は、乗算器140と、帰還率算出回路142とに入力され、ノイズ低減処理の強弱を調整するために利用される。
ここで、上記のノイズ低減部108の機能に相当する構成について説明する。ノイズ低減部108に相当する機能は、主に、減算器122、144によって実現される。減算器144には、入力端子から分岐して入力された映像信号(以下、現映像信号)と、フレームメモリ124から読み出された1フレーム遅延した映像信号(以下、遅延映像信号)とが入力される。そして、減算器144は、現映像信号から遅延映像信号を減算して差分信号を出力する。次いで、減算器144から出力された差分信号は、後述する乗算器140の処理を介して減算器122に入力される。そして、減算器122は、入力端子から入力された現映像信号から、減算器144により出力(実際は乗算器140の出力)された差分信号(ノイズ成分に相当)を減算することによって、ノイズが低減された映像信号を出力する。尚、減算器144により出力された差分信号は、乗算器140と、帰還率算出回路142とに入力され、ノイズ低減処理の強弱を調整するために利用される。
(ノイズ低減処理強度の調整方法について)
ここで、ノイズ低減処理強度の調整方法について説明する。上記のように、減算器122から出力された映像信号(現映像信号)は、分岐されてフレームメモリ124と動き推定回路132とに入力される。動き推定回路132には、現映像信号に加えて、フレームメモリ124から読み出された遅延映像信号が入力される。そこで、動き推定回路132は、現映像信号のフレームと遅延映像信号のフレームとの間の動きベクトルを推定する。そして、動き推定回路132により推定された動きベクトルは、フレームメモリ134と統計算出回路136とに入力される。尚、フレームメモリ134に蓄積された動きベクトルは、動き補償回路150において補間フレームを生成する際に利用される。
ここで、ノイズ低減処理強度の調整方法について説明する。上記のように、減算器122から出力された映像信号(現映像信号)は、分岐されてフレームメモリ124と動き推定回路132とに入力される。動き推定回路132には、現映像信号に加えて、フレームメモリ124から読み出された遅延映像信号が入力される。そこで、動き推定回路132は、現映像信号のフレームと遅延映像信号のフレームとの間の動きベクトルを推定する。そして、動き推定回路132により推定された動きベクトルは、フレームメモリ134と統計算出回路136とに入力される。尚、フレームメモリ134に蓄積された動きベクトルは、動き補償回路150において補間フレームを生成する際に利用される。
(統計算出回路136)
統計算出回路136は、動き推定回路132から入力された動きベクトルに基づいてノイズ低減処理の強弱を設定するための係数を算出する。ここで、図4を参照しながら、統計算出回路136の詳細な回路構成について説明する。図4は、本実施形態に係る統計算出回路136の回路構成を示す説明図である。
統計算出回路136は、動き推定回路132から入力された動きベクトルに基づいてノイズ低減処理の強弱を設定するための係数を算出する。ここで、図4を参照しながら、統計算出回路136の詳細な回路構成について説明する。図4は、本実施形態に係る統計算出回路136の回路構成を示す説明図である。
図4に示すように、統計算出回路136は、主に、絶対値算出回路162と、積算値算出回路164と、係数算出回路166と、閾値判定回路168と、カウンタ170とにより構成される。
絶対値算出回路162は、入力された動きベクトルの絶対値(ノルム)を算出する。絶対値算出回路162により算出された絶対値は、分岐された積算値算出回路164と閾値判定回路168とに入力される。積算値算出回路164は、入力された絶対値を1フレーム期間にわたり積算して積算値を算出する。積算値算出回路164により算出された積算値は、係数算出回路166に入力される。一方、閾値判定回路168は、入力された絶対値が所定の範囲内に収まるか否かを判定し、所定の範囲内に収まる絶対値に対応する画素を選択する。例えば、下限閾値th1と上限閾値th2とが予め設定されている場合、閾値判定回路168は、絶対値mvと各閾値との間の大小関係を調べることにより、th1≦mv≦th2となる画素を選択することができる。次いで、カウンタ170は、閾値判定回路168により所定の範囲内に絶対値が収まると判定された動きベクトルに対応する画素の数をカウントする。
次いで、係数算出回路166は、積算値算出回路164により算出された積算値と、カウンタ170から出力されたカウンタ値とに基づいて係数を算出する。ここで、図5を参照しながら、係数算出回路166による係数算出方法について説明する。図5は、係数算出回路166による係数算出方法を示す説明図である。
図5には、積算値算出回路164から出力された積算値Sに対して設定される係数Cのグラフが示されている。但し、係数Cは、0から1の範囲で決定される。図5に示すように、積算値算出回路164は、積算値Sが小さいほど係数Cを大きく設定し、積算値Sが大きいほど係数Cを小さく設定する。但し、積算値Sの増加に対して係数Cが減少する割合(傾き)は、カウンタ170から出力されるカウント値により決定される。図5に示すように、カウント値が大きくなるにつれて、積算値Sの増加に対して係数Cが減少する割合が大きくなり、急峻な傾きとなる。図5に示すような特性を有する係数Cを設定することで、フレーム間の動きが少ないほど大きな係数Cが設定される。後述するように、本実施形態に係る映像処理装置100は、係数Cが大きいほど、ノイズ低減処理が強まるように構成されるため、フレーム間の動きが大きい場合にノイズ低減処理が強めることが可能になる。
(帰還率算出回路142)
再び図3を参照する。統計算出回路136により算出された係数は、乗算器138に入力される。乗算器138には、上記の係数に加えて、帰還率算出回路142により算出される帰還率が入力される。そこで、帰還率算出回路142について説明する。既に述べた通り、帰還率算出回路142には、減算器144から出力される差分信号が入力される。
再び図3を参照する。統計算出回路136により算出された係数は、乗算器138に入力される。乗算器138には、上記の係数に加えて、帰還率算出回路142により算出される帰還率が入力される。そこで、帰還率算出回路142について説明する。既に述べた通り、帰還率算出回路142には、減算器144から出力される差分信号が入力される。
まず、帰還率算出回路142は、減算器144から入力された差分信号に基づいてノイズ成分の比率に対応する帰還率を算出する。但し、帰還率は、0以上1未満の値である。ここで、図6を参照しながら、帰還率算出回路142による帰還率の算出方法について説明する。図6は、帰還率算出回路142による帰還率の算出方法を示す説明図である。
図6には、差分信号の絶対値に相当する入力レベルIに応じて設定される帰還率の値Rのグラフが示されている。図6に示すように、帰還率算出回路142は、入力レベルIが大きいほど、より小さい帰還値Rを出力する。つまり、ノイズ成分が大きい場合に小さい帰還率が出力される。そして、出力された帰還値Rは、乗算器138に入力されて、統計算出回路136から入力された係数に乗算される。そして、乗算器138の出力値は、乗算器140に入力されて減算器144から出力された差分信号に乗算される。その結果、減算器122において減算されるノイズ成分の大きさが、上記の係数と帰還率とにより調整される。
以上、本実施形態に係るフレーム処理ブロック120によるノイズ低減処理について説明した。上記のように、フレーム処理ブロック120は、フレーム巡回型のノイズ低減処理を実行することが可能であると共に、フレーム間の移動量、及びノイズ成分の大きさに応じて、ノイズ低減処理の強度を変更することができる。その結果、大きなフレーム間の動きに起因してノイズ低減処理の誤動作を抑制することが可能になる。また、動きベクトルの推定処理の直前段階においてノイズ低減処理を実行することにより、動きベクトルの誤検出を低減させることが可能になる。
(フレームメモリ124へのアクセスタイミング)
次に、図7を参照しながら、フレームメモリ124へのアクセスタイミングの制御方法について説明する。図7は、フレームメモリ124に対するアクセスタイミングの一例を示す説明図である。
次に、図7を参照しながら、フレームメモリ124へのアクセスタイミングの制御方法について説明する。図7は、フレームメモリ124に対するアクセスタイミングの一例を示す説明図である。
図7の上図は、(A)現映像信号の入力タイミングを基準にして、(B)遅延映像信号の読み出しタイミング、(C)ノイズ低減(NR;Noise Reduction)後の書き込みタイミング、及び(D)遅延映像信号の倍速読み出しタイミングを示した説明図である。図7の下図は、各タイミングでアクセスされるメモリアドレスを示す説明図である。
図7に示すように、1フレーム分遅延した遅延映像信号を入力された映像信号と同じタイミングで読み出される。また、フレームメモリ124への書き込み処理がノイズ低減処理の直後に実行されるため、1フレーム分遅延した遅延映像信号の読み出し処理が開始されてからノイズ低減処理に要する時間だけ経過した後に書き込み処理が開始される。これに対し、倍速読み出し処理は、フレームメモリ124に対する書き込み処理の開始時点から、フレーム周期の1/2を僅かに超える程度の時間だけ遅れて開始される。
上記のタイミング制御により、図7の下図に示すように、倍速読み出し処理のためにアクセスされるアドレスと、NR後の書き込み処理のためにアクセスされるアドレスとの重複が防止される。また、映像信号の読み出し処理が常にNR後の書き込み処理に先行して実行されるため、必要なフレームメモリ124のメモリ容量を1フレーム分に抑えることができる。
(動き推定回路132)
再び図3を参照する。フレームメモリ124内に蓄積された1フレーム分遅延した遅延信号とノイズ低減後の現映像信号とは、動き推定回路132に入力される。そして、動き推定回路132は、入力された遅延映像信号と現映像信号とに基づいて動きベクトルを推定する。動き推定回路132は、動きベクトルを推定する方法として、例えば、ブロックマッチング法を利用することができる。ブロックマッチング法とは、一対の参照フレームのうち、一方の参照フレームをm×n画素のブロックに細分化して、そのブロックに含まれる画像をもう一方の参照フレーム上で移動させながら、画素値の差分絶対値和が最小になる移動ベクトルを算出する方法である。その移動ベクトルが動きベクトルになる。
再び図3を参照する。フレームメモリ124内に蓄積された1フレーム分遅延した遅延信号とノイズ低減後の現映像信号とは、動き推定回路132に入力される。そして、動き推定回路132は、入力された遅延映像信号と現映像信号とに基づいて動きベクトルを推定する。動き推定回路132は、動きベクトルを推定する方法として、例えば、ブロックマッチング法を利用することができる。ブロックマッチング法とは、一対の参照フレームのうち、一方の参照フレームをm×n画素のブロックに細分化して、そのブロックに含まれる画像をもう一方の参照フレーム上で移動させながら、画素値の差分絶対値和が最小になる移動ベクトルを算出する方法である。その移動ベクトルが動きベクトルになる。
(フレームメモリ134へのアクセスタイミング)
次に、図8を参照しながら、フレームメモリ134へのアクセスタイミングの制御方法について説明する。図8は、フレームメモリ134に対するアクセスタイミングの一例を示す説明図である。
次に、図8を参照しながら、フレームメモリ134へのアクセスタイミングの制御方法について説明する。図8は、フレームメモリ134に対するアクセスタイミングの一例を示す説明図である。
図8には、(C)NR後書き込みタイミング、(E)動きベクトルの書き込みタイミング、(F)動きベクトルの読み出しタイミング、(D)倍速読み出しタイミング、及び(G)生成映像の出力タイミングが示されている。
図8に示すように、動き推定回路132により算出された動きベクトルは、入力された映像信号のフレーム周波数と同じ周波数でフレームメモリ134に書き込まれる。このとき、書き込み処理が開始されてから、1/2フレーム周期後に倍速読み出し処理が開始される。そして、読み出された動きベクトルは、動き補償回路150に入力される。
(動き補償回路150)
再び図3を参照する。動き補償回路150は、データ選択回路152と、少量の画像メモリ154とを有している。データ選択回路152は、入力された動きベクトルに対応する画素を選択し、補間フレームの画素として画像メモリ154に入力する。例えば、フレーム1’とフレーム2’との間で算出された動きベクトルをmv12と表記すると、動き補償回路150は、後から入力されたフレーム2’の画素を−mv12/2だけシフトさせて補間フレーム(動き補償フレーム)の画素を生成することができる。そして、動き補償回路150は、補間フレームを元の映像信号に挿入することでフレームレートを変換することが可能になる。
再び図3を参照する。動き補償回路150は、データ選択回路152と、少量の画像メモリ154とを有している。データ選択回路152は、入力された動きベクトルに対応する画素を選択し、補間フレームの画素として画像メモリ154に入力する。例えば、フレーム1’とフレーム2’との間で算出された動きベクトルをmv12と表記すると、動き補償回路150は、後から入力されたフレーム2’の画素を−mv12/2だけシフトさせて補間フレーム(動き補償フレーム)の画素を生成することができる。そして、動き補償回路150は、補間フレームを元の映像信号に挿入することでフレームレートを変換することが可能になる。
以上、本発明の第1実施形態に係る映像処理装置100の構成について詳細に説明した。上記の通り、本実施形態に係る映像処理装置100の特徴は、フレーム処理ブロック120によるノイズ低減処理と、動きベクトルを用いたフレームレート変換処理とにある。特に、映像処理装置100は、ノイズ低減処理の際にノイズ成分の割合やフレーム間の画像移動量等を考慮してノイズ低減処理の強度を調整する機能を有する点に一つの特徴を有している。かかる構成により、動きベクトルの統計情報がノイズ低減処理の制御に使用されるため、ノイズ低減処理の際に、フレーム間の画像移動に起因する信号レベルの変動がノイズ成分に誤解されることがほとんど無くなる。さらに、動きベクトルを検出する直前の段階でノイズ低減処理を行なうため、順次走査変換等の誤動作で加わったノイズ成分も低減することが可能になる。その結果、動きベクトルの誤検出が低減される。
また、フレーム倍速変換部110に相当する動き補償回路150や動き推定回路132等の構成要素において、フレームメモリ124、134に対するアクセスタイミングを好適に制御することで、必要となるフレームメモリの容量が低減される。その結果、フレームメモリの容量を抑えつつ、ノイズ低減処理とフレームレート変換とを実行することが可能になる。
<第2実施形態>
次に、本発明の第2実施形態について説明する。尚、上記の第1実施形態と実質的に同一の構成要素については詳細な説明を省略し、相違する構成についてのみ詳細に説明する。本実施形態は、動きベクトルを用いて補間フレームを生成する際に、補間フレームの前後に位置する参照フレームを両方参照する構成に特徴がある。そのため、上記の第1実施形態との間の相違点は、上記の映像処理装置100が備えるフレーム処理ブロック120の装置構成にある。そこで、以下では、本実施形態に係るフレーム処理ブロック120の構成についてのみ詳細に説明する。
次に、本発明の第2実施形態について説明する。尚、上記の第1実施形態と実質的に同一の構成要素については詳細な説明を省略し、相違する構成についてのみ詳細に説明する。本実施形態は、動きベクトルを用いて補間フレームを生成する際に、補間フレームの前後に位置する参照フレームを両方参照する構成に特徴がある。そのため、上記の第1実施形態との間の相違点は、上記の映像処理装置100が備えるフレーム処理ブロック120の装置構成にある。そこで、以下では、本実施形態に係るフレーム処理ブロック120の構成についてのみ詳細に説明する。
[フレーム処理ブロック120の回路構成]
図9を参照しながら、本実施形態に係るフレーム処理ブロック120の回路構成について説明する。図9は、本実施形態に係るフレーム処理ブロック120の回路構成を示す説明図である。
図9を参照しながら、本実施形態に係るフレーム処理ブロック120の回路構成について説明する。図9は、本実施形態に係るフレーム処理ブロック120の回路構成を示す説明図である。
図9に示すように、フレーム処理ブロック120は、主に、減算器122、144と、フレームメモリ124と、データ選択回路202と、複数の動き補償回路204、206と、平均化回路208と、動き推定回路132と、統計算出回路136と、乗算器138、140と、帰還率算出回路142とにより構成される。
まず、入力端子から入力された映像信号は、分岐されて減算器122、及び減算器144に入力される。また、減算器122には、入力された映像信号に加えて、減算器144からノイズ成分が入力される。尚、このノイズ成分の生成に係る処理は、上記の第1実施形態と実質的に同一であるため、詳細な説明を省略する。
本実施形態において、減算器122から出力されたノイズ低減後の映像信号は、分岐されてフレームメモリ124と、動き補償回路206と、動き推定回路132とに入力される。また、動き補償回路204には、フレームメモリ124に蓄積されて1フレーム分遅延した遅延映像信号が入力される。さらに、動き推定回路132により推定された動きベクトルは、分岐されて動き補償回路204と、動き補償回路206とに入力される。
例えば、連続するフレーム(フレーム1、2)が動き推定回路132に入力されると、ブロックマッチング法等を用いて動きベクトルmv12が算出される。そして、動き補償回路204は、時間的に先のフレーム1に含まれる画素をmv12/2だけシフトさせて補間フレームの画素を生成する。同様に、動き補償回路206は、時間的に後のフレーム2に含まれる画素を−mv12/2だけシフトさせて補間フレームの画素を生成する。そして、動き補償回路204、206により生成された補間フレームの画素は、平均化回路208に入力されて平均化処理が施される。例えば、平均化回路208は、入力された2つの画素の画素値を平均して、その平均値を補間フレームの画素値として出力する。平均化回路208から出力された画素値は、フレームメモリ134に蓄積される。
次いで、データ選択回路202は、フレームメモリ124に書き込まれた動き補償前のフレームと、フレームメモリ134に書き込まれた動き補償後のフレームとを2倍の垂直同期周波数になるように交互に読み出して倍速化された映像信号を出力する。ここで、図10を参照しながら、フレームメモリ124、134からフレームを読み出すタイミングについて説明する。図10は、フレームメモリ124、134からフレームを読み出すタイミングを示す説明図である。
図10に示すように、ノイズ低減後の書き込み映像がフレームメモリ124に書き込まれる処理が開始される少し前に1フレーム分遅延した遅延映像信号の読み出し処理が開始される。これらの処理開始時間の時間差は、ノイズ低減処理に必要な遅延時間に等しい。また、倍速読み出し処理は、ノイズ低減後の書き込み処理が開始する直前に開始される。このようにフレームメモリ124へのアクセスタイミングを制御することで、フレームメモリ124のメモリ容量を1フレーム分程度に抑えることが可能になる。また、フレームメモリ134において、動き補正後の映像信号が書き込まれた後で1/2フレームを僅かに超える時間後に倍速読み出し処理が開始される。このようなタイミング制御がされることで、動き補償前の映像信号と、動き補償後の映像信号とが交互に読み出されて、好適に倍速変換された映像信号を出力することができる。
(双方向参照の原理)
図11に示すように、本実施形態では、補間フレームの前後に位置する参照フレームから算出された動きベクトルmvを用いて、前の参照フレームの画素をmv/2、後の参照フレームの画素を−mv/2移動させて2つの補間フレームの画素を生成する。そして、2つの補間フレームの画素を平均化処理して、実際に用いる補間フレームの画素を算出するため、上記の第1実施形態に比べ、動きベクトルを誤検出した際に発生するノイズが軽減されるという効果が得られる。
図11に示すように、本実施形態では、補間フレームの前後に位置する参照フレームから算出された動きベクトルmvを用いて、前の参照フレームの画素をmv/2、後の参照フレームの画素を−mv/2移動させて2つの補間フレームの画素を生成する。そして、2つの補間フレームの画素を平均化処理して、実際に用いる補間フレームの画素を算出するため、上記の第1実施形態に比べ、動きベクトルを誤検出した際に発生するノイズが軽減されるという効果が得られる。
以上説明したように、本発明の好適な実施形態に係る技術を適用すると、フレーム巡回型のノイズ低減処理と垂直周波数の倍速変換とに用いるフレームメモリを共通化できるため、全体の高画質化処理に必要なメモリ容量を削減することが可能になる。また、垂直周波数の倍速変換を実行する際に、動きベクトルの検出結果をノイズ低減処理のゲイン調整に使用することで、ノイズ低減処理のエラーに起因してボヤケが発生することを抑制できる。さらに、動きベクトルを検出する処理の直前にノイズ低減処理が実行されるため、動きベクトルの誤検出が低減される。
[ハードウェア構成]
上記装置が有する各構成要素の機能は、例えば、図12に示すハードウェア構成を有する情報処理装置により実現することが可能である。図12は、上記装置の各構成要素が有する機能を実現することが可能な情報処理装置のハードウェア構成を示す説明図である。
上記装置が有する各構成要素の機能は、例えば、図12に示すハードウェア構成を有する情報処理装置により実現することが可能である。図12は、上記装置の各構成要素が有する機能を実現することが可能な情報処理装置のハードウェア構成を示す説明図である。
図12に示すように、前記の情報処理装置は、主に、CPU(Central Processing Unit)902と、ROM(Read Only Memory)904と、RAM(Random Access Memory)906と、ホストバス908と、ブリッジ910と、外部バス912と、インターフェース914と、入力部916と、出力部918と、記憶部920と、ドライブ922と、接続ポート924と、通信部926とにより構成される。
CPU902は、例えば、演算処理装置又は制御装置として機能し、ROM904、RAM906、記憶部920、又はリムーバブル記録媒体928に記録された各種プログラムに基づいて各構成要素の動作全般又はその一部を制御する。ROM904は、例えば、CPU902に読み込まれるプログラムや演算に用いるデータ等を格納する。RAM906は、例えば、CPU902に読み込まれるプログラムや、そのプログラムを実行する際に適宜変化する各種パラメータ等を一時的又は永続的に格納する。これらの構成要素は、例えば、高速なデータ伝送が可能なホストバス908によって相互に接続されている。また、ホストバス908は、例えば、ブリッジ910を介して比較的データ伝送速度が低速な外部バス912に接続されている。
入力部916は、例えば、マウス、キーボード、タッチパネル、ボタン、スイッチ、及びレバー等の操作手段である。また、入力部916は、赤外線やその他の電波を利用して制御信号を送信することが可能なリモートコントロール手段(所謂、リモコン)であってもよい。なお、入力部916は、上記の操作手段を用いて入力された情報を入力信号としてCPU902に伝送するための入力制御回路等により構成されている。
出力部918は、例えば、CRT(Cathode Ray Tube)、LCD(Liquid Crystal Display)、PDP(Plasma DisplayPanel)、又はELD(Electro−Luminescence Display)等のディスプレイ装置、スピーカ、ヘッドホン等のオーディオ出力装置、プリンタ、携帯電話、又はファクシミリ等、取得した情報を利用者に対して視覚的又は聴覚的に通知することが可能な装置である。
記憶部920は、各種のデータを格納するための装置であり、例えば、ハードディスクドライブ(HDD;Hard Disk Drive)等の磁気記憶デバイス、半導体記憶デバイス、光記憶デバイス、又は光磁気記憶デバイス等により構成される。
ドライブ922は、例えば、磁気ディスク、光ディスク、光磁気ディスク、又は半導体メモリ等のリムーバブル記録媒体928に記録された情報を読み出し、又はリムーバブル記録媒体928に情報を書き込む装置である。リムーバブル記録媒体928は、例えば、DVDメディア、Blu−rayメディア、HD−DVDメディア、コンパクトフラッシュ(CF;CompactFlash)(登録商標)、メモリースティック、又はSDメモリカード(Secure Digital memory card)等である。もちろん、リムーバブル記録媒体928は、例えば、非接触型ICチップを搭載したICカード(Integrated Circuit Card)、又は電子機器等であってもよい。
接続ポート924は、例えば、USB(Universal Serial Bus)ポート、IEEE1394ポート、SCSI(Small Computer System Interface)、RS−232Cポート、又は光オーディオ端子等のような外部接続機器930を接続するためのポートである。外部接続機器930は、例えば、プリンタ、携帯音楽プレーヤ、デジタルカメラ、デジタルビデオカメラ、又はICレコーダ等である。
通信部926は、ネットワーク932に接続するための通信デバイスであり、例えば、有線又は無線LAN(Local Area Network)、Bluetooth(登録商標)、又はWUSB(Wireless USB)用の通信カード、光通信用のルータ、ADSL(Asymmetric Digital Subscriber Line)用のルータ、又は各種通信用のモデム等である。また、通信部926に接続されるネットワーク932は、有線又は無線により接続されたネットワークにより構成され、例えば、インターネット、家庭内LAN、赤外線通信、放送、又は衛星通信等である。
以上、本発明の好適な実施形態について詳細に説明した。上記の技術を適用することにより、例えば、(1)計算リソースの削減、(2)動き推定の精度向上、(3)フレームレート変換の品質向上、(4)高画質化処理の品質向上等の効果が期待される。
以上、添付図面を参照しながら本発明の好適な実施形態について説明したが、本発明は係る例に限定されないことは言うまでもない。当業者であれば、特許請求の範囲に記載された範疇内において、各種の変更例または修正例に想到し得ることは明らかであり、それらについても当然に本発明の技術的範囲に属するものと了解される。
例えば、ブロックマッチングを行う際に、参照ブロックの移動量を大きく設定することで、より動きベクトルの推定精度を向上させることができる。或いは、上記の実施形態に係る映像処理方法と、「ブロックマッチングする範囲を限定する方法」、「ブロックマッチングするエリアを縮小する方法」、又は「階層的にブロックマッチングする方法」とを組み合わせて用いることもできる。これらの変形は、計算リソースと必要な動きベクトルの推定精度との兼ね合いに応じて適宜調整されうる。
以上、添付図面を参照しながら本発明の好適な実施形態について説明したが、本発明は係る例に限定されないことは言うまでもない。当業者であれば、特許請求の範囲に記載された範疇内において、各種の変更例または修正例に想到し得ることは明らかであり、それらについても当然に本発明の技術的範囲に属するものと了解される。
100 映像処理装置
102 スケーリング部
104 順次走査変換部
106 精細度補正部
108 ノイズ低減部
110 フレーム倍速変換部
114、116 フレームメモリ
120 フレーム処理ブロック
122、144 減算器
124、134 フレームメモリ
132 動き推定回路
136 統計算出回路
138、140 乗算器
150 動き補償回路
152 データ選択回路
154 画像メモリ
162 絶対値算出回路
164 積算値算出回路
166 係数算出回路
168 閾値判定回路
170 カウンタ
202 データ選択回路
204、206 動き補償回路
208 平均化回路
102 スケーリング部
104 順次走査変換部
106 精細度補正部
108 ノイズ低減部
110 フレーム倍速変換部
114、116 フレームメモリ
120 フレーム処理ブロック
122、144 減算器
124、134 フレームメモリ
132 動き推定回路
136 統計算出回路
138、140 乗算器
150 動き補償回路
152 データ選択回路
154 画像メモリ
162 絶対値算出回路
164 積算値算出回路
166 係数算出回路
168 閾値判定回路
170 カウンタ
202 データ選択回路
204、206 動き補償回路
208 平均化回路
Claims (12)
- 動きベクトルを用いて映像信号の解像度変換をする映像処理装置であって、
一のフレームメモリを用いてフレーム巡回型のノイズ低減処理をするノイズ低減部と、
前記一のフレームメモリを用いて映像信号の解像度変換をする解像度変換部と、
を備え、
前記ノイズ低減処理と前記解像度変換とで共通の前記一のフレームメモリが利用されることを特徴とする、映像処理装置。 - 前記ノイズ低減部は、前記動きベクトルが検出される直前の段階で前記ノイズ低減処理をすることを特徴とする、請求項1に記載の映像処理装置。
- 前記動きベクトルの大きさに応じて、前記ノイズ低減処理の強度を設定するノイズ低減強度設定部をさらに備え、
前記ノイズ低減部は、前記ノイズ低減強度設定部により設定された強度で前記ノイズ低減処理をすることを特徴とする、請求項1に記載の映像処理装置。 - 前記ノイズ低減強度設定部は、前記動きベクトルの大きさに基づいて算出される統計値に応じて、フレーム間の変化が少ない場合にノイズ低減処理の強度を強く設定することを特徴とする、請求項3に記載の映像処理装置。
- 前記ノイズ低減強度設定部は、前記動きベクトルの大きさが所定の範囲内に収まる画素の個数と前記統計値とに基づいて前記ノイズ低減処理の強度を設定することを特徴とする、請求項4に記載の映像処理装置。
- 前記ノイズ低減強度設定部は、フレーム間の差分から得られるノイズの比率に応じて、前記ノイズ低減処理の強度を設定することを特徴とする、請求項3に記載の映像処理装置。
- 前記ノイズ低減強度設定部は、前記ノイズの比率が小さい場合に前記ノイズ低減処理の強度を強く設定することを特徴とする、請求項6に記載の映像処理装置。
- 前記解像度変換部は、前記動きベクトルに基づいて生成された補間フレームを用いて、前記映像信号の時間解像度を向上させるフレームレート変換をすることを特徴とする、請求項1に記載の映像処理装置。
- 前記一のフレームメモリに対する映像データの読み出し処理又は書き込み処理のタイミングを制御するタイミング制御部をさらに備え、
前記タイミング制御部は、前記ノイズ低減部及び前記解像度変換部による前記一のフレームメモリへのアクセスタイミングを制御することを特徴とする、請求項1に記載の映像処理装置。 - 前記タイミング制御部は、前記一のフレームメモリに対する映像データの読み出し処理が映像データの読み出し処理に先行するように制御することを特徴とする、請求項10に記載の映像処理装置。
- 動きベクトルを用いて映像信号の解像度変換をする映像処理装置による映像処理方法であって、
一のフレームメモリを用いてフレーム巡回型のノイズ低減処理をするノイズ低減ステップと、
前記一のフレームメモリを用いて映像信号の解像度変換をする解像度変換ステップと、
を含み、
前記ノイズ低減処理と前記解像度変換とで共通の前記一のフレームメモリが利用されることを特徴とする、映像処理方法。 - 請求項1〜10のいずれかに記載の映像処理装置が有する機能をコンピュータに実現させるためのプログラム。
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Cited By (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010093680A (ja) * | 2008-10-10 | 2010-04-22 | Victor Co Of Japan Ltd | 映像信号処理装置及び映像信号処理方法 |
WO2012073866A1 (ja) * | 2010-11-30 | 2012-06-07 | シャープ株式会社 | 信号処理装置、信号処理方法、信号処理プログラムおよび表示装置 |
JP2012182673A (ja) * | 2011-03-01 | 2012-09-20 | Toshiba Corp | 映像表示装置及び映像処理方法 |
JP2013048446A (ja) * | 2012-09-26 | 2013-03-07 | Toshiba Corp | 映像表示装置及び映像処理方法 |
US8451373B2 (en) | 2009-07-31 | 2013-05-28 | Sanyo Electric Co., Ltd. | Frame rate converter and display apparatus equipped therewith |
KR20140095330A (ko) * | 2013-01-24 | 2014-08-01 | 삼성디스플레이 주식회사 | 표시 장치 및 그것의 구동 방법 |
JP2015146558A (ja) * | 2014-02-04 | 2015-08-13 | 三菱電機株式会社 | 画像処理装置 |
JP2015192178A (ja) * | 2014-03-27 | 2015-11-02 | セイコーエプソン株式会社 | 表示装置、画像処理装置、及び、表示方法 |
JP2015192156A (ja) * | 2014-03-27 | 2015-11-02 | セイコーエプソン株式会社 | 表示装置、画像処理装置、及び、表示方法 |
KR20170060975A (ko) * | 2015-11-25 | 2017-06-02 | 삼성전자주식회사 | 프레임 레이트 변환 장치 및 그 프레임 레이트 변환 방법 |
JP2018110325A (ja) * | 2017-01-04 | 2018-07-12 | 東芝映像ソリューション株式会社 | 時分割的に複数回処理可能な高画質化装置 |
JP2019062528A (ja) * | 2017-09-27 | 2019-04-18 | キヤノン株式会社 | 画像処理方法、画像処理装置、撮像装置、およびプログラム |
CN114449183A (zh) * | 2020-11-02 | 2022-05-06 | 瑞昱半导体股份有限公司 | 影像处理芯片与影像处理方法 |
-
2007
- 2007-07-12 JP JP2007183482A patent/JP2009021868A/ja not_active Withdrawn
Cited By (18)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010093680A (ja) * | 2008-10-10 | 2010-04-22 | Victor Co Of Japan Ltd | 映像信号処理装置及び映像信号処理方法 |
US8451373B2 (en) | 2009-07-31 | 2013-05-28 | Sanyo Electric Co., Ltd. | Frame rate converter and display apparatus equipped therewith |
WO2012073866A1 (ja) * | 2010-11-30 | 2012-06-07 | シャープ株式会社 | 信号処理装置、信号処理方法、信号処理プログラムおよび表示装置 |
JP2012182673A (ja) * | 2011-03-01 | 2012-09-20 | Toshiba Corp | 映像表示装置及び映像処理方法 |
US8593575B2 (en) | 2011-03-01 | 2013-11-26 | Kabushiki Kaisha Toshiba | Video display apparatus for shortened-delay processing of a video signal and video processing method |
JP2013048446A (ja) * | 2012-09-26 | 2013-03-07 | Toshiba Corp | 映像表示装置及び映像処理方法 |
KR102015771B1 (ko) * | 2013-01-24 | 2019-08-30 | 삼성디스플레이 주식회사 | 표시 장치 및 그것의 구동 방법 |
KR20140095330A (ko) * | 2013-01-24 | 2014-08-01 | 삼성디스플레이 주식회사 | 표시 장치 및 그것의 구동 방법 |
JP2015146558A (ja) * | 2014-02-04 | 2015-08-13 | 三菱電機株式会社 | 画像処理装置 |
JP2015192178A (ja) * | 2014-03-27 | 2015-11-02 | セイコーエプソン株式会社 | 表示装置、画像処理装置、及び、表示方法 |
JP2015192156A (ja) * | 2014-03-27 | 2015-11-02 | セイコーエプソン株式会社 | 表示装置、画像処理装置、及び、表示方法 |
KR20170060975A (ko) * | 2015-11-25 | 2017-06-02 | 삼성전자주식회사 | 프레임 레이트 변환 장치 및 그 프레임 레이트 변환 방법 |
KR102192488B1 (ko) | 2015-11-25 | 2020-12-17 | 삼성전자주식회사 | 프레임 레이트 변환 장치 및 그 프레임 레이트 변환 방법 |
JP2018110325A (ja) * | 2017-01-04 | 2018-07-12 | 東芝映像ソリューション株式会社 | 時分割的に複数回処理可能な高画質化装置 |
JP2019062528A (ja) * | 2017-09-27 | 2019-04-18 | キヤノン株式会社 | 画像処理方法、画像処理装置、撮像装置、およびプログラム |
JP7118818B2 (ja) | 2017-09-27 | 2022-08-16 | キヤノン株式会社 | 画像処理方法、画像処理装置、撮像装置、およびプログラム |
CN114449183A (zh) * | 2020-11-02 | 2022-05-06 | 瑞昱半导体股份有限公司 | 影像处理芯片与影像处理方法 |
CN114449183B (zh) * | 2020-11-02 | 2024-03-15 | 瑞昱半导体股份有限公司 | 影像处理芯片与影像处理方法 |
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