JP2007109732A - Manufacturing method of element substrate and substrate holding device - Google Patents
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Abstract
Description
本発明は素子基板の製造方法及び基板保持装置に関する。 The present invention relates to an element substrate manufacturing method and a substrate holding apparatus.
近年、半導体装置及び液晶表示装置等の製造には絶縁性のガラス基板が用いられ、その上にTFT(Thin Film Transistor:薄膜トランジスタ)等の電子デバイスが形成される。基板上に電子デバイスを形成する際には、例えばフォトリソグラフィー法が用いられる。フォトリソグラフィー法においては、例えばウェットエッチングによるパターニングが行われる。 In recent years, an insulating glass substrate is used for manufacturing a semiconductor device, a liquid crystal display device, and the like, and an electronic device such as a TFT (Thin Film Transistor) is formed thereon. When forming an electronic device on a substrate, for example, a photolithography method is used. In the photolithography method, for example, patterning by wet etching is performed.
ウェットエッチング工程では、パターン形成予定の薄膜上に保護膜(レジスト)を形成し、酸等の薬液を用いて保護膜のないところを除去する。その後、リンス液により余分な酸を十分に落とす。このリンス液には、主に純水が用いられる。即ち、基板上の薬液を洗い流すために水洗が行なわれる。基板上に形成される電子デバイスは複数の層が積層されてなることが多い。従って、上記のフォトリソグラフィー法によるパターニングを複数回行うこととなり、それに伴ってリンス液による水洗も複数回行われる。このとき、絶縁性のガラス基板と絶縁性の純水との摩擦により静電気が発生し、発生した電荷が原因で基板上に形成された電子デバイスの静電破壊が発生する問題があった。 In the wet etching process, a protective film (resist) is formed on the thin film to be patterned, and portions without the protective film are removed using a chemical solution such as an acid. Thereafter, excess acid is sufficiently removed with a rinse solution. As the rinsing liquid, pure water is mainly used. That is, water washing is performed to wash away the chemical solution on the substrate. Electronic devices formed on a substrate are often formed by laminating a plurality of layers. Therefore, the patterning by the above-described photolithography method is performed a plurality of times, and accordingly, the rinse with the rinse liquid is also performed a plurality of times. At this time, static electricity is generated due to friction between the insulating glass substrate and the insulating pure water, and there has been a problem that electrostatic breakdown of the electronic device formed on the substrate occurs due to the generated charges.
従来この様な問題を解決する方法として、例えば特許文献1には純水に炭酸ガス等を導入してその比抵抗値を下げる手法が提案されている。また特許文献2には、基板を保持するチャックを導電性材料で構成することにより、当該チャックを介して基板上に帯電した電荷を放電させる手法が提案されている。更に、特許文献3には、基板を保持するチャックの表面抵抗値及び比抵抗値(文献中における体積固有抵抗値)が所定の範囲となるように調整することによって、静電破壊や、使用中の粉塵等の付着を防止している。
特許文献1に開示されているように、純水に炭酸ガス等を導入するためには、純水供給設備の改良が必要であり、多額なコストがかかってしまう。また、純水の比抵抗値を制御する必要がある等、プロセス管理上の制約が発生してしまうという問題がある。更に、写真製版の現像工程においては、現像処理後の純水リンス液に、炭酸ガスを導入した純水を使用することは、現像液のアルカリ濃度を急激に低下させ、レジストの残渣を発生させてしまい、パターン不良の原因となる問題点があった。 As disclosed in Patent Document 1, in order to introduce carbon dioxide gas or the like into pure water, it is necessary to improve the pure water supply facility, and a large cost is required. In addition, there is a problem that restrictions on process management occur, such as the necessity of controlling the specific resistance value of pure water. Furthermore, in the development process of photoengraving, the use of pure water into which carbon dioxide gas has been introduced into the pure water rinsing solution after the development process rapidly reduces the alkali concentration of the developer and generates resist residues. Therefore, there is a problem that causes a pattern defect.
特許文献2に開示されている方法を用いる場合、チャックが導電材料で形成されているため、基板上に帯電した電荷がチャックを伝って急激に放電される場合がある。この放電時に流れる電流によって基板上に形成された電子デバイスが破壊されてしまうという問題点があった。また、特許文献3に開示されているチャックは比抵抗値が低すぎるため、これも同様に基板上に帯電した電荷がチャックを伝って急激に放電される場合がある。 In the case of using the method disclosed in Patent Document 2, since the chuck is formed of a conductive material, the charge charged on the substrate may be rapidly discharged through the chuck. There is a problem that the electronic device formed on the substrate is destroyed by the current flowing during the discharge. In addition, since the specific resistance value of the chuck disclosed in Patent Document 3 is too low, the charge charged on the substrate may also be rapidly discharged through the chuck.
本発明は上記事情を背景としてなされたものであって、電荷による不具合が発生する基板に対して所定の処理を施す工程において、該基板の帯電を抑制すると共に、該基板からの電荷の除去に際して流れる電流が所定の値を超えないように制御し、結果的に製造されるものの歩留まりの向上を図ることを目的とする。 The present invention has been made against the background described above, and in the step of performing a predetermined treatment on a substrate in which a defect due to charge occurs, the substrate is suppressed from being charged and the charge is removed from the substrate. An object is to control the flowing current so as not to exceed a predetermined value and to improve the yield of the manufactured product as a result.
本発明に係る基板保持装置は、基板を保持するチャックと、前記チャックを支持するチャック支持部と、を備え、前記チャックの前記基板との接触部における最も比抵抗値の低い部分は、105Ωcm〜1010Ωcmの比抵抗値の材料で形成され、前記最も比抵抗値の低い部分は、前記チャック支持部を介して接地されているものである。これにより、電荷による不具合が発生する基板に対して所定の処理を施す工程において、該基板の帯電を防止すると共に、該基板からの電荷の除去に際して流れる電流が所定の値を超えないように制御し、結果的に製造されるものの歩留まりの向上を図ることができる。 A substrate holding apparatus according to the present invention includes a chuck that holds a substrate and a chuck support portion that supports the chuck, and a portion having the lowest specific resistance value in a contact portion of the chuck with the substrate is 10 5. It is formed of a material having a specific resistance value of Ωcm to 10 10 Ωcm, and the portion having the lowest specific resistance value is grounded via the chuck support portion. As a result, in the step of performing a predetermined process on the substrate in which a defect due to charge occurs, the substrate is prevented from being charged and the current flowing when the charge is removed from the substrate is controlled not to exceed a predetermined value. As a result, the yield of manufactured products can be improved.
ここで、前記最も比抵抗値の低い部分は、絶縁性材料にカーボンナノチューブを混合させた材料で形成されていることが好ましい。これにより、絶縁性材料に混合するカーボンナノチューブの混合比率で比抵抗を調整することができ、更にカーボンナノチューブであることによって、少ない混合比で所望の比抵抗を実現することができる。 Here, the portion having the lowest specific resistance value is preferably formed of a material obtained by mixing carbon nanotubes with an insulating material. As a result, the specific resistance can be adjusted by the mixing ratio of the carbon nanotubes mixed with the insulating material, and the desired specific resistance can be realized with a small mixing ratio by using the carbon nanotubes.
また、前記カーボンナノチューブの繊維が略一方向に配列しており、前記最も比抵抗値の低い部分が電気的異方性を有することが好ましい。これにより、必要な方向にのみ電流パスを形成することができ、絶縁性材料に混合するカーボンナノチューブの比率を更に少なくすることができる。 The carbon nanotube fibers are preferably arranged in approximately one direction, and the portion having the lowest specific resistance value preferably has electrical anisotropy. Thereby, a current path can be formed only in a necessary direction, and the ratio of carbon nanotubes mixed in the insulating material can be further reduced.
更に、前記絶縁性材料が、ポリカーボネイト、フッ素樹脂及び塩化ビニルのうちの少なくとも1種類以上を主成分とする材料で形成されている、請求項2又は3に記載の基板保持装置。ポリカーボネイトであれば、容易にカーボンナノチューブを混合することができ、フッ素樹脂であれば上記チャックを用いてガラス基板を保持する場合に帯電を抑制することができ、塩化ビニルであれば容易に加工することができる。 The substrate holding device according to claim 2 or 3, wherein the insulating material is formed of a material mainly composed of at least one of polycarbonate, fluororesin, and vinyl chloride. If it is a polycarbonate, carbon nanotubes can be easily mixed. If it is a fluororesin, charging can be suppressed when holding the glass substrate using the above chuck, and if it is vinyl chloride, it is easily processed. be able to.
更にまた、前記チャック支持部は、前記チャックの基板保持面とは反対側の面において前記チャックを支持し、前記最も比抵抗値の低い部分において、前記基板に平行な方向の比抵抗値は前記基板に垂直な方向の比抵抗値よりも大きいことが好ましい。これにより、基板はチャックを伝って導電性の部材に電気的に接続されると共に、チャックとその側面に当接する他の部材とを絶縁することが可能となる。 Furthermore, the chuck support portion supports the chuck on a surface opposite to the substrate holding surface of the chuck, and the specific resistance value in the direction parallel to the substrate is the portion having the lowest specific resistance value. It is preferably larger than the specific resistance value in the direction perpendicular to the substrate. As a result, the substrate is electrically connected to the conductive member through the chuck and can insulate the chuck from other members that abut on the side surfaces thereof.
本発明に係る素子基板の製造方法は、電子素子がその上に形成された素子基板の製造方法であって、基板の帯電荷を除電するように、前記基板との接触部における最も比抵抗値の低い部分が、105Ωcm〜1010Ωcmの比抵抗値である材料で形成されたチャックによって前記基板を保持し、前記チャックで前記基板を保持した状態において当該基板を処理するものである。これにより、電荷による不具合が発生する基板に対して所定の処理を施す工程において、該基板の帯電を防止すると共に、該基板からの電荷の除去に際して流れる電流が所定の値を超えないように制御し、結果的に製造されるものの歩留まりの向上を図ることができる。 A method for manufacturing an element substrate according to the present invention is a method for manufacturing an element substrate on which an electronic element is formed, and the most specific resistance value at a contact portion with the substrate so as to remove a charge on the substrate. The lower part of the substrate holds the substrate by a chuck made of a material having a specific resistance value of 10 5 Ωcm to 10 10 Ωcm, and processes the substrate in a state where the substrate is held by the chuck. As a result, in the step of performing a predetermined process on the substrate in which a defect due to charge occurs, the substrate is prevented from being charged and the current flowing when the charge is removed from the substrate is controlled not to exceed a predetermined value. As a result, the yield of manufactured products can be improved.
ここで、前記最も比抵抗値の低い部分は、絶縁性材料にカーボンナノチューブを混合させた材料で形成されていることが好ましい。これにより、絶縁性材料に混合するカーボンナノチューブの混合比率で比抵抗を調整することができ、更にカーボンナノチューブであることによって、少ない混合比で所望の比抵抗を実現することができる。 Here, it is preferable that the portion having the lowest specific resistance value is formed of a material obtained by mixing carbon nanotubes with an insulating material. Thereby, the specific resistance can be adjusted by the mixing ratio of the carbon nanotubes mixed in the insulating material, and the desired specific resistance can be realized with a small mixing ratio by using the carbon nanotubes.
また、前記カーボンナノチューブの繊維が略一方向に配列しており、前記最も比抵抗値の低い部分が電気的異方性を有することが好ましい。これにより、必要な方向にのみ電流パスを形成することができ、絶縁性材料に混合するカーボンナノチューブの比率を更に少なくすることができる。 The carbon nanotube fibers are preferably arranged in approximately one direction, and the portion having the lowest specific resistance value preferably has electrical anisotropy. Thereby, a current path can be formed only in a necessary direction, and the ratio of carbon nanotubes mixed in the insulating material can be further reduced.
更に、前記基板は絶縁性基板であり、前記チャックで前記基板を保持した状態において当該基板を純水を用いて洗浄することができる。これにより、純水以外を洗浄液として用いる場合の不具合を回避することができ、絶縁性基板と絶縁性である純水との摩擦によって生じる電荷を好適に除電することができる。 Further, the substrate is an insulating substrate, and the substrate can be cleaned with pure water in a state where the substrate is held by the chuck. As a result, it is possible to avoid problems when other than pure water is used as the cleaning liquid, and it is possible to appropriately eliminate charges generated by friction between the insulating substrate and the pure water that is insulating.
更にまた、導電性の部材が、前記チャックの基板保持面とは反対側の面において前記チャックを保持し、前記基板の帯電荷は前記導電性の部材を介して除電され、前記最も比抵抗値の低い部分において、前記基板に平行な方向の比抵抗値は前記基板に垂直な方向の比抵抗値よりも大きいことが好ましい。これにより、基板はチャックを伝って導電性の部材に電気的に接続されると共に、チャックとその側面に当接する他の部材とを絶縁することが可能となる。 Furthermore, a conductive member holds the chuck on a surface opposite to the substrate holding surface of the chuck, and the charge on the substrate is neutralized through the conductive member, and the most specific resistance value is obtained. Preferably, the specific resistance value in the direction parallel to the substrate is higher than the specific resistance value in the direction perpendicular to the substrate. As a result, the substrate is electrically connected to the conductive member through the chuck and can insulate the chuck from other members that abut on the side surfaces thereof.
本発明により、電荷による不具合が発生する基板に対して所定の処理を施す工程において、該基板の帯電を防止すると共に、該基板からの電荷の除去に際して流れる電流が所定の値を超えないように制御し、結果的に製造されるものの歩留まりの向上を図ることができる。 According to the present invention, in the step of performing a predetermined process on a substrate in which a defect due to electric charge occurs, the substrate is prevented from being charged, and the current flowing when the charge is removed from the substrate does not exceed a predetermined value. It is possible to control, and as a result, the yield of manufactured products can be improved.
実施の形態1.
以下に、本発明を適用可能な実施の形態を説明する。説明の明確化のため以下の記載及び図面は、適宜、省略及び簡略化がなされている。又、各図面において、同一要素には同一の符号が付されており、必要に応じて重複説明は省略されている。以下の実施形態においては、液晶表示装置の製造工程において、絶縁性であるガラス基板上にTFT素子や画素電極等を形成し、アレイ基板を製造する工程を例として説明する。まず、液晶パネルの全体的な構成について図1を用いて説明する。
Embodiment 1 FIG.
Hereinafter, embodiments to which the present invention can be applied will be described. For clarity of explanation, the following description and drawings are omitted and simplified as appropriate. Moreover, in each drawing, the same code | symbol is attached | subjected to the same element and the duplication description is abbreviate | omitted as needed. In the following embodiments, a process of manufacturing an array substrate by forming TFT elements, pixel electrodes and the like on an insulating glass substrate in a manufacturing process of a liquid crystal display device will be described as an example. First, the overall configuration of the liquid crystal panel will be described with reference to FIG.
図1は、液晶表示装置の一例として、TN(Twisted Nematic)タイプのアクティブマトリックス液晶パネル200の構成を示す模式断面図である。以下の説明においては、アクティブマトリックス、TNタイプの液晶表示装置を例として説明するが、本発明は、IPS(In-Plane Switching)タイプやパッシブ駆動の液晶パネルにも適用可能である。図1に示すように液晶パネル200は、TFT(Thin Film Transistor)アレイ基板201、対向基板202、液晶203、TFT204、画素電極205、コモン電極206、カラーフィルタ207、ブラックマトリクス208及び配向膜209を有する。また、TFT204は、ゲート電極204a、ソース電極204b及びドレイン電極204cを有する。本実施形態は、図1に示したような液晶パネルの製造方法において、TFTアレイ基板201上にTFT204や画素電極205等を形成する工程に特徴を有する。
FIG. 1 is a schematic cross-sectional view showing a configuration of a TN (Twisted Nematic) type active matrix
液晶パネル200は、TFTアレイ基板201と対向配置される対向基板202と両基板を接着する図示しないシール材との間の空間に液晶203を封入した構成を有する。TFTアレイ基板201は透明性を有する絶縁性の基板であり、例えばガラス基板が用いられる。TFTアレイ基板201上には、互いに直交する方向に図示しないゲート線(走査線)及びソース線(信号線)が形成されており、ゲート線とソース線との交差点近傍にはTFT204が設けられている。また、ゲート線とソース線との間にマトリクス状に形成された複数の画素電極205を有している。TFT204のゲート電極204aがゲート線に、ソース電極204bがソース線に、ドレイン電極204cが画素電極205に夫々接続される。
The
他方、対向基板202上にはコモン電極206及びR(赤)、G(緑)、B(青)のカラーフィルタ207、ブラックマトリクス208が形成されている。コモン電極206は、画素電極205と対向するように対向基板202の略全面に形成される短形状の透明基板である。コモン電極206としては、ITO(Indium Tin Oxide)などの透明導電膜を用いる。TFTアレイ基板201と対向基板202との間は、図示しないビーズスペーサ、柱状スペーサ等によって所定の間隔になるように維持されている。
On the other hand, a
TFTアレイ基板201及び対向基板202の対向する面には、夫々所定の方向に配向された配向膜209が形成されている。両基板は、図示しない枠状のシール材により周辺を接着され、TFTアレイ基板201と対向基板202とシール材とで形成される空間に液晶203が封入されている。これら両基板に挟持された液晶203は、夫々の基板上に設けられた配向膜209によって所定の方向に配向する。上述の様な配向膜209の液晶配向機能は、TFTアレイ基板201及び対向基板202上に形成された配向膜209表面をラビング(こする)ことにより与えられる。
On the opposing surfaces of the
上記の様な液晶パネル200におけるTFT204や画素電極205等の形成は、TFTアレイ基板201上に導電層や絶縁層等をパターニングし、積層していくことにより行う。各層のパターニング工程ではフォトリソグラフィー法が用いられる。フォトリソグラフィー法においては、例えばウェットエッチングによるパターニングが行われ、この後にエッチングに用いた薬液をリンス液によって洗い流す洗浄工程が行われる。リンス液には主に純水が用いられる。本実施形態は、少なくとも上記の洗浄工程においてTFTアレイ基板201を保持するチャックに特徴を有する。
The
次に、TFTアレイ基板201面上の洗浄工程について説明する。図2は、洗浄工程において、TFTアレイ基板201を保持するチャック101の基板保持面を示す平面図である。図2においては、チャック101に保持されるTFTアレイ基板201は破線で示されている。また、図3は、図2に示すチャック101のX−X部の断面形状及びこのチャック101を用いた基板処理装置100を示すものである。本実施形態に係るチャック101は、チャック101の基板保持面に形成された溝102、溝102内部に形成された吸気口103、それぞれの吸気口103から延在し、チャック101内部で1つに連結されている真空排気用の配管105を有する。
Next, a cleaning process on the surface of the
更に、図3に示すように、本実施形態に係る基板処理装置100は、上記のチャック101、チャック101の基板保持面とは反対側の面の中央に接続された回転軸104、チャック101に保持されたTFTアレイ基板201の基板面に純水を供給して洗浄するためのノズル108、ノズル108に純水を供給するための純水供給装置109、回転軸104を回転駆動するための回転駆動装置110及び配管105内部を真空吸引するための真空吸引装置111を有する。
Further, as shown in FIG. 3, the
チャック101は、その基板保持面の形状が円形であり、所定の厚さを有する円盤状若しくは円柱状の形状を有する。チャック101は主材料がポリカーボネイトであり、針状のカーボンナノチューブが混合されている。カーボンナノチューブがポリカーボネイト内部において電流パスとなり、チャック101の比抵抗値を下げることができる。これにより、TFTアレイ基板201と純水との摩擦によって該基板上に生じた静電気がチャック101を伝って除電される。ポリカーボネイト内部においてカーボンナノチューブの繊維の方向はランダムであり、チャック101は全体として電器的に等方性の部材となる。
The
チャック101の基板保持面には、同心円状に複数の溝102が形成されている。本実施形態においては、同心円状に大小2つの溝102が形成されている。更に、溝102の内部には所定の間隔で複数の吸気口103が形成されている。夫々の吸気口103はチャック101内部の配管105とつながっている。夫々の吸気口103と連結されている配管105はチャック101内部で1つに連結されている。チャック101内部で連結された配管105は、チャック101の基板保持面とは反対側の面の中央に設けられた開口部106に連結している。
A plurality of
チャック101の基板保持面とは反対側の面の中央には、回転軸104が設けられている。換言すると、チャック101は回転軸104によって支持されている。回転軸104は円筒状の部材であり、その円筒軸がTFTアレイ基板201の基板保持面と垂直になるように設けられている。また回転軸104内部の空洞は開口部106と連結されており、これにより回転軸104内部の空洞と配管105とが連結される。回転軸104内部の空洞は、チャック101とは反対側の端部において排気口107となる。従って、開口部106と回転軸104内部の空洞とは、排気口107から配管105内部を真空吸引するために十分な機密性を保って連結される。
A
回転軸104は、チャック101と同一若しくはチャック101よりも比抵抗値の低い素材で形成されている。さらに、回転軸104には回転駆動装置110が接続され、排気口107には真空吸引装置111が接続されている。これにより、回転軸104は接地された状態となる。即ち、TFTアレイ基板201に帯電した電荷はチャック101及び回転軸104を伝って放電される。尚、チャック101と回転軸104とは別々の部材である必要はなく、上記の構成を有する限りは一体に成形されても良い。
The
回転駆動装置110が回転軸104を回転させることによってチャック101が回転し、チャック101に保持されたTFTアレイ基板201が回転する。これにより、TFTアレイ基板201上を洗浄した純水が振りきられ、TFTアレイ基板201がスピン乾燥される。この様に、チャック101はスピナーチャックとしても用いられるため、円盤状若しくは円筒状で形成することが好ましい。
The
チャック101の溝102が形成された面にTFTアレイ基板201を載置した状態で、真空吸引装置111を用いて排気口107から真空吸引することにより、配管105及び吸気口103を通してTFTアレイ基板201が溝102に吸着される。これにより、TFTアレイ基板201がチャック101に保持される。
With the
ノズル108は、チャック101の基板保持面側に設けられている。ノズル108は純水供給装置109と接続されており、純水供給装置109からノズル108に純水が供給される。ノズル108は純水供給装置109から供給された純水をチャック101に保持されたTFTアレイ基板201表面に供給し、基板面を洗浄する。
The
この時、絶縁性であるTFTアレイ基板201と純水との摩擦により静電気が発生する。しかしながら、TFTアレイ基板201はチャック101によって保持されているため、TFTアレイ基板201上で発生した電荷は基板上に帯電することなくチャック101を伝って放電される。以下に、チャック101によるTFTアレイ基板201上の電荷の除電について説明する。
At this time, static electricity is generated by friction between the insulating
チャック101の比抵抗値は105Ωcm以上、1010Ωcm以下である。チャック101を比抵抗値が105Ωcm未満の材料で形成した場合、チャック101表面若しくはチャック101内部における電荷の移動が速くなり過ぎる。これにより、TFTアレイ基板201上に帯電した電荷がチャック101を伝って急激に放電される。この時にTFTアレイ基板201上に大きな電流が流れる。この電流により、TFTアレイ基板201上に形成された電子デバイスが破壊される場合があり、好ましくない。
The specific resistance value of the
また、チャック101を比抵抗値が1010Ωcmよりも高い材料で形成した場合には、チャック101表面若しくはチャック101内部において電荷はほとんど移動しない。これにより、TFTアレイ基板201上に帯電した電荷は放電されず、TFTアレイ基板201は帯電したままとなる。TFTアレイ基板201上の電荷の分布によって、電圧の高い部分から低い部分に向かって電荷が移動し電流が流れる。この電流により、TFTアレイ基板201上に形成された電子デバイスが破壊される場合があり、好ましくない。
Further, when the
チャック101の比抵抗値が105Ωcm以上、1010Ωcm以下であれば、チャック101表面若しくは内部において電荷はゆっくりと移動する。これにより、TFTアレイ基板201上に帯電した電荷が徐々に放電されるので、TFTアレイ基板201上に大きな電流が流れることはない。従って、TFTアレイ基板201上に形成された電子デバイスの破壊を防ぐことができる。チャック101の比抵抗値は、主材料であるポリカーボネイトに混合するカーボンナノチューブの混合比、即ちポリカーボネイトに対するカーボンナノチューブの重量比率を調整することにより、所望の値に調整することができる。
If the specific resistance value of the
本実施形態のようにチャック101を伝って電荷が除電される構成を用いることにより、TFTアレイ基板201がチャック101に保持されている限り常に、基板上に発生した電荷の除電効果を得ることが可能となり、基板の帯電を防ぐことができる。また、基板をチャック101から剥離する際の基板の帯電量(剥離帯電)は大きなものとなるが、本実施形態に係るチャック101であれば、発生した電荷は瞬時にチャック101を伝って除電される。従って、TFTアレイ基板201をチャック101から剥離する際の基板の帯電を抑制することも可能となる。
By using a configuration in which charges are removed through the
尚、チャック101の主材料はポリカーボネイトの他に、例えばテフロン(登録商標)等のフッ素樹脂や塩化ビニル等の絶縁性樹脂を用いることができる。ポリカーボネイトはカーボンナノチューブを混合するのが容易であり、テフロン(登録商標)はガラスとの接触において帯電が少なく、塩化ビニルは安価で加工性が良い等夫々メリットがあるため、これらの材料は適宜選択される。また、主材料の内部に電流パス形成のために混合する材料はカーボンナノチューブの他に、例えば黒鉛(グラファイト)や炭化ケイ素(カーボランダム)等の導電性炭化物を用いることができる。導電性炭化物を混合することによって電流パスが形成され、比抵抗値を下げることがでる。また、その混合比を調整することによって、比抵抗値を好適な範囲に調整することができる。
In addition to the polycarbonate, the main material of the
ここで、主材料に対して粒状の導電性炭化物を混合する場合、電流パスとなるのは夫々の粒子である。この場合、図4(a)に示されるように、主材料中に粒状の導電性炭化物が散在するため、電流パスを形成して全体の比抵抗値を下げるためには主材料に対して多くの導電性炭化物を必要とする。これに対して、カーボンナノチューブの分子は図4(b)に示されるように細長い繊維状の構造を有し、この繊維が電流パスとなる。従って、粒状の物質を混合して電流パスを形成する場合よりも少ない添加量で比抵抗値を下げることができる。 Here, when a granular conductive carbide is mixed with the main material, each particle becomes a current path. In this case, as shown in FIG. 4A, since granular conductive carbides are scattered in the main material, in order to form a current path and lower the specific resistance value, it is much more than the main material. Of conductive carbides. On the other hand, the carbon nanotube molecule has an elongated fiber structure as shown in FIG. 4B, and this fiber becomes a current path. Therefore, the specific resistance value can be lowered with a smaller amount of addition than when a current path is formed by mixing granular substances.
図5に、ポリカーボネイトにカーボンナノチューブを混合させた場合と、黒鉛粉末を混合させた場合との、混合比(重量%)と比抵抗値の変化の一例を示す。上記の説明の通り、カーボンナノチューブの繊維の方向はランダムであり、カーボンナノチューブを含有するポリカーボネイトは電気的に等方性の部材である。図5のグラフが示す通り、ポリカーボネイトの比抵抗値を105Ωcmから1010Ωcmの範囲とするために、黒鉛粉末では概ね24〜28重量%の比率が必要であるのに対し、カーボンナノチューブでは概ね10〜15重量%の比率でよいことがわかる。尚、主材料に対する好適な導電性炭化物の混合比は、上記の重量比の範囲に限らず、実際に調合した材料の比抵抗値が105Ωcmから1010Ωcmとなる場合の比率をもって規定することができる。 FIG. 5 shows an example of the change in the mixing ratio (% by weight) and the specific resistance value when carbon nanotubes are mixed with polycarbonate and when graphite powder is mixed. As described above, the direction of the carbon nanotube fiber is random, and the polycarbonate containing the carbon nanotube is an electrically isotropic member. As shown in the graph of FIG. 5, in order to set the specific resistance value of polycarbonate in the range of 10 5 Ωcm to 10 10 Ωcm, graphite powder requires a ratio of about 24 to 28% by weight, whereas carbon nanotubes It can be seen that a ratio of about 10 to 15% by weight is sufficient. The suitable mixing ratio of the conductive carbide to the main material is not limited to the range of the weight ratio described above, but is defined by the ratio when the specific resistance value of the actually prepared material is from 10 5 Ωcm to 10 10 Ωcm. be able to.
上記の基板処理装置を用いて、TFTアレイ基板201上にウェットエッチングを用いた電子デバイスのパターニングを行った後に、基板面の純水リンス洗浄及びスピン乾燥を実施した。その後、処理後のTFTアレイ基板201の静電気帯電量を測定したところ、帯電量は概ね数十V(ボルト)であった。また、TFTアレイ基板上に形成した電子デバイスに静電破壊による問題は生じなかった。尚、ここで用いたチャック101の比抵抗値は107Ωcmである。
After patterning an electronic device using wet etching on the
図6は、上記において用いた静電気帯電量の測定方法を示したものである。TFTアレイ基板201は上記洗浄処理後、速やかに静電気測定装置300に設置される。TFTアレイ基板201は、接地電位となっている接地面301の表面に複数個設けられた非導電性スペーサ302を介して当接面積を極力小さくしつつ、接地面301から均一に1mm離した状態で配置される。そして、静電気測定センサー303と電圧計304とを用いてTFTアレイ基板201表面の静電気帯電量を測定する。
FIG. 6 shows a method for measuring the electrostatic charge amount used above. The
図6に示した方法と同様の方法を用いて、比較例として従来一般的に用いられていたPPS(Poly Phenylene Sulfide:ポリフェニレンサルファイド)製のチャックを用いた場合の、TFTアレイ基板201の洗浄処理後の静電気帯電量を測定したところ、600〜1kVであった。また、この場合には基板上に形成した電子デバイスにおいて、静電破壊が生じた。この様に、本実施形態を用いた基板処理後のTFTアレイ基板201の帯電量は、従来の比較例と比べると十分の一以下に低減されており、かつ基板上に形成された電子デバイスにも静電破壊の発生は認められず、本実施形態による除電の効果が明確に認められた。
Using the same method as that shown in FIG. 6, the
この様に、TFTアレイ基板201の洗浄工程において該基板を保持するチャックに、本実施形態に係るチャック101を用いることにより、基板上に帯電した電荷をチャックを通して除電することができる。また、この際にTFTアレイ基板201上に流れる電流を、基板上に形成された電子デバイスを破壊しない程度の電流とすることができる。従って、基板上に形成された電子デバイスの静電破壊を防止し、歩留まりの向上を図ることができる。
In this way, by using the
尚、上記の説明においては、チャック101全体の比抵抗値を105Ωcm以上、1010Ωcm以下として説明した。即ち、チャック101全体を上記の比抵抗値を有する1つの材料で成形することが好ましい。これにより、チャック101を1つの部材として成形できる。しかしながら、TFTアレイ基板201が上記の比抵抗値を有する部材によって保持され、当該部材を介して接地されていれば上記と同様の効果を得ることができる。従って、チャック101のTFTアレイ基板201と接触する接触部の比抵抗値が105Ωcm以上、1010Ωcm以下であれば、上記と同様の効果を得ることができる。例えば、チャック101の反基板側の一部を、1010Ωcm以下の比抵抗値を有する他の材料で形成し、当該部位を介してチャック101が接地されていれば、上記と同様の効果を得ることができる。
In the above description, the specific resistance value of the
更には、チャック101とTFTアレイ基板201との接触部の全てが105Ωcm以上、1010Ωcm以下の比抵抗値を有する必要はなく、当該接触部における最も比抵抗値の低い部分が、105Ωcm以上、1010Ωcm以下の比抵抗値であれば良い。これにより、TFTアレイ基板201の帯電荷は、チャック101の基板保持面において主に105Ωcm以上、1010Ωcm以下の比抵抗値の部分を伝って除電されるため、上記と同様の効果を得ることができる。例えば、チャック101の外周部を比抵抗値が1010Ωcmより大きい絶縁材料で形成し、中央部のみを105Ωcm以上、1010Ωcm以下の材料で形成することができる。
Furthermore, it is not necessary that all the contact portions between the
また、上記の説明においては、チャック101は回転軸104に支持されており、スピナーチャックとして用いられる例を説明したが、必ずしもチャック101がスピナーチャックである必要はない。即ち、回転軸104ではなく、単純にチャック101を支持する支持部材によってチャック101が支持されていてもよい。この時、チャック101を支持する支持部材が、チャック101と同一若しくはチャック101よりも比抵抗値の低い素材で形成されており、当該支持部材が接地されていれば上記と同様の効果を得ることができる。即ち、支持部材は導体で形成することが好ましい。更に、当該支持部材が筒状の部材であり、その内部の空洞と開口部106とが連結されていれば、真空吸引装置111により配管105内部を真空吸引することが可能である。
In the above description, the
実施の形態2.
本実施の形態においては、チャック101の主材料である絶縁性樹脂にカーボンナノチューブを混合する場合において、その混合の態様に特徴をもたせた例及び、チャック101の比抵抗値に特徴をもたせた例を説明する。尚、実施の形態1と同様の符号を付す構成については実施の形態1と同一又は相当部を示し、説明を省略する。
Embodiment 2. FIG.
In the present embodiment, when carbon nanotubes are mixed with the insulating resin that is the main material of the
図7はチャック101の主材料であるポリカーボネイト中の、カーボンナノチューブ分子の状態を模式的に示した図である。図に示すように、ポリカーボネイト中においてカーボンナノチューブ分子は略同一方向に配列している。これにより、チャック101は異方性を有することとなり、カーボンナノチューブが配列する方向(低抵抗方向)には電流が流れやすく、その他の方向には電流が流れにくくなる。
FIG. 7 is a diagram schematically showing the state of carbon nanotube molecules in polycarbonate which is the main material of the
図3を参照すると、TFTアレイ基板201上に発生した電荷は、チャック101及び回転軸104を伝って接地点である回転駆動装置110若しくは真空吸引装置111に除電される。即ち、チャック101において、電荷は少なくとも基板保持面から反対側の面に形成された回転軸104までの間移動可能であれば除電されることとなる。すなわち、少なくともチャック101の基板保持面に対して略垂直な方向に移動可能であれば良い。従って、チャック101内部において、基板保持面に対して平行な方向に形成された電流パスは意味の無い電流パスとなり、電流パス形成のために用いられたカーボンナノチューブ等の導電性炭化物が無駄になる。
Referring to FIG. 3, the charge generated on the
従って、図7に示すようなカーボンナノチューブの配列による異方性を利用して、チャック101において基板保持面に対して略垂直な方向にのみ電流パスを形成することによって、チャック101の主材料に対して必要なカーボンナノチューブの量を更に低減することができる。カーボンナノチューブは高価であるため、これによりチャック101のコストダウンを図ることができる。ここで、チャック101において混合するカーボンナノチューブを配列させて異方性を持たせた場合において、カーボンナノチューブが配列し、電流パスとなる方向、即ち最も低抵抗となる方向の比抵抗値が105Ωcm以上1010Ωcm以下となる。これにより、実施の形態1において説明した効果は保ったまま、必要とされるカーボンナノチューブの量を低減することが可能となる。
Therefore, by utilizing the anisotropy due to the arrangement of the carbon nanotubes as shown in FIG. 7, a current path is formed only in a direction substantially perpendicular to the substrate holding surface in the
また、図3において、チャック101は除電のため回転軸104と導通している必要がある。即ち、チャック101の基板保持面と、その反対側の面(図3中における下面)との間には電流パスが形成されている必要がある。それに対し、チャック101の側面に当接する他の部材とチャック101とを絶縁する必要がある場合、図7に示すような異方性を利用することによって、チャック101の基板保持面から反対側の面までの間には電流パスを形成し、チャック101の側面と該側面に当接する部材とを絶縁することが可能となる。
In FIG. 3, the
尚、上記の説明においては、カーボンナノチューブを配列させることによってチャック101に異方性を持たせた。カーボンナノチューブの繊維の配列により電気的異方性を実現することができるため、チャック101には絶縁性材料にカーボンナノチューブを混合させた材料を用いることが好ましい。しかしながら、他の方法を用いてチャック101に異方性を持たせることも可能である。これにより、チャック101を接地しながら、チャック101とこれに当接する他の部材とを絶縁することが可能となる。また、実施の形態1において説明したように、チャック101のTFTアレイ基板201との接触部又は、接触部における最も比抵抗値の低い部分にのみ異方性をもたせることによっても、上記の様な効果を得ることができる。
In the above description, the
上記の説明においては、図3に示されるように、チャック101が反基板側において支持され、接地されている場合を例としたため、基板に対して垂直な方向が低抵抗となるように電気的異方性を持たせることが好ましい。しかしながら、必ずしもチャック101が反基板側において支持され、接地されているとは限らない。従って、チャック101の電気的異方性の方向は、チャック101に保持される基板とチャック101を支持する部材との位置関係により適宜選択される。
In the above description, as shown in FIG. 3, since the case where the
以上の説明は、本発明の実施形態を説明するものであり、本発明が上述の実施形態に限定されるものではない。当業者であれば、上述の実施形態の各要素を、本発明の範囲において容易に変更、追加、変換することが可能である。例えば、上記の説明においては、フォトリソグラフィー法におけるウェットエッチング後の洗浄工程を例として説明した。しかしながら、これに限らず、絶縁性の基板を純水を用いて洗浄する工程であれば上記の説明と同様の課題が生じるため、本発明を適用することによって課題を解決することができる。絶縁性基板の他の例としては上記で説明したガラス基板の他に、例えばセラミックス系基板等が考えられる。 The above description describes the embodiment of the present invention, and the present invention is not limited to the above-described embodiment. A person skilled in the art can easily change, add, and convert each element of the above-described embodiment within the scope of the present invention. For example, in the above description, the cleaning process after wet etching in the photolithography method has been described as an example. However, the present invention is not limited to this, and the same problem as described above occurs if the insulating substrate is cleaned with pure water. Therefore, the problem can be solved by applying the present invention. As another example of the insulating substrate, in addition to the glass substrate described above, for example, a ceramic substrate can be considered.
また、上記の説明においては、TFTアレイ基板201が絶縁性の基板であり、該基板を洗浄するリンス液は純水であり、TFTアレイ基板201を洗浄する工程において、絶縁性の基板と絶縁性の純水との摩擦により生じる静電気の除電を課題として説明した。しかしながら、半導体基板等の非絶縁性基板を用いる場合や、純水以外の非絶縁性の液体を用いる場合であっても、静電気の発生による不具合を回避する目的においては、本発明を適用することによる効果を得ることができる。
In the above description, the
例えば、半導体基板上に電子デバイスを形成して半導体装置を製造する場合においても、半導体基板の帯電及びこれによる電子デバイスの絶縁破壊が問題となる。また、基板と純水との摩擦に限らず、現像液やエッチング液等の純水以外の液体を用いて基板を処理する工程において、これらの液体と基板との摩擦により基板が帯電することも考えられる。この様な場合に、基板を保持する部材として本発明に係るチャックを用いることにより、基板上に形成された電子デバイスを破壊することなく、基板上に帯電した電荷を除電することができる。 For example, even when an electronic device is formed on a semiconductor substrate to manufacture a semiconductor device, charging of the semiconductor substrate and resulting dielectric breakdown of the electronic device are problematic. Further, not only friction between the substrate and pure water, but also in the process of processing the substrate using a liquid other than pure water such as a developer or an etching solution, the substrate may be charged by friction between the liquid and the substrate. Conceivable. In such a case, by using the chuck according to the present invention as a member for holding the substrate, the charge charged on the substrate can be eliminated without destroying the electronic device formed on the substrate.
従って、チャック101はTFTアレイ基板201の洗浄工程において該基板を保持する部材として説明したが、洗浄工程のみではなくエッチング工程等のTFTアレイ基板201上に電子デバイスを形成する工程や、TFTアレイ基板201と対向基板202とシール材を用いて接着する工程等、液晶パネルの製造工程全般においてTFTアレイ基板201を保持するチャックとして用いることができる。これにより、製造工程中における静電気によって発生した電荷を、TFTアレイ基板201上に形成された電子デバイスを破壊することなく除電することができ、基板の帯電を防ぐことができる。
Accordingly, the
100 基板処理装置、101 チャック、102 溝、103 吸気口、
104 回転軸、105 配管、106 開口部、107 排気口、108 ノズル、
109 純水供給装置、110 回転駆動装置、111 真空吸引装置、
200 液晶パネル、201 TFTアレイ基板、202 対向基板、203 液晶、
204 TFT、204a ゲート電極、204b ソース電極、
204c ドレイン電極、205 画素電極、206 コモン電極、
207 カラーフィルタ、208 ブラックマトリクス、209 配向膜、
300 静電気測定装置、301 接地面、302 非導電性スペーサ、
303 静電気測定センサー、304 電圧計、
100 substrate processing apparatus, 101 chuck, 102 groove, 103 air inlet,
104 rotating shaft, 105 piping, 106 opening, 107 exhaust port, 108 nozzle,
109 Pure water supply device, 110 Rotation drive device, 111 Vacuum suction device,
200 liquid crystal panel, 201 TFT array substrate, 202 counter substrate, 203 liquid crystal,
204 TFT, 204a gate electrode, 204b source electrode,
204c drain electrode, 205 pixel electrode, 206 common electrode,
207 color filter, 208 black matrix, 209 alignment film,
300 electrostatic measurement device, 301 ground plane, 302 non-conductive spacer,
303 Electrostatic measurement sensor, 304 Voltmeter,
Claims (10)
前記チャックを支持するチャック支持部と、を備え、
前記チャックの前記基板との接触部における最も比抵抗値の低い部分は、105Ωcm〜1010Ωcmの比抵抗値の材料で形成され、
前記最も比抵抗値の低い部分は、前記チャック支持部を介して接地されている、基板保持装置。 A chuck for holding a substrate;
A chuck support part for supporting the chuck,
The portion having the lowest specific resistance value in the contact portion of the chuck with the substrate is formed of a material having a specific resistance value of 10 5 Ωcm to 10 10 Ωcm,
The substrate holding apparatus, wherein the portion having the lowest specific resistance value is grounded via the chuck support.
前記最も比抵抗値の低い部分において、前記基板に平行な方向の比抵抗値は前記基板に垂直な方向の比抵抗値よりも大きい、請求項1乃至4いずれかに記載の基板保持装置。 The chuck support portion supports the chuck on a surface opposite to the substrate holding surface of the chuck,
5. The substrate holding apparatus according to claim 1, wherein a specific resistance value in a direction parallel to the substrate is larger than a specific resistance value in a direction perpendicular to the substrate in the portion having the lowest specific resistance value.
基板の帯電荷を除電するように、前記基板との接触部における最も比抵抗値の低い部分が、105Ωcm〜1010Ωcmの比抵抗値である材料で形成されたチャックによって前記基板を保持し、
前記チャックで前記基板を保持した状態において当該基板を処理する、素子基板の製造方法。 A method of manufacturing an element substrate having an electronic element formed thereon,
The substrate is held by a chuck formed of a material having a specific resistance value of 10 5 Ωcm to 10 10 Ωcm in a portion having the lowest specific resistance value in a contact portion with the substrate so as to eliminate the charge on the substrate. And
A method for manufacturing an element substrate, wherein the substrate is processed while the substrate is held by the chuck.
前記チャックで前記基板を保持した状態において当該基板を純水を用いて洗浄する、請求項6乃至8いずれかに記載の素子基板の製造方法。 The substrate is an insulating substrate;
The element substrate manufacturing method according to claim 6, wherein the substrate is cleaned with pure water in a state where the substrate is held by the chuck.
前記基板の帯電荷は前記導電性の部材を介して除電され、
前記最も比抵抗値の低い部分において、前記基板に平行な方向の比抵抗値は前記基板に垂直な方向の比抵抗値よりも大きい、請求項6乃至9いずれかに記載の素子基板の製造方法。 A conductive member holds the chuck on a surface opposite to the substrate holding surface of the chuck;
The charge on the substrate is neutralized through the conductive member,
10. The element substrate manufacturing method according to claim 6, wherein a specific resistance value in a direction parallel to the substrate is greater than a specific resistance value in a direction perpendicular to the substrate in the portion having the lowest specific resistance value. 11. .
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005296820A JP2007109732A (en) | 2005-10-11 | 2005-10-11 | Manufacturing method of element substrate and substrate holding device |
TW095134785A TW200729389A (en) | 2005-10-11 | 2006-09-20 | Manufacturing method of element substrate and substrate holding device |
KR1020060097013A KR100834479B1 (en) | 2005-10-11 | 2006-10-02 | Method for manufacturing element substrate and supporting apparatus for the substrate |
CNB2006101641272A CN100474552C (en) | 2005-10-11 | 2006-10-11 | Method for manufacturing element substrate and supporting apparatus for the substrate |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2005296820A JP2007109732A (en) | 2005-10-11 | 2005-10-11 | Manufacturing method of element substrate and substrate holding device |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2007109732A true JP2007109732A (en) | 2007-04-26 |
Family
ID=38035388
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2005296820A Pending JP2007109732A (en) | 2005-10-11 | 2005-10-11 | Manufacturing method of element substrate and substrate holding device |
Country Status (4)
Country | Link |
---|---|
JP (1) | JP2007109732A (en) |
KR (1) | KR100834479B1 (en) |
CN (1) | CN100474552C (en) |
TW (1) | TW200729389A (en) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2010245498A (en) * | 2009-03-31 | 2010-10-28 | Top Engineering Co Ltd | Anti-static treated work stage |
Families Citing this family (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101171316B1 (en) * | 2010-04-06 | 2012-08-10 | (주)탑나노시스 | Method for repairing working stage with CNT antistatic treatment |
KR101237869B1 (en) * | 2010-10-22 | 2013-02-27 | (주)탑나노시스 | Method for manufacturing working stage with CNT antistatic treatment and the working stage with CNT antistatic treatment |
TWI669794B (en) * | 2018-09-27 | 2019-08-21 | 頎邦科技股份有限公司 | Method and device for compression bonding of chip to substrate |
CN111970840B (en) * | 2020-08-28 | 2021-05-18 | 李钟波 | Printed circuit board etching device |
WO2022138662A1 (en) * | 2020-12-23 | 2022-06-30 | 京セラ株式会社 | Clamping jig, method for producing clamping jig, and cleaning device |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5460684A (en) * | 1992-12-04 | 1995-10-24 | Tokyo Electron Limited | Stage having electrostatic chuck and plasma processing apparatus using same |
JPH09160401A (en) * | 1995-12-12 | 1997-06-20 | Canon Inc | Production of semiconductive elastic roller |
ATE355323T1 (en) * | 1999-12-07 | 2006-03-15 | Univ Rice William M | ORIENTED NANOFIBER BOUND IN A POLYMER MATRIX |
-
2005
- 2005-10-11 JP JP2005296820A patent/JP2007109732A/en active Pending
-
2006
- 2006-09-20 TW TW095134785A patent/TW200729389A/en unknown
- 2006-10-02 KR KR1020060097013A patent/KR100834479B1/en not_active IP Right Cessation
- 2006-10-11 CN CNB2006101641272A patent/CN100474552C/en not_active Expired - Fee Related
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---|---|---|---|---|
JP2010245498A (en) * | 2009-03-31 | 2010-10-28 | Top Engineering Co Ltd | Anti-static treated work stage |
Also Published As
Publication number | Publication date |
---|---|
CN100474552C (en) | 2009-04-01 |
CN1956162A (en) | 2007-05-02 |
TW200729389A (en) | 2007-08-01 |
KR100834479B1 (en) | 2008-06-05 |
KR20070040300A (en) | 2007-04-16 |
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