JP2006518479A - 改善された双安定性ネマティック液晶ディスプレイ方法およびデバイス - Google Patents
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Abstract
Description
本発明の全般的な目的は、特許文献1に記載される双安定性ディスプレイ・デバイスを改善することである。それらのデバイスは、一般に「BiNem」デバイスと呼ばれる。この用語は、本特許出願に関連して使用される。そのようなデバイスの構造は、以下により詳細に記載される。
新規な双安定性ディスプレイが、特許文献1に記載され、かつBiNemディスプレイと呼ばれる。
2つの双安定性の組織UおよびTは、トポロジ的に異なる。連続して体積を変形することによって、一方の組織から他方の組織へ変換することはできない。したがって、U組織からT組織への変換またはその逆の変換は、強い外部電界によってまたは転移(disinclination)のラインを移動することによって、表面へのアンカリングが壊される必要がある。この第2の現象は、第1の現象よりかなり遅くかつ無視されることができるので、以下に詳細には記載されない。
一般に、BiNemタイプの液晶画素の切り替えは、2つの段階(アンカリングを壊す第1の段階、および組織を選択する第2の段階)で実行される。
・段階C:アンカリングを壊す
アンカリングが壊される段階Cの間、スレーブ・プレート30にアンカリングを壊す電界より大きい電界を加えるパルスを印加し、かつ図1の中央に示されるように、画素における分子が上昇される必要がある長さの時間を待機する必要がある。この壊す電界は、液晶層10の弾性および電気特性と、電界がセルのスレーブ・プレート30上に付着されたアンカリング層34と相互作用する方法とに応じる。それは、マイクロメータ当たり約10ボルトまで、数ボルトの範囲にわたって変化する。分子の持ち上げ時間は、回転粘度γに比例し、かつ使用される材料10の誘電異方性に反比例し、また印加される電界の二乗に反比例する。実際、この時間は、マイクロメータ当たり約20ボルトの電界に関して数マイクロ秒に下げられることができる。
・段階S:組織を選択する
その後、それは、数マイクロ秒または多くとも数十マイクロ秒で制御電圧における急な降下を確立することによって、電界を急速に降下させることに十分である。ΔV以上である強度を介する電圧におけるこの急な降下は、液晶における十分な強度の流体力学効果を生じることができるようなものである。組織Tを生成するために、この降下ΔVは、必ず印加される電圧を、アンカリングを壊す電圧Vcより大きな値から前記電圧より低い値にさせなければならない。
・段階C:アンカリングを壊す
アンカリングを壊す段階Cの間、T状態に書き込む上述の状態におけるように、分子を持ち上げるために十分である長さの時間にわたって、スレーブ・プレート30にアンカリングを壊す電界より大きい電界を印加する必要がある。
・段階S:組織を選択する
その後、印加される電圧を遅く降下させることが適切である。特許文献1は、そのような「遅い降下」を達成する2つの方法を提案する。信号が、パルスの持続期間の3倍より長い降下時間(図3)を有する傾斜の持続期間τ2が続く、持続期間τ1でありかつ強度P1のパルスであるか、または階段降下が課される。
一般的な多重化
中間解像度のマトリクス・スクリーンに関して、当業者は、各画素にそれぞれ独立した制御電極を接続が存在することには疑問の余地が無いことを知っている。なぜならそれは、画素毎に1つの接続を必要とするからであり、スクリーンが複雑になると技術的に不可能である。通常の液晶技術での場合のように、使用される電気光学効果が線形では無いときに、多重化技術を使用することによって接続の数を低減することが可能である。画素は、それぞれm個の画素のn個のグループとしてマトリクス・システムで編成される。例えば、マトリクス・スクリーンのためのn個の行およびm個の列が存在するか、またはデジタル・ディスプレイのためにn個のデジットおよびm個のデジットが存在する。通常の場合のように、順次のアドレス指定モードで、1つの行が同時に選択され、その後、次の行が選択されなど、最後の行まで選択される。毎回、ある行が選択され、列信号が、行における全ての画素に同時に加えられる。この方法は、1つの行をアドレス指定するために必要な時間に、行の数のn倍した時間に等しい時間間隔において、全ての画像をアドレス指定されることを可能にする。この方法を用いて、m+n個の接続は、m×n個の画素のスクリーンをアドレス指定するのに十分である。ここで、mは、考慮しているマトリクスにおける列の数である。そのような多重化されたマトリクス・スクリーンは、図5に示される。
多重化されるために、画素信号は、全ての画素に共通である行信号と、その符号に応じて、U組織またはT組織のいずれかを得るように作用する列信号とに再分割される必要がある。図6は、適切な画素信号が実施されることを可能にする例示的な行および列信号を示す。
A1=P1、A2−C=P2U、A2+C=P2T。
τ1=τ2=1msで、P2U=8VかつP2T=13Vであるなら、A1=20V、A2=10.5V、C=2.5Vである。
BiNemをアドレス指定する間に干渉信号を低減するために、特許文献3は、行アドレス指定信号における第2のレベルの持続期間より短い持続期間に、列信号の持続期間を低減することを推奨する。この低減は、その波形への修正に関連付けられることもできる。強度C’の方形波形信号である、列信号の持続期間を低減することによって得られる信号の一例は、図7に概略的に示される。最大強度C”の傾斜形状波形を有する、列信号の持続期間を低減することによって得られる信号の一例は、図8に概略的に示される。強度C1およびC2の階段波形を有する、列信号の持続期間を低減することによって得られる信号の一例は、図9に概略的に示される。
本発明による第1の変形形態の記載が最初に続き、記載は、添付の図10、図11、および図12を参照する。
本発明による第2の変形形態の記載が続き、記載は、添付の図13、図14、および図15を参照する。
図7c、図8c、および図9cに示される列信号に加えて、図16に示されるような列信号は、本発明の両方の変形形態における多重化モードで使用されることができる。この列信号は、傾斜する立ち上がりエッジ、および急な降下エッジによって終了するレベルを有する持続期間τCのパルスを含む。
従来のBiNemのアドレス指定において、パルスは、1ミリ秒から数ミリ秒までの程度の持続期間を有して通常使用されることを想起されたい。アンカリングが壊される画素への印加に関する電圧P1の強度は、1.5マイクロメートル(μm)から2μmの厚みを有するセルに関して10Vから30Vの程度である。
直流電圧を受けて電気分解によって所定の液晶材料が劣化する危険性を考慮するために、ゼロの平均値を有する信号を画素に印加することが有利である。
特許文献4は、行パルス間の時間の重なりを有するBiNemスクリーンのためのアドレス指定モードを記載する。関連する信号(例えば、2レベルの信号)は、まだアンカリングを壊す段階および選択段階を備え、その全体の持続期間はτLである。
τC≦τD≦τLであり、ここでτCは、列信号の持続期間である。
本発明の主な利点は、以下に説明されるように、引き出される電流Iinsを制限し、一方、アンカリングを壊す信号において上昇する間に画素をアドレス指定することにある。
従来の矩形制御パルスに応答する画素のための瞬間充電電流が決定される。図23に与えられる等価回路は、ゼロの立ち上がり時間および強度V0を有する矩形の印加される信号V(t)のためのものである。
この例において、最大強度V0でτRに等しい立ち上がり時間を有する浅い傾斜を有するパルスである。
Rp=1000Ω
ここで、Cp/単位面積=15平方センチメートル当たりナノファラッド(nF/cm2)
f=10Hz、
τR=400μs
例1:容量Cp=15nF、すなわちRpCp=15μsであると仮定して、面積=1cm2の単一の直接アドレス指定される画素。したがって、
τR≫RpCp:400μs≫15μs
行寸法:2mm×20mm、すなわち40mm2=0.4cm2の面積。
本発明の変形形態1を使用するシステムの記載が続く。記載される例は、図26に示される種類のバッテリまたは任意の他のエネルギー蓄積構成部品を有さない無線スマート・カードのためのBiNemタイプのディスプレイを使用する、ディスプレイ・モジュールを含む。このデバイスにおいて、エネルギーは、誘導ループ50および電源回路52によって供給される(断続的に)。この回路は、マイクロコントローラ54、ドライバ回路56、およびBiNemディスプレイ58に接続される。
したがってV0=20V、およびRp=1000Ω(上記数値例)で、
Iins=20mA
一方、平均電流Imeanは、
Imean=fCpV0=0.003mA Cp=15nFに関して
電源が供給できなければならない最大瞬間電流Iinsは、画素が、主に制御信号の切り替えの間に充電および放電するので、Imeanより非常に大きい。従来の矩形制御信号を用いて、電流は、全てのときにゼロまたはほぼゼロであるが、電圧を切り替えるとき毎に著しいピークを呈する。
一般に、上述された誘導ループ50で利用可能な出力は、20mWの程度である。
P(ins max,square)=Rp・Iins(square)2=400mWである。
τR=2.5msを仮定する。
記載を簡略化するために、記載される例は、2つの列C1およびC2によって掛けられる2つの行L1およびL2を備える(多重化されるモードにおいてアドレス指定可能である4つの画素を与える)、BiNemディスプレイ・マトリクス58に接続されるドライバ回路56に関連する。これは、図28に示される。
液晶セルのパラメータ、電圧およびアドレス指定モード、ならびに動作温度は、全てBiNemセルの切り替えに影響することがある要因を構成する。これら要因の値に応じて、1つの組織が「容易に」得られることができ、一方、他の組織は得るのが「困難に」なることが理解されるべきである。例えば、これは、特に温度要因に適用され、温度要因は、液晶の特性に影響を与えることが良く知られており、したがってT組織への切り替えの起源を構成する流体力学的な流れの特徴に影響を与えることが良く知られている。
・ディスプレイ全体が、「困難な」状態をとるべきディスプレイのこれらの画素を切り替えるように(傾斜するまたは傾斜しないことがある立ち上がりエッジで)、従来の多重化モードでアドレス指定される第2のステップとである。
52 電源回路
54 マイクロコントローラ
56 ドライバ回路
58 BiNemディスプレイ
70、72、78 トランジスタ
Claims (53)
- アンカリングを壊すことを含む双安定性のネマティック液晶マトリクス・スクリーン(58)を備えるディスプレイ・デバイスであって、前記ディスプレイ・デバイスは、前記マトリクス・スクリーンの各画素に対する制御信号を生成しかつ印加するのに適したアドレス指定手段(56)を含み、前記制御信号は、0.5V/μsから0.0001V/μsの範囲にある勾配を呈する傾斜して立ち上がるエッジ(Fm)を有することを特徴とするデバイス。
- ディスプレイ・デバイスが、2つの組織を使用し、一方の組織は、分子が少なくとも実質的に互いに平行である均一またはわずかにねじれており、他方の組織は、プラスまたはマイナス180°の程度のねじれだけ一方の組織と異なることを特徴とする請求項1に記載のデバイス。
- 前記アドレス指定手段(56)は、2つの段階を含む信号を生成するように適合され、第1の段階がアンカリングを壊すためであり、第2の段階が選択する目的であることを特徴とする請求項1または2に記載のデバイス。
- 均一な組織を得るために、前記アドレス指定手段(56)は、信号を生成するために適合され、前記信号は、前記選択段階の前記降下エッジにおける2つの連続するレベル間の前記低下が、限界閾値ΔVを超えず、一方、ねじれた組織を得るために、前記降下エッジが、前記限界閾値ΔVより大きな少なくとも1つの急な低下を含むことを特徴とする請求項3に記載のデバイス。
- 前記立ち上がりエッジ(Fm)が、0.1V/μsから0.005V/μsの傾斜を呈することを特徴とする請求項1から4のいずれか一項に記載のデバイス。
- 前記立ち上がりエッジ(Fm)が、40μsから20ms、好ましくは200μsから4msの持続期間τRを呈することを特徴とする請求項1から5のいずれか一項に記載のデバイス。
- 前記立ち上がりエッジ(Fm)が、300μsより長い持続期間τRを呈することを特徴とする請求項1から5のいずれか一項に記載のデバイス。
- 前記アドレス指定および制御信号は、アンカリングを壊す段階の終わりで傾斜する降下エッジ(Fd)も有することを特徴とする請求項1から7のいずれか一項に記載のデバイス。
- 前記降下エッジ(Fd)の前記勾配は、前記立ち上がりエッジ(Fm)の前記勾配と同じ程度の強度であることを特徴とする請求項8に記載のデバイス。
- 各画素は、導電状態と非導電状態との間で切り替えられることができるそれぞれの構成部品、例えばトランジスタによって制御されることを特徴とする請求項1から9のいずれか一項に記載のデバイス。
- 列信号の持続期間は、行パルスの最後のレベルの持続期間より短いことを特徴とする請求項1から10のいずれか一項に記載のデバイス。
- 前記列信号は、方形波の形態であることを特徴とする請求項1から11のいずれか一項に記載のデバイス。
- 前記列信号は、傾斜の形態であることを特徴とする請求項1から11のいずれか一項に記載のデバイス。
- 前記列信号は、2つの連続するレベルを有することを特徴とする請求項1から11のいずれか一項に記載のデバイス。
- 前記アドレス指定手段は、ゼロの中間値を有する信号を各画素に生成するように適合されることを特徴とする請求項1から14のいずれか一項に記載のデバイス。
- 前記アドレス指定手段は、連続する反対極性を有する信号を各画素に生成するように適合されることを特徴とする請求項1から15のいずれか一項に記載のデバイス。
- 前記アドレス指定手段は、反対極性の連続する行および列信号を生成するように適合されることを特徴とする請求項1から15のいずれか一項に記載のデバイス。
- 前記アドレス指定手段は、各画像で反転される信号を各画素に生成するように適合されることを特徴とする請求項1から15のいずれか一項に記載のデバイス。
- 前記アドレス指定手段は、全ての行および列信号に共通電圧VMを追加するように適合されることを特徴とする請求項1から15のいずれか一項に記載のデバイス。
- 前記アドレス指定手段は、列電圧を印加するために必要な時間より長いまたは等しい持続期間に関して時間においてオフセットされる同様の行信号を同時に使用して、複数の行をアドレス指定するように適合されることを特徴とする請求項1から19のいずれか一項に記載のデバイス。
- 前記列信号の終わりが、前記行信号の終わりに同期されることを特徴とする請求項1から20のいずれか一項に記載のデバイス。
- τC≦τD<τLであり、以下の関係であり、
τDは、2つの行信号間でオフセットされる時間を表し、
τLは、アンカリングを壊す段階および組織を選択する段階を少なくとも含む行アドレス指定時間を表し、
τCは、列信号の前記持続期間を表すことを特徴とする請求項20または21に記載のデバイス。 - 前記制御信号は、少なくとも第1のステップを含み、前記第1のステップの間に、前記信号は、少なくとも1つの画素のパケット、好ましくは行画素のパケットを集合的に同一の状態に切り替えるように適合されることを特徴とする請求項1から22のいずれか一項に記載のデバイス。
- 前記第1のステップの信号は、好ましくは行画素の前記パケットを「困難」である状態に切り替えるように適合されることを特徴とする請求項23に記載のデバイス。
- 前記第1のステップの信号は、傾斜する立ち上がりエッジを表すことを特徴とする請求項23または24に記載のデバイス。
- 前記制御信号は、第2のステップを含み、前記第2のステップの間に、ディスプレイ全体が、各画素を選択されたそれぞれの状態に切り替えるために多重化されたモードでアドレス指定されることを特徴とする請求項23から25のいずれか一項に記載のデバイス。
- 前記第2のステップの信号は、所定の選択された画素、好ましくは行を容易な状態に切り替えるように適合されることを特徴とする請求項23から26のいずれか一項に記載のデバイス。
- 前記第2のステップの信号は、傾斜する立ち上がりエッジを表すことを特徴とする請求項23から27のいずれか一項に記載のデバイス。
- 前記第1のステップの信号は、全ての画素、好ましくは行に同時に印加されることを特徴とする請求項23から28のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、均一な状態を得るために直線的な傾斜によって形成されることを特徴とする請求項1から29のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、均一な状態を得るために単一の中間レベル方形波信号によって形成されることを特徴とする請求項1から29のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、均一な状態を得るために2つの連続レベルを有する方形波信号によって形成されることを特徴とする請求項1から29のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、均一な状態を得るために、降下する傾斜が続き、それ自体が急激な降下エッジが続く中間レベルを含む信号によって作られることを特徴とする請求項1から29のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、均一な状態を得るために3つの連続レベルを有する方形波信号によって形成されることを特徴とする請求項1から29のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、ねじれた状態を得るために急激なエッジによって形成されることを特徴とする請求項1から34のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、ねじれた状態を得るために単一の中間レベル方形波信号によって形成されることを特徴とする請求項1から34のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、ねじれた状態を得るために2つの連続レベルを有する方形波信号によって形成され、これら連続レベルの第2のレベルは、第1のレベルより大きな強度を有することを特徴とする請求項1から34のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、ねじれた状態を得るために、上昇する傾斜が続き、それ自体が急激な降下エッジが続く中間レベルを含む信号によって形成されることを特徴とする請求項1から34のいずれか一項に記載のデバイス。
- 画素信号選択段階の前記降下エッジは、ねじれた状態を得るために、あるレベルから後続するレベルに強度がそれぞれ増大する3つの連続レベルを有する方形波信号によって形成されることを特徴とする請求項1から34のいずれか一項に記載のデバイス。
- 前記アドレス指定手段(56)は、傾斜する立ち上がりエッジと、単一の中間レベルを含む方形波の降下エッジとを含む、行信号を生成するように適合されることを特徴とする請求項1から39のいずれか一項に記載のデバイス。
- 前記アドレス指定手段(56)は、アンカリングを壊すためのレベルが続く傾斜する立ち上がりエッジ、レベルが続く傾斜する降下エッジ、および分離する目的のための急な低下を含む行信号を生成するように適合されることを特徴とする請求項1から39のいずれか一項に記載のデバイス。
- 前記アドレス指定手段(56)は、単一の方形波パルスの形態の列信号を生成するように適合されることを特徴とする請求項1から41のいずれか一項に記載のデバイス。
- 前記アドレス指定手段(56)は、それぞれ傾斜して立ち上がるエッジと、急激に降下するエッジとを有する信号の形態での列信号を生成するように適合されることを特徴とする請求項1から41のいずれか一項に記載のデバイス。
- 前記アドレス指定手段(56)は、第2のレベルが、第1のレベルより大きな強度である、2つのレベルを有する方形波信号の形態の列信号を生成するように適合されることを特徴とする請求項1から41のいずれか一項に記載のデバイス。
- 前記アドレス指定手段(56)は、それぞれ傾斜して立ち上がるエッジを有するパルスの形態であり、そのレベルが急激に降下するエッジで終了する列信号を生成するように適合されることを特徴とする請求項1から41のいずれか一項に記載のデバイス。
- 前記アドレス指定手段(56)は、アナログ・スイッチ(Co1からCo10)を備え、前記アナログ・スイッチは、2つの電圧VL(t)または0Vから1つの電圧を切り替えて行信号を生成し、かつ3つの電圧+C(t)、−C(t)、または0Vから1つの電圧を切り替えて列信号を生成するように適合されることを特徴とする請求項1から45のいずれか一項に記載のデバイス。
- 前記アドレス指定手段(56)は、行の数の2倍に、列の数の3倍を加えた数に等しい数のアナログ・スイッチを備えることを特徴とする請求項46に記載のデバイス。
- 前記アナログ・スイッチは、時間で変化するアナログ信号(VL(t)、+C(t)、及び−C(t))が供給されることを特徴とする請求項46または47に記載のデバイス。
- 前記アドレス指定手段(56)は、一定電圧(V1、V2、+C、Vo+C、−C、Vo−C)によって給電されるアナログ・スイッチを含むことを特徴とする請求項1から47のいずれか一項に記載のデバイス。
- 前記アドレス指定手段(56)は、各行に関して、2つの相補的トランジスタ(60、62)を含む制御回路を備え、相補的トランジスタの主導電経路は、接地と、交互に電圧V1またはV2を受けることができる電源端子(64)との間に直列に接続されることを特徴とする請求項1から49のいずれか一項に記載のデバイス。
- 電源端子(64)は、正信号のための電圧V1およびV2と、負信号のための電圧0VおよびV1−V2を受けることを特徴とする請求項50に記載のデバイス。
- 前記アドレス指定手段(56)は、各列に関して、3つのトランジスタ(70、72、78)を有する制御回路を備え、その2つのトランジスタ(70、72)は、交互に電圧+CまたはV0+Cを受けるのに適した電源端子(74)と、交互に電圧−CまたはV0−Cを受けるのに適した電源端子(76)との間に直列に接続された主導電経路を有し、第3のトランジスタ(78)は、その主導電経路が、2つの前記トランジスタ(70、72)の共通点と、交互に電圧0VとV0を受けるのに適した電源端子(79)との間に配置されることを特徴とする請求項1から51のいずれか一項に記載のデバイス。
- アンカリングを壊すことを含む双安定性のネマティック液晶マトリクス・スクリーンを電気的に制御する方法であって、マトリクス・スクリーンに、傾斜して立ち上がるエッジを有するアドレス指定および制御信号を生成しかつ印加することを含むことを特徴とする方法。
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WO (1) | WO2004075156A1 (ja) |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008257047A (ja) * | 2007-04-06 | 2008-10-23 | Nano Loa Inc | 液晶デバイスおよび液晶デバイスの駆動方法 |
WO2010095686A1 (ja) * | 2009-02-19 | 2010-08-26 | セイコーインスツル株式会社 | 双安定ネマチック液晶を用いたドットマトリクスディスプレイの駆動方法 |
JP5432149B2 (ja) * | 2008-08-19 | 2014-03-05 | セイコーインスツル株式会社 | 双安定ネマチックのドットマトリクス液晶ディスプレイの駆動方法および駆動デバイス |
Families Citing this family (11)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8310441B2 (en) | 2004-09-27 | 2012-11-13 | Qualcomm Mems Technologies, Inc. | Method and system for writing data to MEMS display elements |
KR20080080117A (ko) * | 2005-11-16 | 2008-09-02 | 폴리머 비젼 리미티드 | 강유전성 박막 트랜지스터 기반의 픽셀들을 가지는 액티브메트릭스 디스플레이들을 어드레싱하기 위한 방법 |
US8194056B2 (en) | 2006-02-09 | 2012-06-05 | Qualcomm Mems Technologies Inc. | Method and system for writing data to MEMS display elements |
TWI352322B (en) * | 2006-07-19 | 2011-11-11 | Prime View Int Co Ltd | Drive apparatus for bistable displayer and method |
TWI336461B (en) * | 2007-03-15 | 2011-01-21 | Au Optronics Corp | Liquid crystal display and pulse adjustment circuit thereof |
US8736590B2 (en) | 2009-03-27 | 2014-05-27 | Qualcomm Mems Technologies, Inc. | Low voltage driver scheme for interferometric modulators |
TWI402818B (zh) * | 2009-11-02 | 2013-07-21 | Wintek Corp | 液晶顯示器的驅動方法 |
TWI406223B (zh) * | 2009-12-15 | 2013-08-21 | Prime View Int Co Ltd | 雙穩態顯示器的畫素驅動方法 |
CN102208175B (zh) * | 2010-03-29 | 2016-01-20 | 精工电子有限公司 | 双稳定型液晶显示装置的驱动方法 |
JP2012137575A (ja) * | 2010-12-27 | 2012-07-19 | Hitachi Chem Co Ltd | 懸濁粒子装置,懸濁粒子装置を用いた調光装置及びそれらの駆動方法 |
CA2894477A1 (en) * | 2012-11-23 | 2014-05-30 | Mega Act Technologies Holding Ltd | Method and apparatus for data communications over power lines |
Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH10239662A (ja) * | 1997-03-03 | 1998-09-11 | Toshiba Corp | 液晶表示装置 |
JPH1184345A (ja) * | 1997-09-12 | 1999-03-26 | Ricoh Co Ltd | 液晶表示素子の駆動方法及び液晶表示装置 |
JP2000504433A (ja) * | 1995-11-08 | 2000-04-11 | サントル・ナシオナル・ドゥ・ラ・ルシェルシュ・シアンティフィーク(セーエヌエールエス) | 双安定効果を持った液晶表示デバイス |
JP2000514932A (ja) * | 1997-05-07 | 2000-11-07 | ケント ステイト ユニバーシティ | 双安定液晶ディスプレイ用のダイナミック駆動方法および装置 |
JP2001506379A (ja) * | 1997-06-04 | 2001-05-15 | ケント・ディスプレイズ・インコーポレイテッド | 液晶ディスプレー用の累積駆動系および方法 |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
GB9302997D0 (en) * | 1993-02-15 | 1993-03-31 | Secr Defence | Multiplex addressing of ferro-electric liquid crystal displays |
GB9510612D0 (en) * | 1995-05-25 | 1995-07-19 | Central Research Lab Ltd | Improvements in or relating to the addressing of liquid crystal displays |
WO1999005563A1 (fr) * | 1997-07-25 | 1999-02-04 | Seiko Epson Corporation | Afficheur et dispositif electronique comportant un tel afficheur |
GB9718369D0 (en) * | 1997-08-29 | 1997-11-05 | Sharp Kk | Multiplexing Method and Apparatus |
US6278429B1 (en) * | 1998-09-11 | 2001-08-21 | Kent State University | Bistable reflective cholesteric liquid crystal displays utilizing super twisted nematic driver chips |
FR2808890B1 (fr) * | 2000-05-12 | 2002-08-09 | Nemoptic | Dispositif bistable d'affichage en reflexion avec contraste inverse |
GB0022055D0 (en) * | 2000-09-07 | 2000-10-25 | Secr Defence | Addressing multistable nematic liquid crystal devices |
US7696971B2 (en) * | 2001-05-15 | 2010-04-13 | The Hong Kong University Of Science And Technology | Method, materials and apparatus for driving gray-scale bistable cholesteric displays |
US6911965B2 (en) * | 2003-01-28 | 2005-06-28 | Kent Displays Incorporated | Waveform sequencing method and apparatus for a bistable cholesteric liquid crystal display |
-
2003
- 2003-02-20 FR FR0302074A patent/FR2851683B1/fr not_active Expired - Fee Related
-
2004
- 2004-02-19 US US10/545,940 patent/US7724221B2/en not_active Expired - Fee Related
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Patent Citations (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2000504433A (ja) * | 1995-11-08 | 2000-04-11 | サントル・ナシオナル・ドゥ・ラ・ルシェルシュ・シアンティフィーク(セーエヌエールエス) | 双安定効果を持った液晶表示デバイス |
JPH10239662A (ja) * | 1997-03-03 | 1998-09-11 | Toshiba Corp | 液晶表示装置 |
JP2000514932A (ja) * | 1997-05-07 | 2000-11-07 | ケント ステイト ユニバーシティ | 双安定液晶ディスプレイ用のダイナミック駆動方法および装置 |
JP2001506379A (ja) * | 1997-06-04 | 2001-05-15 | ケント・ディスプレイズ・インコーポレイテッド | 液晶ディスプレー用の累積駆動系および方法 |
JPH1184345A (ja) * | 1997-09-12 | 1999-03-26 | Ricoh Co Ltd | 液晶表示素子の駆動方法及び液晶表示装置 |
Cited By (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2008257047A (ja) * | 2007-04-06 | 2008-10-23 | Nano Loa Inc | 液晶デバイスおよび液晶デバイスの駆動方法 |
JP5432149B2 (ja) * | 2008-08-19 | 2014-03-05 | セイコーインスツル株式会社 | 双安定ネマチックのドットマトリクス液晶ディスプレイの駆動方法および駆動デバイス |
WO2010095686A1 (ja) * | 2009-02-19 | 2010-08-26 | セイコーインスツル株式会社 | 双安定ネマチック液晶を用いたドットマトリクスディスプレイの駆動方法 |
Also Published As
Publication number | Publication date |
---|---|
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FR2851683A1 (fr) | 2004-08-27 |
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Khan et al. | 22.4: Novel Drive Techniques and Temperature Compensation Mechanisms in Reflective Cholesteric Displays | |
JP2004192002A (ja) | 液晶表示装置 |
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