JP2006284493A - Semiconductor device and circuit testing method of semiconductor device - Google Patents
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Abstract
Description
本発明は半導体装置の直流電流リーク試験方法に係り、特に電流測定ポイント数の削減に有効な技術に関するものである。 The present invention relates to a DC current leakage test method for a semiconductor device, and more particularly to a technique effective for reducing the number of current measurement points.
半導体集積回路技術の発展に伴って素子の微細化と大規模化が平行して加速的に進んだ結果、半導体集積回路のリーク電流の増加が問題となっており、その試験時や不良品の解析時に不良箇所の特定手法の重要性が高くなっている。従来の直流電流リーク試験技術として、大規模化した半導体集積回路を複数の回路ブロックに分割し、各回路ブロックの電源供給源を分離することにより、回路ブロック毎に直流電流リークを測定するものがある(例えば、特許文献1参照)。
上記従来の方法は、複数に分割された回路ブロックの電源供給線を分離することにより、回路ブロック毎のリーク電流測定結果から不良回路ブロックを判別する方法があるが、回路ブロック数が多くなるに従って測定用の電源端子の増加と試験時間の増大が加速的に進んでしまうという問題が生じる。 In the above conventional method, there is a method of determining a defective circuit block from the leakage current measurement result for each circuit block by separating the power supply lines of the circuit blocks divided into a plurality, but as the number of circuit blocks increases, There is a problem that the increase in the number of power terminals for measurement and the increase in test time are accelerated.
本発明は、半導体装置を複数の回路ブロックに分割して直流電流リーク試験を行う際に、より簡単な回路構成で異常回路を判別することができ、電流測定ポイント数を削減し、試験時間を短縮することを目的とする。 In the present invention, when a DC current leak test is performed by dividing a semiconductor device into a plurality of circuit blocks, an abnormal circuit can be identified with a simpler circuit configuration, the number of current measurement points can be reduced, and the test time can be reduced. The purpose is to shorten.
本発明の半導体装置の回路試験方法は、半導体装置を複数の回路ブロックに分割して直流電流リーク試験を行う回路試験方法であって、相互に分離された複数の電源電圧供給源と相互に分離された複数の接地を用い、前記回路ブロックのそれぞれに対して前記電源電圧供給源と前記接地の組み合わせが唯一であるように接続し、それぞれの前記電源電圧供給源とそれぞれの前記接地を流れる電流値を測定し、電流値が異常となる前記電源電圧供給源と前記接地の組み合わせにより異常が発生した前記回路ブロックを特定する。 A circuit test method for a semiconductor device according to the present invention is a circuit test method for performing a DC current leakage test by dividing a semiconductor device into a plurality of circuit blocks, and is separated from a plurality of power supply voltage supply sources separated from each other. A plurality of grounds connected to each of the circuit blocks such that a combination of the power supply voltage supply source and the ground is unique, and a current flowing through the power supply voltage supply source and the ground. A value is measured, and the circuit block in which an abnormality has occurred due to a combination of the power supply voltage supply source and the ground in which the current value is abnormal is specified.
上記構成によれば、いずれの回路ブロックに接続されている電源電圧供給源と接地の組み合わせも全体の組み合わせ中で唯一の組み合わせであるため、測定した電流値が異常となる電源電圧供給源と接地の組み合わせにより、異常が発生した回路ブロックを容易に特定することができる。 According to the above configuration, the combination of the power supply voltage supply source connected to any circuit block and the ground is the only combination in the whole combination. With this combination, it is possible to easily identify the circuit block in which an abnormality has occurred.
本発明の半導体装置は、複数に分割された回路ブロックと、相互に分離された複数の電源電圧供給源と、相互に分離された複数の接地とを備え、前記回路ブロックのそれぞれに対して前記電源電圧供給源と前記接地の組み合わせが唯一であるように接続する。 A semiconductor device according to the present invention includes a plurality of circuit blocks divided into a plurality, a plurality of power supply voltage supply sources separated from each other, and a plurality of grounds separated from each other. Connection is made so that the combination of the power supply voltage source and the ground is unique.
上記構成によれば、いずれの回路ブロックに接続されている電源電圧供給源と接地の組み合わせも全体の組み合わせ中で唯一の組み合わせであるため、電源電圧供給源と接地を流れるそれぞれの電流値を測定し、測定した電流値が異常となる電源電圧供給源と接地の組み合わせにより、異常が発生した回路ブロックを容易に特定することができる。 According to the above configuration, since the combination of the power supply voltage supply source and the ground connected to any circuit block is the only combination in the whole combination, each current value flowing through the power supply voltage supply source and the ground is measured. The circuit block in which the abnormality has occurred can be easily identified by the combination of the power supply voltage supply source and the ground in which the measured current value becomes abnormal.
本発明の半導体装置において、前記電源電圧供給源は2値以上の電源電圧レベルの設定が可能なものである。複数の被測定回路において同時にリーク電流異常が発生した場合には、1回の測定では異常が発生した被測定回路の判別が困難な場合があるが、上記構成によれば、電源電圧供給源は2値以上の電源電圧レベルの設定が可能なため、2回以上の測定により異常が発生した被測定回路を判別することができる。 In the semiconductor device of the present invention, the power supply voltage supply source can set a power supply voltage level of two or more values. When a leakage current abnormality occurs simultaneously in a plurality of measured circuits, it may be difficult to determine the measured circuit in which an abnormality has occurred in a single measurement. Since two or more power supply voltage levels can be set, it is possible to determine a circuit under measurement in which an abnormality has occurred due to two or more measurements.
本発明の半導体装置において、前記回路ブロックに接続される前記電源電圧供給源を切り替える手段を備える。複数の被測定回路において同時にリーク電流異常が発生した場合には、1回の測定では異常が発生した被測定回路の判別が困難な場合があるが、上記構成によれば、回路ブロックに接続される電源電圧供給源を切り替え、2回以上の測定を行うことにより異常が発生した被測定回路を判別することができる。 The semiconductor device of the present invention includes means for switching the power supply voltage supply source connected to the circuit block. When a leakage current abnormality occurs simultaneously in a plurality of measured circuits, it may be difficult to determine the measured circuit in which an abnormality has occurred in a single measurement, but according to the above configuration, the circuit is connected to a circuit block. It is possible to determine the circuit under measurement in which an abnormality has occurred by switching the power supply voltage supply source and performing the measurement twice or more.
本発明半導体装置において、前記回路ブロックに接続される前記電源電圧供給源を個別に切断する手段を備える。上記構成によれば、リーク電流異常回路が判別された場合に、異常リーク電流が発生している回路を個別に切断装置で電源電圧供給源から切断し、ストレス印加時の全体の異常電流を停止することにより、過電流による基盤および基盤に装着された部品の破壊を予防することができる。 The semiconductor device of the present invention further includes means for individually disconnecting the power supply voltage supply source connected to the circuit block. According to the above configuration, when an abnormal leakage current circuit is determined, the circuit in which the abnormal leakage current has occurred is individually disconnected from the power supply source by the cutting device, and the entire abnormal current is stopped when stress is applied. By doing so, it is possible to prevent destruction of the base and parts mounted on the base due to overcurrent.
本発明の半導体装置として、半導体集積回路のウェハ上に前記電源電圧供給源と前記接地を格子構造に配置する。半導体集積回路のウェハ上のチップは行方向と列方向に規則的な配置構造を持つため、上記構成によれば、回路ブロックのそれぞれに対して電源電圧供給源と接地の組み合わせが唯一であるように接続する格子構造を最適に実現することができる。 As a semiconductor device of the present invention, the power supply voltage supply source and the ground are arranged in a lattice structure on a wafer of a semiconductor integrated circuit. Since the chips on the semiconductor integrated circuit wafer have a regular arrangement structure in the row direction and the column direction, according to the above configuration, the combination of the power supply voltage source and the ground seems to be unique for each circuit block. The lattice structure connected to can be optimally realized.
本発明の半導体装置において、前記回路ブロックはある機能を果たす素子領域あるいは機能セルあるいはベースチップに搭載された半導体チップであり、異常であることが特定された前記回路ブロックを置換するための冗長素子領域あるいは冗長機能セルあるいは冗長半導体チップを備える。 In the semiconductor device of the present invention, the circuit block is an element region that performs a certain function, a semiconductor chip mounted on a function cell or a base chip, and a redundant element for replacing the circuit block that is specified to be abnormal A region, a redundant function cell, or a redundant semiconductor chip is provided.
上記構成によれば、測定した電流値が異常となる電源電圧供給源と接地の組み合わせにより、異常が発生した素子領域あるいは機能セルあるいは半導体チップを容易に特定することができるため、電流リーク試験を行うだけで不良箇所の判別と救済を実施でき、総試験時間の短縮によるコスト削減が期待できる。 According to the above configuration, an element region or a functional cell or a semiconductor chip in which an abnormality has occurred can be easily identified by a combination of a power supply voltage supply source and a ground in which the measured current value becomes abnormal. Defects can be identified and remedied just by doing this, and cost reductions can be expected by shortening the total test time.
本発明によれば、半導体装置を複数の回路ブロックに分割して直流電流リーク試験を行う際に、いずれの回路ブロックに接続されている電源電圧供給源と接地の組み合わせも全体の組み合わせ中で唯一の組み合わせとすることができるため、測定した電流値が異常となる電源電圧供給源と接地の組み合わせにより異常が発生した回路ブロックを容易に特定することができる。その結果、総電源電流測定ポイント数の削減と試験時間の短縮化を図ることができる。 According to the present invention, when a semiconductor device is divided into a plurality of circuit blocks and a DC current leak test is performed, the combination of the power supply voltage supply source connected to any circuit block and the ground is the only combination in the whole combination. Therefore, it is possible to easily identify the circuit block in which an abnormality has occurred due to the combination of the power supply voltage supply source and the ground in which the measured current value becomes abnormal. As a result, the total number of power supply current measurement points can be reduced and the test time can be shortened.
以下、本発明の実施形態について図面を参照しながら説明する。図1は本発明の第1の実施形態に係る回路試験方法を実施するための半導体装置の回路構成例を示す図であり、複数の回路ブロックに分割された半導体装置に対して、複数の個別電源電圧供給源と複数の個別接地を組み合わせている。 Hereinafter, embodiments of the present invention will be described with reference to the drawings. FIG. 1 is a diagram showing a circuit configuration example of a semiconductor device for carrying out a circuit testing method according to the first embodiment of the present invention. A plurality of individual devices are divided into a plurality of semiconductor devices divided into a plurality of circuit blocks. A power supply voltage source and a plurality of individual grounds are combined.
図1において、101〜104はそれぞれ被測定回路A〜被測定回路Dの4つの回路ブロック、105と106はそれぞれ相互に電気的に分離された電源電圧供給源、107と108はそれぞれ相互に電気的に分離された接地である。なお、図1の回路構成例は回路数を特に限定するものではなく、以降の各実施形態の回路構成例においても同様である。 In FIG. 1, 101 to 104 are four circuit blocks of a circuit under test A to a circuit under test D, 105 and 106 are power supply sources that are electrically separated from each other, and 107 and 108 are electrically connected to each other. Isolated ground. The circuit configuration example of FIG. 1 does not particularly limit the number of circuits, and the same applies to the circuit configuration examples of the following embodiments.
電源電圧供給源105は被測定回路101と被測定回路102に共通に接続されて電源電圧を供給し、電源電圧供給源106は被測定回路103と被測定回路104に共通に接続されて電源電圧を供給し、接地107は被測定回路101と被測定回路103に共通に接続され、接地108は被測定回路102と被測定回路104に共通に接続されている。
The power supply
このような複数の個別電源電圧供給源と複数の個別接地を接続した組み合わせ構造を持つことにより、被測定回路101〜被測定回路104のそれぞれに接続される電源電圧供給源と接地の組み合わせは互いに異なる唯一の組み合わせとなる。
By having such a combined structure in which a plurality of individual power supply voltage supply sources and a plurality of individual grounds are connected, the combination of the power supply voltage supply source and the ground connected to each of the circuit under
電源電圧供給源105に流れる電流値は電源電流109で測定し、電源電圧供給源106に流れる電流値は電源電流110で測定し、接地107に流れ込む電流値は電源電流111で測定し、接地108に流れ込む電流値は電源電流112で測定する。
The current value flowing through the power supply
電源電流109の電流値は被測定回路101と被測定回路102に流れる電流値の総計となり、電源電流110の電流値は被測定回路103と被測定回路104に流れる電流値の総計となり、電源電流111の電流値は被測定回路101と被測定回路103から流れ込む電流値の総計となり、電源電流112の電流値は被測定回路102と被測定回路104から流れ込む電流値の総計となる。
The current value of the
直流リーク電流Iddqの測定を行うときに、全回路が正常なリーク電流値以下の回路であれば電源電流値はすべて正常値以下であるが、仮に被測定回路103が異常に大きいリーク電流が流れる不良箇所を含む回路であった場合は、電源電圧供給源106から被測定回路103を通って接地107へ抜ける電流経路に異常電流が流れ、電流値の測定ポイントとしては電源電流110と電源電流111に異常な電流が検出される。
When the DC leakage current Iddq is measured, if all the circuits are below the normal leakage current value, the power supply current values are all below the normal value, but the circuit under
被測定回路101〜被測定回路104の電源電圧供給源と接地の接続組み合わせは互いに異なる唯一の構成であるため、被測定回路101〜被測定回路104のいずれかに直流リーク電流Iddqの異常があった場合は、電源電流109と電源電流110および電源電流111と電源電流112のどの電源電流測定ポイントの組み合わせで異常電流が流れているかにより、異常電流が流れている被測定回路を判別することが可能となる。
Since the circuit under
上記回路構成例は回路数を特に限定するものではなく、例えば、電源電圧供給源が5つで接地が4つの構成を持った場合は、各電源電圧供給源に被測定回路が4つずつ接続され、各接地に被測定回路が5つずつ接続された構成が考えられ、上記と同様に電源電流値の観測結果の組み合わせにより20個の被測定回路の内から異常回路ブロックの判別が可能である。 The above circuit configuration example does not particularly limit the number of circuits. For example, when there are five power supply voltage supply sources and four grounding configurations, four circuits to be measured are connected to each power supply voltage supply source. A configuration in which five circuits under test are connected to each ground is conceivable, and an abnormal circuit block can be identified from among 20 circuits under measurement by combining the observation results of the power supply current values in the same manner as described above. is there.
仮に20個の被測定回路に個別に電源電圧供給源のみを接続した場合は、異常回路の判別に20箇所の電源電流測定ポイントが必要になるが、上記の例では電源電流測定ポイントは電源電圧供給源側の5つと接地側の4つの合計9箇所となり、試験回路構成を簡単にすることができる。 If only 20 power supply voltage sources are individually connected to 20 circuits under test, 20 power supply current measurement points are required to identify an abnormal circuit. In the above example, the power supply current measurement points are the power supply voltage. There are a total of 9 locations, 5 on the supply side and 4 on the ground side, so that the test circuit configuration can be simplified.
被測定回路に対して電源電圧供給源と接地の組み合わせを唯一の組み合わせであるようにする本実施形態の回路構成方法は、半導体装置上において、行方向の被測定回路を行毎に1つの電源電圧供給源接続で共通接続し、列方向の被測定回路を列毎に1つの接地接続で共通接続すると、配線構造が簡単でかつ電流値測定によって判別された異常なリーク電流回路ブロックの判別が容易なものとなる。このような格子構造を被測定回路を3行3列に配置して実現した半導体装置の構成例を図9に示す。 The circuit configuration method according to the present embodiment in which the combination of the power supply voltage supply source and the ground is the only combination for the circuit to be measured. In the semiconductor device, the circuit under measurement in the row direction has one power supply for each row. When the voltage supply source connection is connected in common and the circuit under test in the column direction is connected in common by one ground connection for each column, the wiring structure is simple and abnormal leakage current circuit blocks determined by current value measurement can be identified. It will be easy. FIG. 9 shows a configuration example of a semiconductor device in which such a lattice structure is realized by arranging circuits to be measured in 3 rows and 3 columns.
また、半導体集積回路のウェハ上のチップは行方向と列方向に規則的な配置構造を持つため、この格子構造は特に半導体集積回路のウェハ上で実現するのに適している。図10は半導体集積回路のウェハ状態で電源電圧供給源と接地を4行4列の格子構造に組み合わせた例を示したものである。 Further, since the chips on the semiconductor integrated circuit wafer have a regular arrangement structure in the row direction and the column direction, this lattice structure is particularly suitable for realization on the semiconductor integrated circuit wafer. FIG. 10 shows an example in which a power supply voltage supply source and grounding are combined in a 4 × 4 lattice structure in a wafer state of a semiconductor integrated circuit.
図2は本発明の第2の実施形態に係る回路試験方法を実施するための半導体装置の回路構成例を示す図である。図2において、201と202はそれぞれ個別に2値以上の電源電圧レベルを任意に設定できる構成を持つ電源電圧供給源である。これ以外の点では、本実施形態の構成は図1の構成と同一である。
FIG. 2 is a diagram showing a circuit configuration example of a semiconductor device for carrying out a circuit test method according to the second embodiment of the present invention. In FIG. 2,
第1の実施形態のように電源電圧供給源の電源電圧レベルが1値しか設定できない構成では、被測定回路101〜被測定回路104の内で複数の被測定回路において同時にリーク電流異常が発生した場合に1回の測定では異常発生した被測定回路の判別が困難な場合がある。
In the configuration in which only one power supply voltage level of the power supply voltage supply source can be set as in the first embodiment, a leakage current abnormality occurred simultaneously in a plurality of measured circuits among the measured
例えば、電源電流109と電源電流110に流れる異常リーク電流値が同一で、かつ、電源電流111と電源電流112に流れる異常リーク電流値も同一であった場合は、被測定回路101と被測定回路104に同じ値のリーク電流値異常が発生しているのか、被測定回路102と被測定回路103に同じ値のリーク電流値異常が発生しているのかの判別ができない。
For example, when the abnormal leakage current values flowing in the power supply current 109 and the power supply current 110 are the same and the abnormal leakage current values flowing in the power supply current 111 and the power supply current 112 are also the same, the circuit under
本実施形態においては、複数の異常回路ブロックが存在する場合に、電源電圧供給源201もしくは電源電圧供給源202の電源電圧を変化させた前後における電源電流109〜電源電流112の電流値の変化した値を用いることで、被測定回路101〜被測定回路104の内のどの回路にリーク電流異常が発生したかの判別が可能となる。
In this embodiment, when there are a plurality of abnormal circuit blocks, the current values of the power supply current 109 to the power supply current 112 change before and after the power supply voltage of the power supply
例えば、被測定回路101と被測定回路104に同じ値のリーク電流値異常が発生している場合に、電源電圧供給源201の電圧を最初に基準とした測定した電圧から下げた場合は、被測定回路101から接地107に流れ込む電源電流111の電流値は減少するが、接地108に流れ込む電源電流112は変化しないので、異常回路ブロックの判別が可能となる。
For example, when the leakage current value abnormality of the same value has occurred in the circuit under
被測定回路のブロック数が上記構成例より多く、電源電圧供給源と接地数がそれぞれ3つ以上の場合であっても、上記の方法と同様に、電源電圧供給源の電圧値を個別に2値以上変化させて設定することにより、複数の被測定回路ブロックでの異常発生を必要最低限のリーク電流測定回数で判別することができ、試験時間の短縮を図ることができる。 Even when the number of blocks of the circuit under test is larger than the above configuration example and the number of power supply voltage supply sources and the number of grounds are three or more, respectively, the voltage value of the power supply voltage supply source is set to 2 individually as in the above method. By setting the value by changing more than the value, it is possible to determine the occurrence of an abnormality in a plurality of circuit blocks to be measured with the minimum necessary number of leak current measurements, and to shorten the test time.
図3は本発明の第3の実施形態に係る回路試験方法を実施するための半導体装置の回路構成例を示す図である。図3において、301は被測定回路102の電源電圧供給源を電源電圧供給源105または電源電圧供給源106のいずれかに切り替えることができる経路切替装置である。これ以外の点では、本実施形態の構成は図1の構成と同一である。
FIG. 3 is a diagram showing a circuit configuration example of a semiconductor device for carrying out a circuit testing method according to the third embodiment of the present invention. In FIG. 3,
前記第2の実施形態で述べたように、被測定回路101〜被測定回路104の内で複数の被測定回路において同時にリーク電流異常が発生した場合に1回の測定では異常発生した被測定回路の判別が困難な場合があるが、本実施形態では、被測定回路の電源電圧供給源を切り替えて電流値の変化を測定することで電流異常がある回路を判別する。
As described in the second embodiment, when a leakage current abnormality occurs simultaneously in a plurality of measured circuits among the measured
例えば、被測定回路101と被測定回路104に同じ値のリーク電流値異常が発生している場合に、被測定回路102に電流リーク異常が発生していない結果として、経路切替装置301を電源電圧供給源105から電源電圧供給源106に切り替えた前後では電源電流109〜電源電流112の電流値が変化しないため、被測定回路101と被測定回路104に同じ値のリーク電流値異常が発生しているという異常回路ブロックの判別が可能となる。
For example, when a leakage current value abnormality having the same value occurs in the circuit under
被測定回路のブロック数が上記構成例より多く、電源電圧供給源と接地数がそれぞれ3つ以上の場合であっても、経路切替装置を複数箇所挿入することにより、前記第2の実施形態の方法と同様に、複数の被測定回路ブロックでの異常発生を必要最低限のリーク電流測定回数で判別することができ、試験時間の短縮を図ることができる。 Even if the number of blocks of the circuit under test is larger than that in the above configuration example and the number of power supply voltage supply sources and the number of grounds are each 3 or more, by inserting a plurality of path switching devices in the second embodiment, Similarly to the method, it is possible to determine the occurrence of an abnormality in a plurality of circuit blocks to be measured with the minimum necessary number of leak current measurements, and to shorten the test time.
図4は本発明の第4の実施形態に係る回路試験方法を実施するための半導体装置の回路構成例を示す図である。図4において、401は被測定回路101〜被測定回路104の電源電圧供給源側の電流経路に個別に挿入された切断装置である。これ以外の点では、本実施形態の構成は図1の構成と同一である。
FIG. 4 is a diagram showing a circuit configuration example of a semiconductor device for carrying out a circuit test method according to the fourth embodiment of the present invention. In FIG. 4,
この切断装置は半導体集積回路の初期不良発生品の選別に有用である。すなわち、この切断装置をパッケージ製品数十個をまとめてソケットで装着した電圧ストレス印加用の基盤や、ウェハ状態の半導体集積回路に同時に電気接続用のプローブ針で電圧ストレス印加する基盤に実装し、各被測定回路への電源電圧供給源を個別に切断可能にする。 This cutting apparatus is useful for selecting an initial defective product of a semiconductor integrated circuit. In other words, this cutting device is mounted on a base for voltage stress application in which dozens of package products are mounted together with a socket, or on a base for voltage stress application with a probe needle for electrical connection simultaneously to a semiconductor integrated circuit in a wafer state, The power supply voltage supply source to each circuit under test can be disconnected individually.
個別の電源電圧供給源と個別の接地の電流値測定でリーク電流異常回路を判別した後に、異常リーク電流が発生している回路を個別に切断装置で電源電圧供給源から切断し、ストレス印加時の全体の異常電流を停止することにより、過電流による基盤および基盤に装着された部品の破壊を予防することができる。 After determining the leakage current abnormal circuit by measuring the current value of the individual power voltage supply source and individual ground, disconnect the circuit where the abnormal leakage current has occurred from the power voltage supply source individually with a cutting device, and when applying stress By stopping the abnormal current as a whole, it is possible to prevent destruction of the base and parts mounted on the base due to overcurrent.
図5は本発明の第5の実施形態に係る半導体装置の回路構成を示す図である。本実施形態においては、半導体装置が複数の機能ブロックおよび冗長機能ブロックで構成される場合に、機能ブロックの直流電流リーク試験を第1の実施形態と同様の方法で行い、その結果で判別された異常な機能ブロックを置換する方法を示す。 FIG. 5 is a diagram showing a circuit configuration of a semiconductor device according to the fifth embodiment of the present invention. In the present embodiment, when the semiconductor device is configured by a plurality of functional blocks and redundant functional blocks, the DC current leakage test of the functional blocks is performed by the same method as that of the first embodiment, and is determined based on the result. Shows how to replace abnormal functional blocks.
図5の(a)に示すように、半導体装置内は機能ブロック501〜機能ブロック504と、機能ブロック501〜機能ブロック504のそれぞれと同一の機能を有する冗長機能ブロック505〜冗長機能ブロック508を内蔵している。 As shown in FIG. 5A, the semiconductor device includes function blocks 501 to 504 and redundant function blocks 505 to 508 having the same functions as the function blocks 501 to 504, respectively. is doing.
機能ブロック501〜機能ブロック504に対しては、第1の実施形態と同様に、電源電圧供給源105と電源電圧供給源106と接地107と接地108を組み合わせた接続がなされており、冗長機能ブロック505〜冗長機能ブロック508に対しては、それぞれ対応する機能ブロック501〜機能ブロック504と同様に、接地107と接地108が接続されている。
Similarly to the first embodiment, the
リーク電流測定によって電流異常が発生している機能ブロックが有った場合は、第1の実施形態と同様に、電源電圧供給源105と電源電圧供給源106と接地107と接地108の電流値の確認により不良が発生している機能ブロックを判別することができる。
If there is a functional block in which a current abnormality has occurred due to leakage current measurement, the current values of the power supply
また、例えば不良機能ブロックが機能ブロック504と判定された場合は、図5の(b)に示すように、半導体装置内で機能ブロック504から冗長機能ブロック508に電源電圧供給源と制御信号を切り替えて接続することにより、半導体装置全体としての電流値異常発生と機能異常発生を回避して不良の救済をすることができる。
For example, when the defective functional block is determined to be the
この例では、4つの機能ブロックであるため電源電圧供給源と接地がそれぞれ2つずつであるが、機能ブロックが多数の場合は必要最低限の個別の電源電圧供給源と個別の接地を持つことにより、半導体装置内の故障した機能ブロックの判別と機能救済を行うことができる。 In this example, since there are four function blocks, there are two power supply voltage supply sources and two grounds each. However, when there are a large number of function blocks, a minimum number of individual power supply voltage supply sources and individual grounds are required. As a result, it is possible to determine the functional block in the semiconductor device and to repair the function.
図6は本発明の第6の実施形態に係る半導体装置の回路構成を示す図である。本実施形態では、半導体装置においてSRAMメモリセルのような同一物理構成の機能セルが連続して配置されている場合に、機能セルの直流電流リーク試験を第1の実施形態と同様の方法で行い、その結果で判別された異常な機能セルを置換して救済する方法を示す。 FIG. 6 is a diagram showing a circuit configuration of a semiconductor device according to the sixth embodiment of the present invention. In the present embodiment, when functional cells having the same physical configuration, such as SRAM memory cells, are continuously arranged in the semiconductor device, the direct current leakage test of the functional cells is performed by the same method as in the first embodiment. Then, a method of repairing by replacing the abnormal functional cell determined by the result will be described.
図6の(a)に示すように、半導体装置内のある機能ブロック606において、第1の実施形態と同様に、機能セル601〜機能セル604に対して電源電圧供給源105と電源電圧供給源106と接地107と接地108を組み合わせた接続がなされており、リーク電流測定によって電流異常が発生している機能セルが有った場合は、電源電圧供給源105と電源電圧供給源106と接地107と接地108の異常リーク電流値の確認により不良機能セルを判別することができる。
As shown in FIG. 6A, in a
機能セルは同一物理構造なので、救済用に必要な最低限の冗長機能セル605を予め備えておくことができる。例えば、機能セル603がリーク電流測定で異常と判別同定された場合は、図6の(b)に示すように、不良判定された機能セル603の電源電圧供給源と制御信号を冗長機能セル605に切り替えることにより、機能ブロック606全体のリーク電流異常と機能の救済を実施する。電流リーク試験を行うだけで不良機能セルの判別と救済を実施できるため、総試験時間の短縮によるコスト削減が期待できる。
Since the functional cells have the same physical structure, the minimum redundant
図7は本発明の第7の実施形態に係る半導体装置の回路構成を示す図である。本実施形態では、例えばSRAMやフラッシュROMのような個別のメモリチップが複数組み込まれた半導体装置など、複数の半導体チップが同一パッケージ内に組み込まれた構成を持つ半導体装置において、半導体チップの直流電流リーク試験を第1の実施形態と同様の方法で行い、その結果で判別された異常な半導体チップを置換して救済する方法を示す。 FIG. 7 is a diagram showing a circuit configuration of a semiconductor device according to the seventh embodiment of the present invention. In the present embodiment, in a semiconductor device having a configuration in which a plurality of semiconductor chips are incorporated in the same package, such as a semiconductor device in which a plurality of individual memory chips such as SRAM and flash ROM are incorporated, the direct current of the semiconductor chip A method of performing a leak test by the same method as that of the first embodiment and replacing the abnormal semiconductor chip determined based on the result will be described.
図7の(a)に示すように、半導体チップ701〜半導体チップ704に対して、第1の実施形態と同様に、ベースチップ706上で電源電圧供給源105と電源電圧供給源106と接地107と接地108を組み合わせた接続がなされており、リーク電流測定によって電流異常が発生している半導体チップが有った場合は、電源電圧供給源105と電源電圧供給源106と接地107と接地108の電流値の確認により不良半導体チップを判別することができる。
As shown in FIG. 7A, for the
ベースチップ706上には、救済用に必要な最低限の冗長機能セル705を予め備えておく。例えば、半導体チップ704がリーク電流測定で異常と判別された場合は、図7の(b)に示すように、不良判定された半導体チップ704の電源電圧供給源と制御信号を冗長半導体チップ705に切り替えることにより、半導体装置全体のリーク電流異常と機能の救済を実施する。
On the
電流リーク試験を行うだけで不良半導体チップの判別と救済を事前に実施できるため、試験時間の短縮ができ、また、複数チップを同一パッケージに組み込んだ高価な半導体装置であっても、製造の最後の工程においても機能救済が可能なため、コスト削減の効果が期待できる。 Since it is possible to identify and relieve defective semiconductor chips in advance simply by performing a current leak test, the test time can be shortened, and even an expensive semiconductor device that incorporates multiple chips in the same package can be used at the end of manufacturing. Since the function can be relieved even in this process, an effect of cost reduction can be expected.
図8は、以上説明した本発明に係る回路試験方法を要約したフローチャートである。図8において、ステップ802で複数の個別電源電圧供給源と複数の個別接地の構成により異常個所の存在が判別されると、ステップ803で論理配置情報データベース811と物理配置情報データベース812を参照することにより異常箇所を特定し、異常箇所に対する置換データが無い場合はステップ804からステップ805に進み、異常箇所情報を出力する。
FIG. 8 is a flowchart summarizing the circuit test method according to the present invention described above. In FIG. 8, when the presence of an abnormal location is determined in
異常箇所を置換するための機能ブロックや機能セルや半導体チップが半導体装置内に用意されている場合は、その配置と接続情報により予め置換情報データベース813を作成しておく。この場合はステップ804からステップ806に進み、異常箇所の特定結果に対して置換情報データベース813を参照して置換場所を特定し、ステップ807で置換による救済情報を出力する。
When functional blocks, functional cells, or semiconductor chips for replacing abnormal parts are prepared in the semiconductor device, a
本発明の半導体装置および半導体装置の回路試験方法は、半導体装置を複数の回路ブロックに分割して直流電流リーク試験を行う際に、いずれの回路ブロックに接続されている電源電圧供給源と接地の組み合わせも全体の組み合わせ中で唯一の組み合わせとすることができるため、測定した電流値が異常となる電源電圧供給源と接地の組み合わせにより異常が発生した回路ブロックを容易に特定することができ、その結果、総電源電流測定ポイント数の削減と試験時間の短縮化を図ることができるという効果を有し、半導体装置の直流電流リーク試験方法等として有用である。 According to the semiconductor device and the circuit testing method of the semiconductor device of the present invention, when the DC current leakage test is performed by dividing the semiconductor device into a plurality of circuit blocks, the power supply voltage supply source connected to any circuit block and the ground Since the combination can also be the only combination in the overall combination, it is possible to easily identify the circuit block in which an abnormality has occurred due to the combination of the power supply voltage supply source and the ground in which the measured current value is abnormal, As a result, it has the effect of reducing the total number of power supply current measurement points and shortening the test time, and is useful as a DC current leak test method for semiconductor devices.
101、102、103、104 被測定回路
105、106、201、202 電源電圧供給源
107、108 接地
109、110、111、112 電源電流
301 経路切替装置
401 切断装置
501、502、503、504 機能ブロック
505、506、507、508 冗長機能ブロック
601、602、603、604 機能セル
605 冗長機能セル
606 機能ブロック
701、702、703、704 半導体チップ
705 冗長半導体チップ
706 ベースチップ
801〜807 処理ステップ
811 論理配置情報データベース
812 物理配置情報データベース
813 置換情報データベース
101, 102, 103, 104 Circuit under
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