JP2001051912A - シリアルデータ転送システムおよび異常検出方法 - Google Patents
シリアルデータ転送システムおよび異常検出方法Info
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- JP2001051912A JP2001051912A JP11228274A JP22827499A JP2001051912A JP 2001051912 A JP2001051912 A JP 2001051912A JP 11228274 A JP11228274 A JP 11228274A JP 22827499 A JP22827499 A JP 22827499A JP 2001051912 A JP2001051912 A JP 2001051912A
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Abstract
た、CPUが存在しない処理回路でもシリアルデータ転
送の異常検知を実現する。 【解決手段】 シリアルデータ転送手段として受信手段
と送信手段とをそれぞれ有する第1の処理回路100お
よび第2の処理回路200を備え、第1の処理回路の送
信手段と第2の処理回路の受信手段との間、および、第
2の処理回路の送信手段と第1の処理回路の受信手段と
間でデータ転送をおこなう際に、テストモード送信側と
なる一方の処理回路から送信されたテストデータは、テ
ストモード受信側となる他方の処理回路との間で折り返
され、全ての信号線を経由して循環してからテストモー
ド送信側となる一方の処理回路に戻る。これにより、信
号線上に異常があるかを信号線数や部品点数を増やさ
ず、CPUや処理プログラムの負荷を増加させず、また
通常動作時の信号線の入出力の方向を維持したまま、異
常を自動検出できる。
Description
システムおよびその異常検出方法に関し、特に、複数の
半導体集積回路の間のシリアルデータ転送における不具
合を自動検出するシリアルデータ転送システムおよびそ
の異常検出方法に関する。
複数の回路基板,複数の半導体集積回路などが存在して
いて、それらの間でデータ転送を行う場合には、シリア
ルデータ転送手段を使用することで配線数を削減できる
という有利がある。
れ別基板上に搭載され、基板間の接続にシリアルデータ
転送を使用する場合、基板単位でそれぞれクロックに同
期してASICが動作しているケースがある。このよう
な場合には送信側は自分のクロックでデータを出力し、
受信側も自分のクロックでデータを受信する。データに
は最初にスタートビットを送り、タイミングを合わせ
る。また長時間転送を連続させると送信側と受信側との
クロックのずれが蓄積される可能性があるで、データを
8ビットなどに区切り、ストップビットを最後につけ
る。そして次のデータも最初にスタートビットを付ける
ようにする。
出回路として、もっとも多く使用される方法は、送信側
がテストデータを受信側に送り、受信側はそのテストデ
ータを一旦レジスタに格納、あるいは信号処理を施し、
格納したデータあるいは信号処理を施したデータを再び
送信側に送り返すものがある。送信側では送り返された
データを検証し、送受信に異常があったかを検出する。
ーが発生した場合、 プロトコル(データのレートも含む)上の問題なの
か、 配線(結線)上の物理的な異常なのか、を特定するの
が困難であり、多大な時間を費やすことが多かった。
だけが判明している場合、 ・問題がソフトなのかハードなのか、 ・クロック等のラッチするための信号の微妙なずれなの
か、 ・シリアルデータのプロトコルの問題なのか、問題点を
絞り込む(切り分けを行う)のに悪戦苦闘することにな
る。
配線が切れていた、部品定数に間違いがあり信号が相手
ASICまで正しく転送されていなかった、といったハ
ードウェアに原因があるという結果がでることが多々あ
る。
データ転送の検査に関し、特開昭60−45858号公
報には、2つの処理回路において、一方から送信したデ
ータを受信側の回路で受信してしまわずに途中で折り返
すように制御して、送信側で異常の検出を行うものが示
されている。
きるものの、シリアルデータ転送に使用する各線の受信
側で折り返しの制御をおこなうようにすると共に、送信
側では各線に対してテストデータを送信すると共に、テ
ストデータの受信と検査とを行う必要がある。すなわ
ち、通信要求信号の信号線,通信許可信号の信号線,デ
ータの信号線の各線について両方の処理回路で行うた
め、CPUや処理プログラムの負担も大きくなる。
路(半導体集積回路)では別途CPUを設ける必要があ
り、また、CPUが存在する処理回路でもその負担が大
きくなるという問題を有している。
なされたものであって、CPUや処理プログラムに負担
をかけず、また、CPUが存在しない処理回路でもシリ
アルデータ転送の異常検知を実現可能なシリアルデータ
転送システムおよびその異常検出方法を実現することを
目的とする。
発明は以下に説明するものである。 (1)請求項1記載の発明は、シリアルデータ転送手段
として受信手段と送信手段とをそれぞれ有する第1の処
理回路および第2の処理回路を備え、前記第1の処理回
路の送信手段と前記第2の処理回路の受信手段との間、
および、前記第2の処理回路の送信手段と前記第1の処
理回路の受信手段と間でデータ転送をおこなうシリアル
データ転送システムにおいて、テストモード送信側とな
る一方の処理回路に、送信手段からのテストデータを通
信要求信号の信号線から送信させ、受信データの信号線
で受信したテストデータを前記受信手段に導く第1切替
手段と、通信許可信号の信号線からのテストデータを送
信データの信号線に折り返し、通信要求信号の信号線か
らのテストデータを通信許可信号の信号線に折り返す第
2切替手段と、各信号線を循環して受信したテストデー
タにより異常検出を行う検出手段と、を設け、テストモ
ード受信側となる他方の処理回路に、通信要求信号の信
号線からのテストデータを通信許可信号の信号線に折り
返し、受信データの信号線からのテストデータを通信要
求信号の信号線に折り返し、通信許可信号の信号線から
のテストデータを送信データの信号線に折り返す第3切
替手段、を設ける、ことを特徴とするシリアルデータ転
送システムである。
一方の処理回路から送信されたテストデータは、テスト
モード受信側となる他方の処理回路との間で折り返さ
れ、全ての信号線を経由して循環してからテストモード
送信側となる一方の処理回路に戻る。
るシリアルデータ転送手段を有する二つの信号処理回路
のデータ転送において、その信号線上に異常があるかを
信号線数や部品点数を増やさず、CPUや処理プログラ
ムの負荷を増加させず、また通常動作時の信号線の入出
力の方向を維持したまま、異常を自動検出できる。
をかけず、また、CPUが存在しない処理回路でも容易
にシリアルデータ転送の異常検知が実現可能になる。た
とえば、処理回路をASIC等の集積回路とした場合、
集積回路自体に比較的簡単なテスト回路を搭載すること
で、製品本体のコストアップや部品点数増加はない。
ータと受信したテストデータとの比較により異常検出を
行う。また、前記検出手段は、テストデータを送信して
から、テストデータを受信するまでの時間間隔により異
常検出を行う。
手段と、テストモードに設定されているかを判別するモ
ード判別手段を備え、前記モード判別手段の判別結果に
より、前記第1切替手段,前記第2切替手段および前記
第3切替手段の信号伝達状態が切り替わる、ようにする
ことが可能である。
電源投入時から一定時間はテストモードの設定を行う、
ことが望ましい。また、前記モード設定手段は、前記検
出手段により異常が検出されなかった場合に、テストモ
ード送信側とテストモード受信側を入れ替える、ことが
望ましい。
定手段は、前記時間計測手段の計測結果に基づいて、テ
ストモード送信側とテストモード受信側を入れ替える、
ことが望ましい。
ータ転送手段として受信手段と送信手段とをそれぞれ有
する第1の処理回路および第2の処理回路を備え、前記
第1の処理回路の送信手段と前記第2の処理回路の受信
手段との間、および、前記第2の処理回路の送信手段と
前記第1の処理回路の受信手段と間でデータ転送をおこ
なうシリアルデータ転送システムでの異常を検出する異
常検出方法であって、いずれか一方の処理回路をテスト
モード送信側、他方の処理回路をテストモード受信側と
設定し、テストモード送信側では送信手段からのテスト
データを通信要求信号の信号線から送信させ、テストモ
ード受信側では通信要求信号の信号線からのテストデー
タを通信許可信号の信号線に折り返し、テストモード送
信側では通信許可信号の信号線からのテストデータをデ
ータの信号線に折り返し、テストモード受信側ではデー
タの信号線からのテストデータを通信要求信号の信号線
に折り返し、テストモード送信側では通信要求信号の信
号線からのテストデータを通信許可信号の信号線に折り
返し、テストモード受信側では通信許可信号の信号線か
らのテストデータをデータの信号線に折り返し、テスト
モード送信側でデータの信号線で受信したテストデータ
を受信手段に導くと共に、送信したテストデータと受信
したテストデータとの比較により異常検出を行う、こと
を特徴とするシリアルデータ転送システムの異常検出方
法である。
一方の処理回路から送信されたテストデータは、テスト
モード受信側となる他方の処理回路との間で折り返さ
れ、全ての信号線を経由して循環してからテストモード
送信側となる一方の処理回路に戻る。
るシリアルデータ転送手段を有する二つの信号処理回路
のデータ転送において、その信号線上に異常があるかを
信号線数や部品点数を増やさず、CPUや処理プログラ
ムの負荷を増加させず、また通常動作時の信号線の入出
力の方向を維持したまま、異常を自動検出できる。
をかけず、また、CPUが存在しない処理回路でも容易
にシリアルデータ転送の異常検知が実現可能になる。
詳細に説明する。図1は本発明の実施の形態例のシリア
ルデータ転送システムの基本的な詳細構成を示すブロッ
ク図である。また、図2はシリアルデータ転送システム
の基本的な概略構成を示すブロック図である。
とシリアルデータ転送回路200とから構成されるシリ
アルデータ転送システムの一例を示す。まず、図2によ
り、全体の概略構成を説明する。
回路100とシリアルデータ転送回路200とは略同一
の回路構成になっており、シリアルデータ転送回路10
0、シリアルデータ転送回路200は、それぞれ独立し
た処理回路であり、ASIC等の半導体集積回路などで
構成される。そして、それぞれ、データ送信を行う送信
手段110,210、データ受信を行う受信手段12
0,220、送受信以外の各種の機能を実現するための
別機能回路190,290を備えている。
細な回路構成を説明する。この図1では、シリアルデー
タ転送回路100とシリアルデータ転送回路200とは
同一の回路構成になっている場合を示している。なお、
シリアルデータ転送回路100、シリアルデータ転送回
路200は、それぞれ独立した処理回路であり、ASI
C等の半導体集積回路などで構成される。
部構成について説明する。なお、シリアルデータ転送回
路200については、シリアルデータ転送回路100と
同一構成であるので詳細説明は省略する。
アルデータ転送回路100がテストモード送信側となる
一方の処理回路、シリアルデータ転送回路200がテス
トモード受信側となる他方の処理回路、となっている場
合を例にして説明を行う。
号(RTS)をSREQ端子より送信し、これに対する通信許
可信号(CTS)をSACK端子で相手側より受信した場合
に、送信データ(TxD)をSDATA端子より送信するもので
ある。なお、本実施の形態例の特徴として、テストモー
ド時には送信手段110内のテストデータ送信部111
よりテストデータの送信を行う。
号(RTS)をMREQ端子で受信した場合にこれに対する通
信許可信号(CTS)をMACK端子より送信し、相手側から
の送信データを受信データ(RxD)としてMDATA端子で受
信するものである。なお、本実施の形態例の特徴とし
て、テストモード時には受信手段120内のテストデー
タ比較部121で受信したテストデータの比較を行う。
ド送信側かテストモード受信側かを処理回路に知らせる
ためのモード信号を受けて、その結果を送信手段110
と受信手段120とに伝達する論理回路である。なお、
この実施の形態例では、テストA=Lで通常モード,テ
ストA=Hでテストモードになり、テストA=H,テス
トB=Hでテストモード送信側,テストA=H,テスト
B=Lでテストモード受信側になる。
あり、テストモード時のテストモード送信側では送信手
段110からのテストデータを通信要求信号(RTS)送
出用のSREQ端子に接続された信号線から送信させ、受信
データ(RxD)用の信号線で受信したテストデータを受
信手段120に導く。
あり、テストモード時にはセレクタ141を通過した送
信手段110からのテストデータを通信要求信号(RT
S)送出用のSREQ端子に接続された信号線から送信さ
せ、通常時は送信手段110からの通信要求信号(RT
S)をSREQ端子に接続された信号線から送信させる。
あり、テストモード時には相手の処理回路からの通信許
可信号(CTS)受信用のSACK端子に接続された信号線で
受信されて振り分け用の論理回路162を通過したテス
トデータを、通常時には送信手段110からの送信デー
タ(TxD)を、送信データ(TxD)用のSDATA端子に接続
された信号線から送信させる。この場合、論理回路16
2とセレクタ143が折り返し手段を構成している。
あり、テストモード時には相手の処理回路からの通信要
求信号(RTS)受信用のMREQ端子に接続された信号線で
受信されて振り分け用の論理回路164を通過したテス
トデータを、通常時には受信手段120からの通信許可
信号(CTS)を、通信許可信号(CTS)用のMACK端子に接
続された信号線から送信させる。この場合、論理回路1
64とセレクタ144が折り返し手段を構成している。
トデータと通常時の通信許可信号とを振り分ける論理回
路である。163と164とはテストモード時のテスト
データと通常時の通信要求信号とを振り分ける論理回路
である。151〜156は各端子を通過するデータを増
幅するバッファアンプである。
リアルデータ転送回路200の各セレクタは、請求項に
おける第3切替手段を構成している。なお、以上の各セ
レクタは、印加されるテストAまたはテストBがHの場
合にはH側の入力が出力され、印加されるテストAまた
はテストBがLの場合にはHとは逆の側の入力が出力さ
れるように構成されている。
のエラー検出についての動作説明を行う。ここでは、シ
リアルデータ転送回路100にはテストA=H,テスト
B=Hが印加されることでテストモード送信側に設定さ
れ、シリアルデータ転送回路200にはテストA=H,
テストB=Lが印加されることでテストモード受信側に
設定された場合を考える。
は両入力にHが印加されるため、その出力はHになる。
そして、この論理回路131の出力Hがテストデータ送
信部111に印加されるため、テストデータ送信部11
1はテストデータを出力する。また、この論理回路13
1の出力Hがテストデータ比較部121に印加されるた
め、テストデータ比較部121はテストデータを受信し
た場合には比較を行う準備をしている。
ータは、通常の送信データと同様に送信手段110デー
タ端子から出力される。このテストデータは、セレクタ
141とセレクタ142とを通過し(図3ア)、通信要
求信号送出用のSREQ端子に接続された信号線を経由して
シリアルデータ転送回路200に向かう(図3イ)。
要求信号受信用のMREQ端子に接続された信号線で受信さ
れたテストデータは、アクティブになっている振り分け
用の論理回路264を通過し、セレクタ244で折り返
されて(図3ウ)、通信許可信号用のMACK端子に接続さ
れた信号線から再びシリアルデータ転送回路100に向
けて送信される(図3エ)。
許可信号受信用のSACK端子に接続された信号線で受信さ
れたテストデータは、アクティブになっている振り分け
用の論理回路162を通過し、セレクタ143で折り返
されて(図3オ)、送信データ用のSDATA端子に接続さ
れた信号線から再びシリアルデータ転送回路200に向
けて送信される(図3カ)。
データ用のMDATA端子に接続された信号線で受信された
テストデータは、セレクタ241とセレクタ242とで
折り返されて(図3キ)、通信要求信号用のSREQ端子に
接続された信号線から再びシリアルデータ転送回路10
0に向けて送信される(図3ク)。
要求信号受信用のMREQ端子に接続された信号線で受信さ
れたテストデータは、アクティブになっている振り分け
用の論理回路164を通過し、セレクタ144で折り返
されて(図3ケ)、通信許可信号用のMACK端子に接続さ
れた信号線から再びシリアルデータ転送回路200に向
けて送信される(図3コ)。
許可信号受信用のSACK端子に接続された信号線で受信さ
れたテストデータは、アクティブになっている振り分け
用の論理回路262を通過し、セレクタ243で折り返
されて(図3サ)、送信データ用のSDATA端子に接続さ
れた信号線から再びシリアルデータ転送回路100に向
けて送信される(図3シ)。
データ用のMDATA端子に接続された信号線で受信された
テストデータは、セレクタ241は通過せず、受信手段
120のデータ端子で受信される(図3ス)。
から送信されたテストデータが、シリアル転送に使用さ
れる全ての信号線を循環して再びシリアルデータ転送回
路100に戻ってくる。
おいて、送信手段110から送信したテストデータと、
循環して受信手段120に届いたテストデータとの内容
の比較を行う。
たテストデータと受信したテストデータとが一致すれば
信号線は正常である(異常なし)と判定する。この場合
には、テストモードを終了して通常モードに移行すれば
よい。
かの信号線に異常有りと判定する。なお、異常有りの場
合には、その結果をシステムのCPUや表示手段などに
伝達することが望ましい。
時間計測手段(図示せず)を備えておいて、テストデー
タを送信してから、テストデータを受信するまでの時間
間隔の値により異常検出を行うことも可能である。これ
により、未結線を検出できる。なお、比較結果が一致し
ない場合の異常とテストデータが戻ってこない異常とを
区別してCPUや表示手段に伝達することが望ましい。
るシリアルデータ転送手段を有する二つの信号処理回路
のデータ転送において、その信号線上に異常があるかを
信号線数や部品点数を増やさず、CPUや処理プログラ
ムの負荷を増加させず、また通常動作時の信号線の入出
力の方向を維持したまま、異常を自動検出できる。
をかけず、また、CPUが存在しない処理回路でも容易
にシリアルデータ転送の異常検知が実現可能になる。た
とえば、処理回路をASIC等の集積回路とした場合、
集積回路自体に比較的簡単なテスト回路を搭載すること
で、製品本体のコストアップや部品点数増加はない。
ようなスタートビットとストップビットを備えた1バイ
トデータ、あるいは、ブロック転送(1バイトデータを
数バイトと順番に連続して転送し、この場合は最初の1
バイト目にテストデータであることを示す情報にする)
として、受信したテストデータをテストデータ比較部1
21において偶発的な一致により異常なしとの判断がく
だされないようにすることが望ましい。
て、テストモード送信側とテストモード受信側とを逆に
することも可能である。また、各シリアルデータ転送回
路間の配線数が奇数の場合は、シリアルデータ転送回路
100が送信側になり1往復チェックし、その後シリア
ルデータ転送回路200が送信側になり1往復チェック
すればよい。これにより、2重にチェックする配線が存
在することになるが、奇数の信号線についてもテストが
可能になる。
常が検出されなかった場合に、テストモード送信側とテ
ストモード受信側を入れ替える、ことも望ましい。さら
に、時間計測手段を備え、前記モード設定手段は、前記
時間計測手段の計測結果に基づいて、テストモード送信
側とテストモード受信側を入れ替える、ことも望まし
い。これらの場合、テストモード送信側になる場合に
は、時間計測に一定のマージンを持たせることが望まし
い。
時から一定時間はテストモードの設定を行う、ことが望
ましい。これにより、電源投入のたびに自動的に信号線
のテストが可能になる。そして、一定時間経過後に通常
モードに移行させる。
リアルデータ転送回路200とで電源投入のタイミング
が異なる場合には、テストモード送信側でマージンを考
えて、一定時間経過後にテストデータの送信を開始する
ことが望ましい。
たない場合には、外部に切替指示手段を設けることで対
処することができる。また、以上の各場合に、信号線の
配線が交差していてテストデータ送信部111からの送
信データがテストデータ比較部121に届いてしまう場
合には、異常を検知することができない。このような異
常を検知するためには、テストデータを1往復ずつ順番
にチェックできるような形のセレクタを設ければよい。
この場合には、1往復で異常がなければ、次の1往復、
あるいは最初の1往復と次の1往復とを加えた2往復、
というようにすればよい。
の機器において、複数の処理回路,複数の回路基板,複
数の半導体集積回路などが存在していて、それらの間で
データ転送を行う場合に、配線上のさまざまな検証が可
能になる。
も、送信側のテストデータ比較部に送られてこないこと
になる。受信する際にはスタートビットを検出してから
データを読み取るので、スタートビットがなければ、配
線が切れているなどの配線ミスがあることになる。
のテストデータはテストデータ比較部121に戻ってく
ることになる。よって上述したように1往復ずつチェッ
クするセレクタを設けることにより交差しているという
異常も検出可能になる。
取れないほど鈍ってしまっている(信号劣化)場合、テ
ストモード送信側が自分自身で出力したテストデータを
読み取れなくなり、テストデータ比較部121でエラー
となる。逆に、テストデータ比較部121で一致が確認
できれば、配線上の部品定数は送受信に関して問題ない
範囲であると判断することができる。
な効果が得られる。本発明では、テストモード送信側と
なる一方の処理回路から送信されたテストデータは、テ
ストモード受信側となる他方の処理回路との間で折り返
され、全ての信号線を経由して循環してからテストモー
ド送信側となる一方の処理回路に戻る。
るシリアルデータ転送手段を有する二つの信号処理回路
のデータ転送において、その信号線上に異常があるかを
信号線数や部品点数を増やさず、CPUや処理プログラ
ムの負荷を増加させず、また通常動作時の信号線の入出
力の方向を維持したまま、異常を自動検出できる。
をかけず、また、CPUが存在しない処理回路でも容易
にシリアルデータ転送の異常検知が実現可能になる。た
とえば、処理回路をASIC等の集積回路とした場合、
集積回路自体に比較的簡単なテスト回路を搭載すること
で、製品本体のコストアップや部品点数増加はない。
ステムの構成や接続状態を示す機能ブロック図である。
ステムの構成や接続状態を示す機能ブロック図である。
ステムの動作状態を示す機能ブロック図である。
の様子を模式的に示す説明図である。
Claims (8)
- 【請求項1】 シリアルデータ転送手段として受信手段
と送信手段とをそれぞれ有する第1の処理回路および第
2の処理回路を備え、前記第1の処理回路の送信手段と
前記第2の処理回路の受信手段との間、および、前記第
2の処理回路の送信手段と前記第1の処理回路の受信手
段と間でデータ転送をおこなうシリアルデータ転送シス
テムにおいて、 テストモード送信側となる一方の処理回路に、 送信手段からのテストデータを通信要求信号の信号線か
ら送信させ、受信データの信号線で受信したテストデー
タを前記受信手段に導く第1切替手段と、 通信許可信号の信号線からのテストデータを送信データ
の信号線に折り返し、通信要求信号の信号線からのテス
トデータを通信許可信号の信号線に折り返す第2切替手
段と、 各信号線を循環して受信したテストデータにより異常検
出を行う検出手段と、を設け、 テストモード受信側となる他方の処理回路に、 通信要求信号の信号線からのテストデータを通信許可信
号の信号線に折り返し、受信データの信号線からのテス
トデータを通信要求信号の信号線に折り返し、通信許可
信号の信号線からのテストデータを送信データの信号線
に折り返す第3切替手段、を設ける、ことを特徴とする
シリアルデータ転送システム。 - 【請求項2】 前記検出手段は、送信したテストデータ
と受信したテストデータとの比較により異常検出を行
う、ことを特徴とする請求項1記載のシリアルデータ転
送システム。 - 【請求項3】 前記検出手段は、テストデータを送信し
てから、テストデータを受信するまでの時間間隔により
異常検出を行う、ことを特徴とする請求項1または請求
項2のいずれかに記載のシリアルデータ転送システム。 - 【請求項4】 テストモードに設定するモード設定手段
と、 テストモードに設定されているかを判別するモード判別
手段を備え、 前記モード判別手段の判別結果により、前記第1切替手
段,前記第2切替手段および前記第3切替手段の信号伝
達状態が切り替わる、ことを特徴とする請求項1乃至請
求項3のいずれかに記載のシリアルデータ転送システ
ム。 - 【請求項5】 前記モード設定手段は、システムの電源
投入時から一定時間はテストモードの設定を行う、こと
を特徴とする請求項4記載のシリアルデータ転送システ
ム。 - 【請求項6】 前記モード設定手段は、前記検出手段に
より異常が検出されなかった場合に、テストモード送信
側とテストモード受信側を入れ替える、ことを特徴とす
る請求項1乃至請求項5のいずれかに記載のシリアルデ
ータ転送システム。 - 【請求項7】 時間計測手段を備え、 前記モード設定手段は、前記時間計測手段の計測結果に
基づいて、テストモード送信側とテストモード受信側を
入れ替える、ことを特徴とする請求項1乃至請求項5の
いずれかに記載のシリアルデータ転送システム。 - 【請求項8】 シリアルデータ転送手段として受信手段
と送信手段とをそれぞれ有する第1の処理回路および第
2の処理回路を備え、前記第1の処理回路の送信手段と
前記第2の処理回路の受信手段との間、および、前記第
2の処理回路の送信手段と前記第1の処理回路の受信手
段と間でデータ転送をおこなうシリアルデータ転送シス
テムでの異常を検出する異常検出方法であって、 いずれか一方の処理回路をテストモード送信側、他方の
処理回路をテストモード受信側と設定し、 テストモード送信側では送信手段からのテストデータを
通信要求信号の信号線から送信させ、 テストモード受信側では通信要求信号の信号線からのテ
ストデータを通信許可信号の信号線に折り返し、 テストモード送信側では通信許可信号の信号線からのテ
ストデータをデータの信号線に折り返し、 テストモード受信側ではデータの信号線からのテストデ
ータを通信要求信号の信号線に折り返し、 テストモード送信側では通信要求信号の信号線からのテ
ストデータを通信許可信号の信号線に折り返し、 テストモード受信側では通信許可信号の信号線からのテ
ストデータをデータの信号線に折り返し、 テストモード送信側でデータの信号線で受信したテスト
データを受信手段に導くと共に、送信したテストデータ
と受信したテストデータとの比較により異常検出を行
う、ことを特徴とするシリアルデータ転送システムの異
常検出方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22827499A JP3600480B2 (ja) | 1999-08-12 | 1999-08-12 | シリアルデータ転送システムおよび異常検出方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP22827499A JP3600480B2 (ja) | 1999-08-12 | 1999-08-12 | シリアルデータ転送システムおよび異常検出方法 |
Publications (2)
Publication Number | Publication Date |
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JP2001051912A true JP2001051912A (ja) | 2001-02-23 |
JP3600480B2 JP3600480B2 (ja) | 2004-12-15 |
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ID=16873920
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP22827499A Expired - Fee Related JP3600480B2 (ja) | 1999-08-12 | 1999-08-12 | シリアルデータ転送システムおよび異常検出方法 |
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JP (1) | JP3600480B2 (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
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JP2008310389A (ja) * | 2007-06-12 | 2008-12-25 | Omron Corp | Ioユニット |
JP4869234B2 (ja) * | 2005-08-26 | 2012-02-08 | パナソニック株式会社 | 信号ソース装置 |
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1999
- 1999-08-12 JP JP22827499A patent/JP3600480B2/ja not_active Expired - Fee Related
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Publication number | Priority date | Publication date | Assignee | Title |
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JP4869234B2 (ja) * | 2005-08-26 | 2012-02-08 | パナソニック株式会社 | 信号ソース装置 |
JP2008310389A (ja) * | 2007-06-12 | 2008-12-25 | Omron Corp | Ioユニット |
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JP3600480B2 (ja) | 2004-12-15 |
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