JP2000068320A - 半導体装置、及び、該半導体装置の静電破壊の防止方法 - Google Patents
半導体装置、及び、該半導体装置の静電破壊の防止方法Info
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Abstract
プローブに静電気が帯電している場合に、該静電気が、
半導体装置内部の回路に流れ込まないような構成の電極
パッドを備える半導体装置を提供する。 【解決手段】 本発明の半導体装置は、電極パッドとし
て、平面のパッド部と、該パッド部に接続され、半導体
装置の内部回路に接続されるパターン配線と交差するエ
アーブリッジ部とで構成される電極パッドを備えること
を特徴とする。
Description
半導体装置の電極パッドの構成に関する。
半導体装置100の機能ブロック図である。半導体装置
100は、高周波信号の入力用のRF入力パッド10
1、RF入力パッド101より入力された高周波信号を
処理するRF回路102、電源電圧Vccの入力用のD
Cパッド103、複数のトランジスタで構成されるトラ
ンジスタ回路105、上記DCパッド103より入力さ
れる電源電圧Vccに対して降圧等の処理を施し、処理
後の電源電圧Vccを上記トランジスタ回路105の各
トランジスタのゲートに印加するDC回路104、トラ
ンジスタ回路105から出力される信号に対して所定の
処理を施して高周波信号を出力するRF回路106、及
び、RF回路106より出力される高周波信号の出力用
のRF出力パッド107で構成される。
される前に、テスト装置によって特性テストや動作テス
トが行われる。上記特性テストや動作テストでは、電源
供給用のDCパッド103や高周波信号の入力用のRF
入力パッド101に、テスト装置のプローブを接触さ
せ、該プローブより駆動電圧やテストパターン信号等を
入力し、対応する電極パッド(例えばRF出力パッド1
07)より検出される電流、電圧又は信号を調べる。
置100が備えるRF入力パッド101、DCパッド1
03、又は、RF出力パッド107に対して、テスト装
置131のプローブ130を接触させた状態を示す図で
ある。テスト装置131のプローブ130に静電気が帯
電していると、該プローブ130をRF入力パッド10
1、DCパッド103、又は、RF出力パッド107に
接触させた瞬間に、半導体装置内の回路に大きな電圧が
印加され、トランジスタ等の回路素子が破壊されること
がある。上記の現象は、半導体装置100をリードフレ
ームにワイヤボンディングする際に、ボンディング装置
のキャピラリに静電気が帯電していた場合にも生じる。
ボンディング装置のプローブに静電気が帯電している場
合であっても、内部の回路に静電気が流れ込むことを防
止することのできる構成の電極パッドを備える半導体装
置を提供することである。
置は、1以上の電極パッドを供える半導体装置におい
て、上記電極パッドは、平面のパッド部と、該パッド部
に接続され、所定の間隙をもって半導体装置の内部回路
のパターン配線と交差するエアーブリッジ部とで構成さ
れることを特徴とする。
法は、電極パッドに外部処理装置(テスト装置、ボンデ
ィング装置)の導電性部材(プローブ、キャピラリ)を
接触させる際に、他端の接地されたプローブをパッド部
に接触させるステップと、外部処理装置の導電性部材を
エアーブリッジ部に接触させるステップと、外部処理装
置の導電性部材を押し下げ、エアーブリッジ部をパター
ン配線に接触させるステップと、パッド部に接触させて
いる上記他端の接地されたプローブを引き離すステップ
とからなることを特徴とする。
上の電極パッドを供える半導体装置において、上記電極
パッドは、該半導体装置の内部回路のパターン配線に接
続される平面のパッド部と、アース端子と、上記パッド
部とアース端子を電気的に接続する切断可能な導電体と
で構成されることを特徴とする。
法は、電極パッドに外部処理装置の導電性部材を接触さ
せる際に、外部処理装置の導電性部材をパッド部に接触
させるステップと、パッド部とアース端子を接続してい
る上記導電体を切断するステップとからなることを特徴
とする。
て説明する。図1は、実施の形態1にかかる半導体装置
1の機能ブロック図である。半導体装置1は、高周波信
号の入力用のRF入力パッド2、該RF入力パッド2よ
り入力された高周波信号を処理するRF回路3、電源電
圧Vccの入力用のDCパッド4、複数のトランジスタ
で構成されるトランジスタ回路6、上記DCパッド4よ
り入力される電源電圧Vccに対して降圧等の処理を施
し、処理後の電源電圧Vccを上記トランジスタ回路6
の各トランジスタのゲートに印加するDC回路5、トラ
ンジスタ回路6から出力される信号に対して所定の処理
を施して高周波信号を出力するRF回路7、及び、RF
回路7より出力された高周波信号の出力用のRF出力パ
ッド8で構成される。
4の構成を示す図である。なお、RF入力パッド2、及
び、RF出力パッド8も同じ構成である。図2の(a)
は、基板10上に設けられるDCパッド4の斜視図であ
り、図2の(b)は、(a)に示すDCパッド4のa−
a’断面図である。図2の(a)に示すように、DCパ
ッド4は、DC回路5に接続されているパターン配線2
1上を所定の間隙を保持しつつまたぐエアーブリッジ構
成のエアーブリッジ部23、及び、パッド部22からな
る。なお、DCパッド4及びパターン配線21の素材に
は、金(Au)を用いる。
みbは、約500Åであり、DCパッド4(エアーブリ
ッジ部23及びパッド部22)の厚みcは、約2μmで
あり、該パターン配線21とエアーブリッジ部23との
間隔dは、約10〜20μmである。
成のDCパッド4に対して、外部処理装置の導電性部材
を接触させる方法の一例として、テスト装置のプローブ
を接触させる方法について説明する。 (ステップ1)図3に示すように、他端の接地されたプ
ローブ32をパッド部22に接触させる。 (ステップ2)テスト装置31に他端が接続され、DC
パッド4にテスト用の電源電圧Vccを印加するプロー
ブ30をエアーブリッジ部23に接触させる。これによ
り、プローブ30に帯電していた静電気がプローブ32
を介して放電される。 (ステップ3)プローブ30を基板10側に押し付け、
図4に示すように、エアーブリッジ部23をパターン配
線21に接触させる。これにより、プローブ30とパタ
ーン配線21とが電気的に接続される。 (ステップ4)プローブ32をパッド部22より離す。 以上のステップ1〜ステップ4の手順を実行すること
で、プローブ30に帯電していた静電気を完全に放電し
た後に、DC回路5に接続されているパターン配線21
に接触させることができる。これにより、プローブ30
に帯電していた静電気によって、DC回路5やトランジ
スタ回路6内のトランジスタが破壊されるのを防止する
ことができる。
ブ30から、テスト用の電源電圧Vccの出力を開始し
た後に、プローブ32をパッド部22から引き離すよう
にしても良い。この場合、テスト装置31より出力され
るテスト用の電源電圧Vccのサージ電圧が、半導体装
置の回路内に印加されることを防止することができる。
成のDCパッド4をワイヤボンディングする場合の方法
について説明する。 (ステップ10) 図5に示すように、他端の接地され
たプローブ32をパッド部22に接触させる。 (ステップ11) ボンディング装置のキャピラリ40
をエアーブリッジ部23に接触させる。これにより、キ
ャピラリ40に帯電していた静電気がプローブ32を介
して放電される。 (ステップ12) キャピラリ40を基板10側に押し
下げ、図6の(a)に示すように、エアーブリッジ部2
3をパターン配線21に接触させる。キャピラリ40の
先端のAuボール41に熱又は超音波振動を与え、該A
uボール41、エアーブリッジ部23及びパターン配線
21を溶接する。 (ステップ13) 図6の(b)に示すように、キャピ
ラリ40を上に引き上げ、接続するピン(リードフレー
ム)の方向へ移動させる。Auボール41はエアーブリ
ッジ部23に接続されているため、キャピラリ40の移
動に伴いボンディング装置42内部からAuライン43
が引き出される。 (ステップ14) プローブ32をパッド部22より引
き離す。 以上のステップ10〜ステップ14を実行することで、
キャピラリ40に帯電していた静電気を完全に放電した
後に、キャピラリ40をDC回路5に接続されているパ
ターン配線21に接触させることができる。これによ
り、キャピラリ40に帯電していた静電気が、DC回路
5やトランジスタ回路6を構成するトランジスタ等の回
路素子に流れ込み、該回路素子が破壊されることを防止
することができる。
いて説明する。半導体装置45の機能ブロックの構成
は、上記実施の形態1にかかる半導体装置1と同じであ
る。半導体装置45は、半導体装置1とRF入力パッド
2、DCパッド、及び、RF出力パッド8の構成が異な
る。以下、半導体装置45のDCパッド4の構成を説明
する。なお、半導体装置45におけるRF入力パッド
2、DCパッド、及び、RF出力パッド8の構成は、同
じである。
構成を示す斜視図である。DCパッド4は、DC回路5
に接続されるパターン配線21と電気的に接続された状
態で設けられた平面のパッド部51と、基板50の裏面
のGND端子に接続されるバイアホールを持つアース端
子53と、パッド部51及びアース端子53を電気的に
接続する抵抗であって、レーザにより切断可能な抵抗5
4より構成される。
ディングする方法について説明する。 (ステップ20) キャピラリ40の先端に位置するA
uボール41をパッド部51に接触させる。パッド部4
1は、予めアース端子53に接続されているため、キャ
ピラリ40に帯電していた静電気は、全てアース端子5
3に放電される。 (ステップ21) キャピラリ40の先端のAuボール
41に熱又は超音波振動を与え、該Auボール41とパ
ッド部51を溶接する。 (ステップ22) キャピラリ40を引き上げた後、接
続するピンの方向へ移動させる。この際、Auボール4
1はパッド部51に接続されているため、ボンディング
装置42内部からAuライン43が引き出される。 (ステップ23) ワイヤボンディングの終了後、抵抗
54をレーザにより切断する。 以上のステップ20〜ステップ23を実行することで、
ワイヤボンディングを行う際にキャピラリ40に帯電し
ていた静電気が半導体装置の内部回路に流れ込むことを
防止することができる。これにより、キャピラリ40に
帯電していた静電気によって、DC回路5やトランジス
タ回路6内のトランジスタ等の回路素子が破壊されるこ
とを防止することができる。
ドを構成するパッド部に他端の接地されたプローブを接
触させた後に、エアーブリッジ部に外部処理装置の導電
性部材を接触させ、更に該導電性部材を押し下げてエア
ーブリッジ部とパターン配線を接触させることができ
る。これにより、上記導電性部材に帯電していた静電気
を完全に放電した後に、該導電性部材をパターン配線に
接触させることができ、半導体装置内部の回路に静電気
が流れ込むことを防止することができる。
の防止方法では、電極パッドに外部処理装置の導電性部
材を接触させる際に、上記導電性部材に帯電していた静
電気を完全に放電した後に、該導電性部材をパターン配
線に接触させることができ、半導体装置内部の回路に静
電気が流れ込むことを防止することができる。
を構成するパッド部に外部処理装置の導電性部材を接触
させた後に、切断可能な導電体を切断することで、上記
導電性部材に帯電していた静電気を完全に放電し、半導
体装置内部の回路に静電気が流れ込むことを防止するこ
とができる。
の防止方法では、電極パッドに外部処理装置の導電性部
材を接触させる際に、上記導電性部材に帯電していた静
電気を完全に放電し、半導体装置内部の回路に静電気が
流れ込むことを防止することができる。
ック図である。
す図である。
置によりテストする場合の実施状態を示す図である。
施状態を示す断面図である。
ンディングを施す際の状態を示す図である。
ボンディング実行時における断面図である。
ンディングを施す際の状態を示す図である。
す図である。
スト装置によるテスト実行時の様子を示す図である。
パッド、3,102 RF回路、4,103 DCパッ
ド、5,104 DC回路、6,105 トランジスタ
回路、7,106 RF回路、8,107 RF出力パ
ッド、21 パターン配線、22,51 パッド部、2
3 エアーブリッジ部、30,32,130 プロー
ブ、31,131 テスト装置、40 キャピラリ、4
1 Auボール、53 アース端子
Claims (4)
- 【請求項1】 1以上の電極パッドを供える半導体装置
において、 上記電極パッドは、平面のパッド部と、該パッド部に接
続され、所定の間隙をもって内部回路のパターン配線と
交差するエアーブリッジ部とで構成されることを特徴と
する半導体装置。 - 【請求項2】 請求項1に記載の半導体装置の静電破壊
の防止方法であって、 他端の接地されたプローブをパッド部に接触させるステ
ップと、 外部処理装置の導電性部材をエアーブリッジ部に接触さ
せるステップと、 外部処理装置の導電性部材を押し下げ、エアーブリッジ
部をパターン配線に接触させるステップと、 パッド部に接触させている上記他端の接地されたプロー
ブを引き離すステップとからなることを特徴とする半導
体装置の静電破壊の防止方法。 - 【請求項3】 1以上の電極パッドを供える半導体装置
において、 上記電極パッドは、該半導体装置の内部回路のパターン
配線に接続される平面のパッド部と、アース端子と、上
記パッド部とアース端子を電気的に接続する切断可能な
導電体とで構成されることを特徴とする半導体装置。 - 【請求項4】 請求項3に記載の半導体装置の静電破壊
の防止方法であって、 外部処理装置の導電性部材をパッド部に接触させるステ
ップと、 パッド部とアース端子を接続している上記導電体を切断
するステップとからなることを特徴とする半導体装置の
静電破壊の防止方法。
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JP23869298A JP3769128B2 (ja) | 1998-08-25 | 1998-08-25 | 半導体装置のパターン配線へのワイヤボンディング方法 |
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1998
- 1998-08-25 JP JP23869298A patent/JP3769128B2/ja not_active Expired - Fee Related
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