JP2000004455A - ディスプレイコントロ―ラ及び3次元ディスプレイ並びにクロスト―ク低減方法 - Google Patents
ディスプレイコントロ―ラ及び3次元ディスプレイ並びにクロスト―ク低減方法Info
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Abstract
ターレースを効率的に実現することができて、3D立体
ディスプレイの駆動を簡略化することができる立体ディ
スプレイコントローラを提供する。 【解決手段】 立体ディスプレイコントローラが、複数
の画素を備える走査立体ディスプレイに、シリアル画素
データを供給する。該画素の各々は、M色のコンポーネ
ントのためのイメージデータを有しており、Mは1より
も大きい。この立体ディスプレイコントローラは、N個
のメモリ(Nは1よりも大きい整数)と、3次元イメー
ジのN個の異なるビューに対する該画素データを該それ
ぞれのメモリに書き込み、且つ、次に該メモリの読み出
しを制御して、該ディスプレイの連続的に走査される画
素のイメージデータが該メモリのうちの異なるものから
読み出されるように構成された、メモリコントローラ
と、該メモリの出力に結合され、該色コンポーネントの
少なくとも一つに対して該イメージデータを再配置する
ように構成された、データ再配置回路と、を備える。
Description
トローラ及びこのようなコントローラを含む3次元(3
D)ディスプレイに関する。本発明はまた、例えば3次
元ディスプレイにおける異なるビュー間の、クロストー
クを低減する方法に関する。
バイス(LCD)の画素(ピクセル)のレイアウトを示
す。LCDは、カラーディスプレイに使用され、R、
G、及びBによって示される赤、緑、及び青のピクセル
から構成される。ピクセルは、赤、緑、及び青のピクセ
ルが垂直に並ぶ列Col0からCol5として、配置さ
れる。そこで、ピクセルの最も左の列Col0は、表示
されるイメージの最も左のストリップを表示し、右隣の
列Col1は、イメージの次の列を表示することにな
り、以下も同様である。
なLCDは、3D自動立体ディスプレイを形成するため
に使用され得る。3Dディスプレイは、バックライト2
からの光を調節するための空間光変調器(SLM)とし
て作用するLCD1を備える。視差光学系は、ビューイ
ングウインドウを形成するためにLCD1と協調して動
作する。図2aは、視差光学系が視差バリア3を備える
前面視差バリアタイプの3D自動立体ディスプレイを描
いている。視差バリア3は、参照番号4として示される
ような、垂直に伸び且つ横方向には等間隔で平行に並ぶ
複数のスリットを備えており、各スリットは、個々の色
のピクセル列の一対の中心に位置される。例えば、図2
aの4で示されるスリットは、青ピクセルの列5及び緑
ピクセルの列6に位置合わせされる。
ュー自動立体3Dディスプレイのためのビューイングウ
インドウ構造を示す。LCD1を横切って立体対を形成
する2つのビューを空間的に多重化することによって、
左及び右のビューは、左目が左のビューイングウインド
ウLにあり且つ右目が右のビューイングウインドウRに
あるように観察者が位置する場合に3Dイメージが知覚
されるように、ビューイングウインドウ7において可視
となる。このような位置は、整像位置と称され、図2b
の8、9、及び10に示される。
〜14を示す。観察者がこれらの位置のひとつにいる場
合、左目が右目像を見る一方で右目が左目像を見る。こ
のようなビューイング位置は、避けなければいけない。
配置に確実にあるようにするために、左及び右のイメー
ジデータは、図3に示される方法で、図1に示されるタ
イプのLCDに供給される。左イメージの最も左のスト
リップの色イメージデータは、Col0左で示される
赤、緑、及び青ピクセル列によって表示される。同様
に、右目ビューの最も左のストリップの色データは、C
ol0右で示されるピクセルの列によって表示される。
この配置によって、左及び右のビューのイメージデータ
が、適切な左及び右ビューイングウインドウへ確実に送
られる。この配置はまた、3つのピクセル色R、G、及
びBがすべて、各ビューストリップを表示するために使
用されることを確実にする。このように、図1に示され
るレイアウトと比べて、最も左の列の赤及び青ピクセル
は、左のビューのイメージデータを表示する一方、最も
左の列の緑ピクセルは、右のビューのイメージデータを
表示する。次の列において、赤及び青ピクセルは、右の
ビューのイメージデータを表示する一方、緑ピクセル
は、左のビューのイメージデータを表示する。このよう
に、図1から3に示されたタイプの標準的なLCDを使
用する場合には、RGBピクセルの列間で緑コンポーネ
ントを「交換」しながら、左及び右のビューのイメージ
データをインターレースすることが必要である。当然な
がら、ディスプレイの設定によっては、緑コンポーネン
ト以外に、赤或いは青コンポーネントが交換されてもよ
い。
ュータ)は、標準的なビデオフレーム速度でこのような
インターレースを行い且つ緑(或いは赤或いは青)コン
ポーネントの交換を行うことが、できない。なぜなら、
図1に示される標準的なレイアウトに2次元(2D)の
イメージを表示する場合に比べて、各ピクセルの「書き
込み」動作も変更しなければならないからである。
3Dディスプレイは、英国特許出願第9619097.
0号及び第9702259.4号、欧州特許出願公開公
報第724175号、第696144号、第64592
6号、及び第389842号、並びに米国特許第5,5
53,203号及び第5,264,946号に開示され
る。
る公知のタイプのビデオボードの一部を示す。このよう
なビデオボードの例は、ARM VIDC20 Dat
asheet、Advanced Risc Mach
ines Limited、February 199
5、並びにFuchsら、「Pixel Plane
s:a VLSI−oriented design
for a raster graphic engi
ne」、VLSI Design、thirdquar
ter 1981、pp.20−28、及びHarre
lら、「Graphic rendering arc
hitecture for a high perf
ormance desktop work stat
ion」、Proceedings of ACM S
iggraph conference、1993、p
p.93−100に、開示されている。このような配置
の一般的なレイアウトは、添付の図4aに示される。表
示されるデータは、データバス20上にシリアル形態で
供給され、ピクセルのスクリーンにおける配置を定義す
るアドレスは、アドレスバス21上に供給される。デー
タバス20は、VRAM22及び23のようなランダム
アクセスメモリ(図面に2つ示される)の数個のバンク
の入力に接続される。アドレスバス21は、メモリ管理
システム24に接続される。このメモリ管理システム2
4は、スクリーンアドレスを、メモリ22及び23のア
ドレス入力へ供給されるメモリアドレスに変換する。
チ回路30を介して、ビデオコントローラ26のファー
ストインファーストアウト(FIFO)レジスタ25へ
接続される。ビデオコントローラ26は更に、赤
(R)、緑(G)、青(B)、水平同期(H)、及び垂
直同期(V)信号をディスプレイデバイスへ供給する回
路27を備える。メモリ22及び23、並びにレジスタ
25は、個々のピクセルデータがメモリ22及び23か
ら交互に読み出されて正しい順序で回路27へ供給され
るように、制御される。例えば、回路27は、データを
シリアル化し、且つ、色パレットルックアップテーブル
(LUT)及びデジタル−アナログ変換器(DAC)を
含む。ビデオボードのタイミング信号は、タイミング生
成器28によって生成される。
す。ラッチ回路30は、メモリ22及び23の出力ポー
トにそれぞれ接続されるラッチ40及び41を備える。
ラッチ40及び41の各々は、それぞれのメモリからの
R、G、B、及びAデータをラッチする、8個で1グル
ープとして配置される32個の1ビットラッチを備え
る。8ビットAは、後で説明される。ラッチ40及び4
1は、ラッチイネイブル(latch enable)
入力をまとめて接続して、ラッチイネイブル信号Lを供
給するタイミング生成器28の出力へ接続させる。
グ回路42、43、及び44を備え、そのスイッチング
回路はそれぞれ、制御入力がまとめて接続された8個の
個別のスイッチングエレメントを備える。スイッチング
回路42、43、及び44の制御入力は、まとめて接続
されて、スイッチング信号SWを供給するタイミング生
成器28の出力へ接続される。タイミング生成器28
は、書き込みイネイブル信号Fをレジスタ25へ供給す
る、更なる出力を有する。
イミング図である。これらの信号は、タイミング生成器
28によって、ビデオボードの残りの部分に同期化され
る。
出力ポートで使用可能な場合、ラッチイネイブル信号L
は、例えば時刻t1に示されるようにhighになる。
このようにして、ラッチ40及び41は、表示データを
ラッチする。ラッチイネイブル信号Lが0に戻ったすぐ
後に、スイッチング信号SWは、highレベルに上昇
する。時刻t2で、スイッチング回路42、43、及び
44が図4bに示される状態へ切り換えられ、ラッチ4
0のRGB出力がレジスタ25へ接続されるようにな
る。時刻t3で、書き込みイネイブル信号fがレジスタ
25へ供給され、ラッチ40からのRGBデータがレジ
スタ25へ書き込まれる。時刻t4で、書き込みイネイ
ブル信号Fは、次の書き込みイネイブル信号まで更なる
データがレジスタ25へ書き込まれることを防ぐため
に、使用不可にされる。
wレベルになり、スイッチング回路42、43、及び4
4がラッチ41の出力をレジスタ25へ接続する。更な
る書き込みイネイブル信号Fが時刻t6及びt7の間に
発生して、ラッチ41からのデータがレジスタ25へ書
き込まれる。
生して、処理が繰り返される。このように、データは、
メモリ22及び23から、交互にレジスタ25へ書き込
まれる。
物理的にピクセルに分割され、そして走査されるタイプ
である。隣接するピクセルのイメージデータは、ディス
プレイデバイスに連続して供給され、同様にイメージデ
ータのラインは、連続して供給される。従って、ディス
プレイデバイスによって必要とされるデータ速度は、フ
レーム或いはフィールド速度、フレーム或いはフィール
ド当たりの表示ライン数、及びライン当たりのピクセル
数に依存する。標準的なビデオ速度は、通常1秒当たり
50のインターレースされたフィールドであるが、これ
を超えることができて、例えば1秒当たり70或いは1
00のインターレースされたフィールド、或いはインタ
ーレースされていないフレームというオーダであり得
る。各フレームは、通常600ラインから構成され、通
常1ライン当たり800ピクセルある。各々の色コンポ
ーネントは、通常8ビットで符号化される。従って、デ
ィスプレイデバイスに必要とされる入力シリアルデータ
速度は、利用可能なメモリデバイスの最大出力速度を超
え得る。
使用することによってデータ速度の増大を達成可能にす
る。示された2つのメモリ22及び23を用いると、イ
メージデータをディスプレイデバイスへ供給する最大デ
ータ速度は、各メモリ22及び23が読み出され得る速
度の2倍に、ほとんど等しい。2つのメモリ、或いはメ
モリの2つのバンクが提供され、且つピクセルデータが
メモリ或いはメモリバンクから交互に読まれる場合、添
付の図5に示されるように、イメージデータはメモリ2
2或いは23に格納される。詳細には、偶数ピクセル列
のイメージデータはメモリ22に格納され、奇数ピクセ
ル列のイメージデータはメモリ23に格納される。
ータ速度を増大させるために、同時に読み出されるビデ
オメモリを複数提供することはまた、公知である。これ
らの技術の例は、Pinkhamら、「Video R
AM Excels atFast Graphic
s」、Electronic Design、Augu
st 18、1983、pp.160−172、及びW
hitton、「Memory designed f
or raster graphics displa
ys com”、IEEE Computer Gra
phics and Applications Ma
rch、1984、pp.48−65に、開示される。
ードメモリは、Silicon Graphic社、
「Reality engine in visual
simulation:technical ove
rview」、1992に開示される。この配置におい
て、メモリは、並列のグラフィックスプロセッサの間で
インタリーブされ、そしてプロセッサは、常に隣接のピ
クセルを処理するように配置される。立体イメージは、
左及び右目ビューが各ビデオフレームの交互のフィール
ドを占有するように、時間的に連続してディスプレイに
供給される。
のメモリアレイを使用して空間的に多重化されたイメー
ジを作成する技術を開示する。メモリアレイの2つは、
左及び右目のイメージデータのために使用される。アレ
イの別の2つは、空間変調機能によって処理された初期
イメージをコピーするために使用される。5番目のメモ
リアレイは、空間的に多重化されたイメージを保持す
る。このような配置は、標準的な「フレームバッファ」
配置と比べて、余分なメモリを必要とし、このため更に
もっと高価となり、そして必要となる電力が増大する。
右目のイメージが別々に保存され、いつでも書き換えら
れることを可能にするメモリ配置を有する3Dディスプ
レイを開示する。別々のメモリバンクが、各イメージの
ために使用される。
問題は、クロストークである。クロストークは、2つの
「ビューイングチャンネル」の間で漏れる迷光によって
生成される。これは、ディスプレイデバイスの光学要素
による散乱及び回折を含む、幾つかのファクターの結果
として発生する。その結果、観察者にとっては、右目で
左イメージの幾らかが見え、左目で右イメージの幾らか
が見えることになる。これは、バックグラウンドの中で
は低強度のイメージとして観察され、また、しばしば、
ゴーストイメージと呼ばれる。クロストークが望ましく
ないのは、それが自然現象ではなく、観察者を混乱さ
せ、視覚的なストレスを生じさせるからである。この問
題は、「Reducing Crosstalk Be
tweenStereoscopic Display
s」、SPIE、Vol.2177,pp.92−95
という論文で、論じられている。
ィスプレイで要求される画像インターレースを効率的に
実現することができず、3D立体ディスプレイのために
必要とされる駆動回路が複雑である。また、2つの画像
チャンネル間でのクロストークの影響を十分に抑制する
ことも、困難である。
ものであって、その目的は、(1)3D立体ディスプレ
イの駆動を簡略化することができる立体ディスプレイコ
ントローラを提供すること、(2)上記のような立体デ
ィスプレイコントローラによって駆動され得る3次元デ
ィスプレイデバイスを提供すること、並びに、(3)2
つの画像チャンネル間でのクロストークの影響を十分に
抑制することができるクロストーク低減方法を提供する
こと、である。
れば、複数の画素を備える走査立体ディスプレイにシリ
アル画素データを供給する立体ディスプレイコントロー
ラが提供される。ここで、該画素の各々は、M色のコン
ポーネントのためのイメージデータを有しており、Mは
1よりも大きい。該立体ディスプレイコントローラは、
N個のメモリ(Nは1よりも大きい整数)と、3次元イ
メージのN個の異なるビューに対する該画素データを該
それぞれのメモリに書き込み、且つ、次に該メモリの読
み出しを制御して、該ディスプレイの連続的に走査され
る画素のイメージデータが該メモリのうちの異なるもの
から読み出されるように構成された、メモリコントロー
ラと、該メモリの出力に結合され、該色コンポーネント
の少なくとも一つに対して該イメージデータを再配置す
るように構成された、データ再配置回路と、を備える。
の各画素は、M色のコンポーネントのためのイメージデ
ータを有していてもよく、Mは1よりも大きい。ディス
プレイコントローラは、ディスプレイの連続的に走査さ
れる画素に対して、少なくとも一つの第1の色コンポー
ネントのイメージデータと、第1の色コンポーネントと
は異なる少なくとも一つの第2の色コンポーネントのイ
メージデータとを、同時に供給するデータ再構成回路を
備えていてもよい。Mが3に等しくてもよい。前記少な
くとも一つの第1の色コンポーネントが赤、青、及び緑
の各コンポーネントであって、前記少なくとも一つの第
2の色コンポーネントが該緑コンポーネントであっても
よい。
に書き込まれる前記画素の各々が、前記色コンポーネン
トの一部を備える多ビットワードであるように構成され
ても良い。或いは、前記メモリに書き込まれる前記画素
の各々がコードワードであり、ディスプレイコントロー
ラが、前記データ再配置回路と前記メモリの出力との間
に結合されて、該コードワードを、各々が前記色コンポ
ーネントの一部を備えるそれぞれの多ビットワードに変
換するコードワード変換器を更に備えていてもよい。
配置回路が、前記少なくとも一つの色コンポーネントに
対して前記異なるメモリから読み出された前記画素を交
換するように構成されていてもよい。或いは、前記デー
タ再配置回路が、前記少なくとも一つの色コンポーネン
トに対して前記メモリの各々から読み出された前記画素
を、1ビットだけ遅延させるように構成されていてもよ
い。
ジに対する画素データを前記メモリの対応するメモリ位
置に複製するように構成されていてもよい。
リデバイスを備えていてもよい。
からの出力データを受け取るラッチを更に備えていても
よい。
からの出力データを受け取るファースト・イン・ファー
スト・アウト回路を更に備えていてもよい。
1の局面によるディスプレイコントローラと、複数の画
素列を有する走査立体ディスプレイと、該画素列のうち
のN個の隣接する列にそれぞれ対応している複数の視差
エレメントを有する視差光学系と、を備える3次元ディ
スプレイが提供される。
を備える走査立体ディスプレイに、3次元イメージのN
個の異なるビューに対応するシリアル画素データを供給
する方法であって、第1の色コンポーネントに関連する
画素を、該第1の色コンポーネント以外の他の色コンポ
ーネントの画素に対して、1画素だけ遅延させる遅延ス
テップを包含している方法が、提供される。
て、前記N個のビューに対する前記画素データを、N個
の異なるメモリにそれぞれ書き込むステップと、該メモ
リの各々から走査された画素を連続的に読み出すステッ
プと、が更に含まれ、該遅延ステップがその後に実施さ
れて、該読み出された画素ストリームの各々に対して、
前記第1の色コンポーネントに関連する該画素を遅延さ
せる。
ィスプレイに、3次元イメージのN個の異なるビューに
対応するシリアル画素データを供給する立体ディスプレ
イコントローラであって、第1の色コンポーネントに関
連する画素を、該第1の色コンポーネント以外の他の色
コンポーネントの画素に対して、1画素だけ遅延させる
ように構成されている立体ディスプレイコントローラ
が、提供される。
明の第4の局面によるディスプレイコントローラと、複
数の画素列を有する走査立体ディスプレイと、該画素列
のうちのN個の隣接する列にそれぞれ対応している複数
の視差エレメントを有する視差光学系と、を備える3次
元ディスプレイが、提供される。
のセットによって規定される第1及び第2のイメージの
間のクロストークを低減して、クロストーク補正画素を
生成する方法が提供される。この方法は、該第1のイメ
ージにグレイレベルを加算して第1の合計を形成するス
テップと、該第2のイメージに該グレイレベルを加算し
て第2の合計を形成するステップと、該第1の合計か
ら、該第2のイメージの所与の部分に等しい量を引くス
テップと、該第2の合計から、該第1のイメージの所与
の部分に等しい量を引くステップと、を包含しており、
更に、該第1及び第2のイメージの両方に対する該クロ
ストーク補正画素を決定するために使用される部分結果
を計算するステップを包含する。
するM色コンポーネントを備えており、前記方法は、前
記第1のイメージの前記画素の各々の強度値Ixに対し
て、クロストークが補正された強度レベルIoxを、 Iox=Ix+[K(Im−Ix−Iy−1)/(Im
+1)] 或いは上記関係式の等価な形態によって決定するステッ
プと、前記第2のイメージの前記画素の各々の強度値I
yに対して、クロストークが補正された強度レベルIo
yを、 Ioy=Iy+[K(Im−Ix−Iy−1)/(Im
+1)] 或いは上記関係式の等価な形態によって決定するステッ
プと、を、更に含む。ここで、Kがスカラークロストー
ク補正であり、Imが該色コンポーネント中のスカラー
最大値である。
は、ビットシフト処理を使用して実行される。Kを2の
べき乗に限定することによって、Ioyは、ハードウエ
ア要素を使用して容易に計算され得る。
するために使用される前記部分結果は、K(Im−Ix
−Iy−1)と表現される。
ルデータの垂直のストリップのインターレーシングを可
能にするために、インターリーブされたメモリーバンク
を使用することによって標準ビデオディスプレイシステ
ムを改変して、ディスプレイコントローラを提供するこ
とも可能である。インターレーシングは、個別のピクセ
ルに対するイメージデータがメモリに書き込まれる際に
実行される。メモリからのデータ出力は、例えばフラッ
トパネルディスプレイのために左右のイメージの正確な
インターレーシングを達成するためなど、色コンポーネ
ントの交換を実行するために必要な場合に、処理されて
も良い。
は、広く使用されている多バンクビデオメモリアーキテ
クチュアに単純に付加するだけで、ハードウェアにて実
行され得る。これは、自動立体ディスプレイを駆動する
ために、現存するビデオ回路の設計に僅かな変更しか必
要としないという点で、顕著な商業的な効果を有する。
更に、例えばイメージ生成コンピュータのような余分な
メモリを提供する必要がない。これは、3Dイメージを
生成し表示する既知の構成に比べて、集積回路の数がよ
り少なく、ボードサイズがより小さく、且つ消費電力が
より少ないという結果をもたらす。
は、ソフトウエアでは、最小限の処理時間の増加のみで
実行できる。これより、処理時間及びメモリ容量の実質
的な増加は、必要とされない。
の混合を同時にディスプレイ上に表示することが可能で
ある。
ルゴリズムによってイメージ間のクロストークを低減す
る技術を提供することも、可能である。これより、より
高い画質のイメージが、観察者に与えられる視覚的スト
レスが低減された状態で、及び集積回路数及び消費電力
の実質的な増加を必要とせず、生成されることができ
る。
を備える走査立体ディスプレイにN個の異なるビューに
対する画素データを供給する立体ディスプレイコントロ
ーラであって、該立体ディスプレイのピクセルに対して
マップされたメモリエレメントの2次元アレイを備える
メモリと、各イメージに対する該画素データを該メモリ
エレメントの隣接するブロックに書き込み、且つ、該メ
モリから該画素データを行毎に読み出すように構成され
た、メモリコントローラと、該メモリから読み出された
各行の少なくとも一部を受け取る、少なくとも一つのバ
ッファと、該バッファに含まれる該画素データと、該メ
モリから読み出されたが該バッファに含まれていない他
のデータを再配置して、Nビューがインターレースされ
た画素データのストリームを提供する、第1のデータ再
配置回路と、該画素データのストリームを受け取り、少
なくとも一つの色コンポーネントに対して該画素を再配
置する、第2のデータ再配置回路と、を備える、立体デ
ィスプレイコントローラが提供される。
各イメージに対する前記画素データを、該データが前記
メモリエレメントの隣接する列のセットを占有するよう
に書き込むように構成されている。
バイスを備えている。或いは、しかし、メモリは複数の
メモリデバイスを備えていても良い。
は、前記メモリから読み出された前記画素の行の前半を
記憶するように構成され、前記第1のデータ再配置回路
は、該バッファされた画素データを、該同じ行の後半の
画素データで、該後半の画素データが該メモリから読み
出されている間にインターリーブするように構成されて
いる。
は、各々が前記メモリエレメントの行をフルに記憶する
ように構成されている第1及び第2のバッファを備えて
おり、前記メモリコントローラは、前記画素データの行
を、該第1及び第2のバッファに交互に書き込むように
構成されており、前記第1のデータ再配置回路は、該第
1及び第2のバッファの一つの該画素データを、該デー
タが該第1及び第2のバッファの他方に読み込まれてい
る間にインターリーブするように構成されている。より
好ましくは、前記第1及び第2のバッファの各々は、1
対の半行バッファを備えている。
同じ構成要素を示す。
ラは、任意のタイプ、例えば図3に示されるLCDタイ
プの走査式ディスプレイで使用される。ディスプレイコ
ントローラは、図4aに示されるものと同様のタイプで
あり、公知の行アドレス選択(RAS)及び列アドレス
選択(CAS)信号をメモリ22及び23のアドレス入
力へ提供するように、示されている。コントローラは、
RGB色コンポーネント信号及び表示されるイメージが
2Dにおけるものか或いは3Dにおけるものかを示す
「ステレオ」信号の形態で、データを受け取る。
れたものと、ラッチ回路30の出力が、図6bにより詳
細に示されるように緑色交換回路29を含むという点で
相違する。回路29は、ラッチ40及び41からステレ
オ指示ビットSを受け取るように接続された第1及び2
の入力を有するORゲート45を備える。ゲート45の
出力は、排他ORゲート46の第1の入力へ接続され
る。排他ORゲート46の第2の入力は、タイミング生
成器28からスイッチング信号SWを受け取るように接
続される。
は、まとめて接続され、そして図4bに示されたのと同
じ方法で、スイッチング信号SWを受け取るためにタイ
ミング生成器28の出力へ接続される。しかし、スイッ
チング回路43のスイッチング制御入力は、緑スイッチ
ング信号SWGを受け取るためにゲート46の出力へ接
続される。
へ供給されるアドレス信号は、メモリ22及び23にア
クセスするために必要な行アドレス選択、列アドレス選
択、及び行アドレス信号へ変換される。立体イメージデ
ータが存在する場合、ステレオ指示信号は、図7に示さ
れるように、メモリ22が左目イメージデータを格納
し、メモリ23が右目イメージデータを格納するよう
に、設定される。視差光学系が使用不可とされ得ない3
D自動立体ディスプレイの場合、観察者の両目に対して
表示されなければならない2D或いはモノスコープのデ
ータを書き込むことも、また可能である。この場合、ス
テレオ指示ビットが設定されないとき、モノスコープの
ピクセルデータは、メモリ22及び23における対応す
るメモリ位置に複製される。3Dモードにおいて、左及
び右目のイメージの各々は、ディスプレイデバイスの水
平空間解像度の半分の解像度を有する。2D或いはモノ
スコープモードで動作する場合、2Dイメージは同様
に、ディスプレイデバイスの横方向解像度の半分の解像
度を有する。
なわち、論理レベル0の)場合、ゲート45の出力は、
ゲート46が単にスイッチング信号SWを転送するよう
に論理レベル0である。従って、スイッチング回路42
は同期化され、動作は、前述及び図4cに示される通り
である。
定される場合、ゲート45の出力は、論理レベル1であ
る。従って、ゲート46は、図6cに示されるように、
論理インバータとして機能して、スイッチング信号SW
が緑スイッチング信号SWGを形成するために反転され
る。このように、スイッチング回路42及び44がレジ
スタ25の赤及び青入力をラッチ40の赤及び青出力へ
接続するときは必ず、スイッチング回路43は、レジス
タ25の緑入力をラッチ41の緑入力へ接続する。この
逆も同じである。このように、左且つ緑のコンポーネン
トは、隣接する対のピクセル列の間で交換され、自動立
体ビューが、図3を参照して前述されるように正しく表
示される。
は、2Dイメージが表示される領域において、完全に或
いは選択的に、使用不可にされ得る。この場合、メモリ
22及び23において、ピクセルイメージデータを複製
する必要はない。その代わりに、ディスプレイデバイス
或いはデバイスの関連部分の最大空間解像度は、2Dイ
メージを表示するために使用され得る。
イメージが正しい時刻にラッチ回路30へ供給されるよ
うに、メモリ22及び23の読み出しを制御する。
るピクセルデータの記憶配置は、ディスプレイ全体を占
有する3D自動立体イメージに対して適切である。しか
し、図8に示されたピクセルデータの記憶配置に示され
るように、2D及び3Dイメージを混合することもまた
可能である。この場合、各目に対して半分の幅のイメー
ジを描画しなければいけない、しかし、フルスクリーン
の水平イメージ原点はまた、イメージが半分の幅のスク
リーン上に正確に配置されるために、2で割らなければ
いけない。イメージが最大幅スクリーンに描画される場
合、すべての水平ピクセル座標は、単純に2で割られ得
る。イメージが必要な大きさで描画される場合、ステレ
オ領域の原点がわからなければならず、立体領域を正確
に位置付けるために2で割られる。イメージ内の水平座
標は、イメージが同じ大きさを維持しなければならばい
ことから、影響されてはならない。
スクリーンの大きさが800×600ピクセルであるデ
ィスプレイとともに使用される場合における具体的な例
を説明する。このような配置は、3つのモードの動作、
すなわち2D或いはモノスコープモード、フルスクリー
ン立体モード、及び部分スクリーン立体モードを有し得
る。
リーンの大きさが従来より使用されて、イメージが80
0×600ピクセルのフル領域までの任意の領域に描画
され得る。
トローラは、イメージ表示のためにメモリ22及び23
のひとつ(使用可能なスクリーンメモリの半分)を使用
可能にするように設定される。左のイメージは、一方の
半分(スクリーンの幅の半分)を占有し、これに対し右
のイメージは、他方の半分を占有する。立体イメージを
描画する場合、2つの構成イメージは、それぞれフルイ
メージの幅の半分であり、すなわち左及び右目のイメー
ジは、それぞれ400×600ピクセルを占有するの
で、イメージがインターレースされる場合に最大800
×600ピクセルのスクリーン容量が占有される。
に示されるように、1つ以上のインターレースされた立
体イメージがスクリーン上に表示され、そしてモノスコ
ープのイメージによって囲まれる。スクリーンは、スク
リーンの原点(0、0)がスクリーンの左下の隅にある
ようなカーテシアン座標に対応づけられる。図9では、
スクリーンの一部の上の単一のインターレースされた立
体イメージを、参照番号50にて示す。立体イメージの
水平及び垂直の大きさはSx及びSyで与えられ、立体
イメージの原点(左下の隅)は、スクリーンに対して座
標Ox及びOyを有する。
れた立体イメージの最終の幅の半分の幅で描画される。
また、イメージの原点の水平座標は、図10に示される
各イメージのために使用可能な「より小さいスクリーン
空間」へ適合するように、2で割られなければならな
い。
れる場合、各ピクセルビデオデータは、図11に示され
る形態となり得る。赤(R)、緑(G)、及び青(B)
コンポーネントはそれぞれ8ビットを占有して、スペア
の8ビットAが残される。この「スペア」の8ビット
は、通常は使用されないが、例えば、アルファ情報或い
は他の制御データを保持することがある。しかし、これ
らのビットの1つは、ステレオ指示ビットとなるよう割
り当てられる。
らステレオ指示ビットをディスプレイへ供給するよう変
更された以外は、図6aに示されるタイプと同様である
ディスプレイを示す。このような配置は、ディスプレイ
がピクセルごとに制御されるような、スイッチング可能
な2D/3Dディスプレイに使用される。
13に模式的に示される平面にイメージの赤、緑、及び
青コンポーネントを知覚する。特に、赤及び青コンポー
ネントが、ディスプレイ平面の後にある平面に観察さ
れ、緑コンポーネントは、ディスプレイ平面の前にある
平面に観察される。ディスプレイ平面の間のこの不一致
は、表示されるイメージにわずかながら劣化を起こし得
る。
ンポーネントを赤及び青色コンポーネントに対して1ピ
クセル遅延させることによって、左及び右のイメージの
赤、緑、及び青色コンポーネントが観察者の目に対して
正しい空間位置に表示されることを同時に確実にするこ
とで、解決可能である。当然ながら、他のディスプレイ
構成においては、赤或いは青コンポーネントを遅延させ
得る。
おいて1ピクセルの遅延を生成するハードウェア構成
が、図14のブロック図に示される。図6aのディスプ
レイコントローラと共通の構成要素は、同じ参照符号で
示される。図14のビデオコントローラは、緑色交換回
路29を有さないという点で、図6aのビデオコントロ
ーラと相違する。ラッチ回路30の出力は、FIFOレ
ジスタ25へ直接に提供される。FIFOからの出力を
受け取る回路47及び48は、デジタル・アナログ・コ
ンバータ(DAC)機能(図6aの実施形態においては
オプション)が存在しない点を除けば、図6aの回路2
7に対応する。回路48からのデジタル形態の出力は、
例えばFIFOバッファであり得る緑シフト回路49へ
提供される。回路49は、赤及び青コンポーネントに対
する必要な1ピクセル遅延を、左及び右のイメージ両方
の緑コンポーネントへ導入する。ディスプレイへの入力
がデジタルである必要があると仮定すると、回路49か
らの出力は、デジタル・アナログ・コンバータ50へ渡
される。緑シフト回路49は、より詳細に、図15に示
される。最終の表示は、各々の新しい行の始めにて、適
当な色レベル(例えば、黒)で、ディスプレイバッファ
を初期化することによって、改善され得る。これは、一
つ前の行から最後の緑コンポーネントを使用することよ
り好ましい。
ローラより、複雑なラッチ及び交換回路を必要としない
ので、より簡略化されていると考えられる。緑色コンポ
ーネントへの遅延は、また、コントローラにおいて、任
意の適切な時点で導入され得ると考えられる(すなわ
ち、必ずしもデジタル・アナログ・コンバータ50の直
前である必要はない)。この技術は、別々の各イメージ
に対応するメモリを有するビデオコントローラにおける
使用に、限定されない。
の表示の結果として得られる色コンポーネント奥行き平
面を示す。すべての色コンポーネント、すなわち赤、
緑、及び青が、ディスプレイ平面の直後の同じ平面に表
示されることがわかる。この改善された結果は、一般
に、表示されるすべての立体イメージについてあてはま
る。
る実施形態を説明する。図17に示されるディスプレイ
コントローラは、クロストーク補正部31が3D立体デ
ィスプレイの左目及び右目のイメージの間のクロストー
クを低減するために提供される点で、図6aに示される
コントローラと相違する。クロストーク補正部31は、
メモリ22及び23とビデオコントローラ26との間に
配置される。
ディスプレイにとって望ましいが、有効なクロストーク
低減は、一方のビューからのクロストークが他方のビュ
ーのピクセルに十分に記録されるフラットパネルディス
プレイにおいては、容易に提供され得る。
ラウンドのグレイレベルを上げるための、左右両方のイ
メージの全ピクセルへのグレイベースレベルの付加に基
づいて行われる。グレイ量は、必要なクロストーク補正
の量と同じか、それ以上が好ましい。次に、補正される
べきクロストーク量に対応するある割合の左イメージ
が、右のイメージから引かれる。この逆も同じである。
これにより、バックグラウンドグレイレベル中に、低強
度のネガティブイメージが生じる。補正されたイメージ
が表示される場合、クロストークがネガティブイメージ
を埋めて、均一のバックグラウンドグレイレベルが復元
される。このように、イメージコントラストを犠牲にし
て、クロストークを改善し、これによって知覚される3
Dイメージ品質を改善する。
イの実験的測定によって決定され得る。次に、クロスト
ーク補正ファクターは、システムの中央演算部に接続さ
れた電子バスによって、或いはコントロールノブに接続
されたデータケーブルによって、或いはデータを32ビ
ットピクセルデータのスペアビットAの使用可能なビッ
トへデータを入れることによってなど、種々の方法で設
定され得る。
びこれに対応する右イメージのピクセルについて、より
詳細に以下に説明される。
色ベクトル Io:クロストーク補正された出力色ベクトル C :範囲[0,255]のスカラークロストーク補正 Im:各RGBコンポーネントのスカラー最大値とす
る。
色ピクセルにおいて1色当たり8ビットと仮定すると、
[0,255]の範囲の整数である。
イメージピクセルに加えると、 Ib=Il×[(Im−C)/Im]+C (1) となる。
補正を、左イメージピクセルの新しい値から引くと、 Io=Ib−Ir×C/Im (2) となる。値Ioが、新しい左イメージピクセル色値とし
て出力される。
いて補正するために左イメージの全ピクセルに対して適
用され、且つ、左イメージクロストークについて補正す
るために、右イメージの全ピクセルに対して適用されな
ければいけない。この方法は、ソフトウェアで実施され
てもよく、フラットパネルディスプレイの画質の良好な
改善を提供する。
ハードウェアを実現するにあたって、上記の方法は、整
数の計算のみを使用して行われ得る。これは、浮動小数
点計算部の必要性を排除することによって、ハードウェ
ア構成の複雑さを著しく低減する。
の数を使用することは、著しい利点がある。このため、
入力ピクセル色値は、範囲[0,255]から範囲
[1,256]へ1だけ増加される。このとき、上記の
方法は、以下のように書き換えられる。ここで、Kは、
範囲[1,256]のスカラークロストーク補正であ
る。
ら割算の代わりにビットシフト演算を使用して効率的に
計算され、8ビット分のビットごとの右シフトで計算さ
れる。
は、同様に、 Io=Ir+K×(Im−Il−Ir−1)>>8 (7) と計算される。
わち、部分的な結果K(Im−Il−Ir−1)>>8
は、参照番号32の箇所で計算され、左及び右ピクセル
値Il及びIrに、それぞれ参照番号33及び34の箇
所で加算される。
なわち、K=2n)、Kによる掛算が右シフトに組み込
まれ得るので、計算はより簡単に実施される。この結
果、計算は、加算、引算、及び右シフト演算だけを必要
とする。すなわち: Io=Il+(Im−Il−Ir−1)>>(8−n) (8) となる。
ってすべての計算が行われ、得られる最大の数がほんの
18ビットの符号付きの値であるという利点を有してお
り、このため、ハードウェアの実現時の複雑さが低減さ
れる。
用されるディスプレイが入力値に対し知覚的に線形応答
を有すると仮定しているが、通常は、この仮定が成立す
るとは限らない。従って、例えば、Glassner、
「Principles of Digital Im
age Syntheses」、Morgan Kau
fman、1995、3章、pp.97−100に開示
されるように、通常、ビデオディスプレイ駆動回路にお
いて、ガンマ補正を使用することによって補正される。
上述の方法を使用すると、ガンマ補正は、クロストーク
の補正後に全ピクセルについて適用され得る。或いは、
クロストークの補正前に、補正ファクターKのみに適用
されてもよい。
様のフル色ピクセル値を仮定しているが、常にこの仮定
が成立するとは限らず、あるシステムにおいては、色イ
ンデックスがメモリを節約するために使用される。これ
は、色値の範囲が限定され、且つ、ビデオメモリに記憶
された実際の値が、フル24ビットRGB値を保持する
ルックアップテーブルへのインデックスである場合であ
る。このアプローチを用いて、ピクセル毎に8ビットの
み記憶して、任意のある時刻に、ディスプレイ上に25
6の可能な色を得ることが、よくある。色インデックス
システムに対しては、色交換及びクロストーク補正は、
色インデックスが24ビットRGBディスプレイ駆動値
に復号された後で、行われるべきである。
のピクセルに対応付けられた2D配列のメモリエレメン
トを備える単一のメモリデバイスを有するディスプレイ
コントローラを示す図である。メモリ管理システムは、
左イメージの400×600画素をメモリデバイスの4
00列からなる第1のブロックに書き込み、右イメージ
の400×600画素をメモリデバイスの400列から
なる第2のブロックに書き込むように、構成される。メ
モリのこの割り当ては、メモリへのデータ書き込み効率
の観点から望ましいと考えられる。
モリデバイスから行毎に読み出されるようにする。各行
の最初の半分(すなわち、左イメージの画素)は、半行
バッファに読み出される。行の後の半分(すなわち右イ
メージの画素)がその後にメモリから読み出され、その
画素は、バッファされている画素とインタリーブされ
て、必要とされる左右交互化されたものが得られる。次
に、インタリーブされたデータストリームは、図14の
実施形態のビデオコントローラに対応するビデオコント
ローラへ提供される(或いは、図6aのコントローラが
使用され得る)。
のバッファ配置を示す。このバッファ配置は、メモリデ
バイスから読み出される画素の行を交互に受け取る2対
の半行バッファ52及び53を備える。従って、最初の
行は、第1バッファ対52に読み出され、その後に次の
行は、第2バッファ対53へ読み出される。第1バッフ
ァ対52の内部において、左イメージの画素は、第1の
半行バッファ52aへ読み出され、右イメージの画素
は、第2の半行バッファ52bへ読み出される。半行バ
ッファ52a及び52bに含まれる画素がインタリーブ
されてビデオコントローラへ出力されている間に、次の
行の画素が、半行バッファ53a及び53bへ読み出さ
れる。その後、半行バッファ53a及び53bに含まれ
る画素がインタリーブされてビデオコントローラへ出力
されているときに、次の行の画素が半行バッファ52a
及び52bへ読み出される。
ディスプレイで要求される画像インターレースを効率的
に実現することができて、3D立体ディスプレイの駆動
を簡略化することができる立体ディスプレイコントロー
ラが提供される。また、上記のような立体ディスプレイ
コントローラによって駆動され得る3次元ディスプレイ
デバイスも、あわせて提供される。更に、本発明によれ
ば、2つの画像チャンネル間でのクロストークの影響を
十分に抑制することができるクロストーク低減方法が、
提供される。
示す図である。
横断面図である。
るビューウインドウの形成を示す平面図である。
ある。
ーラのブロック模式図である。
式図である。
示す波形図である。
おけるデータの構成を示す図である。
イコントローラのブロック模式図である。
式図である。
示す波形図である。
おけるデータの構成を示す、図5と同様の図である。
おけるデータの構成を示す、図5と同様の図である。
のディスプレイスクリーンを示す図である。
されるかを示す図である。
れるビデオピクセルデータの可能な配置を示す図であ
る。
イのブロック模式図である。
れる種々の色コンポーネント奥行き平面の模式図であ
る。
プレイコントローラのブロック模式図である。
図である。
色コンポーネント奥行き平面の模式図である。
イコントローラのブロック模式図である。
ロストークを低減する方法を示す図である。
イコントローラのブロック模式図である。
イコントローラのブロック模式図である。
Claims (27)
- 【請求項1】 複数の画素を備える走査立体ディスプレ
イにシリアル画素データを供給する立体ディスプレイコ
ントローラであって、該画素の各々は、M色のコンポー
ネントのためのイメージデータを有しており、Mは1よ
りも大きく、該立体ディスプレイコントローラは、 N個のメモリ(Nは1よりも大きい整数)と、 3次元イメージのN個の異なるビューに対する該画素デ
ータを該それぞれのメモリに書き込み、且つ、次に該メ
モリの読み出しを制御して、該ディスプレイの連続的に
走査される画素のイメージデータが該メモリのうちの異
なるものから読み出されるように構成された、メモリコ
ントローラと、 該メモリの出力に結合され、該色コンポーネントの少な
くとも一つに対して該イメージデータを再配置するよう
に構成された、データ再配置回路と、を備える、立体デ
ィスプレイコントローラ。 - 【請求項2】 Nが2に等しい、請求項1に記載の立体
ディスプレイコントローラ。 - 【請求項3】 Mが3に等しい、請求項1に記載の立体
ディスプレイコントローラ。 - 【請求項4】 前記色コンポーネントが赤、青、及び緑
の各コンポーネントであって、前記少なくとも一つの色
コンポーネントが該緑コンポーネントである、請求項3
に記載の立体ディスプレイコントローラ。 - 【請求項5】 前記メモリに書き込まれる前記画素の各
々が、前記色コンポーネントの一部を備える多ビットワ
ードである、請求項1に記載の立体ディスプレイコント
ローラ。 - 【請求項6】 前記メモリに書き込まれる前記画素の各
々がコードワードであり、 前記データ再配置回路と前記メモリの出力との間に結合
されて、該コードワードを、各々が前記色コンポーネン
トの一部を備えるそれぞれの多ビットワードに変換する
コードワード変換器を更に備える、請求項1に記載の立
体ディスプレイコントローラ。 - 【請求項7】 前記データ再配置回路が、前記少なくと
も一つの色コンポーネントに対して前記異なるメモリか
ら読み出された前記画素を交換するように構成されてい
る、請求項1に記載の立体ディスプレイコントローラ。 - 【請求項8】 前記データ再配置回路が、前記少なくと
も一つの色コンポーネントに対して前記メモリの各々か
ら読み出された前記画素を、1ビットだけ遅延させるよ
うに構成されている、請求項1に記載の立体ディスプレ
イコントローラ。 - 【請求項9】 前記メモリコントローラが、2次元イメ
ージに対する画素データを前記メモリの対応するメモリ
位置に複製するように構成されている、請求項1に記載
の立体ディスプレイコントローラ。 - 【請求項10】 前記メモリの各々は少なくとも1つの
メモリデバイスを備える、請求項1に記載の立体ディス
プレイコントローラ。 - 【請求項11】 前記メモリからの出力データを受け取
るラッチを更に備える、請求項1に記載の立体ディスプ
レイコントローラ。 - 【請求項12】 前記メモリからの出力データを受け取
るファースト・イン・ファースト・アウト回路を更に備
える、請求項1に記載の立体ディスプレイコントロー
ラ。 - 【請求項13】 ディスプレイコントローラと、 複数の画素列を有する走査立体ディスプレイと、 該画素列のうちのN個の隣接する列にそれぞれ対応して
いる複数の視差エレメントを有する視差光学系と、を備
え、該ディスプレイコントローラが、請求項1に記載の
立体ディスプレイコントローラである、3次元ディスプ
レイ。 - 【請求項14】 複数の画素を備える走査立体ディスプ
レイに、3次元イメージのN個の異なるビューに対応す
るシリアル画素データを供給する方法であって、 該方法は、第1の色コンポーネントに関連する画素を、
該第1の色コンポーネント以外の他の色コンポーネント
の画素に対して、1画素だけ遅延させる遅延ステップを
包含している、方法。 - 【請求項15】 前記遅延ステップに先立って、 前記N個のビューに対する前記画素データを、N個の異
なるメモリにそれぞれ書き込むステップと、 該メモリの各々から走査された画素を連続的に読み出す
ステップと、を更に含み、 該遅延ステップがその後に実施されて、該読み出された
画素ストリームの各々に対して、前記第1の色コンポー
ネントに関連する該画素を遅延させる、請求項14に記
載の方法。 - 【請求項16】 走査立体ディスプレイに、3次元イメ
ージのN個の異なるビューに対応するシリアル画素デー
タを供給する立体ディスプレイコントローラであって、 該立体ディスプレイコントローラは、第1の色コンポー
ネントに関連する画素を、該第1の色コンポーネント以
外の他の色コンポーネントの画素に対して、1画素だけ
遅延させるように構成されている、立体ディスプレイコ
ントローラ。 - 【請求項17】 ディスプレイコントローラと、 複数の画素列を有する走査立体ディスプレイと、 該画素列のうちのN個の隣接する列にそれぞれ対応して
いる複数の視差エレメントを有する視差光学系と、を備
え、該ディスプレイコントローラが、請求項16に記載
の立体ディスプレイコントローラである、3次元ディス
プレイ。 - 【請求項18】 各々が画素のセットによって規定され
る第1及び第2のイメージの間のクロストークを低減し
て、クロストーク補正画素を生成する方法であって、該
方法は、 該第1のイメージにグレイレベルを加算して第1の合計
を形成するステップと、 該第2のイメージに該グレイレベルを加算して第2の合
計を形成するステップと、 該第1の合計から、該第2のイメージの所与の部分に等
しい量を引くステップと、 該第2の合計から、該第1のイメージの所与の部分に等
しい量を引くステップと、 を包含しており、 更に、該第1及び第2のイメージの両方に対する該クロ
ストーク補正画素を決定するために使用される部分結果
を計算するステップを包含する、方法。 - 【請求項19】 前記画素の各々は強度値を有するM色
コンポーネントを備えており、前記方法は、 前記第1のイメージの前記画素の各々の強度値Ixに対
して、クロストークが補正された強度レベルIoxを、 Iox=Ix+[K(Im−Ix−Iy−1)/(Im
+1)] 或いは上記関係式の等価な形態によって決定するステッ
プと、 前記第2のイメージの前記画素の各々の強度値Iyに対
して、クロストークが補正された強度レベルIoyを、 Ioy=Iy+[K(Im−Ix−Iy−1)/(Im
+1)] 或いは上記関係式の等価な形態によって決定するステッ
プと、を、更に含み、Kがスカラークロストーク補正で
あり、Imが該色コンポーネント中のスカラー最大値で
ある、請求項18に記載の方法。 - 【請求項20】 前記部分結果は、K(Im−Ix−I
y−1)と表現される、請求項18に記載の方法。 - 【請求項21】 前記クロストークが補正された強度レ
ベルIox及びIoyを計算するための除算処理が、前
記部分結果に対するビットシフト処理を使用して実行さ
れる、請求項20に記載の方法。 - 【請求項22】 複数の画素を備える走査立体ディスプ
レイにN個の異なるビューに対する画素データを供給す
る立体ディスプレイコントローラであって、 該立体ディスプレイのピクセルに対してマップされたメ
モリエレメントの2次元アレイを備えるメモリと、 各イメージに対する該画素データを該メモリエレメント
の隣接するブロックに書き込み、且つ、該メモリから該
画素データを行毎に読み出すように構成された、メモリ
コントローラと、 該メモリから読み出された各行の少なくとも一部を受け
取る、少なくとも一つのバッファと、 該バッファに含まれる該画素データと、該メモリから読
み出されたが該バッファに含まれていない他のデータを
再配置して、Nビューがインターレースされた画素デー
タのストリームを提供する、第1のデータ再配置回路
と、 該画素データのストリームを受け取り、少なくとも一つ
の色コンポーネントに対して該画素を再配置する、第2
のデータ再配置回路と、を備える、立体ディスプレイコ
ントローラ。 - 【請求項23】 前記メモリコントローラが、各イメー
ジに対する前記画素データを、該データが前記メモリエ
レメントの隣接する列のセットを占有するように書き込
むように構成されている、請求項22に記載の立体ディ
スプレイコントローラ。 - 【請求項24】 前記メモリが単一のメモリデバイスを
備えている、請求項22に記載の立体ディスプレイコン
トローラ。 - 【請求項25】 前記バッファは、前記メモリから読み
出された前記画素の行の前半を記憶するように構成さ
れ、 前記第1のデータ再配置回路は、該バッファされた画素
データを、該同じ行の後半の画素データで、該後半の画
素データが該メモリから読み出されている間にインター
リーブするように構成されている、請求項22に記載の
立体ディスプレイコントローラ。 - 【請求項26】 前記バッファは、各々が前記メモリエ
レメントの行をフルに記憶するように構成されている第
1及び第2のバッファを備えており、 前記メモリコントローラは、前記画素データの行を、該
第1及び第2のバッファに交互に書き込むように構成さ
れており、 前記第1のデータ再配置回路は、該第1及び第2のバッ
ファの一つの該画素データを、該データが該第1及び第
2のバッファの他方に読み込まれている間にインターリ
ーブするように構成されている、請求項22に記載の立
体ディスプレイコントローラ。 - 【請求項27】 前記第1及び第2のバッファの各々
は、1対の半行バッファを備えている、請求項26に記
載の立体ディスプレイコントローラ。
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