FR2583925A1 - Semi-conducteur a plot de metallisation de structure perfectionnee, et procede de realisation d'un tel plot - Google Patents

Semi-conducteur a plot de metallisation de structure perfectionnee, et procede de realisation d'un tel plot Download PDF

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Hem P Takiar
Divyesh P Shah
Jagdish G Belani
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National Semiconductor Corp
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National Semiconductor Corp
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Abstract

STRUCTURE DE PLOT DE METALLISATION POUR DISPOSITIFS SEMI-CONDUCTEURS. ELLE COMPREND DES COUCHES D'ALUMINIUM 10, DE NICKEL 22 ET DE CUIVRE 24 DEPOSEES DIRECTEMENT PAR-DESSUS UN PLOT DE METALLISATION EN ALUMINIUM COURANT 12. LA COUCHE DE NICKEL S'OPPOSE A LA MIGRATION DE CUIVRE AU SEIN DU COUSSIN DE METALLISATION EN ALUMINIUM SOUS-JACENT, TANDIS QUE LA COUCHE D'ALUMINIUM SUPPLEMENTAIRE S'OPPOSE A LA MIGRATION TANT DE NICKEL QUE DE CUIVRE VERS L'INTERIEUR DU SUBSTRAT 10 DU DISPOSITIF.

Description

La présente invention a trait d'une manière généra-
le à la liaison par ruban automatisée entre des plots de métal-
lisation sur des dispositifs semi-conducteurs et des cadres de connecteurs pour ces dispositifs. Plus particulièrement, l'invention a trait à une structure de plot de métallisation originale, intéressante pour la liaison à du ruban bosselé en cuivre et qui utilise une couche d'arrêt en nickel pour empêcher la migration de cuivre depuis le ruban jusqu'au
sein de l'aluminium de métallisation sous-jacente.
La liaison automatisée au ruban adhésif est une méthode pour la connexion simultanée d'une série de plots de
métallisation sur un dispositif semi-conducteur à des connec-
teurs correspondants sur le cadre de connecteurs sur lequel le dispositif doit être monté. Les plots de métallisation constituent les bornes d'entrée et de sortie du dispositif semi-conducteur et il faut les relier à des connecteurs
individuels présents sur le cadre de connecteurs pour facili-
ter la connexion du dispositif à des plaquettes de circuits
imprimés et analogues. On effectue la liaison par ruban auto-
matisée en utilisant un ruban métallique, typiquement ruban
de cuivre mince, dans lequel sont façonnés de courts connec-
teurs ou barrettes de connexion. En alignant le ruban avec le
dispositif semi-conducteur, on peut lier les extrémités inté-
rieures des connecteurs aux plots de métallisation du dispo-
sitif semi-conducteur en une seule opération de compression, typiquement compression thermique. Une fois les connexions d'extrémités intérieures réalisées, le dispositif est monté sur le cadre de connecteurs, les liaisons extérieures entre les extrémités extérieures des barrettes et les cadres de
connecteurs réalisées et l'excès de ruban est coupé.
La réalisation des liaisons des connecteurs inté-
rieurs exige qu'une saillie ou bosse soit façonnée soit sur le ruban soit sur le plot de métallisation. Cette bosse sert
à fournir le métal nécessaire pour réaliser la liaison, ain-
si qu'à ménager la distance ou décalage nécessaire entre la barrette de connexion et la pastille semi-conducteur. La présente invention a trait à l'utilisation de ruban bosselé dont les bosses sont façonnées sur les conducteurs intérieurs
des barrettes de connexion.
Lorsqu'on utilise du ruban de cuivre bosselé, il est nécessaire d'empêcher ou d'inhiber la migration de cuivre depuis le ruban jusque dans l'aluminium de métallisation du semi-conducteur. De plus, il est nécessaire de prévoir une structure permettant au ruban de se lier au coussin de métal-
lisation en aluminium. Jusqu'à présent, on empêchait la migra-
tion de cuivre dans l'aluminium de métallisation à l'aide d'une couche d'arrêt en tungstène-titane interposée entre le ruban en cuivre et l'aluminium. Certes, cette solution est possible, mais il serait souhaitable d'éviter le dépôt de la
couche d'arrêt en tungstène-titane.
Il serait souhaitable de proposer des variantes
de procédés et de structures de métallisation de nature à fa-
ciliter la réalisation des liaisons des connecteurs intérieurs lorsqu'on utilise du ruban bosselé en cuivre. En particulier,
il serait souhaitable de proposer de tels procédés et struc-
tures qui éviteraient la nécessité d'utiliser des couches
d'arrêt en titane-tungstène au-dessus du plot de métallisa-
tion. La présente invention propose une structure de
plot de métallisation originale comprenant trois couches mé-
talliques déposées successivement par-dessus un plot de métal-
lisation en aluminium. Cette structure à trois couches permet de lier les connecteurs intérieurs de ruban en cuivre bosselé
à une pastille semi-conductrice, tout en inhibant la migra-
tion des métaux des couches au sein du plot de métallisation
en aluminium.
On réalise la structure de plot de métallisation par dépôts sucessifs de couches d'aluminium, de nickel et de cuivre sur le plot de métallisation en aluminium. La couche
d'aluminium adhère fortement au plot de métallisation sous-
jacent et est appliquée sur une épaisseur pour que les cou-
ches métalliques la recouvrant ne pénètrent pas dans le subs-
trat en silicium. La couche de nickel est appliquée en tant que couche intermédiaire entre l'aluminium et la couche de cuivre le recouvrant. La couche de nickel forme un alliage
nickel-aluminium stable à l'interface avec la couche d'alu-
minium. On peut ensuite appliquer directement la couche de
cuivre par-dessus la couche de nickel par dépôt par pulvéri-
sation, en formant pareillement un alliage cuivre-nickel sta-
ble à l'interface. Dans la structure résultante, la couche de nickel agit en couche d'arrêt bloquant la migration de
cuivre au sein de l'aluminium de métallisation.
On va maintenant décrire la réalisation préférée
de l'invention en se référant aux dessins annexés, sur les-
quels: la figure 1 représente un plot de métallisation
recouvert d'une paire de couches isolantes avant la réalisa-
tion de la structure de coussin de métallisation selon la présente invention; la figure 2 représente le plot de métallisation selon la figure 1 après qu'on ait ménagé par gravure dans les couches isolantes un trou d'accès au plot de métallisation; la figure 3 représente le plot de métallisation
dénudé selon la figure 2 après application sucessive de cou-
ches d'aluminium, de nickel et de cuivre; la figure 4 représente la structure de coussin de
métallisation selon la figure 3, comportant en outre une cou-
che de photomasque la recouvrant;
la figure 5 représente la structure selon la fi-
gure 4, dans laquelle on a exposé et développé la couche de photomasque pour éliminer toutes les zones autres que celle recouvrant le plot de métallisation; la figure 6 représente la structure finale de plot de métallisation selon la présente invention, façonnée par gravure des couches de cuivre, de nickel et d'aluminium et
dépouillement de l'agent photo-résistant.
L'invention propose une structure de plots de métal-
lisation en aluminium prévue pour la liaison automatisée avec
du ruban bosselé en cuivre. La structure de plot de métallisa-
tion comprend trois couches métalliques déposées successive-
ment par-dessus le plot de métallisation en aluminium dénudé
pour constituer une structure convenable pour la liaison direc-
te par compression thermique au ruban de cuivre bosselé. D'abord on applique directement une couche d'aluminium sur le plot
de métallisation en aluminium sous-jacent. La couche d'alumi-
nium est d'épaisseur suffisante pour inhiber la migration des métaux ultérieurement déposés à l'intérieur du substrat en
silicium sous-jacent. Une couche de nickel est ensuite appli-
quée directement sur la couche en aluminium, formant à l'in-
terface un alliage nickel-aluminium. Le nickel adhère forte-
ment à l'aluminium sous-jacent, formant un alliage nickel-
aluminium stable à l'interface. Enfin une couche de cuivre
est appliquée directement par-dessus la couche de nickel,for-
mant un alliage cuivre-nickel stable à l'interface. Le cuivre peut être lié directement au ruban bosselé en cuivre pour
constituer les liaisons intérieures des connecteurs.
On va maintenant décrire en détail, en se référant aux figures 1 à 6, le processus de réalisation des -tructures de plot de métallisation selon la présente invention. La figure 1 représente un substrat semi-conducteur 10 comportant sur sa surface un plot de métallisation aluminium 12. Des couches isolantes 14 et 16 ont été formées de manière courante sur
le coussin de métallisation 12. En vue de réaliser la struc-
ture de plot de métallisation selon la présente invention,
il est d'abord nécessaire de ménager un trou d'accès à tra-
vers les couches isolantes 14 et 16. On peut adopter des techniques photolithographiques courantes pour ménager le
trou d'accès 18, comme représenté sur la figure 2.
Après avoir ménagé le trou d'accès 18, on peut
former une couche d'aluminium 20 (figure 3) recouvrant direc-
tement le coussin de métallisation en aluminium 12 et recou-
vrant aussi la couche isolante 16. L'épaisseur de la couche d'aluminium n'est pas critique, mais doit être suffisante
pour s'opposer à la migration du nickel et du cuivre à appli-
quer lors d'opérations ultérieures. La couche d'aluminium a
typiquement une épaisseur d'au moins 200 nm, plus typique-
ment de 200 à 600 nm et usuellement d'environ 400 nm. Attendu que la couche d'aluminium est appliquée directement sur le
coussin de métallisation en aluminium 12, on peut l'appli-
quer par pulvérisation et vaporisation ou autres courantes.
L'application d'aluminium a l'avantage qu'il est inutile d'éliminer la pellicule d'oxyde d'aluminium qui se formerait
sur le plot de métallisation en aluminium.
Après dépôt de la couche d'aluminium 20, on dé-
pose directement par-dessus celle-ci une couche de nickel 22.
La couche de nickel 22 est déposée par des méthodes courantes, typiquement par pulvérisation sous vide, et forme un alliage
nickel-aluminium à l'interface entre les couches 20 et 22.
L'épaisseur de la couche de nickel est suffisante pour empê-
cher la migration de cuivre dans l'aluminium, étant usuelle-
ment d'environ 200 nm, plus couramment comprise entre 200 et
500 nm et habituellement d'environ 300 nm.
La couche de cuivre 24 est déposée ensuite par pulvérisation sous vide sur une épaisseur d'au moins 400 nm, usuellement comprise entre 400 et 1 500 nm environ et plus habituellement d'environ 800 nm. La couche de cuivre sert à assurer la liaison directe avec le ruban bosselé en cuivre
de manière courante.
Après avoir appliqué les trois couches métalliques , 22 et 24 de la structure de plot de métallisation, on
applique une couche de photomasque 26 (figure 4) sur le dis-
positif semi-conducteur. Le photomasque sert à définir les limites de la structure de coussin de métallisation. D'abord on expose le photomasque et on le développe de façon qu'il soit éliminé de la majeure partie de l'aire du dispositif semi-conducteur, mais subsiste sur le plot de métallisation,
comme représenté sur la figure 5. On attaque ensuite les cou-
ches de cuivre 22 et de nickel 24 dans un agent d'attaque chimique tel qu'acide nitrique et peroxyde d'hydrogène, puis on attaque l'aluminium dans un mélange d'acides phosphorique
et acétique. L'attaque se poursuit jusqu'à ce que les cou-
ches métalliques soient sensiblement éliminées sur toute l'aire du dispositif semi-conducteur sous réserve des zones situées au-dessus des plots de métallisation 12 qui sont
protégées par des coiffes de photomasque 26a. On élimine en-
suite les coiffes de photomasque 26a et l'on décape le cui-
vre dans un acide organique doux, tel qu'acide citrique, pen-
dant un temps bref, typiquement d'environ 1 minute. La struc-
ture résultante est représentée sur la figure 6.
Généralement, il est souhaitable de déposer une
mince couche d'or sur l'ensemble du dispositif semi-conduc-
teur, en utilisant typiquement une solution de dorure par déplacement telle que bain de cyanure d'or, pendant un temps bref, typiquement d'environ 5 minutes. La couche d'or est relativement mince, ayant typiquement une épaisseur de 20 à
nm, habituellement d'environ 50 nm. Le dispositif semi-
conducteur est alors dans l'état voulu pour être lié aux con-
ducteurs intérieurs d'un ruban bosselé en cuivre, d'une ma-
nière courante.
Bien que l'invention précédente ait été décrite de façon détaillée dans un but d'illustration et d'exemple en vue de faciliter la compréhension, il est évident que l'on pourra mettre en oeuvre divers changements et modifications
dans la portée des revendications.

Claims (17)

REVENDICATIONS
1. Dispositif semi-conducteur caractérisé en ce
qu'il comporte au moins une structure de plot de métallisa-
tion comprenant un plot de métallisation en aluminium (12), une couche d'aluminium (20) déposée directement par-dessus le plot de métallisation en aluminium, une couche de nickel (22) déposée directement par-dessus la couche d'aluminium, pour former un alliage aluminium-nickel stable à interface, par pulvérisation sous vide et une couche de cuivre (24) déposée par-dessus la couche de nickel pour permettre la liaison avec
du ruban de liaison en cuivre.
2. Dispositif semi-conducteur selon la revendica-
tion 1, caractérisé en ce que la couche d'aluminium a une
épaisseur comprise entre 200 et 600 nm environ.
3. Dispositif semi-conducteur selon la revendica-
tion 1, caractérisé en ce que la couche de nickel a une épais-
seur comprise entre 200 et 500 nm environ.
4. Dispositif semi-conducteur selon la revendica-
tion 1, caractérisé en ce que la couche de cuivre a une épais-
seur comprise entre 400 et 1 500 nm environ.
5. Dispositif semi-conducteur selon la revendica-
tion 1, caractérisé en ce qu'il comporte en outre une couche
d'or déposée par-dessus la structure de plot de métallisa-
tion.
6. Dispositif semi-conducteur selon la revendica-
tion 5, caractérisé en ce que la couche d'or a une épaisseur
comprise entre 20 et 100 nm environ.
7. Dispositif semi-conducteur selon la revendica-
tion 6, caractérisé en ce que la couche d'or est déposée par
dépôt par déplacement.
8. Procédé de réalisation d'une structure de liai-
son sur un plot de métallisation en aluminium, ladite struc-
ture étant susceptible de liaison à un ruban bosselé en cui-
vre, caractérisé en ce qu'il comprend: l'application directe d'une couche d'aluminium par-dessus le plot de métallisation en aluminium;
l'application directe d'une couche de nickel par-
dessus la couche d'aluminium; et
l'application directe d'une couche de cuivre par-
dessus la couche de nickel.
9. Procédé selon la revendication 8, caractérisé en ce qu'on applique la couche d'aluminium sur une épaisseur
comprise entre 200 et 600 nm environ.
10. Procédé selon la revendication 8, en ce qu'on applique la couche de nickel sur une
comprise entre 200 et 500 nm.
11. Procédé selon la revendication 8, en ce qu'on applique la couche de cuivre sur une
comprise entre 400 et 1 500 nm.
12. Procédé selon la revendication 8, caractérisé épaisseur caractérisé épaisseur caractérisé
en ce qu'on applique en outre une couche d'or sur le dispo-
sitif semi-conducteur après dépôt de la couche de cuivre.
13. Procédé selon la revendication 12, caractérisé
en ce qu'on applique la couche d'or sur une épaisseur com-
prise entre 20 et 100 nm environ.
14. Procédé selon la revendication 12, caractérisé
en ce qu'on applique l'or par dépôt par déplacement.
15. Procédé selon la revendication 8, caractérisé en ce qu'on applique la couche d'aluminium par pulvérisation
sous vide.
16. Procédé selon la revendication 8, caractérisé en ce qu'on applique la couche de nickel par pulvérisation
sous vide.
17. Procédé selon la revendication 8, caractérisé en ce qu'on applique la couche de cuivre par pulvérisation
sous vide.
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
NL143369B (nl) * 1967-01-26 1974-09-16 Philips Nv Werkwijze voor het aanbrengen van een elektrische aansluiting op een oppervlak van een halfgeleiderinrichting en halfgeleiderinrichting verkregen volgens deze werkwijze.
US4182781A (en) * 1977-09-21 1980-01-08 Texas Instruments Incorporated Low cost method for forming elevated metal bumps on integrated circuit bodies employing an aluminum/palladium metallization base for electroless plating

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