FI74158B - Kopplingsanordning foer givande av styrorder i ett mikrocomputersystem. - Google Patents
Kopplingsanordning foer givande av styrorder i ett mikrocomputersystem. Download PDFInfo
- Publication number
- FI74158B FI74158B FI820595A FI820595A FI74158B FI 74158 B FI74158 B FI 74158B FI 820595 A FI820595 A FI 820595A FI 820595 A FI820595 A FI 820595A FI 74158 B FI74158 B FI 74158B
- Authority
- FI
- Finland
- Prior art keywords
- input
- output
- line
- memory
- dma
- Prior art date
Links
Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B66—HOISTING; LIFTING; HAULING
- B66B—ELEVATORS; ESCALATORS OR MOVING WALKWAYS
- B66B1/00—Control systems of elevators in general
- B66B1/34—Details, e.g. call counting devices, data transmission from car to control system, devices giving information to the control system
- B66B1/46—Adaptations of switches or switchgear
- B66B1/468—Call registering systems
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/14—Handling requests for interconnection or transfer
- G06F13/20—Handling requests for interconnection or transfer for access to input/output bus
- G06F13/24—Handling requests for interconnection or transfer for access to input/output bus using interrupt
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/14—Handling requests for interconnection or transfer
- G06F13/20—Handling requests for interconnection or transfer for access to input/output bus
- G06F13/32—Handling requests for interconnection or transfer for access to input/output bus using combination of interrupt and burst mode transfer
Landscapes
- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Automation & Control Theory (AREA)
- Computer Networks & Wireless Communication (AREA)
- Bus Control (AREA)
- Selective Calling Equipment (AREA)
- Communication Control (AREA)
- Microcomputers (AREA)
- Electrophonic Musical Instruments (AREA)
- Rear-View Mirror Devices That Are Mounted On The Exterior Of The Vehicle (AREA)
- Medicines Containing Material From Animals Or Micro-Organisms (AREA)
- Enzymes And Modification Thereof (AREA)
Description
1 74158
Kytkinlaite ohjauskäskyjen antamiseksi mikrotietokonesystee-missä. - Kopplingsanordning för givande av styrorder i ett mikrocomputersystem.
Edellä olevan keksinnön kohteena on kytkinlaite ohjauskäskyjen antamiseksi mikrotietokonesysteemissä, jolloin mikrotietokone on liitetty osoite-, tieto- ja ohjainväylällä ainakin yhteen kirjoitus-lukumuistiin ja vakioarvomuistiin sekä osoiteväylällä, tulo-lähtöväylällä ja lisäjohtimilla rinak-kaiseen tulo-lähtö-liitososaan, patenttivaatimuksen 1 johdanto-osassa esitetyllä tavalla.
Tietojen siirtämiseksi mikrotietokonesysteemin ja ympäristön välillä on kehitetty erilaisia menetelmiä. Niinpä esim. ohjelmoidussa tulolähdössä ohjataan tietojen siirtoa systeemin mikroprosessorin suorittamalla ohjelmalla. Tällöin on osoittautunut haitalliseksi, että oheislaitteiden lisääntyessä myös softwarekulutus kasvaa, ja että prosessorin on tunnusteltava ulkopuolta kulloisenkin tarpeen mukaan enemmän tai vähemmän olemassaolevien tietojen tai ohjauskäskyjen vuoksi, jolloin haaskataan muihin tehtäviin käytettävää aikaa.
Eräässä toisessa tunnetussa menetelmässä, keskeytys-(interrupt-) menetelmässä näiltä varjopuolilta vältytään osaksi. Tällöin on tavallista, lisääntyvien tietojen tai ohjauskäskyjen kyseen ollessa, antaa systeemin mikroprosessorille keskeytysvaatimus, minkä jälkeen prosessori sen hyväksymisen jälkeen katkaisee kulussa olevan ohjelman, välivarastoi rekisterisisällön ja vastaanottaa keskeytysohjelmalla uudet, ympäristöstä tulleet tiedot sekä käsittelee ne, ja kes-keytysohjelman jälkeen pääohjelma jatkuu. Jos saatavilla on enemmälti oheislaitteita ja samalla vaaditaan useampia keskeytyksiä ratkaistaan prioriteettilogiikan avulla tietojen tulon ja käsittelyn järjestys.
Siten tunnetuissa mikrotietokonesysteemeissä käytetään kes- 2 74158 keytysprioriteettirakenneosia, jotka samalla soveltuvat rinnakkaiseen tietojen tuloon ja lähtöön. Sellainen kaupan oleva rakenneosa, esim. Texasin TMS9901 (Käyttäjän käsikirja TM 990/100M, syyskuu 1977), käsittää liitäntäkohdassaan ympäristöön kuusitoista keskeytystuloa ja muut tulo-lähdöt rinnakkaisille tiedoille. Liitäntäkohdassaan mikroprosessoriin rakenneosassa on yksi keskeytyslähtö ja neljä osoitelähtöä sekä muita prosessorin kanssa liikennöintiin vaadittavia tulo-lähtöjä. Keskeytysvaatimusten esiintyessä määrittelee sisäinen prioriteettilogiikka keskeytyssignaalien prioriteetin ja muodostaa korkeimmalle prioriteetille kuuluvat osoitteet sekä keskeytyksen mikroprosessorille.
Eräs keskeytysmenetelmään liittyvä varjopuoli on se, että mikroprosessori pakotetaan keskeyttämään ajettava toiminta ja vetäytymään sivuun.
Tällöin voidaan, käytettäessä edelläkuvattuja rakenneosia, keskeyttää ajettava keskeytysohjelma yhdellä tai useammalla tulevalla suurempiprioriteettisella keskeytyksellä. Siitä aiheutuva keskeytysohjelmien kerrostuminen vaatii lisää prosessoriaikaa. Lisähaitta on suhteellisen rajoitettu keskey-tystulojen lukumäärä niin, että tulevien ohjauskäskyjen lisääntyessä keskeytysten lisääntymän täytyy tapahtua kahden rakenneosan peräkkäin liittämisellä. Se vaatii kuitenkin lisää softwaren kulutusta ja vastaavasti enemmän prosessoriaikaa .
Eräässä patenttijulkaisusta US-A-4219881 tunnetuksi tulleessa syöttölaitteessa 16-bittistä syöttökanavaa varten informaatio johdetaan syöttölogiikkapiiriin, joka on ulosmenopuolellaan liitetty D-flip-flopien tietojen tuloihin ja kulloinkin syöttölogiikkapiiriin ja D-flip-flopeihin yhdistetettyihin ehdollisten tai-elimien sisäänmenoon. D-flip-flopin lähdöt on kytketty ehdollisten tai-elimien toisiin tuloihin, joiden I.
3 74158 lähdöt on kytketty toisiinsa. D-flip-flopien lähdöt on sitäpaitsi yhdistetty kulloinkin rinnalle liitetyn NAND-elimien tuloihin, joiden toiset tulot on liitetty toisiinsa ja joiden lähdöt on kytketty syöttöväylän tietojohtimeen. Syöttölaite toimii sillä tavoin, että D-flip-flopeihin talletettuja tietoja verrataan ehdollisen tai-elimen avulla syöttölogiikka-piirin lähdöissä tai D-flip-flopien tuloissa esillä oleviin tietoihin. Näiden tietojen poiketessa toisistaan vähintään bitin verran muuttuu ehdollisen tai-elimen lähtöön liitetyn johtimen signaalitila, jolloin mikroprosessorin antaman kyse-lysignaalin esiintyessä tuotetaan keskeytysvaatimus. Tämän hyväksymisen jälkeen mikroprosessori antaa syöttökanavalle osoitteen, jolloin D-flip-flopit tahdistetaan ja niiden tulo-tilat talletetaan. Osoitteen antamisen yhteydessä NAND-elimien toisiin tuloihin liitetyt johtimet aktivoituvat, jolloin mikroprosessorista lähtevän lukusignaalin esiintyessä uusi 16-bittinen tietosana voidaan siirtää lukukirjoitusmuis-tiin syöttöväylän kautta.
Käytettäessä tämän kaltaista syöttölaitteistoa järjestelmässä jossa on useampi yksi- tai useampibittinen syöttökanava täytyy kunkin kanavan sisältää keskeytysvaatimusjohdin mikroprosessoriin, jolloin tunnistamisen jälkeen esillä oleva kanava täytyy varustaa osoitteella mikroprosessorista tulevan tieto-jensyötön vuoksi. Sivulla 2 toisessa ehjässä kappaleessa mainittu haittojen lisäksi vaatii tämä menetelmä lisää softwarea ja syöttökanavien lukumäärän mukaan myös enemmän tietokoneaikaa. Lisäksi tarvitaan bittiä kohden ehdollinen tai-elin mikä johtaa tietosanan pituuden ja syöttökanavien lukumäärän mukaan lisääntyneeseen kytkimen käyttöön.
Julkaisussa "Electronics, May 26, 1977, sivut 112-113" kuvaillaan tietojen syöttölaite, missä 16 tulolla varustettu multiplekseri on lähtöpuolellaan liitetty 16-bittisen puskurimuistin sarjasisäänmenoon. 16-bittisen puskurimuistin 4 74158 sarjasisäänmeno samoinkuin lähtö on kytketty komparaattoriin, jonka lähtö on liittetty liitoselimen keskeytysvaatimussi-sääntuloon. Kun multiplekserin sisäänmenoon jonottavat tiedot tulee syöttää, siirtää mikroprosessori tiedot 16 lukuoperaa-tiossa puskurimuistiin. Tämän jälkeen vertaillaan puskuri-muistin sarjasisäänmenossa ja sarjalähdössä jonottavia tietoja toisiinsa, jolloin niiden ollessa samanlaisia puskurimuistissa olevia tietoja siirretään kulloinkin yhden paikan verran eteenpäin. Erilaisuuden esiintyessä tuotetaan keskeytys-vaatimus ja multiplekserin sisäänmenoihin osoitettu laskin pysäytetään. Puskurimuistin sarjasisäänmenossa jonottavan uuden informaation lukemisen ja tallettamisen jälkeen laskin kytketään ensisijassa seuraavaan osoitteeseen tarkistamaan löytyykö lisää keskeytysvaatimuksia.
Tässä tietojensyöttöjärjestelmässä täytyy mikroprosessorin ladata puskurimuisti kunkin vertailuoperaation alussa ja tallettaa alussa tulotiedot kirjoitus-lukumuistiin. Tämä vaatii lisäsoftwarea, jolloin vastaavan ohjelman kehittämiseen vaadittava aika sisäänmenojen lukumäärästä riippuen voi muodostua merkittäväksi. Lisäksi tietobitti ja siihen kuuluva ulkopuolisen laskimen tuottama osoite on kerättävä keskeyty-sohjelman puitteissa liitoselimen tietotulon kautta lisäsoft-wareen ja aikaa vaativaan operaatioihin.
Julkaisusta "Electronics, March 17, 1977, sivut 100-104" on tunnettua, että tietojensiirtoa ympäristön ja muistin välillä ilman mikroprosessoria voidaan suorittaa suoran muistihaku-(DMA-)elimen avulla. DMA-operaation aloittaa ulkopuolelta tuleva DMA-vaatimussignaali. Tämän jälkeen DMA-elin pakottaa mikroprosessorin tahtisignaalia pidättämällä keskeyttämään aktiviteettinsä yhden jakson ajaksi (Cycle Stealing), jotta DMA-elin voi suorittaa väylän ohjaamisen.
Keksinnön tehtävänä on mainittujen varjopuolien poistamiseksi I.
5 74158 aikaansaada kytkinlaite, jossa useampien annettavien ohjaus-käskyjen aikanakin on minimimäärä syöttökanavia ja vähäisempi hardwaren käyttö, ja jolla vaaditaan tietojen syöttöä varten vähemmän softwares, jolloin mikroprosessorin syöttötapahtuman aikana käyttämää aikaa voidaan vähentää. Tämä tehtävä ratkaistaan patenttivaatimuksessa esitetyn keksinnön mukaisesti. Tässä aktivoidaan sinänsätunnetusti mikroprosessorin vapau-tussignaalin avulla vertailuelin, missä vertaillaan vanhoja ja uusia ohjainkäskynantimen kytkintiloja ja erilaisuuden esiintyessä tuotetaan keskeytysvaatimus. Vertailuelin on liitetty DMA-elimeen, mikä tunnustelee ohjainkäskynanninta ja vanhan kytkintilan sisältävää kirjoituslukumuistia niihen liitettyjen osoitteiden avulla osoiteväylän kautta. Löydettäessä erilaisuus ja tuotettaessa keskeytysvaatimus DMA-operaatio keskeytetään, jolloin esillä oleva tietobitti ja siihen liittyvä osoite löytyy valmiksi tietojensyöttöjohtimesta tahi osoiteväylästä.
Keksinnöllä saavutettavat edut on nähtävissä oleellisesti siinä, että lukuisalle joukolle annettavia ohjauskäskyjä varten tarvittava vertailulaite on suhteellisen yksinkertainen rakenteeltaan, että keskeytysvaatimuksen esiintyessä tieto-bitti ja siihen liittyvä osoite on jo valmiiksi tietojensyöttö johtimella tai osoiteväylällä, jolloin tietoja luettaessa säästetään softwarea ja aikaa. Lisäetuna on se, että oheislaite on liitetty suoraan tietojensyöttöjohtimeen, jotta mitään rinnakkaisen liitososan tietojen sisäänmenoa ei tarvita ja sen muut sisäänmenot ovat käytettävissä muihin tehtäviin ympäristön liittymäkohdassa. Koska oheislaitteessa olevia oh-jauskäskynantimia tunnustellaan peräkkäin, ei kerran kulkevaa keskeytysohjelmaa voida keskeyttää uudella ohjauskäskyllä, joten prosessoriaikaa voidaan säästää. Lisäetu on ohjauskäs-kynantimen sijoittamisessa matriisimaiseen tunnistinkenttään, jolloin sinänsä tunnetulla tavalla voidaan saada säästöä joh-dotuksessa ja ohjainelementeissä.
6 74158
Keksinnön erästä suoritusesimerkkiä selitetään seuraavassa lähemmin viittaamalla oheisiin piirustuksiin, joissa
Kuvio 1 esittää keksinnönmukaisen kytkinlaitteen kaaviokuvaa, ja
Kuvio 2 esittää kuvion 1 mukaisen kytkinlaitteen vertailulai-tetta .
Kuviossa 1 on viitenumeroilla 1 kuvattu matriisimaista tunnistuskenttää, jonka rivi- ja palstajohtimet on yhdistettävissä risteyskohdissa diodilla 2 sarjaan kytketyllä ohjaus-käskynantimella 3. Riviohjaimet ZQ - Zn on liitetty demultip-lekseristä, optisesta kytkimestä ja vahvistimesta muodostettuun riviohjaimeen 4. Rivijohtimia osoitteistava, laskimesta ja tahtigeneraattorista muodostuva osoitteistolaite 4.1 on yhdistetty osoitejohtimella 4.2 riviohjaimeen 4 ja osoitteis-tettavaan salpaan (Latch) 4.3. Palstajohtimet S0 - Zn on liitetty sisääntuloihin palstavastaanottimessa 5, joka muodostuu optisesta kytkimestä, impulssin muodostimesta ja käyttölaitteesta. Palstavastaanottimen 5 kulloisellekin palstajohtimel-le järjestetyt lähdöt on yhdistetty moninkertaismuistin 6 tuloihin, jolloin kullekin rivinjohtimelle on järjestetty moninkertaismuisti 6, ja moninkertaismuistin 6 muistisolujen lukumäärä on sama kuin palstajohtimien lukumäärä. Niinpä esim. kahdeksan rivi- ja kahdeksan palstajohtimen matriisissa on kaiken kaikkiaan 64 yksittäistä muistisolua, jotka on jaettu kahdeksaksi oktaali-flip-flopin muodostamaksi moninker-taismuistiksi 6. Moninkertaimuistin 6 tahtiliitännät CP on yhdistetty osoitteistavan salvan 4.3 ulostuloihin. Osoitteis-tettaessa esim. rivijohdinta Z0 samanaikaisesti osoitteista-valla salvalla 4.3 aktivoidaan rivijohtimelle Zc järjestetyn oktaali-flip-flopin 6 tahtiliitännät CP niin, että rivijohti-men zQ ja palstanjohtimiin SQ - Sn liitetyn ohjauskäskynan-timen 3 kytkintiloja siirretään palstavastaanottimella 5 ja vastaavan oktaali-flip-flopin 6 tuloilla sen lähtöihin.
I; 7 74158
Viitenumerolla 7 kuvataan multiplekseriä, jonka tietojen tulot on yhdistetty moninkertaismuistin 6 lähtöihin, väyläoh-jain 7.1 on tulopuoleltaan liitetty mikrotietokonesysteemin 8 osoiteväylään AB ja ulostulopuoleltaan osoitejohtimen ensimmäisellä osalla demultiplekserin 7.2 osoitetuloihin ja toisella osalla multiplekserin 7 osoitetuloihin. Demultiplekserin 7.2 lähdöt ovat yhteydessä moninkertaimuistin 6 lähtöjen vapaaliitäntöihin OE. Multiplekserin 7 lähtö Z on liitetty väyläohjaimella 7.1 tiedonantojohtimeen CRUIN, joka, kuten tietojenantojohdin CRUOUT ja tahtisignaalijohdin CRUCLK, on järjestetty mikrotietokonesysteemin 8 tulo-lähtöväylään CRU.
Mikrotietokonesysteemin 8 mikroprosessori CPU on yhdistetty osoiteväylällä AB, tietoväylällä DB, ohjainväylällä StB ainakin yhteen kirjoitin-lukumuistiin RAM ja vakioarvomuistiin ROM sekä osoiteväylällä AB, tulo-lähtöväylällä CRU ja muilla johtimilla 9,10 rinnakkaiseen tulo-lähtöliitososaan if ja DMA-rakenneosaan DMA. Kulloinkin kirjoitin-lukumuistissa RAM varastoitujen tietosanojen lukumäärän mukainen bitti on järjestetty tietyn ohjauskäskynantimen 3 kytkintilan mukaisesti. Rinnakkainen tulo-lähtöliitososa IF on liitetty keskeytysvaa-timustulolla CINT ja vapautussignaalin DMA-toiminnalle antavalla lähdöllä CIEN jäljemmässä kuvion 2 selityksessä lähemmin kuvattuun vertailulaitteeseen 11. DMA-rakenneosa DMA on liitetty DMA-vaatimussignaalia lukevalla tulolla ACCRQl ja kuittaussignaalin antavalla lähdöllä ACCGRl vertailulaittee-seen 11.
Kuviossa 2 on kuvattu viitenumerolla 12 ehdollinen tai-elin, jonka yksi tulo on yhdistetty tietojenantojohtimeen CRUIN ja toinen tulo lisäkirjoitin-lukumuistin Flag-RAM tietojen lähtöön DOUf Kirjoitin-lukumuisti Flag-RAM on yhteydessä osoiteväylään ja liitetty tietojen tulolla Din tietoväylän DB tietojohtimeen DO sekä kirjoitinliitännällä W ohjainväylän Stb johtimeen MW. Toisessa kirjoitin-lukumuistissa Flag-RAM ovat ohjauskäskynantimen 3 kytkintilat varastoituina 1-bitin 8 74158 sanoina. Ehdollisen tai-elimen 12 lähtö on yhdistetty ensimmäisellä NAND-elimellä 13 ensimmäisen JK-flip-flopin 14 tuloihin J,K, jonka lähtö Q on yhdistetty rinnakkaisen liitososan keskeytysvaatimustuloon CINT ja toisen NAND-elimen 15 tuloon. Ensimmäisen NAND-elimen 13 muulle tulolle voidaan DMA-rakenneosalla, kun sitä käytetään muuhun tarkoitukseen, johtaa rajoitinsignaali johtimella 16. Ensimmäisen JK-flip-flopin 14 set-liitäntä on yhteydessä toisen NAND-elimen 15 muun tulon kanssa ja rinnakkaisen liitososan IF vapautus-signaalia antavan lähdön CIEN kanssa. Toisen NAND elimen 15 lähtö on toisen JK-flip-flopin 17 lähtöjen yhteydessä, jonka lähtö Q on yhdistetty DMA-rakenneosan DM-vaatimussignaalia lukevaan tuloon ACCRQl ja set-liitäntä DMA-rakenneosan kuit-taussignaalia antavaan lähtöön ACCGR1.
Tahtisignaalin JK-flip-flopille johtamiseksi vaadittavia liitäntöjä ja yhdistyksiä ei ole esitetty. Kuvatut digitaaliset porttipiirit ja rakenneosat ovat kaupan olevia komponentteja, jolloin esim. mikroprosessoriin, rinnakkaiseen liitos-osaan ja DMA-rakenneosaan voidaan käyttää Texas Instrumentin tyyppejä, TMS9901 ja TMS9911. Rakenneosien eri tuloissa ja lähdöissä esiintyvät signaalit on kuvattu samoin kuin kyseiset tulot ja lähdöt.
Edelläkuvattu kytkinlaite, jota voidaan käyttää esim. kerros-kutsujen antamiseen mikrotietokoneohjatuissa hisseissä, toimii seuraavasti:
Aikaansaamalla vapautussignaalin mikroprosessorisysteemi 8 ilmoittaa valmiutensa ulkopuolisten ohjauskäskyjen vastaanottamiseen. Tällöin rinnakkaisen liitososan IF ulostulon CIEN potentiaali on korkealla. Saman rakenneosan keskey-tysvaatimustulo CINT voi nyt esim., ellei siinä ole keskey-tysvaatimusta, olla korkealla potentiaalilla. Tässä tapauksessa toisen NAND-elimen 15 lähdössä ja tahtisignaalia vaihdettaessa myös vertailulaitteen 11 toisen JK-flip-flopin 9 74158 lähdössä Q tapahtuu potentiaalinvaihtoa, joka tulkitaan DMA-rakenneosan tulossa ACCRQl DMA-vaatimussignaalina. Sitten DMA-rakenneosa antaa lähdössä ACCGRl kautta kuittaussignaalin toisen JK-flip-flopin 17 set-liitäntään ja ilmoittaa mikroprosessorille CPU, että se haluaa kontrollia osoite- ja tieto-väylään AB,DB. Tämä varmistuu tietyn latenssiajan jälkeen, jonka jälkeen DMA-rakenneosa sijoittaa osoiterekisterinsä osoitteen osoiteväylälle AB. Siten tulevat oheislaite 1-7 ja vertailulaitteen 11 kirjoitus-lukumuisti Flag-RAM kysellyiksi. Osoitteen ensimmäisen osan tunnistaa nyt demultiplekse-rillä 7.2 tietylle rivijohtimelle järjestetty oktaali-flip-flop 6, samalla kun kyseisellä vapautusliitännällä OE aktivoidaan lähdöt. Osoitteen toisen osan identifoi multiplekserin 7 osoitetuloilla tietylle palstajohtimelle järjestetty yksittäinen oktaali-flip-flopin 16 muistisolu. Seuraavaksi multiplekserin 7 lähdössä Z esiintyvä, tietyn ohjauskäskynan-timen 3 kytkintilaa vastaava identifioivan muistikennon lähtötila siirretään tietojenantojohtimella CRUIN vertailulaitteen ehdollisen tai-elimen yhteen tuloon. Samanaikaisesti antaa kirjoitus-lukumuisti Flag-RAM ensimmäisen ja toisen osoitteen osan avulla kysytyn muistipaikan sisällön lähtönsä D0ut kautta ehdollisen tai-elimen 12 toiseen tuloon.
Otaksuttakoonpa nyt, että varastoitu 1 bitin arvo, joka vastaa kytkintilaa "AUS", on arvoltaan "0", jota vastoin tun-nisteltu ulkobitti, joka vastaa kytkintilaa "EIN" vastaavassa ohjauskäskynantimessa 3, on arvossa "1". Tällöin ehdollisen tai-elimen 12 lähtö tulee korkeaksi ja ensimmäisen JK-flip-flopin 14 lähtö Q alhaiseksi tahtia vaihdettaessa. Tämä signaalivaihto tulkitaan rinnakkaisen liitososan IF tulossa CINT keskeytysvaatimukseksi. Keskeytysvaatimuksen ollessa olemassa ei mitään muuta DMA-vaatimussignaalia voida aikaansaada, koska ensimmäisen JK-flip-flopin 14 lähtöön Q yhdistetty toisen NAND-elimen 15 tulo on niinikään potentiaaliltaan alhaisempi.
10 741 58
Sen jälkeen, kun mikroprosessori CPU on hyväksynyt keskeytys-vaatimuksen, se lukee DMA-osoiterekisterin osoitteen, jolla erilaisuus havaittiin. Niinikään se lukee tunnistellun ul-kobitin tietojenantojohtimella CRUIN ja kirjoittaa sen tämän osoitteen alle vertailulaitteen 11 kirjoitin-lukumuistiin tietojohtimen DO avulla. Keskeytysohjelman päätyttyä mikroprosessori asettaa rinnakkaisen liitososan IF lähdön CIEN alemmalle potentiaalille, jotta vapautussignaali katoaa ensimmäisen JK-flip-flopin 14 set-liitännän S kautta, jonka lähtö Q on korkealle määritetty ja jotta keskeytysvaatimus lakkaa.
Jos mikroprosessorisysteemillä 8 ei ole mitään muuta tehtävää suoritettavanaan, se voi uudelleen antaa vapautussignaalin niin, että edellä kuvattu menettely alkaa. Jos menettelyn aikana ei havaita mitään erilaisuuksia, ei aikaansaada myöskään mitään keskeytysvaatimusta. Tässä tapauksessa vapautus-signaalin kestäessä muodostetaan jatkuvasti DMA-vaatimuksia, mikä tapahtuu siten, että kulloinkin DMA-vaatimuksen kuittauksen tapahduttua DMA-rakenneosan lähdön ACCGRl kautta toisen JK-flip-flopin 17 lähtö Q tahdin vaihtuessa jälleen saatetaan alhaiselle potentiaalille. Saavutettaessa DMA-osoiterekisterin loppuosoite aikaansaadaan DMA-keskeytysvaatimus, jolloin mikroprosessori CPU käynnistetään laatimaan uudelleen DMA-rakenneosan rekisteri.
Claims (2)
1. Kytkinlaite ohjauskäskyjen antamiseksi mikrotietokonesys-teemissä, jolloin mikroprosessori (CPU) on yhdistetty osoite-, tieto- ja ohjainväylällä (AB,DB,StB) vähintään yhteen kirjoitus-lukumuistiin (RAM) ja vakioarvomuistiin (ROM) sekä osoiteväylällä (AB), tulo-lähtöväylällä (CRU) ja muilla joh-timilla (9) rinakkaiseen tulo-lähtöliitososaan (IF), ja jolloin - ainakin yksi liitososan (FI) keskeytysvaatimustulo (CINT) on liitetty ainakin yhteen oheislaitteeseen (1-7), - vertailulaite (11) on liitetty vapautussignaalia ohjainkäs-kynantimelle antavan liitososan (IF) lähtöön (CIEN), - vertailulaite (11) käsittää vähintään yhden ehdollisen tai-elimen (12), - vapautussignaalin ja oheislaitteeseen (1-7) yhteenliitetyn ohajuskäskynantimen (3) kytkentätilan muutoksen esiintyessä vertailulaite (11) tuottaa keskeytysvaatimuksen ja tallentaa uuden kytkentätilan luku-kirjoitusmuistiin (RAM), tunnettu siitä, että - ehdollisen tai-elimen (12), yksi tulo on liitetty tulo-lähtöväylän (CRU) tietojenantojohtimeen (CRUIN) ja toinen tulo lisäkirjoitin-lukumuistin (Flag-RAM) tietojenlähtöön (Dout)t - lisäkirjoitin-lukumuisti (Flag-RAM) on yhteydessä osoite-väylään (AB) ja tietojen tulolla (Din) liitetty tietoväylän (DB) tietojohtimeen sekä kirjoitinliitännällä (W) ohjaus- väylän (StB) johtimeen (MW), - ehdollisen tai-elimen (12) lähtö on yhteydessä ensimmäisellä NAND-elimellä (13) ensimmäisen JK-flip-flopin (14) tuloihin (J,K), jonka lähtö (Q) on liitetty rinnakkaisen liitososan (IF) keskeytysvaatimustuloon (CINT) ja toisen NAND-elimen (15) tuloon, jolloin ensimmäisen JK-flip-flopin (14) set-liitäntä (S) on yhdistetty toisen NAND-elimen (15) muuhun tuloon ja vapautussignaalia antavaan rinnakkaisen liitososan (IF) lähtöön (CIEN), ja 12 741 58 - että siihen kuuluu toinen JK-flip-flop (17), jonka tulot (J,K) on yhdistetty toisen NAND-elimen (15) lähtöön ja jonka lähtö (Q) on liitetty DMA-vaatimussignaalia lukevaan tuloon (ACCRQ1) ja jonka set-liitäntä (S) on yhdistetty vertailun ohjausta hoitavan DMA-rakenneosan (DMA) kuittaus-signaalia antavaan lähtöön (ACCGRl), - jolloin DMA-rakenneosa (DMA) tuottaa sinänsä tunnetusti oh-jauskäskynantimeeen (3) järjestetyt osoitteet, joiden avulla se vapautussignaalin ja keskeytysvaatimuksen esiintymättä ollessa tuotettujen DMA-vaatimussignaalien esiintyessä tunnustelee osoiteväylän (AB) kautta ohjainkäs-kynantimen (3) kytkentätilaa ja luku-kirjoitumuistiin (Flag-RAM) talletettuja vanhoja kytkentätiloja ja siirtää vertailulaitteeseen (11), jolloin erilaisuuden esiintyessä DMA-operaatio keskeytetään.
2. Patenttivaatimuksen 1 mukainen kytkinlaite, tunnet- t u siitä, että - ohjauslaite (1-7) muodostuu matrixsimaisesta tunnistinken-tästä (1), jonka risteyskohtiin on järjestetty ohjauskäsky-nantimia (3), jolloin, kuten sinänsä tunnetaan, tunnistin-kentän (1) rivijohtimet ovat yhteydessä ainakin yhteen demultiplekserin omaavaan riviohjaukseen (4), - jokaista matriisimaisen tunnistinkentän (1) risteyskohtaa varten on sinänsä tunnetulla tavalla järjestetty muistisolu, jolloin kullekin rivijohtimelle on järjestetty palsta-johtimien lukumäärää vastaava, moninkertaismuisteiksi (6) koostuva määrä muistisoluja, joiden sisääntulot ovat yhteydessä palstavastaanottimella (5) palstajohtimien kanssa, - siihen kuuluu laskimesta ja tahtigeneraattorista muodostuva osoitteistamislaite (4.1), joka on yhdistetty osoitejohti-mella (4.2) riviohjaimen (4) demultiplekseriin ja osoit-teistettavaan välirekisteriin (4.3), jonka lähdöt on liitetty moninkertaismuistin (6) tahtiliitäntöihin, ja - että siihen kuuluu multiplekseri (7), demultiplekseri (7.2) 13 741 58 ja väyläohjain (7.1)r jolloin väyläohjain (7.1) on tulopuoleltaan liitetty mikrotietokonesysteemiin (8) osoiteväylään (AB) ja ulostulopuoleltaan osoitejohtimen ensimmäisellä osalla demultiplekserin (7.2) osoitetuloihin ja osoitejohtimen toisella osalla multiplekserin (7) osoitetuloihin ja jolloin demultiplekserin (7.2) lähdöt ovat yhteydessä moninkertaismuistin (6) vapautusliitäntoihin (OE) ja multiplekserin (7) lähtö (Z) on liitetty väyläohjaimella (7.1) tulo-lähtöväylän (CRU) tietojenantojohtoon (CRUIN). 14 741 58 P at: e n tk r a._v
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CH2037/81A CH653155A5 (de) | 1981-03-26 | 1981-03-26 | Schaltungsanordnung zur eingabe von steuerbefehlen in ein mikrocomputersystem. |
CH203781 | 1981-03-26 |
Publications (3)
Publication Number | Publication Date |
---|---|
FI820595L FI820595L (fi) | 1982-09-27 |
FI74158B true FI74158B (fi) | 1987-08-31 |
FI74158C FI74158C (fi) | 1987-12-10 |
Family
ID=4224453
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
FI820595A FI74158C (fi) | 1981-03-26 | 1982-02-23 | Kopplingsanordning foer givande av styrorder i ett mikrocomputersystem. |
Country Status (9)
Country | Link |
---|---|
US (1) | US4488220A (fi) |
EP (1) | EP0062141B1 (fi) |
JP (1) | JPS57169832A (fi) |
AT (1) | ATE12709T1 (fi) |
AU (1) | AU545877B2 (fi) |
CH (1) | CH653155A5 (fi) |
DE (1) | DE3262924D1 (fi) |
FI (1) | FI74158C (fi) |
HK (1) | HK86285A (fi) |
Families Citing this family (15)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4618968A (en) * | 1983-11-04 | 1986-10-21 | Motorola, Inc. | Output compare system and method automatically controlilng multiple outputs in a data processor |
EP0308590B1 (de) * | 1987-09-24 | 1993-01-13 | Inventio Ag | Gruppensteuerung für Aufzüge mit Sofortzuteilung von Zielrufen |
DE3865803D1 (de) * | 1987-10-20 | 1991-11-28 | Inventio Ag | Gruppensteuerung fuer aufzuege mit lastabhaengiger steuerung der kabinen. |
JPH01169523A (ja) * | 1987-12-24 | 1989-07-04 | Canon Inc | 情報交換装置 |
JPH01247382A (ja) * | 1988-03-30 | 1989-10-03 | Hitachi Ltd | エレベーター制御システム |
CA1315900C (en) * | 1988-09-01 | 1993-04-06 | Paul Friedli | Group control for lifts with immediate allocation of target cells |
US4965718A (en) * | 1988-09-29 | 1990-10-23 | International Business Machines Corporation | Data processing system incorporating a memory resident directive for synchronizing multiple tasks among plurality of processing elements by monitoring alternation of semaphore data |
EP0365782B1 (de) * | 1988-10-28 | 1993-10-20 | Inventio Ag | Verfahren und Einrichtung zur Gruppensteuerung von Aufzügen mit Doppelkabinen |
US5089984A (en) * | 1989-05-15 | 1992-02-18 | Allen-Bradley Company, Inc. | Adaptive alarm controller changes multiple inputs to industrial controller in order for state word to conform with stored state word |
US5404488A (en) * | 1990-09-26 | 1995-04-04 | Lotus Development Corporation | Realtime data feed engine for updating an application with the most currently received data from multiple data feeds |
EP0624540B1 (de) | 1993-05-12 | 1999-03-10 | Inventio Ag | Aufzugsanlage für Zonenbetrieb |
JPH07182157A (ja) * | 1994-10-24 | 1995-07-21 | Mitsubishi Electric Corp | ディジタル信号処理プロセッサ |
DE69731375T2 (de) * | 1997-06-13 | 2005-03-17 | Alcatel | Mehrfachunterbrechungsabwicklungsverfahren und -gerät |
US8799278B2 (en) * | 2012-10-01 | 2014-08-05 | DISCERN, Inc. | Data augmentation based on second-phase metadata |
US11710531B2 (en) * | 2019-12-30 | 2023-07-25 | Micron Technology, Inc. | Memory redundancy repair |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3593302A (en) * | 1967-03-31 | 1971-07-13 | Nippon Electric Co | Periphery-control-units switching device |
DE2420119B2 (de) * | 1974-04-25 | 1977-09-08 | Siemens AG, 1000 Berlin und 8000 München | Schaltungsanordnung zum erfassen von meldungen mit mehreren meldungsgebern |
US4271466A (en) * | 1975-02-20 | 1981-06-02 | Panafacom Limited | Direct memory access control system with byte/word control of data bus |
US4075691A (en) * | 1975-11-06 | 1978-02-21 | Bunker Ramo Corporation | Communication control unit |
US4325119A (en) * | 1977-01-19 | 1982-04-13 | Honeywell Information Systems Inc. | Process and apparatus employing microprogrammed control commands for transferring information between a control processor and communications channels |
US4219881A (en) * | 1977-12-30 | 1980-08-26 | Honeywell Inc. | Digital input control circuit |
US4292669A (en) * | 1978-02-28 | 1981-09-29 | Burroughs Corporation | Autonomous data communications subsystem |
JPS54129942A (en) * | 1978-03-31 | 1979-10-08 | Fujitsu Ltd | Direct transfer system between sub-systems |
US4234919A (en) * | 1978-10-31 | 1980-11-18 | Honeywell Information Systems Inc. | Intersystem communication link |
US4293908A (en) * | 1979-01-31 | 1981-10-06 | Honeywell Information Systems Inc. | Data processing system having direct memory access bus cycle |
-
1981
- 1981-03-26 CH CH2037/81A patent/CH653155A5/de not_active IP Right Cessation
-
1982
- 1982-02-04 EP EP82100794A patent/EP0062141B1/de not_active Expired
- 1982-02-04 AT AT82100794T patent/ATE12709T1/de not_active IP Right Cessation
- 1982-02-04 DE DE8282100794T patent/DE3262924D1/de not_active Expired
- 1982-02-23 FI FI820595A patent/FI74158C/fi not_active IP Right Cessation
- 1982-03-19 US US06/359,829 patent/US4488220A/en not_active Expired - Fee Related
- 1982-03-24 JP JP57047055A patent/JPS57169832A/ja active Granted
- 1982-03-25 AU AU81906/82A patent/AU545877B2/en not_active Ceased
-
1985
- 1985-11-07 HK HK862/85A patent/HK86285A/xx unknown
Also Published As
Publication number | Publication date |
---|---|
JPS57169832A (en) | 1982-10-19 |
AU545877B2 (en) | 1985-08-01 |
DE3262924D1 (en) | 1985-05-15 |
AU8190682A (en) | 1982-09-30 |
ATE12709T1 (de) | 1985-04-15 |
FI74158C (fi) | 1987-12-10 |
EP0062141B1 (de) | 1985-04-10 |
HK86285A (en) | 1985-11-15 |
FI820595L (fi) | 1982-09-27 |
EP0062141A1 (de) | 1982-10-13 |
CH653155A5 (de) | 1985-12-13 |
US4488220A (en) | 1984-12-11 |
JPS6130307B2 (fi) | 1986-07-12 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US5237567A (en) | Processor communication bus | |
FI74158B (fi) | Kopplingsanordning foer givande av styrorder i ett mikrocomputersystem. | |
US3673576A (en) | Programmable computer-peripheral interface | |
US5426612A (en) | First-in first-out semiconductor memory device | |
AU637428B2 (en) | Apparatus for conditioning priority arbitration | |
US4034347A (en) | Method and apparatus for controlling a multiprocessor system | |
US3810105A (en) | Computer input-output system | |
US4628447A (en) | Multi-level arbitration system for decentrally allocating resource priority among individual processing units | |
US3702462A (en) | Computer input-output system | |
CN101263465B (zh) | 用于总线仲裁的方法和*** | |
US4412286A (en) | Tightly coupled multiple instruction multiple data computer system | |
US4115854A (en) | Channel bus controller | |
EP0184657A2 (en) | Multicomputer digital processing system | |
EP0081961A2 (en) | Synchronous data bus system with automatically variable data rate | |
GB1593404A (en) | Logic circuitry for use in a computer | |
JPS58500145A (ja) | 割込連結と監視システム | |
FI74356B (fi) | Anordning foer styrning av koppling av processorer till dataledning. | |
CA1103324A (en) | Request forwarding system | |
FI78994C (fi) | Distribuerad prioritetsnaetslogik foer att moejliggoera att en enhet med laegre prioritet befinner sig i en position foer hoegre prioritet. | |
US4724519A (en) | Channel number priority assignment apparatus | |
EP0036766A1 (en) | Computer system and interface therefor | |
US6701407B1 (en) | Multiprocessor system with system modules each having processors, and a data transfer method therefor | |
EP0370780B1 (en) | A communication command control system between CPUs | |
US5564059A (en) | Simplified protocol for expanding a fixed width bus in an industrial controller | |
EP0067519B1 (en) | Telecommunications system |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
MM | Patent lapsed | ||
MM | Patent lapsed |
Owner name: INVENTIO AG |