DE3637158A1 - Kettenfoermige logikschaltung - Google Patents

Kettenfoermige logikschaltung

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Description

Die Erfindung betrifft eine kettenförmige Logikschaltung mit kreuz­ gekoppelten Gattern in I2L-Technik mit einer Leitung für die Injektor­ stromversorgung der Gatter.
Eine kettenförmige Logikschaltung ist beispielsweise in Frequenz­ teilern, oder in Schieberegistern vorhanden. Diese Schaltungen werden vorzugsweise aus sogenannten master-slave-D-Flipflops aufgebaut. Eine master-slave-Schaltung in I2L-Technik besteht im allgemeinen gemäß der Fig. 1 aus drei jeweils kreuzgekoppelten Gatterpaaren. Das erste Gatterpaar weist ein erstes Takt-Eingangsgatter (T 2) sowie ein Gatter auf, das zusammen mit (T 2) den Eingangsspeicher bildet. Das zweite Gatterpaar weist gemäß der Fig. 1 ein zweites Takt-Eingangs­ gatter (T 1) sowie ein Dateneingangsgatter D auf. Das dritte Gatterpaar weist gemäß der Fig. 1 ein -Ausgangsgatter ( ) sowie ein Q-Ausgangsgatter (Q) auf.
Für bestimmte Fälle wie z.B. für das Messen der kettenförmigen Logik­ schaltung ist es erforderlich, die ganze Kette von master-slave- Schaltungen entweder zu setzen oder zurückzusetzen, um auf diese Weise einen definierten Grundzustand herzustellen. Setzen bedeutet Q=1 und zurücksetzen bedeutet Q=0. Um der master-slave-Schaltung einen bestimmten Ausgangszustand zu geben, sind in herkömmlicher Weise gemäß der Fig. 1 zwei Gatter (GR) und (GS) erforderlich, die bei Aus­ führung der Schaltung in integrierter Technik Chip-Fläche erfordern und zwar etwa 30% der master-slave-Grund-Schaltung.
Der Erfindung liegt die Aufgabe zugrunde, eine kettenförmige Logik­ schaltung anzugeben, die die beiden Gatter zur Einstellung eines Grund­ bzw. Ausgangszustandes der Logik-Schaltung nicht erfordert und dadurch Chip-Fläche einspart. Diese Aufgabe wird bei einer kettenförmigen Logik-Schaltung der eingangs erwähnten Art nach der Erfindung dadurch gelöst, daß für die Injektorstromversorgung der Gatter eine zweite Versorgungsleitung vorgesehen ist, so daß ein Teil der Gatter durch die zweite Versorgungsleitung versorgt wird, und daß eine Steuer­ anordnung vorgesehen ist, die eine voneinander unabhängige Beauf­ schlagung der beiden Versorgungsleitungen mit Versorgungsströmen ermöglicht.
Die eine der beiden Versorgungsleitungen ist eine Set-Versorgungs­ leitung und die andere der beiden Versorgungsleitungen ist eine Reset-Versorgungsleitung. Von den drei kreuzgekoppelten Gatter­ paaren der master-slave-Schaltung wird jeweils ein Gatter von der Reset-Versorgungsleitung versorgt.
Die Reset-Versorgungsleitung ist vorzugsweise mit dem Takt-Eingangs­ gatter (T 2), mit dem -Ausgangsgatter ( ) sowie mit dem Gatter (D) verbunden. Die Set-Versorgungsleitung ist vorzugsweise mit den rest­ lichen drei Gattern der master-slave Schaltung, d.h. also mit dem zweiten Gatter des Eingangsspeichers (1), mit dem Takt-Eingangsgatter des zweiten Gatterpaares (T 1) sowie mit dem Q-Ausgangsgatter (Q) verbunden.
Als Steueranordnung sind beispielsweise Schalter vorgesehen, die die Stromzufuhr zur jeweiligen Versorgungsleitung unterbinden.
Die Erfindung wird im folgenden an einem Ausführungsbeispiel erläutert.
Die Fig. 2 zeigt die prinzipielle Anordnung der sechs Gatter eines master-slave-D-flipflops in I2L-Technik. Die Gatter sind entsprechend der Darstellung der Fig. 1 gekennzeichnet.
Jedes Gatter besteht aus zwei Halbleiterzonen vom gleichen Leitungs­ typ, die sich in einem Halbleiterbereich vom entgegengesetzten Leitungstyp befinden. Die eine Halbleiterzone (1′, T 2′, D′, T 1′, ′, Q′) hat die Funktion einer Injektorzone, während die andere Halbleiterzone (1′′, T 2′′, D′′, T 1′′, ′′, Q′′) die Basiszone des I²L-Gatters darstellt.
Wie die Fig. 2 weiter zeigt, sind nach der Erfindung zwei Ver­ sorgungsleitungen vorhanden, und zwar die Versorgungsleitung und die Versorgungsleitung . Die Versorgungsleitung ist die Reset-Ver­ sorgungsleitung und die Versorgungsleitung ist die Set-Versorgungs­ leitung. Die eine Versorgungsleitung ist mit drei bestimmten Injektor­ zonen der sechs Gatter und die andere Versorgungsleitung ist mit den restlichen drei Injektorzonen der sechs Gatter verbunden. Im Ausführungs­ beispiel der Fig. 2 sind die Injektorzonen T 2′, D′ und ′ an die - Leitung und die Injektorzonen 1′, T 1′ und Q′ an die -Leitung ange­ schlossen.
Die master-slave-Schaltung der Fig. 2 wird durch eine Stromquelle (T v ) gespeist, die zwei gleiche Ströme liefert. Die Stromquelle besteht im Ausführungsbeispiel der Fig. 2 aus einem Multikollektor- Transistor T v in Stromspiegelschaltung: Ein Kollektorausgang des Transistors T v ist mit der -Leitung und ein zweiter Kollektor des Transistors T v ist mit der -Leitung verbunden. Zwischen der - Leitung und Masse ist der Schalter SR und zwischen der -Leitung und Masse ist der Schalter SS angeordnet. Durch die beiden Schalter können die beiden Leitungen mit der Masse verbunden werden.
Wenn der master-slave-Schaltung ein Reset aufgezwungen werden soll, wird die -Leitung durch den Schalter SR gegen Masse geschaltet. Ent­ sprechendes gilt für das Aufzwingen von Set. Wird die -Leitung an Masse gelegt, so erhalten die an die -Leitung angeschlossenen Gatter keinen Versorgungsstrom. Damit werden die Ausgänge der an die -Leitung angeschlossenen Gatter hochohmig, was in der I2L-Technik einer logischen 1 entspricht. Dadurch können die jeweiligen kreuz­ gekoppelten Partnergatter durchschalten. Der eingestellte Zustand Q=0 wird auch nach wieder Auf-Schalten des Schalters SR beibehalten. Analoges gilt für den Set-Vorgang.
Fig. 3 zeigt in perspektivischer Ansicht die flächenoptimierte An­ ordnung der Injektor-Versorgungsleitungen für das Anwendungsbeispiel nach Fig. 2.
Durch die Verwendung von zwei Versorgungsleitungen, durch entsprechende Auswahl von Gattern für den Anschluß an die eine Versorgungsleitung und für den Anschluß an die andere Versorgungsleitung sowie durch ent­ sprechende Strombeaufschlagung der Versorgungsleitungen bzw. Strom­ entzug (z.B. durch Verbinden der betreffenden Versorgungsleitung mit Masse) wird erfindungsgemäß das Setzen bzw. Zurücksetzen der Gatter der Logikschaltung erreicht, ohne daß für diesen Prozeß besondere Gatter erforderlich sind. Die Einsparung wird natürlich umso größer, je mehr Kettenglieder vorhanden sind.

Claims (6)

1. Kettenförmige Logikschaltung mit kreuzgekoppelten Gattern in I2L-Technik mit einer Leitung für die Injektorstromversorgung der Gatter, dadurch gekennzeichnet, daß für die Injektorstrom­ versorgung der Gatter eine zweite Versorgungsleitung vorgesehen ist, so daß ein Teil der Gatter durch die erste Versorgungsleitung und ein Teil der Gatter durch die zweite Versorgungsleitung versorgt werden, und daß eine Steueranordnung vorgesehen ist, die eine voneinander unabhängige Beaufschlagung der Versorgungsleitungen mit Versorgungs­ strömen ermöglicht.
2. Kettenförmige Logikschaltung nach Anspruch 1, dadurch gekennzeichnet, daß sie eine oder mehrere master-slave-Schaltung(en) aufweist.
3. Kettenförmige Logikschaltung nach Anspruch 1 oder 2, dadurch ge­ kennzeichnet, daß die eine Leitung eine Set-Versorgungsleitung und die andere Leitung eine Reset-Versorgungsleitung ist.
4. Kettenförmige Logikschaltung nach einem der Ansprüche 1 bis 3, dadurch gekennzeichnet, daß von den drei kreuzgekoppelten Gatterpaaren einer master-slave-Schaltung jeweils ein Gatter von der Set-Versorgungs­ leitung und jeweils ein Gatter von der Reset-Versorgungsleitung ver­ sorgt wird.
5. Kettenförmige Logikschaltung nach einem der Ansprüche 1 bis 4, dadurch gekennzeichnet, daß die Reset-Versorgungsleitung mit dem Takt-Eingangsgatter des ersten Gatterpaares, mit dem Daten-Ein­ gangsgatter sowie mit dem Q-Ausgangsgatter verbunden ist und daß die Set-Versorgungsleitung mit dem Takt-Eingangsgatter des zweiten Gatterpaares, mit dem Q-Ausgangsgatter sowie mit demjenigen Gatter verbunden ist, welches mit dem Takt-Eingangsgatter des ersten Gatter­ paares kreuzgekoppelt ist.
6. Kettenförmige Logikschaltung nach einem der Ansprüche 1 bis 5, dadurch gekennzeichnet, daß als Steueranordnung jeweils ein Schalter vorgesehen ist, der die Stromzufuhr zur jeweiligen Versorgungs­ leitung unterbindet.
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Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE2624584A1 (de) * 1976-06-01 1977-12-15 Siemens Ag Anordnung zur versorgung von i hoch 2 l-schaltungen mit verschiedenen stroemen
DE2442773B2 (de) * 1974-09-06 1978-04-27 Deutsche Itt Industries Gmbh, 7800 Freiburg Integrierte Master-Slave-Flipflopschaltung
DE2841755A1 (de) * 1977-09-28 1979-04-05 Ibm Integrierte logische schaltung
DE2906531A1 (de) * 1979-02-20 1980-08-21 Itt Ind Gmbh Deutsche Vorspannungsgenerator fuer eine monolithische festkoerperschaltung

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE2442773B2 (de) * 1974-09-06 1978-04-27 Deutsche Itt Industries Gmbh, 7800 Freiburg Integrierte Master-Slave-Flipflopschaltung
DE2624584A1 (de) * 1976-06-01 1977-12-15 Siemens Ag Anordnung zur versorgung von i hoch 2 l-schaltungen mit verschiedenen stroemen
DE2841755A1 (de) * 1977-09-28 1979-04-05 Ibm Integrierte logische schaltung
DE2906531A1 (de) * 1979-02-20 1980-08-21 Itt Ind Gmbh Deutsche Vorspannungsgenerator fuer eine monolithische festkoerperschaltung

Non-Patent Citations (2)

* Cited by examiner, † Cited by third party
Title
H.H. BERGER, S.K. WIEDMANN, "Merged-Transistor Logic (MTL) - A Low-Gost Bipolar Logic Concept" In: IEEE Journal of Solid-State Circuits, Ok- tober 1972, Vol. SC-7, No.5, S.340-346 *
US-Z: IEEE Journal of Solid-State Circuits, Vol. SC-7, No.5, Okt. 1972, S.340-346 *

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