DE2439300A1 - Verfahren zum aetzen abgeschraegter raender, insbesondere an siliziumoxidschichten - Google Patents
Verfahren zum aetzen abgeschraegter raender, insbesondere an siliziumoxidschichtenInfo
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- VYPSYNLAJGMNEJ-UHFFFAOYSA-N Silicium dioxide Chemical compound O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 title claims description 42
- 229910052814 silicon oxide Inorganic materials 0.000 title claims description 40
- 238000005530 etching Methods 0.000 title claims description 30
- 238000000034 method Methods 0.000 title claims description 28
- 229920002120 photoresistant polymer Polymers 0.000 claims description 30
- QTBSBXVTEAMEQO-UHFFFAOYSA-N Acetic acid Chemical compound CC(O)=O QTBSBXVTEAMEQO-UHFFFAOYSA-N 0.000 claims description 12
- NBIIXXVUZAFLBC-UHFFFAOYSA-N Phosphoric acid Chemical compound OP(O)(O)=O NBIIXXVUZAFLBC-UHFFFAOYSA-N 0.000 claims description 8
- QAOWNCQODCNURD-UHFFFAOYSA-N Sulfuric acid Chemical compound OS(O)(=O)=O QAOWNCQODCNURD-UHFFFAOYSA-N 0.000 claims description 8
- KRHYYFGTRYWZRS-UHFFFAOYSA-N Fluorane Chemical compound F KRHYYFGTRYWZRS-UHFFFAOYSA-N 0.000 claims description 6
- GRYLNZFGIOXLOG-UHFFFAOYSA-N Nitric acid Chemical compound O[N+]([O-])=O GRYLNZFGIOXLOG-UHFFFAOYSA-N 0.000 claims description 4
- 229910000147 aluminium phosphate Inorganic materials 0.000 claims description 4
- 229910017604 nitric acid Inorganic materials 0.000 claims description 4
- DDFHBQSCUXNBSA-UHFFFAOYSA-N 5-(5-carboxythiophen-2-yl)thiophene-2-carboxylic acid Chemical compound S1C(C(=O)O)=CC=C1C1=CC=C(C(O)=O)S1 DDFHBQSCUXNBSA-UHFFFAOYSA-N 0.000 claims description 3
- 150000001875 compounds Chemical class 0.000 claims description 2
- 229910052751 metal Inorganic materials 0.000 description 6
- 239000002184 metal Substances 0.000 description 6
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 4
- 239000004020 conductor Substances 0.000 description 4
- 238000004519 manufacturing process Methods 0.000 description 4
- 239000004065 semiconductor Substances 0.000 description 4
- 229910052710 silicon Inorganic materials 0.000 description 4
- 239000010703 silicon Substances 0.000 description 4
- 239000002253 acid Substances 0.000 description 3
- 239000002131 composite material Substances 0.000 description 3
- 239000000758 substrate Substances 0.000 description 3
- 238000010438 heat treatment Methods 0.000 description 2
- 239000010409 thin film Substances 0.000 description 2
- 229910052782 aluminium Inorganic materials 0.000 description 1
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 1
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 238000005119 centrifugation Methods 0.000 description 1
- 230000007547 defect Effects 0.000 description 1
- 239000008367 deionised water Substances 0.000 description 1
- 229910021641 deionized water Inorganic materials 0.000 description 1
- 230000003111 delayed effect Effects 0.000 description 1
- 238000000280 densification Methods 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 239000003989 dielectric material Substances 0.000 description 1
- 230000005684 electric field Effects 0.000 description 1
- 238000010304 firing Methods 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 239000000203 mixture Substances 0.000 description 1
- 229910052760 oxygen Inorganic materials 0.000 description 1
- 239000001301 oxygen Substances 0.000 description 1
- 230000009467 reduction Effects 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
- 239000000377 silicon dioxide Substances 0.000 description 1
- 239000012808 vapor phase Substances 0.000 description 1
- 239000000052 vinegar Substances 0.000 description 1
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Chemical compound O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/28—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection
- H01L23/29—Encapsulations, e.g. encapsulating layers, coatings, e.g. for protection characterised by the material, e.g. carbon
- H01L23/293—Organic, e.g. plastic
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
- H01L21/311—Etching the insulating layers by chemical or physical means
- H01L21/31105—Etching inorganic layers
- H01L21/31111—Etching inorganic layers by chemical means
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/18—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
- H01L21/30—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
- H01L21/31—Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to form insulating layers thereon, e.g. for masking or by using photolithographic techniques; After treatment of these layers; Selection of materials for these layers
- H01L21/3105—After-treatment
- H01L21/311—Etching the insulating layers by chemical or physical means
- H01L21/31144—Etching the insulating layers by chemical or physical means using masks
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- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/482—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body
- H01L23/485—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of lead-in layers inseparably applied to the semiconductor body consisting of layered constructions comprising conductive layers and insulating layers, e.g. planar contacts
- H01L23/4855—Overhang structure
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- H01L23/52—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
- H01L23/522—Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
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- Y10S438/00—Semiconductor device manufacturing: process
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- Engineering & Computer Science (AREA)
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- Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- General Physics & Mathematics (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Manufacturing & Machinery (AREA)
- Chemical & Material Sciences (AREA)
- General Chemical & Material Sciences (AREA)
- Inorganic Chemistry (AREA)
- Chemical Kinetics & Catalysis (AREA)
- Weting (AREA)
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Description
Dipl.-Ing. H. Sauerland · Dr.-Ing. Π. König . Dipl.-Ing. K. Bergen
Patentanwälte · 4ooo Düsseldorf 30 ■ Cecilienallee ve ■ Telefon 432732
14. August 1974 29 518 B
RCA Corporation, 30 Rockefeiler Plaza,
New York, N.Y. 10020 (V.St.A.)
"Verfahren zum Ätzen abgeschrägter Ränder, insbesondere an Siliziumoxidschichten"
Die Erfindung betrifft ein Verfahren zum Ätzen eines abgeschrägten
Randes oder einer abgeschrägten Kante an einer dielektrischen Schicht, beispielsweise Siliziumoxid. Insbesondere
betrifft die Erfindung ein Verfahren zum Abätzen eines vorbestimmten Teils einer dielektrischen Schicht,
beispielsweise Siliziumoxid, von einem Siliziumkörper und zum Abschrägen der Ränder der verbleibenden, dem vorbestimmten
Teil begrenzenden Schicht. Das erfindungsgemäße Verfahren ist insbesondere bei der Herstellung von integrierten
Halbleiter-Mikroschaltungsbauelementen mit Vorteil anwendbar.
Bei der Herstellung elektronischer Bauteile, beispielsweise monolithischer integrierter Schaltungen in Silizium,
wird eine Reihe von fotolithografischen Verfahrensschritten angewandt. Die Prozeßbedingungen und die verwendeten
Materialien bestimmen die Konturen der Ränder der fotolithografisch
begrenzten Strukturen. Für bestimmte Anwendungsfälle können sehr steile Ränder erforderlich sein,
jedoch sind üblicherweise allmählich ansteigende Konturen erwünscht. Dies ist insbesondere dann der Fall, wenn eine
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nachfolgend niedergeschlagene Dünnfilm-Metallschicht eine
zuvor formbegrenzte Schicht überdecken soll, oder wenn starke elektrische Felder vermieden werden müssen.
Durch das Fehlen von abgeschrägten Begrenzungskanten bei fotolithografisch begrenzten Anordnungen verursachte Defekte
von Bauteilen treten hauptsächlich infolge von Unterbrechungen in im Vakuum niedergeschlagenen Metallschichten
auf, wenn sie über steile (90°) Stufen in einer dielektrischen Schicht, beispielsweise aus Siliziumoxid,
hinwegverlaufen. Teilweise Metallunterbrechungen oder Dickenverringerungen eines Leiters können einen erhöhten
Serienwiderstand des Leiters, eine erhöhte Anfälligkeit gegen Versagen infolge von Temperaturänderungen und ein
sofortiges oder verzögertes Versagen des Bauteils nach
Anlegen von Betriebsspannungen verursachen.
Zur Herstellung einer Abschrägung an einer dielektrischen Schicht wurde bereits ein Zwei-Schichten-Ätzverfahren
vorgeschlagen. Bei diesem bekannten Verfahren wird eine schneller, ätzbare Schicht über einer langsamer ätzbaren,
abzuschrägenden Schicht aufgebracht. Die obere Schicht, d.h. die "Abschrägungs-Steuer-Schicht", und die
Zusammensetzung des Ätzmittels werden so gewählt, daß eine allmähliche Abschrägung erzeugt wird, deren Größe
hauptsächlich vom Verhältnis der Ätzgeschwindigkeit der oberen "Abschrägungs-Steuer-Schicht" zur Ätzgeschwindigkeit
der unteren Schicht abhängig ist. Das bekannte Verfahren ist für gewisse Anwendungsfälle geeignet, jedoch
haben Abschrägungs-Steuer-Schichten, die mit einer erheblich höheren Ätzrate als die untere, abzuschrägende
Schicht ätzbar sind, die Tendenz, scharfkantige, nahezu senkrechte oder sogar ausgenommene Stufen zu bilden.
Außerdem können bei diesem Verfahren die Betriebssicherheit beeinträchtigende Probleme, beispielsweise Mikrorisse,
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auftreteten, wenn nicht die obere "Abschrägungs-Steuer-Schicht" entfernt wird, bevor nachfolgend weitere Schichten
niedergeschlagen werden.
Demgegenüber liegt der Erfindung die Aufgabe zugrunde, die Möglichkeit zum Ätzen einer Schicht aus dielektrischem
Material, beispielsweise Siliziumoxid, derart vorzuschlagen, daß eine abgeschrägte Kante erzeugbar
ist, ohne daß eine zusätzliche, schnellere ätzbare "Abschrägung s-Steuer-Schicht" verwendet werden muß,
Das erfindungsgemäße Verfahren zum Abätzen eines vorbestimmten Teils einer dielektrischen Schicht, beispielsweise
aus Siliziumoxid, und zum Abschrägen des Randes des verbleibenden, dem vorbestimmten Teil begrenzenden
Teils, besteht darin, daß der vorbestimmte Teil der dielektrischen Schicht mittels einer auf deren Oberfläche
aufgebrachten Fotolackschicht begrenzt wird, worauf der vorbestimmte Teil der dielektrischen Schicht mit einer
Lösung abgeätzt wird, die ein Ätzmittel für die dielektrische Schicht und einen Bestandteil zum Abheben
des Randes der Potolackschicht von der Zwischenfläche zwischen dem Fotolack und der dielektrischen Schicht an
der Begrenzung des vorbestimmten Abschnitts enthält.
Das erfindungsgemäße Verfahren wird nachstehend in Verbindung mit der Zeichnung näher erläutert, und zwar zeigen:
Fig. 1 bis 4 Teilschnittansichten eines Halbleiter-Bauteils,
mit denen verschiedene Bearbeitungsschritte
des erfindungsgemäßen Verfahrens veranschaulicht sind.
Im folgenden wird auf Fig. 1 bezug genommen, in der ein Teilabschnitt eines Halbleiter-Bauteils 10, beispiels-
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weise ein Abschnitt einer monolithischen intergrierten Schaltung gezeigt ist. Das Bauteil 10 weist ein Substrat
12, beispielsweise einen Körper oder ein Scheibchen aus Silizium auf, in dem im Anschluß an eine Oberfläche 16
eine dotierte Zone 14 vorgesehen ist. Wenn das Substrat 12 beispielsweise aus p-leitendem Silizium besteht, kann
die dotierte Zone 14 η-leitend sein.
Eine dielektrische Schicht 18, die im wesentlichen aus
Siliziumdioxid bestehen kann, ist auf der Oberfläche 16
des Substrats 12 niedergeschlagen und bedeckt die dotierte Zone 14. Die Dicke der Siliziumoxid-Schicht 18 beträgt
etwa 10.000 Ä, jedoch ist diese Dicke nicht kritisch.
Mit dem erfindungsgemäßen Verfahren soll erreicht werden, daß die dotierte Zone 14 an der Oberfläche 16 durch
eine abgeschrägte Kante der dielektrischen Schicht 18 begrenzt wird, so daß es möglich ist, einen guten elektrischen
Anschluß zwischen einem auf der dielektrischen Schicht 18 und der dotierten Zone 14 aufgebrachten Leiter
herzustellen. Um dies zu erreichen, wird eine Fotolack-Schicht 20 auf der äußeren Oberfläche 22 der Siliziumoxid-Schicht
18 aufgebracht, so daß die Oberfläche die Zwischenfläche zwischen dem Fotolack und der Siliziumoxid-Schicht
18 darstellt. Die Fotolack-Schicht 20 besteht vorzugsweise aus einem negativen Fotolack, beispielsweise
KTFR (Kodak thin-film resist) und wird in aus der Halbleiterherstellung bekannter Weise aufgebracht.
Die Siliziumoxid-Schicht 18 sollte vorzugsweise verdichtet werden, was beispielsweise durch ein bekanntes 20-minUtiges
Erhitzen in Sauerstoff bei 1000°C erfolgen kann, bevor die Fotolack-Schicht 20 aufgebracht wird, wodurch eine
gute Haftung zwischen den Schichten 20 und 18 sichergeetellt wird. Diese Verdichtung verringert die vom Siliziumoxid
erzeugte Kapazität und führt außerdem zu einem besse-
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ren Anhaften des Fotolacks am Siliziumoxid.
Die Fotolack-Schicht 20 wird dann auf bekannte Weise belichtet und entwickelt, so daB die Oberfläche eines vorbestimmten Teils 24 der Siliziumoxid-Schicht 18 begrenzt
wird, wie dies in Fig. 2 gezeigt ist. Der vorbestimmte Teil 24 wird dann nach dem erfindungsgemäßen Verfahren
abgeätzt und die dotierte Zone ist durch eine abgeschrägte Kante der Siliziumoxid-Schicht 18 begrenzt.
Die entwickelte Fotolack-Schicht 20 wird vor dem Abätzen
des vorbestimmten Teils 24 der Siliziumoxid-Schicht 18 bei einer Temperatur von etwa 950C bis 1050C ungefähr
28 bis 32 Minuten lang gebrannt. Der Teil 24 sollte außerdem innerhalb eines Zeitraums von 30 Minuten nach
dem erwähnten Brennen der Fotolack-Schicht 20 geätzt werden, um eine gute (gesteuerte) Haftung der Fotolack-Schicht
20 während des Ätzens sicherzustellen. Wenn der vorbestimmte Teil 24 in bekannter Weise nur mit einem
konventionellen Ätzmittel für Siliziumoxid, beispielsweise einer gepufferten HF-Lösung geätzt würde, würde
die dotierte Zone 14 von steilen, nahezu senkrechten Kanten der Siliziumoxid-Schicht 18 begrenzt sein, wobei
diese steilen senkrechten Kanten in Fig. 2 durch gestrichelte Linien 26 schematisch veranschaulicht sind.
Nach dem erfindungsgemäßen Verfahren wird die Slliziumoxid-Schlcht
18 mit einer zusammengesetzten oder Mehrkomponenten-Lösung geätzt, die sowohl ein Atzmittel für
die dielektrische Schicht 18 als auch eine d«n Fotolack . abhebende Komponente enthält, um den Rand der Fotolack-Schicht
20 an der Zwischenfläche 22 zwischen dem Fotolack und der dielektrischen Siliziumoxid-Schioht 18 abzuheben.
Das Ätzmittel für die Siliziumoxid-Schicht kann eine bekannte gepufferte HF-Ätzlösung mit 4 Volumenteilen
Fluorwasserstoffsäure (49# Lösung) und 6 1/4
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Volumenteilen Ammoniumfluorid (40# Lösung) sein, und die
. lackabhebende Komponente zum Abheben des Randes der Fotolack-Schicht 20 lediglich entlang der Zwischenfläche
22 zwischen der Fotolack-Schicht 20 und dar Siliziumoxid-Schicht
18 ist eine Säure, beispielsweise Salpetersäure, Phosphorsäure oder Essigsäure. Die Menge der lackabhebenden
Komponente in der zusammengesetzten Lösung ist von der für den Ätzvorgang gewählten Temperatur abhängig.
Die Größe der Abschrägung (des mit der Horizontalen gebildeten
Winkels) der Begrenzungskanten der Siliziumoxid-Schicht 18 wird durch die Konzentration der lackabhebenden
Säurekomponente der zusammengesetzten Lösung, die Temperatur, bei welcher die Ätzung erfolgt, und die Ätzdauer
bestimmt.
Geeignet abgeschrägte Ränder im Siliziumoxid haben einen Winkel zwischen 30° und 60° zur Horizontalen. Spezielle
Verfahren zur Bildung solcher abgeschrägter Ränder sind in den folgenden Beispielen beschrieben:
Eine der in Fig. 1 gezeigten Siliziumoxid-Schicht entsprechende Schicht mit einer Dicke von etwa 10.000 & wird
mit einem negativen Fotolack (KTFR) beschichtet. Der Fotolack wird belichtet und entwickelt, so daß ein vorbeetimmter Teil der Siliziumoxid-Schicht in der in Fig. 2
gezeigten ¥·**· begrenzt ist. Der Fotolack wird dann bei
100 ί 5°C 30 ± 2 Minuten lang erhitzt oder gebrannt. Der
Fotolack wird auf wenigstens 260C abgekühlt und der vorbtstinmte Teil wird innerhalb von 30 Minuten nach der er
wähnten Erhitzung geätzt. Der vorbestimmte Teil wird mit einer Mehrkomponenten-Lösung behandelt, die eine gepufferte
Xtzlösung aus 29 Volumenteilen Ammoniumfluorid (4096 Lösung),
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4 Volumenteilen Fluorwasserstoffsäure (49% Lösung) und eine .lackabhebende Komponente von 15»5 Volumenteilen Eis-Essig
enthält. Das Ätzen wird bei 26,5 - 0,50C für 10 Minuten durchgeführt. Anschließend wird die Siliziumoxid-Schicht
mit entionisiertem Wasser abgespült und getrocknet durch 3-minütiges Zentrifugieren mit einer Geschwindigkeit
von 2200 ί 200 UPM. Die bei diesem Ausführungsbeispiel erzeugte Abschrägung der Siliziumoxid-Kante
weist eine Neigung von etwa 40° zur Horizontalen auf.
Eine Siliziumoxid-Schicht 18 mit einer Dicke von 10.000 Ä wird in der in Verbindung mit Beispiel 1 beschriebenen
Weise vorbereitet und bei 40° C 5 Minuten lang mit einer Lösung geätzt, die eine mit NH^F gepufferte HF-Lösung zum
Ätzen des Siliziumoxids und eine lackabhebende Komponente mit 5 Vol.-% Schwefelsäure enthält. Der prozentuale Anteil
der Schwefelsäure kann von 3 bis 7 Vol.-96 der zusammengesetzten.
Lösung vaiieren und die Ätzzeit kann zwischen 3 bis 7 Minuten liegen. Je höher der prozentuale
Anteil von Schwefelsäure und je langer die Ätzzeit ist,
eine desto größere Abschrägung wird erreicht, d.h. der Winkel der sich ergebenden abgeschrägten Kante mit der
Horizontalen wird umso kleiner. Die Ätztemperatur kann im
vorliegenden und den folgenden Beispielen auf etwa 25°C gesenkt werden, jedoch vergrößert eine solche Absenkung
die Ätzdauer und die Abschrägung.
Eine entsprechend dem Ausführungsbeispiel 1 hergestellte 10.000 £ dicke Schicht aus Siliziumoxid wird mit einer
NH^F gepufferten HF-Lösung und 10 Vol.-S Essigsäure 7,5
Minuten lang bei 40°C geätzt. Der prozentuale Anteil der
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Essigsäure kann zwischen 5 bis 15 Vol.-% der Lösung liegen
und die Ätzzeit kann zwischen 5 und 10 Minuten variieren.
Eine entsprechend dem Ausführungsbeispiel 1 hergestellte
Siliziumoxid-Schicht mit einer Dicke von etwa 10.000 i wird mit einer Lösung aus einem NH^F gepufferten HF-Ätzmittel
und 10 Vol.-% Phosphorsäure 4 Minuten lang bei 400C geätzt. Der Anteil von Phosphorsäure kann zwischen
5 und 15 V0I.-96 der Lösung und die Ätzzeit zwischen 2,5
und 5 Minuten variieren.
Eine gemäß Ausführungsbeispiel 1 hergestellte Schicht 18 aus Siliziumoxid mit einer Dicke von etwa 10*000 S wird
5 Minuten lang bei 400C mit einer Lösung geätzt, die
sich aus einer NH^F gepufferten HF-Lösung und 10 V0I.-96
Salpetersäure zusammensetzt. Der Gehalt an Salpetersäure kann zwischen 5 bis 15 Vol.-% der Lösung und die Ätzzeit
zwischen 2,5 und 7,5 Minuten variieren.
Im folgenden wird auf Fig. 3 bezug genommen, aus der hervorgeht,
daß der vorbestimmte Teil 24 der Siliziumoxid-Schicht 18 mittels des erfindungsgemäßen Verfahrens abgeätzt
ist, wobei die datierte Zone 14 von abgeschrägten Kanten 28 begrenzt wird, Die Fotolack-Schicht 20 wird
dann in bekannter Weise mittels einer geeigneten Lösung von der Siliziumoxid-Schicht 18 entfernt. Nunmehr kann
ein elektrischer Anschluß an der dotierten Zone 14 hergestellt werden.
In Fig. 4 ist eine Schicht 30 aus Metall, beispielsweise
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ein Aluminiumleiter, gezeigt, der in bekannter Weise auf
der Oberfläche 22 der Siliziumoxid-Schictit 18 und der Oberfläche der dotierten Zone 14 niedergeschlagen sein
kann. Die abgeschrägten Kanten 28 der Siliziumoxid-Schicht
18 begrenzen die dotierte Zone 14, so daß die durch Niederschlagen
aus der Dampfphase erzeugte Metallschicht insgesamt eine im wesentlichen gleichförmige Dicke aufweisen
kann. Das Fehlen einer steilen (90°) Stufe und/ oder ausgenommener Abschnitte in den Begrenzungskanten
des geätzten Siliziumoxid verhindert die Möglichkeit des Entstehens von Zonen hohen spezifischen Widerstands
und/oder von Unterbrechungen der niedergeschlagenen Metallschicht 30, die bei Fehlen der abgeschrägten Kanten
28 der Siliziumoxid-Schicht 18 auftreten würden.
Für die Durchführung des erfindungsgemäßen Verfahrens ist es wichtig, eine gute Haftung des Fotolacks an der
Oberfläche^ der dielektrischen Schicht zu erhalten,, so
daß die Fotolack-Schicht während des Ätzangriffs nur
entlang ihres Randes abgehoben ist. Die Funktion der Säurekomponente relativ niedriger Konzentration in der
gepufferten Ätzlösung besteht darin, nur die Ränder der Fotolack-Schicht an der Zwischenfläche zwischen dem
Fotolack und der dielektrischen Schicht in steuerbarer Weise anzuheben. Schlechte Haftung und/oder ein vollständiges
Abheben der Fotolack-Schicht ist unerwünscht und muß beim erfindungsgemäßen Verfahren vermieden
werden.
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Claims (6)
- RCA Corporation, 30 Rockefeller Plaza, New York, N.Y. 10020 (V.St.A.)Patentansprüche;Verfahren zum Abätzen eines vorbestimmten Teils und zum Abschrägen des Randes des verbleibenden, den vorbestimmten Teil begrenzenden Teils einer dielektrischen Schicht, wobei der vorbestimmte Teil der dielektrischen Schicht mittels einer auf deren Oberfläche aufgebrachten Fotolack-Schicht begrenzt wird, dadurch gekennzeichnet , daß der vorbestimmte Teil der dielektrischen Schicht mit einer Mehrkomponenten-Lösung abgeätzt wird, die ein. Ätzmittel für die dielektrische Schicht und einen lackabhebenden Bestandteil enthält, der den Rand der Fotolack-Schicht entlang der Begrenzung des vorbestimmten Teils der dielektrischen Schicht abhebt.
- 2. Verfahren nach Anspruch 1, dadurch g e -k ein η ζ e A c h η e t, daß der Fotolack höchstens 30 Minuten vor dem Abätzen des vorbestimmten Teils erhitzt wird, daß die dielektrische Schicht aus Siliziumoxid befefceht, und daß das zusammengesetzte Ätzmittel 25 Volumenanteile Ammoniumfluorid (40% Lösung) und etwa 4 Volumenanteile Fluorwasserstoffsäure (49% Lösung) enthält.
- 3. Verfahren nach Anspruch 2, dadurch g ekennzeichnet , daß die lackabhebende Komponente zwischen etwa 3 und 7 Vol.-tf Schwefelsäure, bzogen auf die509810/0745Mehrkomponenten-Lösung, aufweist, und daß das Ätzen bei 400C durchgeführt wird.
- 4. Verfahren nach Anspruch 2, dadurch gekennzeichnet, daß als lackabhebende Komponente 5 bis 15 Vol.-96 Essigsäure, bezogen auf die Mehrkomponenten-Lösung, gewählt wird, und daß das Ätzen bei etwa 400C durchgeführt wird.
- 5. Verfahren nach Anspruch 2, dadurch gekennzeichnet , daß als lackabhebende Komponente 5 bis 15 Vol.-96 Phosphorsäure, bezogen auf die Mehrkomponenten-Lösung, gewählt wird, und daß das Ätzen bei etwa 4O0C durchgeführt wird.
- 6. Verfahren nach Anspruch 2, dadurch gekennzeichnet , daß als lackabhebende Komponente zwischen 5 und 15 V0I.-96 Salpetersäure, bezogen auf die Mehrkomponenten-Lösung, gewählt wird, und daß das Ätzen bei etwa 400C durchgeführt wird.50981 0/0745Leerseite
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US00389718A US3839111A (en) | 1973-08-20 | 1973-08-20 | Method of etching silicon oxide to produce a tapered edge thereon |
Publications (2)
Publication Number | Publication Date |
---|---|
DE2439300A1 true DE2439300A1 (de) | 1975-03-06 |
DE2439300C2 DE2439300C2 (de) | 1982-06-24 |
Family
ID=23539436
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE2439300A Expired DE2439300C2 (de) | 1973-08-20 | 1974-08-16 | "Verfahren zum Abätzen eines vorbestimmten Teils einer Siliziumoxidschicht" |
Country Status (13)
Country | Link |
---|---|
US (1) | US3839111A (de) |
JP (1) | JPS5633858B2 (de) |
BE (1) | BE818991A (de) |
BR (1) | BR7406683D0 (de) |
CA (1) | CA1031250A (de) |
DE (1) | DE2439300C2 (de) |
FR (1) | FR2241876B1 (de) |
GB (1) | GB1445659A (de) |
IN (1) | IN139623B (de) |
IT (1) | IT1022509B (de) |
NL (1) | NL7410810A (de) |
SE (1) | SE389427B (de) |
YU (1) | YU40106B (de) |
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FR2241876A1 (de) | 1975-03-21 |
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DE2439300C2 (de) | 1982-06-24 |
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JPS5633858B2 (de) | 1981-08-06 |
AU7229374A (en) | 1976-02-19 |
CA1031250A (en) | 1978-05-16 |
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---|---|---|---|
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8339 | Ceased/non-payment of the annual fee |