DE2117365A1 - Integrierte Schaltung und Verfahren zu ihrer Herstellung - Google Patents
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Description
Anmelder: General Electric Company, Schenectady, New York, N-Y. USA
, Integrierte Schaltung und Verfahren zu ihrer Herstellung.
Die Erfindung betrifft eine integrierte Schaltung aus Halbleitermaterial
und ein Verfahren zur Herstellung einer elektrischen Isolierschicht zwischen Elementen der integrierten Schaltung
auf einem Halbleitersubstrat.
Bei integrierten Schaltungen besteht die Schwierigkeit, eine geeignete elektrische Isolation zwischen Komponenten oder Elementen
der Schaltung vorzusehen, und gleichzeitig einen gut wärmeleitenden
Weg zu Wärmesenke vorzusehen. Dadurch ist der Nachteil bedingt, daß die Möglichkeiten integrierter Schaltungen nicht vollständig ausgenutzt
werden können. Obwohl zahlreiche Verfahren und Vorrichtungen zur Beseitigung dieser Schwierigkeiten vorgeschlagen wurden, ist
deren Anwendbarkeit insbesondere deshalb begrenzt, weil diese Verfahren verhältnismäßig kompliziert oder teuer sind.
Es ist deshalb Aufgabe der Erfindung, ein Verfahren zur Herstellung
einer integrierten Schaltung anzugeben, deren Komponenten oder Elemente elektrisch voneinander isoliert sind, wobei jedoch
ein gut wärmeleitender Weg zu einer Wärmesenke vorhanden ist. Ferner soll eine derartige integrierte Schaltung mit einer Anzahl von
elektrisch isolierten Elementen mit einem einzigen gut wärmelei-
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tenden Weg zu einer Wärmesenke versehen werden. Ferner soll
das Verfahren unter Verwendung von Verfahrensschritten durchführbar
sein, die in der Haltleitertechnik üblich sind.
Diese Aufgabe wird durch ein Verfahren erfindungsgemäß gelöst,
bei dem eine Isolierschicht auf der Oberfläche eines Halbleitersubstrats mit integrierten Schaltungselementen erzeugt
wird, über der eine Schicht aus gut wärmeleitendem Material wie einem Metall ausgebildet wird, bei dem die gut
wärmeleitende Schicht und die dünne Isolierschicht in Bereichen entfernt werden, wo einzelne Schaltungselemente voneinander
getrennt werden sollen, und bei dem das Halbleitermaterial von der Rückseite des Substrats wahlweise entfernt wird, und das
gut wärmeleitende Material mit einer Wärmesenke verbunden wird.
Zusammenfassend gibt deshalb die Erfindung ein Verfahren an, bei dem eine elektrische Isolation zwischen integrierten Schaltungen
und ein gemeinsamer gut wärmeleitender Weg zu einer Wärmesenke
vorgesehen sind. Bei dem Verfahren wird eine Isolierschicht über der Oberfläche eines Halbleiterplattchens ausgebildet,
welches integrierte Schaltungen enthält. Über dieser Isolierschicht
wird eine Schicht aus gut wärmeleitendem Material ausgebildet. Teile der gut wärmeleitenden Schicht und der Isolierschicht
werden in Bereichen zwischen einzelnen integrierten Schaltungen entfernt. Das Halbleitermaterial wird zwischen integrierten
Schaltungselementen entfernt und ein gut wärmeleitender Weg wird zwischen der gut wärmeleitenden Schicht und einer geeigneten
Wärmesenke ausgebildet.
Anhand der Zeichnung soll die Erfindung näher erläutert werden.
Es zeigen:
Fig. 1 eine perspektivische Ansicht eines Halbleiterplattchens
in dem mehrere verbundene integrierte Schaltungen ausgebildet sind; und
Fig. 2 bis 6 Verfahrensschritte bei der Durchführung des Verfahrens
gemäß der Erfindung.
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Bei dem in Fig. 1 dargestellten Ausführungsbeispiel sind eine Anzahl von integrierten Schaltungen Io auf einem Halbleitersubstrat
11 ausgebildet. Jede integrierte Schaltung Io wird auf dem Substrat 11 in an sich bekannter Weise ausgebildet.
Beispielsweise kann jede integrierte Schaltung Transistoren,
Dioden, Widerstände oder Kondensatoren enthalten, die beispielsweise durch Diffusion ausgewählter Dotiermaterialien in dem
Halbleitersubstrat ausgebildet werden. Durch bekannte Vetffahrensschritte
ist es möglich, eine Vielzahl von Schaltungselementen auszubilden, die miteinander verbunden sein können, um eine große
Anzahl von integrierten Schaltungen auf einem einzigen Halbleitersubstrat auszubilden.
Fig. 2 zeigt einen Querschnitt entlang der Linie 2-2 in Fig. 1, woraus die Einzelheiten einer typischen integrierten Schaltung
deutlicher erkennbar sind. Das Halbleitersubstrat 11 ist n-leitend
und weist mehrere Diffusionsbereich auf. Die integrierte Schaltung Io kann beispielsweise einen ersten Transistor 12 enthalten, der
aus einem p-leitenden Diffusionsbereich besteht, in dem ein flacher η-leitender Diffusionsbereich 14 ausgebildet st. Angrenzend
an den ersten Transistor ist ein zweiter p-leitender Diffusionsbereich vorgesehen, um einen Widerstand 15 zu bilden.
Der Widerstand 15 kann- ebenfalls durch Diffusionen eines Dotiermaterials
in das Substrat ausgebildet werden. Nach der Diffusion wird ein schützender und passivierender Überzug 16, der beispielsweise
aus Siliziumdioxyd besteht, über der Oberfläche des Substrats niedergeschlagen oder thermisch aufgewachsen, in die Oxydschicht
werden dann Öffnungen eingeätzt, um einen elektrischen Anschluß für ausgewählte Teile des Halbleitersubstrats vorzusehen.
Elektrische Verbindungen zwischen Schaltungselementen werden vorzugsweise ausgebildet, indem eine Metallschicht über der Oxydoberfläche
aufgetragen wird und indem die Metallschicht ausgeätzt' wird, un. die gewünschten elektrischen Verbindungen zu schaffen.
Bei dem Ausführungsbeispiel in Fig. 2 ist eine elektrische Verbindung zwischen dem η-leitenden Bereich 14 und dem Widerstand 15
durch eine gemusterte Metallschicht 17 gegeben, die beispielsweise
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aus Molybdän, Wolfram, Aluminium oder Gold besteht. Verfahren zur
Ausbildung derartiger Verbindungen verschiedener Schaltungselemente
sind bekannt und sind nicht Gegenstand der Erfindung.
Bei diesem Ausführungsbeispiel der Erfindung erfolgt die elektrische Isolation zwischen Schaltungselementen und dem gut
wärmeleitenden Weg zwischen den Schaltungselementen und einer Wärmesenke entsprechend der Darstellung in den Figuren 3 bis 6.
Zuerst wird eine dünne Isolierschicht 18 über der Oberfläche der
integrierten Schaltungen ausgebildet. Die Isolierschicht 18 kann z.B. ein Oxyd sein, ein Nitrit oder aus Kombinationen von Oxyden
und Nitriden von Silizium bestehen. Es können auch zahlreiche andere bekannte Isolierschichten Verwendung finden. Die Hauptanforderung
besteht darin, daß die Isolierschicht einen niedrigen thermischen Ausdehnungskoeffizienten hat, der nahezu gleich den
thermischen Ausdehnungskoeffizienten des Substrats ist. Beispielsweise
hat Silizium einen thermischen Ausdehnungskoeffizienten
—6
von etwa 5 χ Io pro Grad C. Obwohl es auch wünschenswert ist, daß die Isolierschicht eine verhältnismäßig große Wärmeleitfähigkeit hat, ist diese Eigenschaft nicht erforderlich, wenn die Schichtdicke hinreichend gering ist, so daß die Wärmeleitung durch die Isolierschicht kein bedeutsamer Faktor bei der Ermittlung der Wärmeübertragung von einer integrierten Schaltung zu einer Wärmesenke ist. Wenn die Isolierschicht 18 beispielsweise aus Siliziumnitrit oder Siliziumdioxyd besteht, erzeugt eine Schichtdicke
von etwa 5 χ Io pro Grad C. Obwohl es auch wünschenswert ist, daß die Isolierschicht eine verhältnismäßig große Wärmeleitfähigkeit hat, ist diese Eigenschaft nicht erforderlich, wenn die Schichtdicke hinreichend gering ist, so daß die Wärmeleitung durch die Isolierschicht kein bedeutsamer Faktor bei der Ermittlung der Wärmeübertragung von einer integrierten Schaltung zu einer Wärmesenke ist. Wenn die Isolierschicht 18 beispielsweise aus Siliziumnitrit oder Siliziumdioxyd besteht, erzeugt eine Schichtdicke
ο
zwischen 2ooo und 5ooo A einen zufriedenstellend wärmeleitenden Weg. Es ist ersichtlich, daß sowohl dünnere als auch dickere Schichten Verwendung finden können. Dünnere Schichten bewirken jedoch im allgemeinen eine unerwünschte Nebenschlußkapazität zwischen der integrierten Schaltung und der Wärmesenke, während dickere Schichten eine schlechte Wärmeleitfähigkeit zu der Wärmesenke ergeben. Deshalb findet bei der Durchführung der Erfindung vorzugsweise eine Schichtdicke der Isolierschicht 18 Verwendung, die mit der zulässigen Nebenschlußkapazität und dem Wärmeverlust verträglich ist.
zwischen 2ooo und 5ooo A einen zufriedenstellend wärmeleitenden Weg. Es ist ersichtlich, daß sowohl dünnere als auch dickere Schichten Verwendung finden können. Dünnere Schichten bewirken jedoch im allgemeinen eine unerwünschte Nebenschlußkapazität zwischen der integrierten Schaltung und der Wärmesenke, während dickere Schichten eine schlechte Wärmeleitfähigkeit zu der Wärmesenke ergeben. Deshalb findet bei der Durchführung der Erfindung vorzugsweise eine Schichtdicke der Isolierschicht 18 Verwendung, die mit der zulässigen Nebenschlußkapazität und dem Wärmeverlust verträglich ist.
1 0 9 8 4 kl 1.61 1
. Eine Isolierschicht aus Siliziumnitrit kann z.B. auf die Oberfläche der integrierten Schaltung durch eine thermische
Trennreaktion von entwässertem Ammoniakgas aufgetragen werden, das über die Oberfläche des Plättchens strömt, während dieses
auf eine so hohe Temperatur erhitzt wird, wie es die verschiedenen Schaltungselemente gestatten. Ein derartiges Verfahren ist aus
der US-PS 3, 385 729 bekannt. Schichten aus Siliziumdioxyd
können beispielsweise aufgedampft werden, mit Hilfe von Materialien wie SiH4 und Sauerstoff. Über der Oberfläche der Isolierschicht
wird eine Schicht aus einem Material 19 aufgetragen, welches eine gute thermische Leitfähigkeit und einen niedrigen Ausdehnungskoeffizienten
hat, wie beispielsweise Molybdän, Wolfram oder Legierungen von Molybdän und Wolfram. Die Schicht 19 kann durch
verschiedene bekannte Verfahren ausgebildet werden. Z.B. kann eine Schicht aus Molybdän oder Wolfram auf einer integrierten
Schaltung durch pyrolytische Reduktion von Molybdän-Tetrachlorid (MoCl1-) oder Wolfram-Hexafluorid (WF1O ausgebildet werden, während
die integrierte Schaltung auf einer Temperatur von etwa 5oo C gehalten wird. Wahlweise kann eine Schicht aus Molybdän oder
Wolfram durch Aufsprühen von einer Kathode ausgebildet werden. Diese und andere Verfahren zur Herstellung derartiger Schichten
sind an sich bekannt. Gewünschtenfalls kann eine dünne Schicht aus einem benetzenden Material wie elektrodenlosem Nickel zugesetzt
werden, um die Benetzbarkeit während des Lötvorgangs zu verbessern. Es sei angenommen, daß die Isolierschicht 18
Siliziumnitrit ist und die Schicht 19 aus dem gut wärmeleitenden Material Molybdän. Jede dieser Schichten wird dann durch photolithographische
Ätzverfahren gemustert, oder durch sonstige Verfahren dieser Art, wobei die Molybdän- und Siliziumnitrit-Schichten
in denjenigen Bereichen entfernt werden, wo die einzelnen integrierten Schaltungen voneinander getrennt werden sollen,wobei diejenigen
Bereiche ungeätzt bleiben, welche die einzelnen Schaltungen bedecken. Verfahren zum Ätzen von Metallschichten und Isolierschichten
sind an sich bekannt.
Fig. 4 zeigt das Halbleitersubstrat, nachdem die Molybdän- und
Siliziumnitrit-Schichten in denjenigen Beaichen entfernt sind, wo
1Q9844/1611
"*■ Ό "■"*
die integrierten Schaltungen getrennt werden sollen. Diese Bereiche sind durch die Bezugszeichen 2o und 21 gekennzeichnet.
Fig. 4 zeigt ferner, daß sich die Leiter 22 und 23, welche einen Kontakt zu dem Transistor 12 und dem Widerstand 15 herstelLen,
linear entlang der Oberfläche des Halbleitersubstrate entlang
einem ausreichenden Abstand erstrecken, damit diese Leiter mit Elektroden angrenzender Schaltungen verbunden werden können,
oder mit Elektroden einer sonstigen Einrichtung.
Um die Abtrennung jeder integrierten Schaltung zu vervollständigen,
wird die Oberfläche des Substrats mit einem geeigneten Wachs 24 bedeckt. Das Substrat wird dann umgedreht,
wie in Fig. 5 dargestellt ist. Das Halbleitermaterial 12 kann dann photolithographisch geätzt werden, zwischen diskreten
Schaltungselementen, die sonst elektrisch kurzgeschlossen wären, weil das Halbleiterraaterial vorhanden ist. In entsprechender
Weise kann das Halbleitermaterial 12 zwischen den integrierten Schaltungen entfernt werden. Ferner kann die Dicke des Halbleitermaterials
12 gewünschten Falls verringert werden. Wie in Fig. 5 dargestellt ist, wird das Halbleitersubstrat 12 in
allen Bereichen weggeätzt, ausgenommen in den Bereich^nwelche
den ersten Transistor und den Widerstand 15 umgeben. Jede integrierte Schaltung 11 und die Schaltungselemente werden nun
elektrisch voneinander isoliert, bleiben aber mechanisch miteinander verbunden, aufgrund der Schichten aus Siliziumnitrit
und Molybdän, und sindelektrisch durch die Leiter 22 und 23 verbunden.
Wie in Fig. 6 dargestellt ist, wird dann jede integrierte
Schaltung von dem Wachs befreit und geeignet mit einer Wärmesenke verbunden, vorzugsweise entlang einem Weg mit einem geringen
thermischen Widerstand. Wie dargestellt ist, kann dies durch Verlöten
mit einer ??ärmeserike 25 mit einem geeigneten Eutektikum
oder Lötmittel 26 erfolgen, beispielsweise mit. Au-Si, Au-Ge, Ag-Si, Ag-Ge, Sn oder Pb* In dieser Weise ist eine gemeinsame
thermische Verbindung für alle einzelnen Schaltungselemente geschaffen, wobei die elektrische Isolation dazwischen gewährleistet
109844/1611
ist. Dann kann ein elektrischer Kontakt 27 für den n-leitenden
Bereich des Transistors 12 hergestellt werden, beispielsweise
durch eine Druckausübung bei erhöhter Temperatur. Die freiliegenden
Halbleiteroberflächen können dann mit einem Schutzüberzug 28 überzogen werden, der beispielsweise aus Siliziumdioxyd
besteht. Die Leiter 22 und 23 können beispielsweise mit Elektroden 29 bzw. 3o verbunden sein.
Aus der vorangegangenen Beschreibung ist ersichtlich, daß ein verbessertes Verfahren geschaffen wurde, das eine elektrische
Isolation zwischen integrierten Schaltungen und Schaltungselementen
mit einem gut wärmeleitendem Verbindungsweg zwischen der
integrierten Schaltung und der Wärmesenke ermöglicht. Obwohl das Verfahren die Verbindung mit lediglich zwei integrierten Schaltungen
beschrieben wurde, ist es auch auf kompliziertere Konfigurationen anwendbar, bei denen eine große Anzahl von Schaltungen
und Schaltungselementen elektrisch voneinander isoliert werden sollen. Durch Anwendung dieses Verfahrens wurden die
hauptsächlichen Schwierigkeiten der bekannten Strahl-lßiter-Technologie überwunden.
Wenn eine elektrischeIsolation entweder nicht erforderlich
oder durch andere !Anstände gewährleistet ist, kann der gut
wärmeleitende Verbindungsweg zwischen den Halbleiterelementen und einer Wärmesenke trotzdem entsprechend der Lehre der Erfindung
Verwendung finden.
- Patentansprüche -
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Claims (12)
1.) Verfahren zur Herstellung einer elektrischen Isolation zwischen
Elementen einer integrierten Schaltung aus einem Halbleitersubstrat, wobei eine wärmeleitende Verbindung zu einer Wärmesenke
vorgesehen wird, dadurch gekennzeichnet, daß eine Isolierschicht über der Oberfläche der Elemente der integrierten
Schaltung ausgebildet wird, daß über dieser Isolierschicht eine Schicht aus thermisch gut leitendem Material ausgebildet
wird, daß ausgewählte Teile des Halbleitersubstrats zwischen Elementen der integrierten Schaltung entfernt werden, um
dazwischen eine elektrische Isolation zu gewährleisten, und daß eine Verbindung mit einem niedrigen thermischen Widerstand zwischen
dem gut wärmeleitenden Material und der Wärmesenke ausgebildet wird.
2. Verfahren nach Anspruch 1, dadurch gekennzeichnet,
daß die Isolierschicht eine Dicke zwischen 2.000 und
5.000 R hat.
3. Verfahren nach Anspruch 1, dadurch gekennzeichnet,
daß das gut wärmeleitende Material ein Metall ist.
4. Verfahren nach Anspruch 1, dadurch gekennzeichnet,
daß das gut wärmeleitende Material Molybdän, Wolfram oder eine Legierung von Molybdän und Wolfram ist. ,
5. Verfahren nach Anspruch 1, dadurch gekennzeichnet,
daß die ausgewählten Teile des Halbleitersubstrats durch
ein fotolithografisches Ätzverfahren entfernt werden.
6. Verfahren nach Anspruch 1, dadurch gekennzeichnet,
daß die Isolierschicht aus Siliziumnitrid, Siliziumdioxyd oder Kombinationen von Siliziumnitrid und Siliziumdioxyd
besteht.
7. Verfahren nach Anspruch 1, dadurch gekennzeichnet,
daß nach der Entfernung ausgewählter Teile des Halblei-
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tersubstrats eine Einhüllung der Elemente der integrierten Schaltung
mit einem Schutzüberzug erfolgt.
8. Integrierte Schaltung, die nach einem der vorhergehenden Ansprüche
hergestellt ist und zur Verbindung mit einer Wärmesenke geeignet ist, gekennzeichnet durch ein Halbleitersubstrat,
auf dessen einer Oberfläche Schaltungselemente ausgebildet sind, durch eine Isolierschicht über dieser einen Oberfläche und durch
ein gut wärmeleitendes Material über dieser Isolierschicht, um von den Schaltungselementen entfernte Wärme zu der Wärmesenke zu
leiten.
9. Integrierte Schaltung nach Anspruch 8, dadurch gekennzeichnet, daß das gut wärmeleitende Material
Molybdän, Wolfram oder eine Legierung von Molybdän und Wolfram ist.
10. Integrierte Schaltung nach Anspruch 8, dadurch gekennzeichnet,
daß die Isolierschicht aus Siliziumnitrid, Siliziumdioxyd oder Kombinationen von Siliziumnitrid und
Siliziumdioxyd besteht.
11. Integrierte Schaltung nach Anspruch 10, dadurch g e kennze
ichnet , daß die Isolierschicht eine Dicke zwischen 200 und 5.000 A* hat.
12. Integrierte Schaltung nach Anspruch 10, -dadurch gekennzeichnet,
daß das gut wärmeleitende Material Molybdän, Wolfram oder eine Legierung von Molybdän und Wolfram
ist.
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Leerseite
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0011443A1 (de) * | 1978-11-08 | 1980-05-28 | Hitachi, Ltd. | Integrierte Halbleiterschaltung |
Families Citing this family (13)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3769688A (en) * | 1972-04-21 | 1973-11-06 | Rca Corp | Method of making an electrically-insulating seal between a metal body and a semiconductor device |
JPS62194652A (ja) * | 1986-02-21 | 1987-08-27 | Hitachi Ltd | 半導体装置 |
US4918505A (en) * | 1988-07-19 | 1990-04-17 | Tektronix, Inc. | Method of treating an integrated circuit to provide a temperature sensor that is integral therewith |
GB2222721B (en) * | 1988-08-23 | 1993-07-28 | Nobuo Mikoshiba | Cooling semiconductor devices |
US5280194A (en) * | 1988-11-21 | 1994-01-18 | Micro Technology Partners | Electrical apparatus with a metallic layer coupled to a lower region of a substrate and metallic layer coupled to a lower region of a semiconductor device |
US5202288A (en) * | 1990-06-01 | 1993-04-13 | Robert Bosch Gmbh | Method of manufacturing an electronic circuit component incorporating a heat sink |
US5521420A (en) * | 1992-05-27 | 1996-05-28 | Micro Technology Partners | Fabricating a semiconductor with an insulative coating |
US5403729A (en) * | 1992-05-27 | 1995-04-04 | Micro Technology Partners | Fabricating a semiconductor with an insulative coating |
JPH0798460A (ja) * | 1992-10-21 | 1995-04-11 | Seiko Instr Inc | 半導体装置及び光弁装置 |
US5656547A (en) * | 1994-05-11 | 1997-08-12 | Chipscale, Inc. | Method for making a leadless surface mounted device with wrap-around flange interface contacts |
JPH10508430A (ja) * | 1994-06-09 | 1998-08-18 | チップスケール・インコーポレーテッド | 抵抗器の製造 |
JP2003109773A (ja) * | 2001-07-27 | 2003-04-11 | Semiconductor Energy Lab Co Ltd | 発光装置、半導体装置およびそれらの作製方法 |
US8907473B2 (en) * | 2009-02-02 | 2014-12-09 | Estivation Properties Llc | Semiconductor device having a diamond substrate heat spreader |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
NL275554A (de) * | 1961-04-19 | 1900-01-01 | ||
CH440478A (de) * | 1963-07-01 | 1967-07-31 | Asea Ab | Verfahren zum Herabsetzen der Durchlasspannung in einem gleichrichtenden Halbleiterkörper und Anordnung zur Ausführung des Verfahrens |
US3414968A (en) * | 1965-02-23 | 1968-12-10 | Solitron Devices | Method of assembly of power transistors |
US3343255A (en) * | 1965-06-14 | 1967-09-26 | Westinghouse Electric Corp | Structures for semiconductor integrated circuits and methods of forming them |
US3453722A (en) * | 1965-12-28 | 1969-07-08 | Texas Instruments Inc | Method for the fabrication of integrated circuits |
-
1970
- 1970-04-13 US US27650A patent/US3686748A/en not_active Expired - Lifetime
-
1971
- 1971-04-08 DE DE19712117365 patent/DE2117365A1/de active Pending
- 1971-04-13 FR FR7112918A patent/FR2086028A1/fr not_active Withdrawn
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0011443A1 (de) * | 1978-11-08 | 1980-05-28 | Hitachi, Ltd. | Integrierte Halbleiterschaltung |
Also Published As
Publication number | Publication date |
---|---|
US3686748A (en) | 1972-08-29 |
FR2086028A1 (de) | 1971-12-31 |
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