CN205450869U - 一种多模组之间时钟同步电路 - Google Patents

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谈赛
罗钦
黄翔
韩韬
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Abstract

本实用新型涉及一种多模组之间时钟同步电路,包括:主模组和若干从模组,主模组设置有相连接的CPU芯片和RTC芯片,各从模组均设置有CPU芯片;所述主模组CPU芯片的COM通讯接口与各从模组CPU芯片的COM通讯接口均相连接;所述主模组的RTC芯片INT中断信号输出接口与各从模组的CPU芯片INT信号接口均相连接。本实用新型的同步对时电路结构简单,成本低,对时精度高,资源占用小,对通讯影响小,可靠性高。

Description

一种多模组之间时钟同步电路
技术领域
本实用新型涉及一种多模组之间进行协同工作的时钟同步电路。
背景技术
通常的多模组设备,模组之间需要协同工作,因此多个模组之间需要做到时钟同步。
现有的多模组之间的时钟同步,多是采用普通的通讯信道如RS232,RS485,以太网等发送对时信息完成时钟同步过程,或是采用专用的时钟同步方式如IRIG-B对时。采用普通的通讯信道对时,容易受通讯延时和通讯阻塞的影响,导致时钟同步精度降低,其可靠性也较低,同时对通讯设备资源占用比较高,影响模组间其他信息的交互。而采用专用的IRIG-B对时方式,又大大增加成本。提高***复杂度,对设备维护运行造成不利影响。
实用新型内容
本实用新型的目的是提供一种低成本、对时精度高、资源占用小、可靠性高的时钟同步电路。
本实用新型采取的技术方案为:一种多模组之间时钟同步电路,包括:主模组和若干从模组,主模组设置有相连接的CPU芯片和RTC芯片,各从模组均设置有CPU芯片;所述主模组CPU芯片的COM通讯接口与各从模组CPU芯片的COM通讯接口均相连接;所述主模组的RTC芯片INT中断信号输出接口与各从模组的CPU芯片INT信号接口均相连接。
所述主模组RTC芯片具有闹钟功能。
所述从模组CPU芯片具有INT中断信号接收功能。
所述从模组CPU具有信息暂存和计时功能。
本实用新型的原理:主模组的CPU芯片通过COM通讯接口先向所有从模组CPU芯片发送预备对时的时间值,再通过主模组RTC芯片向从模组CPU发送时钟同步脉冲,从模组接收到时钟同步脉冲,将时钟设置为预备对时的时间值,完成时钟同步设置。
本实用新型的同步对时电路结构简单,成本低,对时精度高,资源占用小,对通讯影响小,可靠性高。
附图说明
图1是本实用新型一个具体实施方式的功能模块图。
图2是本实用新型的工作流程图。
具体实施方式
图1为本实用新型一个具体实施方式的电路原理框图,包括设置于主模组的CPU芯片和RTC芯片(具有闹钟功能)以及设置于n个从模组的CPU芯片。所述主模组CPU芯片的COM通讯接口与所述从模组CPU芯片COM通讯接口相连接,所述主模组的RTC芯片INT中断信号输出接口与所述从模组的CPU芯片INT信号接口(具有INT中断信号接收功能)相连接;所述主模组的CPU芯片与RTC芯片相连接。
图2为上述具体实施方式的工作方式流程图,其时钟同步流程如下:
S1主模组的CPU芯片通过COM通讯接口向各从模组CPU芯片发送预备对时的时间点t0的信息报文;
S2各从模组CPU接收到此信息后,将时间点t0信息暂存;
S3主模组的CPU芯片设置RTC芯片闹钟功能,其闹钟开启时间点设置为t0;
S4当时间点t0到达时,RTC芯片闹钟开启;RTC芯片的INT信号接口电平变换,产生时钟同步脉冲,输出至各从模组CPU芯片的INT信号接口;
S5各从模组CPU芯片的INT信号接口接收到从主模组RTC芯片产生的时钟同步脉冲中断信号后,立即响应,将预先接收的t0时间点信息写入计时器;完成与主模组的时钟同步过程。

Claims (4)

1.一种多模组之间时钟同步电路,其特征在于包括:主模组和若干从模组,主模组设置有相连接的CPU芯片和RTC芯片,各从模组均设置有CPU芯片;所述主模组CPU芯片的COM通讯接口与各从模组CPU芯片的COM通讯接口均相连接;所述主模组的RTC芯片INT中断信号输出接口与各从模组的CPU芯片INT信号接口均相连接。
2.根据权利要求1所述的多模组之间时钟同步电路,其特征在于所述主模组RTC芯片具有闹钟功能。
3.根据权利要求1所述的多模组之间时钟同步电路,其特征在于所述从模组CPU芯片具有INT中断信号接收功能。
4.根据权利要求1或2所述的多模组之间时钟同步电路,其特征在于所述从模组CPU具有信息暂存和计时功能。
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* Cited by examiner, † Cited by third party
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CN112558685A (zh) * 2020-12-11 2021-03-26 南京四方亿能电力自动化有限公司 一种配电终端模块间对时同步的方法

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