CN1320633C - 反熔丝型存储器组件的结构与制造方法 - Google Patents

反熔丝型存储器组件的结构与制造方法 Download PDF

Info

Publication number
CN1320633C
CN1320633C CNB2004100594275A CN200410059427A CN1320633C CN 1320633 C CN1320633 C CN 1320633C CN B2004100594275 A CNB2004100594275 A CN B2004100594275A CN 200410059427 A CN200410059427 A CN 200410059427A CN 1320633 C CN1320633 C CN 1320633C
Authority
CN
China
Prior art keywords
layer
fuse
memory assembly
type
manufacture method
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
CNB2004100594275A
Other languages
English (en)
Other versions
CN1577797A (zh
Inventor
林智明
汪坤发
刘家成
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Taiwan Semiconductor Manufacturing Co TSMC Ltd
Original Assignee
Taiwan Semiconductor Manufacturing Co TSMC Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Taiwan Semiconductor Manufacturing Co TSMC Ltd filed Critical Taiwan Semiconductor Manufacturing Co TSMC Ltd
Priority to CNB2004100594275A priority Critical patent/CN1320633C/zh
Publication of CN1577797A publication Critical patent/CN1577797A/zh
Application granted granted Critical
Publication of CN1320633C publication Critical patent/CN1320633C/zh
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Images

Landscapes

  • Semiconductor Memories (AREA)
  • Design And Manufacture Of Integrated Circuits (AREA)

Abstract

本发明公开了一种反熔丝型存储器组件的结构与制造方法,包括下列步骤:首先,提供一基板并形成一金属层于该基板上。其后,形成一硅层于该金属层上并使该金属层与部分该硅层反应以形成一金属硅化物层且未被反应的硅层做为第一型导电层。接下来,形成一反熔丝层于该第一型导电层上。图形化该第一型导电层、金属硅化物层、反熔丝层以形成字符线并形成一第二型导电层于该反熔丝层上,最后图形化该第二型导电层以形成位线。本发明可以减少多晶硅的沉积步骤,以简化形成金属硅化物的制程,缩减制程时间,减低制造成本及减少传导层的总体阻质。

Description

反熔丝型存储器组件的结构与制造方法
技术领域
本发明涉及一种半导体制程的改进,特别是关于一种改进反熔丝型存储器组件多晶硅和金属硅化物制程的结构与方法。
背景技术
反熔丝型存储器组件是一种三维的存储器组件(即存储器组件),其存储单元是设在二极管的正极和负极之间的反熔丝层以做控制。当反熔丝层完好时,其正极和负极彼此断路,但是当反熔丝层被破坏时,其正极和负极形成二极管,且其线路设计为正极和负极的材料彼此正交。三维结构的反熔丝型存储器组件和传统的二维结构存储器比较,其所需使用的硅积底面积较传统的存储器小,也因此,可以增加存储器的积极度,减少单位面积的成本。此外反熔丝型存储器组件由于具有一次烧录(OTP)的特性,可在保密性上提供较佳的保护。
请参阅图1A至图1D,为公知反熔丝型存储器组件多晶硅的金属硅化物制程的剖面示意图。如图1A所示,金属导线及其导线间介电层制程已完成在半导体基底100上,此处为简略图示予以省略,于金属导线及其导线间介电层上沉积一掺杂P+的多晶硅层,以做为底部多晶硅层110。其后,沉积一无掺杂的多晶硅或非晶硅层做为反应多晶硅层111于底部多晶硅层110上。接着,沉积一钛金属层119及后续的氮化钛层120于无掺杂的多晶硅或非晶硅层111上。
接下来,如图1B所示,使用一快速回火制程,以使反应多晶硅层和钛金属层119及部分氮化钛层120反应形成一钛硅化合物层130。其形成的钛硅化合物层130具有低的导电系数及良好的热稳定性,可减少导线间的阻值。之后,于钛硅化合物上沉积一层掺杂P+的多晶硅层做为第一型导电层135。
后续,如图1C所示,进行一热氧化制程以第一型导电层135上形成一反熔丝层136。其形成的反熔丝层136是做为控制反熔丝型存储器单元的主要组件。其后,定义之前形成的反熔丝层136,钛硅化合物层130,第一型导电层135及底部多晶硅层110以形成字符线,其包括微影,蚀刻及形成导线后于导线间填入介电材料和后续的化学机械研磨制程,其为一般公知的技艺,不在此详加描述。最后,如图1D所示,沉积一掺杂N的多晶硅层做为第二型导电层140,并定义第二型导电层140以形成位线。
请参阅图3所示,其为公知反熔丝型存储器组件多晶硅的金属硅化物制程的立体图,底部多晶硅层110形成在半导体基底100上,其上依序有底部多晶硅层110、钛硅化合物层130、氮化钛层120、第一型导电层135。底部多晶硅层110、钛硅化合物层130和第一型导电层135做为字符线(WL)。第二型导电层140做为位线(BL)且其和第一型导电层135中夹有一反熔丝层136。
此制程在形成钛金属硅化物时,需先沉积一P+的多晶硅层及后续无掺杂的多晶硅或非晶硅层。加热沉积的钛金属层以使钛金属层和其下的无掺杂的多晶硅或非晶硅层反应形成钛金属硅化物层。其后再沉积一层掺杂P+的多晶硅层。其形成第一型导电层的步骤相当繁琐,并且多层的多晶硅沉积必需不断将整批晶圆由先前的反应器取出再置入预进行反应的反应器中,不但步骤繁杂,且需要长时间等待抽真空,以达到标准的反应室压力,相当耗费制程时间。
美国专利申请号第09/560626号揭示了一种低漏电流的存储单元,其中在正极和负极的二极管间放置一反熔丝层,当反熔丝层是完好时,其正极和负极彼此断路,但是当反熔丝层被破坏时,其正极和负极在一小区域的反熔丝层接通,也因此形成二极管,也因为其很小区域的熔丝使其二极管具有很小的范围区域,也因此其具相对小的漏电流。另外美国专利第6525953号揭示一种三维,可程序化,非挥发性的存储单元,其是藉由一自我对准的柱状物,其中包含二极管的正极和负极组件,以及介于其中的反熔丝层,并依此柱状物形成其存储器单元,其运作原理亦是根据反熔丝层是完好和破坏与否,形成电路,并决定储存的数据。
因此,为克服上述公知的方法,即在形成二极管的正极和负极组件皆是使用掺杂的多晶硅的缺点,产生了本发明。
发明内容
本发明要解决的技术问题是提供一种简化的反熔丝型存储器组件的结构和制造方法,其可以减少多晶硅的沉积步骤,以简化形成金属硅化物的制程,缩减制程时间,并减低制造成本。
本发明要解决的另一技术问题是提供一种反熔丝型存储器组件的结构和制造方法,其借着减少一多晶硅层,可以达到减少多晶硅和硅化物层的总体阻质,并藉此增加反熔丝型存储器组件的驱动电流。
为解决上述技术问题,本发明的技术方案是:一种反熔丝型存储器组件的制造方法,包括下列步骤:
提供一基板;
形成一黏合层于该基板上;
形成一金属层于该黏合层上;
形成一硅层于该金属层上;
使该金属层及部分该黏合层与部分该硅层反应以形成一金属硅化物层且未被反应的硅层做为第一型导电层;
形成一反熔丝层于该第一型导电层上;
图形化该第一型导电层、金属硅化物层、反熔丝层以形成字符线;
形成一第二型导电层于该反熔丝层上;以及
图形化该第二型导电层以形成位线。
所述的反熔丝型存储器组件的制造方法,该基板为一半导体基板。
所述的反熔丝型存储器组件的制造方法,该金属层为钛,钴,或是镍所组成。
所述的反熔丝型存储器组件的制造方法,该黏合层为钛的氮化物、钴的氮化物或镍的氮化物。
所述的反熔丝型存储器组件的制造方法,该硅层为依序一未掺杂的多晶硅及一第一型离子掺杂的多晶硅堆栈构成。
所述的反熔丝型存储器组件的制造方法,该金属硅化物层的形成为金属层和该硅层的未掺杂的多晶硅层反应所形成。
所述的反熔丝型存储器组件的制造方法,该第一型导电层是P型且第二型导电层是N型。
所述的反熔丝型存储器组件的制造方法,该第一型导电层是N型且第二型导电层是P型。
所述的反熔丝型存储器组件的制造方法,该金属硅化物层是钛硅化合物,钴硅化合物,或是镍硅化合物所组成。
所述的反熔丝型存储器组件的制造方法,形成一反熔丝层的方法为加热该第一型导电层。
所述的反熔丝型存储器组件的制造方法,该反熔丝层为二氧化硅或是氮化硅。
一种反熔丝型存储器组件的结构,其包括:
一金属硅化物层;
一第一型导电层于该金属硅化物层上;
一反熔丝层于该第一型导电层上;以及
一第二型导电层于该反熔丝层上。
所述的反熔丝型存储器组件的结构,该第一型导电层是P型且第二型导电层是N型。
所述的反熔丝型存储器组件的结构,该第一型导电层是N型且第二型导电层是P型。
所述的反熔丝型存储器组件的结构,该金属硅化物层是钛硅化合物,钴硅化合物,或是镍硅化合物所组成。
所述的反熔丝型存储器组件的结构,该反熔丝层为二氧化硅或是氮化硅。
一种反熔丝型存储器组件的结构,其包括:
一第一导线;
一黏合层位于该第一导线上;
一金属硅化物层位于该黏合层上;
一第一型导电层位于该第一导线上;
一反熔丝层位于该第一型导电层上;以及
一第二型导电层位于一第二导线下,该第一导线和第二导线互相垂直,且该第一型导电层和该第二型导电层中间的反熔丝层是一矩型区域,且只有在该反熔丝层崩裂时第一型导电层和第二型导电层才会形成二极管。
所述的反熔丝型存储器组件的结构,该第一导线和第二导线为钨、铝、或是铜所构成。
所述的反熔丝型存储器组件的结构,该金属硅化物层是钛硅化合物,钴硅化合物,或是镍硅化合物所组成。
所述的反熔丝型存储器组件的结构,该第一型导电层和第二型导电层是P型或是N型。
所述的反熔丝型存储器组件的结构,该第一型导电层和第二型导电层彼此型态不同。
所述的反熔丝型存储器组件的结构,该反熔丝层为二氧化硅或是氮化硅。
所述的反熔丝型存储器组件的结构,该黏合层为钛的氮化物、钴的氮化物或镍的氮化物。
一种反熔丝型存储器组件的制造方法,包括下列步骤:
提供一基板;
形成一金属层于该基板上;
形成一硅层于该金属层上;
使该金属层与部分该硅层反应以形成一金属硅化物层且未被反应的硅层系做为第一型导电层;
形成一反熔丝层于该第一型导电层上;以及
图形化该第一型导电层、金属硅化物层、反熔丝层以形成字符线。
所述的反熔丝型存储器组件的制造方法,该基板为一半导体基板。
所述的反熔丝型存储器组件的制造方法,该金属层为钛,钴,或是镍所组成。
所述的反熔丝型存储器组件的制造方法,该金属层和该基板间尚包含一黏合层。
所述的反熔丝型存储器组件的制造方法,该黏合层为钛的氮化物、钴的氮化物或镍的氮化物。
所述的反熔丝型存储器组件的制造方法,该硅层为依序一未掺杂的多晶硅及一第一型离子掺杂的多晶硅堆栈构成。
所述的反熔丝型存储器组件的制造方法,该金属硅化物层的形成为金属层和该硅层的未掺杂的多晶硅层反应所形成。
所述的反熔丝型存储器组件的制造方法,该金属硅化物层是钛硅化合物,钴硅化合物,或是镍硅化合物所组成。
所述的反熔丝型存储器组件的制造方法,形成一反熔丝层的方法为加热该第一型导电层。
所述的反熔丝型存储器组件的制造方法,该反熔丝层为二氧化硅或是氮化硅。
本发明提供一种简化的反熔丝型存储器组件的结构与制造方法,包括下列步骤:首先,提供一基板并形成一金属层于该基板上。其后,形成一硅层于该金属层上并使该金属层与部分该硅层反应以形成一金属硅化物层且未被反应的硅层做为第一型导电层。接下来,形成一反熔丝层于该第一型导电层上。图形化该第一型导电层、金属硅化物层、反熔丝层以形成字符线并形成一第二型导电层于反熔丝层上,最后图形化第二型导电层以形成位线。
此外本发明又提出一种反熔丝型存储器组件的多晶硅和硅化物结构,其包括:一金属硅化物层、一第一型导电层于该金属硅化物层上、一反熔丝层于该第一型导电层上、以及一第二型导电层于该反熔丝层上。
本发明的特点及优点是:本发明在反熔丝存储器组件的制程中,于在金属导线上沉积一金属层,于其后沉积一反应层,并藉由加热制程,使金属层向上反应形成一金属硅化物,可减少公知技术的多晶硅沉积步骤,以简化形成金属硅化物的制程,缩减制程时间,并减低制造成本。
本发明由于其比公知技术减少一多晶硅层,故其多晶硅和硅化物层的总体阻质较低,可增加反熔丝型存储器组件的驱动电流。
本发明于多晶硅下所形成的金属硅化物层,仅需增加一制程即可减少多晶硅和硅化物层的总体阻质,并藉此增加反熔丝型存储器组件的驱动电流。
附图说明
图1A至图1D为公知反熔丝型存储器组件多晶硅和金属硅化物制程的剖面示意图;
图2A至图2D为本发明实施例的反熔丝型存储器组件多晶硅和金属硅化物制程剖面示意图;
图3为公知反熔丝型存储器组件多晶硅的金属硅化物制程的立体图;
图4为本发明反熔丝型存储器组件多晶硅的金属硅化物制程的立体图。
符号说明:
公知技术:
100、半导体基底  110、底部多晶硅层  111、反应多晶硅层
119、钛金属层      120、氮化钛层      130、钛硅化合物层
135、第一型导电层  136、反熔丝层      140、第二型导电层
本发明技术:
200、半导体基板    210、氮化钛层      212、钛金属层
220、反应多晶硅层  230、第一型导电层  240、钛金属硅化物层
235、反熔丝层      250、第二型导电层
具体实施方式
为了让本发明的技术问题、特征、和优点能更明显易懂,下文特举一较佳实施例,并配合附图,作详细说明如下:
请参阅图2A至图2D,其为本发明简化的反熔丝型存储器组件的制造方法的实施例的制程剖面图。在本实施例的叙述中,基板包括半导体晶圆上已形成的组件,例如闸极等。
首先,如图2A所示,提供一半导体基板200,并且金属导线及其导线间介电层已形成在半导体基板200上,其金属导线可以是铜金属或是钨金属,且其导线间介电层可以是未掺杂的硅玻璃,四乙氧基硅烷为硅源的二氧化硅或是其它介电材料。其后,沉积一氮化钛层210及后续的钛金属层212,氮化钛可应用化学气相沉积法(CVD)或是物理气相沉积法(PVD)的方式形成,钛金属是应用物理气相沉积法(PVD)沉积。氮化钛的厚度为25-250埃,其做为钛硅化合物和其下金属导线的黏合层,钛金属的厚度为200-800埃,其做为之后形成钛硅化合物的来源。
其后,沉积一无掺杂的多晶硅层或非晶硅层做为反应多晶硅层220于钛金属层212上,其应用一化学气相沉积法(CVD),在反应温度在450℃-800℃,反应压力在0.1Torr-10Torr的条件下沉积,其反应多晶硅层220的厚度为200-1500埃,是做为和其下的钛金属层212及部分氮化钛层210反应以形成后续的钛硅化合物层。接下来,于反应多晶硅层上沉积第一型导电层230,其可以是掺杂P+的多晶硅层,亦是应用化学气相沉积法(CVD)形成,但此多晶硅层做为传导及形成二极管作用,需具较低的电阻率,故藉由掺杂以降低其本身的电阻率,所掺杂的杂质为硼或其它三价元素。并且,可在其多晶硅的化学气相沉积(CVD)反应后,藉由一高温扩散法把杂质趋入,或是于沉积后采离子植入的方式,将杂质以离子型态,植入多晶硅内,或是在多晶硅的沉积反应时,同时(In-situ)进行杂质的渗入,其形成的第一型导电层230厚度为300-2000埃。
后续,如图2B所示,以一热制程,其可以是快速加热制程或是炉管制程,在温度为400℃-1200℃,通入惰性气体,以使之前形成的钛/氮化钛层210和反应多晶硅层220反应以形成钛金属硅化物层240,其形成的钛金属硅化物层240具有低阻质及热稳定的特性。
其后,如图2C所示,进行一热制程,其可以是快速加热制程或是炉管制程,在温度为400℃-1200℃,通入氧气,使第一型导电层表面产生二氧化硅层,其二氧化硅层厚度为5-200埃,做为控制反熔丝型存储器组件的反熔丝层235,因此反熔丝层235的品质和均匀性的控制相当的重要。
接着,定义之前形成的反熔丝层235,钛硅化合物层240和第一型导电层230以形成字符线,其包括微影及蚀刻等公知技术在此不详加描述。形成导线后于导线间填入介电材料,其可以是以一高密度电浆(HDP)的化学气相沉积法所形成的二氧化硅,其电浆内的离子浓度较一般的电浆激发化学气相沉积法为浓,故能利用沉积/蚀刻/沉积的方法,具有较佳的沟填能力,可填入形成导线后的间隙中。接下来,以化学机械研磨法(CMP)移除多余的介电层,并使其平坦化。
接下来,如图2D所示,沉积第二型导电层250在反熔丝层235上,其可以是掺杂N+的多晶硅层,是应用一化学气相沉积法(CVD),在反应温度在450℃-800℃,反应压力在0.1Torr-10Torr的条件下沉积,其厚度为1000-6500埃。第二型导电层做为传导及和之前形成的第一型导电层形成二极管作用,所以其亦需较低的电阻率,并且其所掺杂的杂质为砷或其它五价元素。其植入的方法,亦是可藉由高温扩散法把杂质趋入,或是于采用离子植入的方式。需注意的是,第二型导电层250的型态需和之前形成的第一型导电层230相反,易言之,在此步骤沉积的多晶硅层亦可以是P+型,而之前沉积的多晶硅为N+型。
其后,定义第二型导电层250以形成位线,其包括光罩,显影,及蚀刻。形成导线后于导线间填入介电材料,其亦是以一高密度电浆(HDP)的化学气相沉积法所形成的二氧化硅,填入形成导线后的间隙中,其后,以化学机械研磨法(CMP)移除多余的介电层,并使其平坦化。
请参阅图4所示,其为显示本发明反熔丝型存储器组件多晶硅的金属硅化物制程的立体图,钛金属硅化物层240形成在半导体基底200上,其和第一型导电层230做为字符线(WL)且第二型导电层250做为位线(BL)。其中钛金属硅化物层240和半导体基底200间有一氮化钛层210做为黏合作用,且第一型导电层230和第二型导电层250中间有一反熔丝层235。
虽然本发明已以较佳实施例揭露如上,然其并非用以限定本发明,任何熟习此技艺者,在不脱离本发明的构思和范围内,当可作些许的更动与润饰,因此本发明的保护范围当视权利要求书所界定者为准。

Claims (20)

1.一种反熔丝型存储器组件的制造方法,包括下列步骤:
提供一基板;
形成一黏合层于该基板上;
形成一金属层于该黏合层上;
形成一反应多晶硅层于该金属层上;
形成一第一型导电层于该反应多晶硅层上;
使该金属层及部分该黏合层与该反应多晶硅层反应以形成一金属硅化物层;
形成一反熔丝层于该第一型导电层上;
图形化该第一型导电层、金属硅化物层、反熔丝层以形成字符线;
形成一第二型导电层于该反熔丝层上;以及
图形化该第二型导电层以形成位线。
2.如权利要求1所述的反熔丝型存储器组件的制造方法,其特征在于:该基板为一半导体基板。
3.如权利要求1所述的反熔丝型存储器组件的制造方法,其特征在于:该金属层为钛,钴,或是镍所组成。
4.如权利要求1所述的反熔丝型存储器组件的制造方法,其特征在于:该黏合层为钛的氮化物、钴的氮化物或镍的氮化物。
5.如权利要求1所述的反熔丝型存储器组件的制造方法,其特征在于:该反应多晶硅层为依序一未掺杂的多晶硅及一第一型离子掺杂的多晶硅堆栈构成。
6.如权利要求5所述的反熔丝型存储器组件的制造方法,其特征在于:该金属硅化物层的形成为金属层和该反应多晶硅层的未掺杂的多晶硅层反应所形成。
7.如权利要求1所述的反熔丝型存储器组件的制造方法,其特征在于:该第一型导电层是P型且第二型导电层是N型。
8.如权利要求1所述的反熔丝型存储器组件的制造方法,其特征在于:该第一型导电层是N型且第二型导电层是P型。
9.如权利要求1所述的反熔丝型存储器组件的制造方法,其特征在于:该金属硅化物层是钛硅化合物,钴硅化合物,或是镍硅化合物所组成。
10.如权利要求1所述的反熔丝型存储器组件的制造方法,其特征在于:形成一反熔丝层的方法为加热该第一型导电层。
11.如权利要求1所述的反熔丝型存储器组件的制造方法,其特征在于:该反熔丝层为二氧化硅或是氮化硅。
12.一种反熔丝型存储器组件的制造方法,包括下列步骤:
提供一基板;
形成一黏合层于该基板上;
形成一金属层于该黏合层上;
形成一反应多晶硅层于该金属层上;
形成一第一型导电层于该反应多晶硅层上;
使该金属层与该反应多晶硅层反应以形成一金属硅化物层;
形成一反熔丝层于该第一型导电层上;以及
图形化该第一型导电层、金属硅化物层、反熔丝层以形成字符线。
13.如权利要求12所述的反熔丝型存储器组件的制造方法,其特征在于:该基板为一半导体基板。
14.如权利要求12所述的反熔丝型存储器组件的制造方法,其特征在于:该金属层为钛,钴,或是镍所组成。
15.如权利要求12所述的反熔丝型存储器组件的制造方法,其特征在于:该黏合层为钛的氮化物、钴的氮化物或镍的氮化物。
16.如权利要求12所述的反熔丝型存储器组件的制造方法,其特征在于:该反应多晶硅层为依序一未掺杂的多晶硅及一第一型离子掺杂的多晶硅堆栈构成。
17.如权利要求16所述的反熔丝型存储器组件的制造方法,其特征在于:该金属硅化物层的形成为金属层和该反应多晶硅层的未掺杂的多晶硅层反应所形成。
18.如权利要求12所述的反熔丝型存储器组件的制造方法,其特征在于:该金属硅化物层是钛硅化合物,钴硅化合物,或是镍硅化合物所组成。
19.如权利要求12所述的反熔丝型存储器组件的制造方法,其特征在于:形成一反熔丝层的方法为加热该第一型导电层。
20.如权利要求12所述的反熔丝型存储器组件的制造方法,其特征在于:该反熔丝层为二氧化硅或是氮化硅。
CNB2004100594275A 2003-07-22 2004-06-18 反熔丝型存储器组件的结构与制造方法 Expired - Lifetime CN1320633C (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CNB2004100594275A CN1320633C (zh) 2003-07-22 2004-06-18 反熔丝型存储器组件的结构与制造方法

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
CN03146105 2003-07-22
CN03146105.0 2003-07-22
CNB2004100594275A CN1320633C (zh) 2003-07-22 2004-06-18 反熔丝型存储器组件的结构与制造方法

Publications (2)

Publication Number Publication Date
CN1577797A CN1577797A (zh) 2005-02-09
CN1320633C true CN1320633C (zh) 2007-06-06

Family

ID=34593071

Family Applications (1)

Application Number Title Priority Date Filing Date
CNB2004100594275A Expired - Lifetime CN1320633C (zh) 2003-07-22 2004-06-18 反熔丝型存储器组件的结构与制造方法

Country Status (1)

Country Link
CN (1) CN1320633C (zh)

Families Citing this family (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7728390B2 (en) * 2005-05-06 2010-06-01 Taiwan Semiconductor Manufacturing Company, Ltd. Multi-level interconnection memory device
US8067815B2 (en) * 2008-12-11 2011-11-29 Macronix International Co., Lt.d. Aluminum copper oxide based memory devices and methods for manufacture
CN106653729A (zh) * 2015-11-02 2017-05-10 中国科学院微电子研究所 一种反熔丝结构及其制造方法

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5298784A (en) * 1992-03-27 1994-03-29 International Business Machines Corporation Electrically programmable antifuse using metal penetration of a junction
US6420215B1 (en) * 2000-04-28 2002-07-16 Matrix Semiconductor, Inc. Three-dimensional memory array and method of fabrication
US6444558B1 (en) * 1996-08-26 2002-09-03 Micron Technology, Inc. Methods of forming and programming junctionless antifuses
US6525953B1 (en) * 2001-08-13 2003-02-25 Matrix Semiconductor, Inc. Vertically-stacked, field-programmable, nonvolatile memory and method of fabrication
CN2741188Y (zh) * 2003-07-22 2005-11-16 台湾积体电路制造股份有限公司 反熔丝型存储器组件的结构

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5298784A (en) * 1992-03-27 1994-03-29 International Business Machines Corporation Electrically programmable antifuse using metal penetration of a junction
US6444558B1 (en) * 1996-08-26 2002-09-03 Micron Technology, Inc. Methods of forming and programming junctionless antifuses
US6420215B1 (en) * 2000-04-28 2002-07-16 Matrix Semiconductor, Inc. Three-dimensional memory array and method of fabrication
US6525953B1 (en) * 2001-08-13 2003-02-25 Matrix Semiconductor, Inc. Vertically-stacked, field-programmable, nonvolatile memory and method of fabrication
CN2741188Y (zh) * 2003-07-22 2005-11-16 台湾积体电路制造股份有限公司 反熔丝型存储器组件的结构

Also Published As

Publication number Publication date
CN1577797A (zh) 2005-02-09

Similar Documents

Publication Publication Date Title
CN1197161C (zh) 带有竖直晶体管和掩埋字线的半导体器件
CN1290195C (zh) 半导体装置及其制造方法
CN100336227C (zh) 存储单元阵列位线的制法、存储单元阵列及其制造方法
CN1248305C (zh) 制造半导体器件的方法
CN1181534C (zh) 半导体装置的制造方法
CN1783476A (zh) 集成电路的内连线结构
CN1716572A (zh) 非易失性半导体存储器件的制造方法及半导体存储器件
CN1647206A (zh) Mram制程中穿隧接合帽盖层、穿隧接合硬罩幕及穿隧接合堆栈种子层之材料组合
CN1518112A (zh) 半导体器件及其制造方法
CN1667817A (zh) 用于制造垂直dram中的钨/多晶硅字线结构的方法及由此制造的器件
CN1241265C (zh) 半导体装置及其制造方法
CN1202728A (zh) 一种半导体器件及制造该半导体器件的方法
CN1909209A (zh) 制造半导体器件的方法
CN1384539A (zh) 半导体元件的电容器及其制造方法
CN1505155A (zh) 半导体器件及其制造方法
CN1129189C (zh) 非易失性半导体存储器件及其制造工艺
CN1881591A (zh) 铁电存储器件及其制造方法
CN1201393C (zh) 半导体装置及其制造方法
CN1719597A (zh) 制造半导体器件的方法
CN1320633C (zh) 反熔丝型存储器组件的结构与制造方法
CN1532916A (zh) 设有电容器的半导体装置的制造方法
CN1174406A (zh) 半导体集成电路装置的制造方法
CN1219324C (zh) 非易失性半导体存储器及方法
CN1241036A (zh) 半导体装置及其制造方法
CN1574337A (zh) 半导体器件及其制造方法

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
C14 Grant of patent or utility model
GR01 Patent grant
CX01 Expiry of patent term
CX01 Expiry of patent term

Granted publication date: 20070606