CN1296686A - 发送接收装置 - Google Patents

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CN1296686A
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arq control
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arq
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荒牧隆
白崎良昌
须藤浩章
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Abstract

不采用使ARQ控制信息只由序列号构成的结构,而是采用下述结构,包含:最初发生差错的1个序列号、和表示该序列号以后的序列号有无重发请求的比特信息。

Description

发送接收装置
技术领域
本发明涉及发送接收装置，特别涉及在移动通信中通过进行自动重发请求(ARQ)来进行数据传输中的差错控制的发送接收装置及其差错控制方法。
背景技术
作为接收端向发送端请求以任意的数据量为单位(例如，以分组为单位、以信元为单位)进行重发的ARQ方式，众所周知有Stop And Wait ARQ(SW-ARQ)方式、Go Back N ARQ(GBN-ARQ)方式、及Selective Repeat ARQ(SR-ARQ)方式这3种方式。
此外，最近，提出在上述3种方式中将全部重发比指示的序列号(以下，称为“SN”)在时间上更靠后方的已发送分组或信元的GBN-ARQ方式、和只重发指示的SN的分组或信元的SR-ARQ方式进行组合所得的PRIME-ARQ这一方式。
在PRIME-ARQ方式中，接收端将预定的规定数量的与未接收到的分组或信元对应的SN作为ARQ控制信息发回到发送端，发送端根据接收到的ARQ控制信息来重发与指示的SN对应的分组或信元。此外，发送端全部重发指示重发的SN中在时间上最靠后方的SN以后的已发送分组或信元。
以下，用图1及图2来说明PRIME-ARQ方式。图1是进行PRIME-ARQ方式的差错控制的发送接收装置的概略结构方框图，图2是PRIME-ARQ方式的序列的一例的示意图。这里，假设以分组为单位来进行ARQ。
这里，假定单方向的数据发送，将发送接收装置的结构分为发送端和接收端来表示。此外，鉴于本发明的特征，只示出与重发控制有关的结构。
在图1中，发送端包含：发送缓冲器部1，对发送数据分组赋予SN并存储；调制部2，在发送数据分组上附加CRC，进行调制处理；D/A变换器3，对调制处理后的发送信号进行D/A变换处理；发送RF部4，从未图示的天线发送D/A变换后的发送信号；接收RF部5，从未图示的天线接收无线信号；A/D变换器6，对接收信号进行A/D变换；解调处理部7，对A/D变换后的接收信号进行解调处理及CRC校验，提取ARQ控制信息；以及重发控制部8，根据接收信号中的ARQ控制信息，向发送缓冲器部1指示重发请求重发的SN。
另一方面，接收台包含：接收RF部9，从未图示的天线接收无线信号；A/D变换器10，对接收信号进行A/D变换；解调处理部11，对A/D变换后的接收信号进行解调处理及CRC校验；SN判定部12，对解调处理后的接收信号进行数据分组被赋予的SN的校验，进行SN遗漏的判定及SN信息的除去；接收缓冲器部13，存储除去SN信息后的接收信号的数据分组；重发控制信息生成部14，根据SN判定部12的判定结果来生成ARQ控制信息；调制部15，对生成的ARQ控制信息附加CRC，进行调制处理；D/A变换器16，对调制处理后的发送信号进行D/A变换；以及发送RF部17，从未图示的天线发送D/A变换后的发送信号。
首先，说明发送端的操作。输入的发送分组被赋予SN，存储到发送缓冲器部1。存储的发送分组由发送缓冲器部1根据重发控制部8指示的重发SN来输出。从发送缓冲器部1输出的数据分组经调制部2、D/A变换器3及发送RF部4，从未图示的天线发送。
由接收RF部5接收到的信号经A/D变换器6及解调处理部7输入到重发控制部8，向发送缓冲器部1指示请求重发的SN。
接着，说明接收端的操作。由接收RF部9接收到的信号经A/D变换器10及解调处理部11输入到SN判定部12，由SN判定部12根据接收信号的各数据分组被赋予的SN来判定数据分组的遗漏。有遗漏的SN作为判定结果被输出到重发控制信息生成部14。
接收信号中的数据分组的遗漏由重发控制信息生成部14变换为ARQ控制信息并输出。生成的ARQ控制信息经调制部15及D/A变换器16，由发送RF部17从未图示的天线发送。此外，由SN判定部12判定为可接收的数据分组被除去SN，输入到接收缓冲器部13并存储。
接着，用图2来说明PRIME-ARQ方式中序列的一例。
在图2中，在来自发送端的最初的帧发送中，分组#1～#9(SN=1～9)被发送，在接收端示出SN=2、4、5、8的接收失败。
这里，如果假设预定的ARQ控制信息数为3，则接收端用ARQ控制信号来请求重发SN=2、4、5这3个分组。发送端接收ARQ控制信号，重发SN=2、4、5及SN=6以后的已发送分组。接收端忽略已接收的分组。
这样，在PRIME-ARQ方式中，能够用少的数据量来进行多的重发请求，所以比现有的3种方式传输效率提高。
然而，在现有的PRIME-ARQ方式的差错控制中，在能够用重发控制信息表示的SN数以上的突发差错发生的情况下，存在传输效率恶化的问题。此外，如果为了改善差错率而增加重发控制信息的量，则产生传输效率恶化的问题。
发明概述
本发明的目的在于提供一种发送接收装置，能够降低差错率而不使传输效率恶化。
本发明的主题是，在PRIME-ARQ方式中，不采用使ARQ控制信息只由序列号构成的结构，而是采用下述结构，包含：最初发生差错的1个序列号、和表示该序列号以后的序列号有无重发请求的比特信息。
附图的简单说明
图1是进行PRIME-ARQ方式的差错控制的发送接收装置的概略结构方框图；
图2是PRIME-ARQ方式的序列的一例的示意图；
图3是本发明实施例1的发送接收装置的概略结构方框图；
图4是本发明实施例1的序列的一例的示意图；
图5是本发明实施例1的ARQ控制信息的一结构例的示意图；
图6是本发明实施例2的发送接收装置的概略结构方框图；
图7是本发明实施例2的序列的一例的示意图；
图8是本发明实施例2的ARQ控制信息的一结构例的示意图；
图9是本发明实施例2的ARQ控制信息的一结构例的示意图；
图10是本发明实施例2的ARQ控制信息的一结构例的示意图；
图11是本发明实施例3的序列的一例的示意图；
图12是本发明实施例3的ARQ控制信息的一结构例的示意图；
图13是本发明实施例3的ARQ控制信息的一结构例的示意图；
图14是本发明实施例3的ARQ控制信息的一结构例的示意图；
图15是本发明实施例4的序列的一例的示意图；
图16是本发明实施例4的ARQ控制信息的一结构例的示意图；
图17是本发明实施例4的ARQ控制信息的一结构例的示意图；
图18是本发明实施例4的ARQ控制信息的一结构例的示意图；
图19是本发明实施例5的序列的一例的示意图；
图20是本发明实施例5的ARQ控制信息的一结构例的示意图；
图21是本发明实施例5的序列的一例的示意图；
图22是本发明实施例5的ARQ控制信息的一结构例的示意图；
图23是本发明实施例6的序列的一例的示意图；
图24是本发明实施例6的ARQ控制信息的一结构例的示意图；
图25是本发明实施例6的ARQ控制信息的一结构例的示意图；
图26是本发明实施例7的序列的一例的示意图；
图27是本发明实施例7的通信帧的一结构例的示意图；
图28是本发明实施例8的数据分组的通信状态的示意图；
图29是本发明实施例8的数据分组的通信状态的示意图；
图30是本发明实施例8的数据分组的通信状态的示意图；
图31是本发明实施例9的序列的一例的示意图；
图32是本发明实施例10的发送接收装置的概略结构方框图；
图33是本发明实施例10的序列的一例的示意图；
图34是本发明实施例01的序列的一例的示意图；
图35A是本发明实施例10的ARQ控制信息的一结构例的示意图；
图35B是本发明实施例10的ARQ控制信息的一结构例的示意图；
图36是本发明实施例11的发送接收装置的概略结构方框图；
图37是本发明实施例11的发送接收装置的解调处理部及重发控制参数决定部的概略结构方框图；
图38是本发明实施例12的发送接收装置的解调处理部及重发控制参数决定部的概略结构方框图；
图39是本发明实施例13的发送接收装置的解调处理部及重发控制参数决定部的概略结构方框图；
图40是本发明实施例7的发送接收装置的时隙间平均部的概略结构方框图；
图41是本发明实施例14的发送接收装置的时隙间平均部的概略结构方框图；
图42是本发明实施例15的发送接收装置的时隙间平均部的概略结构方框图；以及
图43是本发明实施例16的发送接收装置的时隙间平均部的概略结构方框图。
实施发明的最好形式
以下，参照附图来详细说明本发明的实施例。在以下的所有实施例中，为了简便，假定单方向的数据发送，假设发送接收装置的结构分为发送端和接收端来表示。此外，鉴于本发明的特征，只示出与重发控制有关的结构。
(实施例1)
以下，用图3至图5来说明本实施例的发送接收装置及差错控制方法。图3是本发明实施例1的发送接收装置的概略结构方框图，图4是本发明实施例1的序列的一例的示意图，图5是本发明实施例1的ARQ控制信息的一结构例的示意图。
在图3中，发送端包含：发送缓冲器部101，对发送数据分组赋予SN并存储；调制部102，在发送数据分组上附加CRC，进行调制处理；D/A变换器103，对调制处理后的发送信号进行D/A变换处理；发送RF部104，从未图示的天线发送D/A变换后的发送信号；接收RF部105，从未图示的天线接收无线信号；A/D变换器106，对接收信号进行A/D变换；解调处理部107，对A/D变换后的接收信号进行解调处理及CRC校验，提取ARQ控制信息；位图(ビットマップ)处理部108，根据提取出的ARQ控制信息来判别请求重发的SN；以及重发控制部109，向发送缓冲器部101指示重发请求重发的SN。
另一方面，接收台包含：接收RF部110，从未图示的天线接收无线信号；A/D变换器111，对接收信号进行A/D变换；解调处理部112，对A/D变换后的接收信号进行解调处理及CRC校验；SN判定部113，对解调处理后的接收信号进行数据分组被赋予的SN的校验，进行SN遗漏的判定及SN信息的除去；接收缓冲器部114，存储除去SN信息后的接收信号的数据分组；位图生成部115，根据SN判定部113的判定结果来生成位图形式的ARQ控制信息；调制部116，对生成的ARQ控制信息附加CRC，进行调制处理；D/A变换器117，对调制处理后的发送信号进行D/A变换；以及发送RF部118，从未图示的天线发送D/A变换后的发送信号。
首先，说明发送端的操作。输入的发送分组被赋予SN，存储到发送缓冲器部101。存储的发送分组由发送缓冲器部101根据重发控制部109指示的重发SN来输出。从发送缓冲器部101输出的数据分组经调制部102、D/A变换器103及发送RF部104，从未图示的天线发送。
由接收RF部105接收到的信号经A/D变换器106及解调处理部107输入到位图处理部108，从ARQ控制信息中提取请求重发的SN。提取出的请求重发的SN由重发控制部109指示给发送缓冲器部101。
接着，说明接收端的操作。由接收RF部110接收到的信号经A/D变换器111及解调处理部112输入到SN判定部113，由SN判定部113根据接收信号的各数据分组被赋予的SN来判定数据分组的遗漏。有遗漏的SN作为判定结果被输出到位图生成部115。
接收信号中的数据分组的遗漏由位图生成部115变换为位图形式的ARQ控制信息并输出。生成的ARQ控制信息经调制部116及D/A变换器117，从发送RF部118作为发送信号来发送。此外，由SN判定部113判定为可接收的数据分组被除去SN，输入到接收缓冲器部114并存储。
接着，说明图4的传输序列图。
在发送端，对数据分组#1～#12的数据分组，赋予SN=1～12并发送。然后，在接收端，在SN=2、4、5、8这4个数据分组中发生差错。在接收端，检测SN=2、4、5、8的数据分组的差错，用ARQ控制信息向发送端请求重发该SN=2、4、5、8的数据分组。
ARQ控制信息的比特结构示于图5。ARQ控制信息包含：最初检测出差错的SN、和表示该最初的SN以后的规定数目的数据分组有无重发请求的位图形式的信息。
在图5所示的ARQ控制信息的一实施例中，先头的4比特构成的比特组301被用于表示最初产生差错的SN，这里假设SN=2。构成该比特组301的比特数不限于4比特，而是可以设定为任意的值。
此外，表示最初产生差错的SN的比特组的后续比特组(这里是6比特)表示最初附加的SN以后的SN中有无重发请求。即，这里，比特组301表示SN=2，所以比特302～比特307依次表示SN=3～8的数据分组有无重发请求。例如，如图所示，假设无重发请求用1表示，而有重发请求用0表示。
因此，在图5所示的一实施例中，首先比特组301是SN=2，所以表示SN=2发生差错，此外，比特302、比特305及比特306是1，所以表示SN=3、6、7接收正常，再者，比特303、比特304及比特307是0，所以SN=4、5、8发生差错。
在从接收端接收到这种ARQ控制信息的发送端，重发SN=2、4、5、8的数据分组。此外，与现有的PRIME-ARQ方式同样，由ARQ控制信息指示的SN中在时间上最靠后方的SN(这里，SN=8)以后的已发送SN(这里，只有SN=9)都重发。因此，在发送端，也重发SN=9的数据分组。
因此，假如用现有的PRIME-ARQ方式的ARQ控制信号来表示图4及图5所示的错误发生的一例，如果表示1个SN要用4比特，则需要4比特×4个错误SN=16比特。然而，本实施例的ARQ控制信息通过使用位图形式，发送相同的信息只用4比特(SN=2)+6比特(SN=3～8)=10比特即可。
此外，在现有的ARQ控制信息中，在为了防备更多的差错发生而增加通过ARQ控制信息发送的信息量的情况下，增加1SN需要4比特，而本实施例的使用位图形式的ARQ控制信息中只增加1比特即可。因此，本发明在通过ARQ控制信息表示的SN数越多的情况下越有效果。
这样，根据本发明，不采用由请求重发ARQ重发控制信息的SN组构成的结构，而是由请求重发的一个SN、和表示接续该SN的SN有无重发的位图构成，所以能够不用降低传输效率就能增加重发控制信息量，改善差错率。
表示SN的比特组不限于4比特，可以为任意的比特数。
(实施例2)
本实施例的发送接收装置及差错控制方法具有与实施例1同样的结构，只是使用表示帧内位置的时隙号(位置信息)来取代SN。
SN所用的数值按一定周期重复，但是如果考虑到有重发，则使用到比较大的数值。通常，按照传输***来使用适当的数值。
例如，在HDLC或X.25分组交换传输协议中，使用3比特(模8，序列号0～7)或7比特(模128，序列号0～127)，在PPP(point-Point Protocol，点对点协议)传输协议中，使用24比特(模24，序列号0～224-1)的值，在TCP(Transmission Control Protocol，传输控制协议)传输协议中，使用32比特(模32，序列号0～232-1)的值。
如果SN的值大，则表示SN需要多的比特数，所以在本实施例中，在ARQ控制信息内，使用帧内的位置信息、即时隙号来取代SN。
一帧内的时隙数远远小于SN可取的值，比特数不会很大。例如，如果假设一帧由16时隙构成，则总是能够用4比特来表示所有帧内位置信息。
以下，用图6至图10来说明本实施例的发送接收装置及其差错控制方法。图6是本发明实施例2的发送接收装置的概略结构方框图，图7是本发明实施例2的序列的一例的示意图，图8至图10分别是本发明实施例2的ARQ控制信息的一结构例的示意图。对于与实施例1同样的结构附以同一标号，并且省略其详细说明。
本实施例的ARQ控制信息采用图6所示的比特结构，位于先头的比特组601表示FSN(Slot Number in Frame，帧内时隙号)、即表示帧内位置的时隙号，比特602～比特605表示由比特组601表示的时隙号以后的时隙有无差错。
这里，如图7所示，在包含数据分组#7～#13的帧的发送中，假设数据分组#8、#9、#12发生差错，数据分组#8在帧内位于第2，比特组601表示FSN=2，以下，表示在帧内位于第3至第6的数据分组有无差错的比特602～比特605依次表示0、1、1、0。
在图6中，帧内发送定时控制部401根据解调处理部107的输出来得到帧及时隙的同步，控制重发控制部109，帧位图处理部402对图8所示的本实施例的ARQ控制信息进行解码，知道要重发的分组，帧定时生成部403根据解调处理部112的输出来得到帧及时隙的同步，输出到调制部116。
判定部404从接收信号中选择要请求重发的分组，传递给后述的帧位图生成部405。帧位图生成部405根据判定部404的判定结果来生成图8所示的本实施例的ARQ控制信息。
这样，通过使用FSN，无需对传输的分组或信元赋予SN，就能够减少数据本身的传输量，此外，也能够减少ARQ控制信息所用的比特数，所以传输效率提高。
此外，作为使用FSN的方法，如图9所示，也可以采用使ARQ控制信息只由FSN构成的比特结构。这里，比特组701表示帧内位置为第2的分组产生差错，以下同样，比特组702表示第3分组的差错，比特组703表示第6分组的差错。
此外，作为使用FSN的方法，在图8中，总是使FSN=1，通过进一步省略该固定的FSN=1，如图10所示，也可以采用使ARQ控制信息只由表示从帧内的先头时隙起有无差错的比特构成的比特结构。
这里，比特801表示帧内位置为第1的分组正常接收，比特802表示帧内位置为第2的分组产生差错，以下同样，比特803表示第3分组有差错，比特804表示第4分组正常接收，比特805表示第5分组正常接收，比特806表示第6分组有差错，比特807表示正常接收。
这样，根据本实施例，在ARQ控制信息中，通过使用FSN来取代SN，只需比发送相同ARQ控制信息更少的数据量即可，所以能够提高传输效率。
这里，帧指的是TDMA方式的传输帧、TDMA方式的复传输帧(マルチ伝送フレ一ム)、多个数据分组、连续的数据分组等。
此外，表示FSN的比特组不限于4比特，可以为任意的比特数。
(实施例3)
本实施例的发送接收装置及差错控制方法具有与实施例2同样的结构，只是在ARQ控制信息上附加帧相对号作为表示帧位置的帧号。
在ARQ控制信息中使用FSN的情况下，通过各帧内的位置信息来表示哪个分组发生差错，所以在ARQ控制信息本身产生差错、重发ARQ控制信息的情况下，不能判别是哪个帧的位置信息。
因此，在本实施例中，在使用FSN的ARQ控制信息上附加帧相对号PFN(Previous Frame Number，以前帧号)，能够判别是与几帧前的帧有关的信息。
以下，使用图11至图14来说明本实施例的发送接收装置及差错控制方法。图11是本发明实施例3的序列的一例的示意图，图12至图14分别是本发明实施例3的ARQ控制信息的一结构例的示意图。本实施例的发送接收装置的方框图与图6所示的实施例2的方框图同样，所以这里省略。
图11示出在图中最初的帧中，数据分组#8、#9及#12产生差错，作为该接收状况下的重发请求，如图12所示，接收端采用[PFN=0][FSN=2][0110]这一比特结构。
在图12中，比特组1001是0，表示是与前一帧有关的的信息。如果PFN=1，则表示是与1帧前的帧有关的信息，以下，随着数值增大，表示是与在时间上相应帧前的帧有关的信息。
在图12中，比特组1002与前述的情况同样，表示在帧内位于第2的分组产生差错，比特1003～1006是FSN=2，所以表示FSN=3～6有无差错。
返回到图11，如果与最初的帧有关的ARQ控制信息产生差错，则接收端重发ARQ控制信息。此时，ARQ控制信息的内容即[FSN=2][0110]是与1帧前的帧有关的信息，所以使附加的PFN为1。
这样，通过使用PFN，发送端能够判别是与几帧前的帧有关的ARQ控制信息。
此外，作为使用FSN及PFN的方法，如图13所示，与图9同样，也可以采用使ARQ控制信息只由PFN及FSN构成的比特结构。这里，比特组1101表示是与前一帧有关的信息，比特组1102表示帧内位置为第2的分组产生差错，以下同样，比特组1103表示第3分组的差错，比特组1104表示第6分组的差错。
此外，作为使用FSN及PFN的方法，如图14所示，与图8同样，也可以总是使FSN=1，并且进一步省略该固定的FSN=1，如图14所示，与图10同样，采用使ARQ控制信息只由PFN及表示从帧内的先头时隙起有无差错的比特构成的比特结构。
这里，比特组1201表示是前一帧的信息，比特1202表示帧内位置为第1的分组正常接收，比特1203表示帧内位置为第2的分组产生差错，以下同样，比特1204表示第3分组有差错，比特1205表示第4分组正常接收，比特1206表示第5分组正常接收，比特1207表示第6分组有差错，比特1208表示正常接收。
这样，根据本实施例，在ARQ控制信息中用FSN来传递帧内位置信息发生差错的分组的情况下，接收端在ARQ控制信息上使用作为帧相对号的PFN，从而发送端即使在多个ARQ控制信息产生错误的情况下，也能够简易地判别是与几帧前的帧有关的ARQ控制信息，能够进行适当的重发。
这里，帧指的是TDMA方式的传输帧、TDMA方式的复传输帧、多个数据分组、连续的数据分组等。
此外，表示FSN的比特组及表示PFN的比特组不限于4比特，可以为任意的比特数。
(实施例4)
本实施例的发送接收装置及差错控制方法具有与实施例3同样的结构，只是作为表示帧位置的帧号，使用帧绝对号来取代帧相对号。
在实施例3所示使用帧相对号的情况下，在多个ARQ控制信息产生错误的情况下，产生处理烦杂这一问题。
因此，在本实施例中，将帧同步获得所用的识别号用作帧绝对号FRN(Frame Number)来取代PFN。
帧识别号通常例如用0～15这16个值来表示，如果可取的数值被限定为16个值，则表示其的比特组由4比特构成即可。
以下，用图15至18来说明本实施例的发送接收装置及差错控制方法。图15是本发明实施例4的序列的一例的示意图，图16至图18分别是本发明实施例4的ARQ控制信息的一结构例的示意图。本实施例的发送接收装置的方框图与图6所示的实施例2的方框图同样，所以这里省略。
在图15中示出下述情况：假设图中最初的帧的识别号是8，在该帧的接收中，数据分组#8、#9及#12产生差错，作为该接收状况下的重发请求，如图16所示，接收端采用[FRN=8][FSN=2][0110]这一比特结构。
在图16中，比特组1401是8，表示是与识别号为8的帧有关的信息。比特组1402与前述的情况同样，表示在帧内位于第2的分组产生差错，由于FSN=2，所以比特1403～比特1406表示FSN=3～6有无差错。
这样，通过使用FRN，发送端在多个ARQ控制信息产生错误的情况下，也能够简易地判别是与几帧前的帧有关的ARQ控制信息。此外，表示FRN的比特组使用比表示PFN的比特组少的比特数即可。
此外，作为使用FSN及FRN的方法，如图17所示，与图9同样，也可以采用使ARQ控制信息只由FRN及FSN构成的比特结构。这里，比特组1501表示是与识别号为8的帧有关的信息，比特组1502表示帧内位置为第2的分组产生差错，以下同样，比特组1503表示第3分组的差错，比特组1504表示第6分组的差错。
此外，作为使用FSN及FRN的方法，与图10同样，也可以总是使FSN=1，并且进一步省略该固定的FSN=1，如图18所示，采用使ARQ控制信息只由FRN及表示从帧内的先头时隙起有无差错的比特构成的比特结构。
这里，比特组1601表示是识别号为8的帧的信息，比特1602表示帧内位置为第1的分组正常接收，比特1603表示帧内位置为第2的分组产生差错，以下同样，比特1604表示第3分组有差错，比特1605表示第4分组正常接收，比特1606表示第5分组正常接收，比特1607表示第6分组有差错，比特1608表示正常接收。
这样，根据本实施例，在ARQ控制信息中使用FSN用帧内位置信息来传递发生差错的分组的情况下，接收端在ARQ控制信息中使用帧绝对号即FRN，从而发送端即使在多个ARQ控制信息产生错误的情况下，也能够简易地判别是与哪个帧有关的ARQ控制信息，能够进行适当的重发。
这里，帧指的是TDMA方式的传输帧、TDMA方式的复传输帧、多个数据分组、连续的数据分组等。
此外，表示FSN的比特组及表示FRN的比特组不限于4比特，可以为任意的比特数。
(实施例5)
本实施例的发送接收装置及差错控制方法具有与实施例1同样的结构，只是省略用二进制数来表示SN的比特组的低位比特，削减ARQ控制信息所用的比特数。
以下，用图19至图22来说明本实施例的发送接收装置及差错控制方法。图19及图21分别是本发明实施例5的序列的一例的示意图，图20及图22分别是本发明实施例5的ARQ控制信息的一结构例的示意图。本实施例的发送接收装置的方框图与图6所示的实施例2的方框图同样，所以这里省略。
图19示出在图中最初的帧中、数据分组#2、#4、#5及#8产生差错的情况，作为该接收状况下的重发请求，如图20所示，接收端采用[OSN=1][010]这一比特结构。
这里，OSN (Omitted Sequence Number)是用二进制数来表示SN、并省略低位比特时的值用十进制数来表示所得的值。
在本实施例中，假设省略的是最低位比特即第1比特。例如，SN=2用二进制数来表示，则是“10”。省略其第1比特，则为“1”，将其用十进制来表示，则为OSN=1。此外，例如SN=8用二进制来表示，则是“1000”。省略其第1比特，则为“100”，将其用十进制数来表示，则为OSN=4。即，OSN=1表示SN=2及SN=3两者，而OSN=4表示SN=8及SN=9两者。
在图20中，比特组1801是1，表示SN=2及SN=3中至少一方发生差错，由于在比特组1801中OSN=1，所以比特1802～比特1804分别表示OSN=2～4。比特1802是0，所以表示SN=4及SN=5中至少一方发生差错，比特1803是1，所以表示SN=6及SN=7都被正常接收，比特1804是0，所以表示SN=8及SN=9中至少一方发生差错。
返回到图19，接收到与最初的帧有关的ARQ控制信息的发送端重发图20所示的ARQ控制信息指示的SN=2、3、4、5、8、9。接收端由于SN=3及SN=9已经正常接收，所以将其抛弃。
这样，通过使用OSN，能够减少ARQ控制信息所用的比特数，所以传输效率提高。
此外，作为使用OSN的方法，如图22所示，与图9同样，也可以采用使ARQ控制信息只由OSN构成的比特结构。
例如，如图21所示的序列的一例那样，在最初的帧中SN=2及SN=8发生差错的情况下，作为ARQ控制信息，接收端发送[OSN=1][OSN=4]。
在图22中，比特组2001表示SN=2、3中至少一方发生差错，比特组2002表示SN=8、9中至少一方发生差错。因此，接收到该ARQ控制信息的发送端重发SN=2、3、8、9。接收端由于SN=3、9已正常接收，所以将其抛弃。
这样，根据本实施例，在ARQ控制信息中，通过使用OSN来取代SN，发送相同的ARQ控制信息只需少的数据量即可，所以能够提高传输效率。特别是，OSN能够一次发送连续的SN，所以在差错连续的状况下很有效。
在本实施例中，说明了省略的比特数是1的情况，但是不限于上述情况，也可以省略2以上的低位比特。省略的比特数越多，则能够一次发送的连续SN越多，所以在差错连续的状况下很有效。
这里，帧指的是TDMA方式的传输帧、TDMA方式的复传输帧、多个数据分组、连续的数据分组等。
此外，表示OSN的比特组不限于4比特，可以为任意的比特数。
(实施例6)
本实施例的发送接收装置及差错控制方法具有与实施例5同样的结构，只是在通信中能够改变省略的比特数。
以下，用图23至图25来说明本实施例的发送接收装置及差错控制方法。图23是本发明实施例6的序列的一例的示意图，图24及图25分别是本发明实施例6的ARQ控制信息的一结构例的示意图。本实施例的发送接收装置的方框图与图6所示的实施例2的方框图同样，所以这里省略。
在实施例5中，说明了省略预定比特数个用二进制来表示SN的情况下的低位比特的情况，而在本实施例中，通过使得在通信中可以自适应地改变省略的低位比特数，来进一步提高传输效率。
图23示出在图中最初的帧中、数据分组#2、#4及#5产生差错的情况，作为该接收状况下的重发请求，如图24所示，接收端采用[OMB=1][OSN=1][010]这一比特结构。这里，OMB(Omitted Bits)是表示省略几比特个用二进制数表示的SN的低位比特的值。
例如，如果OMB=2，则省略低位2比特，OSN=1表示SN=4～7。
在图24中，比特组2201是1，表示省略低位1比特，比特组2202是1，表示SN=2、3，比特2203～比特2205分别表示OSN=2～4，比特2203是0，所以表示SN=4及SN=5中至少一方发生差错，比特2204是1，所以表示SN=6及SN=7都被正常接收，比特2205是0，所以表示SN=8及SN=9中至少一方发生差错。
返回到图23，接收到与最初的帧有关的ARQ控制信息的接收端重发图24所示的ARQ控制信息指示的SN=2、3、4、5、8、9。接收端由于SN=3及SN=9已经正常接收，所以将其抛弃。
这样，通过使用OMB及OSN，能够减少ARQ控制信息所用的比特数，所以传输效率提高。
此外，作为使用OMB及OSN的方法，如图25所示，与图22同样，也可以采用使ARQ控制信息只由OSN构成的比特结构。
在图25中，比特组2301表示低位的省略比特数是1，比特组2302表示SN=2、3中至少一方发生差错，比特组2303表示SN=4、5中至少一方发生差错，比特组2304表示SN=8、9中至少一方发生差错。
因此，接收到该ARQ控制信息的发送端重发SN=2、3、4、5、8、9。接收端由于SN=3、9已正常接收，所以将其抛弃。
这样，根据本实施例，在ARQ控制信息中，通过使用OSN来取代SN，并且在通信中可以自适应地改变省略的比特数，用OMB来传递发送端省略的比特数，所以能够提高传输效率。特别是，省略的比特数越多，则能够一次发送的连续SN越多，所以在差错连续的状况下很有效。
这里，帧指的是TDMA方式的传输帧、TDMA方式的复传输帧、多个数据分组、连续的数据分组等。
此外，表示OSN的比特组及表示OMB的比特组不限于4比特，可以为任意的比特数。
(实施例7)
本实施例的发送接收装置及差错控制方法具有与实施例2同样的结构，只是在与多个通信对方台进行通信的情况下用公用信道来发送ARQ控制信息。
以下，用图26及图27来说明本实施例的发送接收装置及差错控制方法。图26是本发明实施例7的序列的一例的示意图，图27是本发明实施例7的通信帧的一结构例的示意图。本实施例的发送接收装置的方框图与图6所示的实施例2的方框图同样，所以这里省略。
在本实施例中，接收端是基站，发送端是多个通信终端(TE1～3)。
在本实施例中，用公用信道对每个信道(每个通信终端)进行差错控制，各通信终端从基站接收公用的ARQ控制信息，发送接收的数据量减少，传输效率提高。
在图26中，在作为接收端的基站中，对最初的帧内的第3分组即来自TE3的分组#1、第4分组即来自TE1的分组#2、第7分组及来自TE2的分组#2检测错误。
因此，基站用公共信道来发送ARQ控制信息[FSN=3][FSN=4][FSN=7]。各通信终端接收该ARQ控制信息，重发指示的帧内位置上的分组。
图27示出1帧内的时隙结构的一例，示出下述情况：在1帧的先头配置公用信道2501，时隙2502、2505被用于TE1，时隙2503、2508及2509被用于TE2，时隙2504、2506及2507被用于TE3。
这样，根据本实施例，作为接收端的基站无需向每个通信对方台发送ARQ控制信息，所以能够提高传输效率。
在本实施例中，说明了ARQ控制信息采用图9所示比特结构的情况，但是在本实施例中接收端从公共信道广播的ARQ控制信息也可以使用前述任一实施例中的ARQ控制信息的结构。
(实施例8)
本实施例的发送接收装置及差错控制方法具有与实施例1同样的结构，只是在规定的数据单位内附加同一SN。
数据处理时的数据单位和发送接收时的数据单位未必一致，例如，实际发送接收的分组是发送接收时的数据单位，通常多个分组合起来才成为有效的数据处理时的数据单位。
因此，在数据处理时的数据单位中即使一个分组产生差错，也不能正常进行数据处理，构成该数据处理时的数据单位的分组即使被正常接收也被抛弃。
因此，如果对每个分组赋予SN，则在数据处理时的数据单位中某个分组产生差错、而请求重发构成该数据处理时的数据单位的所有分组的情况下，必须向发送端指示赋予所有分组的SN。
因此，在本实施例中，将赋予每个分组的SN赋予更上位的数据处理时的每个数据单位。
以下，用图28至图30来说明本实施例的发送接收装置。图28至图30分别是本发明实施例8的数据分组的通信状态的示意图。本实施例的发送接收装置的方框图与图6所示的实施例2的方框图同样，所以这里省略。
图28示出在分组通信中、对每个突发(ノミ一スト)赋予相同的SN的情况。各突发是各个通信台数据，即使缺一个分组，对该通信台来说也不是正常的数据发送接收。因此，赋予同一SN，如果至少一个有差错则全部重发。
此外，图29示出以时隙为单位来赋予相同的SN的情况。各时隙是各个通信台数据，即使缺一个分组，对该通信台来说也不是正常的数据发送接收。因此，赋予同一SN，如果至少一个有差错则全部重发。
此外，图30示出作为上位层例如以IP分组为单位来赋予相同的SN的情况。各IP分组是数据处理时的处理单位，即使缺一个分组，该数据也被抛弃。因此，赋予同一SN，如果至少一个有差错则全部重发。
这样，根据本实施例，不是对作为发送接收时的数据单位的每个分组赋予SN，而是对数据处理时的每个数据单位赋予SN，在处理时的数据单位中即使一个分组产生差错的情况下，如果请求重发一个SN，则能够重发指示该处理时的数据单位的所有分组，能够提高传输效率。
本实施例中的ARQ控制信息也可以使用前述的任一实施例中的ARQ控制信息的结构。
(实施例9)
本实施例的发送接收装置及差错控制方法具有与实施例1同样的结构，只是连续发送使用多个位图形式的ARQ控制信息。
以下，用图31来说明本实施例的发送接收装置及差错控制方法。图31是本发明实施例9的序列的一例的示意图。本实施例的发送接收装置的方框图与图6所示的实施例2的方框图同样，所以这里省略。
图5所示的、使用位图形式的ARQ控制信息的优点是能够用少的比特数来发送多的SN，但是由于是比特串，所以只能发送连续的SN的信息，而在差错离散发生的情况下传输效率恶化。
因此，在本实施例中，缩短比特串的长度，2个连续地发送图5所示的使用位图形式的ARQ控制信息。
图31是本实施例中的序列的一例，示出在图中最初的帧中、数据分组#2、#4、#5、#7、#8产生差错的情况。
假设接收端将图5所示比特结构的比特串缩短为3比特，这里发送2次。在此情况下，ARQ控制信息如图所示，为[SN=2][100][SN=7][SN=010]。这种ARQ控制信息的发送方法产生下述效果：在帧内的分组数多、差错离散发生的情况下使传输效率进一步提高。
这样，根据本实施例，减少使用位图形式的ARQ控制信息的比特结构中的比特串的比特数，并多次发送，所以能够减少ARQ控制信息的比特数，特别是在差错离散发生的情况下，能够提高传输效率。
本实施例中的ARQ控制信息除了上述结构以外，也可以使用前述的任一实施例中的ARQ控制信息的结构。此外，只要是能够应付离散差错的比特结构，则多个ARQ控制信息也可以不必连续发送。
(实施例10)
本实施例的发送接收装置及差错控制方法具有与实施例1同样的结构，只是按照错误的发生状况来改变ARQ控制信息的结构。
以下，用图32至图35来说明本实施例的发送接收装置及差错控制方法。图32是本发明实施例10的发送接收装置的概略结构方框图，图33及图34分别是本发明实施例10的序列的一例的示意图，图35是本发明实施例10的ARQ控制信息的一结构例的示意图。对于与实施例1同样的结构附以同一标号，并且省略其详细说明。
图35A所示的比特结构是在通常的PRIME-ARQ方式的ARQ控制信息的结构(比特组3302及比特组3303)上附加表示识别标志的1比特(比特3301)而得到的，图35B所示的比特结构是在使用位图形式的ARQ控制信息的结构(比特组3305及比特组3306～3309)上附加表示识别标志的1比特(比特3304)而得到的。
如果识别标志是0，则表示按照通常的PRIME-ARQ方式来发送ARQ控制信息，而如果是1，则表示发送使用位图形式的ARQ控制信息。
在图32所示的发送端中，重发控制信息选择部3001根据接收到的ARQ控制信息中的识别标志来判别ARQ控制信息的比特结构，如果是位图形式，则将接收到的ARQ控制信息输出到位图处理部108，而如果是通常的PRIME-ARQ方式的结构，则经选择器3002输出到重发控制部109。
另一方面，在接收端中，重发控制信息判定部3003根据SN判定部113的输出来判别SN的错误是连续的还是离散的，传递给重发控制信息切换部3005。重发控制信息生成部3004根据SN判定部113的输出，生成通常的PRIME-ARQ方式的ARQ控制信息。重发控制信息切换部3005根据重发控制信息判定部3003的输出，来选择性地输出重发控制信息生成部3004生成的通常的PRIME-ARQ方式的ARQ控制信息、或使用位图生成部115生成的位图形式的ARQ控制信息中的某个。
如果假设1帧的分组数为13，则如图33所示，在差错发生的SN是2及12这样离散发生差错的情况下，使用通常的PRIME-ARQ方式传输效率好。此外，如图34所示，在差错是SN=8、10、11这样非离散发生的情况下，使用位图形式传输效率提高。
这样，根据本实施例，按照帧内的错误发生状况来自适应地切换ARQ控制信息的结构，能够提高传输效率。
通过本实施例的发送接收装置及差错控制方法来切换的ARQ控制信息的结构不限于上述2种结构，也可以使用前述任一实施例中的ARQ控制信息的结构。
此外，识别标志不限于1比特。通过使识别标志由2比特以上构成，能够切换2种以上的结构。
此外，也可以不切换ARQ控制信息的种类，而是采用相同的结构，但是增减位图形式的比特数等，增减构成的比特或比特组的数目。
(实施例11)
本实施例的发送接收装置具有与实施例10同样的结构，只是用解调信号的判定误差来估计线路品质，按照线路品质来改变ARQ控制信号所用的比特数。
以下，用图36及图37来说明本实施例的发送接收装置。图36是本发明实施例11的发送接收装置的概略结构方框图，图37是本发明实施例11的发送接收装置的解调处理部及重发控制参数决定部的概略结构方框图。对于与实施例10同样的结构附以同一标号，并且省略其详细说明。
在图36中，重发控制参数决定部3401根据解调处理部的输出来估计接收信号的线路品质，按照估计出的线路品质来控制位图生成部115、重发控制信息生成部3004及重发控制信息切换部3005，按照线路品质来增减通常的PRIME-ARQ方式的ARQ控制信息及使用位图形式的ARQ控制信息所用的比特数或比特组数。
在图37中，解调部3501对接收信号进行解调，判定部3502进行信号点的判定。减法器3503对判定器3502的输入信号和输出信号进行减法处理，计算判定误差，减法器3504对减法器3503输出的判定误差和阈值进行减法处理，判定部3505进行大小判定。
根据该判定结果，在判定误差比规定值多的情况下，判断为线路品质恶劣的状况，而在比规定值少的情况下，判断为线路品质良好的情况。在线路品质恶劣的情况下，通过增加ARQ控制信息所用的比特数或比特组数来改善差错率，而在线路品质良好的情况下，减少比特数或比特组数，提高传输效率。
这样，根据本实施例，按照线路品质来自适应地改变ARQ控制信息所用的比特数或比特组数，所以能够抑制差错率，并且提高传输效率。
(实施例12)
本实施例的发送接收装置具有与实施例11同样的结构，只是对判定误差进行平均化后使用。
以下，用图38来说明本实施例的发送接收装置。图38是本发明实施例12的发送接收装置的解调处理部及重发控制参数决定部的概略结构方框图。对于与实施例11同样的结构附以同一标号，并且省略其详细说明。
在图38中，平均化器3601对减法器3503输出的判定误差进行平均化。
这样，根据本实施例，对判定误差进行平均化后使用，所以能够提高线路品质的检测精度。
(实施例13)
本实施例的发送接收装置具有与实施例12同样的结构，只是在时隙间对判定误差进行平均化后使用。
以下，用图39及图40来说明本实施例的发送接收装置。图39是本发明实施例13的发送接收装置的解调处理部及重发控制参数决定部的概略结构方框图，图40是本发明实施例7的发送接收装置的时隙间平均部的概略结构方框图。对于与实施例12同样的结构附以同一标号，并且省略其详细说明。
在图39中，时隙间平均部3701计算平均化过的各时隙的判定误差的平均值，输出到减法器3504。
在图40中，开关3801按每个时隙来切换输出目的地，存储器3802暂时存储各时隙的平均化过的判定误差，平均化部3803对各时隙的平均化过的判定误差进行平均化处理。
这样，根据本实施例，在时隙间对各时隙中平均化过的判定误差进行平均化，所以能够提高线路品质估计精度。
(实施例14)
本实施例的发送接收装置具有与实施例13同样的结构，只是对1帧前的线路估计值和当前帧的线路估计值进行加权平均。
以下，用图41来说明本实施例的发送接收装置。图41是本发明实施例14的发送接收装置的时隙间平均部的概略结构方框图。对于与实施例13同样的结构附以同一标号，并且省略其详细说明。
在图41中，乘法器3901将当前帧的线路估计值乘以0.1，存储器3902存储1帧前的线路估计值，乘法器3903将1帧前的线路估计值乘以0.9，加法器3904将乘法器3901和乘法器3903的输出相加，输出到减法器3504。
这样，根据本实施例，对1帧前的线路估计值和当前帧的线路估计值进行加权平均，所以能够提高线路品质估计的精度。
(实施例15)
本实施例的发送接收装置具有与实施例14同样的结构，只是使加权平均所用的系数的值可变。
以下，用图42来说明本实施例的发送接收装置。图42是本发明实施例15的发送接收装置的时隙间平均部的概略结构方框图。对于与实施例14同样的结构附以同一标号，并且省略其详细说明。
在图42中，开关4001选择性地输出0.5或0.1，开关4002选择性地输出0.5或0.9。从开关4001及开关4002输出的系数之和总是为1。
这样，根据本实施例，使加权平均所用的系数可变，所以能够加快加权平均处理的收敛速度。
(实施例16)
本实施例的发送接收装置具有与实施例14同样的结构，只是用移位来实现加权平均。
以下，用图43来说明本实施例的发送接收装置。图43是本发明实施例16的发送接收装置的时隙间平均部的概略结构方框图。对于与实施例14同样的结构附以同一标号，并且省略其详细说明。
鉴于如果对数字信号移位1比特则振幅减半，通过使用移位器，能够节省时隙间平均部3701的运算量所需的乘法器。
2比特移位器4101将当前帧的线路估计值移位2比特，成为0.25倍。2比特移位器4102及1比特移位器4103将存储器3902输出的1帧前的线路估计值分别移位2比特、移位1比特，分别成为0.25倍、0.5倍。
加法器4104将2比特移位器4102及1比特移位器4103的输出相加，生成1帧前的线路估计值的0.75倍。最后，加法器3904将2比特移位器4101的输出和加法器4104的输出相加，输出到减法器3504。
这样，根据本实施例，能够用移位来实现加权平均处理，所以能够减少运算量。
在上述实施例1～16中，作为错误校验的方法，举出CRC校验的例子，但是只要能够进行错误判定，则可以是任意的方法。
此外，上述实施例1～16都可以适当组合来实施，而在与发送控制有关的形态中，不问比特表示的数值是SN还是帧号。
如上所述，本发明的发送接收装置采用下述结构，接收最初发生差错的1个序列号、和表示该序列号以后的序列号有无重发请求的比特信息构成的ARQ控制信息，全部重发与该ARQ控制信息指示的序列号对应的分组及上述ARQ控制信息指示的序列号中在时间上最靠后方的序列号以后的号对应的已发送分组。
根据该结构，不采用使ARQ重发控制信息由请求重发的SN组构成的结构，而是由请求重发的一个SN、和表示接续该SN的SN有无重发的位图构成，所以能够增加重发控制信息量而不降低传输效率，能够改善差错率。
本发明的发送接收装置接收最初发生差错的1个帧内位置信息、和表示该帧内位置信息的位置以后的位置信息有无重发请求的比特信息构成的ARQ控制信息，全部重发与该ARQ控制信息指示的位置对应的分组及上述ARQ控制信息指示的位置中在时间上最靠后方的位置以后的号对应的已发送分组。
根据该结构，无需对传输的分组或信元赋予SN，能够减少数据本身的传输量，此外，也能够减少ARQ控制信息所用的比特数，所以传输效率提高。
本发明的发送接收装置在上述结构中采用下述结构，其中，ARQ控制信息包含表示帧位置的帧号。
根据该结构，在用ARQ控制信息由帧内的位置信息来传递发生差错的分组的情况下，接收端在ARQ控制信息中使用帧相对号，从而发送端即使在多个ARQ控制信息产生错误的情况下，也能够简易地判别是与几帧前的帧有关的ARQ控制信息，能够进行适当的重发。
本发明的发送接收装置在上述结构中采用下述结构，其中，删除序列号的规定的低位比特。根据该结构，发送相同的ARQ控制信息只需少的数据量即可，所以能够提高传输效率。
本发明的发送接收装置在上述结构中采用下述结构，其中，自适应地变更删除的低位比特数。根据该结构，在通信中可以自适应地改变省略的比特数，在发送端传递省略的比特数，所以能够进一步提高传输效率。
本发明的发送接收装置在上述结构中采用下述结构，其中，ARQ控制信息用公用信道来发送。根据该结构，无需向每个通信对方台发送ARQ控制信息，所以能够提高传输效率。
本发明的发送接收装置在上述结构中采用下述结构，其中，序列号在规定的数据单位内相同地设定。根据该结构，不是对作为发送接收时的数据单位的每个分组赋予SN，而是对数据处理时的每个数据单位赋予SN，在处理时的数据单位中即使一个分组产生差错的情况下，如果请求重发一个SN，则能够重发指示该处理时的数据单位的所有分组，能够提高传输效率。
本发明的发送接收装置在上述结构中采用下述结构，其中，连续发送多个ARQ控制信息。根据该结构，能够减少ARQ控制信息的比特数，特别是在差错离散发生的情况下，能够提高传输效率。
本发明的发送接收装置在上述结构中采用下述结构，其中，按照错误的发生状况或线路品质来变更ARQ控制信息的结构。根据该结构，能够按照错误发生状况或线路品质来自适应地选择最佳结构，所以能够提高传输效率。
本发明的发送接收装置在上述结构中采用下述结构，其中，按照错误的发生状况或线路品质来变更构成ARQ控制信息的比特数。根据该结构，按照错误发生状况或线路品质来自适应地改变最佳比特数，所以能够提高传输效率。
本发明的差错控制方法接收最初发生差错的1个序列号、和表示该序列号以后的序列号有无重发请求的比特信息构成的ARQ控制信息，全部重发与该ARQ控制信息指示的序列号对应的分组及上述ARQ控制信息指示的序列号中在时间上最靠后方的序列号以后的号对应的已发送分组。根据该方法，能够降低差错率而不使传输效率恶化。
本说明书基于1999年3月10日申请的特愿平11-107032号及1999年3月18日申请的特愿平11-074632号。这些内容全部包含于此。
产业上的可利用性
本发明能够应用于数字无线通信***中的通信终端装置或基站装置。由此，能够进行无线通信，使差错率降低而不使传输效率恶化。

Claims (15)

1、一种发送接收装置，接收表示与发生差错的序列号对应的分组有无重发请求的ARQ控制信息，全部重发与该ARQ控制信息指示的序列号对应的分组及上述ARQ控制信息指示的序列号中在时间上最靠后方的序列号以后的号对应的已发送分组。
2、如权利要求1所述的发送接收装置，其中，ARQ控制信息包含：最初发生差错的1个序列号、和表示该序列号以后的序列号有无重发请求的比特信息。
3、一种发送接收装置，接收最初发生差错的1个帧内位置信息、和表示该帧内位置信息的位置以后的位置信息有无重发请求的比特信息构成的ARQ控制信息，全部重发与该ARQ控制信息指示的位置对应的分组及上述ARQ控制信息指示的位置中在时间上最靠后方的位置以后的号对应的已发送分组。
4、如权利要求1所述的发送接收装置，其中，ARQ控制信息包含表示帧位置的帧号。
5、如权利要求1所述的发送接收装置，其中，删除序列号的规定的低位比特。
6、如权利要求5所述的发送接收装置，其中，自适应地变更删除的低位比特数。
7、如权利要求1所述的发送接收装置，其中，ARQ控制信息用公用信道来发送。
8、如权利要求1所述的发送接收装置，其中，序列号在规定的数据单位内相同地设定。
9、如权利要求1所述的发送接收装置，其中，连续发送多个ARQ控制信息。
10、如权利要求1所述的发送接收装置，其中，按照错误的发生状况或线路品质来变更ARQ控制信息的结构。
11、如权利要求1所述的发送接收装置，其中，按照错误的发生状况或线路品质来变更构成ARQ控制信息的比特数。
12、一种通信终端装置，包括权利要求1所述的发送接收装置。
13、一种基站装置，包括权利要求1所述的发送接收装置。
14、一种差错控制方法，接收表示与发生差错的序列号对应的分组有无重发请求的ARQ控制信息，全部重发与该ARQ控制信息指示的序列号对应的分组及上述ARQ控制信息指示的序列号中在时间上最靠后方的序列号以后的号对应的已发送分组。
15、如权利要求14所述的差错控制方法，其中，ARQ控制信息包含：最初发生差错的1个序列号、和表示该序列号以后的序列号有无重发请求的比特信息。
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