CN1199213A - 液晶显示器件及其数据线驱动电路 - Google Patents

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Abstract

一种液晶显示器件以及一种液晶显示器件的数据线驱动电路,它能够单独地减少视频信号输入与输出之间的差、减少各输出之间的偏差并相应地获得良好的图象质量,它具有多个输出块,各输出块具有串联的用于对输入视频信号采样并将此采样数据保持一恒定时间的采样保持电路,用于将保持的数据作为预定电平的信号输出的驱动电路,以及输出电平调节电路。

Description

液晶显示器件及其数据线驱动电路
本发明涉及液晶显示器件的改进及其用于驱动数据线的数据线驱动电路。
图8示出采用薄膜晶体管(TFT)驱动***的液晶显示器件构造的电路图。
如图8所示，此液晶显示器件1是由薄膜晶体管开关矩阵部分2、栅线驱动电路3、数据线驱动电路4、时序控制电路5、门电路6以及数据线控制电路7构成。
在薄膜晶体管开关矩阵部分2中，薄膜晶体管开关21以矩阵形式排列。
各薄膜晶体管开关21是由薄膜晶体管21a、液晶单元21b、以及计数电极21c构成。此外，各晶体管21a的漏极连到象素电极上。
在同一行中排列的薄膜晶体管开关21的薄膜晶体管21a的栅极连到同一栅线GL1-GLM上，而在同一列中的晶体管21a的源极则连到同一数据线DL1-DLN上。
栅线驱动电路3顺序地将驱动电压加到栅线GL1-GLM上。
数据线驱动电路4具有n个(例如为6)采样和保持电路，在由时序控制电路5的控制信号CTL51控制的时刻将输入视频信号VIN分配给多个为n个数的输出上，在所有的输出都准备好的同一时刻将n个数的信号D1-D1n输出。
图9为数据线驱动电路4的构造的方框图。
如图9所示，数据线驱动电路4是由n个并联联到视频信号VIN的输入端子TIN的采样和保持电路41-1-41-n以及连在采样保持电路41-1-41-n与输出端TOUT1-TOUTn之间的驱动电路42-1-42-n构成。
在图9的数据线驱动电路4中，采样保持电路41-1-41-1n的采样时间和保持时间的开关控制是根据来自时序控制电路5的控制信号CTL51进行的，输入视频信号VIN被分配到多个n个数的输出上，并且n个数的信号D1-D1n在同一时刻经驱动电路42-1-42-n在所有输出被准备好的时刻从输出端TOUT1-TOUTn输出出来。
数据线驱动电路4的n个输出端TOUT1-TOUTn以n个数为单位经构成栅电路6的薄膜晶体管61-1-61-N(N＞n)并联到N个数据线DL1-DLN上。
栅电路6的薄膜晶体管61-1-61-N的栅极以n个为单位连接到数据线控制电路7的控制信号CTL71-CTL7x的输出线上，且薄膜晶体管61-1-61-N顺序地受控以n个为单位而导通。
为何如上所述用以n个为单位驱动数据线DL的方法代替一个一个地进行驱动的原因是：每个点所获分配的时间随着液晶显示器件的精度的改进而变短，且难于对附在数据线(图8中CL所表示的)上的导线电容负载充电(或放电)，并在那一短暂时间内得到稳定的电压。
也就是说，这是因为如果多个(例如n个)点的输出可在同一时间输出，则可获得n倍的时间，这样就可较易获得稳定的电压。
但是，当用此法时，由于分配到各n个数的点上的信号通过不同的采样保持电路和驱动电路，则在输出之中有产生偏差的倾向。
至于偏差的产生，可考虑因采样和保持的下降引起的偏差和因驱动器引起的偏差。
通过参考图10A和10B以及图11进一步考虑此偏差。
例如，如果如图10A所示由一个集成电路IC实现数据线驱动电路，就会有在集成电路内由因特性的差引起的约+50mV的差的可能性。
此外，如果它如图10B所示是在多个集成电路中实现的，则就会有在集成电路内由因特性的差引起的约+100mV的差再加到此差上的可能性。
图11A-11D为视频信号的输入和输出实例的附图。
如图11A所示，当假定输入视频信号为平坦信号时，理想地讲，如图11B所示，输出信号也必须是平坦的。
但在事实上如图10A所示，一个集成电路的输出已变得如图11C所示，并且如图10B所示，多个集成电路的输出变得如图11D所示(注，在图11D中，而在图11B中m＝2)。
由于此输出中的偏差，当在相关领域的数据线驱动电路中采用以n个数为单位驱动数据线DL的方法代替逐个地驱动它们的方法时，如果此数据线驱动电路被用在高等级液晶显示器件中，则会在屏幕上产生重复的垂直条纹图案，因此它的缺点就使图象质量下降。
本发明考虑了上述情况，其目的在于提供液晶显示器件和该液晶显示器件的数据线驱动电路，它能单独地减少视频信号输入与输出之间的偏差、减小输出之间的偏差，进而获得良好的图象质量。
为了实现上述目的，根据本发明的第一个方面，提供一种用于驱动数据线的液晶显示器件的数据线驱动电路，根据输入视频信号，象素开关联到该驱动电路上，其中该电路包括：用于对输入视频信号采样并将采样后的数据保持一恒定时间的采样保持电路；用于将所述采样保持电路的保持数据作为预定电平的信号输出的驱动电路；以及输出电平调节电路，用于将输入视频信号中预定时期内的电压与所述驱动电路的输出信号电压相比较，并将驱动电路的输出信号的电平调节成恒定电平。
根据本发明的第二个方面，提供一种用于驱动多个数据线的液晶显示器的数据线驱动电路，根据输入视频信号，象素开关并联到该驱动电路上，其中该电路包括多个输出块，并且输出块具有：至少一个用于对输入视频信号采样并将采样后的数据保持一预定时期的采样保持电路；用于将所述采样保持电路的保持数据作为预定电平的信号输出的驱动电路；以及输出电平调节电路，用于将在输入视频信号中预定时期的电压与所述驱动电路的输出信号电压相比较，并将驱动电路的输出信号的电平调节到恒定电平；其中输出块的输入端并联到视频信号的输入端，并且输出端联到将被驱动的不同数据线上。
根据本发明的第三个方面，提供一种具有用来驱动数据线的数据线驱动电路的液晶显示器，根据输入视频信号，象素开关被连到该驱动电路上，其中显示器包括：用于对输入视频信号采样并将采样后的数据保持一恒定时间的采样保持电路；用于将所述采样保持电路的保持数据作为预定电平的信号输出的驱动电路；以及输出电平调节电路，用于将输入视频信号中预定时期内的电压与所述驱动电路的输出信号电压相比较，并将驱动电路的输出信号的电平调节成恒定电平。
根据本发明的第四个方面，提供一种具有用于驱动多个数据线的数据线驱动电路的液晶显示器，根据输入视频信号，象素开关并联到该驱动电路上，其中该电路包括多个输出块，并且输出块具有：至少一个用于对输入视频信号采样并将采样后的数据保持一预定时期的采样保持电路；用于将所述采样保持电路的保持数据作为预定电平的信号输出的驱动电路；以及输出电平调节电路，用于将在输入视频信号中预定时期的电压与所述驱动电路的输出信号电压相比较，并将驱动电路的输出信号的电平调节到恒定电平；输出块的输入端并联到视频信号的输入端，并且输出端联到将被驱动的不同数据线上。
在除视频数据时期的预定时期中为视频信号设定比较用电压，而输出电平调节电路将比较用电压与驱动电路的输出信号的电压电平相比较。
除视频数据期的预定时期为在视频信号的水平同步信号的切换期内的预定时期。
视频信号在水平同步信号的每个切换处重复地反相和不反相，且第一比较用电压和第二比较用电压是分别在反相期和非反相期的水平同步信号的切换期内设定的。
此外，还提供了一种用于控制每个输出块的采样保持电路的采样保持时序、以及输出电平调节电路的比较操作时序的控制电路。
根据本发明，输入视频信号被采样和保持在采样和保持电路中，输入到驱动电路中，并作为预定电平的信号输出到数据线上。
此时，驱动电路的输出信号电平与输出电平调节电路的输入视频信号的预定时期的电压相比较，且驱动电路的输出信号的电平被调到恒定电平上。
此外，根据本发明，输入视频信号被输入到输出块上。随后，在每个输出块中，由采样保持电路进行采样和保持，输入到驱动电路，并作为预定电平的信号输出到数据线上。
此时，驱动电路的输出信号的电平与输出电平调节电路中的输入视频信号的预定时期的电压相比较，且驱动电路的输出信号的电平被调节到恒定电平上。
由控制电路控制各输出块的采样和保持电路的采样和保持时序以及输出电平调节电路的比较操作时序。
当视频信号在水平同步信号的每个切换处重复反相和不反相且第一比较用电压和第二比较用电压分别设定在反相期和非反相期的水平同步信号的切换期内时，根据诸如比较用电压的输入时序来控制比较操作的时序。
图1为根据本发明一个实施例的液晶显示器件的电路图；
图2为由图1的4A所表示的数据线驱动电路和实施例的电路图；
图3为用于解释根据本发明构成视频信号的实例和反相及非反相操作的示意图；
图4用于解释数据线驱动电路的输入/输出特性；
图5A-5F为时序图，用于解释由根据本发明的时序控制电路进行的采样和保持操作以及比较操作的时序控制；
图6A和6B为根据本发明而集成的数据线驱动电路的输出波形图；
图7为根据本发明另一实施例的数据线驱动电路的电路图；
图8为使用薄膜晶体管驱动方法构成的液晶显示器件的实例的电路图；
图9为相关领域的数据线驱动电路的构成实例的方框图；
图10A和10B为数据线驱动电路整体构成实例的示意图；
图11A和11D为相关领域的其数据线驱动电路被集成起来的电路的理想输入/输出和实际输出波形的实例示意图。
本发明的液晶显示器件1A使用类似于图8的器件的薄膜晶体管驱动方法，并由其中薄膜晶体管开关是以矩阵形式排列的薄膜晶体管开关矩阵部分2、用于顺序地将驱动电压加到栅线GL1-GLM的栅线驱动电路3、数据线驱动电路4A、时序控制电路5A、门电路6以及数据线控制电路7构成。这些构成元件以类似于图8的电路构造的联接关系出现在液晶显示器件1A中。
应当注意，在薄膜晶体管开关矩阵部分2中的各薄膜晶体管开关21是由薄膜晶体管21a、液晶元件21b和计数电极21c构成。各晶体管21a的漏极连接到像素电极上。在同一行中的薄膜晶体管开关21的薄膜晶体管21a的栅极连到栅线GL1-GLM上，而在同一列中的晶体管21a的源极则连到同一数据线DL1-DLN上。
此外，在本实施例中的视频信号如图3所示对水平同步信号(H)的每个切换时刻重复进行反相和不反相处理。第一比较用电压V1和第二比较用电压V2在反相期和不反相期的水平同步信号的切换期内被设定。
如图2所示，在本发明的数据线驱动电路4A中，与n个输出(在本实施例中n＝3)对应的输出块40-1-40-n并联到视频信号VIN的输入端TIN上。
应当注意，在图2中，为了简化描述，加有输入视频信号VIN的n个块被设定为“3”。电路结构与输出块40-1-40-3的相同，因此只示出输出块40-1的结构。
输出块40-1是由串联的第一和第二采样保持电路(S/H)401-1和401-2、驱动电路402以及输出电平调节电路403构成。
第一采样保持电路40-1是由缓存器电路BUF1、开关电路SW1和电容C1构成。
缓存器电路BUF1的输入连接到视频信号VIN的输入端TIN1上，而输出端则连接到开关电路SW1的固定触点上。开关电路SW1的工作触点b连接到电容C1(连接点将定义为输出节点N1)的一个电极上，而电容C1的其它电极则接地。
当时序控制电路5A的脉冲型控制信号CP1-1为低电平时，开关电路SW1保持断开状态，而当为高电平时则变为导通状态。
当开关电路SW1处于导通状态时，第一采样保持电路401-1处于采样时间。此时，电容C1的电压被充到等于缓冲器电路BUF1的输出电压。
当控制信号CP1-1变为低电平并处于断开状态时，它进入保持期并保持充后的电压。
第二采样保持电路401-2是由缓冲器电路BUF2、开关电路SW2和电容C2构成。
缓冲器电路BUF2的输入连接到第一采样保持电路401-1的输出节点N1，而输出端则连到开关电路SW2的固定触点上。开关电路SW2的工作触点b连到电容C2的一个电极上(两个的连接点将被定义为输出节点N2)，而电容C2的其它电极则接地。
当时序控制电路5A的脉冲型控制信号CP2为低电平时，开关电路SW2则为断开状态，而当为高电平时，则变为导通状态。
当开关电路SW2为导通状态时，第二采样保持电路401-2处于采样期。此时，电容C2的电压被充到等于缓冲电路BUF2的输出电压。
当控制信号CP2为低电平并处于断开状态时，它进入保持期并保持此充后的电压。
驱动电路402在随后提到的输出电平调节电路403的控制下将第二采样保持电路401-2的输出信号保持在预定电平VOUT上，并从输出端VOUT1输出一个信号D1。
驱动电路402的非反相输入端(+)连接到第二采样保持电路401-2的输出节点N2上，而反相输入端(-)则在同一时刻经电阻R2连接到输出电平调节电路403的输出上。
输出电平调节电路403将输入视频信号VIN与由对驱动电路402的输出信号VOUT的电平进行电阻分压所获的电压VOUT′相比较，并将根据差值的信号按消除视频信号VIN与反馈电压VOUT′差的方向加到驱动电路402的反相输入端(-)上。
输出电平调节电路403具体是由电压/电流转换放大器GMA1、电容C3、缓冲电路BUF3、电阻R1-R4以及恒压源VCT构成。
电压/电流转换电路GMA1的反相输入端(-)连到视频信号VIN的输入端TIN1上，非反相输入端(+)连到电阻R3与R4的连接点上，而输出端则连到电容C3的一个电极以及缓冲电路BUF3的输入端上(两个的连接点被定义为输出节点N3)。电容C3其它电极则接地，且缓冲电路BUF3的输出端则经电阻R1连到驱动电路402的反相输入端(-)上。
电阻R4与R3以及恒压源VCT串联在驱动电路402的输出端与地之间。
在输出电平调节电路403中，电压/电流转换电路GMA1具有一个由时序控制电路5A的控制信号CP3控制为导通或断开的开关电路SW3。当开关电路SW3处于导通状态时，输入视频信号VIN的电压电平将与电阻分压的电压VOUT′相比较。
随后，两个电压的差以电流形式输出并在电容C3上转换为电压。节点N3的电压经过缓冲电路BUF3并按消除VIN与VOUT′之间差的方向加到驱动电路402的反相输入端(-)上。
注意，在输出电平调节电路403中，电阻R1和R2被用作提供一定的校正量之用。
此外，电阻R3和R4还用于对VOUT进行R3/(R3+R4)的分压以获得等于VIN的VOUT′，因为当在电压/电流转换电路GMA1上进行电压比较且比较难如愿进行时，驱动电路402的输出信号电压VOUT相对于输入视频信号VIN变为(R1+R2)/R1。
因此，所需的R2/R1＝R4/R3的关系获得满足。
此外，恒压源VCT的电源电压适于定作输入电压范围的中心电压。
通过构成此回路，最后，驱动电路402的输出信号电压VOUT变为一个稳定值，其中，针对输入视频信号VIN的偏差被减少。
另外，在输出电平调节电路403的电压/电流转换电路GMA1中的电压比较将会在视频信号VIN的反相时期和非反相时期进行。
这一点将在下面详述。
当直流型电压不断地加到液晶显示器上时，其工作寿命就会变短，因此其中视频信号VIN被反相成约为每个水平同步信号(H)的参考电压VSIG(例如7伏)并平均来防止直流型电压加上的方法被用作较为主要的方法。
图3示出此时的视频信号的状态。
在视频信号的输入如图3所示的情况下，甚至当用于改进偏差的比较操作仅在非反相时期或反相时期进行的情况下，仍可获得优越的效果。
但在此情况下，如果在输入与输出之间有精细的增益差，就会出现下述情况。
图4用来解释数据线驱动电路的输入/输出特性。
在图4中，由虚线(a)代表的直线为理想的输入/输出特性。
与之相反，图4中的直线(b)是在通过比较输入与本发明的输出进行偏差处理未进行时的输入/输出特性的实例。
假定由(b)所表示的特性除了偏差之外还有细微的增益差。
此处，图4的直线(c)表示仅在非反相时(在点V1，例如3V)在通过比较输入与本发明的输出进行偏差处理时的特性。
如图所见，直线(c)平行地相对于直线(b)移到理想直线(a)附近。整体偏差减少一个量Va。
注意，甚至在非反相期间偏差被消除，因增益差引致的偏差Vb仍在反相期内。
类似地，如果对偏差进行抵制的措施仅在反相的时刻(点V2，例如11V)进行，此时，偏差Vb′仍在非反相期内。这是由图3的直线(d)表示的。
如果偏差象特性线(c)和(d)那样在反相期和非反相期之间不相同，当在观察一个屏幕的点时，视频信号的每个V循环期的输出中会有差出现。这将以一种闪烁情况出现。
在对偏差进行抵制的措施是在非反相(点V1)和反相(点V2)时都进行的情况下进行的，特性则是由直线(e)来表示的。
在此情况下，在非反相时刻的效果和在反相时刻的效果被平衡的点处会有收敛出现。
此时，点V1处的偏差Vc′和点V2处的偏差Vc彼此相等，因此闪烁消失，图象质量得以提高。
由于此原因，在输出电平调节电路403的电压/电流转换电路GMA1中的电压比较是在视频信号VIN的反相期间和非反相期间进行的。
时序控制电路5A通过数据线驱动电路4A的输出块40-1、40-2和40-3的第一和第二采样保持电路401-1和401-2的开关电路SW1和SW2的开/关控制进行采样时间和保持时间的时序控制，并且当用于视频信号的水平同步信号(H)切换的视频数据由时序控制信号CTL51A控制而不存在时，还由输出电平调节电路403的电压/电流转换电路GMA1的开关电路SW3的开/关控制进行电压比较的时序控制。
时序控制电路5A将控制信号CP1-1、CP1-2和CP1-3加到输出块40-1、40-2和40-3上，这样，第一采样和保持电路401-1的开关电路SW1的开/关控制并不同时对输出块40-1、40-2和40-3进行，而是顺序地进行。
接着，在将控制信号CP1-3加到输出块40-3相同的时刻，控制信号CP2被加到输出块40-1-40-3的第二采样和保持电路401-2的开关电路SW2上。
随后，用于使电压/电流转换电路GMA1的开关电路导通的控制信号CP3在同一时刻被加到输出块40-1-40-3上。
图5A-5F为提供时序控制电路5A的控制信号CP1(-1到-3)的时序的时序图。
为了比较包含采样保持电路的电路中输入与输出之间的电压，需要在某个时间T内不断地将恒压加到输入端上。
在图5例子的情况下，时间T必须为T1+T2的格式。
此处，T1为直到视频信号VIN通过第一和第二采样保持电路401-1和401-2并从驱动电路402上输出作为电压VOUT的信号时的时间。如果没有时间T1，将要进行比较的两个信号就未准备好。因此，它是在开始比较之前必须准备的时间。
另外，时间T2是用来比较视频信号VIN与电阻分压VOUT′并对电容C3充电(或放电)的时间。
需要在此时间T内于视频信号中的某处准备一个恒压。由于在水平同步信号(H)的切换时间中有未使用的部分，它可被充足地安放在那里。
注意，时间T2并不是用于一次将电容C3完全充满的时间。此时间可在视频信号VIN的水平同步信号(H)的每个切换时刻分段出现，因此它是一个使充电逐渐进行的时间。
下面解释上述电路结构的操作情况。
首先，用于比较的电压V1通过使用视频信号VIN的水平同步信号(H)的切换期的未用部分而输入到输入端TIN上。在保持此恒定电平一段时间的同时，此电压V1被输入到输入端TIN上。
电压V1被输入到输出块40-1-40-3上，通过由时序控制电路5A的控制信号CP1和CP2受控于开/关状态的第一和第二采样保持电路401-1和401-2的开关电路SW1和SW2的开/关操作，成为电压V1′，并输入到驱动电路402的非反相输入(+)上。
在此应注意，电压V1改变成电压V1′的原因是由采样保持操作产生的下降等影响造成的。
随后，由诸如((R1+R2)/R1)×(R3/(R3+R4)＝1的关系使电压V1′变为电压V1″，并输入到电压/电流转换电路GMA1的非反相输入端(+)。
应当注意，从电压V1′改变成V1″的原因是由驱动电路402产生的偏差影向的结果。
接着，由时序控制电路5A的控制信号CP3使电压/电流转换电路GMA1的开关电路SW3切换到开的状态。
此时，输入电压V1被加到电压/电流转换电路GMA1的反相输入端(-)。
因此，在电压/电流转换电路GMA1中，输入电压V1与反馈电压V1″相比较，且两个电压的差以电流形式输出并在电容C3上转换成电压。节点N3的电压通过缓冲电路BUF3并以消除VIN与VOUT′之差的方向加到驱动电路402的反相输入端(-)上。
例如，如果V1＜V1″，+方向的电压加到电阻R1上，且驱动电路402的输出电压VOUT趋于下降。
接着，借助时序控制电路5A的控制信号CP3，电压/电流转换电路GMA1的开关电路SW3切换到关断状态，且比较操作被终止。
结果，输入端TIN上没有输入的电压V1也没有视频信号输入。在此期间，电阻R1上的电压维持不变。
随后，视频信号结束，且水平同步信号(H)的切换开始。
上述操作是重复地进行的。在V1等于V1″的点处达到稳定。由于此原因，对于输入视频信号VIN具有小的偏差的信号就可在驱动电路402的输出电压VOUT中获得。
事实上，偏差电压可由电压/电流转换电路GMA1的偏差压抑到约+5mV。
此时的输出波形如图6A和图6B所示。
注意，图6A示出如图10A的由一个集成电路输出的情况；图6B示出如图10B的由多个集成电路输出的情况(注意，在图6B中，如图10B所示m＝2)。
此处电压/电流转换电路GMA1的偏差是由差分晶体管的相对特性差产生的而不是由绝对特性产生的。
由于这个原因，多个集成电路中的偏差量决不大于一个集成电路中各输出的偏差，因此图6A和6B所示的输出波形几乎相同。
如上所述，根据本发明的实施例，提供一种用于驱动多个数据线的液晶显示器件的数据线驱动电路4A，根据输入视频信号，象素开关并联到上述驱动电路4A上，其中还提供多个输出块40-1-40-n，它带有串联的采样保持电路401-1和401-2的用于对输入视频信号采样并将采样后的数据保持一恒定时期、用于将采样和保持电路401-2的保持数据作为预定电平的信号输出的驱动电路402、以及用于将驱动电路402的输入视频信号与输出信号电压VOUT中的水平同步信号的切换期中提供的电压V1与V2相比较并将驱动电路的输出信号的电平调节为一恒定电平的输出电平调节电路403，其中输出块40-1-40-n的输入端TIN1-TINn并联到视频信号的输入端TIN上，而输出端TOUT1-TOUTn连到将被驱动的不同数据线上。因此，通过比较输入与输出信号使输出的偏差得以校正，且使多个输出中的偏差得以抑制。
因此，甚至当在高级液晶显示器中使用此数据线驱动电路4A时，在屏幕上也不会出现重复的垂直条纹。此外，还有一个优点就是可以减少闪烁。
注意，在本实施例中，只描述了输出块中的两个采样保持电路串联的情况，但是不用多说，本发明是完全可以适用于任意K个采样保持电路相串联的情况的。

Claims (20)

1.一种用于驱动数据线的液晶显示器件的数据线驱动电路，根据输入视频信号，象素开关联到该驱动电路上，其特征在于该电路包括：
用于对输入视频信号采样并将采样后的数据保持一恒定时间的采样保持电路；
用于将所述采样保持电路的保持数据作为预定电平的信号输出的驱动电路；以及
输出电平调节电路，用于将输入视频信号中预定时期内的电压与所述驱动电路的输出信号电压相比较，并将驱动电路的输出信号的电平调节成恒定电平。
2.如权利要求1的液晶显示器的数据线驱动电路，其特征在于：
比较用的电压在除所述视频信号的视频数据时期外的预定时期内被设定；以及
所述输出电平调节电路将所述比较用电压与所述驱动电路的输出信号的电压电平相比较。
3.如权利要求2的液晶显示器的数据线驱动电路，其特征在于：
除所述视频数据时期外的预定时期是在视频信号的水平同步信号切换时期内的预定时期。
4.如权利要求3的液晶显示器的数据线驱动电路，其特征在于：
所述视频信号在水平同步信号的每个切换处重复地反相和不反相，并且
第一比较用电压和第二比较用电压在反相时期和非反相时期的水平同步信号的切换期中被设定。
5.一种用于驱动多个数据线的液晶显示器的数据线驱动电路，根据输入视频信号，象素开关并联到该驱动电路上，其特征在于该电路包括多个输出块，并且输出块具有：
至少一个用于对输入视频信号采样并将采样后的数据保持一预定时期的采样保持电路；
用于将所述采样保持电路的保持数据作为预定电平的信号输出的驱动电路；以及
输出电平调节电路，用于将在输入视频信号中预定时期的电压与所述驱动电路的输出信号电压相比较，并将驱动电路的输出信号的电平调节到恒定电平；
输出块的输入端并联到视频信号的输入端，并且
输出端联到将被驱动的不同数据线上。
6.如权利要求5的液晶显示器的数据线驱动电路，其特征在于：
比较用电压是在除所述视频信号的视频数据时期的预定时期内设定的；以及
每个所述输出块的所述输出电平调节电路将所述比较用电压与所述驱动电路的输出信号的电压电平相比较。
7.如权利要求6的液晶显示器的数据线驱动电路，其特征在于：
除所述视频数据时期的预定时期为在视频信号的水平同步信号的切换期内的预定时期。
8.如权利要求7的液晶显示器的数据线驱动电路，其特征在于：
所述视频信号在水平同步信号的每个切换处重复地反相和不反相，并且
第一比较用电压和第二比较用电压在反相时期和非反相时期的水平同步信号的切换期中被设定。
9.如权利要求5的液晶显示器的数据线驱动电路，其特征在于还包括：
用于控制采样电路的采样保持时序和每个所述输出块的输出电平调节电路的比较操作时序的控制电路。
10.如权利要求8的液晶显示器的数据线驱动电路，其特征在于还包括：
用于控制采样电路的采样保持时序和每个所述输出块的输出电平调节电路的比较操作时序的控制电路。
11.一种具有用来驱动数据线的数据线驱动电路的液晶显示器，根据输入视频信号，象素开关被连到该驱动电路上，其特征在于所述显示器包括：
用于对输入视频信号采样并将采样后的数据保持一恒定时间的采样保持电路；
用于将所述采样保持电路的保持数据作为预定电平的信号输出的驱动电路；以及
输出电平调节电路，用于将输入视频信号中预定时期内的电压与所述驱动电路的输出信号电压相比较，并将驱动电路的输出信号的电平调节成恒定电平。
12.如权利要求11的液晶显示器的数据线驱动电路，其特征在于：
比较用的电压在除所述视频信号的视频数据时期外的预定时期内被设定；以及
所述输出电平调节电路将所述比较用电压与所述驱动电路的输出信号的电压电平相比较。
13.如权利要求12的液晶显示器的数据线驱动电路，其特征在于：
除所述视频数据时期外的预定时期是在视频信号的水平同步信号切换时期内的预定时期。
14.如权利要求13的液晶显示器的数据线驱动电路，其特征在于：
所述视频信号在水平同步信号的每个切换处重复地反相和不反相，并且
第一比较用电压和第二比较用电压在反相时期和非反相时期的水平同步信号的切换期中被设定。
15.一种具有用于驱动多个数据线的数据线驱动电路的液晶显示器，根据输入视频信号，象素开关并联到该驱动电路上，其特征在于该电路包括多个输出块，并且输出块具有：
至少一个用于对输入视频信号采样并将采样后的数据保持一预定时期的采样保持电路；
用于将所述采样保持电路的保持数据作为预定电平的信号输出的驱动电路；以及
输出电平调节电路，用于将在输入视频信号中预定时期的电压与所述驱动电路的输出信号电压相比较，并将驱动电路的输出信号的电平调节到恒定电平；
输出块的输入端并联到视频信号的输入端，并且
输出端联到将被驱动的不同数据线上。
16.如权利要求15的液晶显示器的数据线驱动电路，其特征在于：
比较用电压是在除所述视频信号的视频数据时期的预定时期内设定的；以及
每个所述输出块的所述输出电平调节电路将所述比较用电压与所述驱动电路的输出信号的电压电平相比较。
17.如权利要求16的液晶显示器的数据线驱动电路，其特征在于：
除所述视频数据时期的预定时期为在视频信号的水平同步信号的切换期内的预定时期。
18.如权利要求17的液晶显示器的数据线驱动电路，其特征在于：
所述视频信号在水平同步信号的每个切换处重复地反相和不反相，并且
第一比较用电压和第二比较用电压在反相时期和非反相时期的水平同步信号的切换期中被设定。
19.如权利要求15的液晶显示器的数据线驱动电路，其特征在于还包括：
用于控制采样电路的采样保持时序和每个所述输出块的输出电平调节电路的比较操作时序的控制电路。
20.如权利要求18的液晶显示器的数据线驱动电路，其特征在于还包括：
用于控制采样电路的采样保持时序和每个所述输出块的输出电平调节电路的比较操作时序的控制电路。
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