CN116092432A - 像素驱动电路及其驱动方法、显示面板和显示装置 - Google Patents

像素驱动电路及其驱动方法、显示面板和显示装置 Download PDF

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Abstract

本申请涉及一种像素驱动电路及其驱动方法、显示面板和显示装置。该像素驱动电路包括：第一开关单元、第二开关单元、第三开关单元、第四开关单元与驱动晶体管；第一开关单元第一端连接电源，第二端连接驱动晶体管的漏极，控制端输入第一开关控制信号；驱动晶体管的源极连接第二开关单元的第一端，第二开关单元的第二端为电路的输出端，控制端输入第二开关控制信号；驱动晶体管的漏极还连接第三开关单元第一端，第三开关单元第二端连接驱动晶体管的栅极，第三开关单元的控制端输入第三开关控制信号；第四开关单元第一端输入数据信号，第二端连接驱动晶体管的源极，控制端输入第四开关控制信号。本申请可使像素在发光时更不容易出现色差或亮度差。

Description

像素驱动电路及其驱动方法、显示面板和显示装置
技术领域
本发明涉及显示技术领域，具体涉及一种像素驱动电路及其驱动方法、显示面板和显示装置。
背景技术
相关技术中，OLED(Organic Light Emitting Diode，有机发光二极管)显示面板能够发光是由驱动TFT(Thin Film Transistor，薄膜场效应晶体管)在饱和状态时产生的电流所驱动，因为输入相同的灰阶电压时，不同的临界电压会产生不同的驱动电流，造成电流的不一致性。
然而，驱动TFT的阈值电压会随着显示器的长时间工作而发生漂移，而OLED的发光亮度与该阈值电压密切相关。因此，驱动TFT的阈值电压变化会极大地影响OLED的发光亮度。也就是说，驱动TFT的阈值电压的变化都会影响OLED的亮度均匀性。
发明内容
本申请的目的在于提供一种像素驱动电路及其驱动方法、显示面板和显示装置，可以消除驱动晶体管的阈值电压对驱动电流的影响，进而减小驱动电流的偏差，最终使得像素在发光时更不容易出现色差或亮度差。
根据本申请实施例的第一方面，提供一种像素驱动电路，包括：第一开关单元、第二开关单元、第三开关单元、第四开关单元以及驱动晶体管；
所述第一开关单元的第一端连接电源，所述第一开关单元的第二端连接所述驱动晶体管的漏极，所述第一开关单元的控制端用于输入第一开关控制信号；所述驱动晶体管的源极连接所述第二开关单元的第一端，所述第二开关单元的第二端为所述像素驱动电路的输出端，所述第二开关单元的控制端用于输入第二开关控制信号；
所述驱动晶体管的漏极还连接所述第三开关单元的第一端，所述第三开关单元的第二端连接所述驱动晶体管的栅极，所述第三开关单元的控制端用于输入第三开关控制信号；
所述第四开关单元的第一端用于输入数据信号，所述第四开关单元的第二端连接所述驱动晶体管的源极，所述第四开关单元的控制端用于输入第四开关控制信号。
在一种实施方式中，所述驱动晶体管为N型晶体管。所述第三开关控制信号、所述第四开关控制信号与所述第一开关控制信号相同；所述第三开关单元的控制端与所述第四开关单元的控制端连接。
在一种实施方式中，所述第一开关单元包括第一晶体管，所述第一晶体管的第一端为所述第一开关单元的第一端，所述第一晶体管的第二端为所述第一开关单元的第二端，所述第一晶体管的控制端为所述第一开关单元的控制端。所述第一晶体管为P型晶体管，所述第一晶体管的第一端为源极，所述第一晶体管的第二端为漏极，所述第一晶体管的控制端为栅极。
在一种实施方式中，所述第二开关单元包括第二晶体管，所述第二晶体管的第一端为所述第二开关单元的第一端，所述第二晶体管的第二端为所述第二开关单元的第二端，所述第二晶体管的控制端为所述第二开关单元的控制端。所述第二晶体管为N型晶体管，所述第二晶体管的第一端为漏极，所述第二晶体管的第二端为源极，所述第二晶体管的控制端为栅极。
在一种实施方式中，所述第三开关单元包括第三晶体管，所述第三晶体管的第一端为所述第三开关单元的第一端，所述第三晶体管的第二端为所述第三开关单元的第二端，所述第三晶体管的控制端为所述第三开关单元的控制端。所述第三晶体管为N型晶体管，所述第三晶体管的第一端为漏极，所述第三晶体管的第二端为源极，所述第三晶体管的控制端为栅极。
在一种实施方式中，所述第四开关单元包括第四晶体管，所述第四晶体管的第一端为所述第四开关单元的第一端，所述第四晶体管的第二端为所述第四开关单元的第二端，所述第四晶体管的控制端为所述第四开关单元的控制端。所述第四晶体管为N型晶体管，所述第四晶体管的第一端为源极，所述第四晶体管的第二端为漏极，所述第四晶体管的控制端为栅极。
在一种实施方式中，所述驱动晶体管工作时输出的驱动电流为：
Figure BDA0004124167550000021
其中，I为所述驱动电流，μ是电子迁移率，COX是单位面积的栅氧电容，
Figure BDA0004124167550000022
为所述驱动晶体管的宽长比，Vdata为所述数据信号的电压，VANODE为所述像素驱动电路的输出端的电压，VTH为所述驱动晶体管的阈值电压，α的计算式如下：
Figure BDA0004124167550000031
其中，CPG为所述驱动晶体管的栅极的寄生电容，CPS为所述驱动晶体管的源极的寄生电容。
根据本申请实施例的第二方面，提供一种上述的像素驱动电路的驱动方法，包括：
在第一时间段内，所述第一开关单元与所述第二开关单元断开、所述第三开关单元与所述第四开关单元闭合，向所述第四开关单元的第一端输入数据信号，以使所述驱动晶体管进行数据存储；
在第二时间段内，所述第一开关单元与所述第二开关单元闭合、所述第三开关单元与所述第四开关单元断开，以使所述驱动晶体管进行工作，输出驱动电流；所述第二时间段位于所述第一时间段之后。
根据本申请实施例的第三方面，提供一种显示面板，包括：发光元件以及上述的像素驱动电路，所述像素驱动电路与所述发光元件连接，并向所述发光元件输入驱动电流，驱动所述发光元件发光。
根据本申请实施例的第四方面，提供一种显示装置，包括：供电组件以及上述的显示面板；所述供电组件与所述显示面板连接，用于为所述显示面板供电。
与现有技术相比，本申请的有益效果在于：由于像素驱动电路包括第一开关单元、第二开关单元、第三开关单元、第四开关单元以及驱动晶体管，且第一开关单元的第一端连接电源，第一开关单元的第二端连接驱动晶体管的漏极，第一开关单元的控制端用于输入第一开关控制信号，驱动晶体管的源极连接第二开关单元的第一端，第二开关单元的第二端为像素驱动电路的输出端，第二开关单元的控制端用于输入第二开关控制信号，驱动晶体管的漏极还连接第三开关单元的第一端，第三开关单元的第二端连接驱动晶体管的栅极，第三开关单元的控制端用于输入第三开关控制信号，第四开关单元的第一端用于输入数据信号，第四开关单元的第二端连接驱动晶体管的源极，第四开关单元的控制端用于输入第四开关控制信号，这样，可以通过第一开关控制信号、第二开关控制信号、第三开关控制信号以及第四开关控制信号，实现在第一时间段内第一开关单元与第二开关单元断开、第三开关单元与第四开关单元闭合，向第四开关单元的第一端输入数据信号，以使驱动晶体管进行数据存储，在第二时间段内，控制第一开关单元与第二开关单元闭合、第三开关单元与第四开关单元断开，以使驱动晶体管进行工作，输出驱动电流，且驱动电流的计算式中不存在驱动晶体管的阈值电压，即可以消除驱动晶体管的阈值电压对驱动电流的影响，进而减小驱动电流的偏差，最终使得像素在发光时更不容易出现色差或亮度差。
附图说明
图1是根据相关技术示出的一种像素驱动电路的结构示意图。
图2是图1所示的像素驱动电路采用的时序图。
图3是图1所示的像素驱动电路的驱动电流的蒙特卡洛仿真的结果示意图。
图4是根据一示例性实施例示出的一种像素驱动电路的结构示意图。
图5是图4所示的像素驱动电路的驱动电流的蒙特卡洛仿真的结果示意图。
图6是图4所示的像素驱动电路采用的时序图。
图7是根据一示例性实施例示出的一种像素驱动电路的驱动方法的流程图。
图8是根据一示例性实施例示出的一种显示面板的结构示意图。
具体实施方式
除非另作定义，在本说明书和权利要求书中使用的技术术语或者科学术语应当为本发明所属技术领域内具有一般技能的人士所理解的通常意义。以下将结合附图描述本发明的具体实施方式，需要指出的是，在这些实施方式的具体描述过程中，为了进行简明扼要的描述，本说明书不可能对实际的实施方式的所有特征均作详尽的描述。在不偏离本发明的精神和范围的情况下，本领域技术人员可以对本发明的实施方式进行修改和替换，所得实施方式也在本发明的保护范围之内。
相关技术中，如图1所示，成熟使用的OLED(Organic Light-Emitting Diode，有机发光二极管)的驱动电路结构是由晶体管M01、晶体管M02共2个MOS(Metal-Oxide-Semiconductor Field-Effect Transistor，金氧半场效晶体管)组成的，晶体管M02用于驱动OLED发光，可称为驱动管。其中，VDATA为数据信号，NG为行同步信号，VDDP为电源信号，OUTPUT为输出信号。该驱动电路的工作时序，如图2所示。OLED的驱动电流的公式为下式(1)：
Figure BDA0004124167550000051
其中，μ是电子迁移率，COX是单位面积的栅氧电容，
Figure BDA0004124167550000052
为驱动管的宽长比，VDATA为数据信号的电压，VANODE为OLED的阳极电压，VTH为驱动管的阈值电压。
一旦NG处于高电平状态，驱动管的栅极G的电压就是VDATA，而源极S的电压是VANODE。
因为上述的式(1)是没有补偿时序的，所以驱动电流会受到VTH的影响，因为VDATA和VANODE在仿真情况下是理想的，这个公式只会因为VTH的偏差而出现偏差。所以经过蒙特卡洛仿真的时候，如图3所示，正态分布的方差(也就是每一格的刻度)为96.2974pA，平均值为2.5065nA，与平均值相比，方差约为5％的幅度，比较大。其中，图3中，横轴为电流值，单位为nA，纵轴为样本号。偏差比较大的话会导致驱动芯片的电流会出现较大偏差，进而在驱动显示屏显示时，更容易出现色差或者亮度差。
为解决上述技术问题，本申请提供一种像素驱动电路及其驱动方法、显示面板和显示装置，可以消除驱动晶体管的阈值电压对驱动电流的影响，进而减小驱动电流的偏差，最终使得像素在发光时更不容易出现色差或亮度差。
图4是根据一示例性实施例示出的一种像素驱动电路的结构示意图。该像素驱动电路，用于驱动OLED发光。请参见图4，该像素驱动电路，包括第一开关单元C1、第二开关单元C2、第三开关单元C3、第四开关单元C4以及驱动晶体管M0。
如图4所示，第一开关单元C1的第一端连接电源，第一开关单元C1的第二端连接驱动晶体管M0的漏极D，第一开关单元C1的控制端用于输入第一开关控制信号KA1；驱动晶体管M0的源极S连接第二开关单元C2的第一端，第二开关单元C2的第二端为像素驱动电路的输出端OUTPUT，第二开关单元C2的控制端用于输入第二开关控制信号KA2。像素驱动电路的输出端OUTPUT用于与发光元件连接。
驱动晶体管M0的漏极D还连接第三开关单元C3的第一端，第三开关单元C3的第二端连接驱动晶体管M0的栅极G，第三开关单元C3的控制端用于输入第三开关控制信号KA3。
第四开关单元C4的第一端用于输入数据信号VDATA，第四开关单元C4的第二端连接驱动晶体管M0的源极S，第四开关单元C4的控制端用于输入第四开关控制信号KA4。
在本实施例中，第一开关控制信号KA1用于控制第一开关单元C1断开与闭合，第二开关控制信号KA2用于控制第二开关单元C2断开与闭合，第三开关控制信号KA3用于控制第三开关单元C3断开与闭合，第四开关控制信号KA4用于控制第四开关单元C4断开与闭合。
在本实施例中，可以在第一时间段内，控制第一开关单元C1与第二开关单元C2断开、第三开关单元C3与第四开关单元C4闭合，向第四开关单元C4的第一端输入数据信号VDATA，以使驱动晶体管M0进行数据存储。
在第一时间段内，驱动晶体管M0的源极S的电压为Vdata，即B点的电压为Vdata，驱动晶体管M0的栅极G的电压，即C点的电压，为Vdata+VTH-α*Vdata，其中，Vdata为数据信号VDATA的电压，VTH为驱动晶体管M0的阈值电压，α的计算式如下：
Figure BDA0004124167550000061
其中，CPG为驱动晶体管M0的栅极G的寄生电容，CPS为驱动晶体管M0的源极S的寄生电容。
然后，在第二时间段内，控制第一开关单元C1与第二开关单元C2闭合、第三开关单元C3与第四开关单元C4断开，以使驱动晶体管M0进行工作，输出驱动电流，驱动发光元件发光；其中第二时间段位于第一时间段之后。
在第二时间段内，驱动晶体管M0的栅极G的电压，即C点的电压，为Vdata+VTH-α*Vdata+(1-α)VANODE，其中，VANODE为像素驱动电路的输出端OUTPUT的电压，也是OLED的阳极的电压。
在第二时间段内，驱动晶体管M0工作时输出的驱动电流为：
Figure BDA0004124167550000062
其中，I为驱动电流，μ是电子迁移率，COX是单位面积的栅氧电容，
Figure BDA0004124167550000063
为驱动晶体管M0的宽长比。
从驱动电流的计算公式看，驱动晶体管M0的阈值电压(VTH)被优化掉了，这使得驱动电流的正态分布会有所改善。
如图5所示，经过蒙特卡洛仿真验证，驱动电流的正态分布的结果得到改善。其中，正态分布的方差只有14.9426pA，相比较2.47522nA的期望值，方差约为0.6％，明显得到改善。这使得像素驱动电路在驱动像素(发光元件)发光时更不容易出现色差或亮度差。
而且，对比图3与图5可知，两个正态分布最高的区域，也就是中心值的部分，都是相同的，因此，可知认为图4所示的像素驱动电路与图1所示的像素驱动电路的驱动电流是同样大小的，本实施例中的像素驱动电路的功耗并没有增加。
由于像素驱动电路包括第一开关单元C1、第二开关单元C2、第三开关单元C3、第四开关单元C4以及驱动晶体管M0，且第一开关单元C1的第一端连接电源，第一开关单元C1的第二端连接驱动晶体管M0的漏极D，第一开关单元C1的控制端用于输入第一开关控制信号KA1，驱动晶体管M0的源极S连接第二开关单元C2的第一端，第二开关单元C2的第二端为像素驱动电路的输出端OUTPUT，第二开关单元C2的控制端用于输入第二开关控制信号KA2，驱动晶体管M0的漏极D还连接第三开关单元C3的第一端，第三开关单元C3的第二端连接驱动晶体管M0的栅极G，第三开关单元C3的控制端用于输入第三开关控制信号KA3，第四开关单元C4的第一端用于输入数据信号，第四开关单元C4的第二端连接驱动晶体管M0的源极S，第四开关单元C4的控制端用于输入第四开关控制信号KA4，这样，可以通过第一开关控制信号KA1、第二开关控制信号KA2、第三开关控制信号KA3以及第四开关控制信号KA4，实现在第一时间段内第一开关单元C1与第二开关单元C2断开、第三开关单元C3与第四开关单元C4闭合，向第四开关单元C4的第一端输入数据信号，以使驱动晶体管M0进行数据存储，在第二时间段内，控制第一开关单元C1与第二开关单元C2闭合、第三开关单元C3与第四开关单元C4断开，以使驱动晶体管M0进行工作，输出驱动电流，且驱动电流的计算式中不存在驱动晶体管M0的阈值电压，即可以消除驱动晶体管M0的阈值电压对驱动电流的影响，进而减小驱动电流的偏差，最终使得像素在显示时更不容易出现色差或亮度差。
在本实施例中，驱动晶体管M0可为N型晶体管。
在本实施例中，第一开关单元C1包括第一晶体管M1，第一晶体管M1的第一端为第一开关单元C1的第一端，第一晶体管M1的第二端为第一开关单元C1的第二端，第一晶体管M1的控制端为第一开关单元C1的控制端。
在本实施例中，第一晶体管M1为P型晶体管，第一晶体管M1的第一端为源极S，第一晶体管M1的第二端为漏极D，第一晶体管M1的控制端为栅极G。即第一晶体管M1的源极S连接电源，第一晶体管M1的漏极D连接驱动晶体管M0的漏极D，第一晶体管M1的栅极G用于输入第一开关控制信号KA1。
在本实施例中，第二开关单元C2包括第二晶体管M2，第二晶体管M2的第一端为第二开关单元C2的第一端，第二晶体管M2的第二端为第二开关单元C2的第二端，第二晶体管M2的控制端为第二开关单元C2的控制端。
在本实施例中，第二晶体管M2为N型晶体管，第二晶体管M2的第一端为漏极D，第二晶体管M2的第二端为源极S，第二晶体管M2的控制端为栅极G。即第二晶体管M2的栅极G用于输入第二开关控制信号KA2，第二晶体管M2的漏极D连接驱动晶体管M0的源极S，第二晶体管M2的源极S为像素驱动电路的输出端OUTPUT。
在本实施例中，第三开关单元C3包括第三晶体管M3，第三晶体管M3的第一端为第三开关单元C3的第一端，第三晶体管M3的第二端为第三开关单元C3的第二端，第三晶体管M3的控制端为第三开关单元C3的控制端。
在本实施例中，第三晶体管M3为N型晶体管，第三晶体管M3的第一端为漏极D，第三晶体管M3的第二端为源极S，第三晶体管M3的控制端为栅极G。即第三晶体管M3的栅极G用于输入第三开关控制信号KA3，第三晶体管M3的漏极D连接驱动晶体管M0的漏极D，第三晶体管M3的源极S连接驱动晶体管M0的栅极G。
在本实施例中，第四开关单元C4包括第四晶体管M4，第四晶体管M4的第一端为第四开关单元C4的第一端，第四晶体管M4的第二端为第四开关单元C4的第二端，第四晶体管M4的控制端为第四开关单元C4的控制端。
在本实施例中，第四晶体管M4为N型晶体管，第四晶体管M4的第一端为源极S，第四晶体管M4的第二端为漏极D，第四晶体管M4的控制端为栅极G。即第四晶体管M4的栅极G用于输入第四开关控制信号KA4，第四晶体管M4的源极S用于输入数据信号，第四晶体管M4的漏极D连接驱动晶体管M0的源极S。
在本实施例中，第三开关控制信号KA3、第四开关控制信号KA4与第一开关控制信号KA1相同，即第三开关控制信号KA3、第四开关控制信号KA4与第一开关控制信号KA1同步。第三开关单元C3的控制端与第四开关单元C4的控制端连接，即第四晶体管M4的栅极G与第三晶体管M3的栅极G并接。
在本实施例中，采用的时序如图6所示，在第一时间段T1内，第一开关控制信号KA1、第三开关控制信号KA3、第四开关控制信号KA4均为高电平，第二开关控制信号KA2为低电平，第一晶体管M1与第二晶体管M2断开，第三晶体管M3与第四晶体管M4闭合，B点的电压为Vdata，C点的电压为Vdata+VTH-α*Vdata。
在第二时间段T2内，第一开关控制信号KA1、第三开关控制信号KA3、第四开关控制信号KA4均为低电平，第二开关控制信号KA2为高电平，第一晶体管M1与第二晶体管M2闭合，第三晶体管M3与第四晶体管M4断开，A点与电源连接，B点电压为VANODE，C点的电压为Vdata+VTH-α*Vdata+(1-α)VANODE，驱动晶体管M0工作时输出的驱动电流如下：
Figure BDA0004124167550000091
从驱动电流的计算公式看，驱动晶体管M0的阈值电压(VTH)被优化掉了，这使得驱动电流的正态分布会有所改善。
在本实施例中，图4所示的像素驱动电路所占用的面积与图1所示的像素驱动电路所占用的面积相同，因此，虽然本实施例中，像素驱动电路包括了5个晶体管，但是，通过调整5个晶体管的宽长比，电路面积并没有增加。
在本实施例中，第一晶体管M1的宽度为1μm，长度为0.3μm，宽长比为1μm/0.3μm。第二晶体管M2的宽度为0.35μm，长度为0.22μm，宽长比为0.35μm/0.22μm。第三晶体管M3的宽度为0.35μm，长度为0.22μm，宽长比为0.35μm/0.22μm。第四晶体管M4的宽度为0.35μm，长度为0.22μm，宽长比为0.35μm/0.22μm。驱动晶体管M0的宽度为1.3μm，长度为0.85μm，宽长比为1.3μm/0.85μm。而图1所示的电路中的晶体管M01、M02的宽度为2.15μm，长度为1.5μm，宽长比为2.15μm/1.5μm。
需要说明的是，在其他实施例中，第一开关单元C1、第二开关单元C2、第三开关单元C3、第四开关单元C4可以为其他开关元件或开关电路，不限于本实施例中的晶体管，其他开关元件或开关电路的闭合与断开可由开关控制信号控制。
本申请另一示例性实施例还提供一种像素驱动电路的驱动方法，用于驱动上述的像素驱动电路。如图7所示，在本实施例中，像素驱动电路的驱动方法包括以下步骤：
步骤701，在第一时间段内，第一开关单元C1与第二开关单元C2断开、第三开关单元C3与第四开关单元C4闭合，向第四开关单元C4的第一端输入数据信号，以使驱动晶体管M0进行数据存储。
步骤702，在第二时间段内，第一开关单元C1与第二开关单元C2闭合、第三开关单元C3与第四开关单元C4断开，以使驱动晶体管M0进行工作，输出驱动电流；第二时间段位于第一时间段之后。
在本实施例中，在第一时间段内，驱动晶体管M0的源极S的电压为Vdata，驱动晶体管M0的栅极G的电压为Vdata+VTH-α*Vdata，其中，Vdata为数据信号的电压，VTH为驱动晶体管M0的阈值电压，α的计算式如下：
Figure BDA0004124167550000101
其中，CPG为驱动晶体管M0的栅极G的寄生电容，CPS为驱动晶体管M0的源极S的寄生电容。
在本实施例中，在第二时间段内，驱动晶体管M0的栅极G的电压为Vdata+VTH-α*Vdata+(1-α)VANODE，其中，VANODE为像素驱动电路的输出端OUTPUT的电压。
在第二时间段内，驱动晶体管M0工作输出的驱动电流如下：
Figure BDA0004124167550000102
从驱动电流的计算公式看，驱动晶体管M0的阈值电压(VTH)被优化掉了，这使得驱动电流的正态分布会有所改善。
本实施例中的像素驱动电路的驱动方法与上述实施例中的像素驱动电路的技术方案的内容可相互补充。
本申请另一示例性实施例还提供一种显示面板。如图8所示，该显示面板，包括：发光元件D以及上述的像素驱动电路81，像素驱动电路81与发光元件D连接，并向发光元件D输入驱动电流，驱动发光元件D发光。
在一个实施例中，发光元件D可以是OLED，但不限于此。
本申请另一示例性实施例还提供一种显示装置，包括：供电组件以及上述的显示面板；供电组件与显示面板连接，用于为显示面板供电。
在本发明中，术语“第一”、“第二”仅用于描述目的，而不能理解为指示或暗示相对重要性。术语“多个”指两个或两个以上，除非另有明确的限定。
上述对实施例的描述是为了便于本技术领域的普通技术人员能理解和应用本申请。熟悉本领域技术的人员显然可以容易地对这些实施例做出各种修改，并把在此说明的一般原理应用到其它实施例中而不必付出创造性的劳动。因此，本申请不限于这里的实施例，本领域技术人员根据本申请披露的内容，在不脱离本申请范围和精神的情况下做出的改进和修改都本申请的范围之内。

Claims (10)

1.一种像素驱动电路，其特征在于，包括：第一开关单元、第二开关单元、第三开关单元、第四开关单元以及驱动晶体管；
所述第一开关单元的第一端连接电源，所述第一开关单元的第二端连接所述驱动晶体管的漏极，所述第一开关单元的控制端用于输入第一开关控制信号；所述驱动晶体管的源极连接所述第二开关单元的第一端，所述第二开关单元的第二端为所述像素驱动电路的输出端，所述第二开关单元的控制端用于输入第二开关控制信号；
所述驱动晶体管的漏极还连接所述第三开关单元的第一端，所述第三开关单元的第二端连接所述驱动晶体管的栅极，所述第三开关单元的控制端用于输入第三开关控制信号；
所述第四开关单元的第一端用于输入数据信号，所述第四开关单元的第二端连接所述驱动晶体管的源极，所述第四开关单元的控制端用于输入第四开关控制信号。
2.如权利要求1所述的像素驱动电路，其特征在于，所述驱动晶体管为N型晶体管；
所述第三开关控制信号、所述第四开关控制信号与所述第一开关控制信号相同；
所述第三开关单元的控制端与所述第四开关单元的控制端连接。
3.如权利要求1所述的像素驱动电路，其特征在于，所述第一开关单元包括第一晶体管，所述第一晶体管的第一端为所述第一开关单元的第一端，所述第一晶体管的第二端为所述第一开关单元的第二端，所述第一晶体管的控制端为所述第一开关单元的控制端；
所述第一晶体管为P型晶体管，所述第一晶体管的第一端为源极，所述第一晶体管的第二端为漏极，所述第一晶体管的控制端为栅极。
4.如权利要求1所述的像素驱动电路，其特征在于，所述第二开关单元包括第二晶体管，所述第二晶体管的第一端为所述第二开关单元的第一端，所述第二晶体管的第二端为所述第二开关单元的第二端，所述第二晶体管的控制端为所述第二开关单元的控制端；
所述第二晶体管为N型晶体管，所述第二晶体管的第一端为漏极，所述第二晶体管的第二端为源极，所述第二晶体管的控制端为栅极。
5.如权利要求1所述的像素驱动电路，其特征在于，所述第三开关单元包括第三晶体管，所述第三晶体管的第一端为所述第三开关单元的第一端，所述第三晶体管的第二端为所述第三开关单元的第二端，所述第三晶体管的控制端为所述第三开关单元的控制端；
所述第三晶体管为N型晶体管，所述第三晶体管的第一端为漏极，所述第三晶体管的第二端为源极，所述第三晶体管的控制端为栅极。
6.如权利要求1所述的像素驱动电路，其特征在于，所述第四开关单元包括第四晶体管，所述第四晶体管的第一端为所述第四开关单元的第一端，所述第四晶体管的第二端为所述第四开关单元的第二端，所述第四晶体管的控制端为所述第四开关单元的控制端；
所述第四晶体管为N型晶体管，所述第四晶体管的第一端为源极，所述第四晶体管的第二端为漏极，所述第四晶体管的控制端为栅极。
7.如权利要求1所述的像素驱动电路，其特征在于，所述驱动晶体管工作时输出的驱动电流为：
Figure FDA0004124167510000021
其中，I为所述驱动电流，μ是电子迁移率，COX是单位面积的栅氧电容，
Figure FDA0004124167510000022
为所述驱动晶体管的宽长比，Vdata为所述数据信号的电压，VANODE为所述像素驱动电路的输出端的电压，VTH为所述驱动晶体管的阈值电压，α的计算式如下：
Figure FDA0004124167510000023
其中，CPG为所述驱动晶体管的栅极的寄生电容，CPS为所述驱动晶体管的源极的寄生电容。
8.一种如权利要求1-7任一项所述的像素驱动电路的驱动方法，其特征在于，包括：
在第一时间段内，所述第一开关单元与所述第二开关单元断开、所述第三开关单元与所述第四开关单元闭合，向所述第四开关单元的第一端输入数据信号，以使所述驱动晶体管进行数据存储；
在第二时间段内，所述第一开关单元与所述第二开关单元闭合、所述第三开关单元与所述第四开关单元断开，以使所述驱动晶体管进行工作，输出驱动电流；所述第二时间段位于所述第一时间段之后。
9.一种显示面板，其特征在于，包括：发光元件以及如权利要求1-7任一项所述的像素驱动电路，所述像素驱动电路与所述发光元件连接，并向所述发光元件输入驱动电流，驱动所述发光元件发光。
10.一种显示装置，其特征在于，包括：供电组件以及如权利要求9所述的显示面板；所述供电组件与所述显示面板连接，用于为所述显示面板供电。
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