CN115311972A - 栅极驱动部及包括其的显示装置 - Google Patents

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Abstract

本发明公开一种栅极驱动部及包括其的显示装置。栅极驱动部包括多个有源级以及多个前置级。所述多个前置级连接于所述有源级而向所述有源级输出进位信号。所述多个前置级包括第一前置级以及第二前置级。所述第二前置级包括：Q节点补偿部，从所述第一前置级接收时钟信号的输入，并基于所述第一前置级的所述时钟信号补偿Q节点的电压。所述Q节点补偿部包括：反馈晶体管，将接收所述第一前置级的所述时钟信号的输入的反馈输入端子与所述第二前置级的反馈节点二极管连接。

Description

栅极驱动部及包括其的显示装置
技术领域
本发明涉及一种栅极驱动部及包括其的显示装置，涉及一种包括多个前置级的栅极驱动部及包括其的显示装置。
背景技术
通常，显示装置包括显示面板以及显示面板驱动部。所述显示面板包括多个栅极线以及多个数据线。所述显示面板驱动部包括将栅极信号提供于所述多个栅极线的栅极驱动部以及将栅极电压提供于所述数据线的数据驱动部。
所述栅极驱动部可以利用在显示面板上集成的多个级而输出所述栅极信号。所述栅极驱动部可以包括将所述栅极信号输出于所述显示面板的有源级和不将所述栅极信号输出于所述显示面板的前置级。
前置级可以基于垂直起始信号对Q节点充电(pre-charge)。可以是，在前置级中晶体管的泄漏电流产生的情况下，Q节点的电压不保持(holding)。在Q节点的电压不保持的情况下，有源级可以输出非正常的感测信号以及非正常的栅极信号。
发明内容
本发明的一目的是提供一种可以在前置级之间反馈进位信号而在保持时间期间使Q节点的电压一定地保持的栅极驱动部。
本发明的另一目的是提供一种包括所述栅极驱动部的显示装置。
用于实现上述本发明的目的的根据一实施例的栅极驱动部可以包括：多个有源级，将栅极信号输出于显示部；以及多个前置级，连接于所述有源级而向所述有源级输出进位信号。可以是，所述多个前置级包括第一前置级以及第二前置级。在此，可以是，所述第二前置级包括：Q节点补偿部，从所述第一前置级接收时钟信号的输入，并基于所述第一前置级的所述时钟信号补偿Q节点的电压。可以是，所述Q节点补偿部包括：反馈晶体管，将接收所述第一前置级的所述时钟信号的输入的反馈输入端子与所述第二前置级的反馈节点二极管连接。可以是，所述反馈晶体管包括源极电极、栅极电极以及漏极电极，所述源极电极与所述反馈输入端子连接，所述栅极电极与所述源极电极连接，所述漏极电极与所述反馈节点连接。
在一实施例中，可以是，所述第一前置级的所述时钟信号是所述第一前置级的进位信号、所述第一前置级的感测信号以及所述第一前置级的栅极信号中的一个。
在一实施例中，可以是，所述Q节点补偿部调节施加于所述反馈节点的电压电平，从而减小连接所述反馈节点与所述Q节点的晶体管中的至少一个晶体管的漏极-源极电压。
在一实施例中，可以是，所述第二前置级包括：Q节点充电部，接收垂直起始信号的输入而对所述Q节点充电；Q节点稳定化部，接收所述有源级的进位信号的输入而将所述Q节点稳定化；以及反相部，基于所述Q节点的所述电压，生成反相信号。
在一实施例中，可以是，所述第二前置级的所述反馈节点与所述Q节点充电部、所述Q节点稳定化部以及所述反相部连接。
在一实施例中，可以是，所述第二前置级包括：晶体管稳定化部，基于晶体管稳定化信号，将连接于所述反馈节点的多个晶体管稳定化。可以是，所述晶体管稳定化部包括第一晶体管稳定化晶体管以及第二晶体管稳定化晶体管。可以是，所述第一晶体管稳定化晶体管包括：源极电极，连接于所述第二晶体管稳定化晶体管；栅极电极，连接于所述Q节点；以及漏极电极，连接于所述反馈节点。可以是，所述第二晶体管稳定化晶体管包括：源极电极，被施加栅极高电压；栅极电极，连接于所述Q节点；以及漏极电极，连接于所述第一晶体管稳定化晶体管。
在一实施例中，可以是，所述Q节点充电部包括第一充电晶体管以及第二充电晶体管。可以是，所述第二充电晶体管包括：源极电极，接收所述垂直起始信号的输入；栅极电极，连接于所述第二充电晶体管的所述源极电极；以及漏极电极，连接于所述第一充电晶体管。可以是，所述第一充电晶体管包括：源极电极，连接于所述第二充电晶体管；栅极电极，连接于所述第二充电晶体管的所述源极电极；以及漏极电极，连接于所述Q节点。
在一实施例中，可以是，所述Q节点稳定化部包括第一稳定化晶体管以及第二稳定化晶体管。可以是，所述第一稳定化晶体管包括：源极电极，连接于所述第二稳定化晶体管；栅极电极，被施加之后进位信号中的任一个；以及漏极电极，连接于所述Q节点。可以是，所述第二稳定化晶体管包括：源极电极，被施加第一低电压；栅极电极，被施加所述之后进位信号中的任一个；以及漏极电极，连接于所述第一稳定化晶体管。
在一实施例中，可以是，所述Q节点充电部、所述Q节点稳定化部以及所述反相部各自由氧化物半导体晶体管构成。
在一实施例中，可以是，所述第二前置级调节所述反馈节点的电压电平，从而减小连接所述反馈节点与所述Q节点的晶体管的泄漏电流，基于所述Q节点的所述电压生成进位信号，并将所述进位信号输出于所述有源级。
用于实现上述本发明的另一目的的根据一实施例的显示装置可以包括显示面板、数据驱动部以及栅极驱动部。可以是，所述显示面板包括显示图像的显示部以及与所述显示部相邻的周边部。可以是，所述数据驱动部将数据电压施加于所述显示面板。可以是，所述栅极驱动部包括：多个有源级，将栅极信号输出于所述显示部；以及多个前置级，连接于所述有源级而向所述有源级输出进位信号。可以是，所述多个前置级包括第一前置级以及第二前置级。在此，可以是，所述第二前置级包括：Q节点补偿部，从所述第一前置级接收时钟信号的输入，并基于所述第一前置级的所述时钟信号补偿Q节点的电压。可以是，所述Q节点补偿部包括：反馈晶体管，将接收所述第一前置级的所述时钟信号的输入的反馈输入端子与所述第二前置级的反馈节点二极管连接。可以是，所述反馈晶体管包括源极电极、栅极电极以及漏极电极，所述源极电极与所述反馈输入端子连接，所述栅极电极与所述源极电极连接，所述漏极电极与所述反馈节点连接。
在一实施例中，可以是，所述第一前置级的所述时钟信号是所述第一前置级的进位信号、所述第一前置级的感测信号以及所述第一前置级的栅极信号中的一个。
在一实施例中，可以是，所述Q节点补偿部调节施加于所述反馈节点的电压电平，从而减小连接所述反馈节点与所述Q节点的晶体管中的至少一个晶体管的漏极-源极电压。
在一实施例中，可以是，所述第二前置级包括：Q节点充电部，接收垂直起始信号的输入而对所述Q节点充电；Q节点稳定化部，接收所述有源级的进位信号的输入而将所述Q节点稳定化；以及反相部，基于所述Q节点的所述电压，生成反相信号。
在一实施例中，可以是，所述第二前置级的所述反馈节点与所述Q节点充电部、所述Q节点稳定化部以及所述反相部连接。
在一实施例中，可以是，所述第二前置级包括：晶体管稳定化部，基于晶体管稳定化信号，将连接于所述反馈节点的多个晶体管稳定化。可以是，所述晶体管稳定化部包括第一晶体管稳定化晶体管以及第二晶体管稳定化晶体管。可以是，所述第一晶体管稳定化晶体管包括：源极电极，连接于所述第二晶体管稳定化晶体管；栅极电极，连接于所述Q节点；以及漏极电极，连接于所述反馈节点。可以是，所述第二晶体管稳定化晶体管包括：源极电极，被施加栅极高电压；栅极电极，连接于所述Q节点；以及漏极电极，连接于所述第一晶体管稳定化晶体管。
在一实施例中，可以是，所述Q节点充电部包括第一充电晶体管以及第二充电晶体管。可以是，所述第二充电晶体管包括：源极电极，接收所述垂直起始信号的输入；栅极电极，连接于所述第二充电晶体管的所述源极电极；以及漏极电极，连接于所述第一充电晶体管。可以是，所述第一充电晶体管包括：源极电极，连接于所述第二充电晶体管；栅极电极，连接于所述第二充电晶体管的所述源极电极；以及漏极电极，连接于所述Q节点。
在一实施例中，可以是，所述Q节点稳定化部包括第一稳定化晶体管以及第二稳定化晶体管。可以是，所述第一稳定化晶体管包括：源极电极，连接于所述第二稳定化晶体管；栅极电极，被施加之后进位信号中的任一个；以及漏极电极，连接于所述Q节点。可以是，所述第二稳定化晶体管包括：源极电极，被施加第一低电压；栅极电极，被施加所述之后进位信号中的任一个；以及漏极电极，连接于所述第一稳定化晶体管。
在一实施例中，可以是，所述Q节点充电部、所述Q节点稳定化部以及所述反相部各自由氧化物半导体晶体管构成。
在一实施例中，可以是，所述第二前置级调节所述反馈节点的电压电平，从而减小连接所述反馈节点与所述Q节点的晶体管的泄漏电流，基于所述Q节点的所述电压生成进位信号，并将所述进位信号输出于所述有源级。
根据这样的栅极驱动部及包括其的显示装置，包括在栅极驱动部中的前置级可以从之前前置级接收时钟信号的输入，并基于所述之前前置级的所述时钟信号补偿Q节点的电压，以保持所述Q节点的电压。结果，所述栅极驱动部及包括其的显示装置可以使显示装置的显示品质提升。
附图说明
图1是示出根据本发明的一实施例的显示装置的框图。
图2是示出包括在图1的显示装置中的栅极驱动部的框图。
图3a是示出图2的栅极驱动部的级间的进位输出线的框图。
图3b是示出包括在图2的栅极驱动部中的有源级的电路图。
图4是示出包括在图2的栅极驱动部中的前置级的电路图。
图5是示出图4的前置级的Q节点的电压的时序图。
图6是示出在初始前置级与反馈前置级通过反馈线连接的情况下，级间的进位输出线的框图。
图7是示出包括在图6中的反馈前置级的电路图。
图8是示出包括在图6中的初始前置级以及反馈前置级的输入输出信号的时序图。
图9是示出包括在图6中的初始前置级以及反馈前置级的Q节点的电压的时序图。
图10是示出根据本发明的实施例的电子设备的框图。
图11是示出图10的电子设备实现为智能电话的一例的图。
(附图标记说明)
100：显示面板 200：驱动控制部
300：栅极驱动部 400：伽马基准电压生成部
500：数据驱动部
具体实施方式
以下，将参照所附的附图，更详细地说明本发明。
图1是示出根据本发明的一实施例的显示装置的框图。
参照图1，所述显示装置可以包括显示面板100以及显示面板驱动部。所述显示面板驱动部可以包括驱动控制部200、栅极驱动部300、伽马基准电压生成部400以及数据驱动部500。
例如，所述驱动控制部200以及所述数据驱动部500可以一体地形成。例如，所述驱动控制部200、所述伽马基准电压生成部400以及所述数据驱动部500可以一体地形成。可以将至少所述驱动控制部200以及所述数据驱动部500一体地形成的驱动模组命名为时序控制器嵌入式数据驱动部(Timing Controller Embedded Data Driver，TED)。
所述显示面板100可以包括显示图像的显示部AA以及与所述显示部AA相邻配置的周边部PA。
所述显示面板100可以包括多个栅极线GL、多个数据线DL以及电连接于所述栅极线GL和所述数据线DL各自的多个像素P。可以是，所述栅极线GL向第一方向D1延伸，所述数据线DL向与所述第一方向D1交叉的第二方向D2延伸。
所述驱动控制部200可以从外部的装置(未图示)接收输入图像数据IMG以及输入控制信号CONT。例如，所述输入图像数据IMG可以包括红色图像数据、绿色图像数据以及蓝色图像数据。所述输入图像数据IMG可以包括白色图像数据。所述输入图像数据IMG可以包括品红色(magenta)图像数据、黄色(yellow)图像数据以及青色(cyan)图像数据。所述输入控制信号CONT可以包括主时钟信号、数据使能信号。所述输入控制信号CONT可以还包括垂直同步信号以及水平同步信号。
所述驱动控制部200可以依据所述输入图像数据IMG以及所述输入控制信号CONT，生成第一控制信号CONT1、第二控制信号CONT2、第三控制信号CONT3以及数据信号DATA。
所述驱动控制部200依据所述输入控制信号CONT，生成用于控制所述栅极驱动部300的工作的所述第一控制信号CONT1而将其输出于所述栅极驱动部300。所述第一控制信号CONT1可以包括垂直起始信号以及栅极时钟信号。
所述驱动控制部200依据所述输入控制信号CONT，生成用于控制所述数据驱动部500的工作的所述第二控制信号CONT2而将其输出于所述数据驱动部500。所述第二控制信号CONT2可以包括水平起始信号以及负载信号。
所述驱动控制部200可以依据所述输入图像数据IMG，生成数据信号DATA。所述驱动控制部200可以将所述数据信号DATA输出于所述数据驱动部500。
所述驱动控制部200可以依据所述输入控制信号CONT，生成用于控制所述伽马基准电压生成部400的工作的所述第三控制信号CONT3而将其输出于所述伽马基准电压生成部400。
所述栅极驱动部300可以响应于从所述驱动控制部200接收的所述第一控制信号CONT1，生成用于驱动所述栅极线GL的栅极信号。所述栅极驱动部300可以将所述栅极信号输出于所述栅极线GL。例如，所述栅极驱动部300可以将所述栅极信号依次输出于所述栅极线GL。
在本实施例中，所述栅极驱动部300可以集成在所述显示面板100的所述周边部PA上。
所述伽马基准电压生成部400可以响应于从所述驱动控制部200接收的所述第三控制信号CONT3，生成伽马基准电压VGREF。所述伽马基准电压生成部400可以将所述伽马基准电压VGREF提供于所述数据驱动部500。所述伽马基准电压VGREF可以具有与各个数据信号DATA对应的值。
在本发明的一实施例中，所述伽马基准电压生成部400可以配置于所述驱动控制部200内或配置于所述数据驱动部500内。
所述数据驱动部500可以从所述驱动控制部200接收所述第二控制信号CONT2以及所述数据信号DATA的输入，并从所述伽马基准电压生成部400接收所述伽马基准电压VGREF的输入。所述数据驱动部500可以利用所述伽马基准电压VGREF，将所述数据信号DATA转换为模拟形式的数据电压。所述数据驱动部500可以将所述数据电压输出于所述数据线DL。
图2是示出包括在图1的显示装置中的栅极驱动部300的框图，图3a是示出图2的栅极驱动部300的级间的进位输出线的框图，图3b是示出包括在图2的栅极驱动部300中的有源级的电路图。
参照图1至图3b，所述栅极驱动部300可以包括多个有源级AST1～ASTX以及多个前置级PST1～PST4。
所述多个有源级AST1～ASTX可以将所述栅极信号输出于所述显示部AA。例如，所述多个有源级AST1～ASTX的数量可以与所述显示面板100的所述显示部AA的所述栅极线的数量相同。例如，所述多个有源级AST1～ASTX的数量可以与所述显示面板100的所述显示部AA的像素行的数量相同。各个所述有源级AST1～ASTX可以输出所述栅极信号以及进位信号。
所述多个前置级PST1～PST4可以连接于所述有源级AST1～ASTX而向所述有源级AST1～ASTX输出进位信号。在图2中，所述多个前置级PST1～PST4示例为四个，但是本发明的多个前置级的数量不限于此。
可以是，在所述第N有源级ASTN施加第一至第六输入信号(例如，S1～S6)，施加第N时钟信号，并施加第一至第三低电压(例如，VSS1、VSS2、VSS3)。所述第N时钟信号可以包括栅极时钟信号SC_CKN、感测时钟信号SS_CKN以及进位时钟信号CR_CKN。在有源区间中所述栅极时钟信号SC_CKN、所述感测时钟信号SS_CKN以及所述进位时钟信号CR_CKN可以具有相同的时序。在所述栅极驱动部300的所述多个有源级AST1～ASTX可以依次施加具有彼此不同相位的六个时钟信号。在此，各时钟信号的波形的周期可以为六个水平区间。
例如，可以是，第一有源级AST1被施加第一时钟信号，第二有源级AST2被施加第二时钟信号，第三有源级AST3被施加第三时钟信号，第四有源级AST4被施加第四时钟信号，第五有源级AST5被施加第五时钟信号，第六有源级AST6被施加第六时钟信号，第七有源级AST7被施加所述第一时钟信号，第八有源级AST8被施加所述第二时钟信号，第九有源级AST9被施加所述第三时钟信号，第十有源级AST10被施加所述第四时钟信号，第十一有源级AST11被施加所述第五时钟信号，第十二有源级AST12被施加所述第六时钟信号。
所述第N有源级ASTN可以包括第一感测部31、第二感测部32、Q节点充电部33、Q节点稳定化部34、反相部35、进位信号输出部36、感测信号输出部37、栅极信号输出部38以及晶体管稳定化部39。
所述第一感测部31以及所述第二感测部32可以基于第一输入信号S1、第二输入信号S2、第四输出信号S4以及Q节点NQ信号工作，并感测所述显示面板100的像素部内的晶体管的特性。所述第一感测部31可以包括第一感测晶体管T24A及第二感测晶体管T25A以及感测电容器C3A。所述第二感测部32可以包括第三感测晶体管T21A、第四感测晶体管T22A、第五感测晶体管T23A、第六感测晶体管T26A以及第七感测晶体管T27A。
所述Q节点充电部33可以基于之前进位信号中的任一个，对所述Q节点NQ充电。在此，所述之前进位信号中的任一个可以是从当前级起第三个之前级的进位信号IN N-3。所述Q节点充电部33可以包括第一充电晶体管T4_1A以及第二充电晶体管T4_2A。
所述Q节点稳定化部34可以基于之后进位信号中的任一个以及第五输入信号S5，将所述Q节点NQ稳定化。在此，所述之后进位信号中的任一个可以是从当前级起第四个之后级的进位信号IN N+4。例如，所述Q节点稳定化部34可以接收从所述当前级起第四个之后级的进位信号IN N+4。在此，所述第五输入信号S5可以是垂直起始信号STVP。所述Q节点稳定化部34可以包括第一稳定化晶体管T1_1A、第二稳定化晶体管T1_2A、第三稳定化晶体管T2_1A以及第四稳定化晶体管T2_2A。
所述反相部35可以基于第三输入信号S3以及所述Q节点NQ信号，生成反相信号INVN。所述反相部35可以包括第一反相晶体管T3_1A、第二反相晶体管T3_2A、第三反相晶体管T19A、第四反相晶体管T5_1A、第五反相晶体管T5_2A、第六反相晶体管T20A、第七反相晶体管T15A、第八反相晶体管T16A、第九反相晶体管T17A、第十反相晶体管T18A。
所述进位信号输出部36可以基于所述Q节点NQ信号以及反相信号INV N，输出进位信号CR N。所述进位信号输出部36可以包括第一进位晶体管T12A、第二进位晶体管T13A以及第三进位晶体管T14A。
所述感测信号输出部37可以基于所述Q节点NQ信号以及反相信号INV N，输出感测信号SS N。所述感测信号输出部37可以包括第一感测输出晶体管T9A、第二感测输出晶体管T10A以及第三感测输出晶体管T11A。所述感测信号输出部37可以还包括连接于所述第一感测输出晶体管T9A的所述控制电极与所述输出电极之间的感测输出电容器C2A。
所述栅极信号输出部38可以基于所述Q节点NQ信号以及反相信号INV N，输出栅极信号SC N。所述栅极信号输出部38可以包括第一栅极晶体管T6A、第二栅极晶体管T7A以及第三栅极晶体管T8A。所述栅极信号输出部38可以还包括连接于所述第一栅极晶体管T6A的所述控制电极与所述输出电极之间的栅极电容器C1A。
所述晶体管稳定化部39可以响应于所述Q节点NQ，将所述第六输入信号S6传输于串联连接的晶体管的中间节点而将所述串联连接的晶体管的工作稳定化。所述晶体管稳定化部39可以包括第一晶体管稳定化晶体管T28_1A以及第二晶体管稳定化晶体管T28_2A。
在一实施例中，所述栅极驱动部300可以包括第一前置级PST1、第二前置级PST2、第三前置级PST3以及第四前置级PST4。所述第一前置级PST1可以与所述第二前置级PST2以一对工作。所述第二前置级PST2可以将前置进位信号输出于第一有源级AST1以及第二有源级AST2。所述第三前置级PST3可以与所述第四前置级PST4以一对工作。所述第四前置级PST4可以将前置进位信号输出于第三有源级AST3以及第四有源级AST4。
图4是示出包括在图2的栅极驱动部中的前置级的电路图，图5是示出图4的前置级的Q节点的电压的时序图。
参照图4至图5，所述前置级PST1～PST4的电路结构可以与所述有源级AST1～ASTX(参照图2)的电路结构相同。相比于所述有源级AST1～ASTX的电路结构，所述前置级PST1～PST4的电路可以为从所述有源级AST1～ASTX的电路中排除了第一感测部以及第二感测部的结构。前置级PST1～PST4可以包括Q节点NQ。
前置级PST1～PST4可以基于垂直起始信号STVP，对所述Q节点NQ充电(pre-charge)。可以是，在前置级PST1～PST4中晶体管的泄漏电流产生的情况下，Q节点NQ的电压不保持(holding)。在前置级PST1～PST4的Q节点NQ的电压不保持的情况下，有源级AST1～ASTX可以输出非正常的感测信号以及非正常的栅极信号。
具体地，在Q节点充电之后，Q节点NQ的电压可以具有保持时间HT。在前置级PST1～PST4以及有源级AST1～ASTX中，阈值电压的感测(Vth sensing)工作时，为了确保充分的感测时间，Q节点NQ的电压可以保持为浮置(floating)状态。即，保持时间HT可以是在Q节点NQ充电之后，将Q节点NQ的电压保持为浮置状态的时间。尤其是，前置级PST1～PST4基于垂直起始信号STVP对所述Q节点NQ充电，因此从第一前置级PST1增加至第四前置级PST4，Q节点NQ的保持时间HT可以增加。
例如，在图5中将各个前置级PST1～PST4的Q节点示出为第一Q节点NQ1至第四Q节点NQ4。在第一Q节点NQ1处第一Q节点电压VNQ1可以保持正常的电压电平。相反地，根据晶体管的泄漏电流，在第四Q节点NQ4处，随着保持时间的增加，第四Q节点电压VNQ4可以具有非正常的电压电平。在此情况下，接收基于第四Q节点电压VNQ4生成的进位信号的有源级AST1～ASTX可以输出非正常的感测信号以及非正常的栅极信号。
为了解决这样的问题，本发明的所述前置级可以包括Q节点补偿部310(参照图7)，Q节点补偿部310从之前前置级接收时钟信号的输入，并基于所述之前前置级的所述时钟信号补偿Q节点的电压，以保持所述Q节点NQ的电压。
图6是示出在初始前置级IPST与反馈前置级FBPST通过反馈线连接的情况下，级间的进位输出线的框图，图7是示出包括在图6中的反馈前置级FBPST的电路图，图8是示出包括在图6中的初始前置级以及反馈前置级的输入输出信号的时序图，图9是示出包括在图6中的初始前置级以及反馈前置级的Q节点NQ的电压的时序图。
参照图6至图9，前置级PST1～PST4可以包括初始前置级IPST以及反馈前置级FBPST。所述反馈前置级FBPST可以包括Q节点补偿部310，Q节点补偿部310从所述初始前置级IPST接收时钟信号CK_IPST的输入，并基于所述初始前置级IPST的所述时钟信号CK_IPST补偿Q节点NQ的电压。在图6中示出了第一前置级PST1为初始前置级IPST，第二至第四前置级PST2～PST4为反馈前置级FBPST，但是本发明的初始前置级IPST以及反馈前置级FBPST不限于此。例如，初始前置级IPST可以是多个。
如在图7中看到的，反馈前置级FBPST可以包括Q节点充电部320、Q节点稳定化部330、反相部340以及晶体管稳定化部350。此时，反馈前置级FBPST可以还包括Q节点补偿部310。所述Q节点充电部320、所述Q节点稳定化部330以及所述反相部340各自可以由氧化物半导体晶体管构成。
所述Q节点充电部320可以基于垂直起始信号STVP，对所述Q节点NQ充电。所述Q节点充电部320可以包括第一充电晶体管T4_1A以及第二充电晶体管T4_2A。所述第二充电晶体管T4_2A可以包括接收所述垂直起始信号STVP的输入的源极电极、连接于所述源极电极的栅极电极以及连接于所述第一充电晶体管T4_1A的漏极电极。所述第一充电晶体管T4_1A可以包括连接于所述第二充电晶体管T4_2A的源极电极、连接于所述第二充电晶体管T4_2A的所述源极电极的栅极电极以及连接于所述Q节点NQ的漏极电极。
所述Q节点稳定化部330可以基于所述有源级的进位信号，将所述Q节点NQ稳定化。所述Q节点稳定化部330可以包括第一稳定化晶体管T2_1A以及第二稳定化晶体管T2_2A。所述第一稳定化晶体管T2_1A可以包括连接于所述第二稳定化晶体管T2_2A的源极电极、被施加之后进位信号中的任一个的栅极电极以及连接于所述Q节点NQ的漏极电极。所述第二稳定化晶体管T2_2A包括被施加第一低电压VSS1的源极电极、被施加所述之后进位信号中的任一个的栅极电极以及连接于所述第一稳定化晶体管T2_1A的漏极电极。
所述反相部340可以基于所述Q节点NQ的所述电压，生成反相信号。所述反相部340可以包括第一反相晶体管T3_1A、第二反相晶体管T3_2A、第三反相晶体管T5_1A以及第四反相晶体管T5_2A。
晶体管稳定化部350可以基于晶体管稳定化信号，将连接于所述反馈节点NFB的多个晶体管稳定化。所述晶体管稳定化部350可以包括第一晶体管稳定化晶体管T28_1A、第二晶体管稳定化晶体管T28_2A。所述第一晶体管稳定化晶体管T28_1A可以包括连接于所述第二晶体管稳定化晶体管T28_2A的源极电极、连接于所述Q节点NQ的栅极电极以及连接于所述反馈节点NFB的漏极电极。所述第二晶体管稳定化晶体管T28_2A可以包括被施加栅极高电压S6(上述的第六输入信号)的源极电极、连接于所述Q节点NQ的栅极电极以及连接于所述第一晶体管稳定化晶体管T28_1A的漏极电极。
所述Q节点补偿部310可以从所述初始前置级IPST接收时钟信号CK_IPST的输入，并基于所述初始前置级IPST的所述时钟信号CK_IPST，补偿Q节点NQ的电压。所述Q节点补偿部310可以包括反馈晶体管T4_fb，反馈晶体管T4_fb将接收所述初始前置级IPST的所述时钟信号CK_IPST的输入的反馈输入端子311与所述反馈前置级FBPST的反馈节点NFB二极管连接。在此，所述初始前置级IPST的所述时钟信号CK_IPST可以是所述初始前置级IPST的进位信号CRN、所述初始前置级IPST的感测信号SSN以及所述初始前置级IPST的栅极信号SCN中的一个。
在向所述反馈节点NFB输入所述初始前置级IPST的时钟信号CK_IPST的情况下，所述反馈节点NFB的电压电平可以被补偿。在通过所述初始前置级IPST的时钟信号CK_IPST补偿所述反馈节点NFB的电压电平的情况下，所述Q节点NQ的电压电平可以保持为正常的电平。
具体地，所述反馈前置级FBPST的所述反馈节点NFB可以与所述Q节点充电部320、所述Q节点稳定化部330以及所述反相部340连接。在所述反馈节点NFB输入所述初始前置级IPST的时钟信号CK_IPST而所述反馈节点NFB的电压电平被补偿的情况下，连接所述反馈节点NFB与所述Q节点NQ的晶体管的漏极-源极电压可以减小。即，在所述反馈节点NFB输入所述初始前置级IPST的时钟信号CK_IPST而所述反馈节点NFB的电压电平保持为所述初始前置级IPST的时钟信号CK_IPST的激活电平(即，高电平)的情况下，连接所述反馈节点NFB与所述Q节点NQ的晶体管的漏极-源极电压可以、减小。在连接所述反馈节点NFB与所述Q节点NQ的晶体管的漏极-源极电压减小的情况下，所述Q节点NQ的电压电平可以保持为正常的电平。另外，在所述反馈节点NFB输入所述初始前置级IPST的时钟信号CK_IPST而所述反馈节点NFB的电压电平被补偿的情况下，连接所述反馈节点NFB与所述Q节点NQ的晶体管的泄漏电流可以减小。即，在所述Q节点充电部320、所述Q节点稳定化部330以及所述反相部340中产生的泄漏电流可以减小。在连接所述反馈节点NFB与所述Q节点NQ的晶体管的泄漏电流减小的情况下，所述Q节点NQ的电压电平可以保持为正常的电平。
如在图8中看到的，在所述反馈节点NFB(参照图7)输入所述初始前置级IPST(参照图6)的时钟信号CK_IPST而所述反馈节点NFB的电压电平被补偿的情况下，在所述反馈前置级FBPST(参照图7)的保持时间HT期间，包括在所述反馈前置级FBPST中的第一充电晶体管T4_1A(参照图7)的漏极-源极电压、第一稳定化晶体管T2_1A(参照图7)的漏极-源极电压、第一反相晶体管T3_1A(参照图7)的漏极-源极电压、第三反相晶体管T5_1A(参照图7)的漏极-源极电压可以减小。在所述反馈节点NFB输入所述初始前置级IPST的时钟信号CK_IPST而所述反馈节点NFB的电压电平被补偿的情况下，在所述反馈前置级FBPST的保持时间HT期间，包括在所述反馈前置级FBPST中的第一充电晶体管T4_1A的泄漏电流、第一稳定化晶体管T2_1A的泄漏电流、第一反相晶体管T3_1A的泄漏电流、第三反相晶体管T5_1A的泄漏电流可以减小。
例如，在第二前置级PST2中，在保持时间HT期间在反馈节点NFB持续输入所述初始前置级IPST的时钟信号CK_IPST，因此第二Q节点NQ2可以在保持时间HT期间不产生由于连接所述反馈节点NFB与所述Q节点NQ的晶体管的泄漏电流。
例如，在第三前置级PST3中，在保持时间HT期间在反馈节点NFB持续输入所述初始前置级IPST的时钟信号CK_IPST，因此第三Q节点NQ3可以在保持时间HT期间不产生由于连接所述反馈节点NFB与所述Q节点NQ的晶体管的泄漏电流。
例如，在第四前置级PST4中，在保持时间HT的一部分区间期间在反馈节点NFB输入所述初始前置级IPST的时钟信号CK_IPST，因此第四Q节点NQ4可以在保持时间HT期间由于连接所述反馈节点NFB与所述Q节点NQ的晶体管的泄漏电流产生的区间相比于现有技术减小为1/3。例如，第四Q节点NQ4可以在保持时间HT期间由于连接所述反馈节点NFB与所述Q节点NQ的晶体管的泄漏电流产生的区间从3H减小为1H。即，在保持时间HT期间，可以将由于连接所述反馈节点NFB与所述Q节点NQ的晶体管的泄漏电流最小化。
如在图9中看到的，所述反馈前置级FBPST(参照图7)可以基于保持为正常电平的Q节点NQ的电压，生成进位信号。所述反馈前置级FBPST可以将所述进位信号输出于所述有源级。在从所述反馈前置级FBPST接收所述进位信号的输入的情况下，有源级AST1～ASTX(参照图2)可以输出正常的感测信号以及正常的栅极信号。结果，所述栅极驱动部及包括其的显示装置可以使显示装置的显示品质提升。
图10是示出根据本发明的实施例的电子设备1000的框图，图11是示出图10的电子设备1000实现为智能电话的一例的图.
参照图10和图11，电子设备1000可以包括处理器1010、内存装置1020、存储装置1030、输入输出装置1040、电源1050以及显示装置1060。此时，显示装置1060可以是图1的显示装置。另外，电子设备1000可以还包括可以与视频卡、声卡、内存卡、USB装置等通信或者与其它***通信的多种端口(port)。在一实施例中，如图11所示，电子设备1000可以实现为智能电话。但是，这是示例性的，电子设备1000不限于此。例如，电子设备1000也可以实现为移动电话、视频电话、智能平板、智能手表、平板PC、车用导航仪、计算机监视器、笔记本计算机、头戴式显示装置等。
处理器1010可以执行特定计算或者任务(task)。根据实施例，处理器1010可以为微处理器(micro processor)、中央处理单元(central processing unit)、应用处理器(application processor)等。处理器1010可以通过地址总线(address bus)、控制总线(control bus)以及数据总线(data bus)等与其它构成要件连接。根据实施例，处理器1010也可以与外设部件互连标准(Peripheral Component Interconnect；PCI)总线之类扩展总线连接。内存装置1020可以存储电子设备1000的工作需要的数据。例如，内存装置1020可以包括可擦可编程只读存储器(Erasable Programmable Read-Only Memory；EPROM)装置、带电可擦可编程只读存储器(Electrically Erasable Programmable Read-Only Memory；EEPROM)装置、闪速存储器装置(flash memory device)、相变随机存取存储器(PhaseChange Random Access Memory；PRAM)装置、电阻随机存取存储器(Resistance RandomAccess Memory；RRAM)装置、纳米浮栅存储器(Nano Floating Gate Memory；NFGM)装置、聚合物随机存取存储器(Polymer Random Access Memory；PoRAM)装置、磁性随机存取存储器(Magnetic Random Access Memory；MRAM)、铁电随机存取存储器(Ferroelectric RandomAccess Memory；FRAM)装置等之类非挥发性内存装置及/或动态随机存取存储器(DynamicRandom Access Memory；DRAM)装置、静态随机存取存储器(Static Random AccessMemory；SRAM)装置、移动DRAM装置等之类挥发性内存装置。存储装置1030可以包括固态驱动器(Solid State Drive；SSD)、硬盘驱动器(Hard Disk Drive；HDD)、光盘只读存储器(CD-ROM)等。输入输出装置1040可以包括键盘、小键盘、触摸板、触摸屏、鼠标等之类输入部件以及扬声器、打印机等之类输出部件。根据实施例，显示装置1060也可以包括在输入输出装置1040中。电源1050可以供应电子设备1000的工作需要的电力。显示装置1060可以通过总线或者其它通信链路与其它构成要件连接。
显示装置1060可以显示与电子设备1000的视觉信息相应的图像。此时，显示装置1060可以将前置级的Q节点的电压电平稳定化，从而使图像品质提升。为了此，显示装置1060可以包括显示面板、数据驱动部以及栅极驱动部。所述显示面板可以包括显示图像的显示部以及与所述显示部相邻的周边部。所述数据驱动部可以将数据电压施加于所述显示面板。所述栅极驱动部可以包括将栅极信号输出于所述显示部的多个有源级以及连接于所述有源级而向所述有源级输出进位信号的多个前置级。所述多个前置级可以包括第一前置级以及第二前置级。在此，所述第二前置级可以包括Q节点补偿部，Q节点补偿部从所述第一前置级接收时钟信号的输入，并基于所述第一前置级的所述时钟信号补偿Q节点的电压。
如此，根据本发明的前置级可以从之前前置级接收时钟信号的输入，并基于所述之前前置级的所述时钟信号补偿Q节点的电压，以保持所述Q节点的电压。结果，所述栅极驱动部及包括其的显示装置可以使显示装置的显示品质提升。但是，针对此有上述内容，因此关于其的重复说明将省略。
本发明可以适用于显示装置及包括其的电子设备。例如，本发明可以适用于移动电话、智能电话、视频电话、智能平板、智能手表、平板PC(个人计算机)、车用导航***、电视、计算机监视器、笔记本计算机、数码相机、头戴式显示器等。
以上参照本发明的示例性实施例进行了说明，但是在本技术领域中具有通常的知识的人将可以理解在不脱离所附的权利要求书中记载的本发明的构思以及领域的范围内可以对本发明进行各种修改以及变更。

Claims (20)

1.一种栅极驱动部，其特征在于，包括：
多个有源级，将栅极信号输出于显示部；以及
多个前置级，连接于所述有源级而向所述有源级输出进位信号，
所述多个前置级包括第一前置级以及第二前置级，
所述第二前置级包括：
Q节点补偿部，从所述第一前置级接收时钟信号的输入，并基于所述第一前置级的所述时钟信号补偿Q节点的电压，
所述Q节点补偿部包括：
反馈晶体管，将接收所述第一前置级的所述时钟信号的输入的反馈输入端子与所述第二前置级的反馈节点二极管连接，
所述反馈晶体管包括第一电极、第二电极以及第三电极，所述第一电极与所述反馈输入端子连接，所述第二电极与所述第一电极连接，所述第三电极与所述反馈节点连接。
2.根据权利要求1所述的栅极驱动部，其特征在于，
所述第一前置级的所述时钟信号是所述第一前置级的进位信号、所述第一前置级的感测信号以及所述第一前置级的栅极信号中的一个。
3.根据权利要求1所述的栅极驱动部，其特征在于，
所述Q节点补偿部调节施加于所述反馈节点的电压电平，从而减小连接所述反馈节点与所述Q节点的晶体管中的至少一个晶体管的漏极-源极电压。
4.根据权利要求3所述的栅极驱动部，其特征在于，
所述第二前置级包括：
Q节点充电部，接收垂直起始信号的输入而对所述Q节点充电；
Q节点稳定化部，接收所述有源级的进位信号的输入而将所述Q节点稳定化；以及
反相部，基于所述Q节点的所述电压，生成反相信号。
5.根据权利要求4所述的栅极驱动部，其特征在于，
所述第二前置级的所述反馈节点与所述Q节点充电部、所述Q节点稳定化部以及所述反相部连接。
6.根据权利要求4所述的栅极驱动部，其特征在于，
所述第二前置级包括：
晶体管稳定化部，基于晶体管稳定化信号，将连接于所述反馈节点的多个晶体管稳定化，
所述晶体管稳定化部包括第一晶体管稳定化晶体管以及第二晶体管稳定化晶体管，
所述第一晶体管稳定化晶体管包括：第一电极，连接于所述第二晶体管稳定化晶体管；第二电极，连接于所述Q节点；以及第三电极，连接于所述反馈节点，
所述第二晶体管稳定化晶体管包括：第一电极，被施加栅极高电压；第二电极，连接于所述Q节点；以及第三电极，连接于所述第一晶体管稳定化晶体管。
7.根据权利要求4所述的栅极驱动部，其特征在于，
所述Q节点充电部包括第一充电晶体管以及第二充电晶体管，
所述第二充电晶体管包括：第一电极，接收所述垂直起始信号的输入；第二电极，连接于所述第二充电晶体管的所述第一电极；以及第三电极，连接于所述第一充电晶体管，
所述第一充电晶体管包括：第一电极，连接于所述第二充电晶体管；第二电极，连接于所述第二充电晶体管的所述第一电极；以及第三电极，连接于所述Q节点。
8.根据权利要求4所述的栅极驱动部，其特征在于，
所述Q节点稳定化部包括第一稳定化晶体管以及第二稳定化晶体管，
所述第一稳定化晶体管包括：第一电极，连接于所述第二稳定化晶体管；第二电极，被施加之后进位信号中的任一个；以及第三电极，连接于所述Q节点，
所述第二稳定化晶体管包括：第一电极，被施加第一低电压；第二电极，被施加所述之后进位信号中的任一个；以及第三电极，连接于所述第一稳定化晶体管。
9.根据权利要求4所述的栅极驱动部，其特征在于，
所述Q节点充电部、所述Q节点稳定化部以及所述反相部各自由氧化物半导体晶体管构成。
10.根据权利要求4所述的栅极驱动部，其特征在于，
所述第二前置级调节所述反馈节点的电压电平，从而减小连接所述反馈节点与所述Q节点的晶体管的泄漏电流，基于所述Q节点的所述电压生成进位信号，并将所述进位信号输出于所述有源级。
11.一种显示装置，其特征在于，包括：
显示面板，包括显示图像的显示部以及与所述显示部相邻的周边部；
数据驱动部，将数据电压施加于所述显示面板；以及
栅极驱动部，包括：多个有源级，将栅极信号输出于所述显示部；以及多个前置级，连接于所述有源级而向所述有源级输出进位信号，
所述多个前置级包括第一前置级以及第二前置级，
所述第二前置级包括：
Q节点补偿部，从所述第一前置级接收时钟信号的输入，并基于所述第一前置级的所述时钟信号补偿Q节点的电压，
所述Q节点补偿部包括：
反馈晶体管，将接收所述第一前置级的所述时钟信号的输入的反馈输入端子与所述第二前置级的反馈节点二极管连接，
所述反馈晶体管包括第一电极、第二电极以及第三电极，所述第一电极与所述反馈输入端子连接，所述第二电极与所述第一电极连接，所述第三电极与所述反馈节点连接。
12.根据权利要求11所述的显示装置，其特征在于，
所述第一前置级的所述时钟信号是所述第一前置级的进位信号、所述第一前置级的感测信号以及所述第一前置级的栅极信号中的一个。
13.根据权利要求11所述的显示装置，其特征在于，
所述Q节点补偿部调节施加于所述反馈节点的电压电平，从而减小连接所述反馈节点与所述Q节点的晶体管中的至少一个晶体管的漏极-源极电压。
14.根据权利要求13所述的显示装置，其特征在于，
所述第二前置级包括：
Q节点充电部，接收垂直起始信号的输入而对所述Q节点充电；
Q节点稳定化部，接收所述有源级的进位信号的输入而将所述Q节点稳定化；以及
反相部，基于所述Q节点的所述电压，生成反相信号。
15.根据权利要求14所述的显示装置，其特征在于，
所述第二前置级的所述反馈节点与所述Q节点充电部、所述Q节点稳定化部以及所述反相部连接。
16.根据权利要求14所述的显示装置，其特征在于，
所述第二前置级包括：
晶体管稳定化部，基于晶体管稳定化信号，将连接于所述反馈节点的多个晶体管稳定化，
所述晶体管稳定化部包括第一晶体管稳定化晶体管以及第二晶体管稳定化晶体管，
所述第一晶体管稳定化晶体管包括：第一电极，连接于所述第二晶体管稳定化晶体管；第二电极，连接于所述Q节点；以及第三电极，连接于所述反馈节点，
所述第二晶体管稳定化晶体管包括：第一电极，被施加栅极高电压；第二电极，连接于所述Q节点；以及第三电极，连接于所述第一晶体管稳定化晶体管。
17.根据权利要求14所述的显示装置，其特征在于，
所述Q节点充电部包括第一充电晶体管以及第二充电晶体管，
所述第二充电晶体管包括：第一电极，接收所述垂直起始信号的输入；第二电极，连接于所述第二充电晶体管的所述第一电极；以及第三电极，连接于所述第一充电晶体管，
所述第一充电晶体管包括：第一电极，连接于所述第二充电晶体管；第二电极，连接于所述第二充电晶体管的所述第一电极；以及第三电极，连接于所述Q节点。
18.根据权利要求14所述的显示装置，其特征在于，
所述Q节点稳定化部包括第一稳定化晶体管以及第二稳定化晶体管，
所述第一稳定化晶体管包括：第一电极，连接于所述第二稳定化晶体管；第二电极，被施加之后进位信号中的任一个；以及第三电极，连接于所述Q节点，
所述第二稳定化晶体管包括：第一电极，被施加第一低电压；第二电极，被施加所述之后进位信号中的任一个；以及第三电极，连接于所述第一稳定化晶体管。
19.根据权利要求14所述的显示装置，其特征在于，
所述Q节点充电部、所述Q节点稳定化部以及所述反相部各自由氧化物半导体晶体管构成。
20.根据权利要求14所述的显示装置，其特征在于，
所述第二前置级调节所述反馈节点的电压电平，从而减小连接所述反馈节点与所述Q节点的晶体管的泄漏电流，基于所述Q节点的所述电压生成进位信号，并将所述进位信号输出于所述有源级。
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