CN115223494B - 驱动电路及显示面板 - Google Patents

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Abstract

本申请公开了一种驱动电路及显示面板，该驱动电路包括第一晶体管、第一电容、发光器件、脉冲宽度调制模块以及第一外部侦测模块；其中，脉冲宽度调制模块包括第二晶体管；第一晶体管的栅极与第一节点电连接，第一晶体管的源极和漏极中的一者与第一电源端电连接，第一晶体管的源极和漏极中的另一者与第二节点电连接；发光器件的一端与第二节点电连接，发光器件的另一端与第二电源端电连接；第一外部侦测模块接入脉冲宽度调制信号，并与第一节点电连接。通过第一外部侦测模块侦测并补偿脉冲宽度调制模块中的第二晶体管的阈值电压，以保证画面显示的均一性，提高显示面板的显示效果。

Description

驱动电路及显示面板
技术领域
本申请涉及显示技术领域，具体涉及一种驱动电路及显示面板。
背景技术
目前，显示面板常见的像素驱动方式有两种，即脉冲幅度调制(Pulse AmplitudeModulation，PAM)驱动以及脉冲宽度调制(Pulse Width Modulation，PWM)驱动。其中，PAM驱动是通过控制每个像素单元中的发光器件的驱动电流大小来实现不同亮度显示，但是，PAM驱动方式在低灰阶下存在色点漂移的问题，从而影响显示效果；PWM驱动是通过控制每个像素单元中的发光器件的发光时间来实现不同亮度显示，但是，PWM驱动方式对栅极驱动芯片(Gate IC)的要求较高。
为此，结合PWM驱动方式以及PAM驱动方式的优点，本领域技术人员开发出了PHM混合电路，低灰阶时采用PWM驱动，高灰阶时采用PAM驱动。其中，PHM混合电路的PWM模块包括PWM驱动晶体管，PWM驱动晶体管的阈值电压(Vth)值决定了PWM驱动晶体管的打开时间，从而决定了发光器件的发光时间，当多个PWM驱动晶体管的Vth值不同时，发光器件的发光时间受影响较大，从而影响显示画面的均一性。
发明内容
本申请提供一种驱动电路以及显示面板，通过对驱动电路的PWM驱动晶体管的阈值电压进行侦测，以对PWM驱动晶体管进行外部补偿，达到画面显示的均一性。
第一方面，本申请提供一种驱动电路，其包括：
第一晶体管，所述第一晶体管的栅极与第一节点电连接，所述第一晶体管的源极和漏极中的一者与第一电源端电连接，所述第一晶体管的源极和漏极中的另一者与第二节点电连接；
发光器件，所述发光器件的一端与所述第二节点电连接，所述发光器件的另一端与第二电源端电连接；
第一电容，所述第一电容的第一端与所述第一节点电连接，所述第一电容的第二端与所述第二节点电连接；
脉冲宽度调制模块，所述脉冲宽度调制模块接入脉冲宽度调制信号以及数据信号，并与所述第二电源端以及所述第一节点电连接，所述脉冲宽度调制模块包括第二晶体管，所述脉冲宽度调制模块用于在所述脉冲宽度调制信号的控制下，调整流经所述发光器件的驱动电流的脉冲宽度；以及
第一外部侦测模块，所述第一外部侦测模块接入所述脉冲宽度调制信号，并与所述第一节点电连接，所述第一外部侦测模块用于侦测并补偿所述第二晶体管的阈值电压。
在本申请提供的驱动电路中，所述第二电源端接入的信号包括恒压高电平信号以及恒压低电平信号。
在本申请提供的驱动电路中，当所述第一外部侦测模块侦测所述第二晶体管的阈值电压时，所述第二电源端接入所述恒压高电平信号；当所述第一外部侦测模块没有侦测所述第二晶体管的阈值电压时，所述第二电源端接入所述恒压低电平信号。
在本申请提供的驱动电路中，所述第一外部侦测模块包括第三晶体管；
所述第三晶体管的栅极接入所述脉冲宽度调制信号，所述第三晶体管的源极和漏极中的一者与所述第一节点电连接，所述第三晶体管的源极和漏极中的另一者与第一侦测端电连接。
在本申请提供的驱动电路中，所述脉冲宽度调制模块还包括第四晶体管；
所述第四晶体管的栅极接入所述脉冲宽度调制信号，所述第四晶体管的源极和漏极中的一者接入所述数据信号，所述第四晶体管的源极和漏极中的另一者与第三节点电连接；
所述第二晶体管的栅极与所述第三节点电连接，所述第二晶体管的源极和漏极中的一者与所述第二电源端电连接，所述第二晶体管的源极和漏极中的另一者与所述第一节点电连接。
在本申请提供的驱动电路中，所述脉冲宽度调制模块还包括第二电容；
所述第二电容的第一端接入扫频信号，所述第二电容的第二端与所述第三节点电连接，从而所述扫频信号通过所述第二电容调整所述第三节点电位。
在本申请提供的驱动电路中，所述驱动电路还包括脉冲幅度调制模块；
所述脉冲幅度调制模块接入脉冲幅度调制信号以及所述数据信号，并与所述第一节点电连接，所述脉冲幅度调制模块用于在所述脉冲幅度调制信号的控制下，调整所述驱动电流的脉冲幅度。
在本申请提供的驱动电路中，所述脉冲幅度调制模块包括第五晶体管；
所述第五晶体管的栅极接入所述脉冲幅度调制信号，所述第五晶体管的源极和漏极中的一者接入所述数据信号，所述第五晶体管的源极和漏极中的另一者与所述第一节点电连接。
在本申请提供的驱动电路中，所述驱动电路还包括第二外部侦测模块；
所述第二外部侦测模块接入所述脉冲幅度调制信号，并与所述第二节点电连接，所述第二外部侦测模块用于侦测并补偿所述第一晶体管的阈值电压。
在本申请提供的驱动电路中，所述第二外部侦测模块包括第六晶体管；
所述第六晶体管的栅极接入所述脉冲幅度调制信号，所述第六晶体管的源极和漏极中的一者与第二侦测端电连接，所述第六晶体管的源极和漏极中的另一者与所述第二节点电连接。
第二方面，本申请还提供一种显示面板，其包括如上所述的驱动电路。
本申请提供的驱动电路以及显示面板，通过设置第一外部侦测模块电连接于第一节点，实现对脉冲宽度调制模块中的第二晶体管的阈值电压进行侦测，即对PWM驱动晶体管的阈值电压进行侦测，以对PWM驱动晶体管的阈值电压进行外部补偿，保证画面显示的均一性，提高显示面板的显示效果。
附图说明
图1为本申请实施例提供的驱动电路的第一种结构示意图；
图2为图1示出的驱动电路的第二晶体管的阈值电压侦测时序图；
图3为图1提供的驱动电路在图2所示的时序下的第一初始化阶段的通路示意图；
图4为本申请实施例提供的驱动电路的第二种结构示意图；
图5为图4示出的驱动电路的第一晶体管的阈值电压侦测时序图；
图6为图4提供的驱动电路在图5所示的时序下的第二初始化阶段的通路示意图；
图7为图4提供的驱动电路在图5所示的驱动时序下的第二侦测阶段的通路示意图；
图8为本申请实施例提供的驱动电路的第三种结构示意图；
图9为图8示出的驱动电路的发光时序图；
图10为图8提供的驱动电路在图9所示的驱动时序下的第三初始化阶段的通路示意图；
图11为图8提供的驱动电路在图9所示的驱动时序下的数据写入阶段的通路示意图；
图12为图8提供的驱动电路在图9所示的驱动时序下的发光阶段的通路示意图。
具体实施方式
下面将结合本申请实施例中的附图，对本申请实施例中的技术方案进行清楚、完整地描述。显然，所描述的实施例仅仅是本申请的一部分实施例，而不是全部的实施例。基于本申请中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本申请保护的范围。
此外，本申请的说明书和权利要求书中的术语“第一”、“第二”等是用于区别不同对象，而不是用于描述特定顺序。术语“包括”和“具有”以及它们任何变形，意图在于覆盖不排他的包含。由于本申请采用的晶体管的源极、漏极是对称的，所以其源极、漏极是可以互换的。按附图中的形态规定晶体管的中间端为栅极、信号输入端为源极、输出端为漏极。
下文的公开提供了许多不同的实施方式或例子用来实现本申请的不同结构。为了简化本申请的公开，下文中对特定例子的部件和设置进行描述。当然，它们仅仅为示例，并且目的不在于限制本申请。此外，本申请可以在不同例子中重复参考数字和/或参考字母，这种重复是为了简化和清楚的目的，其本身不指示所讨论各种实施方式和/或设置之间的关系。
请参阅图1，图1为本申请实施例提供的驱动电路的第一种结构示意图。如图1所示，本申请实施例提供的驱动电路100包括：第一晶体管T1、发光器件D、第一电容C1、脉冲宽度调制模块10以及第一外部侦测模块20。需要说明的是，发光器件D可以为迷你发光二极管、微型发光二极管或有机发光二极管。
其中，第一晶体管T1的栅极与第一节点Q电连接，第一晶体管T1的源极和漏极中一者与第一电源端V1电连接，第一晶体管T1的源极和漏极中的另一者与第二节点S电连接。
其中，发光器件D的一端与第二节点Q电连接，发光器件D的另一端与第二电源端V2电连接。
其中，第一电容C1的第一端与第一节点Q电连接，第一电容C1的第二端与第二节点S电连接。
其中，脉冲宽度调制模块10接入脉冲宽度调制信号SPWM以及数据信号Data，脉冲宽度调制模块10并与第二电源端V2以及第一节点Q电连接；其中，脉冲宽度调制模块10包括第二晶体管T2。
其中，第一外部侦测模块20接入脉冲宽度调制信号SPWM，并与第一节点Q电连接。
具体的，脉冲宽度调制模块10用于在脉冲宽度信号SPWM的控制下，将第二电源端V2提供的信号输出至第一节点Q，以调整第一节点Q的电位，从而控制第一晶体管T1开启或者关闭，从而调整流经发光器件D的驱动电流的脉冲宽度。
具体的，第一外部侦测模块20通过与第一节点Q电连接，从而可通过第一外部侦测模块20侦测以及补偿第一节点Q的电位，由于第二晶体管T2的阈值电压值可以通过第二晶体管T2的栅极与第一节点Q之间的电位差确定，因此，第一外部侦测模块20能用于侦测并外部补偿第二晶体管T2的阈值电压。
需要指出的是，本申请实施例提供的第二晶体管T2为脉冲宽度调制模块10中具有驱动作用的晶体管，换言之，第二晶体管T2为PWM驱动晶体管，第二晶体管T2的阈值电压值决定了自身的打开时间，从而第二晶体管T2的阈值电压值决定了发光器件D的发光时间。
本申请实施例提供的驱动电路100，通过设置第一外部侦测模块20电连接于第一节点Q，实现对脉冲宽度调制模块10中的第二晶体管T2的阈值电压进行侦测，即对PWM驱动晶体管的阈值电压进行侦测，以便于对PWM驱动晶体管的阈值电压进行外部补偿，实现发光器件的均匀发光，有利于提高显示面板的显示效果。
在本申请提供的一些实施例中，请继续参阅图1。如图1所示，在驱动电路100中，第一外部侦测模块20包括第三晶体管T3；脉冲宽度调制模块10包括第二晶体管T2以及第四晶体管T4。
其中，第二晶体管T2的栅极与第三节点P电连接，第二晶体管T2的源极和漏极中的一者与第二电源端V2电连接，第二晶体管T2的源极和漏极中的另一者与第一节点Q电连接。
其中，第二电源端V2接入的信号包括恒压高电平信号以及恒压低电平信号。
其中，第三晶体管T3的栅极接入脉冲宽度调制信号SPWM，第三晶体管T3的源极和漏极中的一者与第一节点Q电连接，第三晶体管T3的源极和漏极中的另一者与第一侦测端Sense1电连接。
其中，第四晶体管T4的栅极接入脉冲宽度调制信号SPWM，第四晶体管T4的源极和漏极一者接入数据信号Data，第四晶体管T4的源极和漏极中的另一者与第三节点P电连接。
具体的，第四晶体管T4用于在脉冲宽度调制信号SPWM的控制下，将数据信号Data提供至第三节点P。第二晶体管T2用于根据第三节点P的电位，将第二电源端V2接入的信号提供至第一节点Q，从而第一晶体管T1可根据第一节点Q的电位，将第一电源端V1接入的信号提供至第二节点S，进而第二节点S的电位升高至预设电位时，发光器件D基于预设电位发光。第三晶体管T3用于在脉冲宽度调制信号SPWM的控制下，将第一侦测端Sense1提供的信号输出至第一节点Q。进一步的，当第一侦测端Sense1接入复位信号(图中未示出)时，第三晶体管T3将复位信号输出至第一节点Q；当第一侦测端Sense1与外部ADC模块电连接时，第三晶体管T3将第一节点Q的电位输出至外部ADC模块，以对第二晶体管T2的阈值电压进行侦测并补偿。
请参阅图2，图2为图1示出的驱动电路的第二晶体管的阈值电压侦测时序图。需要注意的是，为方便进行说明，图1示出的驱动电路均采用N型晶体管，但是，这不应该构成对本申请实施例的限制，在一些实施例中，驱动电路100可均采用P型晶体管，或者，部分采用N型晶体管，部分采用P型晶体管。如图2所示，脉冲宽度调制信号SPWM、数据信号Data、第一电源端V1接入的信号以及第二电源端V2接入的信号相组合先后对应于第一初始化阶段t11、第一侦测阶段t12。
在一些实施例中，第一初始化阶段t11，第一电源端V1接入的信号、第二电源端V2接入的信号以及脉冲宽度调制信号SPWM均为高电平信号。此时，数据信号Data为低电平信号。
在一些实施例中，第一侦测阶段t12，第一电源端V1接入的信号、第二电源端V2接入的信号、脉冲宽度调制信号SPWM以及数据信号Data均为高电平信号。
具体的，请参阅图2以及图3，图3为图1提供的驱动电路在图2所示的时序下的第一初始化阶段的通路示意图。
在第一初始化阶段t11，脉冲宽度调制信号SPWM为高电平信号，第二晶体管T2在脉冲宽度调制信号SPWM的控制下打开，从而将数据信号Data输出至第三节点P，以实现对第三节点P的初始化。
同时，脉冲宽度调制信号SPWM为高电平信号，第三晶体管T3在脉冲宽度调制信号SPWM的控制下打开，从而第三晶体管T3将第一侦测端Sense1提供的复位信号输出至第一节点Q，以实现对第一节点Q的初始化。
由于本阶段的数据信号Data为低电平信号，则VP-VQ<Vth2，其中，VP表示P点的电位，VQ表示Q点的电位，Vth2表示第二晶体管T2的阈值电压。故第四晶体管T4处于关闭状态。
值得一提的是，在本阶段中，由于第一节点Q为低电平信号，第一晶体管T1处于关闭状态，发光器件D不发光。
具体的，请再次参阅图1以及图2。由于在图2所示的驱动时序下的第一侦测阶段的通路示意图与图1示出的电路图一致，故用图2以及图1进行说明。
在第一侦测阶段t12，脉冲宽度调制信号SPWM为高电平信号，第二晶体管T2在脉冲宽度调制信号SPWM的控制下打开，从而将数据信号Data输出至第三节点P。由于本阶段的数据信号Data为高电平信号，故在本阶段中，通过控制第二晶体管T2打开，并且对第三节点P输出高电平信号，以实现对第三节点P的充电。第二晶体管T2的栅极与第三节点P电连接，从而第二晶体管T2基于第三节点P的电位打开，第二晶体管T2将第二电源端V2提供的信号输出至第一节点Q，并且，第二电源端V2为高电平信号，进而通过第二晶体管T2以及第二电源端V2可对第一节点Q进行充电。当Q点的电位抬升至VP-VQ＝Vth2时，第二晶体管T2处于截止状态，此时，第一节点Q的电位不再上升。
与此同时，脉冲宽度调制信号SPWM为高电平信号，第三晶体管T3在脉冲宽度调制信号SPWM的控制下打开，使第一侦测端Sense1与外部ADC模块电连接，即可侦测得到第一节点Q的电位，进而可侦测得到第二晶体管T2的阈值电压值，以实现对第二晶体管T2阈值电压的侦测以及外部补偿。
需要注意的是，在侦测第二晶体管T2的阈值电压的过程中，也即在第一初始化阶段t11以及第一侦测阶段t12中，第一电源端V1和第二电源端V2均为高电平信号，则第一外部侦测模块20侦测第二晶体管T2的阈值电压时，第二电源端V2可接入恒压高电平信号，第一电源端V1也可接入恒压高电平信号。
值得一提的是，当第一外部侦测模块20没有侦测第二晶体管T2的阈值电压时，第二电源端V2接入恒压低电平信号。
请参阅4，图4为本申请实施例提供的驱动电路的第二种结构示意图。如图4所示，本申请实施例提供的驱动电路与图1的区别在于：在本实施例提供的驱动电路200中，还包括脉冲幅度调制模块30。
其中，脉冲幅度调制模块30接入脉冲幅度调制信号SPAM以及数据信号Data，脉冲幅度调制模块30并与第一节点Q电连接。
具体的，脉冲幅度调制模块30用于在脉冲幅度调制信号SPAM的控制下，将数据信号Data输出至第一节点Q，从而第一晶体管T1基于第一节点Q的电位打开，对第二节点S进行充电。当第二节点S的电位提升至预设电位时，发光器件D基于预设电位发光。从而脉冲幅度调制模块30用于调整流经发光器件D的驱动电流的脉冲幅度。
请继续参阅图4，在本实施例提供的驱动电路200中，还包括第二外部侦测模块40。
其中，第二外部侦测模块40接入脉冲幅度调制信号SPAM，并与第二节点S电连接。
具体的，第二外部侦测模块40通过与第二节点S电连接，从而可通过第二外部侦测模块40侦测以及补偿第二节点S的电位。由于第一晶体管T1的阈值电压可以通过第一节点Q与第二节点S之间的电位差确定，因此，第二外部侦测模块40能用于侦测并外部补偿第一晶体管T1的阈值电压。
本申请实施例提供的驱动电路200，通过增设第二外部侦测模块40电连接于第二节点S，实现对第一晶体管T1的阈值电压进行侦测，以对第一晶体管T1的阈值电压进行外部补偿，实现发光器件D的均匀发光，提高发光器件D的发光效果。
在本申请提供的一些实施例中，请继续参阅图4。如图4所示，在驱动电路200中，脉冲幅度调制模块30包括第五晶体管T5；第二外部侦测模块40包括第六晶体管T6。
其中，第五晶体管T5的栅极接入脉冲幅度调制信号SPAM，第五晶体管T5的源极和漏极中的一者接入数据信号Data，第五晶体管T5的源极和漏极中的另一者与第一节点Q电连接。
具体的，第五晶体管T5用于在脉冲幅度调制信号SPAM的控制下，将数据信号Data提供至第一节点Q。以便于第一晶体管T1基于第一节点Q的电位打开或者关闭。
其中，第六晶体管T6的栅极接入脉冲幅度调制信号SPAM，第六晶体管T6的源极和漏极中的一者与第二侦测端Sense2电连接，第六晶体管T6的源极和漏极中的另一者与第二节点S电连接。
具体的，第六晶体管T6用于在脉冲幅度调制信号SPAM的控制下，将第二侦测端Sense2提供的信号输出至第二节点S。进一步的，当第二侦测端Sense2接入复位信号(图中未示出)时，第六晶体管T6将复位信号输出至第二节点S；当第二侦测端Sense2与外部ADC模块(图中未示出)电连接时，第六晶体管T6将第二节点S的电位输出至外部ADC模块，以对第一晶体管T1的阈值电压进行侦测并外部补偿。
请参阅图5，图5为图4示出的驱动电路的第一晶体管的阈值电压侦测时序图。需要注意的是，图5示出的驱动电路均采用N型晶体管，但是，这不应构成对本申请的限制。在一些实施例中，驱动电路200也可均采用P型晶体管；在一些实施例中，驱动电路200可部分采用P型晶体管以及部分采用N型晶体管。
如图5所示，脉冲宽度调制信号SPWM、脉冲幅度调制信号SPAM、数据信号Data、第一电源端V1接入的信号以及第二电源端V2接入的信号相组合先后对应于第二初始化阶段t21、第二充电及侦测阶段t22。
在一些实施例中，第二初始化阶段t21，第一电源端V1接入的信号以及脉冲宽度调制信号SPWM均为高电平信号。此时，第二电源端V2接入的信号、脉冲幅度调制信号SPAM以及数据信号Data均为低电平信号。
在一些实施例中，第二充电及侦测阶段t22，第一电源端V1接入的信号、脉冲幅度调制信号SPAM以及数据信号Data均为高电平信号。此时，第二电源端V2接入的信号以及脉冲宽度调制信号SPWM均为低电平信号。
具体的，请参阅图5以及图6，图6为图4提供的驱动电路在图5所示的时序下的第二初始化阶段的通路示意图。
在第二初始化阶段t21，脉冲宽度调制信号SPWM为高电平信号，第三晶体管T3在脉冲宽度调制信号SPWM的控制下打开，从而第三晶体管T3将第一侦测端Sense1提供的复位信号输出至第一节点Q，以实现对第一节点Q的初始化。
同时，在第二初始化阶段t21，脉冲宽度调制信号SPWM为高电平信号，第二晶体管T2在脉冲宽度调制信号SPWM的控制下打开，从而将数据信号Data输出至第三节点P，以实现对第三节点P的初始化。需要注意的是，在本阶段，数据信号Data为低电平信号，则VP-VQ<Vth2，故第二晶体管T2处于关闭状态。
值得一提的是，在本阶段中，由于第一节点Q为低电平信号，因此，第一晶体管T1处于关闭状态，发光器件D不发光。在本阶段中，由于脉冲幅度调制信号SPAM为低电平信号，因此，第五晶体管T5以及第六晶体管T6均处于关闭状态。
具体的，请参阅图5以及图7，图7为图4提供的驱动电路在图5所示的驱动时序下的第二侦测阶段的通路示意图。
在第二侦测阶段t22，脉冲幅度调制信号SPAM为高电平信号，第五晶体管T5在脉冲幅度调制信号SPAM的控制下打开，从而第五晶体管T5将数据信号Data输出至第一节点Q，以实现对第一节点Q的充电。
同时，脉冲幅度调制信号SPAM为高电平信号，第六晶体管T6在脉冲幅度调制信号SPAM的控制下打开，从而第六晶体管T6将第二节点S的电位输出至第二侦测端Sense2，以使外部ADC模块对第一晶体管T1的阈值电压进行侦测并补偿。
由于本阶段的脉冲宽度调制信号SPWM为低电平信号，则第三晶体管T3、第四晶体管T4以及第二晶体管T2处于关闭状态。
在本申请提供的一些实施例中，请参阅图8，图8为本申请实施例提供的驱动电路的第三种结构示意图。如图8所示，本实施例提供驱动电路与前述驱动电路的区别在于：在本申请提供的驱动电路300中，脉冲宽度调制模块10还包括第二电容C2。
其中，第二电容C2的第一端接入扫频信号SWEEP，第二电容C2的第二端与第三节点P电连接。
具体的，基于扫频信号SWEEP以及第二电容C2的耦合作用调整第三节点P的电位，从而控制第二晶体管T2的打开时间，进而控制发光器件D的发光时间。
本申请实施例提供的驱动电路300，通过增设第二电容C2电连接于第三节点P，并且第二电容C2接入扫频信号SWEEP，从而控制第二晶体管T2的打开时间，进一步控制第一节点Q的电位，进而控制第一晶体管T1的打开时间，再而控制发光器件D的发光时间。
请参阅图9，图9为图8示出的驱动电路的发光时序图。需要注意的是，图9示出的驱动电路均采用N型晶体管。如图9所示，脉冲宽度调制信号SPWM、脉冲幅度调制信号SPAM、数据信号Data、第一电源端V1接入的信号、第二电源端V2接入的信号以及扫频信号SWEEP相组合先后对应于第三初始化阶段t31、数据写入阶段t32以及发光阶段t33。
在一些实施例中，第三初始化阶段t31，脉冲宽度调制信号SPWM、数据信号Data以及扫频信号SWEEP均为高电平信号，第一电源端V1的信号、第二电源端V2的信号以及脉冲幅度调制信号SPAM均为低电平信号。
在一些实施例中，数据写入阶段t32，脉冲幅度调制信号SPAM以及数据信号Data为高电平信号，第一电源端V1的信号、第二电源端V2的信号、脉冲幅度调制信号SPAM以及扫频信号SWEEP均为低电平信号。
在一些实施例中，发光阶段t33，第一电源端V1的信号为高电平信号，脉冲幅度调制信号SPAM、脉冲宽度调制信号SPWM、数据信号Data以及第二电源端V2的信号均为低电平信号。此时，扫频信号SWEEP的电位逐步上升。
具体的，请参阅图9以及图10，图10为图8提供的驱动电路在图9所示的驱动时序下的第三初始化阶段的通路示意图。
在第三初始化阶段t31，脉冲宽度调制信号SPWM为高电平信号，第三晶体管T3在脉冲宽度调制信号SPWM的控制下打开，从而第三晶体管T3将第一侦测端Sense1提供的复位信号(图中未示出)输出至第一节点Q，以实现对第一节点Q的初始化。
同时，脉冲宽度调制信号SPWM为高电平信号，第四晶体管T4在脉冲宽度调制信号SPWM的控制下打开，从而第四晶体管T4将数据信号Data输出至第三节点P，以实现对第三节点P的初始化。此时，扫频信号SWEEP维持为高电平信号，第二电容C2对第三节点P的电位变化不产生影响。
需要指出的是，在本阶段中，第三节点P的电位还未上升至能够使第二晶体管打开的状态，因此，第二晶体管T2在第三初始化阶段t31为关闭状态。第一节点Q为低电位，则第一晶体管T1为关闭状态。
此外，本阶段中，由于脉冲幅度调制信号SPAM为低电平信号，则第五晶体管T5以及第六晶体管T6关闭。
具体的，请参阅图11以及图9，图11为图8提供的驱动电路在图9所示的驱动时序下的数据写入阶段的通路示意图。
在数据写入阶段t32，脉冲幅度调制信号SPAM为高电平信号，第五晶体管T5在脉冲幅度调制信号SPAM的控制下打开，从而第五晶体管T5将数据信号Data输出至第一节点Q，以对第一节点Q进行充电。此时，即使第一晶体管T1基于第一节点Q的电位打开，由于第一电源端V1以及第二电源端V2的电位均为0V，故发光器件D不发光。
同时，脉冲宽度调制信号SPWM为高电平信号，第六晶体管T6在脉冲幅度调制信号SPAM的控制下打开，从而第六晶体管T6将复位信号(图中未示出)输出至第二节点S，以实现对第二节点S的初始化。
需要指出的是，在本阶段中，为避免上一阶段使第三节点P的电位提升至令第二晶体管T2打开，本阶段的扫频信号SWEEP为低电平信号，即在第二电容C2的耦合作用下，扫频信号SWEEP将第三节点P的电位下拉，以确保第二晶体管T2处于关闭状态。
此外，在本阶段中，由于脉冲宽度调制信号SPWM为低电平信号，则第四晶体管T4以及第三晶体管T3关闭。
具体的，请参阅图12以及图9，图12为图8提供的驱动电路在图9所示的驱动时序下的发光阶段的通路示意图。
在发光阶段t33，脉冲幅度调制信号SPAM以及脉冲宽度调制信号SPWM均为低电平信号，则第三晶体管T3、第四晶体管T4、第五晶体管T5以及第六晶体管T6均关闭，第一电容C1用于维持第一节点Q与第二节点S之间的电位差，以使第一晶体管T1维持打开状态。第一电源端V1提供的信号为高电平信号，如图9所示，第一电源端V1提供的信号为12V。第一晶体管T1将第一电源端V1的高电平信号输出至第二节点S，以上拉第二节点S的电位，当第二节点S的电位上升至预设电位时，发光器件D基于预设电位发光。
与此同时，扫频信号SWEEP的电位逐步上升，扫频信号SWEEP通过第二电容C2的耦合作用抬升第三节点P的电位，以使第二晶体管T2打开，从而第二晶体管T2将第二电源端V2的电位输出至第一节点Q，如图9所示，第二电源端V2提供的信号为0V。由于第二电源端V2提供的信号为低电平信号，故第一节点Q的电位被下拉，第一晶体管T1关闭，发光器件D停止发光。
基于第四晶体管T4的开启能够将不同的数据电压Data输出至第三节点P，故通过在第三初始化阶段t31给第三节点P写入不同的电位来控制发光器件D的发光时间。
本申请的另一方面，提供一种显示面板，其包括上述至少一实施例中的驱动电路。可以理解的是，本申请提供的显示面板，通过设置第一外部侦测模块电连接于第一节点，实现对脉冲宽度调制模块中的PWM驱动晶体管的阈值电压进行侦测，以对PWM驱动晶体管的阈值电压进行外部补偿，提高画面显示的均一性，改善显示面板的显示效果。
以上仅为本申请的实施例，并非因此限制本申请的专利范围，凡是利用本申请说明书及附图内容所作的等效结构或等效流程变换，或直接或间接运用在其他相关的技术领域，均同理包括在本申请的专利保护范围内。

Claims (10)

1.一种驱动电路，其特征在于，包括：
第一晶体管，所述第一晶体管的栅极与第一节点电连接，所述第一晶体管的源极和漏极中的一者与第一电源端电连接，所述第一晶体管的源极和漏极中的另一者与第二节点电连接；
发光器件，所述发光器件的一端与所述第二节点电连接，所述发光器件的另一端与第二电源端电连接；
第一电容，所述第一电容的第一端与所述第一节点电连接，所述第一电容的第二端与所述第二节点电连接；
脉冲宽度调制模块，所述脉冲宽度调制模块接入脉冲宽度调制信号以及数据信号，并与所述第二电源端以及所述第一节点电连接，所述脉冲宽度调制模块用于在所述脉冲宽度调制信号的控制下，调整流经所述发光器件的驱动电流的脉冲宽度，所述脉冲宽度调制模块包括第二晶体管和第四晶体管，所述第四晶体管的栅极接入所述脉冲宽度调制信号，所述第四晶体管的源极和漏极中的一者接入所述数据信号，所述第四晶体管的源极和漏极中的另一者与第三节点电连接，所述第二晶体管的栅极与所述第三节点电连接，所述第二晶体管的源极和漏极中的一者与所述第二电源端电连接，所述第二晶体管的源极和漏极中的另一者与所述第一节点电连接；以及
第一外部侦测模块，所述第一外部侦测模块接入所述脉冲宽度调制信号，并与所述第一节点电连接，所述第一外部侦测模块用于侦测并补偿所述第二晶体管的阈值电压；
所述第二电源端接入的信号包括恒压高电平信号，当所述第一外部侦测模块侦测所述第二晶体管的阈值电压时，所述第二电源端接入所述恒压高电平信号，所述第一电源端也接入所述恒压高电平信号。
2.根据权利要求1所述的驱动电路，其特征在于，所述第二电源端接入的信号还包括恒压低电平信号。
3.根据权利要求2所述的驱动电路，其特征在于，当所述第一外部侦测模块没有侦测所述第二晶体管的阈值电压时，所述第二电源端接入所述恒压低电平信号。
4.根据权利要求1所述的驱动电路，其特征在于，所述第一外部侦测模块包括第三晶体管；
所述第三晶体管的栅极接入所述脉冲宽度调制信号，所述第三晶体管的源极和漏极中的一者与所述第一节点电连接，所述第三晶体管的源极和漏极中的另一者与第一侦测端电连接。
5.根据权利要求1所述的驱动电路，其特征在于，所述脉冲宽度调制模块还包括第二电容；
所述第二电容的第一端接入扫频信号，所述第二电容的第二端与所述第三节点电连接，从而所述扫频信号通过所述第二电容调整所述第三节点的电位。
6.根据权利要求1-5任一项所述的驱动电路，其特征在于，所述驱动电路还包括脉冲幅度调制模块；
所述脉冲幅度调制模块接入脉冲幅度调制信号以及所述数据信号，并与所述第一节点电连接，所述脉冲幅度调制模块用于在所述脉冲幅度调制信号的控制下，调整所述驱动电流的脉冲幅度。
7.根据权利要求6所述的驱动电路，其特征在于，所述脉冲幅度调制模块包括第五晶体管；
所述第五晶体管的栅极接入所述脉冲幅度调制信号，所述第五晶体管的源极和漏极中的一者接入所述数据信号，所述第五晶体管的源极和漏极中的另一者与所述第一节点电连接。
8.根据权利要求7所述的驱动电路，其特征在于，所述驱动电路还包括第二外部侦测模块；
所述第二外部侦测模块接入所述脉冲幅度调制信号，并与所述第二节点电连接，所述第二外部侦测模块用于侦测并补偿所述第一晶体管的阈值电压。
9.根据权利要求8所述的驱动电路，其特征在于，所述第二外部侦测模块包括第六晶体管；
所述第六晶体管的栅极接入所述脉冲幅度调制信号，所述第六晶体管的源极和漏极中的一者与第二侦测端电连接，所述第六晶体管的源极和漏极中的另一者与所述第二节点电连接。
10.一种显示面板，其特征在于，包括如权利要求1-9任一项所述的驱动电路。
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