CN114758610A - 显示面板的驱动架构 - Google Patents

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Abstract

本发明提供一种显示面板的驱动架构，其包含至少一驱动群组与至少一控制电路，驱动群组设置于一显示面板，每一驱动群组包括复数驱动器，该些驱动器相互串联，每一驱动器耦接显示面板的至少一显示元件。控制电路设置于显示面板并耦接驱动群组，且控制驱动群组。运用本发明的驱动架构于显示面板，可不需设置扫描线于显示面板，而可简化显示面板的结构。

Description

显示面板的驱动架构
技术领域
本发明是关于一种驱动架构，尤其涉及一种显示面板之驱动架构。
背景技术
显示设备已成为电子产品必要的装备，以用于显示信息。显示设备已从液晶显示设备发展至次毫米发光二极管(Mini LED)显示设备及微发光二极管(Micro LED)显示设备。由于显示设备的进化，习知驱动架构已不合用于进化的显示面板，例如次毫米发光二极管显示面板或者微发光二极管显示面板。运用习知驱动架构驱动显示面板，显示面板必须设置扫描线，如此增加显示面板的结构的复杂度。
基于上述，本发明提供一种显示面板的驱动架构，运用此驱动架构驱动显示面板，可不需设置扫描线于显示面板，而可简化显示面板的结构。
发明内容
本发明的一目的在于提供一种显示面板的驱动架构，其包含至少一驱动群组，驱动群组包含相互串联的复数驱动器，该些驱动器于不同时间接收输入数据，即该些驱动器接收的输入数据的画素数据不相同，以驱动显示面板的复数显示元件，如此可不需设置扫描线于显示面板。
本发明的一目的在于提供一种显示面板的驱动架构，其驱动器包含储存电路，可储存数据，未更新数据时，驱动器可依据储存的数据驱动显示元件显示影像。
本发明提供一种显示面板的驱动架构，其包含至少一驱动群组与至少一控制电路。驱动群组与控制电路设置于一显示面板，每一驱动群组包括复数驱动器，该些驱动器相互串联，每一驱动器耦接显示面板的至少一显示元件。控制电路耦接驱动群组，并控制驱动群组。运用本发明的驱动架构驱动显示面板，可不需设置扫描线于显示面板，而可简化显示面板的结构。
附图说明
图1：其为本发明的驱动架构的一实施例的示意图；
图2：其为本发明的控制电路与驱动群组的一实施例的方块图；以及
图3：其为本发明的储存电路与驱动器的一实施例的电路图。
【图号对照说明】
10 显示面板
14 显示元件
20 驱动群组
22 驱动器
24 致能电路
26 储存电路
261 缓冲器
263 控制器
265 内存
28 驱动电路
281 比较器
283 计数器
285 准位转换电路
286 第一晶体管
288 第二晶体管
30 控制电路
32 输入接口
33 致能电路
34 缓冲器
36 时序控制器
38 缓存器
39 调整电路
DCLK 时脉讯号
Din 输入数据
PWMCLK 时脉讯号
VDD 供应电压
VR 调整讯号
具体实施方式
为了使本发明的结构特征及所达成的功效有更进一步的了解与认识，特用较佳的实施例及配合详细的说明，说明如下：
在说明书及权利要求当中使用了某些词汇指称特定的元件，然，所属本发明技术领域中具有通常知识者应可理解，制造商可能会用不同的名词称呼同一个元件，而且，本说明书及权利要求并不以名称的差异作为区分元件的方式，而是以元件在整体技术上的差异作为区分的准则。在通篇说明书及权利要求当中所提及的「包含」为一开放式用语，故应解释成「包含但不限定于」。再者，「耦接」一词在此包含任何直接及间接的连接手段。因此，若文中描述一第一装置耦接一第二装置，则代表该第一装置可直接连接该第二装置，或可透过其他装置或其他连接手段间接地连接至该第二装置。
请参阅图1，其为本发明的驱动架构的第一实施例的示意图。如图所示，本发明的驱动架构用于驱动一显示面板10显示影像。驱动架构包含至少一驱动群组20与至少一控制电路30。于本实施例中，以复数驱动群组20与复数控制电路30为例说明本发明的驱动架构。该些驱动群组20与该些控制电路30设置于显示面板10，该些控制电路30耦接该些驱动群组20，并控制该些驱动群组20。于本发明的一实施例中，每一控制电路30可为一独立芯片，但不以此为限，该些控制电路30可整合为一芯片。
此外，每一驱动群组20包括复数驱动器22，该些驱动器22相互串联。每一驱动群组20的该些驱动器22沿一方向设置于显示面板10。于本实施例中，每一驱动群组20的该些驱动器22沿纵向设置于显示面板10，其表示该些驱动群组20分别纵向设置于显示面板10，且彼此相邻，但并不以此为限。于本发明的一实施例中，每一驱动器22可为一独立芯片，但不以此为限。每一驱动器22耦接显示面板10的至少一显示元件12(如图2所示)，以驱动显示元件14显示影像。显示元件12可为次毫米发光二极管(Mini LED)或者微发光二极管(MicroLED)，而显示面板10则为次毫米发光二极管显示面板或者微发光二极显示面板。然而，本发明的驱动架构并非仅限用于上述两种显示面板。该些控制电路30耦接该些驱动群组20，以控制该些驱动群组20。
复参阅图1，控制电路30传输一输入数据至驱动群组20。于本发明的一实施例中，输入数据可为一串行数据，且包含复数像素数据。驱动群组20的该些驱动器22皆耦接一总线(图未示)，控制电路30传输输入数据至总线，该些驱动器33经由总线接受输入数据。该些驱动器33于不同时间接收输入数据，如此该些驱动器33即各自接收的画素数据不相同。举例说明，驱动群组20的一驱动器22接收输入数据时，其他驱动器22不接收输入数据，而此驱动器22接收完输入数据的一像素数据后，则驱使另一驱动器22接收输入数据，以接收输入数据的另一像素数据。由于上述两个驱动器22于不同时间接收输入数据，如此两个驱动器22接收的输入数据的像素数据不相同，以驱动显示面板10的复数显示元件12显示不同影像。其他驱动器22的作动如同上述。依据上述说明可知，驱动器22于接收完输入数据的像素数据后，进一步驱使另一驱动器22接收输入数据的另一像素资料，如此不需额外设置扫描线于显示面板10，而简化显示面板10的结构。
另外，于本发明的另一实施例中，该些驱动群组20的一驱动群组20的一驱动器22可耦接另一驱动群组20的一驱动器22。举例来说，每一驱动群组20的最后一驱动器22可相互耦接，以传递数据或者讯号，但不以此为限。此外，该些驱动群组20与该些控制电路30设置于显示面板10的一显示区，但不以此为限。该些控制电路30可设置于显示面板10的一非显示区。
请参阅图2，其为本发明的控制电路与驱动群组的一实施例的方块图。为了便于说明，此实施例的驱动群组20包含两驱动器22。如图所示，控制电路30包含一输入接口32、一致能电路33、一缓冲器34、一时序控制器36、一缓存器38及一调整电路39。控制电路30耦接一主机，例如电子产品的微处理器，以接收输入数据、控制命令或者相关控制参数。输入接口32接收输入数据、控制命令或者控制参数。致能电路33耦接输入接口32，并依据接收的一致能讯号致能输入接口32，驱使输入接口32接收输入数据、控制命令或者控制参数。
复参阅图2，缓冲器34耦接输入接口32与时序控制器36，输入接口32传送输入数据至缓冲器34，缓冲器34缓冲输入数据，并传送缓冲的输入数据至时序控制器36，时序控制器36经由总线传送输入数据至驱动群组22，并输出一时序讯号至驱动群组22的驱动器22，以控制驱动器22的运作。缓存器38耦接输入接口32、时序控制器36与调整电路39，输入接口32传送控制参数至缓存器38，缓存器38储存控制参数，并提供控制参数至时序控制器36与调整电路39，时序控制器36依据控制参数产生时序讯号。调整电路39依据控制参数产生调整讯号至驱动器22，以调整驱动器22产生的一驱动讯号的强度，驱动讯号用于驱动显示面板10的显示元件14，驱动讯号的强度会决定显示元件14的亮度。
复参阅图2，每一驱动器22包含一致能电路24、一储存电路26以及一驱动电路28。储存电路26经由总线耦接控制电路30的时序控制器36，以接收时序控制器36传输的输入数据。致能电路24耦接储存电路26，并致能储存电路26，以驱使储存电路36接收输入数据，并储存输入数据。于本发明的一实施例中，致能电路24致能储存电路26一预定时间，储存电路26于此预定时间接收输入数据，并储存所接收的输入数据。致能电路24致能储存电路26此预定时间后禁能储存电路26，即储存电路26不接收输入数据。
举例来说，第一驱动器22的致能电路24耦接控制电路30的时序控制器36，时序控制器36发送一致能讯号至第一驱动器22的致能电路24，驱使第一驱动器22的致能电路24致能储存电路26接收输入数据。其表示时序控制器36驱使第一驱动器22接收输入数据。上述的致能讯号可为一时脉讯号。第一驱动器22的致能电路24致能第一驱动器22的储存电路26时，其余驱动器22的致能电路24禁能其余驱动器22的储存电路26，即不接收输入数据。第一驱动器22的致能电路24禁能第一驱动器22的储存电路26后，并发送致能讯号至另一驱动器22的致能电路24。于本发明的一实施例中，第一驱动器22的致能电路24发送致能讯号至第二驱动器22的致能电路24，驱使第二驱动器22的致能电路24致能第二驱动器22的储存电路26接收输入讯号。同理，于预定时间后，第二驱动器22的致能电路24禁能第二驱动器22的储存电路26，并发送致能讯号至另一驱动器的致能电路26，例如第三驱动器22，以致能另一驱动器22的储存电路26。由上述说明可知，该些驱动器22的储存电路26于不同时间接收输入数据，其相当于分时接收输入数据，如此，该些驱动器22的储存数据26所接收的输入数据的画素数据不相同。举例来说，第一驱动器22的储存电路26接收并储存的画素数据不同于第二驱动器22的储存电路26接收并储存的画素数据。
起初，并不限定时序控制器36传送致能讯号至第一驱动器22的致能电路24，可依据使用需求设定时序控制器36传送致能讯号至其他驱动器22的致能电路24，例如第二驱动器22的致能电路24。另外，前述第一驱动器22的致能电路24禁能第一驱动器22的储存电路26后，并传送致能讯号至第二驱动器22的致能电路24，其仅为本发明的一实施例，并不以此为限，其可依据需求设定致能该些驱动器22接收输入讯号的顺序。
复参阅图2，每一驱动器22的驱动电路28耦接储存电路26与显示面板10的至少一显示元件14。驱动电路28接收储存电路28储存的输入数据的画素数据，并依据所接收的画素数据产生驱动讯号，以驱动显示元件14显示影像。此外，控制电路30的调整电路39耦接该些驱动器22的驱动电路28，调整电路39输出一调整讯号至该些驱动电路28，以调整该些驱动电路28输出的驱动讯号的强度，如此即可调整该些显示元件14的亮度。于本发明的一实施例中，调整讯号为一电压，藉由改变电压的强度而调整驱动讯号的强度。
复参阅图1与图2，该些控制电路30相互串联，其沿着一方向排列，于此实施例中，该些控制电路30沿着横向设置于显示面板10，但并不以此为限。于本发明的一实施例中，该些控制电路30的一控制电路30的致能电路33致能输入接口32一预定时间，以驱使输入接口32于此预定时间接收输入数据，致能电路33致能输入接口32此预定时间后禁能输入接口32，即输入接口32不接收输入数据。于此预定时间内，其余控制电路30的致能电路33禁能该些其余控制电路30的输入接口32，而不接收输入数据。此外，致能电路33致能输入接口32此预定时间33后禁能输入接口32，并发送致能讯号至另一控制电路30的致能电路33，以致能该另一控制电路30的输入接口32接收输入讯号。如此控制电路30如同该些控制器22分时接收输入讯号，该些控制电路30所接收的输入讯号不相同。于本发明的另一实施例中，该些控制电路30可不相互串联，该些控制电路30可从主机接收输入数据，主机可分别控制该些控制电路30，以驱使该些控制电路30接收输入数据。如此，控制电路30可不需设置致能电路33。
请参阅图3，其为本发明的储存电路与驱动器的一实施例的电路图。如图所示，每一储存电路26包含一缓冲器261、一控制器263及复数内存265。缓冲器261耦接致能电路24并接收输入数据Din及一时脉讯号DCLK，致能电路24依据接收的致能讯号与时脉讯号DCLK致能缓冲器261，驱使缓冲器261依据时脉讯号DCLK接收输入数据Din，缓冲器261缓冲输入数据Din。缓冲器261与该些内存265耦接一总线，缓冲器261输出输入数据Din于总线，该些内存265可从总线接收输入数据Din并储存输入数据Din。控制器263耦接该些内存265并接收时脉讯号DCLK，且依据时脉讯号DCLK控制该些内存265于不同时间分别从总线接收输入数据，即该些内存265分时从总线接收输入数据，如此该些内存265接收的输入数据的画素数据不相同。于本发明的一实施例中，控制器263可为一计数器，而控制该些内存265于不同时间接收缓冲器261输出的输入数据Din。
复参阅图3，驱动电路28包含复数比较器281、一计数器283、复数准位转换电路285以及复数讯号产生电路。该些比较器281耦接该些内存265与计数器283。计数器283接收一时脉讯号PWMCLK，并依据时脉讯号PWMCLK计数而输出一计数讯号，计数讯号随着计数器283的计数而改变。每一比较器281接收计数讯号与内存265储存的输入数据Din的画素数据，并比较计数讯号与画素数据，当画素数据大于计数讯号时，比较器281则输出一驱动准位，例如高准位。于本发明的另一实施例中，当画素数据小于计数讯号时，比较器281则输出驱动准位。
该些准位转换电路285耦接该些比较器281，转换比较器281输出的驱动准位而产生一致能准位。每一讯号产生电路包含一第一晶体管286与一第二晶体管288。第一晶体管286与第二晶体管288相互串联，第一晶体管286的一端耦接显示元件14的一端，第二晶体管288的一端耦接一接地端。该些准位转换电路285耦接该些讯号产生电路的第二晶体管288的闸极，并输出致能准位至第二晶体管288的闸极，以导通第二晶体管288，而产生驱动讯号以驱使显示元件14发光，以显示影像。驱动讯号为从一供应电压VDD流向接地端的一电流。供应电压VDD耦接于显示元件14的另一端。此外，第一晶体管286的闸极耦接控制电路30的调整电路39传送的调整讯号VR，调整讯号VR可控制第一晶体管286的导通程度，而可控制流经显示元件14的电流的强度，以控制显示元件14的亮度。由上述说明可知，比较器281持续产生驱动准位的时间为驱动时间，即驱动显示元件14的时间，其会决定显示元件14的亮度。
上文仅为本发明的较佳实施例而已，并非用来限定本发明实施的范围，凡依本发明权利要求范围所述的形状、构造、特征及精神所为的均等变化与修饰，均应包括于本发明的权利要求范围内。

Claims (12)

1.一种显示面板的驱动架构，其特征在于，其包含：
至少一驱动群组，设置于一显示面板，每一该驱动群组包括复数驱动器，该些驱动器相互串联，每一该驱动器耦接该显示面板的至少一显示元件；以及
至少一控制电路，设置于该显示面板，并耦接该驱动群组，且控制该驱动群组。
2.如权利要求1所述的显示面板的驱动架构，其特征在于，其中每一该驱动群组的该些驱动器沿一方向设置于该显示面板。
3.如权利要求1所述的显示面板的驱动架构，其特征在于，其中该至少一驱动群组包含复数驱动群组，该些驱动群组的一驱动群组的一驱动器耦接另一驱动群组的一驱动器。
4.如权利要求1所述的显示面板的驱动架构，其特征在于，其中每一该驱动器包含：
一储存电路，耦接该控制电路，并储存该控制电路传输的一输入数据；以及
一致能电路，耦接该储存电路，并致能该储存电路，以接收该输入数据；
其中，该致能电路致能该储存电路后，该致能电路禁能该储存电路，并驱使另一驱动器的该致能电路致能该另一驱动器的该储存电路接收该控制电路传输的该输入数据。
5.如权利要求4所述的显示面板的驱动架构，其特征在于，其中该控制电路包含一时序控制器，该时序控制器耦接该储存电路，以传输该输入数据至该储存电路，该时序控制器更耦接该致能电路，并驱使该致能电路致能该储存电路。
6.如权利要求1所述的显示面板的驱动架构，其特征在于，其中该每一驱动器包含一驱动电路，该驱动电路依据一输入数据驱动该至少一显示元件。
7.如权利要求6所述的显示面板的驱动架构，其特征在于，其中该控制电路包含一调整电路，其耦接该驱动电路，并调整该驱动电路输出的一驱动讯号的强度，该驱动讯号驱动该显示面板的该显示元件。
8.如权利要求1所述的显示面板的驱动架构，其特征在于，其中该至少一驱动群组包含复数驱动群组，至少一控制电路包含复数控制电路，该些控制电路耦接该些驱动群组，并控制该些驱动群组。
9.如权利要求8所述的显示面板的驱动架构，其特征在于，其中该些控制电路相互串联，该些控制电路的一控制电路接收一输入数据后，驱使该些控制电路的另一控制电路接收该输入数据。
10.如权利要求9所述的显示面板的驱动架构，其特征在于，其中每一该控制电路包含：
一输入接口，接收该输入数据；以及
一致能电路，耦接该输入接口，并致能该输入接口，以接收该输入数据；
其中，该致能电路致能该输入接口后，该致能电路禁能该输入接口，并驱使另一控制电路的该致能电路致能该另一控制电路的该输入接口接收该输入数据。
11.如权利要求1所述的显示面板的驱动架构，其特征在于，其中该控制电路包含：
一输入接口，接收一输入数据；
一缓冲器，耦接该输入接口，缓冲该输入数据；以及
一时序控制器，耦接该缓冲器，接收该输入数据，并输出该输入数据至该驱动群组，且驱使该驱动群组的一驱动器接收该输入数据。
12.如权利要求1所述的显示面板的驱动架构，其特征在于，其中该控制电路位于该显示面板的一显示区。
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