CN114270428A - 显示驱动器、半导体器件和放大器电路 - Google Patents

显示驱动器、半导体器件和放大器电路 Download PDF

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Abstract

[目的]本发明的目的是提供允许高速地驱动显示装置，同时抑制热生成量、功率消耗和装置规模的增加的显示驱动器、半导体器件和放大器电路。[结构]本发明包括灰度电压生成单元和解码器单元。灰度电压生成单元包括第一至第k个放大器，第一至第k个放大器各自接收具有相互不同的电压值的第一至第k个基准电压，各自利用增益1放大第一至第k个基准电压，并且输出被放大的第一至第k个基准电压。灰度电压生成单元通过在从第一至第k个放大器输出的相应电压之间进行分压来生成多个灰度电压。解码器单元从多个灰度电压中选择与像素数据片所表示的亮度水平对应的一个灰度电压，并且生成具有所述一个灰度电压的信号作为用于驱动显示装置的驱动信号。第一至第k个放大器均包括响应速度增加电路，响应速度增加电路包括至少一个晶体管，其中源极和背侧栅极被连接到该放大器的输出端子，漏极被施加预定电位，并且在栅极处接收该放大器所接收的基准电压。

Description

显示驱动器、半导体器件和放大器电路
技术领域
本发明涉及响应于图像信号而驱动显示装置的显示驱动器、其中形成显示驱动器的半导体器件、以及放大器电路。
背景技术
包括作为显示装置的显示面板的显示设备连同显示面板一起包括显示驱动器，显示驱动器包括以下的灰度电压生成电路和解码器。灰度电压生成电路生成以64个灰度表示亮度水平的64个灰度电压，并且解码器从这64个灰度电压中选择与显示数据对应的一个灰度电压，并且将其供给到显示面板的信号线(例如参见专利文献1)。
灰度电压生成电路包括：作为伽马缓冲器的多个运算放大器，每个运算放大器接收与合期望的伽马特性相应的电压，并且利用增益1放大该电压；以及阶梯电阻器，其通过在相应的运算放大器的输出电压之间进行分压来生成64个灰度电压。
专利文献1：JP-A-2012-137783。
发明内容
本发明要解决的问题
近来，由于与显示设备的更大屏幕和高清晰度相适应的一个水平扫描周期的减小，期望显示驱动器中的高速处理。即，需要在从在其处供给到解码器的显示数据切换为下一个水平扫描周期的显示数据的时间点起经过一个水平扫描周期的时段内，使从解码器输出的灰度电压的电压值达到与显示数据对应的目标电压值。
顺便提及，当供给到解码器的显示数据切换为对应于下一个水平扫描周期的显示数据时，与此相应地，在一些情况下，在解码器内流动的电流暂时大幅增加或减小。因而，从灰度电压生成电路供给到解码器的灰度电压的电压值暂时减小或增加。即，与在作为灰度电压生成电路的负载的解码器内流动的电流的波动(称为负载改变)关联，本来要维持为恒定电压值的灰度电压的电压值波动。
于是，例如，当灰度电压的电压值暂时减小时，从解码器输出的灰度电压的电压值达到与显示数据对应的目标电压值所花费的时间被延长使减小的电压值恢复到原来电压值所需要的时间的长度。因而，当一个水平扫描周期被缩短时，从解码器输出的灰度电压的电压值在一个水平扫描周期内不能达到目标电压值，从而可能引起图像劣化。
于是，为了迅速抑制灰度电压的电压波动，考虑增加伽马缓冲器(运算放大器)中的工作电流。然而，出现由与工作电流的增加相应的功率消耗增加和热生成量增加引起特性劣化的问题。
伽马缓冲器中的工作电流的增加在低电压下减小对于晶体管的饱和区的工作余量。于是，为了对此进行补偿，需要增加构成伽马缓冲器的每个晶体管的栅极宽度，并且还出现芯片尺寸增加和成本增加的问题。
因而，本发明的目的是提供允许高速驱动显示装置同时抑制热生成量、功率消耗和装置规模的增加的显示驱动器、半导体器件和放大器电路。
问题的解决方案
根据本发明的显示驱动器是响应于表示基于视频信号的每个像素的亮度水平的像素数据片而生成用于驱动显示装置的驱动信号的显示驱动器。显示驱动器包括灰度电压生成单元和解码器单元。灰度电压生成单元包括第一至第k个(k是2以上的整数)放大器，具有相互不同的电压值的第一至第k个基准电压被各自输入到第一至第k个放大器。第一至第k个放大器放大第一至第k个基准电压，并且输出被放大的第一至第k个基准电压。灰度电压生成单元通过在从第一至第k个放大器输出的相应电压之间进行分压来生成多个灰度电压。解码器单元从多个灰度电压中选择与由像素数据片表示的亮度水平对应的一个灰度电压并且生成具有该一个灰度电压的信号作为驱动信号。灰度电压生成单元包括连接到相应的第一至第k个放大器的多个响应速度增加电路。响应速度增加电路包括至少一个晶体管，其中源极和背侧栅极被连接到放大器的输出端子，漏极被施加预定电位，并且栅极被施加输入到放大器的基准电压。
根据本发明的半导体器件是包括显示驱动器的半导体器件。显示驱动器响应于表示基于视频信号的每个像素的亮度水平的像素数据片而生成用于驱动显示装置的驱动信号。显示驱动器包括灰度电压生成单元和解码器单元。灰度电压生成单元包括第一至第k个(k是2以上的整数)放大器，具有相互不同的电压值的第一至第k个基准电压分别输入到第一至第k个放大器。第一至第k个放大器放大第一至第k个基准电压，并且输出被放大的第一至第k个基准电压。灰度电压生成单元通过在从第一至第k个放大器输出的相应电压之间进行分压来生成多个灰度电压。解码器单元从多个灰度电压中选择与由像素数据片表示的亮度水平对应的一个灰度电压，并且生成具有该一个灰度电压的信号作为驱动信号。灰度电压生成单元包括连接到相应的第一至第k个放大器的多个响应速度增加电路。响应速度增加电路包括至少一个晶体管，其中源极和背侧栅极被连接到放大器的输出端子，漏极被施加预定电位，并且栅极被施加输入到放大器的基准电压。
根据本发明的放大器电路包括运算放大器、n沟道MOS晶体管和p沟道MOS晶体管。在运算放大器中，反相输入端子被连接到运算放大器自身的输出端子。运算放大器通过非反相输入端子接收输入电压。在n沟道MOS晶体管中，源极和背侧栅极被连接到运算放大器的输出端子，漏极被施加电源电位，并且栅极被施加输入电压。在p沟道MOS晶体管中，源极和背侧栅极被连接到运算放大器的输出端子，漏极被施加接地电位，并且栅极被施加输入电压。
本发明的有益效果
在根据本发明的显示驱动器中，灰度电压生成单元包括放大多个基准电压的第一至第k个(k是2以上的整数)放大器，并且通过在从相应放大器输出的电压之间进行分压来生成多个灰度电压。灰度电压生成单元包括以下的响应速度增加电路。即，放大器中的每个包括响应速度增加电路，响应速度增加电路包括至少一个晶体管，其中源极和背侧栅极被连接到放大器的输出端子，漏极被施加预定电位，并且在栅极处接收放大器接收的基准电压。
因此，当输入到放大器的基准电压和该放大器的输出电压之间的差，即，输出电压的波动量变为大于晶体管的阈值时，晶体管接通。即，在该时段期间，晶体管向放大器的输出端子施加预定电位，由此引起输出端子充电或放电电荷。因此，放大器的输出电压的电压波动量被抑制，并且与此相应地，基于输出电压生成的灰度电压的波动量被减小，因此增加使用灰度电压生成的并且驱动显示装置的驱动信号的电平的上升或下降的速度。
因而，与其中为了减小放大器的输出电压的波动而增加放大器的内部电流的情况相比，响应速度增加电路允许抑制热生成量、功率消耗和装置规模的增加。
附图说明
图1是图示包括根据本发明的显示驱动器的显示设备的配置的方框图。
图2是图示源极驱动器的内部配置的方框图。
图3是图示灰度电压生成单元的示例性内部配置的电路图。
图4是图示伽马缓冲器的示例性内部配置的电路图。
图5是用于描述响应速度增加电路的工作的波形图。
图6是用于描述响应速度增加电路的工作的波形图。
图7是图示灰度电压生成单元的另一示例性内部配置的电路图。
具体实施方式
下面参照附图详细描述本发明的实施例。
图1是图示包括根据本发明的显示驱动器的显示设备100的配置的方框图。如图1中图示那样，显示设备100包括驱动控制单元11、栅极驱动器12、源极驱动器13、以及包括液晶或有机EL面板的显示装置20。
显示装置20包括均沿着二维屏幕的水平方向延伸的m个(m为2以上的整数)水平扫描线S1至Sm，以及均沿着二维屏幕的垂直方向延伸的n个(n为2以上的整数)源极线D1至Dn。此外，水平扫描线S和源极线D之间的交点的区(被虚线围绕的区)均包括充当像素的显示单元PC。
驱动控制单元11接收输入视频信号VS，并且基于输入视频信号VS，生成例如通过6比特数据来表示针对每个像素的像素亮度水平的一系列像素数据PD以及水平同步信号。驱动控制单元11将水平同步信号供给到栅极驱动器12，并且生成包括与上面描述的一系列像素数据PD和水平同步信号对应的时钟信息的视频数据信号VPD，以将其供给到源极驱动器13。
栅极驱动器12与从驱动控制单元11供给的水平同步信号同步地生成栅极脉冲，并且将其依次施加到显示装置20的水平扫描线S1至Sm中的每个。
源极驱动器13基于视频数据信号VPD生成分别与显示装置20的源极线D1至Dn对应的像素驱动信号G1至Gn，并且将它们各自供给到对应的源极线D1至Dn。源极驱动器13被形成在单个半导体芯片中或者被划分在多个半导体芯片中。
图2是图示源极驱动器13的内部配置的方框图。
如图2中图示那样，源极驱动器13包括时钟生成单元130、数据锁存单元131、基准电压生成单元132、灰度电压生成单元133、解码器E1至En、以及输出放大器A1至An。
时钟生成单元130基于包括在视频数据信号VPD中的时钟信息，生成其中针对每个水平扫描周期出现一个脉冲的时钟信号CLK，并且将其供给到数据锁存单元131。
数据锁存单元131顺次取回包括在视频数据信号VPD中的一系列像素数据PD。此时，每当取回一个水平扫描线(n)的像素数据PD时，数据锁存单元131分别在与时钟信号CLK同步的定时处将n个像素数据PD作为像素数据P1至Pn供给到解码器E1至En。
基准电压生成单元132生成与显示装置20的伽马特性的逆伽马特性相应的9个直流电压作为基准电压VG1至VG9，并且将它们供给到灰度电压生成单元133。
基准电压VG1至VG9的相应的电压值例如具有以下的幅度关系。
VG1 < VG2 < VG3 < VG4 < VG5 < VG6 < VG7 < VG8 < VG9
灰度电压生成单元133基于基准电压VG1至VG9，生成表示可以由显示装置20按256个灰度显示的亮度水平的灰度电压V1至V256，并且将它们供给到解码器E1至En中的每个。
每个解码器E1至En从灰度电压V1至V256中选择对应于由它自己接收的像素数据P所表示的亮度水平的至少一个灰度电压，并且输出灰度电压。
每个输出放大器A1至An例如是包括其中其自身的输出端子被连接到其自身的反相输入端子(-)的所谓运算放大器的电压跟随器电路。
输出放大器A1至An分别通过它们的非反相输入端子(+)接收从解码器E1至En输出的灰度电压，并且将与它们接收的灰度电压对应的电流输出到它们自己的输出端子，从而生成分别与灰度电压对应的像素驱动信号G1至Gn。像素驱动信号G1至Gn经由半导体芯片的外部端子供给到显示装置20的源极线S1至Sn。
图3是图示灰度电压生成单元133的示例性内部配置的电路图。如图3中图示那样，灰度电压生成单元133包括伽马缓冲器GB1至GB9、响应速度增加电路SP1至SP9、以及阶梯电阻器LD。
每个伽马缓冲器GB1至GB9例如包括运算放大器。
图4是图示作为运算放大器的每个伽马缓冲器GB1至GB9的示例性内部配置的电路图。
如图4中图示那样，每个伽马缓冲器GB1至GB9包括差分级DFP、电流镜级CMR和输出级OUP。
差分级DFP包括n沟道金属氧化物半导体(MOS)型晶体管J1和J2，以及电流源CG。
差分级DFP从电流镜级CMR的初级侧电流路径提取与施加到反相输入端子(-)的电位对应的第一电流，并且从电流镜级CMR的次级侧电流路径提取与施加到非反相输入端子(+)的电位对应的第二电流。在差分级DFP中，以施加到非反相输入端子(+)的电位和施加到反相输入端子(-)的电位之间的比率将电流源CG生成的预定恒定电流分成两部分，分得的两个电流充当相应的上面描述的第一电流和第二电流。
电流镜级CMR包括构成初级侧电流路径的p沟道MOS晶体管U1和U2、电阻器R1、以及n沟道MOS晶体管X1和X2，和构成次级侧电流路径的p沟道MOS晶体管U3和U4、电阻器R2、以及n沟道MOS晶体管X3和X4。
在电流镜级CMR中，在电阻器R2中生成与施加到相应的反相输入端子(-)和非反相输入端子(+)的电位之间的差对应的电压。此时，在电阻器R2的一个端部处的电位作为正驱动电位PG并且在另一端部处的电位作为负驱动电位NG被供给到输出级OUP。
输出级OUP包括p沟道MOS晶体管U11、n沟道MOS晶体管J11、以及用于相位补偿的电容器C1和C2。
输出级OUP的晶体管U11将与正驱动电位PG对应的电流输送到输出端子Y，并且晶体管J11从输出端子Y向接地电位VSS提取与负驱动电位NG对应的电流。
在此，包括具有如图4中图示那样的内部配置的运算放大器的每个伽马缓冲器GB1至GB9包括其中如图3中图示那样其自身的反相输入端子(-)被连接到其自身的输出端子Y的所谓的电压跟随器电路。
伽马缓冲器GB1至GB9各自通过相应的非反相输入端子(+)接收从基准电压生成单元132供给的基准电压VG1至VG9。伽马缓冲器GB1至GB9的输出端子Y被分别各自连接到电压供给线L1至L9，并且被经由电压供给线L1至L9连接到在阶梯电阻器LD的9个位置处的不同的第一至第九连接点。
伽马缓冲器GB1生成通过利用增益1放大基准电压VG1而获得的电压作为伽马基准电压GOUT1，并且经由其自身的输出端子Y将该电压施加到电压供给线L1。因而，伽马基准电压GOUT1被经由电压供给线L1施加到阶梯电阻器LD的第一连接点。
伽马缓冲器GB2生成通过利用增益1放大基准电压VG2而获得的电压作为伽马基准电压GOUT2，并且经由其自身的输出端子Y将该电压施加到电压供给线L2。因而，伽马基准电压GOUT2被经由电压供给线L2施加到阶梯电阻器LD的第二连接点。
类似地，伽马缓冲器GB(i)(i是3至9的整数)生成通过利用增益1放大基准电压VG(i)而获得的电压作为伽马基准电压GOUT(i)，并且经由电压供给线L(i)将该电压施加到阶梯电阻器LD的第(i)个连接点。
阶梯电阻器LD通过在相应的伽马基准电压GOUT1至GOUT9之间进行分压来生成具有相互不同的电压值的灰度电压V1至V256。在本实施例中，在灰度电压V1至V256当中，例如，灰度电压V256具有与最高亮度水平对应的最大电压值，并且灰度电压V1具有与最低亮度水平对应的最小电压值。在图3中图示的配置中，伽马基准电压GOUT1直接充当最低灰度电压V1，并且伽马基准电压GOUT9直接充当最大灰度电压V256。
在此，伽马缓冲器GB1至GB9分别被提供有响应速度增加电路SP1至SP9，响应速度增加电路SP1至SP9通过抑制伽马基准电压GOUT1至GOUT9的电压波动量来增加像素驱动信号G1至Gn对用于每个水平扫描周期的像素数据的改变的响应速度。
如图3中图示那样，例如，响应速度增加电路SP1至SP9具有相同的内部配置，并且均包括n沟道MOS晶体管Q1和p沟道MOS晶体管Q2。
下面描述从响应速度增加电路SP1至SP9提取的响应速度增加电路SP2的内部配置。
如图3中图示那样，晶体管Q1具有被施加有电源电位VDD的漏极，并且具有被施加有基准电压VG2的栅极。晶体管Q1具有被经由电压供给线L2连接到伽马缓冲器GB2的输出端子Y的背侧栅极和源极。
晶体管Q2具有被施加接地电位VSS的漏极，并且具有被施加基准电压VG2的栅极。晶体管Q2具有被经由电压供给线L2连接到伽马缓冲器GB2的端子Y的背侧栅极和源极。
即，如图3中图示那样，灰度电压生成单元133包括用于每个基准电压的放大器电路，并且放大器电路包括运算放大器(例如，GB1)和以下的响应速度增加电路(例如，SP1)，在运算放大器中，反相输入端子(-)被连接到其自身的输出端子Y，并且通过非反相输入端子(+)接收输入电压(例如，VG1)。
每个响应速度增加电路包括以下的n沟道MOS晶体管和p沟道MOS晶体管。即，在n沟道MOS晶体管(Q1)中，它自身的源极和背侧栅极被连接到运算放大器(例如，GB1)的输出端子(Y)，漏极被施加电源电位(VDD)，并且在它自身的栅极处接收输入电压(例如，VG1)。在p沟道MOS晶体管(Q2)中，它自身的源极和背侧栅极被连接到该运算放大器的输出端子(Y)，漏极被施加接地电位(VSS)，并且在它自身的栅极处接收输入电压(例如，VG1)。
接下来，将参照图5和图6描述从响应速度增加电路SP1至SP9提取的响应速度增加电路SP2的内部配置。
图5是图示暂时向下降方向波动的伽马基准电压GOUT2的波形、晶体管Q1和Q2的状态、和其电平按照像素数据P1增加并且达到目标电位Vtg的像素驱动信号G1的波形之间的对应的波形图。
即，当像素数据P1至Pn在时间点t0对应于时钟信号CLK变化时，在一些情况下，由于与解码器E2的状态转变相应的负载改变的影响，伽马基准电压GOUT2的电压值暂时下降，如图5中图示那样。
在此，当没有布置图3中图示的响应速度增加电路SP2时，伽马基准电压GOUT2的电压值下降到电压值W1，如由图5的单点划线指示那样，并且随后逐渐增加达到原来的电压值，即对应于基准电压VG2的电压值。因此，当伽马基准电压GOUT2的电压值下降到电压值W1时，基于伽马基准电压GOUT2生成的像素驱动信号G1的电平上升速度减小。因而，如由图5的双点划线指示那样，在像素驱动信号G1的电平开始上升之后，在其处像素驱动信号G1的电平达到目标电位Vtg的时间点可能延迟到超出一个水平扫描周期的时间点t4。
另一方面，当布置有响应速度增加电路SP2时，如图5中图示那样，在其处伽马基准电压GOUT2的电压值和基准电压VG2之间的差超过晶体管Q1的阈值Vth的时间点t1处，晶体管Q1接通。
因而，晶体管Q1将电源电位VDD施加到电压供给线L2以对电压供给线L2充电，从而抑制伽马基准电压GOUT2的下降。
于是，如图5的粗实线指示那样，伽马基准电压GOUT2的下降在高于电压值W1的电压值W2处停止，并且然后伽马基准电压GOUT2增加。在此时段期间，在其处伽马基准电压GOUT2的电压值和基准电压VG2之间的差减小到阈值Vth或其以下的时间点t2处，晶体管Q1关断，并且充电操作停止。
因而，由于其中与没有布置响应速度增加电路SP2的情况相比，该充电操作允许抑制伽马基准电压GOUT2的下降，因此能够迅速地将伽马基准电压GOUT2的电压值恢复到与基准电压VG2相同的电压值。因而，如图5中图示那样，可以使像素驱动信号G1的电平在比时间点t4早的时间点t3处达到目标电位Vtg。
图6是图示暂时向增加方向波动的伽马基准电压GOUT2的波形、晶体管Q1和Q2的状态、和其电平按照像素数据P1至Pn下降并且达到目标电位Vtg的像素驱动信号G1的波形之间的对应的波形图。
即，当像素数据P1至Pn在时间点t0处对应于时钟信号CLK变化时，在一些情况下，由于与解码器E2的状态转变相应的负载改变的影响，伽马基准电压GOUT2的电压值暂时增加，如图6中图示那样。
在此，当没有布置图3中图示的响应速度增加电路SP2时，伽马基准电压GOUT2的电压值增加到电压值B1，如由图6的单点划线指示那样，并且随后逐渐下降达到原来的电压值，即对应于基准电压VG2的电压值。因此，当伽马基准电压GOUT2的电压值增加到电压值B1时，基于伽马基准电压GOUT2生成的像素驱动信号G1的电平下降速度减小。因而，如由图6的双点划线指示那样，在像素驱动信号G1的电平开始下降之后，在其处像素驱动信号G1的电平达到目标电位Vtg的时间点可能延迟到超出一个水平扫描周期的时间点t4。
另一方面，当布置有响应速度增加电路SP2时，如图6中图示那样，在其处伽马基准电压GOUT2的电压值和基准电压VG2之间的差超过晶体管Q2的阈值Vth的时间点t1处，晶体管Q2接通。
因而，晶体管Q2将接地电位VSS施加到电压供给线L2以从电压供给线L2放电，从而抑制伽马基准电压GOUT2的增加。
于是，如由图6的粗实线指示那样，伽马基准电压GOUT2的增加在低于电压值B1的电压值B2处停止，并且然后伽马基准电压GOUT2下降。在此时段期间，在其处伽马基准电压GOUT2的电压值和基准电压VG2之间的差减小到阈值Vth或其以下的时间点t2处，晶体管Q2关断，并且停止放电处理。
因而，由于与其中没有布置响应速度增加电路SP2的情况相比，该放电处理允许抑制伽马基准电压GOUT2的增加，因此能够迅速地将伽马基准电压GOUT2的电压值恢复到与基准电压VG2相同的电压值。因而，如图6中图示那样，可以使像素驱动信号G1的电平在比时间点t4早的时间点t3处达到目标电位Vtg。
因此，在图3中图示的灰度电压生成单元133中，布置有响应速度增加电路SP1至SP9，从而抑制由在负载(解码器E1至En)中流动的电流的大幅波动引起的伽马基准电压GOUT1至GOUT9的波动量。于是，由于通过对伽马基准电压GOUT1至GOUT9进行分压而获得的灰度电压V1至V256的波动量被减小，因而，在每个水平扫描周期中出现的相应的像素驱动信号G1至Gn的电平的上升或下降的速度被增加。即，通过布置响应速度增加电路SP1至SP9，可以获得能够高速地驱动显示装置20的像素驱动信号G1至Gn。
此外，利用图3中图示的响应速度增加电路SP1至SP9，与其中为了抑制在伽马基准电压GOUT1至GOUT9中引起的电压波动而增加相应的伽马缓冲器GB1至GB9的内部工作电流的情况相比，可以减小功率消耗和热生成量。为了增加伽马缓冲器的内部工作电流，需要增加构成伽马缓冲器的相应晶体管的尺寸(栅极宽度)，以确保低电压下的晶体管的饱和工作余量。与此相对，在灰度电压生成单元133中，虽然电路尺寸增加了响应速度增加电路SP1至SP9的尺寸，但是与其中增加每个伽马缓冲器中的晶体管的尺寸的情况相比，电路尺寸的增量较小。
因而，采用图3中图示的灰度电压生成单元133允许高速地驱动显示装置20而不增加热生成量、功率消耗以及装置规模。
在图3中图示的示例中，在每个伽马缓冲器GB1至GB9中布置包括两个晶体管Q1和Q2的响应速度增加电路SP。
然而，即使其电压值由于负载改变而向低于基准电压VG9的方向波动，与基准电压VG1至VG9中具有最大电压值的基准电压VG9对应的伽马基准电压GOUT9也不波动得更高。即使其电压值由于负载改变而向高于基准电压VG1的方向波动，与基准电压VG1至VG9中具有最小电压值的基准电压VG1对应的伽马基准电压GOUT1也不波动得更低。
于是，可以从响应速度增加电路SP1中移除晶体管Q1和Q2中的晶体管Q1，并且可以从响应速度增加电路SP9中移除晶体管Q1和Q2中的晶体管Q2。
图7是图示考虑到这一点而配置的灰度电压生成单元133的另一示例性内部配置的电路图。
除了代替图3中图示的响应速度增加电路SP1而采用从中移除晶体管Q1的响应速度增加电路SP1a，和代替响应速度增加电路SP9而采用从中移除晶体管Q2的响应速度增加电路SP9a以外，图7中图示的配置与图3中图示的配置相同。
与采用图3中图示的配置的情况相比，采用图7中图示的配置将电路尺寸减小了被移除的两个晶体管(Q1、Q2)的尺寸。
总的说来，只需要在配置为响应于表示相应像素的亮度水平的像素数据片P1至Pn而生成驱动显示装置20的像素驱动信号G1至Gn的源极驱动器13中包括以下的灰度电压生成单元和解码器单元即可。
即，灰度电压生成单元(133)包括第一至第k个放大器(例如，GB1至GB9)，第一至第k个放大器各自接收具有相互不同的电压值的第一至第k个基准电压(例如，VG1至VG9)，各自分别利用增益1放大第一至第k个基准电压，并且输出它们。然后，灰度电压生成单元通过在从第一至第k个放大器输出的相应电压(例如，GOUT1至GOUT9)之间进行分压来生成多个灰度电压(例如，V1至V256)。
解码器单元(例如，E1至En)从多个灰度电压中选择与像素数据片(P)所表示的亮度水平对应的一个灰度电压，并且生成具有该一个灰度电压的像素驱动信号(例如，G1至Gn)。
第一至第k个放大器均包括响应速度增加电路(例如，SP1)，响应速度增加电路包括至少一个晶体管(Q1、Q2)，其中源极和背侧栅极被连接到该放大器的输出端子，漏极被施加预定电位(例如，VDD或VSS)，并且在栅极处接收该放大器所接收的基准电压(例如，VG1)。
此外，灰度电压生成单元(133)包括被连接到相应的第一至第k个放大器的多个响应速度增加电路(例如，SP1至SP9)。响应速度增加电路均包括至少一个晶体管(Q1、Q2)，其中源极和背侧栅极被连接到放大器的输出端子(Y)，漏极被施加预定电位(例如，VDD或VSS)，并且在栅极处接收该放大器所接收的基准电压(例如，VG1)。
参考符号的说明
13 源极驱动器；133 灰度电压生成单元；E1至En 解码器；GB1至GB9 伽马缓冲器；LD 阶梯电阻器；Q1，Q2 晶体管；SP1至SP9 响应速度增加电路。

Claims (6)

1.一种显示驱动器，其响应于表示基于视频信号的每个像素的亮度水平的像素数据片而生成用于驱动显示装置的驱动信号，所述显示驱动器包括：
灰度电压生成单元，其包括第一至第k个(k是2以上的整数)放大器，具有相互不同的电压值的第一至第k个基准电压被各自输入到第一至第k个放大器，第一至第k个放大器放大第一至第k个基准电压，并且输出被放大的第一至第k个基准电压，灰度电压生成单元通过在从第一至第k个放大器输出的相应的电压之间进行分压来生成多个灰度电压；和
解码器单元，其从所述多个灰度电压中选择与像素数据片所表示的亮度水平对应的一个灰度电压，并且生成具有所述一个灰度电压的信号作为驱动信号，其中
灰度电压生成单元包括被连接到相应的第一至第k个放大器的多个响应速度增加电路，并且
响应速度增加电路包括至少一个晶体管，其中源极和背侧栅极被连接到放大器的输出端子，漏极被施加预定电位，并且栅极被施加输入到放大器的基准电压。
2.根据权利要求1所述的显示驱动器，其中
通过供给预定的电源电位和预定的接地电位来使第一至第k个放大器中的每个放大器工作，以及
响应速度增加电路包括：
n沟道MOS晶体管，其中源极和背侧栅极被连接到放大器的输出端子，漏极被施加电源电位，并且栅极被施加输入到放大器的基准电压；和
p沟道MOS晶体管，其中源极和背侧栅极被连接到放大器的输出端子，漏极被施加接地电位，并且栅极被施加输入到放大器的基准电压。
3.根据权利要求1所述的显示驱动器，其中
通过供给预定的电源电位和预定的接地电位来使第一至第k个放大器中的每个放大器工作，以及
第一至第k个基准电压中具有最低电压值的基准电压被输入到第一放大器，并且第一至第k个基准电压中具有最高电压值的基准电压被输入到第k个放大器，其中
布置在第二至第(k-1)个放大器的每个中的响应速度增加电路包括：
n沟道MOS晶体管，其中源极和背侧栅极被连接到放大器的输出端子，漏极被施加电源电位，并且栅极被施加输入到放大器的基准电压；和
p沟道MOS晶体管，其中源极和背侧栅极被连接到放大器的输出端子，漏极被施加接地电位，并且栅极被施加输入到放大器的基准电压，其中
布置在第一放大器中的响应速度增加电路至少只包括n沟道MOS晶体管和p沟道MOS晶体管当中的p沟道MOS晶体管，并且
布置在第k个放大器中的响应速度增加电路至少只包括n沟道MOS晶体管和p沟道MOS晶体管当中的n沟道MOS晶体管。
4.根据权利要求1至3中的任何一项所述的显示驱动器，其中
放大器是包括运算放大器的电压跟随器电路。
5.一种半导体器件，包括
显示驱动器，其响应于表示基于视频信号的每个像素的亮度水平的像素数据片而生成用于驱动显示装置的驱动信号，其中
显示驱动器包括：
灰度电压生成单元，其包括第一至第k个(k是2以上的整数)放大器，具有相互不同的电压值的第一至第k个基准电压被各自输入到第一至第k个放大器，第一至第k个放大器放大第一至第k个基准电压，并且输出被放大的第一至第k个基准电压，灰度电压生成单元通过在从第一至第k个放大器输出的相应电压之间进行分压来生成多个灰度电压；和
解码器单元，其从所述多个灰度电压中选择与像素数据片所表示的亮度水平对应的一个灰度电压，并且生成具有所述一个灰度电压的信号作为驱动信号，其中
灰度电压生成单元包括被连接到相应的第一至第k个放大器的多个响应速度增加电路，并且
响应速度增加电路包括至少一个晶体管，其中源极和背侧栅极被连接到放大器的输出端子，漏极被施加预定电位，并且栅极被施加输入到放大器的基准电压。
6.一种放大器电路，包括：
运算放大器，其中反相输入端子被连接到运算放大器自身的输出端子，运算放大器在非反相输入端子处接收输入电压；
n沟道MOS晶体管，其中源极和背侧栅极被连接到运算放大器的输出端子，漏极被施加电源电位，并且栅极被施加输入电压；和
p沟道MOS晶体管，其中源极和背侧栅极被连接到运算放大器的输出端子，漏极被施加接地电位，并且栅极被施加输入电压。
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