CN112735339A - 一种数据电流产生电路、驱动方法、驱动芯片和显示面板 - Google Patents
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Abstract
本发明公开了一种数据电流产生电路、驱动方法、驱动芯片和显示面板,其中,数据电流产生电路包括:数据电压产生模块、数据电压传输控制模块、补偿控制模块、第一电容、第一晶体管和参考电压写入模块:数据电压传输控制模块传输数据电压产生模块的数据电压至第一晶体管的第一极;补偿控制模块分别与第一晶体管的栅极和第二极电连接,将第一晶体管的阈值电压关联至第一晶体管的栅极;第一电容用于存储第一晶体管的栅极的电压;参考电压写入模块分别与第一晶体管的第一极和第一参考电压输出端电连接;第一晶体管的第二极作为数据电流产生电路的输出端。本发明提供的技术方案,以提高显示面板的均一性。
Description
技术领域
本发明涉及显示技术领域,尤其涉及一种数据电流产生电路、驱动方法、驱动芯片和显示面板。
背景技术
电流型像素驱动电路包括为像素电路提供数据电流的像素驱动电流产生电路。像素驱动电流产生电路可以将数据电压转换为数据电流,为像素电路提供数据电流。
在像素驱动电流产生电路将数据电压转换为数据电流的过程中,由于产生数据电流的晶体管具有阈值电压,使得转换后的数据电流相对于数据电压会有一定的偏差,造成显示面板的均一性比较差。
发明内容
本发明实施例提供了一种数据电流产生电路、驱动方法、驱动芯片和显示面板,以提高显示面板的均一性。
第一方面,本发明实施例提供了一种数据电流产生电路,包括:数据电压产生模块、数据电压传输控制模块、补偿控制模块、第一电容、第一晶体管和参考电压写入模块:
所述数据电压产生模块用于产生数据电压;
所述数据电压传输控制模块连接于所述数据电压产生模块与所述第一晶体管的第一极之间,用于传输所述数据电压至所述第一晶体管的第一极;所述补偿控制模块分别与所述第一晶体管的栅极和所述第一晶体管的第二极电连接,用于将所述第一晶体管的阈值电压关联至所述第一晶体管的栅极;所述第一电容的第一极与所述第一晶体管的栅极电连接,所述第一电容的第二极与第一参考电压输出端电连接,用于存储所述第一晶体管的栅极的电压;所述参考电压写入模块分别与所述第一晶体管的第一极和所述第一参考电压输出端电连接,用于将所述第一参考电压输出端的第一参考电压写入所述第一晶体管的第一极;所述第一晶体管的第二极作为所述数据电流产生电路的输出端,用于根据所述第一晶体管的栅极的电压输出数据电流。
第二方面,本发明实施例提供了一种数据电流驱动芯片,所述数据电流驱动芯片包括本发明任意实施例提供的数据电流产生电路。
第三方面,本发明实施例还提供了一种显示面板,包括显示区和非显示区;所述显示区设置有多个像素电路,所述非显示区设置有本发明任意实施例提供的数据电流产生电路;
所述像素电路通过数据线和开关模块与所述数据电流产生电路电连接;所述数据电流产生电路通过所述数据线和所述开关模块为所述像素电路提供数据电流。
第四方面,本发明实施例还提供了一种数据电流产生电路的驱动方法,用于驱动本发明任意实施例提供的数据电流产生电路,包括:
在初始化阶段,控制所述数据电流产生电路的数据电压产生模块输出数据电压至数据电压传输控制模块,并控制所述数据电压传输控制模块将所述数据电压传输至第一晶体管的第一极,同时控制补偿控制模块将数据电流产生电路的第一晶体管的阈值电压关联至所述第一晶体管的栅极,并通过第一电容存储所述第一晶体管的栅极的电压;
在编程阶段,控制参考电压写入模块将第一参考电压写入所述第一晶体管的第一极;所述第一晶体管根据所述栅极的电压输出数据电流。
本发明中,数据电流产生电路包括数据电压产生模块、数据电压传输控制模块、补偿控制模块、第一电容、第一晶体管和参考电压写入模块,在数据电流产生电路工作的过程中,数据电压产生模块可产生数据电压,并通过数据电压传输控制模块将数据电压传输至第一晶体管的第一极,同时补偿控制模块能够将第一晶体管的阈值电压关联至第一晶体管的栅极,第一电容对第一晶体管的栅极的电压进行存储,之后参考电压写入模块可写入第一参考电压至第一晶体管的第一极,第一晶体管的第二极作为输出端,并根据栅极的电压输出数据电流。本实施例中,用于输出数据电流的第一晶体管的栅极电压与第一晶体管的阈值电压相关,当第一晶体管输出数据电流时,该栅极电压能够补偿第一晶体管的阈值电压对数据电流的影响,从而可以提高数据电压与数据电流的匹配程度,进而提高了显示面板的均一性。
附图说明
图1是现有技术中的一种数据电流产生电路为像素电路提供数据电流的结构示意图;
图2是本发明实施例提供的一种数据电流产生电路的结构示意图;
图3是本发明实施例提供的另一种数据电流产生电路的结构示意图;
图4是图3中数据电流产生电路的一种时序图;
图5是本发明实施例提供的一种显示面板的结构示意图;
图6是本发明实施例提供的一种显示装置的结构示意图;
图7是本发明实施例提供的另一种显示面板的结构示意图;
图8是图7中一组像素电路和数据电流产生电路的结构示意图;
图9是图8中数据电流产生电路和像素电路的一种时序图;
图10是本发明实施例提供的一种数据电流产生电路的驱动方法的流程示意图。
具体实施方式
下面结合附图和实施例对本发明作进一步的详细说明。可以理解的是,此处所描述的具体实施例仅仅用于解释本发明,而非对本发明的限定。另外还需要说明的是,为了便于描述,附图中仅示出了与本发明相关的部分而非全部结构。
图1是现有技术中的一种数据电流产生电路为像素电路提供数据电流的结构示意图。如图1所示,数据电流产生电路1’包括源极驱动运算放大器(Source OperationalAmplifier,SOP)、第一N型晶体管N1和第二N型晶体管N4。数据电流产生电路1’通过数据线D’与像素电路2’连接。在数据线D’上,还包括用于开关作用的第三N型晶体管N2,以及用于复位的第四N型晶体管N3。参考图1,在驱动像素电路工作的过程中,SOP的输入端输入数模转换器(Digital to Analog Converter,DAC)输出的第一电平和第二电平。DAC的输入端输入gamma电压。当gamma电压包括65个电压值时,第一电平和第二电平为DAC根据数据DATA<7:0>中的DATA<7:2>选择的gamma电压GAMMA<65:1>中相邻的两个gamma电压。其中,DATA<7:0>为8bit的数字信号,DATA<7:2>为DATA<7:0>中的高6bit。SOP根据数据DATA<1:0>将第一电平和第二电平电压内插出灰阶对应的数据电压V_DATA,并输出至第二N型晶体管N4。其中,DATA<1:0>为DATA<7:0>中的低2bit。SOP可以是多位的内插电路,也可以是单位增益的buffer电路,本实施对此不进行限定。
数据电流产生电路的具体工作过程如下:在驱动像素电路2’工作的复位阶段Reset,复位控制信号输入端SA’输出的复位控制信号为高电平,开关控制输入端SB’输出的开关控制信号为低电平,SOP输出的数据电压V_DATA通过第二N型晶体管N4输入第一N型晶体管N1的栅极,并通过电容C’保持,同时初始化信号VREF_RST通过第四N型晶体管N3写至像素电路2’;在驱动像素电路2’工作的数据写入阶段Program,复位控制信号输入端SA’输出的复位控制信号为低电平,开关控制输入端SB’输出的开关控制信号为高电平,第一N型晶体管N1根据栅极的数据电压V_DATA形成数据电流,通过第三N型晶体管N2输入至像素电路2’;在驱动像素电路2’工作的发光阶段t3,复位控制信号输入端SA’输出的复位控制信号为高电平,开关控制输入端SB’输出的开关控制信号为低电平,像素电路2’输出数据电流驱动发光器件OLED发光。同时第二N型晶体管N4和第四N型晶体管N3导通,为下一帧输出数据电压V_DATA做准备。由上述驱动像素电路2’的工作过程可知,第一N型晶体管N1将数据电压V_DATA转换成数据电流为像素电路2’提供数据电流I_DATA。而第一N型晶体管N1具有阈值电压偏差,使得第一N型晶体管N1转换后的数据电流I_DATA与数据电压V_DATA具有一定的偏差,从而导致不同的数据电流产生电路1’输出的数据电流I_DATA不同,造成发光器件OLED的发光亮度不同,使得显示面板的均一性比较差。
为解决上述问题,本发明实施例提供了一种数据电流产生电路,如图2所示,图2是本发明实施例提供的一种数据电流产生电路的结构示意图,数据电流产生电路包括:数据电压产生模块11、数据电压传输控制模块12、补偿控制模块13、第一电容C1、第一晶体管T1和参考电压写入模块14:
数据电压产生模块11用于产生数据电压;
数据电压传输控制模块12连接于数据电压产生模块11与第一晶体管T1的第一极之间,用于传输数据电压至第一晶体管T1的第一极;补偿控制模块13分别与第一晶体管T1的栅极和第一晶体管T1的第二极电连接,用于将第一晶体管T1的阈值电压关联至第一晶体管T1的栅极;第一电容C1的第一极与第一晶体管T1的栅极电连接,第一电容C1的第二极与第一参考电压输出端电连接,用于存储第一晶体管T1的栅极的电压;参考电压写入模块14分别与第一晶体管T1的第一极和第一参考电压端VINT1电连接,用于将第一参考电压输出端VINT1的第一参考电压写入第一晶体管T1的第一极;第一晶体管T1的第二极作为数据电流产生电路的输出端OUT,用于根据第一晶体管T1的栅极的电压输出数据电流。
本发明中,数据电流产生电路包括数据电压产生模块、数据电压传输控制模块、补偿控制模块、第一电容、第一晶体管和参考电压写入模块,在数据电流产生电路工作的过程中,数据电压产生模块可产生数据电压,并通过数据电压传输控制模块将数据电压传输至第一晶体管的第一极,同时补偿控制模块能够将第一晶体管的阈值电压关联至第一晶体管的栅极,第一电容对第一晶体管的栅极的电压进行存储,之后参考电压写入模块可写入第一参考电压至第一晶体管的第一极,第一晶体管的第二极作为输出端,并根据栅极的电压输出数据电流。本实施例中,用于输出数据电流的第一晶体管的栅极电压与第一晶体管的阈值电压相关,当第一晶体管输出数据电流时,该栅极电压能够补偿第一晶体管的阈值电压对数据电流的影响,从而可以提高数据电压与数据电流的匹配程度,进而提高了显示面板的均一性。
以上是本发明的核心思想,下面将结合本发明实施例中的附图,对本发明实施例中的技术方案进行清楚、完整地描述。基于本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提下,所获得的所有其他实施例,都属于本发明保护的范围。
图3是本发明实施例提供的另一种数据电流产生电路的结构示意图,具体的,可选的,数据电压传输控制模块12可以包括:第二晶体管T2;第二晶体管T2的栅极与第一控制信号输入端XSB电连接,第二晶体管T2的第一极与数据电压产生模块11电连接,第二晶体管T2的第二极与第一晶体管T1的第一极电连接。
数据电压产生模块11输出数据电压,数据电压传输控制模块12可以包括第二晶体管T2,第二晶体管T2的栅极与第一控制信号输入端XSB连接,第二晶体管T2的第一极接入数据电压产生模块11,第二极与第一晶体管T1的第一极电连接,第一控制信号输入端XSB可控制第二晶体管T2的导通或关断,以控制第一晶体管T1的第一极是否获取数据电压产生模块11输出的数据电压。上述数据电压传输控制模块12作为连接数据电压产生模块11和第一晶体管T1的第一极的开关元件,可通过对其进行开关控制以变换第一晶体管T1的第一极的电压值,可选的,除了上述第二晶体管T2之外,本实施例中数据电压传输控制模块12还可以由其他开关器件组成,本实施例对此不进行限定。
继续参考图3,可选的,补偿控制模块13可以包括:第三晶体管T3和第四晶体管T4;第三晶体管T3的栅极与第二控制信号输入端SA0电连接,第三晶体管T3的第一极与第二参考电压输出端VINT2电连接,第三晶体管T3的第二极与第四晶体管T4的第一极电连接;第四晶体管T4的栅极与第三控制信号输入端SA1电连接,第四晶体管T4的第二极与第一晶体管T1的第二极电连接。
补偿控制模块13可以包括第三晶体管T3和第四晶体管T4,第三晶体管T3的栅极接入第二控制信号输入端SA0,第四晶体管T4的栅极接入第三控制信号输入端SA1,第三晶体管T3和第四晶体管T4顺次连接,也即,第三晶体管T3的第一极接入第二参考电压输出端VINT2以获取第二参考电压,第三晶体管T3的第二极连接第四晶体管T4的第一极,第四晶体管T4的第二极连接第一晶体管T1的第二极。可选的,本实施例中,第三晶体管T3和第四晶体管T4不同时导通,也即,当第三晶体管T3和第四晶体管T4中存在一个导通,则另一个截止。补偿控制模块13能够将第一晶体管T1的阈值电压VTHN关联至第一晶体管T1的栅极,则在第一晶体管T1导通之后,关联至第一晶体管T1的栅极的阈值电压VTHN能够补偿第一晶体管T1的阈值电压对数据电流的影响。
继续参考图3,可选的,参考电压写入模块14可以包括:第五晶体管T5;第五晶体管T5的栅极与第四控制信号输入端SB电连接,第五晶体管T5的第二极与第一晶体管T1的第一极电连接,第五晶体管T5的第一极与第一参考电压输出端VINT1电连接。
参考电压写入模块14包括有第五晶体管T5,参考电压写入模块14能够通过第五晶体管T5的导通或关断控制第一晶体管T1的第一极和第一参考电压输出端VINT1连接或断开。则第一晶体管T1的第一极的电压可瞬时进行变化,示例性的,如图2所示,当第二晶体管T2导通,第五晶体管T5关断时,数据电压VDATA可输入至第一晶体管T1的第一极;当第二晶体管T2关断,第五晶体管T5导通时,第一参考电压VINT1可输入至第一晶体管T1的第一极。上述参考电压写入模块14能够将第一晶体管T1的第一极的电压改变为第一参考电压VINT1,便于第一晶体管T1的阈值电压VTHN和数据电压VDATA叠加至第一晶体管T1的栅极,使得第一晶体管T1产生的数据电流仅与数据电压VDATA相关,提高数据电压与数据电流的匹配程度,进而提高了显示面板的均一性。
本实施例中,第五晶体管T5的栅极接入第四控制信号输入端SB,可选的,第一控制信号输入端XSB输入的第一控制信号,与第四控制信号输入端SB输入的第四控制信号可以互为反向信号。本实施例中,第五晶体管T5和第二晶体管T2连接的同为第一晶体管T1的第一极,则第一晶体管T1的第一极不能同时接入不同电位,第一控制信号输入端XSB输入的第一控制信号,与第四控制信号输入端SB输入的第四控制信号可以互为反向信号,则第二晶体管T2和第五晶体管T5无法同时导通。
在上述实施例的基础上,以下对各个模块的具体配合和工作过程进行详述需要注意的是,上述晶体管T1~T5可均为N型晶体管,高电平导通,低电平关断,如图4所示,图4是图3中数据电流产生电路的一种时序图,数据电流产生电路的具体工作过程如下:
如图3和图4所示,在初始化阶段t1的第一个阶段,第四控制信号SB=0(0为低电平,1为高电平),第一控制信号XSB=1,第二控制信号SA0=1,第三控制信号SA1=0,则第二晶体管T2导通,输出数据电压VDATA,第一晶体管T1的第一极的电压值VNS=VDATA;第三晶体管T3导通,第二参考电压输出端通过第三晶体管T3输出第二参考电压值VINT2至第一晶体管T1的栅极,第一晶体管T1的栅极的电压VNG=VINT2,并且第一电容C1保持第二参考电压值VINT2;第一晶体管的第二端的电压值VND=VNS=VDATA;
在初始化阶段t1的第二个阶段,同样的,第四控制信号SB=0,第一控制信号XSB=1,不同的是,此时,第二控制信号SA0=0,第三控制信号SA1=1,关断第三晶体管T3,导通第四晶体管T4,则第一晶体管T1的栅极和第二极被短接,由于第一晶体管T1没有电流通路,VNG逐渐下降,最终会使第一晶体管T1的栅源电压等于第一晶体管T1的阈值电压Vthn,也即VNG-VNS=VTHN,此时第一晶体管T1没有电流,第一晶体管T1的栅极电压(VNG=VND=VDATA+VTHN)会被第一电容C1保持。
在编程阶段t2,第四控制信号SB=1,第一控制信号XSB=0,第二控制信号SA0=0,第三控制信号SA1=0,第二晶体管T2、第三晶体管T3和第四晶体管T4关断,第五晶体管T5导通,第一晶体管T1的第一极的电压值VNS=VINT1,示例性的,本实施例中第一参考电压端可以为地端,则第五晶体管T5的第一极可连接地端,当然,第一参考电压VINT1还可以为其他电压值,本实施例对此不进行限定。则第一晶体管T1的栅源电压VGS=VNG-VNS=VDATA+VTHN;第一晶体管T1产生数据电流,数据电流 其中,μn为电流输出晶体管Tout的载流子迁移率;Cox为第一晶体管T1的沟道电容常数;W为第一晶体管T1的沟道宽度,L为第一晶体管T1的沟道长度。可知,数据电流产生电路可以消除第一晶体管T1的阈值电压对第一晶体管T1电流源的影响,消除第一晶体管T1源极电源对第一晶体管T1电流源的影响。从而可以提高数据电压与数据电流的匹配程度,进而提高了显示面板的均一性。
根据上述推导的数据电流ID_T1的电流公式: 可以得出,在ID_T1的范围不变的情况下,减小W/L的大小可以增加VDATA的范围,也即增加了gamma电压的范围,提高对整个显示面板的色偏调节效果,提高面板显示亮度。此外,本实施例中提供的对像素电路补偿的数据电流产生电路为外部补偿电路,仅需要设置一行数据电流产生电路,每个数据电流产生电路对应一列像素电路,并为对应列的像素电路提供补偿。因为数据电流产生电路数量较少,可不对上述晶体管T1~T5的尺寸进行限定,在工艺条件允许的情况下,对于晶体管TI,可以通过增加L和减小W来减小W/L的取值大小,以增加gamma电压的范围。
需要注意的是,上述本实施例中提供的工作时序为数据电流产生电路的工作时序中的一种,本发明实施例中数据电流产生电路包括但不限于上述工作时序。
本发明实施例还提供一种数据电流驱动芯片,包括本发明任意实施例提供的数据电流产生电路。因此具有本发明任意实施例提供的数据电流产生电路的全部技术特征,从而具有本发明任意实施例提供的数据电流产生电路的有益效果,此处不再赘述。
本发明实施例还提供一种显示面板。图5是本发明实施例提供的一种显示面板的结构示意图,包括显示区AA和非显示区NA;显示区AA设置有多个像素电路2,非显示区NA设置有本发明任意实施例提供的数据电流产生电路1;
像素电路2通过数据线(D1、D2、D3、D4等)和开关模块T7与数据电流产生电路1电连接;数据电流产生电路1通过数据线和开关模块T7为像素电路2提供数据电流。
具体地,显示区AA包括多个像素单元,每个像素单元包括一个像素电路2。非显示区NA包括栅极驱动电路和数据驱动电路,栅极驱动电路通过扫描线(S1、S2、S3、S4等)为像素电路2提供扫描信号,数据驱动电路通过数据线(D1、D2、D3、D4等)为像素电路2提供数据电流。像素电路2在扫描信号的作用下,连通与之对应的数据线(D1、D2、D3、D4等)。在开关模块T7导通时,数据线(D1、D2、D3、D4等)通过从数据驱动电路中的数据电流产生电路1获取数据电流,并传输至像素电路2,像素电路依此实现显示面板的显示。
图6是本发明实施例提供的一种显示装置的结构示意图,显示面板可以为如图6中所示的手机的显示面板3,也可以为电脑、电视机、智能穿戴设备等电子设备的显示面板,本实施例对此不作特殊限定。
可选的,继续参考图5,显示面板还可以包括第六晶体管T6;开关模块包括第七晶体管T7;第六晶体管T6的栅极与复位控制信号输入端SA电连接,第六晶体管T6的第一极通过数据线与像素电路2的数据电流输入端IN1电连接,第六晶体管T6的第二极与复位信号输入端RST电连接;第七晶体管T7的栅极与第五控制信号输入端SB电连接,第七晶体管T7的第一极与数据电流产生电路1的第一晶体管T1的第二极电连接,第七晶体管T7的第二极通过数据线与像素电路2的数据电流输入端IN1电连接。
第六晶体管T6能够控制像素电路2的数据电流输入端IN1是否接入复位信号进行复位,具体的,第六晶体管T6的栅极连接复位控制信号输入端SA,第一极通过数据线连接像素电路2的数据电流输入端IN1,第二极与复位信号输入端RST连接,则当复位控制信号输入端SA输入复位控制信号至第六晶体管T6时,第六晶体管T6将复位信号RST输入数据电流输入端IN1。而当,第六晶体管T6断开,第七晶体管T7导通时,第五控制信号输入端SB输出第一控制信号至第七晶体管T7的栅极,并且第七晶体管T7的第一极与第一晶体管T1的第二极连接,第七晶体管T7的第二极与数据电流输入端IN1连接,则数据电流可通过第七晶体管T7传输至像素电路2的数据电流输入端IN1,便于像素电路2的初始化阶段接入复位信号RST,并在编程阶段接入数据电流。
图7是本发明实施例提供的另一种显示面板的结构示意图,图8是图7中一组像素电路和数据电流产生电路的结构示意图,可选的,第五晶体管T5与第七晶体管T7导通时序可以相同。第七晶体管T7用于将数据电流传输至像素电路2,则第七晶体管T7导通时,第一晶体管T1需导通产生数据电路,此时,第五晶体管T5需导通形成数据电流通路。继续参考图8,可选的,第五晶体管T5可先于第七晶体管T7导通,从而错开了第五晶体管T5与第七晶体管T7的开启时间,等待第一晶体管T1的第一极电压VNS等于VINT1,此时因为第七晶体管T7还未导通,第一晶体管T1没有电流流过,则当第五晶体管T5导通的瞬间,第一参考电压输出端VINT1上不存在动态电压降,每个数据电流产生电路的第一晶体管T1中的源漏极电压保持一致,提高数据电流的均一性,此后再次开启第七晶体管T7,使得数据电流经由第七晶体管T7传输至像素电路2。
继续参考图8,可选的,像素电路2可以包括第八晶体管T8、第九晶体管T9、第十晶体管T10、第十一晶体管T11、第二电容C2和发光器件OLED;第八晶体管T8的第一极和第九晶体管T9的第二极与像素电路2的数据电流输入端IN1电连接,第八晶体管T8的第二极与第十晶体管T10的栅极和第二电容C2的第一极电连接,第八晶体管T8的栅极和第九晶体管T9的栅极均与像素电路2的扫描信号输入端WS电连接,第九晶体管T9的第一极与第十晶体管T10的第二极电连接,第十晶体管T10的第一极与像素电路2的第一电源信号输入端ELVDD电连接;第二电容C2的第二极与像素电路2的第三参考电压输入端VREF电连接,第十晶体管T10的第二极与第十一晶体管T11的第一极电连接,第十一晶体管T11的栅极与像素电路2的发光控制信号输入端EMIT电连接,第十一晶体管T11的第二极与发光器件OLED的阳极电连接,发光器件OLED的阴极与像素电路2的第二电源信号输入端ELVSS电连接。
可选的,上述像素电路2中的晶体管T8~T11均为P型晶体管,低电平导通,高电平关断。以下将结合像素电路2和数据电流产生电路1的配合时序对像素单元的发光过程进行详述。如图9所示,图9是图8中数据电流产生电路和像素电路的一种时序图。
在初始化阶段t1的第一阶段,WS为低电平,EMIT为低电平,SB为低电平,XSB为高电平,SA为高电平,SA0为高电平,SA1为低电平,此时第二晶体管T2、第三晶体管T3、第六晶体管T6、第八晶体管T8、第九晶体管T9和第十一晶体管T11导通。数据电压产生模块11输出的数据电压过第二晶体管T2输入至,第一晶体管T1的第一极,第一晶体管T1的第一极的电压值VNS=VDATA,第三晶体管T3导通,第二参考电压输出端通过第三晶体管T3输出第二参考电压值VINT2至第一晶体管T1的栅极,第一晶体管T1的栅极的电压VNG=VINT2,并且第一电容C1保持第二参考电压值VINT2;第一晶体管的第二端的电压值VND=VNS=VDATA;同时,复位信号RST通过第六晶体管T6和第八晶体管T8输入至第十晶体管T10的栅极,复位信号RST还通过第六晶体管T6和第九晶体管T9输入至第十晶体管T10的第二极,并且通过第十一晶体管T11写入发光器件OLED的阳极,使得发光器件OLED处于复位状态;
在初始化阶段t1的第二个阶段,同样的,WS为低电平,EMIT存在由低电平转换为高电平过程,与此同时,当EMIT由低电平转换为高电平的时刻,SA由高电平转换为低电平,SB为低电平,XSB为高电平,不同的是,此时,SA0为低电平,SA1为高电平,此时第二晶体管T2、第四晶体管T4、第八晶体管T8、第九晶体管T9和第十一晶体管T11导通。第六晶体管T6和第十一晶体管T11有道通变为关闭,发光器件OLED停止接收复位信号。与上述第一阶段相比,关断第三晶体管T3,导通第四晶体管T4,则第一晶体管T1的栅极和第二极被短接,由于第一晶体管T1没有电流通路,VNG逐渐下降,最终会使第一晶体管T1的栅源电压等于第一晶体管T1的阈值电压Vthn,也即VNG-VNS=VTHN,此时第一晶体管T1没有电流,第一晶体管T1的栅极电压(VNG=VND=VDATA+VTHN)会被第一电容C1保持;
在编程阶段t2,WS为低电平,EMIT为高电平,SA为低电平,SB为高电平,XSB为低电平,SA1为低电平,SA0为低电平,第五晶体管T5、第一晶体管T1、第七晶体管T7、第八晶体管T8和第九晶体管T9导通,第一晶体管T1的栅极电压(VNG=VND=VDATA+VTHN)保持,第十晶体管T10的栅极电压为RST,第二极的电压为RST,这样,第一晶体管T1和第十晶体管T10决定了一个平衡态的电流。具体的,第一晶体管T1的第一极的电压值VNS=VINT1,示例性的,本实施例中第一参考电压端可以为地端,则第五晶体管T5的第一极可连接地端,当然,第一参考电压VINT1还可以为其他电压值,本实施例对此不进行限定。则第一晶体管T1的栅源电压VGS=VNG-VNS=VDATA+VTHN;第一晶体管T1产生数据电流,数据电流 可选的,驱动第五晶体管T5的SB和驱动第七晶体管T7的SB可存在一定的时延,避免受地上电压降的影响。
在发光阶段t3,WS为高电平,EMIT为低电平,SB为低电平,SA为高电平,XSB为高电平,SA1为低电平,SA0为低电平,第二晶体管T2、第六晶体管T6、第十晶体管T10和第十一晶体管T11导通,第十晶体管T10的栅极电压保持RST,第十晶体管T10产生的电流通过第十一晶体管T11传输至发光器件OLED,使得发光器件OLED发光,并且第六晶体管T6再次将复位信号RST输入至数据线,并且第二晶体管T2再次将数据电压传输至第一晶体管T1的第一极,为下一次初始化阶段做准备。
需要注意的是,上述本实施例中提供的工作时序为数据电流产生电路和像素电路的工作时序中的一种,本发明实施例中数据电流产生电路包括但不限于上述工作时序。
基于同一构思,本发明实施例还提供一种数据电流产生电路的驱动方法。图10是本发明实施例提供的一种数据电流产生电路的驱动方法的流程示意图,如图10所示,本实施例的方法包括如下步骤:
步骤S110、在初始化阶段,控制数据电流产生电路的数据电压产生模块输出数据电压至数据电压传输控制模块,同时控制补偿控制模块将数据电流产生电路的第一晶体管的阈值电压关联至第一晶体管的栅极。
步骤S120、在编程阶段,控制数据电压传输控制模块输出数据电压至第一晶体管的栅极;第一晶体管根据栅极的电压输出数据电流。
本发明实施例中,数据电流产生电路包括数据电压产生模块、数据电压传输控制模块、补偿控制模块、第一电容、第一晶体管和参考电压写入模块,在数据电流产生电路工作的过程中,数据电压产生模块可产生数据电压,并通过数据电压传输控制模块将数据电压传输至第一晶体管的第一极,同时补偿控制模块能够将第一晶体管的阈值电压关联至第一晶体管的栅极,第一电容对第一晶体管的栅极的电压进行存储,之后参考电压写入模块可写入第一参考电压至第一晶体管的第一极,第一晶体管的第二极作为输出端,并根据栅极的电压输出数据电流。本实施例中,用于输出数据电流的第一晶体管的栅极电压与第一晶体管的阈值电压相关,当第一晶体管输出数据电流时,该栅极电压能够补偿第一晶体管的阈值电压对数据电流的影响,从而可以提高数据电压与数据电流的匹配程度,进而提高了显示面板的均一性。
注意,上述仅为本发明的较佳实施例及所运用技术原理。本领域技术人员会理解,本发明不限于这里的特定实施例,对本领域技术人员来说能够进行各种明显的变化、重新调整和替代而不会脱离本发明的保护范围。因此,虽然通过以上实施例对本发明进行了较为详细的说明,但是本发明不仅仅限于以上实施例,在不脱离本发明构思的情况下,还可以包括更多其他等效实施例,而本发明的范围由所附的权利要求范围决定。
Claims (12)
1.一种数据电流产生电路,其特征在于,包括:数据电压产生模块、数据电压传输控制模块、补偿控制模块、第一电容、第一晶体管和参考电压写入模块;
所述数据电压产生模块用于产生数据电压;
所述数据电压传输控制模块连接于所述数据电压产生模块与所述第一晶体管的第一极之间,用于传输所述数据电压至所述第一晶体管的第一极;所述补偿控制模块分别与所述第一晶体管的栅极和所述第一晶体管的第二极电连接,用于将所述第一晶体管的阈值电压关联至所述第一晶体管的栅极;所述第一电容的第一极与所述第一晶体管的栅极电连接,所述第一电容的第二极与第一参考电压输出端电连接,用于存储所述第一晶体管的栅极的电压;所述参考电压写入模块分别与所述第一晶体管的第一极和所述第一参考电压输出端电连接,用于将所述第一参考电压输出端的第一参考电压写入所述第一晶体管的第一极;所述第一晶体管的第二极作为所述数据电流产生电路的输出端,用于根据所述第一晶体管的栅极的电压输出数据电流。
2.根据权利要求1所述的数据电流产生电路,其特征在于,所述数据电压传输控制模块包括:第二晶体管;
所述第二晶体管的栅极与第一控制信号输入端电连接,所述第二晶体管的第一极与所述数据电压产生模块电连接,所述第二晶体管的第二极与所述第一晶体管的第一极电连接。
3.根据权利要求1所述的数据电流产生电路,其特征在于,所述补偿控制模块包括:第三晶体管和第四晶体管;
所述第三晶体管的栅极与第二控制信号输入端电连接,所述第三晶体管的第一极与第二参考电压输出端电连接,所述第三晶体管的第二极与所述第四晶体管的第一极电连接;
所述第四晶体管的栅极与第三控制信号输入端电连接,所述第四晶体管的第二极与所述第一晶体管的第二极电连接。
4.根据权利要求2所述的数据电流产生电路,其特征在于,所述参考电压写入模块包括:第五晶体管;
所述第五晶体管的栅极与第四控制信号输入端电连接,所述第五晶体管的第二极与所述第一晶体管的第一极电连接,所述第五晶体管的第一极与所述第一参考电压输出端电连接。
5.根据权利要求1所述的数据电流产生电路,其特征在于,所述第一控制信号输入端输入的第一控制信号,与第四控制信号输入端输入的第四控制信号互为反向信号。
6.一种数据电流驱动芯片,其特征在于,包括权利要求1-5任一项所述的数据电流产生电路。
7.一种显示面板,其特征在于,包括显示区和非显示区;所述显示区设置有多个像素电路,所述非显示区设置有权利要求1-5任一项所述的数据电流产生电路;
所述像素电路通过数据线和开关模块与所述数据电流产生电路电连接;所述数据电流产生电路通过所述数据线和所述开关模块为所述像素电路提供数据电流。
8.根据权利要求7所述的显示面板,其特征在于,还包括第六晶体管;所述开关模块包括第七晶体管;
所述第六晶体管的栅极与复位控制信号输入端电连接,所述第六晶体管的第一极通过所述数据线与所述像素电路的数据电流输入端电连接,所述第六晶体管的第二极与复位信号输入端电连接;
所述第七晶体管的栅极与第五控制信号输入端电连接,所述第七晶体管的第一极与所述数据电流产生电路的第一晶体管的第二极电连接,所述第七晶体管的第二极通过所述数据线与所述像素电路的数据电流输入端电连接。
9.根据权利要求8所述的显示面板,其特征在于,所述第五晶体管与所述第七晶体管导通时序相同。
10.根据权利要求8所述的显示面板,其特征在于,所述第五晶体管先于所述第七晶体管导通。
11.根据权利要求7所述的显示面板,其特征在于,所述像素电路包括第八晶体管、第九晶体管、第十晶体管、第十一晶体管、第二电容和发光器件;
所述第八晶体管的第一极和所述第九晶体管的第二极与所述像素电路的数据电流输入端电连接,所述第八晶体管的第二极与所述第十晶体管的栅极和所述第二电容的第一极电连接,所述第八晶体管的栅极和所述第九晶体管的栅极均与所述像素电路的扫描信号输入端电连接,所述第九晶体管的第一极与所述第十晶体管的第二极电连接,所述第十晶体管的第一极与所述像素电路的第一电源信号输入端电连接;所述第二电容的第二极与所述像素电路的第三参考电压输入端电连接,所述第十晶体管的第二极与所述第十一晶体管的第一极电连接,所述第十一晶体管的栅极与所述像素电路的发光控制信号输入端EMIT电连接,所述第十一晶体管的第二极与所述发光器件的阳极电连接,所述发光器件的阴极与所述像素电路的第二电源信号输入端电连接。
12.一种数据电流产生电路的驱动方法,其特征在于,用于驱动权利要求1-5任一项所述的数据电流产生电路,包括:
在初始化阶段,控制所述数据电流产生电路的数据电压产生模块输出数据电压至数据电压传输控制模块,并控制所述数据电压传输控制模块将所述数据电压传输至第一晶体管的第一极,同时控制补偿控制模块将数据电流产生电路的第一晶体管的阈值电压关联至所述第一晶体管的栅极,并通过第一电容存储所述第一晶体管的栅极的电压;
在编程阶段,控制参考电压写入模块将第一参考电压写入所述第一晶体管的第一极;所述第一晶体管根据所述栅极的电压输出数据电流。
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PB01 | Publication | ||
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SE01 | Entry into force of request for substantive examination | ||
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