CN110688024A - 移位寄存器及具有移位寄存器的触控显示装置 - Google Patents
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Abstract
一种移位寄存器能够产生将脉冲信号平移一预定相位的多个脉冲位移信号。移位寄存器包括多个级联连接的单位电路。单位电路包括输出端、输入晶体管、输出晶体管及上拉晶体管。输入晶体管在第一控制信号的控制下,根据外部提供的触发信号来向第一节点输出高电平。输出晶体管根据第一节点的高电平向输出端输出与接收的时钟控制信号同步的脉冲位移信号。在任意相邻两个单位电路输出的脉冲位移信号之间***空白区段,上拉晶体管将处于下一级输出的单位电路的输出端的脉冲位移信号上拉至高电平。本发明还提供一种具有移位寄存器的触控显示装置。
Description
技术领域
本发明涉及一种移位寄存器及具有移位寄存器的触控显示装置。
背景技术
触控显示装置可分时实现显示功能和触控功能。触控显示装置包括多条数据线和多条扫描线。多条数据线和多条扫描线正交设置定义出呈矩阵排列的多个像素单元。触控显示装置还包括时序控制器、栅极驱动器以及源极驱动器。栅极驱动器输出扫描驱动信号给扫描线以对像素单元进行扫描。源极驱动器输出数据驱动信号给数据线以对像素单元加载相应的图像数据信号。栅极驱动器通常由多个级联的单位电路构成。每一级单位电路至少接收第一时钟控制信号、第二时钟控制信号、设置信号以及重置信号。单位电路由多个薄膜晶体管、驱动晶体管及至少一个电容构成。电容并联连接在驱动晶体管的栅极和漏极之间。驱动晶体管在导通时输出接收的时钟控制信号同步的信号作为扫描信号。每一级单位电路工作在预充电阶段、上拉阶段及下拉阶段。触控阶段可***在预充电阶段、上拉阶段及下拉阶段中任意二者之间。当触控阶段***在预充电阶段和上拉阶段之间时,由于在触控阶段,驱动晶体管保持开启状态,其对应的栅极电压会受电容及漏电流的影响而下降,且会使得驱动晶体管的开启电压变大。当由触控阶段进入上拉阶段时,由于驱动晶体管的栅极电压下降和特性的变化,使得输出端无法输出第一电压,进而引起显示异常而出现横线,从而影响触控显示装置的稳定性。
发明内容
有鉴于此,有必要提供一种可提高稳定性的移位寄存器。
还有必要提供一种可提高稳定性的具有移位寄存器的触控显示装置。
一种移位寄存器,其能够产生将脉冲信号平移一预定相位的多个脉冲位移信号,包括:
多个级联连接的单位电路,每个单位电路接收外部提供的时钟控制信号,包括:
输出端,输出端与外部的至少一信号线电性连接,用于为相应连接的信号线提供脉冲位移信号,其中,第N+1级的单位电路的输出端向第N+1条信号线上输出的脉冲位移信号与第N级的单位电路的输出端向第N条信号线上输出的脉冲位移信号延迟预定相位,且存在空白区段***在任意相邻两个单位电路输出的脉冲位移信号之间;
输入晶体管,输入晶体管在第一控制信号的控制下,根据外部的用于表征当前级的单位电路开始工作的触发信号来向第一节点输出高电平;
输出晶体管,其包括与第一节点电性连接的第一控制端、接收时钟控制信号的第一连接端及与输出端电性连接的第二连接端,输出晶体管根据第一节点的高电平向输出端输出与时钟控制信号同步的脉冲位移信号;
上拉晶体管,其包括与输出端电性连接的第二控制端、与第二控制端电性连接的第一连接端及与高压电压源电性连接的第二连接端;
其中,在第N级的单位电路与第N+1级的单位电路***空白区段后,且第N+1级的单位电路开始输出所述脉冲位移信号期间,上拉晶体管将第N+1级的单位电路的输出端的脉冲位移信号上拉至高电平。
一种触控显示装置,定义有显示区域和围绕显示区域设置的非显示区域。非显示区域内设置有至少一个栅极驱动器。至少一个栅极驱动器内包括至少一个移位寄存器。移位寄存器能够产生将脉冲信号平移一预定相位的多个脉冲位移信号,包括:
多个级联连接的单位电路,每个单位电路接收外部提供的时钟控制信号,包括:
输出端,输出端与外部的至少一信号线电性连接,用于为相应连接的信号线提供脉冲位移信号,其中,第N+1级的单位电路的输出端向第N+1条信号线上输出的脉冲位移信号与第N级的单位电路的输出端向第N条信号线上输出的脉冲位移信号延迟预定相位,且存在空白区段***在任意相邻两个单位电路输出的脉冲位移信号之间;
输入晶体管,输入晶体管在第一控制信号的控制下,根据外部的用于表征当前级的单位电路开始工作的触发信号来向第一节点输出高电平;
输出晶体管,其包括与第一节点电性连接的第一控制端、接收时钟控制信号的第一连接端及与输出端电性连接的第二连接端,输出晶体管根据第一节点的高电平向输出端输出与时钟控制信号同步的脉冲位移信号;
上拉晶体管,其包括与输出端电性连接的第二控制端、与第二控制端电性连接的第一连接端及与高压电压源电性连接的第二连接端;
其中,在第N级的单位电路与第N+1级的单位电路***空白区段后,且第N+1级的单位电路开始输出所述脉冲位移信号期间,上拉晶体管将第N+1级的单位电路的输出端的脉冲位移信号上拉至高电平。
与现有技术相比较,采用上述的移位寄存器及触控显示装置,在部分相邻两级单位电路的输出脉冲位移信号之间***空白区段时通过保持模块上拉处于下级输出的单位电路的输出端的输出脉冲位移信号为高电平,避免了***空白区段后下级输出的单位电路的输出端的输出脉冲位移信号小于高电平,避免了水平横线的产生,进而保证了触控显示装置的稳定性。
附图说明
图1为本发明较佳实施方式之触控显示装置的模块示意图。
图2为图1中所示栅极驱动器的模块示意图。
图3为图2中所示单位电路的等效电路图。
图4为图2中所示单位电路的驱动时序图。
主要元件符号说明
触控显示装置 1
像素单元 10
显示区域 11
非显示区域 13
扫描线 G1-Gn
数据线 D1-Dm
栅极驱动器 20
移位寄存器 200
源极驱动器 30
时钟控制信号线 VCK1-VCK4
单位电路 21
起始脉冲信号 STV
设置端 S
重置端 R
时钟控制信号输入端 CK
第一控制端 C1
第二控制端 C2
输出端 OUT
输入模块 22
子输出端 22a
输出模块 23
重置模块 24
保持模块 25
预充电阶段 P1
上拉阶段 P2
下拉阶段 P3
输入晶体管 T1
输出晶体管 T2
第一节点 N1
存储电容 C
高压电源 VDD
低压电源 VGL
第一晶体管 T3
第二晶体管 T4
下拉晶体管 T5
上拉晶体管 T6
子触控阶段 TP1-TPn
子显示阶段 DP1-DPn
如下具体实施方式将结合上述附图进一步说明本发明。
具体实施方式
本发明提供一种移位寄存器。移位寄存器能够产生将脉冲信号平移一预定相位的多个脉冲位移信号,包括:
多个级联连接的单位电路,每个单位电路接收外部提供的时钟控制信号,包括:
输出端,输出端与外部的至少一信号线电性连接,用于为相应连接的信号线提供脉冲位移信号,其中,第N+1级的单位电路的输出端向第N+1条信号线上输出的脉冲位移信号与第N级的单位电路的输出端向第N条信号线上输出的脉冲位移信号延迟预定相位,且存在空白区段***在任意相邻两个单位电路输出的脉冲位移信号之间;
输入晶体管,输入晶体管在第一控制信号的控制下,根据外部的用于表征当前级的单位电路开始工作的触发信号来向第一节点输出高电平;
输出晶体管,其包括与第一节点电性连接的第一控制端、接收时钟控制信号的第一连接端及与输出端电性连接的第二连接端,输出晶体管根据第一节点的高电平向输出端输出与时钟控制信号同步的脉冲位移信号;
上拉晶体管,其包括与输出端电性连接的第二控制端、与第二控制端电性连接的第一连接端及与高压电压源电性连接的第二连接端;
其中,在第N级的单位电路与第N+1级的单位电路***空白区段后,且第N+1级的单位电路开始输出所述脉冲位移信号期间,上拉晶体管将第N+1级的单位电路的输出端的脉冲位移信号上拉至高电平。
在一实施例中,在空白区段,所有单位电路均停止输出脉冲位移信号。
在一实施例中,单位电路还包括重置模块。重置模块接收外部提供的重置信号。重置模块包括下拉晶体管。下拉晶体管包括与接收重置信号的第三控制端、与输出端电性连接的第一连接端以及与低压电源电性连接的第二连接端。下拉晶体管根据外部用于表征当前级的单位电路重置的重置信号来向输出端输出低电平。
在一实施例中,重置模块还接收外部提供的第二控制信号。重置模块还包括第一晶体管。第一晶体管包括接收第二控制信号的第四控制端、与第一节点电性连接的第二连接端及与低压电源电性连接的第二连接端。第一晶体管根据第二控制信号的高电平向第一节点输出低电平。
在一实施例中,第一控制信号、时钟控制信号及第二控制信号来自三条相邻时钟线,三者之间依次延迟预定相位。
在一实施例中,重置模块还包括第二晶体管。第二晶体管包括接收重置信号的第五控制端、与第一节点电性连接的第二连接端及与低压电源电性连接的第二连接端。第二晶体管根据重置信号的高电平向第一节点输出低电平。
在一实施例中,一种触控显示装置,定义有显示区域和围绕显示区域设置的非显示区域。非显示区域内设置有至少一个栅极驱动器。至少一个栅极驱动器内包括至少一个移位寄存器。移位寄存器能够产生将脉冲信号平移一预定相位的多个脉冲位移信号,包括:
多个级联连接的单位电路,每个单位电路接收外部提供的时钟控制信号,包括:
输出端,输出端与外部的至少一信号线电性连接,用于为相应连接的信号线提供脉冲位移信号,其中,第N+1级的单位电路的输出端向第N+1条信号线上输出的脉冲位移信号与第N级的单位电路的输出端向第N条信号线上输出的脉冲位移信号延迟预定相位,且存在空白区段***在任意相邻两个单位电路输出的脉冲位移信号之间;
输入晶体管,输入晶体管在第一控制信号的控制下,根据外部的用于表征当前级的单位电路开始工作的触发信号来向第一节点输出高电平;
输出晶体管,其包括与第一节点电性连接的第一控制端、接收时钟控制信号的第一连接端及与输出端电性连接的第二连接端,输出晶体管根据第一节点的高电平向输出端输出与时钟控制信号同步的脉冲位移信号;
上拉晶体管,其包括与输出端电性连接的第二控制端、与第二控制端电性连接的第一连接端及与高压电压源电性连接的第二连接端;
其中,在第N级的单位电路与第N+1级的单位电路***空白区段后,且第N+1级的单位电路开始输出所述脉冲位移信号期间,上拉晶体管将第N+1级的单位电路的输出端的脉冲位移信号上拉至高电平。
在一实施例中,触控显示装置交替工作在触控阶段和显示阶段。显示阶段包括多个子显示阶段。至少一个移位寄存器在相邻的子显示阶段分别输出二脉冲位移信号作为触控显示装置的薄膜晶体管阵列电路工作所需的扫描信号,触控阶段包括多个子触控阶段。子触控阶段***在任意两个相邻的子显示阶段之间。子触控阶段为空白区段。
下面结合图对本发明触控显示装置的具体实施方式进行说明。
请一并参阅图1,其为本发明一种实施方式的触控显示装置1的模块示意图。触控显示装置1定义有显示区域11和围绕显示区域11设置的非显示区域13。显示区域11包括多条相互平行的扫描线G1-Gn及多条相互平行的数据线D1-Dm。其中,n,m为正整数。多条扫描线G1-Gn沿第一方向X延伸,多条数据线D1-Dm均沿与第一方向垂直的第二方向Y延伸,且分别与多条扫描线G1-Gn相互交错定义出网格状,网格的镂空处定义出多个呈矩阵设置的像素单元10。可以理解,本揭露的触控显示装置的多条扫描线G1-Gn及多条数据线D1-Dm可根据需要排布,比如扫描线G1-Gn与数据线D1-Dm并非正交交错,而是倾斜的交错,并不以本实施例为限。非显示区域13内设置有一个栅极驱动器20及一个源极驱动器30。其中,栅极驱动器20与扫描线G1-Gn电性连接,用于驱动扫描线G1-Gn。源极驱动器30还用于输出数据信号给数据线D1-Dm,以使得对应的像素单元10加载数据信号。可以理解,触控显示装置还可包括时序控制器。时序控制器用于提供多个同步控制信号和至少一个时钟控制信号给栅极驱动器20。在本实施方式中,时序驱动器通过时钟控制信号线VCK1-VCK4提供时钟控制信号给栅极驱动器20。任意一个时钟控制信号线VCK1-VCK4上的脉冲信号为具有预定频率的脉冲信号,且四个时钟控制信号线VCK1-VCK4上的脉冲信号的相位依次延迟。其中,多个同步控制信号可包括水平同步信号(horizontal synchronization,Vsync)、垂直同步信号(vertical synchronization,Vsync)以及数据使能信号(data enable,EN)等。任意一个像素单元10通过一条扫描线Gi与栅极驱动器20电性连接,通过一条数据线Di与源极驱动器30电性连接。
请一并参阅图2及图3,其为第一实施方式之栅极驱动器20的模块示意图。栅极驱动器20由至少一个移位寄存器200构成。移位寄存器200用于产生将脉冲信号平移一预定相位的多个脉冲位移信号。每个移位寄存器200由多个单位电路21级联连接构成。每个单位电路21与扫描线G1-Gn分别电性连接,从而分别为扫描线G1-Gn提供脉冲位移信号作为扫描信号。移位寄存器200与四个时钟控制信号线VCK1-VCK4电性连接,并接收一个起始脉冲信号STV。每个单位电路21用于输出脉冲位移信号以作为扫描信号提供给对应的扫描线Gi。每个单位电路21的电路结构相同,且具有相同的引脚。
每个单位电路21的第一控制端C1、第二控制端C2、时钟控制信号输入端CK分别与时钟控制信号线VCK1-VCK4中的三者电性连接。三个时钟控制信号VCK的相位依次延迟。第一级单位电路21的时钟控制信号输入端CK与时钟控制信号线VCK1电性连接,第一级单位电路21的第一控制端C1与时钟控制信号线VCK2电性连接,第一级单位电路21的第二控制端C2与时钟控制信号线VCK3电性连接。第二级单位电路21的时钟控制信号输入端CK与时钟控制信号线VCK2电性连接,第二级单位电路21的第一控制端C1与时钟控制信号线VCK3电性连接,第二级单位电路21的第二控制端C2与时钟控制信号线VCK4电性连接。第三级单位电路21的的时钟控制信号输入端CK与时钟控制信号线VCK3电性连接,第三级单位电路21的第一控制端C1与时钟控制信号线VCK4电性连接,第三级单位电路21的第二控制端C2与时钟控制信号线VCK1电性连接。第四级单位电路21的的时钟控制信号输入端CK与时钟控制信号线VCK4电性连接,第四级单位电路21的第一控制端C1与时钟控制信号线VCK1电性连接,第四级单位电路21的第二控制端C2与时钟控制信号线VCK2电性连接。
每个单位电路21包括设置端S、重置端R、第一控制端C1、第二控制端C2、时钟控制信号输入端CK及输出端OUT。单位电路21包括触发器电路,并根据设置端S与重置端R的输入信号控制输出端OUT的输出。具体地,当设置端S接收有效电平(以高电平为例),而重置端R接收无效电平(以低电平为例)时,该单位电路21的输出端OUT输出高电平;当设置端S为低电平,而重置端R接收高电平时,该单位电路21的输出置位清零,输出端OUT输出低电平。时钟控制信号输入端CK的脉宽则用于确定输出信号的脉宽。
该单位电路21包括具有设置端S的输入模块22、具有时钟控制信号输入端CK的输出模块23、具有重置端R的重置模块24及保持模块25。
输出模块23用于根据设置端S及重置端R收到的信号来控制其输出端OUT是否输出与时钟控制信号输入端CK输入的时钟控制信号同步的脉冲信号作为单位电路21所要输出的位移脉冲信号。输出模块23包括输出晶体管T2和存储电容C。输出晶体管T2的控制端与输入模块22的子输出端22a连接于第一节点N1,源极连接于时钟控制信号输入端CK,漏极连接于输出端OUT。存储电容C的两端连接在第一节点N1与输出端OUT之间。
输入模块22包括用于接收触发信号的设置端S、子输出端22a及用于接收时钟控制信号的第一控制端C1。输入模块22包括输入晶体管T1。输入晶体管T1的控制端连接第一控制端C1,源极连接设置端S,漏极连接子输出端22a。输入模块22用于在第一控制端C1的控制下控制自设置端S输入的触发信号的输出时序。第N级单位电路21的设置端S上加载的触发信号为第N-1级单位电路21的输出端OUT的输出脉冲位移信号。
重置模块24用于根据重置端R端输入的重置信号来控制当前级的单位电路21停止输出脉冲移位信号。第N级单位电路21的重置端R上加载的重置信号为第N+1级单位电路21的输出端OUT的输出电压。重置模块24包括与输出晶体管T2串联的下拉晶体管T5,连接于第一节点N1与低压电源VGL之间的第一晶体管T3及与该第一晶体管T3并联连接的第二晶体管T4。第一晶体管T3的控制端连接第二控制端C2,第二晶体管T4的控制端连接重置端R。下拉晶体管T5的控制端连接重置端R,源极连接输出端OUT,漏极连接低压电源VGL。其中,下拉晶体管T5的源极亦连接输出端OUT,从而使得输出晶体管T2与下拉晶体管T5之间定义第二节点N2。
在本发明中,单位电路21所产生的脉冲位移信号依序发生平移,且存在在部分相邻两级单位电路21输出的脉冲位移信号之间***空白区段的情况。保持模块25用于上拉该部分相邻的单位电路21中处于下级输出的单位电路21的输出端OUT输出的脉冲位移信号,从而保持输出端OUT输出的脉冲位移信号维持高电平V1的输出。例如,请参考图4,若部分相邻的单位电路21分别为第5级单位电路21与第6级单位电路21,若无保持模块25,则在第5级单位电路21的输出端输出脉冲位移信号后,第6级单位电路21的输出端OUT输出脉冲位移信号的电平V1’小于高电平V1,如图中虚线所示,可比照地,当存在保持模块25时,则第6级单位电路21输出端OUT输出脉冲位移信号维持高电平V1。
在本实施例中,该保持模块25包括上拉晶体管T6,上拉晶体管T6的控制端与漏极均分别连接输出端OUT,源极连接高电压电源VDD。上拉晶体管T6在空白区段后且单位电路21开始输出脉冲位移信号时开启,从而上拉输出端OUT的电位,使之上升至VDD-Vth。
第一级单位电路21的设置端S与起始脉冲信号STV电性连接,其他级单位电路21的设置端S与前一级单位电路21的输出端OUT电性连接。最后一级单位电路21的重置端R与起始脉冲信号STV电性连接,其他级单位电路21的重置端与后一级单位电路21的输出端OUT电性连接。
在本实施方式中,输入晶体管T1、输出晶体管T2、第一晶体管T3、第二晶体管T4、下拉晶体管T5及上拉晶体管T6均为N型薄膜晶体管。
请一并参阅图4,其为第5级单位电路21的相应信号的时序图。触控显示装置1可交替工作在触控阶段和显示阶段。在一帧时长内,触控阶段包括多个子触控阶段TP1-TPn,显示阶段包括多个子显示时段DP1-DPn。多个子显示时段DP1-DPn的时间总和等于全部扫描线G1-Gn被加载一次扫描信号的总时长。也就是说,在其中任意一个子显示时段内,部分扫描线G1-Gn被扫描。相邻二子显示阶段之间***一子触控阶段TPx。在子触控阶段TPx时段内,所有扫描线G1-Gn不被扫描。在本实施方式中,子触控阶段TPx为***在部分相邻两个单位电路21输出的脉冲位移信号之间的空白区段。其中,在触控阶段TPx内,单位电路21第一控制端C1、第二控制端C2、设置端S、重置端R以及时钟控制信号输入端CK的电平均处于低电平。显示阶段DP进一步包括依时间先后顺序进行的预充电阶段P1、上拉阶段P2及下拉阶段P3。其中,在预充电阶段P1,输入模块22对输出晶体管T2控制端和第一节点N1进行预充电。在上拉阶段P2,输出模块22根据输入模块22输出的第一端电压和时钟控制信号输入端CK的时钟控制信号将输出端OUT上拉为高电平V1。在下拉阶段P3,重置模块24根据重置端R的信号将输出端OUT重置为低电平。
在本实施方式中,在第5级单位电路21和第6级单位电路21的输出脉冲位移信号之间***空白区段,即子触控阶段TP1***在6级单位电路21的预充电阶段P1和上拉阶段P2之间。可以理解地,其他子触控阶段TPx可***在任意两个相邻的单位电路21的输出脉冲位移信号之间。子触控阶段TP2可***第9级单位电路21和第10级单位电路21的输出脉冲位移信号之间,即子触控阶段TP2***在第10级单位电路21的预充电阶段P1和上拉阶段P2之间。
下面以第6级单位电路21为例,进行详细说明。
第6级单位电路21的第一控制端C1与时钟控制信号线VCK1电性连接,第二控制端C2与时钟控制信号线VCK3电性连接,时钟控制信号输入端CK与时钟控制信号线VCK2电性连接,设置端S接收第5级单位电路21输出的脉冲位移信号,重置端R接收第7级单位电路21输出的脉冲位移信号。
在第一控制端C1(即时钟控制信号线VCK1)和设置端S的信号处于高电平,且第二控制端C2(即时钟控制信号线VCK3)及重置端R的信号处于低电平时,第6级单位电路21处于在预充电阶段P1。输入晶体管T1导通,设置端S的电压对存储电容C充电,第一节点N1的电压上升。输出晶体管T2在第一节点N1的电压大于阈值电压时导通,使得输出端OUT输出与时钟控制信号输入端CK(即时钟控制信号线VCK2)同步的脉冲位移信号。由于时钟控制信号输入端CK的信号为低电平,输出端OUT输出低电平。
在子触控阶段TP1,第一控制端C1、第二控制端C2、设置端S、时钟控制信号输入端CK及重置端R的信号为低电平。输出晶体管T2维持导通。此时,第一节点N1的电压随着时间的有逐步降低的趋势,输出端OUT维持输出第二电压。
在第一控制端C1、第二控制端C2、设置端S及重置端R的信号为低电平,且时钟控制信号输入端CK的信号为高电平时,单位电路21处于上拉阶段P2。存储电容C放电以保持输出晶体管T2维持在导通状态。此时,上拉晶体管T6导通,使得输出端OUT保持在高电平V1。
在第一控制端C1和设置端S的信号为低电平,第二控制端C2及重置端R的信号为高电平时,单位电路21处于下拉阶段P3。第一晶体管T3和第二晶体管T4导通,使得第一节点N1下拉为第二电压,进而输出晶体管T2截止。下拉晶体管T5导通,使得输出端OUT输出第二电压。此时,存储电容C通过第一晶体管T3、第二晶体管T4及下拉晶体管T5放电。
综上所述,采用上述结构的触控显示装置1,在部分相邻两级单位电路21的输出脉冲位移信号之间***空白区段时通过保持模块25上拉处于下级输出的单位电路21的输出端OUT的输出脉冲位移信号为高电平V1,避免了***空白区段后下级输出的单位电路21的输出端OUT的输出脉冲位移信号小于高电平,避免了水平横线的产生,进而保证了触控显示装置1的稳定性。
本技术领域的普通技术人员应当认识到,以上的实施方式仅是用来说明本发明,而并非用作为对本发明的限定,只要在本发明的实质精神范围之内,对以上实施例所作的适当改变和变化都落在本发明要求保护的范围之内。
Claims (8)
1.一种移位寄存器,其能够产生将脉冲信号平移一预定相位的多个脉冲位移信号,包括:
多个级联连接的单位电路,每个所述单位电路接收外部提供的时钟控制信号,包括:
输出端,所述输出端与外部的至少一信号线电性连接,用于为相应连接的信号线提供脉冲位移信号,其中,第N+1级的所述单位电路的输出端向第N+1条信号线上输出的脉冲位移信号与第N级的所述单位电路的输出端向第N条信号线上输出的脉冲位移信号延迟所述预定相位,且存在空白区段***在任意相邻两个所述单位电路输出的所述脉冲位移信号之间;
输入晶体管,所述输入晶体管在第一控制信号的控制下,根据外部的用于表征当前级的所述单位电路开始工作的触发信号来向第一节点输出高电平;
输出晶体管,其包括与所述第一节点电性连接的第一控制端、接收所述时钟控制信号的第一连接端及与所述输出端电性连接的第二连接端,所述输出晶体管根据所述第一节点的高电平向所述输出端输出与所述时钟控制信号同步的脉冲位移信号;
上拉晶体管,其包括与所述输出端电性连接的第二控制端、与所述第二控制端电性连接的第一连接端及与高压电压源电性连接的所述第二连接端;
其中,在第N级的所述单位电路与所述第N+1级的所述单位电路***所述空白区段后,且第N+1级的所述单位电路开始输出所述脉冲位移信号期间,所述上拉晶体管将所述第N+1级的所述单位电路的所述输出端的脉冲位移信号上拉至高电平。
2.如权利要求1所述的移位寄存器,其特征在于:在所述空白区段,所有所述单位电路均停止输出脉冲位移信号。
3.如权利要求1所述的移位寄存器,其特征在于:所述单位电路还包括重置模块;所述重置模块接收外部提供的重置信号;所述重置模块包括下拉晶体管;所述下拉晶体管包括与接收所述重置信号的第三控制端、与所述输出端电性连接的第一连接端以及与低压电源电性连接的第二连接端;所述下拉晶体管根据外部用于表征当前级的所述单位电路重置的重置信号来向所述输出端输出低电平。
4.如权利要求3所述的移位寄存器,其特征在于:所述重置模块还接收外部提供的第二控制信号;所述重置模块还包括第一晶体管;所述第一晶体管包括接收所述第二控制信号的第四控制端、与所述第一节点电性连接的第二连接端及与所述低压电源电性连接的第二连接端;所述第一晶体管根据所述第二控制信号的高电平向所述第一节点输出低电平。
5.如权利要求4所述的移位寄存器,其特征在于:所述第一控制信号、所述时钟控制信号及所述第二控制信号来自三条相邻时钟线,三者之间依次延迟所述预定相位。
6.如权利要求3所述的移位寄存器,其特征在于:所述重置模块还包括第二晶体管;所述第二晶体管包括接收所述重置信号的第五控制端、与所述第一节点电性连接的第二连接端及与所述低压电源电性连接的第二连接端;所述第二晶体管根据所述重置信号的高电平向所述第一节点输出低电平。
7.一种触控显示装置,定义有显示区域和围绕显示区域设置的非显示区域;所述非显示区域内设置有至少一个栅极驱动器;所述至少一个栅极驱动器内包括至少一个移位寄存器;其特征在于:所述移位寄存器采用权利要求1-6项任意一项的移位寄存器。
8.如权利要求7所述的触控显示装置,其特征在于:所述触控显示装置交替工作在子触控阶段和子显示阶段;所述至少一个移位寄存器在相邻的所述子显示阶段分别输出二脉冲位移信号作为所述触控显示装置的薄膜晶体管阵列电路工作所需的扫描信号,所述子触控阶段***在任意两个相邻的所述子显示阶段之间;所述子触控阶段为所述空白区段。
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