CN110176929A - 一种用于短波双路同时接收***的双通道本振源模块 - Google Patents
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Abstract
本发明公开了一种用于短波双路同时接收***的双通道本振源模块，包括高精度恒温晶振、时钟缓冲电路、DDS模块、嵌入式控制器、放大/缓冲电路和混频器；所述高精度恒温晶振的输出信号经时钟缓冲电路后作为参考时钟输入至DDS模块；所述DDS模块在嵌入式控制器的控制下将参考时钟信号四倍频作为标准时钟，并产生双路本振输出信号；所述双路本振输出信号各经过一个放大/缓冲电路后分别输出至两个混频器。本发明实现了全双工的双通道本振输出方式，适配于短波双路同时接收***，实现双路短波信号同时接收解调，特别适用于宽带扫频快速建链装置。
Description
技术领域
本发明涉及频率信号源领域，特别涉及一种用于短波双路同时接收***的双通道本振源模块。
背景技术
直接数字频率合成(DDS)有着极快的频率切换速度、极高的频率分辨率、较低的相位噪声等优点，这些优点特别适合诸如扫描频率通信等要求频率快速变化和捕捉的应用场合。随着半导体工艺的发展，DDS技术已经较为成熟，一片DDS芯片已经不仅仅只是包含相位累加器、ROM查找表、DA转换等核心部分，同样集成了锁相电路、倍频电路作为时钟产生单元。
在宽带扫频快速建链装置中，需要两路短波接收***同时工作，故需要一种能够同时产生双路本振源信号的本振源模块。
发明内容
本发明的目的是提供一种用于短波双路同时接收***的双通道本振源模块，以满足短波双路同时接收***的工作需要。
实现本发明目的的技术方案是：一种用于短波双路同时接收***的双通道本振源模块，包括高精度恒温晶振、时钟缓冲电路、DDS模块、嵌入式控制器、放大/缓冲电路和混频器；所述高精度恒温晶振的输出信号经时钟缓冲电路后作为参考时钟输入至DDS模块；所述DDS模块在嵌入式控制器的控制下将参考时钟信号四倍频作为标准时钟，并产生双路本振输出信号；所述双路本振输出信号各经过一个放大/缓冲电路后分别输出至两个混频器。
所述高精度恒温晶振输出110.592MHz信号；所述DDS模块在嵌入式控制器的控制下将参考时钟信号四倍频至442.368MHz作为标准时钟。
所述DDS模块在嵌入式控制器的控制下通过内部倍频电路将参考时钟信号四倍频作为标准时钟。
所述DDS模块产生的双路本振输出信号的频率为72.055MHz～100.455MHz。
所述DDS模块采用AD99XX系列专用集成DDS芯片，或者由FPGA器件编程实现。
所述放大/缓冲电路包括电连接的固定增益放大器和LC带通滤波器。
所述LC带通滤波器的通带范围为70MHz～100.5MHz。
所述高精度恒温晶振、时钟缓冲电路、DDS模块、嵌入式控制器和放大/缓冲电路均单独供电。具体为：所述高精度恒温晶振、DDS模块、嵌入式控制器和放大/缓冲电路均采用独立的稳压芯片隔离供电，并且在PCB布局上对高精度恒温晶振、时钟缓冲电路、DDS模块、嵌入式控制器和放大/缓冲电路进行隔离，将数字地与模拟地分开。
采用了上述技术方案，本发明具有以下的有益效果：(1)本发明实现了全双工的双通道本振输出方式，适配于短波双路同时接收***，实现双路短波信号同时接收解调，特别适用于宽带扫频快速建链装置。
(2)本发明的DDS模块在嵌入式控制器的控制下通过内部倍频电路将参考时钟信号四倍频作为标准时钟，简化了电路设计方案，对整机小型化设计有着关键作用。
(3)本发明的放大/缓冲电路滤的LC带通滤波器能够滤除DDS模块的输出信号中的带内杂散频率信号并平滑幅值。
(4)本发明的LC带通滤波器的通带范围为70MHz～100.5MHz，符合本振源的频率输出要求。
(5)本发明的高精度恒温晶振、DDS模块、嵌入式控制器和放大/缓冲电路均采用独立的稳压芯片隔离供电，并且在PCB布局上对高精度恒温晶振、时钟缓冲电路、DDS模块、嵌入式控制器和放大/缓冲电路进行隔离，将数字地与模拟地分开，这种设计能够将DDS模块内部的相互干扰降到最低，同时提高本振源输出信号的相位噪声指标。
附图说明
为了使本发明的内容更容易被清楚地理解，下面根据具体实施例并结合附图，对本发明作进一步详细的说明，其中
图1为本发明的结构框图。
图2为本发明的放大/缓冲电路的电路连接图。
图3为本发明的DDS模块的电路连接图。
图4为本发明的混频器的电路连接图。
图5为本发明的嵌入式控制器的电路连接图。
附图中的标号为：
高精度恒温晶振1、时钟缓冲电路2、DDS模块3、嵌入式控制器4、放大/缓冲电路5、混频器6。
具体实施方式
(实施例1)
见图1，本实施例的双通道本振源模块用于短波双路同时接收***，包括高精度恒温晶振1、时钟缓冲电路2、DDS模块3、嵌入式控制器4、放大/缓冲电路5和混频器6。
高精度恒温晶振1输出110.592MHz信号经时钟缓冲电路2后作为参考时钟输入至DDS模块3。DDS模块3在嵌入式控制器4的控制下通过内部倍频电路将参考时钟信号四倍频至442.368MHz作为标准时钟，并产生频率为72.055MHz～100.455MHz的双路本振输出信号。双路本振输出信号各经过一个放大/缓冲电路5后，作为短波接收机双通道全双通的本振信号分别输出至两个混频器6。
DDS模块3通过内部倍频电路将参考时钟信号四倍频，简化了电路设计方案，对整机小型化设计有着关键作用。本实施例中的DDS模块3采用AD9958芯片，DDS模块3的电路连接图如图3所示。DDS模块3也可以由FPGA器件编程实现。
放大/缓冲电路5包括电连接的固定增益放大器和LC带通滤波器。LC带通滤波器能够滤除DDS模块3的输出信号中的带内杂散频率信号并平滑幅值。LC带通滤波器的通带范围为70MHz～100.5MHz，符合本振源的频率输出要求。放大/缓冲电路5的电路连接图如图2所示。
本实施例中的混频器6采用AD8342混频器，电路连接图如图4所示。
嵌入式控制器4采用ARM处理器，芯片型号为LPC1768，电路连接图如图5所示。
高精度恒温晶振1、DDS模块3、嵌入式控制器4和放大/缓冲电路5均单独供电，具体为：高精度恒温晶振1、DDS模块3、嵌入式控制器4和放大/缓冲电路5均采用独立的稳压芯片隔离供电，并且在PCB布局上对高精度恒温晶振1、时钟缓冲电路2、DDS模块3、嵌入式控制器4和放大/缓冲电路5进行隔离，将数字地与模拟地分开。
本实施例的双通道本振源模块实现了全双工的双通道本振输出方式，适配于短波双路同时接收***，实现双路短波信号同时接收解调，特别适用于宽带扫频快速建链装置。
以上所述的具体实施例，对本发明的目的、技术方案和有益效果进行了进一步详细说明，所应理解的是，以上所述仅为本发明的具体实施例而已，并不用于限制本发明，凡在本发明的精神和原则之内，所做的任何修改、等同替换、改进等，均应包含在本发明的保护范围之内。
Claims (9)
1.一种用于短波双路同时接收***的双通道本振源模块，其特征在于：包括高精度恒温晶振(1)、时钟缓冲电路(2)、DDS模块(3)、嵌入式控制器(4)、放大/缓冲电路(5)和混频器(6)；所述高精度恒温晶振(1)的输出信号经时钟缓冲电路(2)后作为参考时钟输入至DDS模块(3)；所述DDS模块(3)在嵌入式控制器(4)的控制下将参考时钟信号四倍频作为标准时钟，并产生双路本振输出信号；所述双路本振输出信号各经过一个放大/缓冲电路(5)后分别输出至两个混频器(6)。
2.根据权利要求1所述的一种用于短波双路同时接收***的双通道本振源模块，其特征在于：所述高精度恒温晶振(1)输出110.592MHz信号；所述DDS模块(3)在嵌入式控制器(4)的控制下将参考时钟信号四倍频至442.368MHz作为标准时钟。
3.根据权利要求1所述的一种用于短波双路同时接收***的双通道本振源模块，其特征在于：所述DDS模块(3)在嵌入式控制器(4)的控制下通过内部倍频电路将参考时钟信号四倍频作为标准时钟。
4.根据权利要求1所述的一种用于短波双路同时接收***的双通道本振源模块，其特征在于：所述DDS模块(3)产生的双路本振输出信号的频率为72.055MHz～100.455MHz。
5.根据权利要求1所述的一种用于短波双路同时接收***的双通道本振源模块，其特征在于：所述DDS模块(3)采用AD99XX系列专用集成DDS芯片，或者由FPGA器件编程实现。
6.根据权利要求1所述的一种用于短波双路同时接收***的双通道本振源模块，其特征在于：所述放大/缓冲电路(5)包括电连接的固定增益放大器和LC带通滤波器。
7.根据权利要求6所述的一种用于短波双路同时接收***的双通道本振源模块，其特征在于：所述LC带通滤波器的通带范围为70MHz～100.5MHz。
8.根据权利要求1所述的一种用于短波双路同时接收***的双通道本振源模块，其特征在于：所述高精度恒温晶振(1)、DDS模块(3)、嵌入式控制器(4)和放大/缓冲电路(5)均单独供电。
9.根据权利要求8所述的一种用于短波双路同时接收***的双通道本振源模块，其特征在于：所述高精度恒温晶振(1)、DDS模块(3)、嵌入式控制器(4)和放大/缓冲电路(5)均采用独立的稳压芯片隔离供电，并且在PCB布局上对高精度恒温晶振(1)、时钟缓冲电路(2)、DDS模块(3)、嵌入式控制器(4)和放大/缓冲电路(5)进行隔离，将数字地与模拟地分开。
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