CN107452337B - 定时控制器、包括该定时控制器的显示装置及其驱动方法 - Google Patents

定时控制器、包括该定时控制器的显示装置及其驱动方法 Download PDF

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Abstract

一种定时控制器、包括该定时控制器的显示装置及其驱动方法，尽管以多个帧频驱动，但简化了内部逻辑。在定时控制器中，输入信号处理器接收数据使能信号和帧频信息信号，当选择第一帧频时生成具有第一帧频的第一内部数据使能信号，当选择第二帧频时生成具有第二帧频的第二内部数据使能信号。选通控制信号输出单元基于第一内部数据使能信号生成并输出第一选通控制信号或基于第二内部数据使能信号生成并输出第二选通控制信号。数据控制信号输出单元基于第一内部数据使能信号生成并输出第一数据控制信号或基于第二内部数据使能信号生成并输出第二数据控制信号。第一内部数据使能信号的脉宽与第二内部数据使能信号的脉宽相同。

Description

定时控制器、包括该定时控制器的显示装置及其驱动方法
技术领域
本公开涉及定时控制器、包括该定时控制器的显示装置及其驱动方法。
背景技术
随着信息导向社会的进步，对用于显示图像的显示装置的各种要求正在增加。因此，最近正在使用诸如液晶显示器(LCD)设备、等离子体显示面板(PDP)设备、有机发光显示装置等的各种显示装置。
每个显示装置包括显示面板、选通驱动电路、数据驱动电路和定时控制器。
显示面板包括多条数据线、多条选通线和分别设置在通过数据线和选通线的交叉而限定的多个像素区域中的多个像素。当经由选通线提供选通信号时，经由数据线给像素提供数据电压。像素利用数据电压分别发出具有特定亮度的光。
定时控制器从外部***板接收视频数据和定时信号，并且生成用于控制选通驱动电路的操作定时的选通控制信号和用于基于定时信号控制数据驱动电路的操作定时的数据控制信号。定时控制器向选通驱动电路输出选通控制信号并且向数据驱动电路输出数据控制信号。
选通驱动电路根据选通控制信号生成选通信号并且将选通信号提供给选通线。数据驱动电路根据数据控制信号生成数据电压并且将数据电压提供给数据线。
以与输入帧频对应的帧频驱动定时控制器。例如，当以60Hz的帧频输入视频数据和定时信号时，基于在图1中示出的60Hz的数据使能信号来驱动定时控制器。当以120Hz的帧频输入视频数据和定时信号时，基于在图1中示出的120Hz的数据使能信号来驱动定时控制器。
近来，已经开发了以各种帧频驱动的显示装置。例如，已经开发了能够以60Hz的帧频和120Hz的帧频两者被驱动的显示装置。
但是，如图1所示，帧频是60Hz时的数据使能信号的脉宽W1与帧频是120Hz时的数据使能信号的脉宽W2不同。因此，当以60Hz的帧频驱动定时控制器时，定时控制器将内部时钟的脉宽调节为与以60Hz驱动的数据使能信号的脉宽同步。另外，当以120Hz的帧频驱动定时控制器时，定时控制器将内部时钟的脉宽调节为与以120Hz驱动的数据使能信号的脉宽同步。因此，60Hz信号处理块对60Hz的内部时钟进行计数，并且120Hz信号处理块对120Hz的内部时钟进行计数。因此，60Hz信号处理块对内部时钟的计数与120Hz信号处理块对内部时钟的计数不同。为此，定时控制器的内在逻辑的复杂性增加。
此外，当以多个帧频驱动定时控制器时，定时控制器可以包括处理60Hz的定时信号和视频数据的一个块以及处理120Hz的定时信号和视频数据的另一个块以降低内在逻辑的复杂性。但是，定时控制器的尺寸增大，导致显示装置的制造成本增加。
发明内容
因此，本公开致力于提供定时控制器、包括该定时控制器的显示装置及其驱动方法，该定时控制器基本上消除了由于现有技术的限制和缺点而导致的一个或更多个问题。
本公开的方面致力于提供定时控制器、包括该定时控制器的显示装置及其驱动方法，其中，尽管以多个帧频被驱动，但是简化了内部逻辑，另外，在不增大任何尺寸的情况下不增加制造成本。
本发明的其它优点和特征部分地将在以下的说明书中进行阐述，并且部分地对于本领域技术人员来说在研读以下内容后将变得显而易见，或可以通过实施本公开而知晓。本公开的目的和其它优点可以通过在本书面描述及其权利要求书及附图中具体指出的结构来实现和获得。
为了实现这些和其它优点并且根据本公开的目的，如本文具体表达和广泛描述地，提供了一种包括输入信号处理器、选通控制信号输出单元和数据控制信号输出单元的定时控制器。输入信号处理器接收数据使能信号和帧频信息信号，当基于所述帧频信息信号选择第一帧频时生成具有所述第一帧频的第一内部数据使能信号，并且当基于所述帧频信息信号选择第二帧频时生成具有所述第二帧频的第二内部数据使能信号。选通控制信号输出单元基于所述第一内部数据使能信号生成并输出第一选通控制信号或基于所述第二内部数据使能信号生成并输出第二选通控制信号。数据控制信号输出单元基于所述第一内部数据使能信号生成并输出第一数据控制信号或基于所述第二内部数据使能信号生成并输出第二数据控制信号。所述第一内部数据使能信号的脉宽与所述第二内部数据使能信号的脉宽相同。
在本公开的另一方面，提供了一种显示装置，该显示装置包括：显示面板，所述显示面板包括多条选通线、多条数据线和连接至所述多条选通线和所述多条数据线的多个像素；选通驱动器，所述选通驱动器被配置为分别向所述多条选通线输出选通信号；数据驱动器，所述数据驱动器被配置为分别向所述多条数据线输出数据电压；和定时控制器，所述定时控制器被配置为控制所述选通驱动器的操作定时和所述数据驱动器的操作定时。定时控制器包括输入信号处理器、选通控制信号输出单元和数据控制信号输出单元。输入信号处理器接收数据使能信号和帧频信息信号，当基于所述帧频信息信号选择第一帧频时生成具有所述第一帧频的第一内部数据使能信号，并且当基于所述帧频信息信号选择第二帧频时生成具有所述第二帧频的第二内部数据使能信号。选通控制信号输出单元基于所述第一内部数据使能信号生成并输出第一选通控制信号或基于所述第二内部数据使能信号生成并输出第二选通控制信号。数据控制信号输出单元基于所述第一内部数据使能信号生成并输出第一数据控制信号或基于所述第二内部数据使能信号生成并输出第二数据控制信号。所述第一内部数据使能信号的脉宽与所述第二内部数据使能信号的脉宽相同。
在本公开的另一方面，提供了一种驱动显示装置的方法，该方法包括以下步骤：从存储器接收第一帧频数据和第二帧频数据，并且从外部***板接收图像数据和帧频信息信号；当基于所述帧频信息信号选择第一帧频时，根据所述第一帧频数据生成具有所述第一帧频的第一内部数据使能信号，并且当基于所述帧频信息信号选择第二帧频时，根据所述第二帧频数据生成具有第二帧频的第二内部数据使能信号；基于所述第一内部数据使能信号生成第一选通控制信号以向选通驱动器输出所述第一选通控制信号，或基于所述第二内部数据使能信号生成第二选通控制信号以向所述选通驱动器输出所述第二选通控制信号；以及基于所述第一内部数据使能信号生成第一数据控制信号以向数据驱动器输出所述第一数据控制信号，或基于所述第二内部数据使能信号生成第二数据控制信号以向所述数据驱动器输出所述第二数据控制信号。所述第一内部数据使能信号的脉宽与所述第二内部数据使能信号的脉宽相同。
将理解的是，对本公开的以上概述和以下详述都是示例性和说明性的，并旨在对所要求保护的本公开提供进一步的解释。
附图说明
附图被包括进来以提供对本公开的进一步理解，并结合到本申请中且构成本申请的一部分，附图例示了本公开的实施方式，并与说明书一起用于解释本公开的原理。在附图中：
图1是示出以60Hz的帧频输入的数据使能信号和以120Hz的帧频输入的数据使能信号的波形图；
图2是例示根据本公开的实施方式的显示装置的图；
图3是例示根据本公开的实施方式的显示装置的下基板、源驱动集成电路(IC)、定时控制器、存储器、源柔性膜、源电路板和控制电路板的图；
图4是例示图2的像素的图；
图5是详细例示图2的定时控制器的框图；
图6是详细例示驱动根据本公开的实施方式的定时控制器的方法的流程图；
图7是示出由定时控制器生成的第一内部数据使能信号、第一垂直同步信号、第一水平同步信号和第一图像数据的波形图；以及
图8是示出由定时控制器生成的第二内部数据使能信号、第二垂直同步信号、第二水平同步信号和第二图像数据的波形图。
具体实施方式
现在将详细参照本公开的示例性实施方式，在附图中例示了本公开的示例性实施方式的示例。只要可能，在所有附图中将使用相同的附图标记表示相同或相似的部件。
将参照附图通过下面的实施方式来阐述本公开的优点和特征及其实施方法。但是，本发明可以实现为不同形式，并且不应被解释为限于本文提出的实施方式。更确切地说，提供这些实施方式使得本公开将充分且完整，并将向本领域技术人员全面传达本公开的范围。另外，本公开仅由权利要求的范围限定。
在附图中公开的用于描述本公开的实施方式的形状、尺寸、比例、角度和数量仅是示例，并且因此，本公开不限于图示的细节。贯穿全文，相同的附图标记指示相同的元件。在下面的说明中，当确定相关的已知功能或构造的详细说明不必要地使本公开的要点不清楚时，将省略该详细说明。
在使用本说明书中描述的“包括”、“具有”和“包含”的情况下，除非使用“仅”，否则可以添加另一部件。除非另有相反说明，否则单数形式的术语可以包括复数形式。
在解释元件时，虽然没有明确说明，但是元件被解释为包括误差范围。
在描述位置关系时，例如，当两部件之间的位置关系被描述为“在......上”、“在......上方”、“在......下”和“挨着”时，除非使用了“仅”或“直接”，否则可以在两个部件之间布置一个或更多个部件。
在描述时间关系时，例如，当时间顺序被描述为“之后”、“然后”、“接下来”和“之前”时，除非使用“仅”或“就”，否则可以包括不连续的情况。
将理解的是，虽然本文可以使用术语“第一”、“第二”等来描述各元件，但是这些元件不应被这些术语限制。这些术语仅用于将一个元件与另一元件区分开。例如，在不脱离本公开的范围的情况下，第一元件可以被称为第二元件，并且类似地，第二元件可以被称为第一元件。
X轴方向、Y轴方向和Z轴方向不应当被解释为它们之间的垂直关系的几何关系，并且在本公开的元件功能地操作的范围内可以表示具有更广泛的方向性。
术语“至少一个”应被理解为包括相关列出项目的一个或更多个的任意和所有组合。例如，“第一项目、第二项目和第三项目中的至少一个”表示从第一项目、第二项目和第三项目中的两个或者更多个提出的全部项目的组合以及第一项目、第二项目或者第三项目。
如本领域技术人员能充分理解的那样，本公开的各实施方式的特征可以部分地或整体地彼此联接或结合，并且可以不同地彼此交互操作且技术上被驱动。可以彼此独立地执行本公开的实施方式，或以互相依赖的关系一起执行本公开的实施方式。
在下文中，将参照附图详细描述本公开的示例实施方式。
图2是例示根据本公开的实施方式的显示装置的图。图3是例示根据本公开的实施方式的显示装置的下基板、源驱动集成电路(IC)、定时控制器、存储器、源柔性膜、源电路板和控制电路板的图。
根据本公开的实施方式的显示装置的示例可以包括经由供给选通信号的线扫描操作向多条选通线G1至Gn提供数据电压的所有显示装置。例如，根据本公开的实施方式的显示装置可以实现为液晶显示(LCD)设备、有机发光显示装置、场发射显示装置和电泳显示装置中的一种。在下文中，将描述根据本公开的实施方式的显示装置被实现为有机发光显示装置的示例，但是不限于此。
参照图2和图3，根据本公开的实施方式的显示装置可以包括显示面板10、数据驱动器20、选通驱动器30、定时控制器40、存储器50、源柔性膜60、源电路板70、控制电路板80和柔性电缆90。
显示面板10可以包括上基板和下基板。可以在下基板上设置包括多条数据线D1至Dm(其中，m是等于或大于2的整数)和多条选通线G1至Gn(其中，n是等于或大于2的整数)以及多个像素P的显示区域DA。数据线D1至Dm可以设置为与选通线G1至Gn交叉。另外，可以在下基板上设置与选通线G1至Gn平行的多条初始线，并且可以在下基板上设置于数据线D1至Dm平行的多条基准电压线。每个像素P可以连接至数据线D1至Dm中的一条对应的数据线、选通线G1至Gn中的一条对应的选通线、初始线中的一条对应的初始线和基准电压线中的一条对应的基准电压线。
如图4中的每个像素P可以包括有机发光二极管OLED/驱动晶体管DT、第一晶体管ST1和第二晶体管ST2、电容器C。将参照图4详细描述每个像素P。
选通驱动器30可以连接至选通线G1至Gn，并且可以分别向选通线G1至Gn提供选通信号。具体地，选通驱动器30可以接收具有第一帧频的第一选通控制信号GCS1和具有第二帧频的第二选通控制信号GCS2。选通驱动器30可以根据第一选通控制信号GCS1生成具有第一帧频的选通信号以向选通线G1至Gn提供生成的选通信号。或，选通驱动器30可以根据第二选通控制信号GCS2生成具有第二帧频的选通信号以向选通线G1至Gn提供生成的选通信号。
选通驱动器30可以以面板中选通驱动器(GIP)类型设置在非显示区域NDA中。在图2中，选通驱动器30被例示为设置在显示区域DA的一侧外，但是不限于此。例如，选通驱动器30可以设置在显示区域DA的两侧外。显示面板10可以被划分为显示区域DA和非显示区域NDA。显示区域DA可以是设置显示图像的像素P的区域。非显示区域NDA可以是靠近显示区域DA设置并且不显示图像的区域。
另选地，选通驱动器30可以包括多个选通驱动IC，并且选通驱动IC可以分别安装在选通柔性膜上。各选通柔性膜可以是载带封装或膜上芯片。选通柔性膜可以通过使用各向异性导电膜以带式自动焊接(TAB)类型附接在显示面板10的非显示区域NDA上，并且因此，选通驱动IC可以连接至选通线G1至Gn。
数据驱动器20可以连接至数据线D1至Dm。数据驱动器20可以接收第一图像数据DATA1或第二图像数据DATA2以及第一数据控制信号DCS1或第二数据控制信号DCS2。数据驱动器20可以根据第一数据控制信号DCS1将第一图像数据DATA1转换成模拟数据电压。另选地，数据驱动器20可以根据第二数据控制信号DCS2将第二图像数据DATA2转换成模拟数据电压。数据驱动器20可以分别向数据线D1到Dm提供模拟数据电压。
数据驱动器20可以包括至少一个源驱动IC 21。每一个源驱动IC 21可以制造为驱动芯片。源驱动IC 21可以分别安装在源柔性膜60上。每个源柔性膜60可以实现为载带封装或膜上芯片并且可以弯折或弯曲。源柔性膜60可以通过使用各向异性导电膜以TAB类型附接在显示面板10的非显示区域NDA上，并且因此，源驱动IC 21可以连接至数据线D1至Dm。
此外，源柔性膜60可以附接在源电路板70上。源电路板70可以是能够弯折或弯曲的柔性印刷电路板(FPCB)。
定时控制器40可以从外部***板(未示出)接收图像数据DATA、定时信号TS和帧频信息信号FIS。定时信号可以包括垂直同步信号、水平同步信号和外部数据使能信号。另外，定时控制器40可以从存储器50接收多条帧频数据FPD。
定时控制器40可以根据帧频信息信号FIS从多个帧频选择驱动显示面板10的帧频。定时控制器40可以基于与选择的帧频对应的帧频数据FPD根据所选帧频生成内部数据使能信号。然后，定时控制器40可以生成用于控制选通驱动器30的操作定时的第一选通控制信号GCS1或第二选通控制信号GCS2以及用于基于生成的内部数据使能信号来控制数据驱动器20的操作定时的第一数据控制信号DCS1或第二数据控制信号DCS2。
此外，定时控制器40可以将图像数据DATA转换成与内部数据使能信号同步的第一图像数据DATA1或第二图像数据DATA2。定时控制器40可以向数据驱动器提供第一图像数据DATA1或第二图像数据DATA2以及第一数据控制信号DCS1或第二数据控制信号DCS2。定时控制器40可以向选通驱动器提供第一数据控制信号DCS1或第二数据控制信号DCS2。
将参照图5至图8详细描述定时控制器40。
存储器50可以存储多条帧频数据FPD，例如第一帧频数据和第二帧频数据。因此，第一帧频数据可以是用于生成具有第一频率的内部数据使能信号的驱动定时数据，并且第二帧频数据可以是用于生成具有第二频率的内部数据使能信号的驱动定时数据。当显示装置被接通时，存储器50通过使用串行时钟(SCL)信号和串行数据(SDA)信号来执行与定时控制器40的I2C通信以向定时控制器40发送多条帧频数据FPD。存储器50可以是电可擦除可编程只读存储器(EEPROM)。
如图3所示，定时控制器40和存储器50可以安装在控制电路板80上。源电路板70和控制电路板80可以经由诸如柔性扁平电缆(FFC)或柔性印刷电路板(FPC)的柔性电缆90彼此连接。控制电路板80可以是能够弯折或弯曲的FPCB。
图4是例示图2的像素的图。在图4中，为了便于描述，只例示了连接至第j数据线Dj的像素P(其中，j是满足1≤j≤m的整数)、第q基准电压线Rq(其中，q是满足1≤q≤p的整数)和第k选通线Gk和第k初始线SEk(其中，k是满足1≤k≤n的整数)。
参照图4，像素P可以包括有机发光二极管OLED、驱动晶体管DT、多个开关晶体管以及电容器C。多个开关晶体管可以包括第一晶体管ST1和第二晶体管ST2。
有机发光二极管OLED可以利用经由驱动晶体管DT提供的电流发光。有机发光二极管OLED的阳极可以联接至驱动晶体管DT的源极，并且阴极可以联接至提供第一源极电压的第一源极电压线VSSL。第一源极电压线VSSL可以是提供低电平源极电压的低电平电压线。
有机发光二极管OLED可以包括阳极、空穴传输层、有机发光层、电子传输层和阴极。在有机发光二极管OLED中，当向阳极和阴极施加电压时，空穴和电子可以经由空穴传输层和电子传输层分别移动至有机发光层并且可以在有机发光层中彼此结合以发光。
驱动晶体管DT可以布置在有机发光二极管OLED和提供第二源极电压的第二源极电压线VDDL之间。驱动晶体管DT可以根据栅极和源极之间的电压差控制从第二源极电压线VDDL流至有机发光二极管OLED的电流。驱动晶体管DT的栅极可以联接至第一晶体管ST1的第一电极，源极可以联接至有机发光二极管OLED的阳极，并且漏极可以联接至第二源极电压线VDDL。第二源极电压线VDDL可以是提供高电平源极电压的高电平电压线。
第一晶体管ST1可以通过第k选通线Gk的第k选通信号接通，并且向驱动晶体管DT的栅极提供第j数据线Dj的电压。第一晶体管ST1的栅极可以联接至第k选通线Gk，第一电极可以联接至驱动晶体管DT的栅极，并且第二电极可以联接至第j数据线Dj。
第二晶体管ST2可以通过第k初始线SEk的第k初始信号接通，并且可以将第q基准电压线Rq连接至驱动晶体管DT的源极。第二晶体管ST2的栅极可以联接至第k初始线SEk，第一电极可以联接至第q基准电压线Rq，并且第二电极可以联接至驱动晶体管DT的源极。
第一晶体管ST1和第二晶体管ST2中的每一个的第一电极可以是源极，并且第二电极可以是漏极。然而，本实施方式不限于此。在其它实施方式中，第一晶体管ST1和第二晶体管ST2中的每一个的第一电极可以是漏极，并且第二电极可以是源极。
电容器C可以设置在驱动晶体管DT的栅极与源极之间。电容器C可以存储在驱动晶体管DT的栅极电压与源极电压之间的差动电压。
在图4中，将驱动晶体管DT的第一晶体管ST1和第二晶体管ST2描述为被设置成N型金属氧化物半导体场效应晶体管(MOSFET)，但是不限于此。在其它实施方式中，驱动晶体管DT的第一晶体管ST1和第二晶体管ST2可以被设置为T型MOSFET。
图5是详细例示图2的定时控制器的框图。图6是详细例示驱动根据本公开的实施方式的定时控制器的方法的流程图。
参照图5，定时控制器40可以包括输入信号处理器41、数据控制信号输出单元42、选通控制信号输出单元43和内部时钟生成器44。输入信号处理器41可以处理从外部***板输入的定时信号TS和图像数据DATA以便匹配显示装置并且可以向数据控制信号输出单元42和选通控制信号输出单元43输出经处理的定时信号TS和图像数据DATA。数据控制信号处理单元42可以基于来自输入信号处理器41的定时信号TS生成并输出数据控制信号。选通控制信号输出单元43可以基于来自输入信号处理器41的定时信号TS生成并输出选通控制信号。内部时钟生成器44可以包括振荡器。内部时钟生成器44可以生成具有特定频率的内部时钟ICLK并且可以向输入信号处理器41、数据控制信号输出单元42和选通控制信号输出单元43输出内部时钟ICLK。输入信号处理器41、数据控制信号输出单元42和选通控制信号输出单元43可以对内部时钟进行计数以生成信号。
在下文中，参照图5和图6描述驱动根据本公开的实施方式的定时控制器40的方法。
首先，在图6的步骤S101，输入信号处理器41可以从外部***板接收图像数据DATA、定时信号TS和帧频信息信号FIS。另外，定时控制器40可以从存储器50接收多条帧频数据FPD1和FPD2。
图像数据DATA可以是包括关于图像的灰度信息的数字数据。如果图像数据DATA是8位数字数据，则可以以256个灰度表示图像数据DATA。
定时信号TS可以包括垂直同步信号、水平同步信号和数据使能信号。垂直同步信号可以是指定一个帧周期的信号。水平同步信号可以是指定一个水平周期的信号。数据使能信号可以是指示输入有效图像数据DATA的时段的信号。
帧频信息信号FIS可以是指示输入至定时控制器40的定时信号TS和图像数据DATA中的每一个的帧频的信号。例如，如果帧频信息信号FIS具有第一逻辑电平电压，则可以以第一帧频输入图像数据DATA和定时信号TS。另外，如果帧频信息信号FIS具有第二逻辑电平电压，则可以以第二帧频输入图像数据DATA和定时信号TS。第一帧频可以低于第二帧频。例如，在本公开的实施方式中，第一帧频被描述为60Hz，并且第二帧频被描述为120Hz。然而，本实施方式不限于此。
第一帧频数据FPD1可以是用于生成具有第一帧频的内部数据使能信号的驱动定时的数据，并且第二帧频数据FPD2可以是用于生成具有第二帧频的内部数据使能信号的驱动定时的数据。
第二，在图6的步骤S102，输入信号处理器41可以基于帧频信息信号FIS确定要驱动显示面板10的帧频。例如，如果帧频信息信号FIS指示第一帧频，则输入信号处理器41可以以第一帧频驱动显示面板10。另外，如果帧频信息信号FIS指示第二帧频，则输入信号处理器41可以以第二帧频驱动显示面板10。
第三，在图6的步骤S103，确定帧频是否为第一帧频。当帧频被确定为第一帧频时，在图6的步骤104，输入信号处理器41可以基于第一帧频数据FPD1生成具有第一帧频的第一内部数据使能信号IDE1。当帧频被确定为第二帧频时，在图6的步骤105，输入信号处理器41可以基于第二帧频数据FPD2生成具有第二帧频的第二内部数据使能信号IDE2。
即使如图7和图8所示，第一内部数据使能信号IDE1被激活为第一帧频并且第二内部数据使能信号IDE2被激活为第二帧频，第一内部数据使能信号IDE1的脉宽W3也可以被生成为基本与具有第二帧频的第二内部数据使能信号IDE2的脉宽W4相同的脉宽。因此，即使当第一内部数据使能信号IDE1和从***板输入的数据使能信号被激活为相同的频率，在图7中示出的第一内部数据使能信号IDE1的脉宽W3也可以比从如图1的***板输入的数据使能信号的脉宽W1窄。
因此，在本公开的实施方式中，可以通过使用具有相同脉宽的第一内部数据使能信号IDE1和第二内部数据使能信号IDE2来处理输入信号，因此，不需要数据控制信号输出单元和与输入信号处理器相邻地布置的选通控制信号输出单元根据帧频调节对内部时钟ICLK的计数。也就是说，数据控制信号输出单元和选通控制信号输出单元可以通过仅使用内部时钟ICLK来处理输入的信号。因此，在本公开的实施方式中，虽然以多个帧频驱动显示装置，但是简化了内部逻辑。
此外，在本公开的实施方式中，由于简化了内部逻辑，因此不需要根据帧频来区分处理图像数据DATA和定时信号TS的块。因此，在本公开的实施方式中，虽然以多个帧频驱动显示装置，但是在不增加任何尺寸的情况下不增加成本。
第四，在图6的步骤106，输入信号处理器41可以将图像数据DATA转换成与第一内部数据使能信号IDE1同步的第一图像数据DATA1，或可以将图像数据DATA转换成与第二内部数据使能信号IDE2同步的第二图像数据DATA2。
具体地，当帧频被确定为第一帧频时，输入信号处理器41可以基于如图7中的第一内部数据使能信号IDE1的脉宽输出经由转换获得的第一图像数据DATA1。例如，可以与第一内部数据使能信号IDE1的脉冲同步地输出第一图像数据DATA1并且在水平空白期hb1不输出第一图像数据DATA1。
此外，当帧频被确定为第二帧频时，输入信号处理器41可以基于如图8中的第二内部数据使能信号IDE2的脉宽输出经由转换获得的第二图像数据DATA2。例如，可以与第二内部数据使能信号IDE2的脉冲同步地输出第二图像数据DATA2并且在水平空白期hb2不输出第二图像数据DATA2。
第五，在图6的步骤107，输入信号处理器41可以生成第一水平同步信号Hsync1和与第一内部数据使能信号IDE1同步的第一垂直同步信号Vsync1。为此，第一水平同步信号Hsync1的脉宽可以被调节为与第一内部数据使能信号IDE1同步。因此，即使如图7所示第一水平同步信号Hsync1和从***板输入的水平同步信号被激活成相同的频率，第一水平同步信号Hsync1的脉宽也可以比从***板输入的水平同步信号的脉宽窄。
输入信号处理器41可以生成第二水平同步信号Hsync2和与第二内部数据使能信号IDE2同步的第二垂直同步信号Vsync2。为此，第二水平同步信号Hsync2的脉宽可以被调节为与第二内部数据使能信号IDE2同步。
第六，在图6的步骤108，当帧频被确定为第一帧频时，输入信号处理器41可以向数据控制信号输出单元42输出第一内部数据使能信号IDE1、第一水平同步信号Hsync1、第一垂直同步信号Vsync1和第一图像数据DATA1。因此，数据控制信号输出单元42可以基于第一内部数据使能信号IDE1、第一水平同步信号Hsync1、第一垂直同步信号Vsync1和第一图像数据DATA1生成并输出具有用于控制数据驱动器20的第一帧频的第一数据控制信号DCS1。
此外，当帧频被确定为第一帧频时，输入信号处理器41可以向选通控制信号输出单元43输出第一内部数据使能信号IDE1、第一水平同步信号Hsync1、第一垂直同步信号Vsync1。因此，选通控制信号输出单元43可以基于第一内部数据使能信号IDE1、第一水平同步信号Hsync1和第一垂直同步信号Vsync1生成并输出用于控制选通驱动器30的具有第一帧频的第一选通控制信号GCS1。
当帧频被确定为第二帧频时，输入信号处理器41可以向数据控制信号输出单元42输出第二内部数据使能信号IDE2、第二水平同步信号Hsync2、第二垂直同步信号Vsync2和第二图像数据DATA2。因此，数据控制信号输出单元42可以基于第二内部数据使能信号IDE2、第二水平同步信号Hsync2、第二垂直同步信号Vsync2和第二图像数据DATA2生成并输出用于控制数据驱动器20的具有第二帧频的第二数据控制信号DCS2。
此外，当帧频被确定为第二帧频时，输入信号处理器41可以向选通控制信号输出单元43输出第二内部数据使能信号IDE2、第二水平同步信号Hsync2和第二垂直同步信号Vsync2。因此，选通控制信号输出单元43可以基于第二内部数据使能信号IDE2、第二水平同步信号Hsync2和第二垂直同步信号Vsync2生成并输出用于控制选通驱动器30的具有第二帧频的第二选通控制信号GCS2。
如上所述，在本公开的实施方式中，数据使能信号的脉宽在多个帧频中可以是常数.也就是说，在本公开的实施方式中，在第一帧频中，第一内部数据使能信号的脉宽可以与第二内部数据使能信号的脉宽相同。因此，在本公开的实施方式中，不需要数据控制信号输出单元和与输入信号处理器相邻地布置的选通控制信号输出单元根据帧频对内部时钟ICLK的计数进行调节。也就是说，数据控制信号输出单元和选通控制信号输出单元可以通过仅使用内部时钟ICLK来处理输入的信号。因此，在本公开的实施方式中，虽然以多个帧频驱动显示装置，但是简化了内部逻辑。
此外，在本公开的实施方式中，由于简化了内部逻辑，因此不需要根据帧频来区分处理图像数据DATA和定时信号TS的块。因此，在本公开的实施方式中，虽然以多个帧频驱动显示装置，但是在不增加任何尺寸的情况下不增加成本。
图7是示出由定时控制器生成的第一内部数据使能信号、第一垂直同步信号、第一水平同步信号和第一图像数据的波形图。图8是示出由定时控制器生成的第二内部数据使能信号、第二垂直同步信号、第二水平同步信号和第二图像数据的波形图。
在图7中，第一内部数据使能信号、第一垂直同步信号、第一水平同步信号和第一图像数据被示出为具有作为第一帧频的示例的60Hz的帧频。在图8中，第二内部数据使能信号、第二垂直同步信号、第二水平同步信号和第二图像数据被示出为具有作为第二帧频的示例的120Hz的帧频。
如图7所示，在60Hz的帧频中，一个帧周期是约16.67ms。如图7所示，在120Hz的帧频中，一个帧周期是约8.33ms。
一个帧周期可以包括提供图像数据的激活时段ACT和作为空闲时段的垂直消隐时段VBI。在垂直消隐时段VBI期间，可以不输出第一内部数据使能信号IDE1和第二内部数据使能信号IDE2以及图像数据。
参照图7和图8，第一内部数据使能信号IDE1的帧频与第二数据使能信号IDE2的帧频不同，并且因此第一内部数据使能信号IDE1的脉宽W3与第二内部数据使能信号IDE2的脉宽W4基本相同。另外，由于第一内部数据使能信号IDE1的帧频低于第二数据使能信号IDE2的帧频，因此第一内部数据使能信号IDE1的水平消隐时段hb1比第二内部数据使能信号IDE2的水平消隐时段hb2长。
如图7所示，第一水平同步信号Hsync1指示一个水平周期，并且因此具有与一个水平周期对应的周期。第一内部数据使能信号IDE1也具有与一个水平周期对应的周期，并且因此第一水平同步信号Hsync1的周期与第一内部数据使能信号IDE1的周期基本相同。
如图8所示，第二水平同步信号Hsync2指示一个水平周期，并且因此具有与一个水平周期对应的周期。第二内部数据使能信号IDE2也具有与一个水平周期对应的周期，并且因此第二水平同步信号Hsync2的周期与第二内部数据使能信号IDE2的周期基本相同。
可以与第一内部数据使能信号IDE1的脉冲同步地输出第一图像数据DATA1。因此，可以在第一内部数据使能信号IDE1的水平消隐时段hb1期间不输出第一图像数据DATA1。
可以与第二内部数据使能信号IDE2的脉冲同步地输出第二图像数据DATA2。因此，可以在第二内部数据使能信号IDE2的水平消隐时段hb2期间不输出第二图像数据DATA2。
如上所述，在本公开的实施方式中，数据使能信号的脉宽在多个帧频中可以是常数。也就是说，在本公开的实施方式中，在第一帧频中，第一内部数据使能信号的脉宽可以与第二内部数据使能信号的脉宽相同。因此，在本公开的实施方式中，不需要数据控制信号输出单元和与输入信号处理器相邻地布置的选通控制信号输出单元根据帧频对内部时钟ICLK的计数进行调节。也就是说，数据控制信号输出单元和选通控制信号输出单元可以通过仅使用内部时钟ICLK来处理输入的信号。因此，在本公开的实施方式中，虽然以多个帧频驱动显示装置，但是简化了内部逻辑。
此外，在本公开的实施方式中，由于简化了内部逻辑，因此不需要根据帧频来区分处理图像数据DATA和定时信号TS的块。因此，在本公开的实施方式中，虽然以多个帧频驱动显示装置，但是在不增加任何尺寸的情况下不增加成本。
对本领域技术人员将显而易见的是，在不脱离本公开的精神或范围的情况下，可以对本公开进行各种修改和改变。因此，本公开旨在涵盖本公开的落入所附权利要求及其等同物范围内的修改和改变。
相关申请的交叉引用
本申请要求于2016年5月31日提交的韩国专利申请No.10-2016-0067206的优先权，该专利申请以引用方式并入本文，如同在本文中进行完全阐述。

Claims (15)

1.一种定时控制器，该定时控制器包括：
输入信号处理器，所述输入信号处理器被配置为接收外部数据使能信号和帧频信息信号，当基于所述帧频信息信号选择第一帧频时生成具有所述第一帧频的第一内部数据使能信号，并且当基于所述帧频信息信号选择第二帧频时生成具有所述第二帧频的第二内部数据使能信号；
选通控制信号输出单元，所述选通控制信号输出单元被配置为基于所述第一内部数据使能信号生成并输出第一选通控制信号或基于所述第二内部数据使能信号生成并输出第二选通控制信号；和
数据控制信号输出单元，所述数据控制信号输出单元被配置为基于所述第一内部数据使能信号生成并输出第一数据控制信号或基于所述第二内部数据使能信号生成并输出第二数据控制信号，
其中，所述第一内部数据使能信号的脉宽与所述第二内部数据使能信号的脉宽相同，
其中，所述第一帧频不同于所述第二帧频。
2.根据权利要求1所述的定时控制器，其中，当所述第一帧频低于所述第二帧频时，所述第一内部数据使能信号的水平消隐时段比所述第二内部数据使能信号的水平消隐时段长。
3.根据权利要求1所述的定时控制器，其中，所述外部数据使能信号的脉宽与所述第一内部数据使能信号的脉宽不同。
4.根据权利要求1所述的定时控制器，其中，所述输入信号处理器接收图像数据并且将所述图像数据转换成与所述第一内部数据使能信号同步的第一图像数据或将所述图像数据转换成与所述第二内部数据使能信号同步的第二图像数据。
5.根据权利要求4所述的定时控制器，其中，
所述输入信号处理器与所述第一内部数据使能信号的脉冲同步地输出所述第一图像数据并且在所述第一内部数据使能信号的水平消隐时段期间不输出所述第一图像数据，并且
所述输入信号处理器与所述第二内部数据使能信号的脉冲同步地输出所述第二图像数据并且在所述第二内部数据使能信号的水平消隐时段期间不输出所述第二图像数据。
6.根据权利要求4所述的定时控制器，其中，所述数据控制信号输出单元输出所述第一数据控制信号与所述第一图像数据，并且输出所述第二数据控制信号与所述第二图像数据。
7.根据权利要求4所述的定时控制器，其中，
当选择所述第一帧频时，所述输入信号处理器基于所述第一内部数据使能信号生成具有所述第一帧频的第一垂直同步信号和第一水平同步信号，并且
当选择所述第二帧频时，所述输入信号处理器基于所述第二内部数据使能信号生成具有所述第二帧频的第二垂直同步信号和第二水平同步信号。
8.一种显示装置，该显示装置包括：
显示面板，所述显示面板包括多条选通线、多条数据线和连接至所述多条选通线和所述多条数据线的多个像素；
选通驱动器，所述选通驱动器被配置为向所述多条选通线输出选通信号；
数据驱动器，所述数据驱动器被配置为向所述多条数据线输出数据电压；和
根据权利要求1-7中的任一项所述的定时控制器，所述定时控制器被配置为控制所述选通驱动器的操作定时和所述数据驱动器的操作定时。
9.一种驱动显示装置的方法，该方法包括以下步骤：
从存储器接收第一帧频数据和第二帧频数据，并且从外部***板接收外部数据使能信号、图像数据和帧频信息信号；
当基于所述帧频信息信号选择第一帧频时，根据所述第一帧频数据生成具有所述第一帧频的第一内部数据使能信号，并且当基于所述帧频信息信号选择第二帧频时，根据所述第二帧频数据生成具有所述第二帧频的第二内部数据使能信号；
基于所述第一内部数据使能信号生成第一选通控制信号以向选通驱动器输出所述第一选通控制信号，或基于所述第二内部数据使能信号生成第二选通控制信号以向所述选通驱动器输出所述第二选通控制信号；以及
基于所述第一内部数据使能信号生成第一数据控制信号以向数据驱动器输出所述第一数据控制信号，或基于所述第二内部数据使能信号生成第二数据控制信号以向所述数据驱动器输出所述第二数据控制信号，
其中，所述第一内部数据使能信号的脉宽与所述第二内部数据使能信号的脉宽相同，
其中，所述第一帧频不同于所述第二帧频。
10.根据权利要求9所述的方法，其中，当所述第一帧频低于所述第二帧频时，所述第一内部数据使能信号的水平消隐时段比所述第二内部数据使能信号的水平消隐时段长。
11.根据权利要求9所述的方法，其中，所述外部数据使能信号的脉宽与所述第一内部数据使能信号的脉宽不同。
12.根据权利要求9所述的方法，该方法还包括以下步骤：将所述图像数据转换成与所述第一内部数据使能信号同步的第一图像数据或将所述图像数据转换成与所述第二内部数据使能信号同步的第二图像数据。
13.根据权利要求12所述的方法，其中，
与所述第一内部数据使能信号的脉冲同步地输出所述第一图像数据并且在所述第一内部数据使能信号的水平消隐时段期间不输出所述第一图像数据，并且
与所述第二内部数据使能信号的脉冲同步地输出所述第二图像数据并且在所述第二内部数据使能信号的水平消隐时段期间不输出所述第二图像数据。
14.根据权利要求12所述的方法，其中，生成所述第一数据控制信号或所述第二数据控制信号的步骤包括以下步骤：输出所述第一数据控制信号与所述第一图像数据或输出所述第二数据控制信号与所述第二图像数据。
15.根据权利要求12所述的方法，该方法还包括以下步骤：
当选择所述第一帧频时，基于所述第一内部数据使能信号生成具有所述第一帧频的第一垂直同步信号和第一水平同步信号，并且
当选择所述第二帧频时，基于所述第二内部数据使能信号生成具有所述第二帧频的第二垂直同步信号和第二水平同步信号。
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