CN106650111B - 一种基于时序依赖关系的时钟综合结果评价方法 - Google Patents

一种基于时序依赖关系的时钟综合结果评价方法 Download PDF

Info

Publication number
CN106650111B
CN106650111B CN201611217629.7A CN201611217629A CN106650111B CN 106650111 B CN106650111 B CN 106650111B CN 201611217629 A CN201611217629 A CN 201611217629A CN 106650111 B CN106650111 B CN 106650111B
Authority
CN
China
Prior art keywords
clock
cluster
dependency relationship
clock synchronization
evaluating
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Active
Application number
CN201611217629.7A
Other languages
English (en)
Other versions
CN106650111A (zh
Inventor
牛飞飞
刘毅
董森华
汪燕芳
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Beijing Empyrean Technology Co Ltd
Original Assignee
Beijing CEC Huada Electronic Design Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Beijing CEC Huada Electronic Design Co Ltd filed Critical Beijing CEC Huada Electronic Design Co Ltd
Priority to CN201611217629.7A priority Critical patent/CN106650111B/zh
Publication of CN106650111A publication Critical patent/CN106650111A/zh
Application granted granted Critical
Publication of CN106650111B publication Critical patent/CN106650111B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F30/00Computer-aided design [CAD]
    • G06F30/30Circuit design
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F30/00Computer-aided design [CAD]
    • G06F30/30Circuit design
    • G06F30/39Circuit design at the physical level
    • G06F30/396Clock trees
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06NCOMPUTING ARRANGEMENTS BASED ON SPECIFIC COMPUTATIONAL MODELS
    • G06N3/00Computing arrangements based on biological models
    • G06N3/12Computing arrangements based on biological models using genetic models
    • G06N3/126Evolutionary algorithms, e.g. genetic algorithms or genetic programming

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Biophysics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Health & Medical Sciences (AREA)
  • Life Sciences & Earth Sciences (AREA)
  • Evolutionary Computation (AREA)
  • Geometry (AREA)
  • Bioinformatics & Cheminformatics (AREA)
  • Bioinformatics & Computational Biology (AREA)
  • Evolutionary Biology (AREA)
  • Genetics & Genomics (AREA)
  • Physiology (AREA)
  • Artificial Intelligence (AREA)
  • Biomedical Technology (AREA)
  • Computational Linguistics (AREA)
  • Data Mining & Analysis (AREA)
  • General Health & Medical Sciences (AREA)
  • Molecular Biology (AREA)
  • Computing Systems (AREA)
  • Mathematical Physics (AREA)
  • Software Systems (AREA)
  • Design And Manufacture Of Integrated Circuits (AREA)

Abstract

一种基于时序依赖关系的时钟综合结果评价方法,包括步骤:对时钟同步单元,基于时序依赖关系进行结群;对单个结群进行时钟综合结果的评价。本发明提出的基于时序依赖关系的时钟综合结果评价方法,可用于丰富传统的时钟综合评价,将在时钟综合(CTS)过程中被忽略的数据路径以结群的形式融入到其最终的时钟综合评价中,使时钟综合工具的使用者在一定程度上结合时序约束,对时钟综合(CTS)的结果好坏有更清晰和正确的认识,从而实施最有效的约束配置,避免无意义的流程迭代,从而起到加速设计流程,提高设计效率的目的。

Description

一种基于时序依赖关系的时钟综合结果评价方法
技术领域
本发明涉及电路设计技术领域,尤其涉及电路设计的时钟综合结果评价方法。
背景技术
超深亚微米、纳米工艺等在互联网、手机移动、物联网等应用的催发下日趋成熟。处于市场应用和制造产业之间的集成电路设计,受到前后夹击,面临巨大挑战。
时钟综合属于电路设计中的后端设计,具体而言,位于物理布局之后,布线之前,主要完成从时钟源点到该时钟上所有同步单元的有效时钟路径连接。对于后端设计来说,电路满足时序约束是其完成的必要条件,而时钟综合的好坏则影响时序分析的结果。
目前,主流的后端设计流程,还无法实现全自动化,仍需要大量的人为控制。尽管存在专门的EDA工具,能够对时钟综合的好坏进行评价,但从效率和成本考虑,当前的时钟综合结果是否可以接受,是否需要新一轮迭代,如何迭代,仍然是需要人工干预的过程。而人工干预的依据正是时钟综合工具生成的中间结果文件。
该中间结果文件,通常包含两个部分:一部分是以时钟树为单位,综合性地统计延时、偏差、功耗,报告时钟结构;另一部分,则以具体的同步单元为对象,报告其延时等相关的路径信息。以时钟树为单位的统计,是一种相当粗粒度的分析,没有反映具有时序依赖关系的同步单元之间的时钟树综合的情况,往往导致对时钟综合更高更严格的要求,增加设计流程中的迭代次数,降低设计效率。
因而,提出一种新的基于时序依赖关系的时钟综合结果评价方法,能够直接用于评价时钟综合的好坏,降低人工干预带来的不利影响成为亟待解决的问题。
发明内容
为了解决现有技术存在的不足,本发明的目的在于提供一种基于时序依赖关系的时钟综合结果评价方法,利用时钟树上同步单元之间的时序依赖关系提取结群,对单个结群进行时钟综合结果的评价,从而加速设计流程,提高设计效率。
为实现上述目的,本发明提供的基于时序依赖关系的时钟综合结果评价方法,包括以下步骤:
1)对时钟同步单元,基于时序依赖关系进行结群;2)对单个结群进行时钟综合结果的评价。
进一步地,在所述步骤1)、步骤2)之间还包括对所述结群行变种处理的步骤。
进一步地,所述步骤1)包括以下步骤:
11)以某一时钟同步单元作为当前结群中的第一个点;12)将接收所述某一时钟同步单元传输的数据信号的其他时钟同步单元加入到所述当前结群;13)将发送数据信号给所述某一时钟同步单元的剩余时钟同步单元加入到所述当前结群;14)对所述当前结群中未执行步骤11)的时钟同步单元,执行步骤11)、12)及13)。
进一步地,对所述结群进行变种处理,包括以下步骤:
31)将所有的所述结群映射到所有的时钟树上;32)依据结群变种的策略,对所述结群进行调整。
进一步地,对所述结群进行变种处理,还包括以下步骤:
当所述时钟树包含子结群时,所述子结群在所述时钟树上视为等同于其他结群的独立结群。
进一步地,步骤32)中对所述结群进行调整,包括:对所述结群进行合并或者切分。
进一步地,所述步骤2)中包括:
21)统计所述单个结群中所有的时钟同步单元的传统参数;22)统计所述单个结群中所有的时钟同步单元在时钟树上路径的最大及最小门级数;23)统计所述单个结群中所有的时钟同步单元延时的期望值和标准差。
进一步地,所述传统参数包括:最长延时、最短延时及延时偏差。
本发明提出的基于时序依赖关系的时钟综合结果评价方法,目的在于更准确地评估时钟综合结果,避免无意义的开发流程迭代,缩短设计周期。该方法依据同步单元之间是否存在数据传输通路,自动生成基于时序依赖关系的结群;对时钟综合结果的评价,忽略不同结群之间的差异,只关注一个结群内同步单元之间的延时、偏差等特性。这种方法应用在复杂时钟树结构的设计当中,有助于改善对时钟综合结果的认知程度,可以有效提高时钟树综合的迭代效率。
本发明提出的基于时序依赖关系的时钟综合结果评价方法,针对于时钟树,基于结群进行处理。结群的过程中,利用时钟树上同步单元之间的时序依赖关系。一棵时钟树可能包含一个或多个结群:当一棵时钟树只包含一个结群时,本发明的评价方法的粒度与针对一颗时钟树时的相同;当一棵时钟树包含多个结群时,本发明的评价方法的粒度可以分三个粒度层次,反映时钟综合的结果:首先,以时钟树为最粗粒度层次,统计延时、偏差及功耗;其次,以结群为单位,统计结群内部的延时、偏差、功耗等时钟综合(CTS)关注的参数,引入分布曲线的概念;最后,计算各个同步单元具体的延时信息、路径信息等。
本发明提出的基于时序依赖关系的时钟综合结果评价方法,可用于丰富传统的时钟综合评价,将在时钟综合(CTS)过程中被忽略的数据路径以结群的形式融入到其最终的时钟综合评价中,使时钟综合工具的使用者在一定程度上结合时序约束,对时钟综合(CTS)的结果好坏有更清晰和正确的认识,从而实施最有效的约束配置,避免无意义的流程迭代,从而起到加速设计流程,提高设计效率的目的。
本发明的其它特征和优点将在随后的说明书中阐述,并且,部分地从说明书中变得显而易见,或者通过实施本发明而了解。
附图说明
附图用来提供对本发明的进一步理解,并且构成说明书的一部分,并与本发明的实施例一起,用于解释本发明,并不构成对本发明的限制。在附图中:
图1为根据本发明的基于时序依赖关系的时钟综合结果评价方法流程图;
图2为根据本发明的时序依赖关系具有传递性的原理示意图;
图3为根据本发明的基于时序依赖关系进行结群的过程示意图;
图4为根据本发明包含多个结群的时钟树的示意图;
图5为根据本发明的同一结群内时钟同步单元的延时比较获得结群的偏差示意图;
图6为根据本发明的时钟同步单元的延时分布曲线图。
具体实施方式
以下结合附图对本发明的优选实施例进行说明,应当理解,此处所描述的优选实施例仅用于说明和解释本发明,并不用于限定本发明。
图1为根据本发明的基于时序依赖关系的时钟综合结果评价方法流程图,下面将参考图1,对本发明的基于时序依赖关系的时钟综合结果评价方法进行详细描述。
在步骤101,基于电路输入信息,进行时钟综合;
该步骤中,时钟综合是进行时钟综合结果评价方法的处理对象,并不是本发明实现过程中必须具有的步骤。
在步骤102,对时钟同步单元,基于时序依赖关系进行结群;
图2为根据本发明的时序依赖关系具有传递性的原理示意图,下面结合图2,对时序依赖关系的传递性进行详细的解释。并且图2中的FF0、FF1、FF2及FF3均为时钟同步单元。
在电路设计中,当两个时钟同步单元之间存在有效的数据传递(以信号传输方向为基准,从前一个时钟同步单元的输出端输出的数据经过组合逻辑电路被后另一个时钟同步单元的输入端接收)时,被认为他们之间存在时序依赖关系,在最终数据路径进行时序约束检验时,需要满足数据建立(SETUP)和数据保持(HOLD)的时延约束条件。和某一个时钟同步单元具有时序依赖关系的所有其它时钟同步单元因该时钟同步单元而形成了对时延的彼此制约,进而使得时序依赖关系具有传递性。结群即建立在传递性的时序依赖关系基础之上。
在图2中,时钟同步单元FF0的输出端Q输出的数据经过中间的组合逻辑电路传递到时钟同步单元FF1的输入端D。同样,时钟同步单元FF1的输出端Q输出数据传递到时钟同步单元FF2的输入端D。在检查数据路径的时序约束时,只针对有直接约束关系的时钟同步单元组,FF0/FF1组及FF1/FF2组进行,时钟同步单元FF0和时钟同步单元FF2不存在直接约束关系。但时钟同步单元FF1作为交叉节点,时钟信号到达时间同时影响FF0/FF1和FF1/FF2的约束计算,时钟同步单元FF0和时钟同步单元FF2的时钟信号到达时间都需以时钟同步单元FF1为参考,这就构成了间接的时序依赖关系。而时钟同步单元FF3同其余三个时钟同步单元均不存在数据通路,不具备时序依赖。
对于时钟综合来说,可以通过结群来评价其时钟综合结果也正是由于上述原因。不具有时序依赖关系的时钟同步单元之间因不存在时序约束,所以时延相关性为零,对其进行时延的比较,偏差的计算对时序满足是没有意义的。
图3为根据本发明的基于时序依赖关系进行结群的过程示意图,参照图3,对结群过程进行阐述,结群过程包括:
(1) 以某一时钟同步单元作为当前结群中的第一个点,该某一时钟同步单元的数据输出端发出数据信号,将所有数据输入端接收了该数据信号的其他时钟同步单元加入当前结群;
(2)以该某一时钟同步单元的数据输入端作为信号接收点,反向检查电路,将所有可以向该某一时钟同步单元的数据输入端传递数据信号的剩余时钟同步单元加入当前结群;
(3)从当前结群中选取未执行步骤(1)的时钟同步单元,执行步骤(1)及步骤(2),并将所获得的尚未被加入当前结群的时钟同步单元加入当前结群;
(4)重复执行步骤(3),直到当前结群中的所有时钟同步单元均已执行步骤(1),并且不再有新的时钟同步单元加入当前结群。
用户定义的时钟树,可能包含一个结群、多个结群或者结群的子群。如图3所示,结群后,时钟CLK包含结群{FF0,FF1,FF2}及结群{ FF3,FF4,FF5,FF6} 的子群{ FF3,FF4}。结合时钟结构,以及结群在时钟树上的分布,可以对结群进行适当的调整,从而更清晰地呈现结群在时钟树上的综合结果。
在步骤103,对结群进行变种处理;
在该步骤中,将步骤102中得到所有的结群映射到所有的时钟树上。根据时钟树上具体的结群分布情况,可依据结群变种的策略,对结群进行调整。对于时钟树上包含子结群的情况,子结群在时钟树上视为等同于其他结群的独立结群进行分析。
图4为根据本发明的包含多个结群的时钟树的示意图,下面结合图4,详细阐述结群的变种过程。
当时钟树上的某个结群所包含的时钟同步单元个数多,并且从时钟信号源点到这些时钟同步单元的时钟结构较复杂(主要表现为分支多,路径多)时,时钟综合本身难度大,同一结群内的时钟同步单元,延时可能参差不齐。此时可以对结群(如结群A)进行更细粒度地切分。对各个子群分别处理,可以增强评价时钟综合结果的针对性;
当时钟树上结群个数多,单个结群包含同步单元个数少,时钟结构相对简单,可以对结群(如结群C)进行合并。依据不同的时钟综合工具的效能,适当减少时钟树上结群的个数,可以降低评价时钟综合结果的复杂度。
当然,也可以不对结群进行变种处理,而直接执行步骤104。
在步骤104,对单个结群进行时钟综合结果的评价;
在该步骤中,以单个结群的所有时钟同步单元为对象。
首先,统计时钟同步单元的传统参数,如最长延时、最短延时及延时偏差等,其中,图5为根据本发明的同一结群内时钟同步单元的延时比较获得结群的偏差的示意图,参考图5,结群偏差的计算可以有两种手段:
(A)传统的偏差计算方法,即计算最长延时和最短延时的差值;
(B)计算时钟路径上的逻辑门的级数偏差,即逻辑门个数的最大值和最小值的差值。对于不同工艺而言,相同的时钟结构可能会有较大的延时上的差别,而时钟路径的级数却是一个相对稳定的值,这将便于用户对时钟综合结果形成直观的理解。
其次,统计单个结群中所有时钟同步单元延时的期望值和标准差,其中,图6为根据本发明的时钟同步单元的延时分布曲线图(针对一个时钟同步单元的延时的集合)。参考图6,计算延时的方差和标准差。从偏差的角度而言,分布曲线越集中,说明时钟综合的偏差越小,效果越好;相反,曲线越扁平,说明偏差越大,效果越差。期望值的分布靠近最大延时,还是靠近最小延时,可能会影响下一轮迭代的策略。其中,分布曲线可以采用正态分布曲线,统计延时。
该步骤中针对单个结群进行评价的方法,同样适用于单棵时钟树,以时钟树上所有有效的时钟同步单元为处理对象。
通过前述步骤已经实现了本发明的时钟综合结果评价方法,但是还可以继续执行步骤105,进一步完善本发明的时钟综合结果评价方法。
在步骤105,从时钟树、结群及时钟同步单元的角度评价时钟综合。
首先,参考对单个结群的时钟综合评价的方法,对时钟树进行宏观的延时、偏差、功耗等的统计;
其次,基于时钟树上的结群,依据对单个结群进行时钟综合评价的方法,分析结群在时钟树上的结果;
最后,依据传统方法,给出每个时钟同步单元在时钟树上的延时等信息。
本发明提出的基于时序依赖关系的时钟综合结果评价方法,目的在于更准确地评估时钟综合结果,避免无意义的开发流程迭代,缩短设计周期。该方法依据同步单元之间是否存在数据传输通路,自动生成基于时序依赖关系的结群;对时钟综合结果的评价,忽略不同结群之间的差异,只关注一个结群内同步单元之间的延时、偏差等特性。这种方法应用在复杂时钟树结构的设计当中,有助于改善对时钟综合结果的认知程度,可以有效提高时钟树综合的迭代效率。
本发明提出的基于时序依赖关系的时钟综合结果评价方法,针对于时钟树,基于结群进行处理。结群的过程中,利用时钟树上同步单元之间的时序依赖关系。一棵时钟树可能包含一个或多个结群:当一棵时钟树只包含一个结群时,本发明的评价方法的粒度与针对一颗时钟树时的相同;当一棵时钟树包含多个结群时,本发明的评价方法的粒度可以分三个粒度层次,反映时钟综合的结果:首先,以时钟树为最粗粒度层次,统计延时、偏差及功耗;其次,以结群为单位,统计结群内部的延时、偏差、功耗等时钟综合(CTS)关注的参数,引入分布曲线的概念;最后,计算各个同步单元具体的延时信息、路径信息等。
本发明提出的基于时序依赖关系的时钟综合结果评价方法,可用于丰富传统的时钟综合评价,将在时钟综合(CTS)过程中被忽略的数据路径以结群的形式融入到其最终的时钟综合评价中,使时钟综合工具的使用者在一定程度上结合时序约束,对时钟综合(CTS)的结果好坏有更清晰和正确的认识,从而实施最有效的约束配置,避免无意义的流程迭代,从而起到加速设计流程,提高设计效率的目的。
本领域普通技术人员可以理解:以上所述仅为本发明的优选实施例而已,并不用于限制本发明,尽管参照前述实施例对本发明进行了详细的说明,对于本领域的技术人员来说,其依然可以对前述各实施例记载的技术方案进行修改,或者对其中部分技术特征进行等同替换。凡在本发明的精神和原则之内,所作的任何修改、等同替换、改进等,均应包含在本发明的保护范围之内。

Claims (6)

1.一种基于时序依赖关系的时钟综合结果评价方法,其特征在于,包括以下步骤:
1)对时钟同步单元,基于时序依赖关系进行结群;
2)对单个结群进行时钟综合结果的评价;
所述步骤1)进一步包括,a)选定一时钟同步单元作为当前结群中的第一个点;b)将接收选定的时钟同步单元传输的数据信号的其它时钟同步单元加入到所述当前结群;c)将发送数据信号给选定的时钟同步单元的剩余时钟同步单元加入到所述当前结群;d)对所述当前结群中未执行步骤a)的时钟同步单元,执行步骤a)至c);
所述步骤2)进一步包括,统计单个结群中所有的时钟同步单元的传统参数;统计所述单个结群中所有的时钟同步单元在时钟树上路径的最大及最小门级数;统计所述单个结群中所有的时钟同步单元延时的期望值和标准差。
2.根据权利要求1所述基于时序依赖关系的时钟综合结果评价方法,其特征在于,在所述步骤1)、步骤2)之间还包括对所述结群行变种处理的步骤。
3.根据权利要求2所述基于时序依赖关系的时钟综合结果评价方法,其特征在于,对所述结群进行变种处理,包括以下步骤:
31)将所有的所述结群映射到所有的时钟树上;
32)依据结群变种的策略,对所述结群进行调整。
4.根据权利要求3所述基于时序依赖关系的时钟综合结果评价方法,其特征在于,进一步包括以下步骤:当所述时钟树包含子结群时,所述子结群在所述时钟树上视为等同于其他结群的独立结群。
5.根据权利要求3所述基于时序依赖关系的时钟综合结果评价方法,其特征在于,步骤32)中对所述结群进行调整,包括:对所述结群进行合并或者切分。
6.根据权利要求1所述基于时序依赖关系的时钟综合结果评价方法,其特征在于,所述传统参数包括:最长延时、最短延时及延时偏差。
CN201611217629.7A 2016-12-26 2016-12-26 一种基于时序依赖关系的时钟综合结果评价方法 Active CN106650111B (zh)

Priority Applications (1)

Application Number Priority Date Filing Date Title
CN201611217629.7A CN106650111B (zh) 2016-12-26 2016-12-26 一种基于时序依赖关系的时钟综合结果评价方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
CN201611217629.7A CN106650111B (zh) 2016-12-26 2016-12-26 一种基于时序依赖关系的时钟综合结果评价方法

Publications (2)

Publication Number Publication Date
CN106650111A CN106650111A (zh) 2017-05-10
CN106650111B true CN106650111B (zh) 2019-12-06

Family

ID=58828308

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201611217629.7A Active CN106650111B (zh) 2016-12-26 2016-12-26 一种基于时序依赖关系的时钟综合结果评价方法

Country Status (1)

Country Link
CN (1) CN106650111B (zh)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN111881646B (zh) * 2020-07-03 2021-05-18 广芯微电子(广州)股份有限公司 一种基于结构和时序的时钟树质量检测方法及装置
CN112331243B (zh) * 2020-11-26 2021-07-23 安徽省东科半导体有限公司 同时钟域下寄存器的逻辑解耦方法

Family Cites Families (6)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7612903B2 (en) * 2003-09-08 2009-11-03 Castelle Line utilization in integrated document delivery method and apparatus
CN103150435B (zh) * 2013-03-12 2015-10-28 清华大学 时钟节点结群方法以及时钟网络结构
US8994404B1 (en) * 2013-03-12 2015-03-31 Monolithic 3D Inc. Semiconductor device and structure
CN104715095B (zh) * 2013-12-17 2018-05-11 北京华大九天软件有限公司 一种图形化时钟质量检测分析的方法
CN103793483B (zh) * 2014-01-16 2017-02-15 清华大学 基于时钟节点结群的时钟树生成方法和***
CN105095604B (zh) * 2015-09-10 2017-12-15 中国人民解放军国防科学技术大学 一种考虑距离与时钟的时序预算方法

Also Published As

Publication number Publication date
CN106650111A (zh) 2017-05-10

Similar Documents

Publication Publication Date Title
WO2017112077A1 (en) Optimizing skewed joins in big data
US20150278306A1 (en) Bloom filter costing estimation
WO2021169303A1 (zh) 一种优化时分复用技术的多阶段fpga布线方法
US20110131540A1 (en) Path Preserving Design Partitioning With Redundancy
US20140075452A1 (en) Message passing interface tuning using collective operation modeling
CN106650111B (zh) 一种基于时序依赖关系的时钟综合结果评价方法
CN103902774A (zh) X结构下超大规模集成电路总体布线方法
CN103955410A (zh) 基于多中断源优先级排序的中断控制方法
CN101656535A (zh) 针对多模式逻辑单元可编程门阵列的工艺映射方法
CN110688723B (zh) 一种时钟分布网络快速设计方法
WO2018082320A1 (zh) 数据流连接方法及装置
Possignolo et al. Fluid pipelines: Elastic circuitry meets out-of-order execution
CN105404352B (zh) 一种检查时钟树综合结果瓶颈从而提高综合质量的方法
Wijayasekara et al. Equivalence verification for NULL Convention Logic (NCL) circuits
WO2013071480A1 (zh) 用于模拟电路移植的电路优化方法和装置
Hand et al. Performance optimization and analysis of blade designs under delay variability
Hrbacek Parallel multi-objective evolutionary design of approximate circuits
Hwang et al. Timing yield slack for timing yield-constrained optimization and its application to statistical leakage minimization
Deng et al. Fast synthesis of low power clock trees based on register clustering
CN102054089B (zh) 对带有透明锁存器的数字集成电路进行优化的速度分级的方法
US9330216B2 (en) Integrated circuit design synthesis using slack diagrams
Qing-xiu et al. An improved verification method for workflow model based on Petri net reduction
CN107391250B (zh) 一种提高Mapreduce任务Shuffle性能的控制器调度方法
CN107844327B (zh) 一种实现上下文一致性的检测***及检测方法
CN112597009B (zh) 一种基于覆盖率排序的FPGA内嵌PCIExpressIP核量产测试优化方法

Legal Events

Date Code Title Description
PB01 Publication
PB01 Publication
SE01 Entry into force of request for substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant
CP01 Change in the name or title of a patent holder
CP01 Change in the name or title of a patent holder

Address after: 100102 Beijing city two Chaoyang District Lize Road No. 2 A block 2 layer

Patentee after: Beijing Huada Jiutian Technology Co.,Ltd.

Address before: 100102 Beijing city two Chaoyang District Lize Road No. 2 A block 2 layer

Patentee before: HUADA EMPYREAN SOFTWARE Co.,Ltd.