CN106128379B - Goa电路 - Google Patents

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Abstract

本发明提供一种GOA电路，该GOA电路的正反向扫描控制模块包括第一薄膜晶体管以及第三薄膜晶体管，所述第一薄膜晶体管的栅极电性连接于上一级第n‑1级GOA单元的栅极扫描驱动信号，源极接入第一恒压电位，漏极电性连接于第一节点，所述第三薄膜晶体管的栅极电性连接于下一级第n+1级GOA单元的栅极扫描驱动信号，源极接入第一恒压电位，漏极电性连接于第一节点，通过该两个薄膜晶体管即可控制GOA电路在正反向扫描之间进行切换，相比于现有技术减少了两个控制信号的同时并不增加薄膜晶体管和电容，能够扩大IC的选择范围，有利于实现液晶显示器的窄边框。

Description

GOA电路
技术领域
本发明涉及显示技术领域，尤其涉及一种GOA电路。
背景技术
液晶显示器(Liquid Crystal Display，LCD)具有机身薄、省电、无辐射等众多优点，得到了广泛的应用。如：液晶电视、移动电话、个人数字助理(PDA)、数字相机、计算机屏幕或笔记本电脑屏幕等，在平板显示领域中占主导地位。
GOA技术(Gate Driver on Array)即阵列基板行驱动技术，是运用液晶显示面板的原有阵列制程将水平扫描线的驱动电路制作在显示区周围的基板上，使之能替代外接集成电路板((Integrated Circuit，IC)来完成水平扫描线的驱动。GOA技术能减少外接IC的焊接(bonding)工序，有机会提升产能并降低产品成本，而且可以使液晶显示面板更适合制作窄边框或无边框的显示产品。
请参阅图1，图1为现有的一种GOA电路的电路图，该GOA电路包括级联的多级GOA单元：每个GOA单元均包括：正反向扫描控制模块100、输出模块200、及节点控制模块300，设n为正整数，在第n级GOA单元中，所述正反向扫描控制模块100包括：第一薄膜晶体管T1，所述第一薄膜晶体管T1的栅极电性连接于上两级第n-2级GOA单元的栅极扫描驱动信号G(n-2)，源极接入正向扫描控制信号U2D，漏极电性连接于第一节点H(n)；以及第三薄膜晶体管T3，所述第三薄膜晶体管T3的栅极电性连接于下两级第n+2级GOA单元的栅极扫描驱动信号G(n+2)，源极接入反向扫描控制信号D2U，漏极电性连接于第一节点H(n)；所述输出单元200包括：第二薄膜晶体管T2，所述第二薄膜晶体管T2的栅极电性连接于第二节点Q(n)，源极接入第m条时钟信号CK(m)，漏极电性连接于第n级GOA单元的栅极扫描驱动信号G(n)；以及第一电容C1，所述第一电容C1的一端电性连接于第二节点Q(n)，另一端电性连接于第n级GOA单元的栅极扫描驱动信号G(n)；所述节点控制模块300包括：第四薄膜晶体管T4，所述第四薄膜晶体管T4的栅极电性连接于第三节点P(n)，源极电性连接于第n级GOA单元的栅极扫描驱动信号G(n)，漏极接入恒压低电位VGL；第五薄膜晶体管T5，所述第五薄膜晶体管T5的栅极接入恒压高电位VGH，源极电性连接于第一节点H(n)，漏极电性连接于第二节点Q(n)；第六薄膜晶体管T6，所述第六薄膜晶体管T6的栅极电性连接于第三节点P(n)，源极电性连接于第一节点H(n)，漏极接入恒压低电位VGL；第七薄膜晶体管T7，所述第七薄膜晶体管T7的栅极电性连接于第一节点H(n)，源极电性连接于第三节点P(n)，漏极接入恒压低电位VGL；第八薄膜晶体管T8，所述第八薄膜晶体管T8的栅极接入第m+2条时钟信号CK(m+2)，源极接入恒压高电位VGH，漏极电性连接于第三节点P(n)；以及第二电容C2，所述第二电容C2的一端电性连接于第三节点P(n)，另一端接入恒压低电位VGL。
图1所示的现有的GOA电路中，第一薄膜晶体管T1和第三薄膜晶体管T3形成正反向扫描控制单元100，第一薄膜晶体管T1和第三薄膜晶体管T3需要分别接入正向扫描控制信号U2D以及反向扫描控制信号D2U，正向扫描时，正向扫描控制信号U2D为高电平，反向扫描控制信号D2U为低电平；反向扫描时，反向扫描控制信号D2U为高电平，正向扫描控制信号U2D为低电平。而这种方式就需要集成电路(Integrated Circuit，IC)具有输出该控制信号的功能，限制了IC的可选择范围，同时由于正向扫描控制信号U2D以及反向扫描控制信号D2U的存在，在布线(Layout)设计时也不利于窄边框液晶显示器的实现。
发明内容
本发明的目的在于提供一种GOA电路，无需提供正向扫描控制信号和反向扫描控制信号即可实现正反向扫描，有利于实现液晶显示器的窄边框。
为实现上述目的，本发明提供了一种GOA电路，包括：级联的多个GOA单元，每个GOA单元均包括：正反向扫描控制模块、与所述正反向扫描控制模块电性连接输出模块、与所述输出模块电性连接的下拉模块、与所述正反向扫描控制模块、输出模块和下拉模块均电性连接的下拉控制模块；
设n和m均为正整数，除第一级、与最后一级GOA单元外，在第n级GOA单元中：
所述正反向扫描控制模块接入上一级第n-1级GOA单元的栅极扫描驱动信号、下一级第n+1级GOA单元的栅极扫描驱动信号、以及第一恒压电位，用于根据上一级第n-1级GOA单元的栅极扫描驱动信号或下一级第n+1级GOA单元的栅极扫描驱动信号向输出模块输出第一恒压电位，进而控制所述输出单元打开，实现GOA电路正向扫描或反向扫描；
所述输出模块用于在第n级GOA单元作用期间输出第n级栅极扫描驱动信号；
所述下拉模块用于在第n级GOA单元的非作用期间下拉所述第n级栅极扫描驱动信号的电位；
所述下拉控制模块用于在第n级GOA单元的作用期间关闭下拉模块并维持输出模块打开，在第n级GOA单元的非作用期间打开下拉模块并关闭输出模块。
所述正反向扫描控制模块包括：第一薄膜晶体管，所述第一薄膜晶体管的栅极接入上一级第n-1级GOA单元的栅极扫描驱动信号，源极接入第一恒压电位，漏极电性连接于第一节点；以及第三薄膜晶体管，所述第三薄膜晶体管的栅极接入下一级第n+1级GOA单元的栅极扫描驱动信号，源极接入第一恒压电位，漏极电性连接于第一节点；
所述输出单元包括：第二薄膜晶体管，所述第二薄膜晶体管的栅极电性连接于第二节点，源极接入第m条时钟信号，漏极接入第n级GOA单元的栅极扫描驱动信号；第一电容，所述第一电容的一端电性连接于第二节点，另一端接入第n级GOA单元的栅极扫描驱动信号；
所述下拉模块包括：第四薄膜晶体管，所述第四薄膜晶体管的栅极电性连接于第三节点，源极接入第n级GOA单元的栅极扫描驱动信号，漏极接入第二恒压电位；以及第二电容，所述第二电容的一端电性连接于第三节点，另一端接入第二恒压电位；
所述下拉控制模块包括：第六薄膜晶体管，所述第六薄膜晶体管的栅极电性连接于第三节点，源极电性连接于第一节点，漏极接入第二恒压电位；第七薄膜晶体管，所述第七薄膜晶体管的栅极电性连接于第一节点，源极电性连接于第三节点，漏极接入第二恒压电位；以及第八薄膜晶体管，所述第八薄膜晶体管的栅极接入第m+2条时钟信号，源极接入第一恒压电位，漏极电性连接于第三节点；
所述GOA单元还包括稳压模块，所述稳压模块包括：第五薄膜晶体管，所述第五薄膜晶体管的栅极接入第一恒压电位，源极电性连接于第一节点，漏极电性连接于第二节点；
所述第一恒压电位与第二恒压电位的电位相反。
在第一级GOA单元中，所述第一薄膜晶体管的栅极接入电路起始信号。
在最后一级GOA单元中，所述第三薄膜晶体管的栅极接入电路起始信号。
包括四条时钟信号：第一、第二、第三、及第四条时钟信号；当所述第m条时钟信号为第三条时钟信号时，第m+2条时钟信号为第一条时钟信号；当所述第m条时钟信号为第四条时钟信号时，第m+2条时钟信号为第二条时钟信号。
所述第一、第二、第三、及第四条时钟信号的脉冲周期相同，前一条时钟信号的下降沿与后一条时钟信号的上升沿同时产生。
所述各个薄膜晶体管均为N型薄膜晶体管，所述第一恒压电位为恒压高电位，第二恒压电位为恒压低电位。
所述各个薄膜晶体管均为P型薄膜晶体管，所述第一恒压电位为恒压低电位，第二恒压电位为恒压高电位。
所述各个薄膜晶体管均为非晶硅薄膜晶体管、低温多晶硅薄膜晶体管、或氧化物半导体薄膜晶体管。
本发明的有益效果：本发明提供了一种GOA电路，该GOA电路的正反向扫描控制模块包括第一薄膜晶体管以及第三薄膜晶体管，所述第一薄膜晶体管的栅极电性连接于上一级第n-1级GOA单元的栅极扫描驱动信号，源极接入第一恒压电位，漏极电性连接于第一节点，所述第三薄膜晶体管的栅极电性连接于下一级第n+1级GOA单元的栅极扫描驱动信号，源极接入第一恒压电位，漏极电性连接于第一节点，通过该两个薄膜晶体管即可控制GOA电路在正反向扫描之间进行切换，相比于现有技术减少了两个控制信号的同时并不增加薄膜晶体管和电容，能够扩大IC的选择范围，有利于实现液晶显示器的窄边框。
附图说明
为了能更进一步了解本发明的特征以及技术内容，请参阅以下有关本发明的详细说明与附图，然而附图仅提供参考与说明用，并非用来对本发明加以限制。
附图中，
图1为现有的一种GOA电路的电路图；
图2为本发明的GOA电路的电路图；
图3为本发明的GOA电路的第一级GOA单元的电路图；
图4为本发明的GOA电路的最后一级GOA单元的电路图；
图5为本发明的GOA电路的正向扫描时序图；
图6为本发明的GOA电路的反向扫描时序图。
具体实施方式
为更进一步阐述本发明所采取的技术手段及其效果，以下结合本发明的优选实施例及其附图进行详细描述。
请参阅图2，本发明提供一种GOA电路，包括：级联的多个GOA单元，每个GOA单元均包括：正反向扫描控制模块100、与所述正反向扫描控制模块100电性连接输出模块200、与所述输出模块200电性连接的下拉模块(300)、与所述正反向扫描控制模块100、输出模块200和下拉模块300均电性连接的下拉控制模块400；
设n和m均为正整数，除第一级、与最后一级GOA单元外，在第n级GOA单元中：
所述正反向扫描控制模块100接入上一级第n-1级GOA单元的栅极扫描驱动信号G(n-1)、下一级第n+1级GOA单元的栅极扫描驱动信号G(n+1)、以及第一恒压电位，用于根据上一级第n-1级GOA单元的栅极扫描驱动信号G(n-1)或下一级第n+1级GOA单元的栅极扫描驱动信号G(n+1)向输出模块200输出第一恒压电位，进而控制所述输出单元200打开，实现GOA电路正向扫描或反向扫描；
所述输出模块200用于在第n级GOA单元作用期间输出第n级GOA单元的栅极扫描驱动信号G(n)；
所述下拉模块300用于在第n级GOA单元的非作用期间下拉所述第n级GOA单元的栅极扫描驱动信号G(n)的电位；
所述下拉控制模块400用于在第n级GOA单元的作用期间关闭下拉模块300并维持输出模块200打开，在第n级GOA单元的非作用期间打开下拉模块300并关闭输出模块200。
具体地，所述正反向扫描控制模块100包括：第一薄膜晶体管T1，所述第一薄膜晶体管T1的栅极接入上一级第n-1级GOA单元的栅极扫描驱动信号G(n-1)，源极接入第一恒压电位，漏极电性连接于第一节点H(n)；以及第三薄膜晶体管T3，所述第三薄膜晶体管T3的栅极接入下一级第n+1级GOA单元的栅极扫描驱动信号G(n+1)，源极接入第一恒压电位，漏极电性连接于第一节点H(n)；
所述输出单元200包括：第二薄膜晶体管T2，所述第二薄膜晶体管T2的栅极电性连接于第二节点Q(n)，源极接入第m条时钟信号CK(m)，漏极接入第n级GOA单元的栅极扫描驱动信号G(n)；以及第一电容C1，所述第一电容C1的一端电性连接于第二节点Q(n)，另一端接入第n级GOA单元的栅极扫描驱动信号G(n)；
所述下拉模块300包括：第四薄膜晶体管T4，所述第四薄膜晶体管T4的栅极电性连接于第三节点P(n)，源极接入第n级GOA单元的栅极扫描驱动信号G(n)，漏极接入第二恒压电位；以及第二电容C2，所述第二电容C2的一端电性连接于第三节点P(n)，另一端接入第二恒压电位；
所述下拉控制模块400包括：第六薄膜晶体管T6，所述第六薄膜晶体管T6的栅极电性连接于第三节点P(n)，源极电性连接于第一节点H(n)，漏极接入第二恒压电位；第七薄膜晶体管T7，所述第七薄膜晶体管T7的栅极电性连接于第一节点H(n)，源极电性连接于第三节点P(n)，漏极接入第二恒压电位；第八薄膜晶体管T8，所述第八薄膜晶体管T8的栅极接入第m+2条时钟信号CK(m+2)，源极接入第一恒压电位，漏极电性连接于第三节点P(n)；
此外，所述GOA电路还包括稳压模块500，所述稳压模块500包括：第五薄膜晶体管T5，所述第五薄膜晶体管T5的栅极接入第一恒压电位，源极电性连接于第一节点H(n)，漏极电性连接于第二节点Q(n)。
所述第一恒压电位与第二恒压电位的电位相反。
具体地，请参阅图3，在第一级GOA单元中，所述第一薄膜晶体管T1的栅极接入电路起始信号STV。请参阅图4，在最后一级GOA单元中，所述第三薄膜晶体管T3的栅极接入电路起始信号STV。
需要说明的是，上述时钟信号共包括四条：分别为第一、第二、第三、及第四条时钟信；当所述第m条时钟信号CK(m)为第三条时钟信号时，第M+2条时钟信号CK(m+2)为第一条时钟信号；当所述第m条时钟信号CK(m)为第四条时钟信号时，第m+2条时钟信号CK(m+2)为第二条时钟信号。
特别地，所述第一、第二、第三、及第四条时钟信号的脉冲周期相同，所前一条时钟信号的下降沿与后一条时钟信号的上升沿同时产生，即所述第一条时钟信号的第一个脉冲信号首先产生，所述第一时钟信号的第一个脉冲信号结束的同时所述第二条时钟信号的第一个脉冲信号产生，所述第二条时钟信号的第一个脉冲信号结束的同时所述第三条时钟信号的第一个脉冲信号产生，所述第三条时钟信号的第一个脉冲信号结束的同时所述第四条时钟信号的第一个脉冲信号产生，所述第四条时钟信号的第一个脉冲信号结束的同时所述第一条时钟信号的第二个脉冲信号产生。
可选地，所述各个薄膜晶体管可以均为N型薄膜晶体管，也可以均为P型薄膜晶体管，当所述各个薄膜晶体管均为N型薄膜晶体管时，所述第一恒压电位为恒压高电位VGH，第二恒压电位为恒压低电位VGL。当所述各个薄膜晶体管均为P型薄膜晶体管时，所述第一恒压电位为恒压低电位VGL，第二恒压电位为恒压高电位VGH。图2所示的各个薄膜晶体管均为N型薄膜晶体管。
可选地，所述各个薄膜晶体管可选择非晶硅薄膜晶体管、低温多晶硅薄膜晶体管、及氧化物半导体薄膜晶体管等各种类型的薄膜晶体管。
请参阅图5，正向扫描时，所述GOA电路(N型薄膜晶体管)的工作过程如下：
阶段1、预充电阶段：此阶段中第n-1级GOA单元的栅极扫描驱动信号G(n-1)为高电位，第一薄膜晶体管T1导通，第一节点H(n)被预充电至高电位，第七薄膜晶体管T7导通，第三节点P(n)被拉低至恒压低电位VGL，第五薄膜晶体管T5受恒压高电位VGH的控制始终导通，第二节点Q(n)也被预充电至高电位；
阶段2、栅极扫描驱动信号G(n)输出高电位阶段：在此阶段中第n-1级GOA单元的栅极扫描驱动信号G(n-1)降低为低电位，第一薄膜晶体管T1关闭，第二节点Q(n)受第一电容C1的保持作用保持为高电位，第二薄膜晶体管T2导通，第m条时钟信号CK(m)提供高电位，栅极扫描驱动信号G(n)输出高电位，并传递至下一级第n+1级GOA单元的第一薄膜晶体管T1的栅极，以实现正向扫描的级传；
阶段3、栅极扫描驱动信号G(n)输出低电位阶段：在此阶段中第二节点Q(n)受第一电容C1保持作用仍保持为高电位，第二薄膜晶体管T2导通，第m条时钟信号CK(m)的低电位经由栅极扫描驱动信号G(n)输出；
阶段4、第二节点Q(n)拉低阶段：在此阶段中，第m+2条时钟信号CK(m+2)提供高电位，第八薄膜晶体管T8导通，第三节点P(n)被充电至高电位，第六薄膜晶体管T6导通，第一和第二节点H(n)、Q(n)被拉低至恒压低电位VGL；
阶段5、第二节点Q(n)及栅极扫描驱动信号G(n)低电位维持阶段：当第一节点H(n)变为低电位后，第七薄膜晶体管T7处于截止状态，当第m+2条时钟信号CK(m+2)跳变为高电位时第八薄膜晶体管T8导通，第三节点P(n)点被充电至高电位，那么第四薄膜晶体管T4和第六薄膜晶体管T6均处于导通的状态，可以保证第二节点Q(n)及栅极扫描驱动信号G(n)的低电位稳定，同时第二电容C2对第三节点P(n)的高电位具有一定的保持作用。
相应地，请参阅图6，图6为本发明的GOA电路的反向扫描时序图，其工作过程与正向扫描不同点在于，其通过第三薄膜晶体管T3进行扫描控制，扫描顺序为最后一级向第一级扫描，也就说，下一级GOA单元的栅极扫描驱动信号输出的信号传递至上一级GOA单元的第三薄膜晶体管T3的栅极，以驱动上一级GOA单元开始输出，其余均与正向扫描相同，此处不再赘述。
可见，本发明的GOA电路相比于现有技术，不需要IC提供正向扫描控制信号和反向扫描控制信号，也没有增加薄膜晶体管或电容，同时也能保证GOA电路具备正反向扫描功能，扩大了GOA电路可选择的IC范围，有利于实现液晶显示器的窄边框。
综上所述，本发明提供了一种GOA电路，该GOA电路的正反向扫描控制模块包括第一薄膜晶体管以及第三薄膜晶体管，所述第一薄膜晶体管的栅极电性连接于上一级第n-1级GOA单元的栅极扫描驱动信号，源极接入第一恒压电位，漏极电性连接于第一节点，所述第三薄膜晶体管的栅极电性连接于下一级第n+1级GOA单元的栅极扫描驱动信号，源极接入第一恒压电位，漏极电性连接于第一节点，通过该两个薄膜晶体管即可控制GOA电路在正反向扫描之间进行切换，相比于现有技术减少了两个控制信号的同时并不增加薄膜晶体管和电容，能够扩大IC的选择范围，有利于实现液晶显示器的窄边框。
以上所述，对于本领域的普通技术人员来说，可以根据本发明的技术方案和技术构思作出其他各种相应的改变和变形，而所有这些改变和变形都应属于本发明权利要求的保护范围。

Claims (8)

1.一种GOA电路，其特征在于，包括：级联的多个GOA单元，每个GOA单元均包括：正反向扫描控制模块(100)、与所述正反向扫描控制模块(100)电性连接输出模块(200)、与所述输出模块(200)电性连接的下拉模块(300)、与所述正反向扫描控制模块(100)、输出模块(200)和下拉模块(300)均电性连接的下拉控制模块(400)；
设n和m均为正整数，除第一级、与最后一级GOA单元外，在第n级GOA单元中：
所述正反向扫描控制模块(100)接入上一级第n-1级GOA单元的栅极扫描驱动信号(G(n-1))、下一级第n+1级GOA单元的栅极扫描驱动信号(G(n+1))、以及第一恒压电位，用于根据上一级第n-1级GOA单元的栅极扫描驱动信号(G(n-1))或下一级第n+1级GOA单元的栅极扫描驱动信号(G(n+1))向输出模块(200)输出第一恒压电位，进而控制所述输出模块(200)打开，实现GOA电路正向扫描或反向扫描；
所述输出模块(200)用于在第n级GOA单元作用期间输出第n级GOA单元的栅极扫描驱动信号(G(n))；
所述下拉模块(300)用于在第n级GOA单元的非作用期间下拉所述第n级GOA单元的栅极扫描驱动信号(G(n))的电位；
所述下拉控制模块(400)用于在第n级GOA单元的作用期间关闭下拉模块(300)并维持输出模块(200)打开，在第n级GOA单元的非作用期间打开下拉模块(300)并关闭输出模块(200)；
所述正反向扫描控制模块(100)包括：第一薄膜晶体管(T1)，所述第一薄膜晶体管(T1)的栅极接入上一级第n-1级GOA单元的栅极扫描驱动信号(G(n-1))，源极接入第一恒压电位，漏极电性连接于第一节点(H(n))；以及第三薄膜晶体管(T3)，所述第三薄膜晶体管(T3)的栅极接入下一级第n+1级GOA单元的栅极扫描驱动信号(G(n+1))，源极接入第一恒压电位，漏极电性连接于第一节点(H(n))；
所述输出模块(200)包括：第二薄膜晶体管(T2)，所述第二薄膜晶体管(T2)的栅极电性连接于第二节点(Q(n))，源极接入第m条时钟信号(CK(m))，漏极接入第n级GOA单元的栅极扫描驱动信号(G(n))；以及第一电容(C1)，所述第一电容(C1)的一端电性连接于第二节点(Q(n))，另一端接入第n级GOA单元的栅极扫描驱动信号(G(n))；
所述下拉模块(300)包括：第四薄膜晶体管(T4)，所述第四薄膜晶体管(T4)的栅极电性连接于第三节点(P(n))，源极电性连接于第n级GOA单元的栅极扫描驱动信号(G(n))，漏极接入第二恒压电位；以及第二电容(C2)，所述第二电容(C2)的一端电性连接于第三节点(P(n))，另一端接入第二恒压电位；
所述下拉控制模块(400)包括：第六薄膜晶体管(T6)，所述第六薄膜晶体管(T6)的栅极电性连接于第三节点(P(n))，源极电性连接于第一节点(H(n))，漏极接入第二恒压电位；第七薄膜晶体管(T7)，所述第七薄膜晶体管(T7)的栅极电性连接于第一节点(H(n))，源极电性连接于第三节点(P(n))，漏极接入第二恒压电位；以及第八薄膜晶体管(T8)，所述第八薄膜晶体管(T8)的栅极接入第m+2条时钟信号(CK(m+2))，源极接入第一恒压电位，漏极电性连接于第三节点(P(n))；
所述GOA电路还包括稳压模块(500)，所述稳压模块(500)包括：第五薄膜晶体管(T5)，所述第五薄膜晶体管(T5)的栅极接入第一恒压电位，源极电性连接于第一节点(H(n))，漏极电性连接于第二节点(Q(n))；
所述第一恒压电位与第二恒压电位的电位相反。
2.如权利要求1所述的GOA电路，其特征在于，在第一级GOA单元中，所述第一薄膜晶体管(T1)的栅极接入电路起始信号(STV)。
3.如权利要求1所述的GOA电路，其特征在于，在最后一级GOA单元中，所述第三薄膜晶体管(T3)的栅极接入电路起始信号(STV)。
4.如权利要求1所述的GOA电路，其特征在于，包括四条时钟信号：第一、第二、第三、及第四条时钟信号；当所述第m条时钟信号(CK(m))为第三条时钟信号时，第m+2条时钟信号(CK(m+2))为第一条时钟信号；当所述第m条时钟信号(CK(m))为第四条时钟信号时，第m +2条时钟信号(CK(m+2))为第二条时钟信号。
5.如权利要求4所述的GOA电路，其特征在于，所述第一、第二、第三、及第四条时钟信号的脉冲周期相同，前一条时钟信号的下降沿与后一条时钟信号的上升沿同时产生。
6.如权利要求1所述的GOA电路，其特征在于，所述各个薄膜晶体管均为N型薄膜晶体管，所述第一恒压电位为恒压高电位(VGH)，第二恒压电位为恒压低电位(VGL)。
7.如权利要求1所述的GOA电路，其特征在于，所述各个薄膜晶体管均为P型薄膜晶体管，所述第一恒压电位为恒压低电位(VGL)，第二恒压电位为恒压高电位(VGH)。
8.如权利要求1所述的GOA电路，其特征在于，所述各个薄膜晶体管均为非晶硅薄膜晶体管、低温多晶硅薄膜晶体管、或氧化物半导体薄膜晶体管。
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