CN105609047B - 像素电路及其驱动方法、显示面板 - Google Patents

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Abstract

公开了一种像素电路及其驱动方法、以及包括该像素电路的显示面板。所述像素电路包括：发光模块、第一驱动模块和第二驱动模块，所述第一驱动模块在所述第一扫描控制端的第一扫描信号的控制下在第一时段期间驱动所述发光模块发光，以及所述第二驱动模块在所述第二扫描控制端的第二扫描信号的控制下在第二时段期间驱动所述发光模块发光，所述第一时段和所述第二时段彼此不重叠。通过利用两个驱动模块交替地驱动发光器件发光，使得在一个驱动模块驱动发光器件发光时另一驱动模块进入恢复阶段，从而可以降低各驱动模块中驱动晶体管的阈值电压漂移，同时可以延长各驱动模块的驱动晶体管的使用寿命。

Description

像素电路及其驱动方法、显示面板
技术领域
本发明涉及显示领域，并且更具体地涉及一种像素电路及其驱动方法、以及显示面板。
背景技术
目前，为了抑制有机发光二极管显示装置的像素电路中驱动晶体管的阈值电压对有机发光二极管的发光亮度的影响，已经在像素电路中实现了阈值电压补偿功能，从而可以补偿驱动晶体管的阈值电压对有机发光二极管的发光亮度的影响。对于整个有机发光二极管显示装置而言，可以减轻各像素的驱动晶体管的阈值电压的不均匀性和漂移造成整个有机发光二极管显示装置的亮度不均匀或闪烁的现象。
然而，在有机发光二极管显示装置的显示过程中，各像素的驱动晶体管的栅极和源极之间持续施加栅源电压，因此各像素的驱动晶体管的阈值电压漂移会不断增大。在该阈值电压漂移在一定程度范围内时，通过上述的阈值电压补偿功能可以补偿该阈值电压漂移，然而，在该阈值电压漂移超出该一定程度时，上述的阈值电压补偿功能变得失效，相应地，所述有机发光二极管显示装置的显示效果变差，由此缩短了有机发光二极管显示装置的使用寿命。
因此，需要提出一种能够降低各驱动模块的驱动晶体管的阈值电压漂移并延长有机发光二极管显示装置的使用寿命的像素电路和显示面板。
发明内容
为了解决上述技术问题，提出了一种像素电路及其驱动方法、以及包括该像素电路的显示面板，其通过利用两个驱动模块交替地驱动发光器件发光，使得在一个驱动模块驱动发光器件发光时另一驱动模块进入恢复阶段，从而可以降低各驱动模块中驱动晶体管的阈值电压漂移。
根据本发明一方面，提供了一种像素电路，包括：发光模块，其第一端与第一驱动模块的第一端和第二驱动模块的第一端连接，其第二端与第一电源电压端连接；所述第一驱动模块，其第二端与第一驱动电压端连接，其第三端与第一扫描控制端连接，其第四端与数据输入端连接，并且被配置为在所述第一扫描控制端的第一扫描信号的控制下在第一时段期间驱动所述发光模块发光；以及所述第二驱动模块，其第二端与第二驱动电压端连接，其第三端与第二扫描控制端连接，其第四端与所述数据输入端连接，并且被配置为在所述第二扫描控制端的第二扫描信号的控制下在第二时段期间驱动所述发光模块发光，所述第一时段和所述第二时段彼此不重叠；其中，所述第一驱动模块和第二驱动模块交替地驱动所述发光模块发光。
根据本发明实施例，在所述第一驱动模块驱动所述发光模块发光的所述第一时段期间，所述第二驱动模块处于恢复阶段；以及在所述第二驱动模块驱动所述发光模块发光的所述第二时段期间，所述第一驱动模块处于恢复阶段。
根据本发明实施例，在奇数帧期间，所述第一驱动模块在所述第一扫描控制端的第一扫描信号和所述第一驱动电压端的第一驱动电压信号的控制下，读取所述数据输入端的数据信号并且根据所读取的数据信号驱动所述发光模块发光，所述第二驱动模块被重置并且处于恢复阶段；在偶数帧期间，所述第一驱动模块被重置并且处于恢复阶段，所述第二驱动模块在所述第二扫描控制端的第二扫描信号和所述第二驱动电压端的第二驱动电压信号的控制下，读取所述数据输入端的数据信号并且根据所读取的数据信号驱动所述发光模块发光。
根据本发明实施例，所述第一驱动模块包括第一开关晶体管、第一驱动晶体管和第一电容；所述第一开关晶体管的栅极作为所述第一驱动模块的第三端与所述第一扫描控制端连接，所述第一开关晶体管的第一极作为所述第一驱动模块的第四端与所述数据输入端连接，所述第一开关晶体管的第二极与所述第一驱动晶体管的栅极和所述第一电容的第一端连接；所述第一驱动晶体管的第一极作为所述第一驱动模块的第二端与所述第一驱动电压端连接，所述第一驱动晶体管的第二极作为所述第一驱动模块的第一端与所述发光模块的第一端和所述第一电容的第二端连接。
根据本发明实施例，所述第二驱动模块包括第二开关晶体管、第二驱动晶体管和第二电容；所述第二开关晶体管的栅极作为所述第二驱动模块的第三端与所述第二扫描控制端连接，所述第二开关晶体管的第一极作为所述第二驱动模块的第四端与所述数据输入端连接，所述第二开关晶体管的第二极与所述第二驱动晶体管的栅极和所述第二电容的第一端连接；所述第二驱动晶体管的第一极作为所述第二驱动模块的第二端与所述第二驱动电压端连接，所述第二驱动晶体管的第二极作为所述第二驱动模块的第一端与所述发光模块的第一端和所述第二电容的第二端连接。
根据本发明另一方面，还提供了如上所述的像素电路的驱动方法，包括：在奇数帧期间，在第一扫描控制端的第一扫描信号的控制下，第一驱动模块读取数据输入端的数据信号并且根据所读取的数据信号驱动发光模块发光，以及在第二扫描控制端的第二扫描信号的控制下，第二驱动模块被重置并且处于恢复阶段；在偶数帧期间，在第二扫描控制端的第二扫描信号的控制下，第二驱动模块读取数据输入端的数据信号并且根据所读取的数据信号驱动发光模块发光，以及在第一扫描控制端的第一扫描信号的控制下，第一驱动模块被重置并且处于恢复阶段。
根据本发明实施例，每帧被划分为重置时段、补偿时段、数据写入时段和发光时段。
根据本发明实施例，在奇数帧期间，在重置时段，在所述第一和第二驱动电压端输出非驱动电压，所述第一和第二扫描信号为有效电平，所述第一和第二驱动模块被重置；在补偿时段，所述第一驱动电压端输出驱动电压，所述第一扫描信号为有效电平，所述第二扫描信号为无效电平，所述第一驱动模块进行晶体管阈值电压补偿，所述第二驱动模块保持重置状态；在数据写入时段，所述第一驱动电压端浮置并且无电压输出，所述第一扫描信号为有效电平，所述第二扫描信号为无效电平，所述第一驱动模块读入所述数据输入端的数据信号，所述第二驱动模块保持重置状态；在发光时段，所述第一驱动电压端输出驱动电压，所述第一扫描信号为无效电平，所述第二扫描信号为无效电平，所述第一驱动模块驱动所述发光模块发光，所述第二驱动模块保持重置状态。
根据本发明实施例，在偶数帧期间，在重置时段，在所述第一和第二驱动电压端输出非驱动电压，所述第一和第二扫描信号为有效电平，所述第一和第二驱动模块被重置；在补偿时段，所述第二驱动电压端输出驱动电压，所述第二扫描信号为有效电平，所述第一扫描信号为无效电平，所述第二驱动模块进行晶体管阈值电压补偿，所述第一驱动模块保持重置状态；在数据写入时段，所述第二驱动电压端浮置并且无电压输出，所述第二扫描信号为有效电平，所述第一扫描信号为无效电平，所述第二驱动模块读入所述数据输入端的数据信号，所述第一驱动模块保持重置状态；在发光时段，所述第二驱动电压端输出驱动电压，所述第二扫描信号为无效电平，所述第一扫描信号为无效电平，所述第二驱动模块驱动所述发光模块发光，所述第一驱动模块保持重置状态。
根据本发明实施例，在奇数帧期间，在重置时段，所述第一和第二开关晶体管导通，所述第一和第二驱动晶体管截止，所述第一电容和所述第二电容均被重置至重置状态，所述发光模块不发光；在补偿时段，所述第一开关晶体管和第一驱动晶体管导通，所述第二开关晶体管和第二驱动晶体管截止，所述第一电容存储所述第一驱动晶体管的阈值电压，所述第二电容保持重置状态，所述发光模块不发光；在数据写入时段，所述第一开关晶体管和第一驱动晶体管导通，所述第二开关晶体管和第二驱动晶体管截止，所述第一电容存储所述第一驱动晶体管的阈值电压以及所述数据输入端的数据信号，所述第二电容保持重置状态，所述发光模块不发光；在发光时段，所述第一开关晶体管、第二开关晶体管和第二驱动晶体管截止，所述第一电容保持其两端电压，所述第一驱动晶体管导通并驱动所述发光模块发光，所述第二电容保持重置状态。
根据本发明实施例，在偶数帧期间，在重置时段，所述第一和第二开关晶体管导通，所述第一和第二驱动晶体管截止，所述第一电容和所述第二电容均被重置至重置状态，所述发光模块不发光；在补偿时段，所述第一开关晶体管和第一驱动晶体管截止，所述第二开关晶体管和第二驱动晶体管导通，所述第一电容保持重置状态，所述第二电容存储所述第二驱动晶体管的阈值电压，所述发光模块不发光；在数据写入时段，所述第一开关晶体管和第一驱动晶体管截止，所述第二开关晶体管和第二驱动晶体管导通，所述第一电容保持重置状态，所述第二电容存储所述第二驱动晶体管的阈值电压以及所述数据输入端的数据信号，所述发光模块不发光；在发光阶段，所述第一开关晶体管、第一驱动晶体管和第二开关晶体管截止，所述第一电容保持重置状态，所述第二电容保持其两端电压，所述第二驱动晶体管导通并驱动所述发光模块发光。
根据本发明另一方面，提供了一种显示面板，包括像素阵列、栅极驱动电路以及数据驱动电路，所述像素阵列中的每个像素包括如上所述的像素电路。
根据本发明实施例的像素电路及其驱动方法以及显示面板，通过利用第一驱动模块和第二驱动模块交替地驱动发光模块发光，使得在第一驱动模块驱动发光模块发光期间第二驱动模块处于恢复阶段以及在第二驱动模块驱动发光模块发光期间第一驱动模块处于恢复阶段，从而每个驱动模块中的驱动晶体管可以在工作一时段后进入恢复期，由此可以降低每个驱动模块中的驱动晶体管的阈值电压漂移，并且可以增加第一驱动模块的驱动晶体管和第二驱动模块的驱动晶体管的使用寿命，从而可以延长显示面板的使用寿命。
本发明的其它特征和优点将在随后的说明书中阐述，并且，部分地从说明书中变得显而易见，或者通过实施本发明而了解。本发明的目的和其他优点可通过在说明书、权利要求书以及附图中所特别指出的结构来实现和获得。
附图说明
通过结合附图对本发明实施例进行更详细的描述，本发明的上述以及其它目的、特征和优势将变得更加明显。附图用来提供对本发明实施例的进一步理解，并且构成说明书的一部分，与本发明实施例一起用于解释本发明，并不构成对本发明的限制。在附图中，相同的参考标号通常代表相同部件或步骤。
图1是根据本发明实施例的像素电路的示意性框图；
图2是根据本发明实施例的像素电路的另一示意性框图；
图3是根据本发明实施例的像素电路的各信号端的信号在各个工作时段的示意性时序图；
图4是根据本发明实施例的像素电路中的第一驱动模块和第二驱动模块的示例电路图；
图5是根据本发明实施例的写入控制模块的示例电路图；
图6是根据本发明实施例的像素电路的各信号端的信号在各个工作时段的示意性时序图；
图7是根据本发明实施例的像素电路的示例电路图；
图8是根据本发明实施例的像素电路在重置时段的等效电路图；
图9是根据本发明实施例的像素电路在补偿时段的等效电路图；
图10是根据本发明实施例的像素电路在数据写入时段的等效电路图；
图11是根据本发明实施例的像素电路在发光时段的等效电路图；以及
图12是根据本发明实施例的显示面板的示意性框图。
具体实施方式
为了使得本发明实施例的目的、技术方案和优点更为明显，下面将参照附图详细描述本发明的示例实施例。显然，所描述的示例实施例仅仅是本发明的一部分实施例，而不是本发明的全部实施例，本领域技术人员在没有付出创造性劳动的情况下所得到的所有其它实施例都应落入本发明的保护范围之内。
这里，需要注意的是，在附图中，将相同的附图标记赋予基本上具有相同或类似结构和功能的组成部分，并且将省略关于它们的重复描述。
图1是根据本发明实施例的像素电路的示意性框图。如图1所示，根据本发明实施例的像素电路包括发光模块11、第一驱动模块12和第二驱动模块13。
所述发光模块11的第一端1与第一驱动模块12的第一端1和第二驱动模块13的第一端1连接，其第二端2与第一电源电压端V1连接。
所述第一驱动模块12的第二端2与第一驱动电压端VD1连接，其第三端3与第一扫描控制端SCAN1连接，其第四端4与数据输入端DATA连接。所述第一驱动模块12被配置为在所述第一扫描控制端SCAN1的第一扫描信号的控制下在第一时段期间驱动所述发光模块11发光。
所述第二驱动模块13的第二端2与第二驱动电压端VD2连接，其第三端3与第二扫描控制端SCAN2连接，其第四端4与所述数据输入端DATA连接。所述第二驱动模块13被配置为在所述第二扫描控制端SCAN2的第二扫描信号的控制下在第二时段期间驱动所述发光模块11发光，所述第一时段和所述第二时段彼此不重叠。
所述第一驱动模块12和第二驱动模块13交替地驱动所述发光模块11发光。
根据本发明实施例，所述第一时段和第二时段的时长相等，并且均可以为一帧、两帧、多帧或任何合适的时段。例如，第一时段可以为奇数帧，所述第二时段可以为偶数帧，即：所述第一驱动模块12可以在奇数帧期间驱动所述发光模块11发光，所述第二驱动模块13可以在偶数帧期间驱动所述发光模块11发光。再例如，第一时段可以为偶数帧，所述第二时段可以为奇数帧，即：所述第一驱动模块12可以在偶数帧期间驱动所述发光模块11发光，所述第二驱动模块13可以在奇数帧期间驱动所述发光模块11发光。
根据本发明实施例，在所述第一驱动模块12驱动所述发光模块11发光的所述第一时段期间，所述第二驱动模块13处于恢复阶段；而在所述第二驱动模块13驱动所述发光模块11发光的所述第二时段期间，所述第一驱动模块12处于恢复阶段。
通过使得所述第一驱动模块12和第二驱动模块13交替地驱动发光模块11发光，并且使得在第一驱动模块12驱动发光模块11发光期间第二驱动模块13处于恢复阶段以及在第二驱动模块13驱动发光模块11发光期间第一驱动模块12处于恢复阶段，第一驱动模块12和第二驱动模块13每个驱动模块中的驱动晶体管可以在工作一时段后进入恢复期，由此可以降低第一驱动模块12和第二驱动模块13每个驱动模块中的驱动晶体管的阈值电压漂移，从而可以延长显示面板的使用寿命。
图2是根据本发明实施例的像素电路的另一示意性框图。如图2所示，根据本发明实施例的像素电路还包括写入控制模块14。
所述写入控制模块14的第一端与第二电源电压端V2连接，其第二端与第三电源电压端V3连接，其第三端与写入控制端EM连接，其第四端作为所述第一驱动电压端VD1，其第五端作为所述第二驱动电压端VD2。
所述写入控制模块14被配置为：在所述写入控制端EM的写入控制信号的控制下，根据所述第二电源电压端V2的第二电源电压信号和所述第三电源电压端V3的第三电源电压信号，产生所述第一驱动电压端VD1的第一驱动电压信号和所述第二驱动电压端VD2的第二驱动电压信号。
下面，将以第一时段为奇数帧且第二时段为偶数帧为例介绍根据本发明实施例的像素电路。
根据本发明实施例，在奇数帧期间，在所述第一扫描控制端SCAN1的第一扫描信号和所述第一驱动电压端VD1的第一驱动电压信号的控制下，所述第一驱动模块12可以读取所述数据输入端DATA的数据信号并且根据所读取的数据信号驱动所述发光模块11发光，而在偶数帧期间，所述第一驱动模块12被重置并且处于恢复阶段。
根据本发明实施例，在奇数帧期间，所述第二驱动模块13被重置并且处于恢复阶段，而在偶数帧期间，在所述第二扫描控制端SCAN2的第二扫描信号和所述第二驱动电压端VD2的第二驱动电压信号的控制下，所述第二驱动模块13读取所述数据输入端DATA的数据信号并且根据所读取的数据信号驱动所述发光模块11发光。
根据本发明实施例，每帧可以被划分为重置时段、补偿时段、数据写入时段和发光时段。
在奇数帧(第(2n-1)帧)期间，在重置时段，所述第一驱动模块12和所述第二驱动模块13均被重置；在补偿时段，所述第一驱动模块12在所述第一扫描控制端SCAN1的第一扫描控制信号以及所述第一驱动电压端VD1的第一驱动电压信号的作用下，补偿所述第一驱动模块12中驱动晶体管的阈值电压漂移；在数据写入时段，所述第一驱动模块12在所述第一扫描控制端SCAN1的第一扫描控制信号以及所述第一驱动电压端VD1的第一驱动电压信号的作用下，读取所述数据输入端DATA的数据信号；在发光时段，所述第一驱动模块12根据所读取的数据信号驱动所述发光模块11发光；以及在补偿时段、数据写入时段和发光时段，所述第二驱动模块13保持重置状态以处于恢复阶段。
在偶数帧(第(2n)帧)期间，在重置时段，所述第一驱动模块12和所述第二驱动模块13均被重置；在补偿时段，所述第二驱动模块13在所述第二扫描控制端SCAN2的第二扫描控制信号以及所述第二驱动电压端VD2的第二驱动电压信号的作用下，补偿所述第二驱动模块13中驱动晶体管的阈值电压漂移；在数据写入时段，所述第二驱动模块13在所述第二扫描控制端SCAN2的第二扫描控制信号以及所述第二驱动电压端VD2的第二驱动电压信号的作用下，读取所述数据输入端DATA的数据信号；在发光时段，所述第二驱动模块13根据所读取的数据信号驱动所述发光模块11发光；以及在补偿时段、数据写入时段和发光时段，所述第一驱动模块12保持重置状态以处于恢复阶段。
图3是根据本发明实施例的像素电路的各信号端的信号在各个工作时段的示意性时序图。在图3中，重置时段、补偿时段、数据写入时段和发光时段分别被表示为I、II、III和IV。
根据本发明实施例，在每帧的重置时段I，所述第一驱动电压端VD1和第二驱动电压端VD2均输出非驱动电压；在奇数帧期间，在所述数据写入时段，所述第一驱动电压端VD1浮置并且无电压输出；在所述补偿时段和发光时段，所述第一驱动电压端VD1输出驱动电压；在偶数帧期间，在所述数据写入时段，所述第二驱动电压端VD2浮置并且无电压输出；在所述补偿时段和发光时段，所述第二驱动电压端VD2输出驱动电压。可选地，所述第二驱动电压端VD2与所述第一驱动电压端VD1相同(如图3中VD1/VD2所示)，所述第三电源电压端V3与所述第二电源电压端V2相同。在此情况下，在第一时段和第二时段每个时段的重置时段I，在所述第一驱动电压端VD1输出非驱动电压；在数据写入时段，所述第一驱动电压端VD1浮置并且无电压输出；在补偿时段和发光时段，所述第一驱动电压端VD1输出驱动电压。
替代地，可选地，所述第二驱动电压端VD2与所述第一驱动电源端VD1不同，所述第三电源电压端V3与所述第二电源电压端V2相同或不同。在此情况下，在奇数帧和偶数帧的重置时段，所述第一驱动电压端VD1和第二驱动电压端VD2均输出非驱动电压；在奇数帧期间，在所述补偿时段、数据写入时段和发光时段中，所述第二驱动电压端VD2浮置或输出非驱动电压，在所述数据写入时段，所述第一驱动电压端VD1浮置并且无电压输出，在所述补偿时段和发光时段，所述第一驱动电压端VD1输出驱动电压；在偶数帧期间，在所述补偿时段、数据写入时段和发光时段中，所述第一驱动电压端VD1浮置或输出非驱动电压，在所述数据写入时段，所述第二驱动电压端VD2浮置并且无电压输出，在所述补偿时段和发光时段，所述第二驱动电压端VD2输出驱动电压。
此外，根据本发明实施例，在奇数帧期间，在所述重置时段I，所述第一扫描控制端SCAN1的第一扫描信号和第二扫描控制端SCAN2的第二扫描信号均为有效电平；在补偿时段II和数据写入时段III，所述第一扫描控制端SCAN1的第一扫描信号为有效电平且所述第二扫描控制端SCAN2的第二扫描信号为无效电平；在所述发光时段IV，所述第一扫描控制端SCAN1的第一扫描信号和第二扫描控制端SCAN2的第二扫描信号均为无效电平。在偶数帧期间，在所述重置时段I，所述第一扫描控制端SCAN1的第一扫描信号和第二扫描控制端SCAN2的第二扫描信号均为有效电平；在补偿时段II和数据写入时段III，所述第一扫描控制端SCAN1的第一扫描信号为无效电平且所述第二扫描控制端SCAN2的第二扫描信号为有效电平；在所述发光时段IV，所述第一扫描控制端SCAN1的第一扫描信号和第二扫描控制端SCAN2的第二扫描信号均为无效电平。
图4是根据本发明实施例的像素电路中的第一驱动模块12和第二驱动模块13的示例电路图。
如图4所示，所述第一驱动模块12包括第一开关晶体管T1、第一驱动晶体管T2和第一电容C1；所述第二驱动模块13包括第二开关晶体管T3、第二驱动晶体管T4和第二电容C2。
所述第一开关晶体管T1的栅极作为所述第一驱动模块12的第三端与所述第一扫描控制端SCAN1连接，所述第一开关晶体管T1的第一极作为所述第一驱动模块12的第四端与所述数据输入端DATA连接，所述第一开关晶体管T1的第二极与所述第一驱动晶体管T2的栅极和所述第一电容C1的第一端1连接。
所述第一驱动晶体管T2的第一极作为所述第一驱动模块12的第二端与所述第一驱动电压端VD1连接，所述第一驱动晶体管T2的第二极作为所述第一驱动模块12的第一端与所述发光模块11的第一端和所述第一电容C1的第二端2连接。
所述第二开关晶体管T3的栅极作为所述第二驱动模块13的第三端与所述第二扫描控制端SCAN2连接，所述第二开关晶体管T3的第一极作为所述第二驱动模块13的第四端与所述数据输入端DATA连接，所述第二开关晶体管T3的第二极与所述第二驱动晶体管T4的栅极和所述第二电容C2的第一端1连接。
所述第二驱动晶体管T4的第一极作为所述第二驱动模块13的第二端与所述第二驱动电压端VD2连接，所述第二驱动晶体管T4的第二极作为所述第二驱动模块13的第一端与所述发光模块11的第一端和所述第二电容C2的第二端2连接。
根据本发明实施例，所述发光模块11可以包括有机发光二极管OLED。
作为示例，所述有机发光二极管的阳极作为所述发光模块11的第一端，并且所述有机发光二极管的阴极作为所述发光模块11的第二端，所述第一电源电压端V1为电源低电压端。
可选地，所述第一开关晶体管T1、第一驱动晶体管T2、第二开关晶体管T3和第二驱动晶体管T4均为N型晶体管，并且每个晶体管的第一极和第二极分别为漏极和源极。在此情况下，所述非驱动电压为低电压，所述驱动电压为高电压；以及所述第一和第二扫描信号的有效电平为高电平，所述第一和第二扫描信号的无效电平为低电平。
替换地，所述第一开关晶体管T1、第一驱动晶体管T2、第二开关晶体管T3和第二驱动晶体管T4均为P型晶体管，并且每个晶体管的第一极和第二极分别为源极和漏极。在此情况下，所述非驱动电压为低电压，所述驱动电压为高电压；以及所述第一和第二扫描信号的有效电平为低电平，所述第一和第二扫描信号的无效电平为高电平。
图5是根据本发明实施例的写入控制模块14的示例电路图。
如图5的(A)所示，根据本发明实施例的写入控制模块14可以包括第五开关晶体管T5。该第五开关晶体管T5的栅极作为所述写入控制模块14的第三端与所述写入控制端EM连接，其第一端与第二电源电压端V2(VDD)连接，其第二端作为所述第一和第二驱动电压端VD1、VD2。在此情况下，如上所述的所述第二电源电压端V2和第三电源电压端V3为同一电源电压端VDD。
可选地，所述第五开关晶体管T5为N型晶体管，其第一极和第二极分别为漏极和源极。在此情况下，所述写入控制端EM的写入控制信号的有效电平为高电平，所述写入控制信号的无效电平为低电平。
替换地，所述第五开关晶体管T5为P型晶体管，其第一极和第二极分别为源极和漏极。在此情况下，所述写入控制端EM的写入控制信号的有效电平为低电平，所述写入控制端EM的写入控制信号的无效电平为高电平。
如图5的(B)所示，根据本发明实施例的写入控制模块14可以包括第五开关晶体管T5和第六开关晶体管T6。所述第五开关晶体管T5的栅极和所述第六开关晶体管T6的栅极作为所述写入控制模块14的第三端与所述写入控制端EM连接，所述第五开关晶体管T5的第一极与第二电源电压端V2(VDD1)连接，所述第五开关晶体管T5的第二极作为所述第一驱动电压端VD1，所述第六开关晶体管T6的第一极与第三电源电压端V3(VDD2)连接，所述第六开关晶体管T6的第二极作为所述第二驱动电压端VD2。
可选地，所述第五开关晶体管T5和第六开关晶体管T6均为N型晶体管，并且其第一极和第二极分别为漏极和源极。在此情况下，所述写入控制端EM的写入控制信号的有效电平为高电平，所述写入控制信号的无效电平为低电平。
替换地，所述第五开关晶体管T5和第六开关晶体管T6均为P型晶体管，并且其第一极和第二极分别为源极和漏极。在此情况下，所述写入控制端EM的写入控制信号的有效电平为低电平，所述写入控制端EM的写入控制信号的无效电平为高电平。
图6是根据本发明实施例的像素电路的各信号端的信号在各个工作时段的示意性时序图。
对于图5的(A)所示的写入控制模块14，在重置时段I、补偿时段II以及发光时段IV，所述写入控制端EM的写入控制信号处于有效电平，所述第五开关晶体管T5导通，将电源电压端VDD的电源电压信号传递到所述驱动电压端VD1/VD2；而在数据写入时段III，所述写入控制端EM的写入控制信号处于无效电平，所述第五开关晶体管T5截止，将所述驱动电压端VD1/VD2浮置。
此外，在重置时段I，所述电源电压端VDD的电源电压为非驱动电压；在补偿时段II和发光时段IV，所述电源电压端VDD的电源电压为驱动电压；在数据写入时段III，所述电源电压端VDD的电源电压可以为驱动电压也可以为非驱动电压。
对于图5的(B)所示的写入控制模块14，在奇数帧(第(2n-1)帧)期间，所述第一电源电压端VDD1和第二电源电压端VDD2的电源电压为非驱动电压，在补偿时段II和发光时段IV，所述第一电源电压端VDD1的电源电压为驱动电压；在数据写入时段III，所述第一电源电压端VDD1的电源电压可以为驱动电压也可以为非驱动电压；在补偿时段II、数据写入时段III和发光时段IV，所述第二电源电压端VDD2的电源电压可以为非驱动电压或驱动电压。
对于图5的(B)所示的写入控制模块14，在偶数帧(第(2n)帧)期间，所述第一电源电压端VDD1和第二电源电压端VDD2的电源电压为非驱动电压，在补偿时段II和发光时段IV，所述第二电源电压端VDD2的电源电压为驱动电压；在数据写入时段III，所述第二电源电压端VDD2的电源电压可以为驱动电压也可以为非驱动电压；在补偿时段II、数据写入时段III和发光时段IV，所述第一电源电压端VDD1的电源电压可以为非驱动电压或驱动电压。
图7是根据本发明实施例的像素电路的示例电路图。如图7所示的像素电路中的写入控制模块为图5的(A)所示的写入控制模块。
下面，参考图6以及图8－图11描述如图7所示的根据本发明实施例的像素电路的驱动方法。
在奇数帧期间，在所述第一扫描控制端SCAN1的第一扫描信号的控制下，所述第一驱动模块12读取所述数据输入端DATA的数据信号并且根据所读取的数据信号驱动所述发光模块11发光；在所述第二扫描控制端SCAN2的第二扫描信号的控制下，所述第二驱动模块13被重置并且处于恢复阶段。
在偶数帧期间，在所述第二扫描控制端SCAN2的第二扫描信号的控制下，所述第二驱动模块13读取所述数据输入端DATA的数据信号并且根据所读取的数据信号驱动所述发光模块11发光；在所述第一扫描控制端SCAN1的第一扫描信号的控制下，所述第一驱动模块12被重置并且处于恢复阶段。
如图6所示，每帧被划分为重置时段I、补偿时段II、数据写入时段III和发光时段IV。图8－图11为根据本发明实施例的像素电路在奇数帧期间在各个时段的等效电路图。下面，以奇数帧为例来描述如图7所示的根据本发明实施例的像素电路的操作。
在重置时段I，所述第二电源电压端VDD处于非驱动电压Vss，所述写入控制端EM处于有效电平，所述写入控制模块14中的第五开关晶体管T5导通，所述第一驱动电压端VD1和第二驱动电压端VD2输出所述第二电源电压端VDD的电源电压，即非驱动电压Vss。此外，在此时段中，所述第一扫描控制端SCAN1的第一扫描信号和所述第二扫描控制端SCAN2的第二扫描信号均为有效电平，第一驱动模块12中的第一开关晶体管T1和第二驱动模块13中的第二开关晶体管T3导通，将所述数据输入端DATA的数据电压Vss传递到第一驱动晶体管T2和第二驱动晶体管T4的栅极，第一驱动晶体管T2和第二驱动晶体管T4截止，对第一电容C1和第二电容C2放电，使得第一电容C1两端的电压差以及第二电容C2两端的电压差为零。在此时段中，所述第一驱动晶体管T2和第二驱动晶体管T4的栅源电压为零，第一驱动晶体管T2和第二驱动晶体管T4进入恢复阶段。此外，在此时段中，还对发光模块11中的电容(例如，发光二极管的寄生电容C3，下文中称为第三电容C3)放电。根据本发明实施例的像素电路在此时段的等效电路图如图8所示。在此时段中，VA1＝Vss，VA2＝Vss，VB＝Vss，由此所述第一和第二驱动模块12和13被重置，所述发光模块11不发光。
在补偿时段II，所述第二电源电压端VDD处于驱动电压Vdd，所述写入控制端EM保持处于有效电平，所述写入控制模块14中的第五开关晶体管T5导通，所述第一驱动电压端VD1和第二驱动电压端VD2输出所述第二电源电压端VDD的电源电压，即驱动电压Vdd。此外，在此时段中，所述第一扫描控制端SCAN1的第一扫描信号为有效电平，第一驱动模块12中的第一开关晶体管T1保持导通，将所述数据输入端DATA的数据电压Vref传递到第一驱动晶体管T2的栅极，Vref－Vss>Vth2，Vth2为第一驱动晶体管T2的阈值电压，所述第一驱动晶体管T2导通，并且所述第三电容C3被充电；所述第二扫描控制端SCAN2的第二扫描信号为无效电平，第二驱动模块13中的第二开关晶体管T3截止，所述第二驱动晶体管T4保持截止，即第二驱动模块13保持处于重置状态。在进入补偿时段II时，VA1＝Vref，VB＝Vss，且Vgs2＝Vref－Vss>Vth2，其中，Vgs2为第一驱动晶体管T2的栅源电压，因此第一驱动晶体管T2导通。随着第三电容C3的充电，B点的电压VB升高，在VB上升至Vref－Vth2时，第一驱动晶体管T2截止，由此在第一电容C1两端上存储的电压为VC1＝VA1－VB＝Vref－(Vref－Vth2)＝Vth2。根据本发明实施例的像素电路在此时段的等效电路图如图9所示。在该时段结束时，VA1＝Vref，VB＝Vref－Vth2，VC1＝Vth2，由此第一电容C1存储了第一驱动晶体管T2的阈值电压，即，第一驱动模块12进行了第一驱动晶体管T2的阈值电压补偿，并且所述发光模块11不发光。
在数据写入时段III，所述第二电源电压端VDD处于驱动电压Vdd或者处于非驱动电压Vss，所述写入控制端EM处于无效电平，所述写入控制模块14中的第五开关晶体管T5截止，所述第一驱动电压端VD1和第二驱动电压端VD2浮置。此外，在此时段中，所述第一扫描控制端SCAN1的第一扫描信号为有效电平，第一驱动模块12中的第一开关晶体管T1保持导通，将所述数据输入端DATA的数据电压Vdata传递到第一驱动晶体管T2的栅极，Vdata－VB＝Vdata－(Vref－Vth2)＝Vth2+(Vdata－Vref)>Vth2，所述第一驱动晶体管T2导通；所述第二扫描控制端SCAN2的第二扫描信号为无效电平，第二驱动模块13中的第二开关晶体管T3保持截止，所述第二驱动晶体管T4保持截止，即第二驱动模块13保持处于重置状态。在此时段中，尽管第一驱动晶体管T2导通，但是由于第一驱动电压端VD1浮置，B点电压由第一电容C1和第三电容C3的电容量决定，因此在第三电容C3充电完成时，VB＝(Vref－Vth2)+a1(Vdata－Vref)，其中，a1＝C1/(C1+C3)。根据本发明实施例的像素电路在此时段的等效电路图如图10所示。在此时段结束时，VA1＝Vdata，VB＝(Vref－Vth2)+a1(Vdata－Vref)，Vgs2＝VA1－VB＝(1－a1)(Vdata－Vref)+Vth2，由此第一电容C1存储了所述第一驱动晶体管T2的阈值电压Vth2以及所述数据输入端DATA的数据信号Vdata，即，第一驱动模块12读入了所述数据输入端DATA的数据信号Vdata，并且所述发光模块11不发光。
在发光时段IV，所述第二电源电压端VDD处于驱动电压Vdd，所述写入控制端EM处于有效电平，所述写入控制模块14中的第五开关晶体管T5导通，所述第一驱动电压端VD1和第二驱动电压端VD2输出所述第二电源电压端VDD的电源电压，即驱动电压Vdd。此外，在此时段中，所述第一扫描控制端SCAN1的第一扫描信号为无效电平，第一驱动模块12中的第一开关晶体管T1截止，第一电容C1保持其两端电压，所述第一驱动晶体管T2导通并驱动所述发光模块11发光；所述第二扫描控制端SCAN2的第二扫描信号为无效电平，第二驱动模块13中的第二开关晶体管T3保持截止，所述第二驱动晶体管T4保持截止，即第二驱动模块13保持重置状态。根据本发明实施例的像素电路在此时段的等效电路图如图11所示。在此时段中，第一驱动晶体管T2的栅源电压保持为Vgs2＝(1－a1)(Vdata－Vref)+Vth2，由此第一驱动晶体管T2保持导通，并且流过第五驱动晶体管T5、第一驱动晶体管T2和发光器件的电流IOLED可以被表示为：
其中，W2和L2分别为第一驱动晶体管T2的沟道宽度和长度，μn为有效载流子迁移率，Cox为栅极绝缘层的介电常数。
由上式可知，在奇数帧期间，流过发光器件的电流IOLED与第一驱动晶体管T2的阈值电压无关，仅与在补偿时段在数据输入端施加的数据电压Vref和在数据写入时段在数据输入端施加的数据电压Vdata有关，由此消除了驱动晶体管T2的阈值电压的非均匀性和漂移对发光器件的发光亮度的影响。
上面描述了根据本发明实施例的像素电路在奇数帧期间的操作，具体地，在奇数帧期间，根据本发明实施例的像素电路中的第一驱动模块读取数据输入端DATA的数据信号并且根据所读取的数据信号驱动发光模块发光，而第二驱动模块被重置并且处于恢复阶段。
类似地，在偶数帧期间，根据本发明实施例的像素电路中的第二驱动模块读取数据输入端DATA的数据信号并且根据所读取的数据信号驱动发光模块发光，而第一驱动模块被重置并且处于恢复阶段。
在重置时段I，根据本发明实施例的像素电路的操作与在奇数帧期间的重置时段I中的操作相同，在此不再赘述。
在补偿时段II，所述第二电源电压端VDD处于驱动电压Vdd，所述写入控制端EM保持处于有效电平，所述写入控制模块14中的第五开关晶体管T5导通，所述第一驱动电压端VD1和第二驱动电压端VD2输出驱动电压Vdd。此外，在此时段中，所述第二扫描控制端SCAN2的第二扫描信号为有效电平，第二驱动模块13中的第二开关晶体管T3保持导通，所述数据输入端DATA输入数据电压Vref，Vref－Vss>Vth4，其中，Vth4为第二驱动模块13中的第二驱动晶体管T4的阈值电压，所述第二驱动晶体管T4导通，第三电容C3被充电；所述第一扫描控制端SCAN1的第一扫描信号为无效电平，第一驱动模块12中的第一开关晶体管T1截止，所述第一驱动晶体管T2保持截止，即第一驱动模块12保持处于重置状态。在进入补偿时段II时，VA2＝Vref，VB＝Vss，且数据电压Vgs4＝Vref－Vss>Vth4，其中，Vgs4为第一驱动晶体管T2的栅源电压，因此第二驱动晶体管T4导通。随着第三电容C3的充电，B点的电压VB升高，在VB上升至Vref－Vth4时，第二驱动晶体管T4截止，由此在第二电容C2两端上存储的电压为VC2＝VA2－VB＝Vref－(Vref－Vth4)＝Vth4。在该时段结束时，VA2＝Vref，VB＝Vref－Vth4，由此第二电容C2存储了第二驱动晶体管T4的阈值电压，即，第二驱动模块13进行了第二驱动晶体管T4的阈值电压补偿，并且所述发光模块11不发光。
在数据写入时段III，所述第二电源电压端VDD处于驱动电压Vdd或者处于非驱动电压Vss，所述写入控制端EM处于无效电平，所述写入控制模块14中的第五开关晶体管T5截止，所述第一驱动电压端VD1和第二驱动电压端VD2浮置。此外，在此时段中，所述第二扫描控制端SCAN2的第二扫描信号为有效电平，第二驱动模块13中的第二开关晶体管T3保持导通，所述数据输入端DATA输入数据电压Vdata，Vdata－VB＝Vdata－(Vref－Vth4)＝Vth4+(Vdata－Vref)，所述第二驱动晶体管T4导通；所述第一扫描控制端SCAN1的第一扫描信号为无效电平，第一驱动模块12中的第一开关晶体管T1和第一驱动晶体管T2保持截止，即第一驱动模块12保持处于重置状态。在此时段中，在第三电容C3充电完成时，B点电压由第二电容C2和第三电容C3的电容量决定，VB＝(Vref－Vth4)+a2(Vdata－Vref)，其中，a2＝C2/(C2+C3)。在此时段结束时，VA2＝Vdata，VB＝(Vref－Vth4)+a2(Vdata－Vref)，Vgs4＝VA2－VB＝(1－a2)(Vdata－Vref)+Vth4，由此第二电容C2存储了所述第二驱动晶体管T4的阈值电压Vth4以及所述数据输入端DATA的数据信号Vdata，即，第二驱动模块13读入了所述数据输入端DATA的数据信号Vdata，并且所述发光模块11不发光。
在发光时段IV，所述第二电源电压端VDD处于驱动电压Vdd，所述写入控制端EM处于有效电平，所述写入控制模块14中的第五开关晶体管T5导通，所述第一驱动电压端VD1和第二驱动电压端VD2输出驱动电压Vdd。此外，在此时段中，所述第二扫描控制端SCAN2的第二扫描信号为无效电平，第二驱动模块13中的第二开关晶体管T3截止，第二电容C2保持其两端电压，所述第二驱动晶体管T4导通并驱动所述发光模块11发光；所述第一扫描控制端SCAN1的第一扫描信号为无效电平，第一驱动模块12中的第一开关晶体管T1保持截止，所述第一驱动晶体管T2保持截止，即第一驱动模块12保持重置状态。在此时段中，第二驱动晶体管T4的栅源电压保持为Vgs4＝(1－a2)(Vdata－Vref)+Vth4，由此第二驱动晶体管T4保持导通，并且流过第五开关晶体管T5、第二驱动晶体管T4和发光器件的电流IOLED可以被表示为：
其中，W4和L4分别为第二驱动晶体管T4的沟道宽度和长度。
由上式可知，在偶数帧期间，流过发光器件的电流IOLED与第二驱动晶体管T4的阈值电压无关，仅与在补偿时段在数据输入端施加的数据电压Vref和在数据写入时段在数据输入端施加的数据电压Vdata有关，由此消除了驱动晶体管T4的阈值电压的非均匀性和漂移对发光器件的发光亮度的影响。
为了保持发光器件在奇数帧和偶数帧期间在相同的数据电压下的发光亮度相同，在电路结构上可以使得第一电容C1和第二电容C2的结构参数完全相同并且使得第一驱动晶体管T2和第二驱动晶体管T4的结构参数完全相同，即：使得第一电容C1和第二电容C2的电容值相同，并且使得第一驱动晶体管T2和第二驱动晶体管T4的沟道参数(宽度和长度)相同。
上面描述了根据本发明实施例的应用图5的(A)所示的写入控制模块14的像素电路在奇数帧和偶数帧期间的操作，下面将简要描述根据本发明实施例的应用图5的(B)所示的写入控制模块14的像素电路在奇数帧和偶数帧期间的操作。
如图5的(B)所示，所述第二驱动电压端VD1与所述第一驱动电压端VD2不同，所述第三电源电压端VDD2与所述第二电源电压端VDD1相同或不同。
下面，首先描述在根据本发明实施例的应用图5的(B)所示的写入控制模块14的像素电路奇数帧期间的操作。
在重置时段I，所述第二电源电压端VDD1和第三电源电压端VDD2均处于非驱动电压Vss，所述写入控制端EM处于有效电平，所述写入控制模块14中的第五开关晶体管T5和第六开关晶体管T6导通，所述第一驱动电压端VD1和第二驱动电压端VD2均输出非驱动电压Vss。此外，在此时段中，所述第一扫描控制端SCAN1的第一扫描信号和所述第二扫描控制端SCAN2的第二扫描信号均为有效电平，第一驱动模块12中的第一开关晶体管T1和第二驱动模块13中的第二开关晶体管T3导通，所述数据输入端DATA输入数据电压Vss，第一驱动晶体管T2和第二驱动晶体管T4截止。在此时段中，VA1＝Vss，VA2＝Vss，VB＝Vss。
在补偿时段II、数据写入时段III和发光时段IV，所述写入控制模块14中的第五开关晶体管T5、所述第一驱动模块12中的第一开关晶体管T1和第一驱动晶体管T2的操作与上面针对根据本发明实施例的应用图5的(A)所示的写入控制模块14的像素电路在奇数帧期间的操作相同，在此不再赘述。
此外，在补偿时段II、数据写入时段III和发光时段IV，所述第三电源电压端VDD2可以为驱动电压或者非驱动电压，所述写入控制模块14中的第六开关晶体管T6的操作与第五开关晶体管T5的操作相同，区别仅在于第二驱动电压端VD2输出第三电源电压端VDD2的电源电压；此外，所述第二驱动模块13中的第二开关晶体管T3和第二驱动晶体管T4的操作与上面针对根据本发明实施例的应用图5的(A)所示的写入控制模块14的像素电路中的第二开关晶体管T3和第二驱动晶体管T4在奇数帧期间的操作相同，在此不再赘述。
下面简要描述根据本发明实施例的应用图5的(B)所示的写入控制模块14的像素电路在偶数帧期间的操作。
在重置时段I，根据本发明实施例的应用图5的(B)所示的写入控制模块14的像素电路的操作与在奇数帧期间的重置时段I的操作相同，在此不再赘述。
在补偿时段II、数据写入时段III和发光时段IV，所述写入控制模块14中的第六开关晶体管T6、所述第二驱动模块13中的第二开关晶体管T3和第二驱动晶体管T4的操作与上面针对根据本发明实施例的应用图5的(A)所示的写入控制模块14的像素电路在偶数帧期间的操作相同，在此不再赘述。
此外，在补偿时段II、数据写入时段III和发光时段IV，所述第二电源电压端VDD1可以为驱动电压或者非驱动电压，所述写入控制模块14中的第五开关晶体管T5的操作与第六开关晶体管T5的操作相同，区别仅在于第一驱动电压端VD1输出第二电源电压端VDD1的电源电压；此外，所述第一驱动模块12中的第一开关晶体管T1和第一驱动晶体管T2的操作与上面针对根据本发明实施例的应用图5的(A)所示的写入控制模块14的像素电路中的第一开关晶体管T1和第一驱动晶体管T2在偶数帧期间的操作相同，在此不再赘述。
图12是根据本发明实施例的显示面板的示意性框图。如图12所示，根据本发明实施例的显示面板包括像素阵列、栅极驱动电路以及数据驱动电路，所述像素阵列中的每个像素包括如上所述的根据本发明实施例的像素电路。
所述栅极驱动电路产生用于像素阵列中各行像素的扫描信号。具体地，对于像素阵列中每行像素，所述栅极驱动电路产生如上所述的第一扫描信号和第二扫描信号，所述第一扫描信号用于控制所述第一驱动模块12的操作，所述第二扫描信号用于控制所述第二驱动模块13的操作。
所述数据驱动电路产生用于像素阵列中各列像素的数据信号。具体地，对于像素阵列中每列像素，所述数据驱动电路在每帧的重置时段、补偿时段和数据写入时段分别产生如上所述的数据信号Vss、Vref和Vdata。
根据本发明实施例的像素电路及其驱动方法以及显示面板，通过利用第一驱动模块和第二驱动模块交替地驱动发光模块发光，使得在第一驱动模块驱动发光模块发光期间第二驱动模块处于恢复阶段以及在第二驱动模块驱动发光模块发光期间第一驱动模块处于恢复阶段，从而每个驱动模块中的驱动晶体管可以在工作一时段后进入恢复期，由此可以降低每个驱动模块中的驱动晶体管的阈值电压漂移，从而可以延长显示面板的使用寿命。
在上面详细描述了本发明的各个实施例。然而，本领域技术人员应该理解，在不脱离本发明的原理和精神的情况下，可对这些实施例进行各种修改，组合或子组合，并且这样的修改应落入本发明的范围内。

Claims (19)

1.一种像素电路，包括：
发光模块，其第一端与第一驱动模块的第一端和第二驱动模块的第一端连接，其第二端与第一电源电压端连接；
所述第一驱动模块，其第二端与第一驱动电压端连接，其第三端与第一扫描控制端连接，其第四端与数据输入端连接，并且被配置为：在第一时段期间，在所述第一扫描控制端的第一扫描信号和所述第一驱动电压端的第一驱动电压信号的控制下驱动所述发光模块发光，并且在第二时段期间，在所述第一扫描控制端的第一扫描信号和所述数据输入端的数据信号的控制下被重置且处于恢复阶段；以及
所述第二驱动模块，其第二端与第二驱动电压端连接，其第三端与第二扫描控制端连接，其第四端与所述数据输入端连接，并且被配置为：在第二时段期间，在所述第二扫描控制端的第二扫描信号和所述第二驱动电压端的第二驱动电压信号的控制下驱动所述发光模块发光，并且在第一时段期间，在所述第二扫描控制端的第二扫描信号和所述数据输入端的数据信号的控制下被重置且处于恢复阶段，所述第一时段和所述第二时段彼此不重叠；
其中，所述第一驱动模块和第二驱动模块交替地驱动所述发光模块发光。
2.如权利要求1所述的像素电路，其中，
所述第一驱动模块被配置为：在奇数帧期间，在所述第一扫描控制端的第一扫描信号和所述第一驱动电压端的第一驱动电压信号的控制下，所述第一驱动模块读取所述数据输入端的数据信号并且根据所读取的数据信号驱动所述发光模块发光，而在偶数帧期间，所述第一驱动模块被重置并且处于恢复阶段；
所述第二驱动模块被配置为：在奇数帧期间，所述第二驱动模块被重置并且处于恢复阶段，而在偶数帧期间，在所述第二扫描控制端的第二扫描信号和所述第二驱动电压端的第二驱动电压信号的控制下，所述第二驱动模块读取所述数据输入端的数据信号并且根据所读取的数据信号驱动所述发光模块发光。
3.如权利要求2所述的像素电路，其中，每帧被划分为重置时段、补偿时段、数据写入时段和发光时段，
在奇数帧期间，在所述重置时段，在所述第一和第二驱动电压端输出非驱动电压；在所述数据写入时段，所述第一驱动电压端浮置并且无电压输出；在所述补偿时段和发光时段，所述第一驱动电压端输出驱动电压；
在偶数帧期间，在所述重置时段，在所述第一和第二驱动电压端输出非驱动电压；在所述数据写入时段，所述第二驱动电压端浮置并且无电压输出；在所述补偿时段和发光时段，所述第二驱动电压端输出驱动电压；
其中，在奇数帧期间，在所述重置时段、补偿时段和数据写入时段，所述第一扫描信号为有效电平，而在所述发光时段，所述第一扫描信号为无效电平；在所述重置时段，所述第二扫描信号为有效电平，而在所述补偿时段、数据写入时段和发光时段，所述第二扫描信号为无效电平；
在偶数帧期间，在所述重置时段，所述第一扫描信号为有效电平，而在所述补偿时段、数据写入时段和发光时段，所述第一扫描信号为无效电平；在所述重置时段、补偿时段和数据写入时段，所述第二扫描信号为有效电平，而在所述发光时段，所述第二扫描信号为无效电平。
4.如权利要求3所述的像素电路，还包括：
写入控制模块，其第一端与第二电源电压端连接，其第二端与第三电源电压端连接，其第三端与写入控制端连接，其第四端作为所述第一驱动电压端，其第五端作为所述第二驱动电压端。
5.如权利要求4所述的像素电路，其中，所述第二驱动电压端与所述第一驱动电压端相同，所述第三电源电压端与所述第二电源电压端相同；
其中，在所述重置时段，所述第一驱动电压端输出非驱动电压；在所述数据写入时段，所述第一驱动电压端浮置并且无电压输出；在所述补偿时段和发光时段，所述第一驱动电压端输出驱动电压。
6.如权利要求4所述的像素电路，其中，所述第二驱动电压端与所述第一驱动电压端不同，所述第三电源电压端与所述第二电源电压端相同或不同；
其中，在奇数帧期间，在所述重置时段，所述第一驱动电压端和第二驱动电压端输出非驱动电压；在所述数据写入时段，所述第一驱动电压端浮置并且无电压输出；在所述补偿时段和发光时段，所述第一驱动电压端输出驱动电压；在所述补偿时段、数据写入时段和发光时段中，所述第二驱动电压端浮置或输出非驱动电压；
在偶数帧期间，在所述重置时段，所述第一驱动电压端和第二驱动电压端输出非驱动电压；在所述数据写入时段，所述第二驱动电压端浮置并且无电压输出；在所述补偿时段和发光时段，所述第二驱动电压端输出驱动电压；在所述补偿时段、数据写入时段和发光时段中，所述第一驱动电压端浮置或输出非驱动电压。
7.如权利要求5或6所述的像素电路，其中，
所述第一驱动模块包括第一开关晶体管、第一驱动晶体管和第一电容；所述第一开关晶体管的栅极作为所述第一驱动模块的第三端与所述第一扫描控制端连接，所述第一开关晶体管的第一极作为所述第一驱动模块的第四端与所述数据输入端连接，所述第一开关晶体管的第二极与所述第一驱动晶体管的栅极和所述第一电容的第一端连接；所述第一驱动晶体管的第一极作为所述第一驱动模块的第二端与所述第一驱动电压端连接，所述第一驱动晶体管的第二极作为所述第一驱动模块的第一端与所述发光模块的第一端和所述第一电容的第二端连接；
所述第二驱动模块包括第二开关晶体管、第二驱动晶体管和第二电容；所述第二开关晶体管的栅极作为所述第二驱动模块的第三端与所述第二扫描控制端连接，所述第二开关晶体管的第一极作为所述第二驱动模块的第四端与所述数据输入端连接，所述第二开关晶体管的第二极与所述第二驱动晶体管的栅极和所述第二电容的第一端连接；所述第二驱动晶体管的第一极作为所述第二驱动模块的第二端与所述第二驱动电压端连接，所述第二驱动晶体管的第二极作为所述第二驱动模块的第一端与所述发光模块的第一端和所述第二电容的第二端连接。
8.如权利要求7所述的像素电路，其中，所述第一开关晶体管、第一驱动晶体管、第二开关晶体管和第二驱动晶体管均为N型晶体管，并且每个开关晶体管的第一极和第二极分别为漏极和源极，
所述发光模块包括有机发光二极管，所述有机发光二极管的阳极作为所述发光模块的第一端，并且所述有机发光二极管的阴极作为所述发光模块的第二端，
其中，所述非驱动电压为低电压，所述驱动电压为高电压；以及所述有效电平为高电平，所述无效电平为低电平。
9.如权利要求6所述的像素电路，其中，
所述写入控制模块包括第五开关晶体管，其栅极作为所述写入控制模块的第三端与所述写入控制端连接，其第一端与第二电源电压端连接，其第二端作为所述第一和第二驱动电压端，
其中，在所述数据写入时段中，所述写入控制端的写入控制信号处于无效电平，使得所述第五开关晶体管截止，而在其余时段中，所述写入控制端的写入控制信号处于有效电平，使得所述第五开关晶体管导通，
其中，在所述重置时段中，所述第二电源电压端处于低电压，而在补偿时段和发光时段中，所述第二电源电压端处于高电压。
10.一种如权利要求1所述的像素电路的驱动方法，包括：
在奇数帧期间，在所述第一扫描控制端的第一扫描信号和所述第一驱动电压端的第一驱动电压信号的控制下，所述第一驱动模块驱动所述发光模块发光；在所述第二扫描控制端的第二扫描信号和所述数据输入端的数据信号的控制下，所述第二驱动模块被重置且处于恢复阶段；
在偶数帧期间，在所述第一扫描控制端的第一扫描信号和所述数据输入端的数据信号的控制下，所述第一驱动模块被重置且处于恢复阶段；在所述第二扫描控制端的第二扫描信号和所述第二驱动电压端的第二驱动电压信号的控制下，所述第二驱动模块驱动所述发光模块发光。
11.如权利要求10所述的驱动方法，其中，每帧被划分为重置时段、补偿时段、数据写入时段和发光时段，
在奇数帧期间，在重置时段，在所述第一和第二驱动电压端输出非驱动电压，所述第一和第二扫描信号为有效电平，所述第一和第二驱动模块被重置；在补偿时段，所述第一驱动电压端输出驱动电压，所述第一扫描信号为有效电平，所述第二扫描信号为无效电平，所述第一驱动模块进行晶体管阈值电压补偿，所述第二驱动模块保持重置状态；在数据写入时段，所述第一驱动电压端浮置并且无电压输出，所述第一扫描信号为有效电平，所述第二扫描信号为无效电平，所述第一驱动模块读入所述数据输入端的数据信号，所述第二驱动模块保持重置状态；在发光时段，所述第一驱动电压端输出驱动电压，所述第一扫描信号为无效电平，所述第二扫描信号为无效电平，所述第一驱动模块驱动所述发光模块发光，所述第二驱动模块保持重置状态；
在偶数帧期间，在重置时段，在所述第一和第二驱动电压端输出非驱动电压，所述第一和第二扫描信号为有效电平，所述第一和第二驱动模块被重置；在补偿时段，所述第二驱动电压端输出驱动电压，所述第二扫描信号为有效电平，所述第一扫描信号为无效电平，所述第二驱动模块进行晶体管阈值电压补偿，所述第一驱动模块保持重置状态；在数据写入时段，所述第二驱动电压端浮置并且无电压输出，所述第二扫描信号为有效电平，所述第一扫描信号为无效电平，所述第二驱动模块读入所述数据输入端的数据信号，所述第一驱动模块保持重置状态；在发光时段，所述第二驱动电压端输出驱动电压，所述第二扫描信号为无效电平，所述第一扫描信号为无效电平，所述第二驱动模块驱动所述发光模块发光，所述第一驱动模块保持重置状态。
12.如权利要求11所述的驱动方法，其中，所述像素电路还包括：
写入控制模块，其第一端与第二电源电压端连接，其第二端与第三电源电压端连接，其第三端与写入控制端连接，其第四端作为所述第一驱动电压端，其第五端作为所述第二驱动电压端。
13.如权利要求12所述的驱动方法，其中，所述第二驱动电压端与所述第一驱动电压端相同，所述第三电源电压端与所述第二电源电压端相同；
其中，在所述重置时段，在所述第一驱动电压端输出非驱动电压；在所述数据写入时段，所述第一驱动电压端浮置并且无电压输出；在所述补偿时段和发光时段，所述第一驱动电压端输出驱动电压。
14.如权利要求12所述的驱动方法，其中，所述第二驱动电压端与所述第一驱动电压端不同，所述第三电源电压端与所述第二电源电压端相同或不同；
其中，在奇数帧期间，在所述重置时段，所述第一驱动电压端和第二驱动电压端输出非驱动电压；在所述数据写入时段，所述第一驱动电压端浮置并且无电压输出；在所述补偿时段和发光时段，所述第一驱动电压端输出驱动电压；在所述补偿时段、数据写入时段和发光时段中，所述第二驱动电压端浮置或输出非驱动电压；
在偶数帧期间，在所述重置时段，所述第一驱动电压端和第二驱动电压端输出非驱动电压；在所述数据写入时段，所述第二驱动电压端浮置并且无电压输出；在所述补偿时段和发光时段，所述第二驱动电压端输出驱动电压；在所述补偿时段、数据写入时段和发光时段中，所述第一驱动电压端浮置或输出非驱动电压。
15.如权利要求13或14所述的驱动方法，其中，
所述第一驱动模块包括第一开关晶体管、第一驱动晶体管和第一电容；所述第一开关晶体管的栅极作为所述第一驱动模块的第三端与所述第一扫描控制端连接，所述第一开关晶体管的第一极作为所述第一驱动模块的第四端与所述数据输入端连接，所述第一开关晶体管的第二极与所述第一驱动晶体管的栅极和所述第一电容的第一端连接；所述第一驱动晶体管的第一极作为所述第一驱动模块的第二端与所述第一驱动电压端连接，所述第一驱动晶体管的第二极作为所述第一驱动模块的第一端与所述发光模块的第一端和所述第一电容的第二端连接；
所述第二驱动模块包括第二开关晶体管、第二驱动晶体管和第二电容；所述第二开关晶体管的栅极作为所述第二驱动模块的第三端与所述第二扫描控制端连接，所述第二开关晶体管的第一极作为所述第二驱动模块的第四端与所述数据输入端连接，所述第二开关晶体管的第二极与所述第二驱动晶体管的栅极和所述第二电容的第一端连接；所述第二驱动晶体管的第一极作为所述第二驱动模块的第二端与所述第二驱动电压端连接，所述第二驱动晶体管的第二极作为所述第二驱动模块的第一端与所述发光模块的第一端和所述第二电容的第二端连接。
16.如权利要求15所述的驱动方法，其中，
所述第一开关晶体管、第一驱动晶体管、第二开关晶体管和第二驱动晶体管均为N型晶体管，并且每个开关晶体管的第一极和第二极分别为漏极和源极，
所述发光模块包括有机发光二极管，所述有机发光二极管的阳极作为所述发光模块的第一端，并且所述有机发光二极管的阴极作为所述发光模块的第二端，
其中，所述非驱动电压为低电压，所述驱动电压为高电压；以及所述有效电平为高电平，所述无效电平为低电平。
17.如权利要求15所述的驱动方法，其中，
在奇数帧期间，在重置时段，所述第一和第二开关晶体管导通，所述第一和第二驱动晶体管截止，所述第一电容和所述第二电容均被重置至重置状态，所述发光模块不发光；在补偿时段，所述第一开关晶体管和第一驱动晶体管导通，所述第二开关晶体管和第二驱动晶体管截止，所述第一电容存储所述第一驱动晶体管的阈值电压，所述第二电容保持重置状态，所述发光模块不发光；在数据写入时段，所述第一开关晶体管和第一驱动晶体管导通，所述第二开关晶体管和第二驱动晶体管截止，所述第一电容存储所述第一驱动晶体管的阈值电压以及所述数据输入端的数据信号，所述第二电容保持重置状态，所述发光模块不发光；在发光时段，所述第一开关晶体管、第二开关晶体管和第二驱动晶体管截止，所述第一电容保持其两端电压，所述第一驱动晶体管导通并驱动所述发光模块发光，所述第二电容保持重置状态；
在偶数帧期间，在重置时段，所述第一和第二开关晶体管导通，所述第一和第二驱动晶体管截止，所述第一电容和所述第二电容均被重置至重置状态，所述发光模块不发光；在补偿时段，所述第一开关晶体管和第一驱动晶体管截止，所述第二开关晶体管和第二驱动晶体管导通，所述第一电容保持重置状态，所述第二电容存储所述第二驱动晶体管的阈值电压，所述发光模块不发光；在数据写入时段，所述第一开关晶体管和第一驱动晶体管截止，所述第二开关晶体管和第二驱动晶体管导通，所述第一电容保持重置状态，所述第二电容存储所述第二驱动晶体管的阈值电压以及所述数据输入端的数据信号，所述发光模块不发光；在发光阶段，所述第一开关晶体管、第一驱动晶体管和第二开关晶体管截止，所述第一电容保持重置状态，所述第二电容保持其两端电压，所述第二驱动晶体管导通并驱动所述发光模块发光。
18.如权利要求13所述的驱动方法，其中，
所述写入控制模块包括第五开关晶体管，其栅极作为所述写入控制模块的第二端与所述写入控制端连接，其第一端与第二电源电压端连接，其第二端作为所述第一和第二驱动电压端，
其中，在所述数据写入时段中，所述写入控制端的写入控制信号处于无效电平，使得所述第五开关晶体管截止，而在其余时段中，所述写入控制端的写入控制信号处于有效电平，使得所述第五开关晶体管导通，
其中，在所述重置时段中，所述第二电源电压端处于低电压，而在补偿时段和发光时段中，所述第二电源电压端处于高电压。
19.一种显示面板，包括像素阵列、栅极驱动电路以及数据驱动电路，所述像素阵列中的每个像素包括如权利要求1－9之一所述的像素电路。
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