CN104200786A - 一种阵列基板及其驱动方法、显示面板、显示装置 - Google Patents

一种阵列基板及其驱动方法、显示面板、显示装置 Download PDF

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Abstract

本发明公开了一种阵列基板及其驱动方法、显示面板、显示装置，用以实现降低显示面板的功耗，降低生产成本的目的。所述阵列基板中，每一行像素单元对应连接第一栅线和第二栅线，第一栅线用于在奇数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号；第二栅线用于在相邻的偶数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号；每一列像素单元对应连接两条数据线，且相邻两列像素单元共用一条数据线，对于同一帧图像，相邻两条数据线接收源极驱动集成电路输出的源极驱动信号的极性相反，且对于相邻两帧图像，同一数据线接收源极驱动集成电路输出的源极驱动信号的极性相同。

Description

一种阵列基板及其驱动方法、显示面板、显示装置
技术领域
本发明涉及显示器技术领域，尤其涉及一种阵列基板及其驱动方法、显示面板、显示装置。
背景技术
现有技术液晶显示屏(Liquid Crystal Display，LCD)包括一个分布着多个薄膜晶体管(Thin Film Transistor，TFT)的显示面板、一个驱动TFT源极的带有数据(Data)线的源极驱动集成电路(Source Driver IC)、一个驱动TFT栅极的带有栅极(Gate)线的栅极驱动集成电路(Gate Driver IC)以及背光模块，显示面板上一个TFT对应一个像素(pixel)，每个TFT连接像素电极，像素电极与公共电极形成电场，控制与该TFT对应的像素的充电和放电。
在时序控制器的控制下，Gate Driver IC驱动与Gate线连接的TFT的栅极开启或关闭，在TFT的栅极开启时，Source Driver IC驱动Data线输出相应的驱动信号。
如图1所示，与Gate Driver IC连接的每根Gate线与一行TFT的栅极连接，与Source Driver IC连接的每根数据线与一列TFT的源极连接。在进行画面显示时，同一时间，开启一行TFT的栅极。由于液晶分子长时间处于一种电压偏置的时候，会产生极化现象，为了解决这个问题，在帧与帧之间采用极性翻转的方式，在Source Driver IC中设置一个极性翻转单元，该极性翻转单元受极性(polarity)信号的控制，使每个像素的电压都在正负交替变换，从而实现显示面板中像素点翻转(dot-inversion)的显示效果。
现有技术实现显示面板中像素点翻转的效果图如图2(b)所示，该翻转方式的核心思想是第Y帧图像下，每相邻两根Data线上的数据极性相反；Y+1帧图像下同一根Data线上的数据与Y帧图像时的极性相反，且每相邻两根Data线上的数据极性相反，其中，每根Data线接收的源极驱动信号的极性示意图如图2(a)所示，每根Data线接收的源极驱动信号的极性正负交替变化，且同一根Data线在相邻两帧图像的相同时刻的正负极性相反，从而达到既能防止液晶老化又能降低功耗的目的，其中Y为大于等于1的整数。
但是基于该结构下采用点翻转方式在同一图像下每经过一个扫描线扫描时间后，每条Data线所载的驱动信号的极性就要翻转一次，因而消耗大量的能量，并且容易使液晶显示面板上源极驱动集成电路的温度升高。例如为了实现dot-inversion的效果，假设第一行第一列的像素上的数据信号的极性为正，第二行第一列的像素对应的数据信号的极性就要为负，因此当栅极驱动集成电路从驱动第一行的Gate线转为驱动第二行的Gate线时，第一根Data线上的极性就会由正变为负。
综上所述，现有技术的源极驱动集成电路在极性翻转输出的时候，输出的电压需要在较大的电压范围内切换，源极驱动集成电路不停的切换极性，功耗会大幅度提升，其内集成电路的温度也会升高，同时，源极驱动集成电路中还需要制作极性翻转单元，生产成本较高。
发明内容
本发明实施例提供了一种阵列基板及其驱动方法、显示面板、显示装置，用以实现降低显示面板的功耗，降低生产成本的目的。
本发明实施例提供的一种阵列基板，包括多个阵列排列的像素单元、与源极驱动集成电路连接的多条数据线以及与栅极驱动集成电路连接的多条栅线，其中：
每一行像素单元对应连接第一栅线和第二栅线，所述第一栅线用于在奇数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号；所述第二栅线用于在相邻的偶数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号；每一像素单元包括两个薄膜晶体管，通过一第一薄膜晶体管与所述第一栅线连接，通过一第二薄膜晶体管与所述第二栅线连接；
每一列像素单元对应连接两条数据线，且相邻两列像素单元共用一条数据线，对于同一帧图像，相邻两条数据线接收源极驱动集成电路输出的源极驱动信号的极性相反，且对于相邻两帧图像，同一数据线接收源极驱动集成电路输出的源极驱动信号的极性相同。
由本发明实施例提供的阵列基板，该阵列基板中每一行像素单元对应连接第一栅线和第二栅线，第一栅线用于在奇数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号；第二栅线用于在相邻的偶数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号，并且每一像素单元包括两个薄膜晶体管，通过一第一薄膜晶体管与所述第一栅线连接，通过一第二薄膜晶体管与所述第二栅线连接，即对于同一帧图像，每个像素单元内的像素对应连接的两个薄膜晶体管中仅有一个薄膜晶体管接收栅极驱动集成电路输出的栅极驱动信号打开，另一个薄膜晶体管关闭；每一列像素单元对应连接两条数据线，且相邻两列像素单元共用一条数据线，对于同一帧图像，相邻两条数据线接收源极驱动集成电路输出的源极驱动信号的极性相反，且对于相邻两帧图像，同一数据线接收源极驱动集成电路输出的源极驱动信号的极性相同，同时由于在相邻两帧图像显示时，分别由第一栅线和第二栅线接收栅极驱动集成电路输出的栅极驱动信号，因此对于相邻两帧图像仍然能够使像素呈现点翻转的翻转方式，而在实现点翻转时，同一数据线接收的源极驱动集成电路输出的源极驱动信号的极性不变，源极驱动集成电路不用在帧与帧的图像之间切换源极驱动集成电路的源极驱动信号的极性，因此能够降低显示面板的功耗，同时，也不需要在源极驱动集成电路中制作极性翻转单元，能够降低生产成本。
较佳地，每个像素单元内的两个薄膜晶体管分别设置在像素单元内的对角位置。
这样，将每个像素单元内的两个薄膜晶体管分别设置在像素单元内的对角位置，在实际制作过程中更加方便、简单。
较佳地，所述第一栅线位于每行像素单元的一侧，所述第二栅线位于该行像素单元的另一侧。
这样，将第一栅线设置在每行像素单元的一侧，将第二栅线设置在该行像素单元的另一侧，在实际制作过程中更加方便、简单。
较佳地，以与相邻两行的像素单元对应连接的四条栅线为一栅线单元，
所述四条栅线依次为第一栅线、第二栅线、第一栅线、第二栅线；或
所述四条栅线依次为第一栅线、第二栅线、第二栅线、第一栅线。
这样，能够保证相邻两行的像素单元中的每个像素在同一帧图像显示，以及在相邻的两帧图像显示时，方便的实现点翻转。
较佳地，当所述四条栅线依次为第一栅线、第二栅线、第一栅线、第二栅线时，
奇数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元上侧的所述第一栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元下侧的所述第二栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极；
偶数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元上侧的所述第一栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元下侧的所述第二栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极。
这样，通过这种具体的连接关系，可以在相邻的两帧图像显示时，方便的实现点翻转。
较佳地，当所述四条栅线依次为第一栅线、第二栅线、第二栅线、第一栅线时，
奇数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元上侧的所述第一栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元下侧的所述第二栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极；
偶数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元下侧的所述第一栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元上侧的所述第二栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极。
这样，通过这种具体的连接关系，可以在相邻的两帧图像显示时，方便的实现点翻转。
较佳地，当所述四条栅线依次为第一栅线、第二栅线、第一栅线、第二栅线时，与相邻的两行像素单元之间的两条栅线连接的薄膜晶体管，设置在一列像素单元的同一侧。
这样，当所述四条栅线依次为第一栅线、第二栅线、第一栅线、第二栅线时，与相邻的两行像素单元之间的两条栅线连接的薄膜晶体管，设置在一列像素单元的同一侧，在实现点翻转时更加方便、简单。
较佳地，当所述四条栅线依次为第一栅线、第二栅线、第二栅线、第一栅线时，与相邻的两行像素单元之间的两条栅线连接的薄膜晶体管，设置在一列像素单元的两侧。
这样，当所述四条栅线依次为第一栅线、第二栅线、第二栅线、第一栅线时，与相邻的两行像素单元之间的两条栅线连接的薄膜晶体管，设置在一列像素单元的两侧，在实现点翻转时更加方便、简单。
本发明实施例还提供了一种显示面板，该显示面板包括上述的阵列基板。
由于本发明实施例提供的显示面板包括上述的阵列基板，因此该显示面板的功耗同样能够降低。
本发明实施例还提供了一种显示装置，该装置包括上述的显示面板。
由于本发明实施例提供的显示装置包括上述的显示面板，因此该显示装置的功耗同样能够降低。
本发明实施例还提供了一种上述阵列基板的驱动方法，所述方法包括：
在奇数帧图像显示时，栅极驱动集成电路按扫描顺序逐根驱动第一栅线；与第一栅线连接的第一薄膜晶体管导通，源极驱动集成电路向与第一薄膜晶体管源极连接的数据线输出源极驱动信号，通过第一薄膜晶体管的漏极传输给与其连接的像素电极；
在偶数帧图像显示时，栅极驱动集成电路按扫描顺序逐根驱动第二栅线；与第二栅线连接的第二薄膜晶体管导通，源极驱动集成电路向与第二薄膜晶体管源极连接的数据线输出源极驱动信号，通过第二薄膜晶体管的漏极传输给与其连接的像素电极。
由本发明实施例提供的上述阵列基板的驱动方法，该方法包括：在奇数帧图像显示时，栅极驱动集成电路按扫描顺序逐根驱动第一栅线，在薄膜晶体管的栅极开通时，源极驱动集成电路驱动各数据线输出源极驱动信号，在偶数帧图像显示时，栅极驱动集成电路按扫描顺序逐根驱动第二栅线，在薄膜晶体管的栅极开通时，源极驱动集成电路驱动各数据线输出源极驱动信号，该方法在实际驱动过程中方便、简单，并且能够保证每一行像素在奇数帧和偶数帧均能够显示完整的图像。
较佳地，对于同一帧图像，相邻两条数据线接收的源极驱动信号的极性相反，对于相邻两帧图像，同一数据线接收的源极驱动信号的极性相同。
这样，对于同一帧图像，源极驱动集成电路向各奇数列的数据线输出的源极驱动信号的极性相同，向各偶数列的数据线输出的源极驱动信号的极性相同，且向各奇数列的数据线和向各偶数列的数据线输出的源极驱动信号的极性相反，在对应的TFT开启的情况下，以及配合源极驱动集成电路输出的源极驱动信号，方便的实现像素的点翻转。
附图说明
图1为现有技术阵列基板的结构示意图；
图2(a)和图2(b)分别为现有技术数据线接收的源极驱动信号的极性示意图和对应的实现像素点翻转时的效果图；
图3为本发明实施例提供的一种阵列基板的结构示意图；
图4为本发明实施例提供的另一种阵列基板的结构示意图；
图5为本发明实施例提供的一种阵列基板的驱动方法流程图；
图6(a)和图6(b)分别为本发明实施例数据线接收的源极驱动信号的极性示意图和对应的实现像素点翻转时的效果图。
具体实施方式
本发明实施例提供了一种阵列基板及其驱动方法、显示面板、显示装置，用以实现降低显示面板的功耗，降低生产成本的目的。
下面结合附图详细介绍本发明具体实施例提供的阵列基板及其驱动方法。
如图3所示，本发明具体实施例提供了一种阵列基板，该阵列基板包括多个阵列排列的像素单元300、与源极驱动集成电路连接的多条数据线Data1、Data2、Data3等，以及与栅极驱动集成电路连接的多条栅线Gate1、Gate2、Gate3等，其中：
每一行像素单元对应连接第一栅线和第二栅线，如：第一行像素单元连接第一栅线Gate1和第二栅线Gate2，较佳地，第一栅线位于每行像素单元的一侧，第二栅线位于该行像素单元的另一侧，第一栅线用于在奇数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号；第二栅线用于在相邻的偶数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号，即在相邻两帧图像显示时，每一行像素单元均能正常显示；每一像素单元包括两个TFT，如：像素单元300包括TFT31和TFT32，通过一第一薄膜晶体管与所述第一栅线连接，通过一第二薄膜晶体管与所述第二栅线连接，如：像素单元300通过TFT31与第一栅线Gate1连接，通过TFT32与第二栅线Gate2连接；
每一列像素单元对应连接两条数据线，且相邻两列像素单元共用一条数据线，如：第一列像素单元连接数据线Data1和Data2，第一列像素单元和第二列像素单元共用数据线Data2，对于同一帧图像，相邻两条数据线接收源极驱动集成电路输出的源极驱动信号的极性相反，且对于相邻两帧图像，同一数据线接收源极驱动集成电路输出的源极驱动信号的极性相同，如：对于同一帧图像，数据线Data1接收源极驱动集成电路输出的源极驱动信号的极性为正，数据线Data2接收源极驱动集成电路输出的源极驱动信号的极性为负，且对于相邻两帧图像，数据线Data1接收源极驱动集成电路输出的源极驱动信号的极性仍然为正，数据线Data2接收源极驱动集成电路输出的源极驱动信号的极性仍然为负。当然，本发明具体实施例中数据线Data1接收源极驱动集成电路输出的源极驱动信号的极性也可以为负，数据线Data2接收源极驱动集成电路输出的源极驱动信号的极性也可以为正，本发明并不对其作具体的限定。
本发明具体实施例中的第一栅线和第二栅线可以是沿水平方向延伸，也可以沿垂直方向延伸，同样地，数据线可以沿水平方向延伸，也可以沿垂直方向延伸，那么相邻的两行像素单元可以是在水平方向相邻，也可以是在垂直方向相邻，同样地，相邻的两列像素单元可以是在水平方向相邻，也可以是在垂直方向相邻，本发明并未对此作限制，本发明具体实施例以行方向为水平方向，列方向为垂直方向为例介绍。
较佳地，如图3所示，本发明具体实施例中每个像素单元内的两个TFT分别设置在像素单元内的对角位置，如：像素单元300内的两个TFT31和TFT32分别设置在像素单元300内的对角位置。相邻的两行像素单元之间延伸有两条栅线，如：相邻的第一行像素单元与第二行像素单元之间延伸有两条栅线Gate2和Gate3。
较佳地，以与相邻两行的像素单元对应连接的四条栅线为一栅线单元，如以第一行像素单元和第二行像素单元对应连接的四条栅线Gate1、Gate2、Gate3和Gate4为一栅线单元，本发明具体实施例中的阵列基板包括多个沿列方向排布的所述栅线单元，每一栅线单元中包括四条栅线，
这四条栅线依次为第一栅线、第二栅线、第一栅线、第二栅线，即：Gate1为第一栅线、Gate2为第二栅线、Gate3为第一栅线、Gate4为第二栅线；或
这四条栅线依次为第一栅线、第二栅线、第二栅线、第一栅线，即：Gate1为第一栅线、Gate2为第二栅线、Gate3为第二栅线、Gate4为第一栅线。
本发明具体实施例中当栅线单元中的四条栅线依次为第一栅线、第二栅线、第一栅线、第二栅线时，如图3所示，奇数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元上侧的第一栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元下侧的第二栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极；偶数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元上侧的第一栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元下侧的第二栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极。
如图3所示，本发明具体实施例中，对于奇数帧图像，如图像Y，第一栅线接收栅极驱动集成电路输出的栅极驱动信号；对于相邻的偶数帧图像，如图像Y+1，第二栅线接收栅极驱动集成电路输出的栅极驱动信号。具体地，对于奇数帧图像，如图像Y，栅极驱动集成电路按扫描顺序逐根驱动栅线Gate1、Gate3、Gate5等；对于相邻的偶数帧图像，如图像Y+1，栅极驱动集成电路按扫描顺序逐根驱动栅线Gate2、Gate4、Gate6等。与相邻的两行像素单元之间的两条栅线连接的TFT，设置在一列像素单元的同一侧，如：像素单元300中的TFT32和相邻的像素单元302中的TFT34设置在第一列像素单元300或302的右侧。
本发明具体实施例中当栅线单元中的四条栅线依次为第一栅线、第二栅线、第二栅线、第一栅线时，如图4所示，奇数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元上侧的第一栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元下侧的第二栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极；偶数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元下侧的第一栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元上侧的第二栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极。
如图4所示，本发明具体实施例中，对于奇数帧图像，如图像Y，第一栅线接收栅极驱动集成电路输出的栅极驱动信号；对于相邻的偶数帧图像，如图像Y+1，第二栅线接收栅极驱动集成电路输出的栅极驱动信号。具体地，对于奇数帧图像，如图像Y，栅极驱动集成电路按扫描顺序逐根驱动栅线Gate1、Gate4、Gate5等；对于相邻的偶数帧图像，如图像Y+1，栅极驱动集成电路按扫描顺序逐根驱动栅线Gate2、Gate3、Gate6等。与相邻的两行像素单元之间的两条栅线连接的TFT，设置在一列像素单元的两侧，如：像素单元400中的TFT41和相邻的像素单元401中的TFT42设置在第一列像素单元400或401的两侧。
如图3或图4所示，本发明具体实施例中，对于奇数帧图像，如图像Y，奇数列的数据线Data1、Data3、Data5等接收源极驱动集成电路输出的源极驱动信号的极性相同，如接收源极驱动集成电路输出的源极驱动信号的极性为正，当然也可以为负，偶数列的数据线Data2、Data4、Data6等接收源极驱动集成电路输出的源极驱动信号的极性相同，如接收源极驱动集成电路输出的源极驱动信号的极性为负，当然也可以为正，Data1、Data3、Data5等奇数列的数据线和Data2、Data4、Data6等偶数列的数据线接收源极驱动集成电路输出的源极驱动信号的极性相反。
如图5所示，本发明具体实施例还提供了一种上述阵列基板的驱动方法，所述方法包括：
S501、在奇数帧图像显示时，栅极驱动集成电路按扫描顺序逐根驱动第一栅线；与第一栅线连接的第一薄膜晶体管导通，源极驱动集成电路向与第一薄膜晶体管源极连接的数据线输出源极驱动信号，通过第一薄膜晶体管的漏极传输给与其连接的像素电极；
S502、在偶数帧图像显示时，栅极驱动集成电路按扫描顺序逐根驱动第二栅线；与第二栅线连接的第二薄膜晶体管导通，源极驱动集成电路向与第二薄膜晶体管源极连接的数据线输出源极驱动信号，通过第二薄膜晶体管的漏极传输给与其连接的像素电极。
其中，对于同一帧图像，相邻两条数据线接收的源极驱动信号的极性相反，对于相邻两帧图像，同一数据线接收的源极驱动信号的极性相同。
具体地，如图3所示，本发明具体实施例中奇数行栅线和偶数行栅线分别在相邻两帧图像，如图像Y和图像Y+1，内依次打开。当显示图像Y时，奇数行栅线Gate1、Gate3、Gate5等依次打开，同一列像素单元中的像素依次受其左侧和右侧的数据线充电，对于同一帧图像，如图像Y，源极驱动集成电路向相邻的数据线输出的源极驱动信号的极性相反，向相间的数据线输出的源极驱动信号的极性相同，此时第一行像素单元中的像素R通过TFT连接的数据线接收的源极驱动信号的极性为正，像素G通过TFT连接的数据线接收的源极驱动信号的极性为负，像素B通过TFT连接的数据线接收的源极驱动信号的极性为正，第二行像素单元中的像素R通过TFT连接的数据线接收的源极驱动信号的极性为负，像素G通过TFT连接的数据线接收的源极驱动信号的极性为正，像素B通过TFT连接的数据线接收的源极驱动信号的极性为负，如图6(b)所示。当显示图像Y+1时，偶数行栅线Gate2、Gate4、Gate6等依次打开，对于相邻两帧图像，源极驱动集成电路向同一数据线输出的源极驱动信号的极性相同，而此时同一列像素单元中的像素依次受其右侧和左侧的数据线充电，因此第一行像素单元中的像素R通过TFT连接的数据线接收的源极驱动信号的极性为负，像素G通过TFT连接的数据线接收的源极驱动信号的极性为正，像素B通过TFT连接的数据线接收的源极驱动信号的极性为负，第二行像素单元中的像素R通过TFT连接的数据线接收的源极驱动信号的极性为正，像素G通过TFT连接的数据线接收的源极驱动信号的极性为负，像素B通过TFT连接的数据线接收的源极驱动信号的极性为正。对于同一帧图像，如图像Y或图像Y+1，相邻像素通过TFT连接的数据线接收的源极驱动信号的极性相反，对于相邻两帧图像，如图像Y和图像Y+1，相同位置处的像素通过TFT连接的数据线接收的源极驱动信号的极性相反，这样源极驱动集成电路不用在帧与帧之间切换极性，一直保持相同的极性，即图6(a)中每根Data线接收的源极驱动信号的极性不用在帧与帧之间切换极性，而能实现显示面板显示时的点翻转效果，避免了液晶分子极化的问题。
具体地，如图4所示，本发明具体实施例中对于相邻两帧图像，如图像Y和图像Y+1，当显示图像Y时，栅线Gate1、Gate4、Gate5等依次打开，同一列像素单元中的像素分别受其左侧和右侧的数据线充电，对于同一帧图像，如图像Y，源极驱动集成电路向相邻的数据线输出的源极驱动信号的极性相反，向相间的数据线输出的源极驱动信号的极性相同，此时第一行像素单元中的像素R通过TFT连接的数据线接收的源极驱动信号的极性为正，像素G通过TFT连接的数据线接收的源极驱动信号的极性为负，像素B通过TFT连接的数据线接收的源极驱动信号的极性为正，第二行像素单元中的像素R通过TFT连接的数据线接收的源极驱动信号的极性为负，像素G通过TFT连接的数据线接收的源极驱动信号的极性为正，像素B通过TFT连接的数据线接收的源极驱动信号的极性为负，如图6(b)所示。当显示图像Y+1时，栅线Gate2、Gate3、Gate6等依次打开，对于相邻两帧图像，源极驱动集成电路向同一数据线输出的源极驱动信号的极性相同，而此时同一列像素单元中的像素依次受其右侧和左侧的数据线充电，因此第一行像素单元中的像素R通过TFT连接的数据线接收的源极驱动信号的极性为负，像素G通过TFT连接的数据线接收的源极驱动信号的极性为正，像素B通过TFT连接的数据线接收的源极驱动信号的极性为负，第二行像素单元中的像素R通过TFT连接的数据线接收的源极驱动信号的极性为正，像素G通过TFT连接的数据线接收的源极驱动信号的极性为负，像素B通过TFT连接的数据线接收的源极驱动信号的极性为正。对于同一帧图像，如图像Y或图像Y+1，相邻像素通过TFT连接的数据线接收的源极驱动信号的极性相反，对于相邻两帧图像，如图像Y和图像Y+1，相同位置处的像素通过TFT连接的数据线接收的源极驱动信号的极性相反，这样源极驱动集成电路不用在帧与帧之间切换极性，一直保持相同的极性，即图6(a)中每根Data线接收的源极驱动信号的极性不用在帧与帧之间切换极性，而能实现显示面板显示时的点翻转效果，避免了液晶分子极化的问题。
另外，本发明具体实施例还涉及一种没有极性翻转信号的时序控制器，此种时序控制器在进行数据处理的时候，奇数帧图像数据与偶数帧图像数据之间相差一列的数据信号线，即数据线的错位。
综上所述，本发明具体实施例中的源极驱动集成电路不用极性翻转，功耗可以降低约30％左右，尤其适用于现有的大尺寸、高分辨率的LCD产品。同时在源极驱动集成电路中去除极性翻转单元，达到降低成本的目的。
显然，本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样，倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内，则本发明也意图包含这些改动和变型在内。

Claims (12)

1.一种阵列基板，包括多个阵列排列的像素单元、与源极驱动集成电路连接的多条数据线以及与栅极驱动集成电路连接的多条栅线，其特征在于：
每一行像素单元对应连接第一栅线和第二栅线，所述第一栅线用于在奇数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号；所述第二栅线用于在相邻的偶数帧图像显示时，接收栅极驱动集成电路输出的栅极驱动信号；每一像素单元包括两个薄膜晶体管，通过一第一薄膜晶体管与所述第一栅线连接，通过一第二薄膜晶体管与所述第二栅线连接；
每一列像素单元对应连接两条数据线，且相邻两列像素单元共用一条数据线，对于同一帧图像，相邻两条数据线接收源极驱动集成电路输出的源极驱动信号的极性相反，且对于相邻两帧图像，同一数据线接收源极驱动集成电路输出的源极驱动信号的极性相同。
2.根据权利要求1所述的阵列基板，其特征在于，每个像素单元内的两个薄膜晶体管分别设置在像素单元内的对角位置。
3.根据权利要求1所述的阵列基板，其特征在于，所述第一栅线位于每行像素单元的一侧，所述第二栅线位于该行像素单元的另一侧。
4.根据权利要求3所述的阵列基板，其特征在于，以与相邻两行的像素单元对应连接的四条栅线为一栅线单元，
所述四条栅线依次为第一栅线、第二栅线、第一栅线、第二栅线；或
所述四条栅线依次为第一栅线、第二栅线、第二栅线、第一栅线。
5.根据权利要求4所述的阵列基板，其特征在于，当所述四条栅线依次为第一栅线、第二栅线、第一栅线、第二栅线时，
奇数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元上侧的所述第一栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元下侧的所述第二栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极；
偶数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元上侧的所述第一栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元下侧的所述第二栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极。
6.根据权利要求4所述的阵列基板，其特征在于，当所述四条栅线依次为第一栅线、第二栅线、第二栅线、第一栅线时，
奇数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元上侧的所述第一栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元下侧的所述第二栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极；
偶数行的像素单元中的第一薄膜晶体管的栅极连接该像素单元下侧的所述第一栅线，源极连接该像素单元右侧的数据线，漏极连接该像素单元中的像素电极，该像素单元中的第二薄膜晶体管的栅极连接该像素单元上侧的所述第二栅线，源极连接该像素单元左侧的数据线，漏极连接该像素单元中的像素电极。
7.根据权利要求4所述的阵列基板，其特征在于，当所述四条栅线依次为第一栅线、第二栅线、第一栅线、第二栅线时，与相邻的两行像素单元之间的两条栅线连接的薄膜晶体管，设置在一列像素单元的同一侧。
8.根据权利要求4所述的阵列基板，其特征在于，当所述四条栅线依次为第一栅线、第二栅线、第二栅线、第一栅线时，与相邻的两行像素单元之间的两条栅线连接的薄膜晶体管，设置在一列像素单元的两侧。
9.一种显示面板，其特征在于，所述显示面板包括权利要求1-8任一权项所述的阵列基板。
10.一种显示装置，其特征在于，所述装置包括权利要求9所述的显示面板。
11.一种权利要求1-8任一权项所述的阵列基板的驱动方法，其特征在于，所述方法包括：
在奇数帧图像显示时，栅极驱动集成电路按扫描顺序逐根驱动第一栅线；与第一栅线连接的第一薄膜晶体管导通，源极驱动集成电路向与第一薄膜晶体管源极连接的数据线输出源极驱动信号，通过第一薄膜晶体管的漏极传输给与其连接的像素电极；
在偶数帧图像显示时，栅极驱动集成电路按扫描顺序逐根驱动第二栅线；与第二栅线连接的第二薄膜晶体管导通，源极驱动集成电路向与第二薄膜晶体管源极连接的数据线输出源极驱动信号，通过第二薄膜晶体管的漏极传输给与其连接的像素电极。
12.根据权利要求11所述的驱动方法，其特征在于，对于同一帧图像，相邻两条数据线接收的源极驱动信号的极性相反，对于相邻两帧图像，同一数据线接收的源极驱动信号的极性相同。
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