CN103515249B - 先封后蚀三维***级芯片正装凸点封装结构及工艺方法 - Google Patents
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Abstract
本发明涉及一种先封后蚀三维***级芯片正装凸点封装结构及工艺方法,所述封装结构基岛(1)和引脚(2),所述引脚(2)正面设置有导电柱子(3),所述基岛(1)正面正装有第一芯片(4),所述导电柱子(3)、第一芯片(4)和第一金属线(5)***的区域均包封有第一塑封料或环氧树脂(9),所述基岛(1)背面正装有第二芯片(7),所述基岛(1)和引脚(2)背面区域以及第二芯片(7)和第二金属线(8)***的区域均包封有第二塑封料或环氧树脂(10),所述导电柱子(3)上设置有第一金属球(17)。本发明的有益效果是:它能够解决传统金属引线框或有机基板无法埋入物件而限制整个封装功能集成度以及传统有机基板需要更细线宽与更窄的线与线间距的问题。
Description
技术领域
本发明涉及一种先封后蚀三维***级芯片正装凸点封装结构及工艺方法,属于半导体封装技术领域。
背景技术
传统四面无引脚金属引线框封装结构如图104所示,其主要制作工艺是在取金属片进行化学蚀刻、金属电镀从而制成有承载芯片的基岛、内外引脚的金属引线框,再在此基础上进行单侧的装片、打线、包封等封装工艺。
而传统的有机多层线路基板封装结构如图105所示,其主要工艺是在玻璃纤维板核心材料的基础上通过积成材料积成的方式叠加形成多层线路板,线路层之间通过激光钻孔的方式开孔,再镀孔完成电性连接。然后再在多层线路板的基础上进行单侧的装片、打线、包封等封装工艺。
上述金属引线框封装结构与多层线路基板封装结构都存在以下不足:
1、此类金属引线框及多层线路基板都只能进行单侧的芯片封装,金属引线框或多层线路基板的利用率较低,从而限制整个封装的功能集成度。
2、此类金属引线框及多层线路基板本身不埋入任何物件,所以金属引线框及多层线路板不具备功能集成效果,从而也相应地限制了整个封装体的功能集成度。
3、有机多层基板的材料成本以及工艺制作成本较高。
4、传统金属引线框的线宽线距相当地大,至少都要200μm以上,所以无法做到高密度的需求。
5、传统的有机多层线路的线宽线距依据目前的蚀刻制作能力,只能达到25μm线宽以及25μm线距,稍微宽了点。
发明内容
本发明的目的在于克服上述不足,提供一种先封后蚀芯片正装三维***级封装结构及工艺方法,它能够解决传统金属引线框或多层线路基板本身无法埋入芯片以及被动组件而限制整个封装功能集成度的问题以及传统有机基板需要更细线宽与更窄的线与线间距的问题。
本发明的目的是这样实现的:一种先封后蚀三维***级芯片正装凸点封装结构的工艺方法,所述方法包括以下步骤:
步骤一、取金属基板
步骤二、金属基板表面预镀铜材
在金属基板表面预镀一层铜材;
步骤三、贴光阻膜作业
在步骤二完成预镀铜材的金属基板正面及背面分别贴上可进行曝光显影的光阻膜;
步骤四、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行金属线路层电镀的区域;
步骤五、电镀金属线路层
在步骤四中金属基板正面去除部分光阻膜的区域内电镀上金属线路层,金属线路层电镀完成后即在金属基板正面形成相应的基岛和引脚;
步骤六、贴光阻膜作业
在步骤五完成电镀金属线路层的金属基板正面贴上可进行曝光显影的光阻膜;
步骤七、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤六完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行导电柱子电镀的区域;
步骤八、电镀导电柱子
在步骤七中金属基板正面去除部分光阻膜的区域内电镀上导电柱子;
步骤九、去除光阻膜
去除金属基板表面的光阻膜;
步骤十、装片
在步骤五形成的基岛正面涂覆导电或不导电粘结物质进行第一芯片的植入;
步骤十一、金属线键合
在第一芯片正面与步骤五形成的引脚之间进行键合金属线作业;
步骤十二、环氧树脂塑封
在完成装片打线后的金属基板正面进行环氧树脂塑封保护;
步骤十三、环氧树脂表面研磨
在步骤十二完成环氧树脂塑封后进行表面研磨;
步骤十四、贴光阻膜作业
在步骤十三完成环氧树脂表面研磨后的金属基板正面和背面贴上可进行曝光显影的光阻膜;
步骤十五、金属基板背面去除部分光阻膜
参利用曝光显影设备将步骤十四完成贴光阻膜作业的金属基板背面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板背面后续需要进行蚀刻的区域;
步骤十六、蚀刻
在步骤十五中金属基板背面去除部分光阻膜的区域进行化学蚀刻;
步骤十七、去除光阻膜
去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤十八、电镀抗氧化金属层或披覆抗氧化剂(OSP)
在步骤十七中去除光阻膜后金属基板表面裸露在外的金属表面进行抗氧化金属层电镀或是抗氧化剂披覆(OSP);
步骤十九、装片
在基岛背面涂覆导电或不导电粘结物质进行第二芯片的植入;
步骤二十、金属线键合
在第二芯片正面与引脚背面之间进行键合金属线作业;
步骤二十一、环氧树脂塑封
在完成装片打线后的金属基板背面进行环氧树脂塑封保护;
步骤二十二、植球
在步骤十八完成电镀抗氧化金属层或披覆抗氧化剂的导电柱子顶部植入第一金属球;
步骤二十三、切割成品
将步骤二十二完成植球的半成品进行切割作业,使原本以阵列式集合体方式集成在一起并含有芯片的塑封体模块一颗颗切割独立开来,制得先封后蚀三维***级芯片正装凸点封装结构成品。
一种先封后蚀三维***级芯片正装凸点封装结构的工艺方法,所述方法包括以下步骤:
步骤一、取金属基板
步骤二、金属基板表面预镀铜材
在金属基板表面预镀一层铜材,
步骤三、贴光阻膜作业
在步骤二完成预镀铜材的金属基板正面及背面分别贴上可进行曝光显影的光阻膜;
步骤四、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行金属线路层电镀的区域;
步骤五、电镀金属线路层
在步骤四中金属基板正面去除部分光阻膜的区域内电镀上金属线路层,金属线路层电镀完成后即在金属基板正面形成相应的基岛和引脚;
步骤六、贴光阻膜作业
在步骤五完成电镀金属线路层的金属基板正面贴上可进行曝光显影的光阻膜;
步骤七、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤六完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行导电柱子电镀的区域;
步骤八、电镀导电柱子
在步骤七中金属基板正面去除部分光阻膜的区域内电镀上导电柱子;
步骤九、去除光阻膜
去除金属基板表面的光阻膜;
步骤十、装片
在步骤五形成的基岛正面涂覆导电或不导电粘结物质进行第一芯片的植入;
步骤十一、金属线键合
在第一芯片正面与步骤五形成的引脚之间进行键合金属线作业;
步骤十二、环氧树脂塑封
在完成装片打线后的金属基板正面进行环氧树脂塑封保护;
步骤十三、环氧树脂表面研磨
在步骤十二完成环氧树脂塑封后进行表面研磨;
步骤十四、贴光阻膜作业
在步骤十三完成环氧树脂表面研磨后的金属基板正面和背面贴上可进行曝光显影的光阻膜;
步骤十五、金属基板背面去除部分光阻膜
利用曝光显影设备将步骤十四完成贴光阻膜作业的金属基板背面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板背面后续需要进行蚀刻的区域;
步骤十六、蚀刻
在步骤十五中金属基板背面去除部分光阻膜的区域进行化学蚀刻;
步骤十七、去除光阻膜
去除金属基板表面的光阻膜;
步骤十八、金属基板背面披覆绿漆
在步骤十七去除光阻膜后的金属基板背面进行绿漆或可感光的不导电胶材的披覆;
步骤十九、曝光开窗显影
利用曝光显影设备对金属基板背面披覆的绿漆或可感光的不导电胶材进行曝光显影开窗,以露出金属基板背面后续需要进行高导电金属层电镀的区域;
步骤二十、电镀高导电金属层
在步骤十九中金属基板背面绿漆或可感光的不导电胶材的开窗区域内电镀上高导电金属层;
步骤二十一、电镀抗氧化金属层或披覆抗氧化剂(OSP)
在金属基板表面裸露在外的金属表面进行抗氧化金属层电镀或抗氧化剂披覆(OSP);
步骤二十二、装片
在步骤十三经过研磨的环氧树脂表面通过导电或不导电粘结物质正装上第二芯片;
步骤二十三、金属线键合
在第二芯片正面与导电柱子顶部之间进行键合金属线作业;
步骤二十四、环氧树脂塑封
在完成装片打线后的环氧树脂表面再进行环氧树脂塑封保护;
步骤二十五、植球
在步骤二十一完成电镀抗氧化金属层或披覆抗氧化剂的高导电金属层上植入第一金属球;
步骤二十六,切割成品
将步骤二十五完成植球的半成品进行切割作业,使原本以阵列式集合体方式集成在一起并含有芯片的塑封体模块一颗颗切割独立开来,制得先封后蚀三维***级芯片正装凸点封装结构成品。
一种先封后蚀三维***级芯片正装凸点封装结构的工艺方法,所述方法包括以下步骤:
步骤一、取金属基板
步骤二、金属基板表面预镀铜材
在金属基板表面预镀一层铜材;
步骤三、贴光阻膜作业
在步骤二完成预镀铜材的金属基板正面及背面分别贴上可进行曝光显影的光阻膜;
步骤四、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行第一金属线路层电镀的区域;
步骤五、电镀第一金属线路层
在步骤四中金属基板正面去除部分光阻膜的区域内电镀上第一金属线路层;
步骤六、贴光阻膜作业
在步骤五完成电镀第一金属线路层的金属基板正面贴上可进行曝光显影的光阻膜;
步骤七、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤六完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行第二金属线路层电镀的区域;
步骤八、电镀第二金属线路层
在步骤七中金属基板正面去除部分光阻膜的区域内电镀上第二金属线路层作为用以连接第一金属线路层与第三金属线路层的导电柱子;
步骤九、去除光阻膜
去除金属基板表面的光阻膜;
步骤十、贴压不导电胶膜
在金属基板正面贴压一层不导电胶膜;
步骤十一、研磨不导电胶膜表面
在步骤十完成不导电胶膜贴压后进行表面研磨;
步骤十二、不导电胶膜表面金属化预处理
对不导电胶膜表面进行金属化预处理,使其表面附着上一层金属化高分子材料或表面粗糙化处理;
步骤十三、贴光阻膜作业
在步骤十二完成金属化的金属基板正面及背面贴上可进行曝光显影的光阻膜;
步骤十四、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤十三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行蚀刻的区域图形;
步骤十五、蚀刻
将步骤十四中的金属基板正面光阻膜开窗后的区域进行蚀刻作业;
步骤十六、去除光阻膜
去除金属基板正面的光阻膜;
步骤十七、电镀第三金属线路层
在步骤十五中金属基板正面经蚀刻后保留的金属化预处理区域电镀上第三金属线路层,第三金属线路层电镀完成后即在金属基板正面形成相应的基岛和引脚;
步骤十八、贴光阻膜作业
在步骤十七完成电镀第三金属线路层的金属基板正面贴上可进行曝光显影的光阻膜;
步骤十九、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤十八完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行导电柱子电镀的区域;
步骤二十、电镀导电柱子
在步骤十九中金属基板正面去除部分光阻膜的区域内电镀上导电柱子;
步骤二十一、去除光阻膜
去除金属基板表面的光阻膜;
步骤二十二、装片
在步骤十七形成的基岛正面涂覆导电或不导电粘结物质进行第一芯片的植入;
步骤二十三、金属线键合
在第一芯片正面与步骤五形成的引脚之间进行键合金属线作业;
步骤二十四、环氧树脂塑封
在完成装片打线后的金属基板正面进行环氧树脂塑封保护;
步骤二十五、环氧树脂表面研磨
在步骤二十四完成环氧树脂塑封后进行表面研磨;
步骤二十六、贴光阻膜作业
在步骤二十五完成环氧树脂表面研磨后的金属基板正面和背面贴上可进行曝光显影的光阻膜;
步骤二十七、金属基板背面去除部分光阻膜
利用曝光显影设备将步骤二十六完成贴光阻膜作业的金属基板背面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板背面后续需要进行蚀刻的区域;
步骤二十八、蚀刻
在步骤二十七中金属基板背面去除部分光阻膜的区域进行化学蚀刻;
步骤二十九、去除光阻膜
去除金属基板表面的光阻膜;
步骤三十、电镀抗氧化金属层或披覆抗氧化剂(OSP)
在步骤二十九中去除光阻膜后金属基板表面裸露在外的金属表面进行抗氧化金属层电镀或披覆抗氧化剂(OSP);
步骤三十一、装片
在步骤三十完成电镀抗氧化金属层或披覆抗氧化剂的基岛背面涂覆导电或不导电粘结物质进行第二芯片的植入;
步骤三十二、金属线键合
在第二芯片正面与步骤五形成的引脚背面之间进行键合金属线作业;
步骤三十三、环氧树脂塑封
在完成装片打线后的金属基板背面进行环氧树脂塑封保护;
步骤三十四、植球
在步骤三十完成电镀抗氧化金属层或披覆抗氧化剂的导电柱子顶部植入第一金属球;
步骤三十五、切割成品
将步骤三十四完成植球的半成品进行切割作业,使原本以阵列式集合体方式集成在一起并含有芯片的塑封体模块一颗颗切割独立开来,制得先封后蚀三维***级芯片正装凸点封装结构成品。
所述步骤六~步骤十七在步骤五与步骤十八之间重复进行多次。
一种先封后蚀三维***级芯片正装凸点封装结构,它包括基岛和引脚,所述引脚正面设置有导电柱子,所述基岛正面通过导电或不导电粘结物质正装有第一芯片,所述第一芯片正面与引脚正面之间通过第一金属线相连接,所述基岛和引脚正面的区域以及导电柱子、第一芯片和第一金属线***的区域均包封有第一塑封料或环氧树脂,所述第一塑封料或环氧树脂与导电柱子顶部齐平,所述导电柱子露出第一塑封料或环氧树脂的表面设置有抗氧化层,所述基岛背面通过导电或不导电粘结物质正装有第二芯片,所述第二芯片正面与引脚背面之间通过第二金属线相连接,所述基岛和引脚背面区域以及第二芯片和第二金属线***的区域均包封有第二塑封料或环氧树脂,所述导电柱子顶部设置有第一金属球。
所述引脚与引脚之间跨接有无源器件。
所述基岛背面通过导电或不导电粘结物质正装有多个第二芯片,所述第二芯片正面与第二芯片正面之间通过第二金属线相连接。
所述第二芯片正面通过导电或不导电粘结物质正装有第三芯片,所述第三芯片与引脚背面之间通过第三金属线相连接。
所述引脚背面通过第二金属球倒装有第三芯片。
一种先封后蚀三维***级芯片正装凸点封装结构,它包括基岛和引脚,所述引脚正面设置有导电柱子,所述基岛正面通过导电或不导电粘结物质正装有第一芯片,所述第一芯片正面与引脚正面之间通过第一金属线相连接,所述基岛和引脚正面区域以及导电柱子、第一芯片和第一金属线***区域均包封有第一塑封料或环氧树脂,所述第一塑封料或环氧树脂与导电柱子顶部齐平,所述第一塑封料或环氧树脂正面通过导电或不导电粘结物质正装有第二芯片,所述第二芯片正面与导电柱子顶部之间通过第二金属线相连接,所述导电柱子顶部区域以及第二芯片和第二金属线***区域均包封有第二塑封料或环氧树脂,所述基岛和引脚背面设置有高导电金属层,所述高导电金属层与高导电金属层之间填充有绿漆或可感光不导电胶材,所述高导电金属层露出绿漆或可感光不导电胶材的表面设置有抗氧化层,所述高导电金属层上设置有第一金属球。
与现有技术相比,本发明具有以下有益效果:
1、目前金属引线框或有机多层线路基板都无法埋入物件,从而限制了整个封装的功能集成度。而本发明的三维***级金属线路基板,三维***级金属线路基板可以在基板中间的夹层中再制作过程中埋入对象,从而实现在三维***级金属线路基板基板的两侧装载芯片或其他组件,从而提升了整个封装的功能集成度;
2、三维***级金属线路基板中的夹层在制作过程中可以因为导热或是散热需要而在需要的位置或是区域内埋入导热或是散热对象,从而改善整个封装结构的散热效果;
3、三维***级金属线路基板中的夹层在制作过程中可以因为***与功能的需要而在需要的位置或是区域内埋入主动元件或是组件或是被动的组件,从而提高了基板的利用率;
4、从三维***级金属线路基板封装成品的外观完全看不出来基板内部夹层已埋入了因***或是功能需要的对象,尤其是硅材的芯片的埋入连X光都无法检视,充分达到***与功能的隐密性及保护性;
5、三维***级金属线路基板封装整合的***功能多,从而同样功能的元器件模块在PCB上所占用的空间就比较少,从而也就降低了成本。
6、三维***级金属线路基板的夹层在制作过程中可以埋入高功率器件,与控制芯片分别装在基板两侧,从而可以避免高功率器件散热而干扰控制芯片的信号传输。
7、三维***级金属线路基板采用电镀方式制作线路,线宽线距可以达到15μm以下。
8、三维***级金属线路基板采用电镀、蚀刻与塑封工艺制成,工艺简单,成本比有机基板低30%左右。
附图说明
图1~图23为本发明一种先封后蚀三维***级芯片正装凸点封装结构工艺方法实施例1的各工序示意图。
图24为本发明一种先封后蚀三维***级芯片正装凸点封装结构实施例1的示意图。
图25~图50为本发明一种先封后蚀三维***级芯片正装凸点封装结构工艺方法实施例2的各工序示意图。
图51为本发明一种先封后蚀三维***级芯片正装凸点封装结构实施例2的示意图。
图52~图98为本发明一种先封后蚀三维***级芯片正装凸点封装结构工艺方法实施例3的各工序示意图。
图99为本发明一种先封后蚀三维***级芯片正装凸点封装结构实施例3的示意图。
图100为本发明一种先封后蚀三维***级芯片正装凸点封装结构实施例4的示意图。
图101为本发明一种先封后蚀三维***级芯片正装凸点封装结构实施例5的示意图。
图102为本发明一种先封后蚀三维***级芯片正装凸点封装结构实施例6的示意图。
图103为本发明一种先封后蚀三维***级芯片正装凸点封装结构实施例7的示意图。
图104为传统四面无引脚金属引线框封装结构的示意图。
图105为传统的有机多层线路基板封装结构的示意图。
其中:
基岛1
引脚2
导电柱子3
第一芯片4
第一金属线5
导电或不导电粘结物质6
第二芯片7
第二金属线8
第一塑封料或环氧树脂9
第二塑封料或环氧树脂10
抗氧化层11
高导电金属层12
绿漆或可感光不导电胶材13
无源器件14
第三芯片15
第三金属线16
第一金属球17
第二金属球18。
具体实施方式
本发明一种先封后蚀三维***级芯片正装凸点封装结构及工艺方法如下:
实施例1:单层线路单芯片正装单圈引脚(1)
参见图23,本发明一种先封后蚀三维***级芯片正装凸点封装结构,它包括基岛1和引脚2,所述引脚2正面设置有导电柱子3,所述基岛1正面通过导电或不导电粘结物质6正装有第一芯片4,所述第一芯片4正面与引脚2正面之间通过第一金属线5相连接,所述基岛1和引脚2正面的区域以及导电柱子3、第一芯片4和第一金属线5***的区域均包封有第一塑封料或环氧树脂9,所述第一塑封料或环氧树脂9与导电柱子3顶部齐平,所述导电柱子3露出第一塑封料或环氧树脂9的表面设置有抗氧化层11,所述基岛1背面通过导电或不导电粘结物质6正装有第二芯片7,所述第二芯片7正面与引脚2背面之间通过第二金属线8相连接,所述基岛1和引脚2背面区域以及第二芯片7和第二金属线8***的区域均包封有第二塑封料或环氧树脂10,所述导电柱子3顶部设置有第一金属球17。
其工艺方法如下:
步骤一、取金属基板
参见图1,取一片厚度合适的金属基板,金属基板的材质可以是铜材、铁材、镀锌材、不锈钢材、铝材或可以达到导电功能的金属物质或非金属物质,厚度的选择可依据产品特性进行选择;
步骤二、金属基板表面预镀铜材
参见图2,在金属基板表面预镀一层铜材,铜层厚度为2~10微米,依据功能需要也可以减薄或是增厚,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤三、贴光阻膜作业
参见图3,在步骤二完成预镀铜材的金属基板正面及背面分别贴上可进行曝光显影的光阻膜,目的是为了后续金属线路图形的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤四、金属基板正面去除部分光阻膜
参见图4,利用曝光显影设备将步骤三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行金属线路层电镀的区域;
步骤五、电镀金属线路层
参见图5,在步骤四中金属基板正面去除部分光阻膜的区域内电镀上金属线路层,金属线路层电镀完成后即在金属基板正面形成相应的基岛和引脚,金属线路层的材质可以是铜、铝、镍、银、金、铜银、镍金或镍钯金等,金属线路层厚度为5~20微米,可以根据不同特性变换电镀的厚度,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤六、贴光阻膜作业
参见图6,在步骤五完成电镀金属线路层的金属基板正面贴上可进行曝光显影的光阻膜,目的是为后续导电柱子的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤七、金属基板正面去除部分光阻膜
参见图7,利用曝光显影设备将步骤六完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行导电柱子电镀的区域;
步骤八、电镀导电柱子
参见图8,在步骤七中金属基板正面去除部分光阻膜的区域内电镀上导电柱子,导电柱子的材质可以是铜、铝、镍、银、金、铜银、镍金、镍钯金或可以达到导电功能的金属物质等材料,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤九、去除光阻膜
参见图9,去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤十、装片
参见图10,在步骤五形成的基岛正面涂覆导电或不导电粘结物质进行第一芯片的植入;
步骤十一、金属线键合
参见图11,在芯片正面与步骤五形成的引脚之间进行键合金属线作业;
步骤十二、环氧树脂塑封
参见图12,在完成装片打线后的金属基板正面进行环氧树脂塑封保护,环氧树脂材料可以依据产品特性选择有填料或是没有填料的种类;
步骤十三、环氧树脂表面研磨
参见图13,在步骤十二完成环氧树脂塑封后进行表面研磨;
步骤十四、贴光阻膜作业
参见图14,在步骤十三完成环氧树脂表面研磨后的金属基板正面和背面贴上可进行曝光显影的光阻膜;
步骤十五、金属基板背面去除部分光阻膜
参见图15,利用曝光显影设备将步骤十四完成贴光阻膜作业的金属基板背面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板背面后续需要进行蚀刻的区域;
步骤十六、蚀刻
参见图16,在步骤十五中金属基板背面去除部分光阻膜的区域进行化学蚀刻,蚀刻的方法可以采用氯化铜或氯化铁的蚀刻工艺;
步骤十七、去除光阻膜
参见图18,去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤十八、电镀抗氧化金属层或披覆抗氧化剂(OSP)
参见图18,在步骤十七中去除光阻膜后金属基板表面裸露在外的金属表面进行抗氧化金属层电镀,如金、镍金、镍钯金、锡或是被覆抗氧化剂(OSP);
步骤十九、装片
参见图19,在基岛背面涂覆导电或不导电粘结物质进行第二芯片的植入;
步骤二十、金属线键合
参见图20,在第二芯片正面与引脚背面之间进行键合金属线作业;
步骤二十一、环氧树脂塑封
参见图21,在完成装片打线后的金属基板背面进行环氧树脂塑封保护,环氧树脂材料可以依据产品特性选择有填料或是没有填料的种类;
步骤二十二、植球
参见图22,在步骤十八完成电镀抗氧化金属层或披覆抗氧化剂的导电柱子顶部植入第一金属球;
步骤二十三、切割成品
参见图23,将步骤二十二完成植球的半成品进行切割作业,使原本以阵列式集合体方式集成在一起并含有芯片的塑封体模块一颗颗切割独立开来,制得先封后蚀三维***级芯片正装凸点封装结构成品。
实施例2:单层线路单芯片正装单圈引脚(2)
参见图51,本发明一种先封后蚀三维***级芯片正装凸点封装结构,它包括基岛1和引脚2,所述引脚2正面设置有导电柱子3,所述基岛1正面通过导电或不导电粘结物质6正装有第一芯片4,所述第一芯片4正面与引脚2正面之间通过第一金属线5相连接,所述基岛1和引脚2正面区域以及导电柱子3、第一芯片4和第一金属线5***区域均包封有第一塑封料或环氧树脂9,所述第一塑封料或环氧树脂9与导电柱子3顶部齐平,所述第一塑封料或环氧树脂9正面通过导电或不导电粘结物质正装有第二芯片7,所述第二芯片7正面与导电柱子3顶部之间通过第二金属线8相连接,所述导电柱子3顶部区域以及第二芯片7和第二金属线8***区域均包封有第二塑封料或环氧树脂10,所述基岛1和引脚2背面设置有高导电金属层12,所述高导电金属层12与高导电金属层12之间填充有绿漆或可感光不导电胶材13,所述高导电金属层12露出绿漆或可感光不导电胶材13的表面设置有抗氧化层11,所述高导电金属层12上设置有第一金属球17。
实施例2与实施例1的区别在于:实施例2中导电柱子3实际作为内引脚使用,塑封过程在金属基板框正面进行;而实施例1中导电柱子3实际作为外引脚使用,塑封过程在金属基板框背面进行。
其工艺方法如下:
步骤一、取金属基板
参见图25,取一片厚度合适的金属基板,金属基板的材质可以是铜材、铁材、镀锌材、不锈钢材或铝材或可以达到导电功能的金属物质等,厚度的选择可依据产品特性进行选择;
步骤二、金属基板表面预镀铜材
参见图26,在金属基板表面预镀一层铜材,铜层厚度为2~10微米,依据功能需要也可以减薄或是增厚,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤三、贴光阻膜作业
参见图27,在步骤二完成预镀铜材的金属基板正面及背面分别贴上可进行曝光显影的光阻膜,目的是为了后续金属线路图形的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤四、金属基板正面去除部分光阻膜
参见图28,利用曝光显影设备将步骤三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行金属线路层电镀的区域;
步骤五、电镀金属线路层
参见图29,在步骤四中金属基板正面去除部分光阻膜的区域内电镀上金属线路层,金属线路层电镀完成后即在金属基板正面形成相应的基岛和引脚,金属线路层的材质可以是铜、铝、镍、银、金、铜银、镍金或镍钯金或可以达到导电功能的金属物质等,金属线路层厚度为5~20微米,可以根据不同特性变换电镀的厚度,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤六、贴光阻膜作业
参见图30,在步骤五完成电镀金属线路层的金属基板正面贴上可进行曝光显影的光阻膜,目的是为后续导电柱子的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤七、金属基板正面去除部分光阻膜
参见图31,利用曝光显影设备将步骤六完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行导电柱子电镀的区域;
步骤八、电镀导电柱子
参见图32,在步骤七中金属基板正面去除部分光阻膜的区域内电镀上导电柱子,导电柱子的材质可以是铜、铝、镍、银、金、铜银、镍金、镍钯金或可以达到导电功能的金属物质等材料,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤九、去除光阻膜
参见图33,去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤十、装片
参见图34,在步骤五形成的基岛正面涂覆导电或不导电粘结物质进行第一芯片的植入;
步骤十一、金属线键合
参见图35,在第一芯片正面与步骤五形成的引脚之间进行键合金属线作业;
步骤十二、环氧树脂塑封
参见图36,在完成装片打线后的金属基板正面进行环氧树脂塑封保护,环氧树脂材料可以依据产品特性选择有填料或是没有填料的种类;
步骤十三、环氧树脂表面研磨
参见图37,在步骤十二完成环氧树脂塑封后进行表面研磨;
步骤十四、贴光阻膜作业
参见图38,在步骤十三完成环氧树脂表面研磨后的金属基板正面和背面贴上可进行曝光显影的光阻膜;
步骤十五、金属基板背面去除部分光阻膜
参见图39,利用曝光显影设备将步骤十四完成贴光阻膜作业的金属基板背面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板背面后续需要进行蚀刻的区域;
步骤十六、蚀刻
参见图40,在步骤十五中金属基板背面去除部分光阻膜的区域进行化学蚀刻,蚀刻的方法可以采用氯化铜或氯化铁的蚀刻工艺;
步骤十七、去除光阻膜
参见图41,去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤十八、金属基板背面披覆绿漆
参见图42,在步骤十七去除光阻膜后的金属基板背面进行绿漆的披覆;
步骤十九、曝光开窗显影
参见图43,利用曝光显影设备对金属基板背面披覆的绿漆进行曝光显影开窗,以露出金属基板背面后续需要进行高导电金属层电镀的区域;
步骤二十、电镀高导电金属层
参见图44,在步骤十九中金属基板背面绿漆的开窗区域内电镀上高导电金属层,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤二十一、电镀抗氧化金属层或披覆抗氧化剂(OSP)
参见图45,在金属基板表面裸露在外的金属表面进行抗氧化金属层电镀,如金、镍金、镍钯金、锡或是披覆抗氧化剂(OSP);
步骤二十二、装片
参见图46,在步骤十三经过研磨的环氧树脂表面通过导电或不导电粘结物质正装上第二芯片;
步骤二十三、金属线键合
参见图47,在第二芯片正面与导电柱子顶部之间进行键合金属线作业;
步骤二十四、环氧树脂塑封
参见图48,在完成装片打线后的环氧树脂表面再进行环氧树脂塑封保护,环氧树脂材料可以依据产品特性选择有填料或是没有填料的种类;
步骤二十五、植球
参见图49,在步骤二十一完成电镀抗氧化金属层或披覆抗氧化剂的高导电金属层上植入第一金属球;
步骤二十六,切割成品
参见图50,将步骤二十五完成植球的半成品进行切割作业,使原本以阵列式集合体方式集成在一起并含有芯片的塑封体模块一颗颗切割独立开来,制得先封后蚀三维***级芯片正装凸点封装结构成品。
实施例3:多层线路单芯片正装单圈引脚
参见图99,本发明一种先封后蚀三维***级芯片正装凸点封装结构,它包括基岛1和引脚2,所述引脚2正面设置有导电柱子3,所述基岛1正面通过导电或不导电粘结物质6正装有第一芯片4,所述第一芯片4正面与引脚2正面之间通过第一金属线5相连接,所述基岛1和引脚2正面的区域以及导电柱子3、第一芯片4和第一金属线5***的区域均包封有第一塑封料或环氧树脂9,所述第一塑封料或环氧树脂9与导电柱子3顶部齐平,所述导电柱子3露出第一塑封料或环氧树脂9的表面设置有抗氧化层11,所述基岛1背面通过导电或不导电粘结物质6正装有第二芯片7,所述第二芯片7正面与引脚2背面之间通过第二金属线8相连接,所述基岛1和引脚2背面区域以及第二芯片7和第二金属线8***的区域均包封有第二塑封料或环氧树脂10,所述导电柱子3顶部设置有第一金属球17。
实施例3与实施例1的区别在于:所述基岛1和引脚2均由多层金属线路层组成,金属线路层与金属线路层之间通过导电柱子相连接。
其工艺方法如下:
步骤一、取金属基板
参见图52,取一片厚度合适的金属基板,金属基板的材质可以是铜材、铁材、镀锌材、不锈钢材、铝材或可以达到导电功能的金属物质或非金属物质,厚度的选择可依据产品特性进行选择;
步骤二、金属基板表面预镀铜材
参见图53,在金属基板表面预镀一层铜材,铜层厚度为2~10微米,依据功能需要也可以减薄或是增厚,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤三、贴光阻膜作业
参见图54,在步骤二完成预镀铜材的金属基板正面及背面分别贴上可进行曝光显影的光阻膜,目的是为了后续金属线路图形的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤四、金属基板正面去除部分光阻膜
参见图55,利用曝光显影设备将步骤三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行第一金属线路层电镀的区域;
步骤五、电镀第一金属线路层
参见图56,在步骤四中金属基板正面去除部分光阻膜的区域内电镀上第一金属线路层,第一金属线路层的材质可以是铜、铝、镍、银、金、铜银、镍金或镍钯金等,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤六、贴光阻膜作业
参见图57,在步骤五完成电镀第一金属线路层的金属基板正面贴上可进行曝光显影的光阻膜,目的是为后续金属线路图形的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤七、金属基板正面去除部分光阻膜
参见图58,利用曝光显影设备将步骤六完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行第二金属线路层电镀的区域;
步骤八、电镀第二金属线路层
参见图59,在步骤七中金属基板正面去除部分光阻膜的区域内电镀上第二金属线路层作为用以连接第一金属线路层与第三金属线路层的导电柱子,第二金属线路层的材质可以是铜、铝、镍、银、金、铜银、镍金、镍钯金或可以达到导电功能的金属物质等材料,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤九、去除光阻膜
参见图60,去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤十、贴压不导电胶膜
参见图61,在金属基板正面(有线路层的区域)贴压一层不导电胶膜,其目的是为第一金属线路层与第三金属线路层进行绝缘;贴压不导电胶膜的方式可以采用常规的滚压设备,或是在真空环境下进行贴压,以防止贴压过程产生空气的残留;不导电胶膜主要是贴压式热固型环氧树脂,而环氧树脂中可以依据产品特性采用没有填料或是有填料的不导电胶膜;
步骤十一、研磨不导电胶膜表面
参见图62,在步骤十完成不导电胶膜贴压后进行表面研磨,目的是露出第二金属线路层、维持不导电胶膜与第二金属线路层的平整度以及控制不导电胶膜的厚度;
步骤十二、不导电胶膜表面金属化预处理
参见图63,对不导电胶膜表面进行金属化预处理,使其表面附着上一层金属化高分子材料或表面粗糙化处理,目的是作为后续金属材料能够镀上去的触媒转换,附着金属化高分子材料可以采用喷涂、等离子震荡、表面粗化等再行烘干即可;
步骤十三、贴光阻膜作业
参见图64,在步骤十二完成金属化的金属基板正面及背面贴上可进行曝光显影的光阻膜,目的是为后续金属线路图形的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤十四、金属基板正面去除部分光阻膜
参见图65,利用曝光显影设备将步骤十三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行蚀刻的区域图形;
步骤十五、蚀刻
参见图66,将步骤十四中的金属基板正面光阻膜开窗后的区域进行蚀刻作业,其目的是利用腐蚀技术腐蚀去除后续不需要进行电镀第三金属线路层的金属化预处理区域,进行蚀刻的方法可以是氯化铜或是氯化铁的工艺方式;
步骤十六、去除光阻膜
参见图67,去除金属基板正面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤十七、电镀第三金属线路层
参见图68,在步骤十五中金属基板正面经蚀刻后保留的金属化预处理区域电镀上第三金属线路层,第三金属线路层的材质可以是铜、铝、镍、银、金、铜银、镍金或镍钯金等,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤十八、贴光阻膜作业
参见图69,在步骤十八完成电镀第三金属线路层的金属基板正面贴上可进行曝光显影的光阻膜,目的是为后续金属线路图形的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤十九、金属基板正面去除部分光阻膜
参见图70,利用曝光显影设备将步骤十八完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行第四金属线路层电镀的区域;
步骤二十、电镀第四金属线路层
参见图71,在步骤十九中金属基板正面去除部分光阻膜的区域内电镀上第四金属线路层作为用以连接第三金属线路层与第五金属线路层的导电柱子,第四金属线路层的材质可以是铜、铝、镍、银、金、铜银、镍金、镍钯金或可以达到导电功能的金属物质等材料,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤二十一、去除光阻膜
参见图72,去除金属基板正面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤二十二、贴压不导电胶膜
参见图73,在金属基板正面(有线路层的区域)贴压一层不导电胶膜,其目的是为第三金属线路层与第五金属线路层进行绝缘;贴压不导电胶膜的方式可以采用常规的滚压设备,或是在真空环境下进行贴压,以防止贴压过程产生空气的残留;不导电胶膜主要是贴压式热固型环氧树脂,而环氧树脂中可以依据产品特性采用没有填料或是有填料的不导电胶膜;
步骤二十三、研磨不导电胶膜表面
参见图74,在步骤二十二完成不导电胶膜贴压后进行表面研磨,目的是露出第四金属线路层、维持不导电胶膜与第四金属线路层的平整度以及控制不导电胶膜的厚度;
步骤二十四、不导电胶膜表面金属化预处理
参见图75,对不导电胶膜表面进行金属化预处理,使其表面附着上一层金属化高分子材料或表面粗糙化处理,目的是作为后续金属材料能够镀上去的触媒转换,附着金属化高分子材料可以采用喷涂、等离子震荡、表面粗化等再行烘干即可;
步骤二十五、贴光阻膜作业
参见图76,在步骤二十四完成金属化的金属基板正面及背面贴上可进行曝光显影的光阻膜,目的是为后续金属线路图形的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤二十六、金属基板正面去除部分光阻膜
参见图77,利用曝光显影设备将步骤二十五完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行蚀刻的区域图形;
步骤二十七、蚀刻
参见图78,将步骤二十六中的金属基板正面光阻膜开窗后的区域进行蚀刻作业,其目的是利用腐蚀技术腐蚀去除后续不需要进行电镀第五金属线路层的金属化预处理区域,进行蚀刻的方法可以是氯化铜或是氯化铁的工艺方式;
步骤二十八、去除光阻膜
参见图79,去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤二十九、电镀第五金属线路层
参见图80,在步骤二十七中金属基板正面经蚀刻后保留的金属化预处理区域电镀上第五金属线路层,第五金属线路层电镀完成后即在金属基板正面形成相应的基岛和引脚,第五金属线路层的材质可以是铜、铝、镍、银、金、铜银、镍金或镍钯金等,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤三十、贴光阻膜作业
参见图81,在步骤二十九完成电镀第五金属线路层的金属基板正面贴上可进行曝光显影的光阻膜,目的是为后续导电柱子的制作,光阻膜可以是干式光阻膜也可以是湿式光阻膜;
步骤三十一、金属基板正面去除部分光阻膜
参见图82,利用曝光显影设备将步骤三十完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行导电柱子电镀的区域;
步骤三十二、电镀导电柱子
参见图83,在步骤三十一中金属基板正面去除部分光阻膜的区域内电镀上导电柱子,导电柱子的材质可以是铜、铝、镍、银、金、铜银、镍金、镍钯金或可以达到导电功能的金属物质等材料,电镀方式可以是电解电镀也可以采用化学沉积的方式;
步骤三十三、去除光阻膜
参见图84,去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤三十四、装片
参见图85,在步骤二十九形成的基岛正面涂覆导电或不导电粘结物质进行第一芯片的植入;
步骤三十五、金属线键合
参见图86,在第一芯片正面与步骤五形成的引脚之间进行键合金属线作业;
步骤三十六、环氧树脂塑封
参见图87,在完成装片打线后的金属基板正面进行环氧树脂塑封保护,环氧树脂材料可以依据产品特性选择有填料或是没有填料的种类;
步骤三十七、环氧树脂表面研磨
参见图88,在步骤三十六完成环氧树脂塑封后进行表面研磨;
步骤三十八、贴光阻膜作业
参见图89,在步骤三十七完成环氧树脂表面研磨后的金属基板正面和背面贴上可进行曝光显影的光阻膜;
步骤三十九、金属基板背面去除部分光阻膜
参见图90,利用曝光显影设备将步骤三十八完成贴光阻膜作业的金属基板背面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板背面后续需要进行蚀刻的区域;
步骤四十、蚀刻
参见图91,在步骤三十九中金属基板背面去除部分光阻膜的区域进行化学蚀刻,蚀刻的方法可以采用氯化铜或氯化铁的蚀刻工艺;
步骤四十一、去除光阻膜
参见图92,去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤四十二、电镀抗氧化金属层或披覆抗氧化剂(OSP)
参见图93,在步骤四十一中去除光阻膜后金属基板表面裸露在外的金属表面进行抗氧化金属层电镀,如金、镍金、镍钯金、锡或是被覆抗氧化剂(OSP);
步骤四十三、装片
参见图94,在步骤四十二完成电镀抗氧化金属层或披覆抗氧化剂的基岛背面涂覆导电或不导电粘结物质进行第二芯片的植入;
步骤四十四、金属线键合
参见图95,在第二芯片正面与步骤五形成的引脚背面之间进行键合金属线作业;
步骤四十五、环氧树脂塑封
参见图96,在完成装片打线后的金属基板背面进行环氧树脂塑封保护,环氧树脂材料可以依据产品特性选择有填料或是没有填料的种类;
步骤四十六、植球
参见图97,在步骤四十二完成电镀抗氧化金属层或披覆抗氧化剂的导电柱子顶部植入第一金属球;
步骤四十七、切割成品
参见图98,将步骤四十六完成植球的半成品进行切割作业,使原本以阵列式集合体方式集成在一起并含有芯片的塑封体模块一颗颗切割独立开来,制得先封后蚀三维***级芯片正装凸点封装结构成品。
实施例4:单芯片正装单圈引脚+无源器件
参见图100,实施例4与实施例1的区别在于:所述引脚2背面与引脚2背面之间跨接有无源器件14。
实施例5:多芯片平铺
参见图101,实施例5与实施例1的区别在于:所述基岛1背面通过导电或不导电粘结物质6正装有多个第二芯片7,所述第二芯片7正面与第二芯片7正面之间通过第二金属线8相连接。
实施例6:多芯片堆叠正正装
参见图102,实施例6与实施例1的区别在于:所述第二芯片7正面通过导电或不导电粘结物质6正装有第三芯片15,所述第三芯片15与引脚2背面之间通过第三金属线16相连接。
实施例7:多芯片堆叠正倒装
参见图103,实施例7与实施例1的区别在于:所述引脚3背面通过第二金属球18倒装有第三芯片15。
所述第三芯片15可以采用无源器件14代替。
Claims (13)
1.一种先封后蚀三维***级芯片正装凸点封装结构的工艺方法,其特征在于所述方法包括以下步骤:
步骤一、取金属基板
步骤二、金属基板表面预镀铜材
在金属基板表面预镀一层铜材;
步骤三、贴光阻膜作业
在步骤二完成预镀铜材的金属基板正面及背面分别贴上可进行曝光显影的光阻膜;
步骤四、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行金属线路层电镀的区域;
步骤五、电镀金属线路层
在步骤四中金属基板正面去除部分光阻膜的区域内电镀上金属线路层,金属线路层电镀完成后即在金属基板正面形成相应的基岛和引脚;
步骤六、贴光阻膜作业
在步骤五完成电镀金属线路层的金属基板正面贴上可进行曝光显影的光阻膜;
步骤七、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤六完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行导电柱子电镀的区域;
步骤八、电镀导电柱子
在步骤七中金属基板正面去除部分光阻膜的区域内电镀上导电柱子;
步骤九、去除光阻膜
去除金属基板表面的光阻膜;
步骤十、装片
在步骤五形成的基岛正面涂覆导电或不导电粘结物质进行第一芯片的植入;
步骤十一、金属线键合
在第一芯片正面与步骤五形成的引脚之间进行键合金属线作业;
步骤十二、环氧树脂塑封
在完成装片打线后的金属基板正面进行环氧树脂塑封保护;
步骤十三、环氧树脂表面研磨
在步骤十二完成环氧树脂塑封后进行表面研磨;
步骤十四、贴光阻膜作业
在步骤十三完成环氧树脂表面研磨后的金属基板正面和背面贴上可进行曝光显影的光阻膜;
步骤十五、金属基板背面去除部分光阻膜
利用曝光显影设备将步骤十四完成贴光阻膜作业的金属基板背面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板背面后续需要进行蚀刻的区域;
步骤十六、蚀刻
在步骤十五中金属基板背面去除部分光阻膜的区域进行化学蚀刻;
步骤十七、去除光阻膜
去除金属基板表面的光阻膜,去除光阻膜的方法采用化学药水软化并采用高压水冲洗即可;
步骤十八、披覆抗氧化剂
在步骤十七中去除光阻膜后金属基板表面裸露在外的金属表面及导电柱子顶部进行抗氧化剂披覆;
步骤十九、装片
在基岛背面涂覆导电或不导电粘结物质进行第二芯片的植入;
步骤二十、金属线键合
在第二芯片正面与引脚背面之间进行键合金属线作业;
步骤二十一、环氧树脂塑封
在完成装片打线后的金属基板背面进行环氧树脂塑封保护;
步骤二十二、植球
在步骤十八完成披覆抗氧化剂的导电柱子顶部植入第一金属球;
步骤二十三、切割成品
将步骤二十二完成植球的半成品进行切割作业,使原本以阵列式集合体方式集成在一起并含有芯片的塑封体模块一颗颗切割独立开来,制得先封后蚀三维***级芯片正装凸点封装结构成品。
2.一种先封后蚀三维***级芯片正装凸点封装结构的工艺方法,其特征在于所述方法包括以下步骤:
步骤一、取金属基板
步骤二、金属基板表面预镀铜材
在金属基板表面预镀一层铜材;
步骤三、贴光阻膜作业
在步骤二完成预镀铜材的金属基板正面及背面分别贴上可进行曝光显影的光阻膜;
步骤四、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行第一金属线路层电镀的区域;
步骤五、电镀第一金属线路层
在步骤四中金属基板正面去除部分光阻膜的区域内电镀上第一金属线路层;
步骤六、贴光阻膜作业
在步骤五完成电镀第一金属线路层的金属基板正面贴上可进行曝光显影的光阻膜;
步骤七、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤六完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行第二金属线路层电镀的区域;
步骤八、电镀第二金属线路层
在步骤七中金属基板正面去除部分光阻膜的区域内电镀上第二金属线路层作为用以连接第一金属线路层与第三金属线路层的导电柱子;
步骤九、去除光阻膜
去除金属基板表面的光阻膜;
步骤十、贴压不导电胶膜
在金属基板正面贴压一层不导电胶膜;
步骤十一、研磨不导电胶膜表面
在步骤十完成不导电胶膜贴压后进行表面研磨;
步骤十二、不导电胶膜表面进行金属化预处理或粗糙化处理
对不导电胶膜表面进行金属化预处理,使其表面附着上一层金属化高分子材料或进行粗糙化处理;
步骤十三、贴光阻膜作业
在步骤十二完成金属化预处理或粗糙化处理后的金属基板正面及背面贴上可进行曝光显影的光阻膜;
步骤十四、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤十三完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行蚀刻的区域图形;
步骤十五、蚀刻
将步骤十四中的金属基板正面光阻膜开窗后的区域进行蚀刻作业;
步骤十六、去除光阻膜
去除金属基板表面的光阻膜;
步骤十七、电镀第三金属线路层
在步骤十五中金属基板正面经蚀刻后保留的金属化预处理区域或粗糙化处理区域电镀上第三金属线路层,第三金属线路层电镀完成后即在金属基板正面形成相应的基岛和引脚;
步骤十八、贴光阻膜作业
在步骤十七完成电镀第三金属线路层的金属基板正面贴上可进行曝光显影的光阻膜;
步骤十九、金属基板正面去除部分光阻膜
利用曝光显影设备将步骤十八完成贴光阻膜作业的金属基板正面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板正面后续需要进行导电柱子电镀的区域;
步骤二十、电镀导电柱子
在步骤十九中金属基板正面去除部分光阻膜的区域内电镀上导电柱子;
步骤二十一、去除光阻膜
去除金属基板表面的光阻膜;
步骤二十二、装片
在步骤十七形成的基岛正面涂覆导电或不导电粘结物质进行第一芯片的植入;
步骤二十三、金属线键合
在第一芯片正面与步骤五形成的引脚之间进行键合金属线作业;
步骤二十四、环氧树脂塑封
在完成装片打线后的金属基板正面进行环氧树脂塑封保护;
步骤二十五、环氧树脂表面研磨
在步骤二十四完成环氧树脂塑封后进行表面研磨;
步骤二十六、贴光阻膜作业
在步骤二十五完成环氧树脂表面研磨后的金属基板正面和背面贴上可进行曝光显影的光阻膜;
步骤二十七、金属基板背面去除部分光阻膜
利用曝光显影设备将步骤二十六完成贴光阻膜作业的金属基板背面进行图形曝光、显影与去除部分图形光阻膜,以露出金属基板背面后续需要进行蚀刻的区域;
步骤二十八、蚀刻
在步骤二十七中金属基板背面去除部分光阻膜的区域进行化学蚀刻;
步骤二十九、去除光阻膜
去除金属基板表面的光阻膜;
步骤三十、抗氧化剂披覆
在步骤二十九中去除光阻膜后金属基板表面裸露在外的金属表面及导电柱子顶部进行抗氧化剂披覆;
步骤三十一、装片
在步骤三十完成披覆抗氧化剂的基岛背面涂覆导电或不导电粘结物质进行第二芯片的植入;
步骤三十二、金属线键合
在第二芯片正面与步骤五形成的引脚背面之间进行键合金属线作业;
步骤三十三、环氧树脂塑封
在完成装片打线后的金属基板背面进行环氧树脂塑封保护;
步骤三十四、植球
在步骤三十完成披覆抗氧化剂的导电柱子顶部植入第一金属球;
步骤三十五、切割成品
将步骤三十四完成植球的半成品进行切割作业,使原本以阵列式集合体方式集成在一起并含有芯片的塑封体模块一颗颗切割独立开来,制得先封后蚀三维***级芯片正装凸点封装结构成品。
3.根据权利要求2所述的一种先封后蚀三维***级芯片正装凸点封装结构的工艺方法,其特征在于:所述步骤六~步骤十七在步骤五与步骤十八之间重复进行多次。
4.一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:它包括基岛(1)和引脚(2),所述引脚(2)正面设置有导电柱子(3),所述基岛(1)正面通过导电或不导电粘结物质(6)正装有第一芯片(4),所述第一芯片(4)正面与引脚(2)正面之间通过第一金属线(5)相连接,所述基岛(1)和引脚(2)正面的区域以及导电柱子(3)、第一芯片(4)和第一金属线(5)***的区域均包封有第一塑封料(9),所述第一塑封料(9)与导电柱子(3)顶部齐平,所述导电柱子(3)露出第一塑封料(9)的表面设置有抗氧化层(11),所述基岛(1)背面通过导电或不导电粘结物质(6)正装有第二芯片(7),所述第二芯片(7)正面与引脚(2)背面之间通过第二金属线(8)相连接,所述基岛(1)和引脚(2)背面区域以及第二芯片(7)和第二金属线(8)***的区域均包封有第二塑封料(10),所述导电柱子(3)顶部设置有第一金属球(17)。
5.根据权利要求4所述的一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:所述引脚(2)背面设置有无源器件(14)。
6.根据权利要求4或5所述的一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:所述基岛(1)背面通过导电或不导电粘结物质(6)正装有多个第二芯片(7),所述第二芯片(7)正面与第二芯片(7)正面之间通过第二金属线(8)相连接。
7.根据权利要求4或5所述的一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:所述第二芯片(7)正面通过导电或不导电粘结物质(6)正装有第三芯片(15),所述第三芯片(15)与引脚(2)背面之间通过第三金属线(16)相连接。
8.根据权利要求6所述的一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:所述第二芯片(7)正面通过导电或不导电粘结物质(6)正装有第三芯片(15),所述第三芯片(15)与引脚(2)背面之间通过第三金属线(16)相连接。
9.根据权利要求4或5所述的一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:所述引脚(2)背面通过第二金属球(18)倒装有第三芯片(15)。
10.根据权利要求6所述的一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:所述引脚(2)背面通过第二金属球(18)倒装有第三芯片(15)。
11.根据权利要求7所述的一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:所述引脚(2)背面通过第二金属球(18)倒装有第三芯片(15)。
12.根据权利要求8所述的一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:所述引脚(2)背面通过第二金属球(18)倒装有第三芯片(15)。
13.根据权利要求9所述的一种先封后蚀三维***级芯片正装凸点封装结构,其特征在于:所述第三芯片(15)采用无源器件(14)代替。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201310340001.6A CN103515249B (zh) | 2013-08-06 | 2013-08-06 | 先封后蚀三维***级芯片正装凸点封装结构及工艺方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
CN201310340001.6A CN103515249B (zh) | 2013-08-06 | 2013-08-06 | 先封后蚀三维***级芯片正装凸点封装结构及工艺方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
CN103515249A CN103515249A (zh) | 2014-01-15 |
CN103515249B true CN103515249B (zh) | 2016-02-24 |
Family
ID=49897767
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN201310340001.6A Active CN103515249B (zh) | 2013-08-06 | 2013-08-06 | 先封后蚀三维***级芯片正装凸点封装结构及工艺方法 |
Country Status (1)
Country | Link |
---|---|
CN (1) | CN103515249B (zh) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN104201164B (zh) * | 2014-08-27 | 2019-01-15 | 佳禾智能科技股份有限公司 | 一种三维集成电路组件及其制备方法 |
ITUA20162740A1 (it) * | 2016-04-20 | 2017-10-20 | St Microelectronics Srl | Dispositivo a semiconduttore e procedimento corrispondente |
JP2019096731A (ja) * | 2017-11-22 | 2019-06-20 | トヨタ自動車株式会社 | 半導体装置 |
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CN102723293A (zh) * | 2012-06-09 | 2012-10-10 | 江苏长电科技股份有限公司 | 芯片倒装单面三维线路先蚀后封制造方法及其封装结构 |
CN102723289A (zh) * | 2012-06-09 | 2012-10-10 | 江苏长电科技股份有限公司 | 芯片正装单面三维线路先封后蚀制造方法及其封装结构 |
CN102723288A (zh) * | 2012-06-09 | 2012-10-10 | 江苏长电科技股份有限公司 | 芯片倒装单面三维线路先封后蚀制造方法及其封装结构 |
Family Cites Families (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101346420B1 (ko) * | 2011-12-29 | 2014-01-10 | 주식회사 네패스 | 반도체 패키지 및 그 제조 방법 |
-
2013
- 2013-08-06 CN CN201310340001.6A patent/CN103515249B/zh active Active
Patent Citations (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN1638114A (zh) * | 2002-04-22 | 2005-07-13 | 台达电子工业股份有限公司 | 改善热管理的功率转换器封装 |
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CN102723293A (zh) * | 2012-06-09 | 2012-10-10 | 江苏长电科技股份有限公司 | 芯片倒装单面三维线路先蚀后封制造方法及其封装结构 |
CN102723289A (zh) * | 2012-06-09 | 2012-10-10 | 江苏长电科技股份有限公司 | 芯片正装单面三维线路先封后蚀制造方法及其封装结构 |
CN102723288A (zh) * | 2012-06-09 | 2012-10-10 | 江苏长电科技股份有限公司 | 芯片倒装单面三维线路先封后蚀制造方法及其封装结构 |
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---|---|
CN103515249A (zh) | 2014-01-15 |
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