CN100508586C - 再现设备、数据处理***和再现方法 - Google Patents

再现设备、数据处理***和再现方法 Download PDF

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Abstract

公开了一种连续地解码和再现形成再现数据的多个画面数据的再现设备、数据处理***和再现方法，所述再现设备包含：再现存储器；解码器，对画面数据进行解码，在再现存储器中写入解码结果，并且再现和输出从再现存储器中读取的解码结果；以及处理电路，用于执行解码调度，以便确定使解码器以由预定多个画面数据组成的画面数据组为单位、解码属于一组画面数据的画面数据的次序，生成包括指示所确定的次序的解码次序数据以及指示画面数据的有效性的有效性数据的调度结果数据，基于调度结果数据、以由解码调度所确定的次序选择要被处理的画面数据，并且在所选择的画面数据有效的条件下，使解码器解码并且再现和输出画面数据，以及当接收到再现速度改变命令时，依据所改变的再现速度更新调度结果数据中的有效性数据。

Description

再现设备、数据处理***和再现方法
相关申请的交叉引用
本发明包含与在2004年10月26日向日本专利局提交的日本专利申请JP 2004-311599有关的主题，这个专利申请的全部内容通过引用包含在此。
技术领域
本发明涉及用于对已再现数据进行再现的再现设备、数据处理***、再现方法、程序、以及存储介质。
背景技术
例如，存在有解码和再现由MPEG(运动图像专家组)方案编码的已再现数据的再现设备。这样的再现设备，例如，执行解码调度，以便确定以形成再现数据(GOP)的I、P、和B画面数据组为单位对依据画面数据之间的参考关系和再现速度所选择的画面数据进行解码的定时和次序，并且依据解码调度的结果解码该画面数据并且再现和输出解码结果。在这个再现设备中，例如，当接收改变再现速度的命令时，在正被再现的GOP之后的下一个GOP的解码调度中，生成对应于改变的再现速度的解码调度的结果。作为参考，可参见日本专利公开(A)2003-101967。
然而，在上述相关领域的再现设备中，当接收改变再现速度的命令时，因为在正被再现的GOP之后的下一个GOP的解码调度中生成对应于所改变的再现速度的解码调度结果，所以仅仅在接收该改变命令时正被解码并且再现和输出的GOP之后的下一个GOP中，获得对应于所改变的再现速度的再现和输出。因此，从接收用于改变再现速度的命令的时间到获得对应于所改变的再现速度的再现和输出的时间需要较长时间，也就是说，具有响应差的缺点。
发明内容
本发明的一个目的是提供一种再现设备、数据处理***、再现方法、程序、和存储介质，它们在连续地解码并且再现和输出多个画面数据的时候，和相关技术相比，能够缩短从接收到改变再现速度的命令的时刻到获得对应于所改变的再现速度的再现和输出的时刻的时间。
依据本发明的第一方面，提供了一种连续地解码和再现形成再现数据的多个画面数据的再现设备，该设备包含：再现存储器；解码器，对画面数据进行解码，在再现存储器中写入解码结果，并且再现和输出从再现存储器中读取的解码结果；以及处理电路，用于执行解码调度，以便确定使解码器以由预定多个画面数据组成的画面数据组为单位、解码属于一组画面数据的画面数据的次序，生成包括指示所确定的次序的解码次序数据以及指示画面数据的有效性的有效性数据的调度结果数据，基于调度结果数据、以由解码调度所确定的次序选择要被处理的画面数据，以及，在所选择的画面数据有效的条件下，使解码器解码并且再现和输出该画面数据，并且当接收到再现速度改变命令时，依据所改变的再现速度更新调度结果数据中的有效性数据。
本发明第一方面的再现设备的操作模式如下：处理电路执行解码调度，以便确定使解码器以由预定多个画面数据组成的画面数据组为单位、解码属于一组画面数据的画面数据的次序，并且生成包括指示所确定的次序的解码次序数据以及指示画面数据的有效性的有效性数据的调度结果数据。此外，处理电路基于调度结果数据、以由解码调度所确定的次序选择要被处理的画面数据，并且，在所选择的画面数据有效的条件下，使解码器解码并且再现和输出画面数据。此外，当接收到再现速度改变命令时，处理电路依据所改变的再现速度更新调度结果数据中的有效性数据。
依据本发明的第二方面，提供了一种数据处理***，该***包含：数据处理设备，用于向再现设备输出形成再现数据的多个画面数据；以及再现设备，用于连续地解码和再现从数据处理设备输入的多个画面数据，该再现设备包含：输入存储器，用于存储从数据处理设备输入的画面数据；再现存储器；解码器，对从输入存储器读取的画面数据进行解码，在再现存储器中写入解码结果，并且再现和输出从再现存储器中读取的解码结果；以及处理电路，用于执行解码调度，以便确定使解码器以由预定多个画面数据组成的画面数据组为单位、解码属于一组画面数据的画面数据的次序，生成包括指示所确定的次序的解码次序数据以及指示画面数据的有效性的有效性数据的调度结果数据，基于调度结果数据、以由解码调度所确定的次序选择要被处理的画面数据，并且在所选择的画面数据有效的条件下，使解码器解码并且再现和输出该画面数据，以及当接收到再现速度改变命令时，依据所改变的再现速度更新调度结果数据中的有效性数据。
依据本发明的第三方面，提供了一种连续地解码和再现形成再现数据的多个画面数据的再现方法，该方法包含：第一步骤，执行解码调度，以便确定使解码器以由预定多个画面数据组成的画面数据组为单位、解码属于一组画面数据的画面数据的次序，并且生成包括指示所确定的次序的解码次序数据以及指示画面数据的有效性的有效性数据的调度结果数据；第二步骤，基于在第一步骤中生成的调度结果数据、以由解码调度所确定的次序选择要被处理的画面数据，并且在所选择的画面数据有效的条件下，使解码器解码并且再现和输出画面数据；以及第三步骤，当接收到再现速度改变命令时，依据所改变的再现速度、更新在第二步骤中使用的调度结果数据中的有效性数据。
依据本发明的第四方面，提供了一种由连续地解码和再现形成再现数据的多个画面数据的再现设备执行的程序，该程序包含：第一例程，用于执行解码调度，以便确定以由预定多个画面数据组成的画面数据组为单位、解码属于一组画面数据的画面数据的次序，并且生成包括指示所确定的次序的解码次序数据以及指示画面数据的有效性的有效性数据的调度结果数据；第二例程，用于基于在第一例程中生成的调度结果数据、以由解码调度所确定的次序选择要被处理的画面数据，并且在所选择的画面数据有效的条件下，解码并且再现和输出画面数据；以及第三例程，用于当接收到再现速度改变命令时，依据所改变的再现速度、更新在第二例程中使用的调度结果数据中的有效性数据。
依据本发明的第五方面，提供了一种存储程序的存储介质，该程序由连续地解码和再现形成再现数据的多个画面数据的再现设备执行，该程序包含：第一例程，用于执行解码调度，以便确定以由预定多个画面数据组成的画面数据组为单位、解码属于一组画面数据的画面数据的次序，并且生成包括指示所确定的次序的解码次序数据以及指示画面数据的有效性的有效性数据的调度结果数据；第二例程，用于基于在第一例程中生成的调度结果数据、以由解码调度所确定的次序选择要被处理的画面数据，并且在所选择的画面数据有效的条件下，解码并且再现和输出画面数据；以及第三例程，用于当接收到再现速度改变命令时，依据所改变的再现速度、更新在第二例程中使用的调度结果数据中的有效性数据。
依据本发明的第六方面，提供了一种数据处理设备，该设备包含：数据处理装置，用于向再现装置输出形成再现数据的多个画面数据；以及再现装置，用于连续地解码和再现从数据处理装置输入的多个画面数据，该再现装置包含：输入存储器，用于存储从数据处理装置输入的画面数据；再现存储器；解码器，对从输入存储器读取的画面数据进行解码，在再现存储器中写入解码结果，并且再现和输出从再现存储器中读取的解码结果；以及处理电路，用于执行解码调度，以便确定使解码器以由预定多个画面数据组成的画面数据组为单位、解码属于一组画面数据的画面数据的次序，生成包括指示所确定的次序的解码次序数据以及指示画面数据的有效性的有效性数据的调度结果数据，基于调度结果数据、以由解码调度所确定的次序选择要被处理的画面数据，并且在所选择的画面数据有效的条件下，使解码器解码并且再现和输出画面数据，以及当接收到再现速度改变命令时，依据所改变的再现速度更新调度结果数据中的有效性数据。
依据本发明，能够提供这样的再现设备、数据处理***、再现方法、程序、和存储介质，它们在连续地解码并且再现多个画面数据的情况下，和相关技术相比，能够缩短从接收到改变再现速度的命令的时刻到获得对应于所改变的再现速度的再现和输出的时刻的时间。
附图说明
根据以下参考附图给出的优选实施例的描述，本发明的这些及其他目的和特征将变得更清楚，其中：
图1是依据本发明第一实施例中的数据处理***的整体配置的视图；
图2是用于说明要由图1所示的数据处理***解码的再现数据ENC的视图；
图3是在沿前向再现图2所示的再现数据ENC的情况下由解码器34_1、34_2、和34_3进行的解码、再现存储器36_1到36_3的存储状态、以及再现和输出的视图；
图4是在沿前向再现图2所示的再现数据ENC的情况下由解码器34_1、34_2、和34_3进行的解码、再现存储器46_1到46_4的存储状态、以及再现和输出的接着图3的视图；
图5是用于说明当指定的再现速度为1X速度时所生成的调度结果数据DSCD的视图；
图6是用于说明当指定的再现速度为3X速度时所生成的调度结果数据DSCD的视图；
图7是用于说明当指定的再现速度为5X速度时所生成的调度结果数据DSCD的视图；
图8是用于说明图1所示的数据处理***的整体操作示例的流程图；
图9是用于说明图1所示的数据处理***的整体操作示例的接着图8的流程图；
图10是用于说明图1所示的数据处理***的整体操作示例的接着图9的流程图；
图11为一个视图，用于说明在当如图3和图4所示执行前向(FWD)1X速度再现时、以1.5X速度再现、3X速度再现、和1X速度再现的次序改变再现速度的情况下再现设备的操作示例；以及
图12为接着图11的视图，用于说明在当如图3和图4所示执行前向(FWD)1X速度再现时、以1.5X速度再现、3X速度再现、和1X速度再现的次序改变再现速度的情况下再现设备的操作示例。
具体实施方式
下面，将描述依据本发明实施例的数据处理***。
<第一实施例>
在这个实施例中，说明了其中再现设备具有多个解码器的情况。
图1是依据本发明一个实施例的数据处理***1的整体配置的视图。如图1所示，例如，数据处理***1具有计算机2和再现设备4。
[计算机2]
如图1所示，计算机2具有HDD 12、桥接器14、存储器16、桥接器18、操作设备19、以及CPU 20。HDD 12存储由MPEG方案编码的再现数据ENC。如图2所示，再现数据ENC由在再现设备4中按次序连续解码的多个GOP(画面组)组成。在图2所示的示例中，按GOP(N-1)、(N)、(N+1)、(N+2)的次序执行解码。每个GOP由三种类型的画面数据(帧数据)I、P、和B组成。此外，每个GOP包括单个I画面数据。在当前实施例中，例如，使用在GOP中具有相对大量画面数据的所谓的“长GOP”。应注意到：在这个申请的附图中，在左上部分没有向属于GOP(N-1)的画面数据给出任何符合，在左上部分向属于GOP(N)的画面数据给出星号，在左上部分向属于GOP(N+1)的画面数据给出“+”，在左上部分向属于GOP(N+2)的画面数据给出“-”，以及在左上部分向属于GOP(N+3)的画面数据给出“/”。此外，在附图中，附在“I”、“P”、和“B”的底部或者右侧的数字示出其中画面数据的解码结果被再现和输出的次序。
I画面数据是内(帧内)编码图像的画面数据，并且与其它画面数据独立地进行编码。此外，P画面数据是沿前向方向预测性地编码的帧的画面数据，并且参考在时间方面位于过去(先前的显示次序)的I或者P画面数据进行解码。应注意到：“I和P画面数据”还被称为“锚(anchor)画面数据”。此外，B画面数据是在两个方向预测性编码的帧的画面数据，并且在参考在时间方面位于之前或之后(在前或者在后显示次序)的I或者P画面数据的同时进行解码。应注意到：HDD 12的读出速度比再现设备4的最大再现速度要慢。
桥接器14提供了桥接器18的扩展功能并且具有PCI扩展槽或者IDE(集成驱动器电子电路)槽等。桥接器14基本上具有与桥接器18相同的功能，但是具有比桥接器18更窄的带宽，并且与连接到桥接器18的设备相比，连接到桥接器14的设备具有较低的存取速度。
存储器16是例如半导体存储器，并且存储用于CPU 20的处理的程序和数据。操作设备19是键盘、鼠标、或者其它操作装置，并且输出对应于用户操作的操作信号到CPU 20。操作设备19接收用于指定再现数据ENC的再现点的操作、用于发出指定再现点的再现开始命令的操作、以及依据基于未显示的操作屏幕的用户操作的瞬变(transient)命令操作，并且向CPU 20输出表明该操作的操作信号。桥接器18与桥接器14、存储器16、PCI总线6、和CPU 20相连，而且转换数据并且通过CPU 20地址总线和数据总线传输该数据。
例如，CPU 20执行从存储器16读取的程序，以便集中地控制计算机2的操作。当CPU 20从操作设备19接收指示用于指定再现点的操作的操作信号作为输入时，它从HDD 12中读取包括所指定的再现点的画面数据的GOP，并且通过桥接器18和PCI总线6将GOP输出到再现设备4。此外，当CPU 20从操作设备19接收指示再现开始命令操作的操作信号作为输入时，它通过桥接器18和PCI总线6输出指定再现点的再现开始命令到再现设备4。此外，当CPU 20从操作设备19接收指示瞬变命令操作的操作信号作为输入时，它通过桥接器18和PCI总线6输出该瞬变命令到再现设备4。此外，CPU 20将GOP输出到再现设备4，以便将在再现数据ENC的GOP中、以显示次序在这样的GOP之前一个位置的GOP，以及以显示次序在这样的GOP之后一个位置的GOP存储到再现设备4的输入存储器32中，其中这样的GOP包括在再现设备4中的再现点的画面数据。
[再现设备4]
如图1所示，例如，再现设备4具有PCI桥接器30、输入存储器32、解码器34_1到34_3、再现存储器36_1到36_3、选择器38、控制存储器40、CPU 42、以及控制总线46。要注意到，控制存储器40存储预定程序(本发明中的程序)，而且CPU 42读取并且执行该程序以执行以下的处理。预定程序可以存储在半导体存储器或者其它控制存储器40中，或者可以存储在HDD、光盘、或者其它存储介质上。
PCI桥接器30具有存储器，用于缓存经由PCI总线6从计算机2输入的GOP和命令。此外，桥接器18具有动态存储器存取(DMA)传输功能。
[输入存储器32]
输入存储器32是SDRAM或者其它半导体存储器，并且暂时存储经由PCI桥接器30输入的GOP。
[解码器34_1、34_2、以及34_3]
解码器34_1依据从CPU 42输入的解码命令(CPU 42的控制)，通过PCI桥接器30接收从输入存储器32读取的再现数据ENC作为输入，依据MPEG方案解码该数据，并且把结果写入到再现存储器36_1中。具体地说，解码器34_1在CPU 42的控制下，解码从输入存储器32读取的I画面数据而不用参考其它画面数据的解码结果。此外，解码器34_1在CPU 42的控制下，通过参考在时间方面处于过去的、并且已经将解码结果存储在相应的再现存储器36_1中的I或者P画面数据的解码结果，解码从输入存储器32读取的P画面数据。
图3和图4是示出由解码器34_1、34_2、和34_3在沿前向方向对再现数据ENC进行再现时进行的解码、再现存储器36_1到36_3的存储状态、以及产物和输出。在图3、图4、以及后面说明的相应附图中，被示为与解码器34_1相联系的存储体区域“0”到“7”是在再现存储器36_1中定义的存储体区域，被示为与解码器34_2相联系的存储体区域“0”到“7”是在再现存储器36_2中定义的存储体区域，以及被示为与解码器34_3相联系的存储体区域“0”到“7”是在再现存储器36_3中定义的存储体区域。此外，“out0”、“out1”、和“out2”表示从解码器34_1、34_2、和34_3输出到选择器38的解码结果。此外，最底部的“再现和输出”表示来自选择器38的再现和输出。此外，在图3、图4、以及后面说明的相应附图中，被示为由粗线包围的部分表示由解码器34_1、34_2、和34_3所进行的解码。
如图3和图4所示，在依据来自CPU 42的解码命令、沿CPU 42指定的再现方向连续再现的情况下，译码器电路34_1在再现存储器36_1中保持I和P画面数据的解码结果的存储，不再用于再现和输出。例如，解码器34_1即使在完成GOP(N-1)的再现和输出之后也还保持I2、P5、P8、P11、P14、＊I2的解码结果。为此，如下所述，当出现速度改变命令时，通过使用保持存储在再现存储器36_1中的解码结果，能够就在速度改变之后、在用于处理一个画面的时间内执行再现和输出。也就是说，当出现速度改变命令时，解码器34_1能够使用在发出该速度改变命令之前早已经存储在再现存储器36_1中用于再现和输出的、I和P画面数据的解码结果。具体地说，对于I和P画面数据，解码器34_1依据来自CPU 42的显示命令、在速度改变命令之后读取并且再现和输出早已经存储在再现存储器36_1中的I和P画面数据的解码结果。此外，对于B画面数据，解码器34_1依据来自CPU 42的解码命令、在速度改变命令之后参见早已经存储在再现存储器36_1中的、形成该B画面数据的锚画面数据的I和P画面数据的解码结果，执行解码，并且依据来自CPU 42的显示命令再现和输出解码结果。
此外，如图3所示，解码器34_1依据来自CPU 42的解码命令、在B画面数据之前解码在正被解码的GOP中的I和P画面数据，并且把解码结果写入到再现存储器36_1中。
解码器34_2和34_3具有与解码器34_1相同的配置。它们依据MPEG方案解码经由PCI桥接器30输入的图像数据，并且把结果写入到它们相应的再现存储器36_2和36_3中。
在下面，将说明由解码器34_1、34_2、和34_3将解码结果写入到再现存储器36_1、36_2、和36_3中的方法。如图3和图4所示，再现存储器36_1、36_2、和36_3每个都具有八个存储体区域“0”到“7”。在这个实施例中，如图3和图4所示，在每个再现存储器36_1、36_2、和36_3处提供的八个存储体区域当中，六个存储体区域“0”到“6”固定地用作用于排他地存储I和P画面数据的解码结果的存储区域，而且两个存储体区域“6”和“7”固定地用作用于存储B画面数据的解码结果的存储区域。也就是说，再现存储器36_1到36_3同时存储在相应的解码器34_1、34_2、和34_3处解码的所有I和P画面数据的解码结果。保持这个存储直到用下一个要被解码的GOP的I和P画面数据的解码结果写入解码器为止。
当解码图2所示的再现数据ENC时，解码器34_1，例如如图3所示，在再现存储器36_1的存储体区域“0”到“5”中写入GOP(N-1)中的I2、P5、P8、P11、和P14画面数据，以及GOP(N)中的I2画面数据。此外，解码器34_2，例如如图3和图4所示，在再现存储器36_2的存储体区域“0”到“5”中写入GOP(N)中的I2、P5、P8、P11、和P14画面数据，以及GOP(N+1)中的I2画面数据。此外，解码器34_3，例如如图3所示，在再现存储器36_3的存储体区域“0”到“5”中写入GOP(N+1)中的I2、P5、P8、P11、和P14画面数据，以及GOP(N+2)中的I2画面数据。
此外，解码器34_1在解码GOP(N-1)中的B画面数据时，参考存储在再现存储器36_1的存储体区域“0”到“5”中的I和P画面数据的解码结果。此外，解码器34_2在解码GOP(N)中的B画面数据时，参考存储在再现存储器36_2的存储体区域“0”到“5”中的I和P画面数据的解码结果。此外，解码器34_3在解码GOP(N+1)中的B画面数据时，参考存储在再现存储器36_3的存储体区域“0”到“5”中的I和P画面数据的解码结果。要注意到，解码器34_1、34_2、和34_3用在再现存储器36_1到36_3的存储体“6”和“7”中所存储的B画面数据之后三个画面的B画面数据的解码结果，连续地覆写那个B画面数据的解码结果。为此，不需要提供对应于GOP中的所有B画面数据的存储体区域，而且能够使再现存储器36_1到36_3的尺寸变小。
[选择器38]
选择器38在CPU 42的控制下，切换并且有选择地再现和输出从再现存储器36_1、36_2、和36_3读取的解码结果。
[CPU 42]
CPU 42基于存储在控制存储器40中的程序和数据执行以下处理，并且集中地控制再现设备4的操作.CPU 42将从计算机2输入的GOP(再现数据ENC)写入到输入存储器32中。CPU 42执行解码调度，以便为存储在输入存储器32中的GOP以GOP为单位、对应于指定的再现速度解码包括在GOP中的画面数据。具体地说，CPU 42执行解码调度，以便基于在画面数据之间的相互参考关系、再现速度、以及再现方向，确定用于解码存储在输入存储器32中、包括由再现开始命令所指示的再现点的画面数据的1个GOP中的画面数据的次序和时间，并且生成图5所示的调度结果数据DSRD。也就是说，CPU 42以GOP为单位生成调度结果数据DSRD。如图5所示，调度结果数据DSRD指示利用画面数据的标识数据(画面数据id)解码在GOP中的所有画面数据的次序。图5是用于说明其中指定再现速度是1X速度的情况的图。要注意到，在图5、图6和图7中，在附于画面id的括号中的数字表示再现和输出的次序。此外，如图5所示，调度结果数据DSRD包括用于每个画面数据的、指示是否以指定的再现速度再现画面数据的有效性标志数据VF。在当前实施例中，例如，以在生成调度结果数据DSRD的时候指定的再现速度时，指示“1”的有效性标志数据VF与要被再现和输出的画面数据相联系，而指示“0”的有效性标志数据VF与不会被再现和输出的画面数据相联系。当再现速度是图5所示的1X速度时，与所有画面数据相联系的有效性标志数据VF指示“1”。另一方面，如图6所示，当再现速度为3X速度时，CPU 42生成调度结果数据DSRD，其使与I2、P5、P8、Pb、Pe、I2、B3、B6、B9、Bc、和B0画面数据相联系的有效性标志数据VF指示“1”，并且使与其它画面数据相联系的有效性标志数据VF指示“0”。此外，如图7所示，当再现速度为5X速度时，CPU 42生成调度结果数据DSRD，其使与I2、P5、P8、Pb、Pe、B3、和Bd画面数据相联系的有效性标志数据VF指示“1”，并且使与其它画面数据相联系的有效性标志数据VF指示“0”。
CPU 42将解码命令和显示命令输出到解码器34_1、34_2、和34_3，以便基于要被处理的GOP的调度结果数据DSRD、以指定次序连续地解码并且再现和输出被设置为有效的画面数据。当在基于调度结果数据DSRD解码并且再现和输出要被处理的GOP期间接收到速度改变命令时，CPU 42与在改变之后的速度相对应地更新调度结果数据DSRD中的有效性标志数据VF，并且在这之后，基于在更新之后的有效性标志数据VF、执行对解码并且再现和输出在要被处理的GOP中未被处理的画面数据的控制。也就是说，CPU 42对于在解码和再现中的GOP，在速度改变命令之后仅仅更新调度结果数据DSRD一次。
要注意到，在当前实施例中，无论指定了什么再现速度，CPU 42都在B画面数据之前解码I和P画面数据。因此，在接收速度改变命令之后，无论改变速度再现和输出的是I、P、和B画面数据中的哪一个，都能够在1个画面数据的解码时间内获得解码结果，而且能够在短时间内开始速度改变的再现和输出。
CPU 42从输入存储器32中读取画面数据，并且将该数据输出到解码器34_1、34_2、和34_3，以便在相同的解码器34_1、34_2、和34_3中解码属于相同GOP的I和P画面数据以及参考I和P画面数据的解码结果的B画面数据。例如，CPU 42经由PCI桥接器从输入存储器32中读取在GOP(N-1)中的I和P画面数据，以及通过参考该I和P画面数据的解码结果而解码的、在GOP(N)中的B画面数据，并且把该数据输出到解码器34_1。这里，在当前实施例中，B画面数据参考通过参考不同的GOP的I和P画面数据的解码结果而解码的打开的(open)GOP。具体地说，例如，在图2所示的GOP(N)中的B0和B1画面数据通过参考在GOP(N-1)中的I和P画面数据的解码结果进行解码。因此，CPU 42将在GOP(N)中的B0和B1画面数据输出到解码器34_1。
此外，例如，CPU 42经由PCI桥接器30从输入存储器32中读取在GOP(N)中的I和P画面数据，以及通过参考该I和P画面数据的解码结果而解码的、在GOP(N+1)中的B画面数据，并且把该数据输出到解码器34_2。此外，例如，CPU 42经由PCI桥接器30从输入存储器32中读取在GOP(N+1)中的I和P画面数据，以及通过参考该I和P画面数据的解码结果而解码的、在GOP(N+2)中的B画面数据，并且把该数据输出到解码器34_3。
下面，将描述图1所示的数据处理***1的操作示例。
[第一操作示例]
下面，将说明从在计算机2中指定要被再现的图像数据的时间到在再现设备4中执行再现和输出的时间的操作示例。图8到图10是用于说明该操作示例的流程图。
步骤ST1：
计算机2的CPU 20判断是否已经从操作设备19输入了指示用于指定在再现数据ENC中的再现点的操作的操作信号。当判断已经指定了时就继续到步骤ST2，而当判断没有指定时就重复步骤ST1的处理。
步骤ST2：
计算机2的CPU 20从HDD 12中读取包括在步骤ST1指定的再现点的画面数据的GOP，以及围绕的GOP或者总共三个(多个)GOP。
步骤ST3：
计算机2的CPU 20通过桥接器18和PCI总线6将在步骤ST2读取的多个GOP输出到再现设备4。再现设备4的CPU 42通过PCI桥接器30将从计算机2输入的GOP写入到输入存储器32中。
步骤ST4：
计算机2的CPU 20将传输完成通知输出到再现设备4的CPU42。这个传输完成通知示出在步骤ST3从计算机2输出(传输)到再现设备4的GOP的标识数据，在输入存储器32中写入GOP的地址，以及GOP数据的大小。此外，传输完成通知示出在输出的GOP中的每个画面数据的标识数据、在输入存储器32中已经写入了画面数据的地址、以及画面数据的大小。CPU 42在存储器40中写入传输完成通知。
步骤ST5：
再现设备4的CPU 42，在完成步骤ST4的处理之后，将准备完成通知输出到计算机2的CPU 20。
步骤ST6：
计算机2的CPU 20判断是否已经从操作设备19输入了指示指定再现点的再现开始命令操作的操作信号。当判断已经输入了时就继续到步骤ST7，而当判断没有输入时就重复步骤ST6的处理。例如，再现开始命令指定了再现速度。
步骤ST7：
当判断输入了该命令时，计算机2的CPU 20向再现设备4的CPU42输出指定再现点的再现开始命令。
步骤ST8：
再现设备4的CPU 42执行解码调度，以便依据在画面数据之间的相互参考关系、再现速度、以及再现方向，确定对存储在输入存储器32中、包括由在步骤ST7输入的再现开始命令所指示的再现点的画面数据的GOP中的画面数据进行解码的次序和时间，以便生成调度结果数据DSRD。
步骤ST9：
再现设备4的CPU 42判断是否从计算机2的CPU 20输入了速度改变命令，当判断已经输入了该命令时继续到ST10，否则继续到步骤ST11。CPU 42通过就在速度改变命令的输出之后执行的步骤ST9的处理继续到步骤ST10，并且当再次执行该步骤ST9时继续到步骤ST11。也就是说，CPU 42在速度改变命令之后仅仅更新调度结果数据DSRD一次。
步骤ST10：
再现设备4的CPU 42基于由速度改变命令所指定的改变的再现速度、更新在步骤ST8中生成的调度结果数据DSRD中的有效性标志数据VF。在这种情况下，当速度改变命令指示加速时，CPU 42把由有效性标志数据VF指示的有效画面数据的一部分改变为无效，而当速度改变命令指示减速时，它把由有效性标志数据VF指示的无效画面数据的一部分改变为有效。
步骤ST11：
再现设备4的CPU 42基于在调度结果数据DSRD中的有效性标志数据VF、把正被处理的GOP中的接下来要被处理的有效画面数据标识为处理目标。
步骤ST12：
再现设备4的CPU 42将在步骤ST11标识的画面数据的解码命令输出到任意一个解码器34_1、34_2、和34_3。要注意到，当在步骤ST9标识的画面数据的解码结果已经存储在再现存储器36_1、36_2、和36_3中时，CPU 42不输出解码命令。
步骤ST13：
再现设备4的解码器34_1、34_2、和34_3从输入存储器32中读取由在步骤ST12输入的解码命令所指示的画面数据，并且进行解码且把解码结果写入到再现存储器36_1到36_3中。
步骤ST14：
再现设备4的CPU 42基于在调度结果数据DSRD中的有效性标志数据VF标识接下来要被再现和输出的画面数据，并且把指定画面数据的显示命令输出到相应的解码器34_1、34_2、和34_3。
步骤ST15：
再现设备4的解码器34_1、34_2、34_3基于在步骤ST14输入的显示命令、从再现存储器36_1、36_2、和36_3中读取由该显示命令所指定的画面数据的解码结果，并且将它们输出到选择器38。为此，再现并且输出所指定画面数据的解码结果。再现设备4以画面数据为单位、执行上面所描述的步骤ST9到ST15的处理。
步骤ST16：
CPU 20和CPU 42判断在执行上述步骤ST9到ST15的处理之后的画面数据是否是在GOP中的最后画面数据，当判断是最后的画面数据时继续到步骤ST17，否则返回到步骤ST9并且执行用于下一个画面数据的处理。
步骤ST17：
CPU 20和CPU 42判断所处理的画面数据所属的GOP是否是在再现数据ENC中的最后GOP。如果断定它是最后的GOP，则结束该处理，而如果不是的话则继续到步骤ST18。
步骤ST18：
计算机2的CPU 20依据再现方向从HDD 12中该取下一个GOP。
步骤ST19：
计算机2的CPU 20经由桥接器18和PCI总线6将在步骤ST23读取的GOP输出到再现设备4.再现设备4的CPU 42通过PCI桥接器30将从计算机2输入的GOP写入到输入存储器32中。
步骤ST20：
计算机2的CPU 20将在步骤ST24输出的传输完成通知输出到再现设备4的CPU 42。CPU 42在控制存储器40中写入传输完成通知。
步骤ST21：
再现设备4的CPU 42，在步骤ST25的处理结束之后，将准备完成通知输出到计算机2的CPU 20。
步骤ST22：
例如，再现设备4的CPU 42，判断包括依据再现方向的下一个再现点的画面数据的GOP的调度是否已经结束了(也就是说，是否需要调度)。当判断调度没有结束时，它继续到步骤ST8，而如果相反，则继续到步骤ST9。
[第二操作示例]
在这个操作示例中，将详细说明图9所示的步骤ST13的解码。例如，再现设备4的CPU 42基于调度结果、读取以上通过使用图3和图4所述的存储在输入存储器32中的GOP中所包括的画面数据，并且把该数据输出到解码器34_1、34_2、和34_3。然后，解码器34_1、34_2、和34_3如上所述执行解码，并且把解码结果写入到再现存储器36_1、36_2、和36_3中。
如图3和图4所示，在B画面数据之前，再现设备4在解码器34_1、34_2、和34_3中解码每个GOP的I和P画面数据，并且把结果写入到再现存储器36_1、36_2、和36_3的固定存储体区域中。这时，如果在写入操作之后有解码该数据的1个画面(1帧)的时间，则能够再现和输出在正被处理的GOP中的任何画面数据。也就是说，当在如下所述、通过图6和图7所示的步骤ST9到ST18的处理而解码并且再现和输出在GOP中的画面数据期间生成再现速度的速度改变命令时，在速度改变命令之后，能够在一个画面数据的解码时间内以改变的再现速度再现和输出画面数据。例如，当解码并且再现和输出在图3所示的GOP(N-1)中的B9画面数据时，需要在GOP(N-1)中的P8和P11画面数据的解码结果。此外，为了解码P8画面数据，需要P5画面数据的解码结果，而为了解码P5画面数据，需要I2画面数据的解码结果。因此，为了解码P9画面数据，需要I2、P5、P8、和P11画面数据的解码结果。如图3所示，依据再现设备4，通过在再现存储器36_1中存储I和P画面数据，如果解码器34_1接收GOP(N-1)的B9画面数据作为输入，则解码器34_1能够通过利用早已经存储在再现存储器36_1的存储体区域“2”和“3”中的P8和P11画面数据、快速地执行用于解码并且再现和输出B9画面数据的处理。为此，能够改变再现速度而没有时间滞后。
[第三操作示例]
下面，将说明当在如图3和图4所示执行前向(FWD)1X速度再现时以1.5X速度再现、3X速度再现、和1X速度再现的次序改变再现速度时再现设备4的操作示例。图11和图12是用于说明该操作示例的图。如图11所示，再现设备4的CPU 42使解码器34_1和34_2基于在图8的步骤ST8生成的1X速度再现的如图5所示的调度结果数据DSRD，以1X速度解码并且再现和输出GOP(N-1)和(N)中的画面数据。然后，当在以1X速度再现和输出GOP(N)的B1画面数据的解码结果期间从计算机2接收到变到1.5X速度的速度改变命令时，CPU 42执行图9所示的步骤ST10的处理，并且对应于1.5X速度再现而更新调度结果数据DSRD中的有效性标志数据VF。然后，CPU 42基于在更新之后的调度结果数据DSRD、从GOP(N)的B4画面数据开始，变换到以1.5X速度进行再现和输出。以这种方法，在再现设备4中，当接收到速度改变命令时，甚至在GOP的处理期间也可依据所改变的再现速度更新调度结果数据DSRD，并且基于在更新之后的调度结果数据DSRD对在正被处理的GOP中的剩余画面数据进行解码、再现和输出。为此，在正被处理的GOP的处理完成之前，获得改变了再现速度的再现和输出。
此后，当在以1X速度再现和输出GOP(N+1)中的P8画面数据的解码结果期间从计算机2接收到变到3X速度的速度改变命令时，CPU 42执行图9所示的步骤ST10的处理，并且更新调度结果数据DSRD中的有效性标志数据VF以便对应于图6所示的3X速度再现。然后，CPU 42基于在更新之后的调度结果数据DSRD、从GOP(N+1)的P11画面数据开始，变换到以3X速度进行再现和输出。
此后，当在以1X速度再现和输出GOP(N+2)中的P14画面数据的解码结果期间从计算机2接收到变到1X速度的速度改变命令时，CPU 42执行图9所示的步骤ST10的处理，并且更新调度结果数据DSRD中的有效性标志数据VF以便对应于图5所示的1X速度再现。然后，CPU 42基于在更新之后的调度结果数据DSRD、从GOP(N+3)的P5画面数据开始，变换到以1X速度进行再现和输出。以这种方法，如图5到图7所示，在再现设备4中，通过仅仅更新指示每个画面数据的有效性或者无效性的有效性标志数据VF，执行依据指定的再现速度的解码以及再现和输出。为此，即使当速度改变为低速时，按照原样使用由调度结果数据DSRD所指示的解码次序，并且仅仅需要重写有效性标志数据VF，因此能够在短时间内生成改变的调度结果数据DSRD.
如上所述，在数据处理***1中，如图8到图10所示，再现设备4在步骤ST8以GOP为单位执行解码调度，并且生成调度结果数据DSRD。当在GOP的再现和输出期间接收到速度改变命令时，即使在GOP的处理期间也可依据所改变的再现速度更新调度结果数据DSRD，并且基于在更新之后的调度结果数据DSRD、在处理期间解码并且再现和输出GOP中的剩余画面数据。为此，在正被处理的GOP的处理完成之前，获得改变了再现速度的再现和输出。因此，与相关的技术相比较，能够缩短从再现设备4接收到用于改变再现速度的命令的时刻到获得对应于所改变的再现速度的再现和输出的时刻的时间。当采用长GOP或者HD(高清晰度)图像时，这样的结果是尤其大的。
此外，如图5到图7所示，在数据处理***1中，再现设备4通过仅仅更新调度结果数据DSRD中的、指示每个画面数据的有效性或者无效性的有效性标志数据VF，执行依据指定的再现速度的解码以及再现和输出。为此，即使当速度改变为低速时，按照原样使用由调度结果数据DSRD所指示的解码次序，并且仅仅需要重写有效性标志数据VF，因此能够在短时间内生成改变的调度结果数据DSRD。
此外，在数据处理***1中，再现设备4在B画面数据之前，将I和P画面数据的解码结果写入到再现存储器36_1到36_3的固定存储体区域中，并且持续地保持这个结果。为此，再现设备4能够在用于解码B画面数据的时间内，再现和输出在要被处理的GOP中的所有画面数据。此外，再现设备4在再现存储器36_1、36_2、和36_3的固定存储体中连续地覆写B画面数据的解码结果。为此，能够在短时间内执行对应于改变的再现速度的再现和输出，而没有太多地增加再现存储器36_1到36_3的存储容量。
本发明不局限于上述实施例.也就是说，本领域的技术人员可以在本发明的技术范围以及它们的等效范围之内，对实施例的部件进行各种改变、形成组合或者子组合、或者进行替换。此外，在上述实施例上，举例说明了MPEG画面数据作为多个画面数据，但是本发明还可以应用于音频数据，只要该音频数据按次序进行解码。此外，在上述实施例中，作为编码方案示例说明了MPEG，但是对于如同在H.264/AVC(高级视频编码)中那样、数据由第一类型的画面数据以及第二类型的画面数据作为组成成分组成的情况，其中第一类型的画面数据具有被其它画面数据的解码参考的解码结果，而第二类型的画面数据具有不会被其它画面数据的解码参考的解码结果，能够以相同的方法应用本发明。
在上述实施例中，举例说明了其中压缩的画面数据存储在HDD12中的情况，但是本发明不局限于此，例如，本发明还可以应用于通过输入/输出接口等在光盘、磁光盘、半导体存储器、磁盘、或者其它各种存储介质上进行的存储。此外，连接方式不局限于通过电缆等的连接。例如，通过诸如来自外面的有线或者无线连接之类的其它类型连接方式的连接也是可能的。
此外，在上述实施例中，说明了由具有那些功能的硬件执行一系列处理的情况，但是本发明不局限于此。为此使用软件也是可能的。在这时候，当通过软件执行一系列处理时，可以通过把各种程序安装到计算机中来实现各种类型的功能，其中在该计算机中，形成该软件的程序被构建到专用硬件中。例如，程序从例如存储介质中安装到通用个人计算机等中。此外，存储介质包括例如光盘、磁光盘、半导体存储器、磁盘或者其它各种存储介质，是不言而喻的。此外，例如，也有可能例如通过Internet或者其它网络下载各种类型的程序，来把它们安装到一般的个人计算机等中。
此外，在上述实施例中，描述存储在存储介质中的程序的步骤当然可以以沿着所描述的次序的时间顺序执行，但是本发明不局限于该时间顺序。还包括并行或者独立的执行。
此外，在上述实施例中，没有特别地限制再现速度。本发明可以广泛地应用于以任何可变速度进行再现操作的再现设备的特定处理。
此外，实施例中的块配置是块配置的示例。本发明不局限于所说明的示例。
此外，通过适当地提供一组用于存储在HDD 12中的压缩和编码数据的、指示从HDD 12读取的数据是否有效的读取标志，一组指示在解码调度的时候的有效性的解码标志，一组用于解码数据的显示的、指示调度时的有效性的显示标志等作为元数据，并且依据再现速度和方向自动地更新这一系列的标志组，能够管理调度。在这时候，可以作为单独的调度元数据(历史记录信息)管理过去的一系列在变速再现处理中使用的调度和标志组的更新信息。这可以依据需要描述为压缩和编码数据中的语法或者可以单独地存储在诸如HDD 12之类的存储介质中。
此外，还可以作为元数据(部件历史记录信息)管理解码器的数目、存储体的数目、解码器ID等。此外，还可以作为元数据(再现历史记录信息)管理再现速度、再现方向等。在这时候，如果必要，元数据可以描述为压缩和编码数据中的语法或者可以单独地存储在诸如HDD 12之类的存储介质中。通过参考这样的元数据(历史记录信息)，有可能重新使用过去执行的调度并且更快和更准确地执行调度。要注意到，还可以包含这些元数据，以便在例如数据库的外面设备处管理这些元数据。
要注意到，在上述实施例中，本发明还能够应用于当解码器34_1到34_3不完全解码存储在HDD 12上的压缩和编码数据(将该数据解码到中间阶段)时的情况。具体地说，例如，本发明还可以应用于其中解码器34_1到34_3仅仅执行用于可变长度编码的解码和逆量化、而不执行逆DCT的情况，其中解码器执行逆量化但不执行用于可变长度编码的解码的情况等。在这种情况下，例如，解码器34_1到34_3可以生成例如指示它们所执行的处理直至编码和解码的什么阶段(例如，逆量化阶段)的历史记录信息，并且与不完全解码的数据相联系地输出该信息。
此外，在上述实施例中，HDD 12存储不完全编码的数据(例如，执行了DCT和量化但是没有执行可变长度编码的数据)，以及依据需要存储编码和解码的历史记录信息，但是本发明还可以应用于其中解码器34_1到34_3能够在CPU 20的控制下解码所提供的不完全编码的数据并且把该数据转换为基带信号的情况。具体地说，本发明还能够应用于其中例如解码器34_1到34_3对已经应用了DCT和量化但是没有应用可变长度编码的数据执行逆DCT和逆量化但是不执行用于可变长度编码的解码的情况。此外，在这种情况下，例如，CPU 20可以获得与不完全编码的数据相联系的、存储在HDD 12中的编码和解码历史记录信息，并且基于该信息调度通过解码器34_1到34_3进行的解码。
此外，在上述实施例中，HDD 12存储不完全编码的数据，并且依据需要存储编码和解码的历史记录信息，但是本发明还可以应用于其中解码器34_1到34_3在CPU 20的控制下不完全解码所提供的不完全编码的数据(仅仅将数据解码到中间阶段)的情况。此外，在这种情况下，同样，例如，CPU 20可以获得与不完全编码的数据相联系的、存储在HDD 12中的编码和解码历史数据，并且基于该信息调度通过解码器34_1到34_3进行的解码。此外，在这种情况下，同样，解码器34_1到34_3可以根据需要生成编码和解码的历史记录信息，并且与不完全解码的数据相联系地输出该信息。换句话说，本发明还可以应用于其中解码器34_1到34_3在CPU 20的控制下执行部分解码(执行解码步骤的一部分)的情况。CPU 20可以获得与不完全编码的数据相联系的、存储在HDD 12中的编码和解码历史记录信息，并且基于该信息调度通过解码器34_1到34_3进行的解码。解码器34_1到34_3还可以根据需要生成编码和解码的历史记录信息，并且与不完全编码的数据相联系地输出该信息。
此外，HDD 12可以进一步存储与压缩和编码的流数据相联系的、有关编码和解码处理的历史记录的信息，而且CPU 20可以基于有关编码处理和解码处理的历史记录的信息、调度该压缩和编码的流数据的解码。进一步，即使当解码器34_1到34_3能够在CPU 20的控制下解码压缩和编码的流数据并且把它转换为基带信号时，也有可能根据需要生成有关编码和解码的历史记录的信息，并且允许与该基带信号相联系地输出该信息。
要注意到，在上述实施例中，再现设备4被说明为具有多个解码器，但是本发明也能够应用于单个解码器的情况.在这时候，单个解码器不仅可以接收、解码、和显示或者输出压缩和编码的数据，而且还可以以与上述相同的方式，接收压缩和编码的数据、将该数据部分解码至中间阶段、并且将该数据与编码和解码的历史记录信息一起输出到外面，接收部分编码的数据、解码该数据、并且把该数据转换为基带信号以便输出到外面，或者接收部分编码的数据、将该数据部分解码到中间阶段、并且将该数据与编码和解码历史记录信息一起输出到外面。
此外，在上述实施例中，分开地配置CPU 20与CPU 42，但是本发明不局限于此。例如，还可以想得到由作为整体控制再现设备4的单个CPU来配置CPU 20和CPU 42。此外，即使当独立地配置CPU20和CPU 42时，CPU 20和CPU 42也可以在单个芯片上形成。
此外，当独立地配置CPU 20和CPU 42时，有可能使在上述实施例中由CPU 20执行的处理的至少一部分由CPU 42例如通过时间划分来执行，或者使由CPU 42执行的处理的至少一部分由CPU 20例如通过时间划分来执行。也就是说，CPU 20和CPU 42还可以利用能够执行分散处理的处理器实现。
此外，例如，再现设备4可以被配置为能够连接到网络，而且在上述实施例中，由CPU 20或者CPU 42执行的处理的至少一部分可以在通过网络连接的另一个设备的CPU处执行。类似地，在上述实施例中，分开地配置存储器32、40等，但是本发明不局限于此。也可以想得到由再现设备4中的单个存储器配置这些存储器。
此外，在上述实施例中，说明了HDD 12、解码器34_1到34_3、和选择器38经由桥接器和总线连接并且集成为再现设备的情况，但是本发明不局限于此。例如，发明还可以应用于其中这些部件中的一部分通过有线或者无线从外面连接的情况，以及其中这些部件以其它各种连接方式相互连接的情况。
此外，在上述实施例中，说明了压缩的流数据存储在HDD中的情况，但是本发明不局限于此。例如，本发明还可以应用于再现和处理存储在光盘、磁光盘、半导体存储器、磁盘、或者其它各种存储介质上的流数据的情况。
此外，在上述实施例中，CPU 42、存储器32、存储器40、解码器34_1到34_3、以及选择器38安装在同一扩展卡(例如，PCI卡或者PCI快速卡(PCI-Express Card))上，但是发明不局限于此。例如，当在卡之间的传输速度高时，PCI-快速(PCI-Express)或者其它技术可以用来把这些部件安装在单独的扩展卡上。
本发明不局限于在实施例中公开的再现速度。它可以应用于任何可变速度的再现。
此外，在这个说明书中，“***”意指多个设备的逻辑集合。它与不同配置的设备是否处于同一外壳中与否无关。
本发明可以应用于用于再现已再现的数据的***。
本领域的技术人员应当理解：在权利要求和它们的等效含义的范围之内，取决于设计要求及其他因素，可以进行各种修改、组合、子组合以及改变。

Claims (10)

1、一种连续地解码和再现形成再现数据的多个画面数据的再现设备，该设备包含：
再现存储器；
解码器，对所述画面数据进行解码，在所述再现存储器中写入解码结果，并且再现和输出从所述再现存储器中读取的所述解码结果；以及
处理电路，用于执行解码调度，以便以由预定多个所述画面数据组成的画面数据组为单位、确定使所述解码器解码属于一组画面数据的画面数据的次序，生成包括指示所述确定的次序的解码次序数据、以及指示所述画面数据的有效性的有效性数据的调度结果数据，基于所述调度结果数据、以由所述解码调度所确定的所述次序选择要被处理的所述画面数据，并且在所述选择的画面数据有效的条件下，使所述解码器解码并且再现和输出所述画面数据，以及当接收到再现速度改变命令时，依据改变的再现速度更新所述调度结果数据中的所述有效性数据。
2、如权利要求1所述的再现设备，其特征在于：所述处理电路生成有效性数据，并且生成包括所述有效性数据的所述调度结果数据，其中该有效性数据指示在所述画面数据组的画面数据当中、通过指定的再现速度再现的画面数据是有效的，以及指示不是通过所述再现速度再现的画面数据是无效的。
3、如权利要求1所述的再现设备，其特征在于：当在解码并且再现和输出第一组画面数据期间接收到所述改变命令时，所述处理电路
基于所述更新的调度结果数据、解码并且再现和输出所述第一组画面数据中还没被处理的画面数据，并且
在第一组画面数据之后处理的第二组画面数据的解码调度中，新生成对应于所述改变的再现速度的所述调度结果数据。
4、如权利要求1所述的再现设备，其特征在于：所述处理电路以单个画面数据为单位，基于所述确定控制所述画面数据解码、再现和输出，并且更新所述调度结果数据。
5、如权利要求1所述的再现设备，其特征在于所述解码器
以所述画面数据为单位，解码由第一类型画面数据和第二类型画面数据组成的再现数据，其中关于第一类型画面数据，其解码结果在其它画面数据的解码中被参考，关于第二类型画面数据，其解码结果不会在其它画面数据的解码中被参考；
在所述再现存储器中保持存储所述第一类型画面数据的所述解码结果；以及
参考已经存储在所述再现存储器中的所述第一类型画面数据的解码结果，解码并且再现和输出所述第二类型画面数据。
6、如权利要求5所述的再现设备，其特征在于：所述解码器在参考所述第一类型画面数据的解码结果进行解码的所述第二类型画面数据之前，解码形成所述再现数据的所述多个画面数据中的所述第一类型画面数据。
7、如权利要求6所述的再现设备，其特征在于：
在所述设备中，将不用参考其它画面数据的解码结果进行解码的I画面数据、以及参考其它画面数据的解码结果进行解码的P画面数据，作为所述第一类型画面数据，
所述第二类型画面数据是参考其它画面数据的解码结果进行解码的B画面数据，以及
所述解码器在所述再现存储器的第一存储区域中同时存储和保持所述P画面数据的解码结果以及第一I画面数据的解码结果，其中所述P画面数据位于解码结果存储在所述再现存储器中的第一I画面数据和第二I画面数据之间，其中该第二I画面数据是在多个所述I画面数据中沿再现方向位于所述第一I画面数据后的下一个I画面数据。
8、如权利要求7所述的再现设备，其特征在于：
所述再现存储器具有与所述第一存储区域分离的第二存储区域，用于存储所述B画面数据，以及
所述解码器按次序在其它B画面数据的解码结果上写入所述再现和输出的B画面数据的解码结果，直到完成位于所述第一I画面数据和所述第二I画面数据之间的所有B画面数据的解码为止。
9、一种数据处理***，包含：
数据处理设备，用于输出形成再现数据的多个画面数据到再现设备，以及
再现设备，用于连续地解码和再现从所述数据处理设备输入的多个画面数据，
所述再现设备包含：
输入存储器，用于存储从所述数据处理设备输入的所述画面数据；
再现存储器；
解码器，对从输入存储器读取的所述画面数据进行解码，在所述再现存储器中写入解码结果，并且再现和输出从所述再现存储器中读取的所述解码结果；以及
处理电路，用于执行解码调度，以便以由预定多个所述画面数据组成的画面数据组为单位、确定使所述解码器解码属于一组画面数据的画面数据的次序，生成包括指示所述确定的次序的解码次序数据以及指示所述画面数据的有效性的有效性数据的调度结果数据，基于所述调度结果数据、以由所述解码调度所确定的所述次序选择要被处理的所述画面数据，并且在所述选择的画面数据有效的条件下，使所述解码器解码并且再现和输出所述画面数据，以及当接收到再现速度改变命令时，依据改变的再现速度更新所述调度结果数据中的所述有效性数据。
10、一种用于连续地解码和再现形成再现数据的多个画面数据的再现方法，该方法包含：
第一步骤，执行解码调度，以便以由预定多个所述画面数据组成的画面数据组为单位、确定使所述解码器解码属于一组画面数据的画面数据的次序，并且生成包括指示所述确定的次序的解码次序数据以及指示所述画面数据的有效性的有效性数据的调度结果数据；
第二步骤，基于在所述第一步骤中生成的所述调度结果数据、以由所述解码调度所确定的所述次序选择要被处理的所述画面数据，并且在所述选择的画面数据有效的条件下，使所述解码器解码并且再现和输出所述画面数据；以及
第三步骤，当接收到再现速度改变命令时，依据所改变的再现速度、更新在所述第二步骤中使用的所述调度结果数据中的所述有效性数据。
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