CN100350306C - 液晶显示装置及其驱动方法 - Google Patents

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Abstract

液晶显示装置及其驱动方法。液晶显示装置包括：液晶显示板；倍频器，用于对帧频进行倍乘以产生包括奇数号帧和偶数号帧的倍乘帧频；数据转换器，用于将根据来自倍频器的奇数号帧和偶数号帧提供的N位输入数据调制成N-1位数据；以及数据驱动器，用于将来自数据转换器的N-1位数据施加给液晶显示板。

Description

液晶显示装置及其驱动方法
技术领域
本发明涉及液晶显示器，更具体来说，涉及带有简化的数据驱动电路结构的液晶显示器以及用于驱动该液晶显示器的方法。
背景技术
通常，液晶显示器(LCD)利用电场控制液晶的透光性来显示画面。为此，LCD包括：具有按矩阵形式排列的多个液晶单元的LCD板；以及用于驱动该LCD板的驱动电路。LCD易于设计成具有比任何CRT管小得多的尺寸，以满足对安装在便携式电视、膝上型个人电脑等中的显示装置的市场需求。
图1是示出现有技术的LCD的结构的电路原理框图。如图1中所示，现有技术的LCD包括：具有按矩阵形式排列的多个液晶单元的LCD板2；数据驱动器4，用于驱动LCD板2的数据线DL1到DLm；选通驱动器6，用于驱动LCD板2的选通线GL1到GLn；定时控制器8，用于控制数据驱动器4和选通驱动器6；以及基准伽马电压生成器9，用于向数据驱动器4提供16个基准伽马电压GMA1到GMA16。
LCD板2包括：薄膜晶体管TFT，置于数据线DL1到DLm与选通线GL1到GLn之间的每个交叉点处；以及连接到薄膜晶体管TFT的液晶单元7。薄膜晶体管TFT在接收到扫描信号(即，来自选通线GL的选通高电压VGH)时导通，从而将来自数据线DL的模拟数据施加给液晶单元7。另一方面，薄膜晶体管TFT在接收到来自选通线GL的选通低电压VGL时截止，从而保持液晶单元7中所充的模拟数据。
可将液晶单元7等效地视为液晶电容器。液晶单元7包括一公共电极和一连接到薄膜晶体管的像素电极。该公共电极和像素电极彼此相对，并且在它们之间布置有液晶。此外，液晶单元7包括存储电容器，其用于稳定地保持所充入的模拟数据信号，直到充入模拟数据。该存储电容器置于像素电极与前级选通线之间。液晶单元7根据通过薄膜晶体管TFT充入的模拟数据，来改变具有介电各向异性的液晶的配向状态，以控制透光性，从而实现灰度级。
图2是图1的定时控制器8的框图。如图2中所示，定时控制器8基于从外部提供的各种控制信号DE、Hsync、Vsync以及DCLK，生成用于控制选通驱动器6的选通控制信号(即，GSP、GSC、GOE等)和用于控制数据驱动器4的数据控制信号(即，SSP、SSC、SOE、POL等)。此外，定时控制器8对外部提供的用于驱动LCD板2的8位数据RGB进行调整(align)，并将它们施加给数据驱动器4。具体来说，定时控制器8包括：数据处理器32，用于调整外部的8位数据以使它们适合于驱动LCD板2，并对它们进行重排；以及控制信号生成器34，用于利用各种外部控制信号来生成选通控制信号GSP、GSC、GOE等和数据控制信号SSP、SSC、SOE、POL、REV等。
更具体来说，数据处理器32将所述8位数据调整为奇数据ODD Data和偶数据EVEN Data以使它们适合于驱动LCD板2，并将经调整的数据Data提供给数据驱动器4。控制信号生成器34利用通知有效数据间隔的数据使能信号DE、水平同步信号Hsync、帧频Vsync以及用于确定经调整的数据Data的传输定时的点时钟(dot clock)DCLK，生成数据控制信号SSP、SSC、SOE、POL、REV等以将它们施加给数据驱动器4，同时还生成选通控制信号GSC、GSP、GOE等以将它们施加给选通驱动器6。
为顺序地驱动选通线GL1到GLn，选通驱动器6设有多个选通驱动集成电路(IC)(未示出)。这些选通驱动IC在定时控制器8的控制下顺序地驱动选通线GL1到GLn。换句话说，选通IC响应于来自定时控制器8的选通控制信号GSP、GSC、GOE等顺序地把选通高电压VGH施加给选通线GL1到GLn。基准伽马电压生成器9生成具有不同电压电平的16个基准伽马电压GMA1到GMA16，并将它们提供给数据驱动器4。
为在每个帧时段(即，当帧频Vsync为60Hz时，为16.67ms)将模拟数据施加给数据线DL1到DLm中的每一条，数据驱动器4设有多个数据驱动IC(未示出)。这些数据驱动IC响应于来自定时控制器8的数据控制信号SSP、SSC、SOE、REV、POL等把模拟数据施加给数据线DL1到DLm。图3是图1的数据驱动器4的框图。如图3中所示，每个数据驱动IC包括：移位寄存器部14，用于施加顺序的采样信号；锁存部16，用于响应于所述采样信号顺序地锁存数字数据Data，以同时输出它们；数模转换器(DAC)18，用于将来自锁存部16的数字数据Data转换为模拟数据AData；以及输出缓冲器部26，用于缓存并输出模拟数据AData。
此外，数据驱动器4包括：信号生成器10，用于中继数据控制信号SSP、SSC、SOE、REV、POL等和数字数据Data；以及伽马电压部12，用于提供DAC 18所需要的正伽马电压和负伽马电压。每个数据驱动IC驱动数据线DL1到DLm中的每一条。信号生成器10对各种控制信号SSP、SSC、SOE、REV、POL等和数据Data进行控制以把它们输出给它们的对应单元。
伽马电压部12利用内部R-String(电阻串)来为每个灰度级对16个基准伽马电压GMA1到GMA16进行细分(sub-divide)，并将其输出。图4是图3的伽马电压部12的电路图。如图4中所示，伽马电压部12从内部R-String之间的每个节点向DAC 18输出具有不同电压电平的256个正伽马电压V0到V255。即，多个电阻器R1到R257在供电电压源VDD与地电压源GND之间串联连接。此外，伽马电压部12生成256个负伽马电压(未示出)，并把它们提供给DAC 18。移位寄存器部14包括n个移位寄存器，它们用于响应于源采样时钟信号SSC对来自信号生成器10的源启动脉冲SSP顺序地进行移位，并把源启动脉冲SSP输出为采样信号。
为响应于所述采样信号为某个单元顺序地对来自信号生成器10的数字数据Data进行采样以锁存它们，锁存部16设有n个锁存器以锁存n个数字数据Data，其中每个锁存器都具有与数字数据Data的位数相对应的大小。具体来说，定时控制器8把数字数据Data分成偶数据EVEN Data和奇数据ODD Data以降低传输频率，并且通过每条传输线同时输出它们。这里，偶数据EVEN Data和奇数据ODD Data中的每一个都包括红色(R)、绿色(G)以及蓝色(B)数据。由此，锁存部16为每个采样信号同时锁存偶数据EVEN Data和奇数据ODD Data(即，经由信号生成器10提供的6个数字数据Data)。然后，锁存部16响应于来自信号生成器10的源输出使能信号SOE同时输出n个锁存数据Data。这里，锁存部16响应于数据反转选择信号REV来恢复经调制以减少转变位数(transition bit number)的数字数据Data，并输出它们。具体来说，定时控制器8对转变位数超过基准值的数字数据Data进行调制以减少转变位数，从而最小化数据传输时的电磁干扰(EMI)。
为同时将来自锁存部16的数字数据Data转换成正、负模拟数据AData并输出它们，如图3中所示，DAC 18设有：共同连接到锁存部16的正(P)解码部20和负(N)解码部22；以及用于选择P解码部20和N解码部22的输出信号的多路转换器(MUX)部24。P解码部20包括n个P解码器，它们用于利用来自伽马电压部12的正伽马电压将从锁存部16同时输入的n个数据Data转换为正模拟数据AData。N解码部22包括n个N解码器，它们用于利用来自伽马电压部12的负伽马电压将从锁存部16同时输入的n个数据Data转换为负模拟数据AData。多路转换器部24包括n个多路转换器，它们用于响应于来自信号生成器10的极性控制信号POL选择性地输出来自P解码器20的正模拟数据AData，或来自N解码器22的负模拟数据AData。
输出缓冲器部26包括n个具有电压跟随器等的输出缓冲器，它们串联连接到数据线DL1到DLn中的相应数据线。n个输出缓冲器产生来自DAC 18的模拟数据AData的信号缓冲并将它们施加给数据线DL1到DLn。
现有技术的LCD使用被提供了来自伽马电压部12的正、负伽马电压的DAC 18，以将从定时控制器8输出的数字数据Data转换为模拟数据AData并将它们施加给LCD板2。图5是示出提供给图1的LCD板2的模拟数据的波形图。如图5中所示，LCD板2通过在一个帧时段(即16.7ms)内提供给液晶单元7的黑信号与白信号之间的模拟数据AData来显示希望的图像。
现有技术的LCD需要具有不同电压电平的256个正伽马电压V0到V255和256个负伽马电压，并把它们提供给数据驱动器4的DAC 18，以利用60Hz的帧频Vsync来在一个帧时段(即16.7ms)内在LCD板2上显示8位数据Data。由此，每个数据驱动IC的伽马电压部12占据了较大的区域，这是由于要生成具有不同电压电平的256个正伽马电压V0到V255和256个负伽马电压，内部R-String的长度变得很长。结果，现有技术的LCD存在这样的问题，即，由于每个数据驱动IC的伽马电压部12的尺寸较大，使得用于布置具有多个数据驱动IC的数据驱动器4的区域扩大了。
发明内容
因此，本发明旨在提供一种液晶显示器(LCD)和驱动该LCD的方法，其基本上克服了由于现有技术的局限和缺点而导致的一个或更多个问题。
本发明的一个目的是提供具有简化的数据驱动电路结构的LCD以及驱动该LCD的方法。
在下面的说明中将阐述本发明的附加特征和优点，其部分地根据所述说明即可显见，或者可以通过对本发明的实践来获知。通过文字说明及其权利要求以及附图中具体指出的结构，可以实现并获得本发明的目的和其它优点。
为实现这些目的和其它优点，并且根据本发明的用途，如所具体实现和广泛描述的，所述LCD包括：LCD板；倍频器，用于对帧频进行倍乘以产生包括奇数号帧和偶数号帧的倍乘帧频；数据转换器，用于将根据来自倍频器的奇数号帧和偶数号帧提供的N位输入数据调制成N-1位数据；以及数据驱动器，用于将来自数据转换器的N-1位数据施加给LCD板。
在另一方面中，驱动所述LCD的方法包括以下步骤：对帧频进行倍乘以形成包括奇数号帧和偶数号帧的倍乘帧频；将根据所述奇数号帧和偶数号帧提供的N位输入数据调制成N-1位数据；以及将所述N-1位数据转换为模拟数据并将该模拟数据施加给LCD板。
应当理解，本发明的以上一般性描述和以下详细描述都是示例性和说明性的，并旨在提供对如权利要求所述的本发明的进一步说明。
附图说明
附图示出了本发明的实施例并与说明书一起用于解释本发明的原理，其被包括以提供对本发明的进一步理解，并被并入且构成该说明书的一部分。附图中：
图1是示出现有技术的液晶显示器的结构的电路原理框图；
图2是图1的定时控制器的框图；
图3是图1的数据驱动器的框图；
图4是示出图3的伽马电压部的电路图；
图5是示出提供给图1的液晶显示(LCD)板的模拟数据的波形图；
图6是示出根据本发明的示例性实施例的LCD的结构的电路原理框图；
图7是示出图6的定时控制器的框图；
图8是示出图6的数据驱动器的框图；
图9是示出图8的伽马电压部的电路图；
图10是示出提供给图6的LCD板的模拟数据的波形图；
图11是示出在一奇数号帧期间提供给图6的LCD板的数据信号的波形图；以及
图12是示出在一偶数号帧期间提供给图6的LCD板的数据信号的波形图。
具体实施方式
下面详细描述本发明的实施例，其示例示出在附图中。尽可能地，贯穿所有附图都使用相同的标号来表示相同或相似的部分。以下，参照图6到12对本发明的优选实施例进行详细描述。
图6示意性地示出了根据本发明的示例性实施例的液晶显示器(LCD)。如图6中所示，该LCD包括：具有按矩阵形式排列的多个液晶单元的LCD板102；数据驱动器104，用于驱动LCD板102的数据线DL1到DLm；选通驱动器106，用于驱动LCD板102的选通线GL1到GLn；定时控制器108，用于控制数据驱动器104和选通驱动器106；以及基准伽马电压生成器109，用于向数据驱动器104提供16个基准伽马电压GMA1到GMA16。
此外，LCD板102包括：薄膜晶体管TFT，置于选通线GL1到GLn与数据线DL1到DLm之间的每个交叉点处；以及连接到薄膜晶体管TFT的液晶单元107。薄膜晶体管TFT在接收到扫描信号(即，来自选通线GL的选通高电压VGH)时导通，从而将来自数据线DL的模拟数据施加给液晶单元107。另一方面，薄膜晶体管TFT在接收到来自选通线GL的选通低电压VGL时截止，从而保持充入液晶单元107中的模拟数据。
可将液晶单元107等效地视为液晶电容器。液晶单元107包括一公共电极和一连接到薄膜晶体管的像素电极。该公共电极和像素电极彼此相对，并且在它们之间布置有液晶。此外，液晶单元107包括存储电容器，其用于稳定地保持充入的模拟数据信号，直到充入模拟数据。该存储电容器置于像素电极与前级选通线之间。液晶单元107根据通过薄膜晶体管TFT充入的模拟数据改变具有介电各向异性的液晶的配向状态，以控制透光性，从而实现灰度级。
图7是示出图6的定时控制器108的框图。如图7中所示，定时控制器108基于从外部提供的各种控制信号DE、Hsync、Vsync以及DCLK，生成用于控制选通驱动器106的选通控制信号GSP、GSC、GOE等和用于控制数据驱动器104的数据控制信号SSP、SSC、SOE、POL等。此外，定时控制器108将从外部提供的8位数据Data转换为7位调制数据Mdata，并对该7位调制数据Mdata进行调整以使它们适于驱动LCD板102，并将它们施加给数据驱动器104。
具体来说，定时控制器108包括：倍频器136，用于将各种外部控制信号DE、Hsync、Vsync以及DCLK倍乘2；数据处理器132，用于将8位数据转换为7位调制数据MData，并对所转换的7位调制数据Mdata进行调整以使它们适于驱动LCD板102；以及控制信号生成器134，用于利用来自倍频器136的各种倍频控制信号MDE、MVsync、Mhsync、MDCLK等来生成选通控制信号GCS(即，GSP、GSC、GOE等)和数据控制信号DCS(即，SSP、SSC、SOE、POL、REV等)。
更具体来说，倍频器136将各种控制信号DE、Vsync、Hsync、以及DCLK倍乘2，以把它们施加给控制信号生成器134，并把倍乘后的MVsync施加给数据处理器132。其中，倍乘后帧频的MVsync为120Hz。由此，一个帧时段变为8.33ms，这是现有技术中的一个帧时段(即，16.7ms)的一半。
控制信号生成器134利用来自倍频器136的倍乘控制信号MDE、MVsync、MHsync以及MDCLK等，生成数据控制信号DCS(即，SSP、SSC、SOE、REV、POL等)以将它们施加给数据驱动器104，并且同时生成选通控制信号GCS(即，GSC、GSP、GOE等)以将它们施加给选通驱动器106。
数据处理器132包括：帧计数器170，用于对来自倍频器136的倍乘帧频MVsync进行计数；帧存储器172，用于存储外部提供的一帧的8位数据Data并用于在两个帧期间存储一帧的已存储的8位数据Data；数据转换器174，用于响应于来自帧计数器170的帧计数信号FCS将从帧存储器172提供的8位数据Data调制成7位数据MData；以及数据调整器(aligner)176，用于对从数据转换器174提供的经调制的7位数据Mdata进行调整，以使它们适于驱动LCD板102，并把它们施加给数据驱动器104。
帧存储器172为每一帧存储从外部提供的8位数据Data。将存储在帧存储器172中的一帧的8位数据Data在两帧期间提供给数据转换器174。换句话说，通过120Hz的倍乘帧频MVsync来访问存储在帧存储器172中的一帧的8位数据Data，以将它们提供给数据转换器174。
帧计数器170对倍乘帧频MVsync进行计数，由此在与奇数号帧相对应的时间生成低电平状态(‘0’)帧计数信号FCS，并在与偶数号帧相对应的时间生成高电平状态(‘1’)帧计数信号FCS。
数据转换器174响应于来自帧计数器170的帧计数信号FCS，利用诸如下面的表1的查询表，将从帧存储器172提供的用于每一帧的8位数据Data调制成用于每一帧的7位数据MData，并把调制后的7位数据MData施加给数据调整器176。
               表1
数据(8位)   奇数号帧(FCS＝0)   偶数号帧(FCS＝1)
  Mdata(7位)   Mdata(7位)
  00000000   0000000   0000000
  00000001   0000001   0000000
  00000010   0000010   0000000
  ....   ....   ....
  01111111   1111111   0000000
  10000000   1111111   0000000
  10000001   1111111   0000001
  ....   ....   ....
  11111101   1111111   1111101
  11111110   1111111   1111110
  11111111   1111111   1111111
具体来说，如表1中所示，如果从帧计数器170施加了低电平状态(‘0’)帧计数信号FCS，则当从帧存储器172提供的一帧的8位数据Data为00000000到01111111时，数据转换器174把除去最高有效位的0000000到1111111的数据MData施加给数据调整器176，并且，同时，当它们为10000000到11111111时，数据转换器174把除去最高有效数据值的0000000到1111111的数据值调制成1111111。另一方面，如果从帧计数器170施加高电平状态(‘1’)帧计数信号FCS，则当从帧存储器172提供的一帧的8位数据Data为00000000到01111111时，数据转换器174将一数据值调制成0000000的数据值，以把它们施加给数据调整器176；并且同时，当它们为10000000到11111111时，数据转换器174把除去最高有效数据值的0000000到1111111的数据Mdata施加给数据调整器176。数据调整器176把从数据转换器174提供的经调制的7位数据MData调整成奇数据ODD MData和偶数据EVEN MData，使得调整后的数据MData适于驱动LCD板102，并把它们提供给数据驱动器104。
为顺序地驱动选通线GL1到GLn，选通驱动器106设有多个选通驱动集成电路(IC)(未示出)。选通驱动IC在定时控制器108的控制下顺序地驱动选通线GL1到GLn。换句话说，选通驱动IC响应于从定时控制器108提供的选通控制信号GSP、GSC、GOE等顺序地向选通线GL1到GLn施加选通高电压VGH。
基准伽马电压生成器109生成具有不同电压电平的8个基准伽马电压GMA1到GMA8，以把它们提供给数据驱动器104。为了在每个帧时段(即，8.33ms)内把针对每条线的模拟数据施加给数据线DL1到DLm，数据驱动器104设有多个数据驱动IC(未示出)。数据驱动IC响应于从定时控制器108提供的数据控制信号DCS(即，SSP、SSC、SOE、POL等)把模拟数据施加给数据线DL1到DLm。
图8是示出图6的数据驱动器104的框图。如图8中所示，每个数据驱动IC包括：移位寄存器部114，用于施加顺序的采样信号；锁存部116，用于响应于所述采样信号顺序地锁存从数据调整器176提供的经调制的7位数据MData，以同时输出它们；数模转换器(DAC)118，用于将来自锁存部116的经调制的7位数据MData转换为模拟数据AData；以及输出缓冲器部126，用于缓存并输出来自DAC 118的模拟数据AData以输出它们。
此外，数据驱动器104包括：信号生成器110，用于中继从定时控制器108提供的数据控制信号SSP、SSC、SOE、REV、POL等和经调制的7位数据MData；以及伽马电压部112，用于提供DAC 118所需的正伽马电压和负伽马电压。具有上述结构的每个数据驱动IC驱动数据线DL1到DLm中的每一条。
信号生成器110对从定时控制器108提供的各种控制信号(即，SSP、SSC、SOE、REV、POL等)和经调制的7位数据MData进行控制，以把它们输出给它们的对应单元。
伽马电压部112针对每个灰度级对从基准伽马电压生成器109输入的8个基准伽马电压GMA1到GMA8进行细分。图9是示出图8的伽马电压部112的电路图。如图9中所示，伽马电压部112把128个正伽马电压V0到V127输出给DAC 118。该128个正伽马电压V0到V127具有从多个电阻器R1到R129之间的每个节点到DAC 118的不同电压电平，这些电阻器R1到R129串联连接在供电电压源VDD与地电压源GND之间。此外，伽马电压部112生成128个负伽马电压(未示出)，以把它们提供给DAC 118。这里，供电电压源VDD具有与用于将现有技术中的8位数据转换为256个不同伽马电压的伽马电压部的供电电压源相同的电压值。因此，伽马电压部112与现有技术同样地把供电电压源VDD与地电压源GND之间的电压值细分成具有不同电压电平的128个伽马电压，并把它们施加给DAC 118。
移位寄存器部114包括n个移位寄存器，它们用于响应于源采样时钟信号SSC对来自信号生成器110的源启动脉冲SSP顺序地进行移位，并把源启动脉冲SSP输出为采样信号。为响应于来自移位寄存器部114的采样信号通过某个单元对来自信号生成器110的经调制的7位数据MData顺序地进行采样以锁存它们，锁存部116设有多个锁存器，以锁存经调制的7位数据MData，并且每个锁存器都具有与经调制的7位数据MData的位数相对应的大小。具体来说，定时控制器108把经调制的7位数据MData分成偶数据EVEN Data和奇数据ODD Data，以降低传输频率，并且通过每条传输线来同时输出它们。这里，偶数据EVEN Data和奇数据ODD Data中的每一个都包括红色(R)、绿色(G)、蓝色(B)数据。由此，锁存部116同时对偶数据EVEN Data和奇数据ODD Data(即，针对每个采样信号经由信号生成器110提供的经调制的7位数据MData)进行锁存。然后，锁存部116响应于来自信号生成器110的源输出使能信号SOE来同时输出锁存的经调制的7位数据MData。在该示例情况下，锁存部116响应于数据反转选择信号REV恢复使转变位数减少的经调制的7位数据MData，以输出它们。这是因为定时控制器108将具有超过基准值的转变位数的经调制的7位数据MData调制得使转变位数减少，以使数据传输时的电磁干扰(EMI)最小化。
为同时将来自锁存部116的经调制的7位数据MData转换成正、负模拟数据AData以输出它们，DAC 118设有：共同连接到锁存部116的正(P)解码部120和负(N)解码部122；以及用于选择P解码部120和N解码部122的输出信号的多路转换器(MUX)部124。
P解码部120包括n个P解码器，它们用于利用来自伽马电压部112的正伽马电压V0到V127将从锁存部116同时输入的经调制的7位数据MData转换为正模拟数据AData。另一方面，N解码部122包括n个N解码器，它们用于利用来自伽马电压部112的负伽马电压将从锁存部116同时输入的经调制的7位数据MData转换为负模拟数据AData。多路转换器部124包括n个多路转换器，它们用于响应于来自信号生成器110的极性控制信号POL选择性地输出来自P解码器120的正模拟数据AData、或来自N解码器122的负模拟数据AData。
输出缓冲器部126包括n个设有电压跟随器等的输出缓冲器，它们串联连接到相应的n条数据线DL1到DLm。这些输出缓冲器对来自DAC118的模拟数据AData进行信号缓冲以将它们施加给数据线DL1到DLm。
根据该示例性的实施例的LCD利用来自伽马电压部112的具有128个灰度级值的正、负伽马电压，将从定时控制器108输出的7位调制数据MData转换为对应的模拟数据AData，以把它们施加给LCD板102。图10是示出提供给图6的LCD板102的模拟数据的波形图。如图10中所示，LCD板102通过在一个帧时段(即8.33ms)内提供给液晶单元107的黑信号与白信号之间的模拟数据AData来显示希望的图像。
图11是示出在奇数号帧期间提供给图6的LCD板102的数据信号的波形图。如图11中所示，当外部提供的输入数据Data的值大于128时，根据本示例性实施例的LCD在奇数号帧(即8.33ms)期间将与数据值1111111相对应的模拟数据AData(即，白信号)显示在液晶单元107上，而在偶数号帧(即8.33ms)期间将与除最高有效位以外的剩余的7位数据MData相对应的模拟数据AData显示在液晶单元107上。
图12是示出在偶数号帧期间提供给图6的LCD板102的数据信号的波形图。如图12中所示，当外部提供的输入数据Data的值小于128时，根据本发明的示例性实施例的LCD在奇数号帧(即8.33ms)期间将与除最高有效位以外的剩余的7位数据MData的值相对应的模拟数据AData显示在液晶单元107上，而在偶数号帧(即8.33ms)期间将与数据值0000000相对应的模拟数据AData(即，黑信号)显示在液晶单元107上。由此，该LCD利用120Hz的帧频MVsync来把8位输入数据Data调制为7位数据MData，以将具有与调制数据MData相对应的0到127灰度级值的模拟数据AData施加给与现有技术中的一帧(即，16.7ms)相对应的所述两个帧中的每一帧(即8.33ms)，从而表示了现有技术中的256个灰度级。
因此，在根据该示例性实施例的LCD中，包括在每个数据驱动IC中的伽马电压部112生成具有不同电压电平的128个正伽马电压V0到V127和128个负伽马电压，从而将常规伽马电压部的内部R-String的长度缩短到一半。结果，根据本示例性实施例的LCD可以缩短伽马电压部112的内部R-String的长度，从而减小数据驱动器104的尺寸并简化其结构。
而且，根据该示例性实施例的LCD可以利用用于将N位数据转换为模拟数据的数据驱动器104，在LCD板102上显示N+1位输入数据。因此，根据该示例性实施例的LCD可简化数据驱动器104的结构，同时使输入数据的位数保持原样。
如上所述，根据本发明的示例性实施例的LCD和驱动该LCD的方法将N位输入数据调制为N-1位数据，并利用倍乘2的帧频根据经调制的N-1位数据来在常规的一帧期间内将输入数据划分成两部分，从而在LCD板上显示与N位输入数据相对应的灰度级值。因此，可将用于生成伽马电压的伽马电压部的面积减小为现有技术的一半，从而减小数据驱动器的尺寸，并简化其结构。而且，根据本发明的LCD及其驱动方法可以利用倍乘帧频的倍频器和用于将N位数据转换为模拟数据的数据驱动器，将N+1位输入数据显示在LCD板上，从而简化数据驱动器的结构。
本领域的技术人员可在不脱离本发明的精神或范围的前提下，对本发明的LCD和驱动该LCD的方法进行各种修改和变型。由此，本发明将覆盖落入所附权利要求及其等同物的范围内的对本发明的各种修改和变型。
本发明要求2003年12月29日在韩国提交的韩国专利申请No.P2003-99248的优先权，通过引用将其内容并入于此。

Claims (16)

1、一种液晶显示装置，包括：
液晶显示板；
倍频器，用于对帧频进行倍乘以产生倍乘帧频，该倍乘帧频包括奇数号帧和偶数号帧；
数据转换器，用于将根据来自所述倍频器的奇数号帧和偶数号帧提供的N位输入数据调制成N-1位数据，其中N为整数；以及
数据驱动器，用于将来自所述数据转换器的N-1位数据转换为模拟数据并将该模拟数据施加给所述液晶显示板。
2、如权利要求1所述的液晶显示装置，还包括：
帧存储器，用于在两帧期间存储所述N位输入数据；以及
计数器，用于在两帧期间对所述N位输入数据进行计数，以生成与所述奇数号帧和偶数号帧相对应的帧区分信号。
3、如权利要求2所述的液晶显示装置，其中，所述数据转换器响应于所述帧区分信号将来自所述帧存储器的N位输入数据调制成N-1位数据。
4、如权利要求3所述的液晶显示装置，其中，当所述帧区分信号对应于奇数号帧时，如果所述N位输入数据具有等于或大于2N的一半的值，则所述数据转换器将所述N位输入数据调制成与白信号相对应的数据值并输出该数据值，如果所述N位输入数据具有小于2N的一半的值，则所述数据转换器输出不包括其最高有效位的N位输入数据。
5、如权利要求3所述的液晶显示装置，其中，当所述帧区分信号对应于偶数号帧时，如果所述N位输入数据具有等于或大于2N的一半的值，则所述数据转换器输出不包括其最高有效位的N位输入数据，如果所述N位输入数据具有小于2N的一半的值，则所述数据转换器将所述N位输入数据调制成与黑信号相对应的数据值并输出该数据值。
6、如权利要求1所述的液晶显示装置，其中，所述数据驱动器包括：
伽马电压部，用于生成具有与N-1位相对应的不同电压电平的多个伽马电压；
数模转换器，用于利用所述多个伽马电压将所述N-1位数据转换为正模拟数据和负模拟数据，以及响应于外部提供的极性控制信号来选择性地输出所述正模拟数据和负模拟数据；以及
输出部，用于向所述液晶显示板提供来自所述数模转换器的模拟数据。
7、如权利要求6所述的液晶显示装置，其中，所述伽马电压部从多个电阻器之间的每个节点输出所述多个伽马电压，所述多个电阻器串联连接在源电压与地电压之间，并且其中所述源电压具有与所述N位数据的最高有效值相对应的白信号相同的电压电平。
8、如权利要求2所述的液晶显示装置，还包括：
数据调整器，用于重排来自所述数据转换器的N-1位数据，使得该N-1位数据适于驱动所述LCD板，并把该N-1位数据施加给所述数据驱动器。
9、一种驱动液晶显示装置的方法，包括以下步骤：
对帧频进行倍乘以形成倍乘帧频，该倍乘帧频包括奇数号帧和偶数号帧；
将根据所述奇数号帧和偶数号帧提供的N位输入数据调制成N-1位数据，其中N为整数；以及
将所述N-1位数据转换为模拟数据并将该模拟数据施加给液晶显示板。
10、如权利要求9所述的方法，还包括以下步骤：
在两帧期间存储所述输入数据；以及
对所述倍乘帧频进行计数以生成与所述奇数号帧和偶数号帧相对应的帧区分信号。
11、如权利要求10所述的方法，其中，所述调制N位输入数据的步骤包括以下步骤：响应于所述帧区分信号，将为每帧提供的N位输入数据调制成N-1位数据。
12、如权利要求11所述的方法，其中，所述调制N位输入数据的步骤包括以下步骤：
当所述帧区分信号对应于奇数号帧时，
如果所述N位输入数据具有等于或大于2N的一半的值，则将所述N位输入数据调制成与白信号相对应的数据值并输出该数据值；以及
如果所述N位输入数据具有小于2N的一半的值，则输出不包括其最高有效位的N位输入数据。
13、如权利要求11所述的方法，其中，所述调制N位输入数据的步骤包括以下步骤：
当所述帧区分信号对应于偶数号帧时，
如果所述N位输入数据具有等于或大于2N的一半的值，则输出不包括其最高有效位的N位输入数据；以及
如果所述N位输入数据具有小于2N的一半的值，则将所述N位输入数据调制成与黑信号相对应的数据值并输出该数据值。
14、如权利要求9所述的方法，其中，所述将所述N-1位数据转换为模拟数据并将该模拟数据施加给所述液晶显示板的步骤包括以下步骤：
生成具有与所述N-1位数据相对应的不同电压电平的多个伽马电压；
利用所述多个伽马电压将所述N-1位数据转换为正模拟数据和负模拟数据；以及
响应于外部提供的极性控制信号来选择性地输出所述模拟数据，并将该模拟数据施加给所述液晶显示板。
15、如权利要求14所述的方法，其中，所述生成多个伽马电压的步骤包括以下步骤：从多个电阻器之间的每个节点输出所述多个伽马电压，所述多个电阻器串联连接在源电压与地电压之间。
16、如权利要求9所述的方法，还包括以下步骤：对所述N-1位数据进行重排，使得所述N-1位数据适于驱动所述液晶显示板。
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