WO2022049641A1 - 両面冷却パワーモジュールの製造方法、および両面冷却パワーモジュール - Google Patents
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- 238000001816 cooling Methods 0.000 title claims abstract description 24
- 238000000034 method Methods 0.000 title claims abstract description 14
- 238000004519 manufacturing process Methods 0.000 title claims description 11
- 230000009977 dual effect Effects 0.000 title abstract description 6
- 239000000463 material Substances 0.000 claims abstract description 45
- 239000000758 substrate Substances 0.000 claims abstract description 34
- 125000006850 spacer group Chemical group 0.000 claims description 14
- 239000004065 semiconductor Substances 0.000 claims description 11
- 238000010438 heat treatment Methods 0.000 claims description 3
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims 2
- 229910052802 copper Inorganic materials 0.000 claims 2
- 239000010949 copper Substances 0.000 claims 2
- NDVLTYZPCACLMA-UHFFFAOYSA-N silver oxide Chemical compound [O-2].[Ag+].[Ag+] NDVLTYZPCACLMA-UHFFFAOYSA-N 0.000 claims 2
- QPLDLSVMHZLSFG-UHFFFAOYSA-N Copper oxide Chemical compound [Cu]=O QPLDLSVMHZLSFG-UHFFFAOYSA-N 0.000 claims 1
- 239000005751 Copper oxide Substances 0.000 claims 1
- BQCADISMDOOEFD-UHFFFAOYSA-N Silver Chemical compound [Ag] BQCADISMDOOEFD-UHFFFAOYSA-N 0.000 claims 1
- 229910000431 copper oxide Inorganic materials 0.000 claims 1
- 229910052709 silver Inorganic materials 0.000 claims 1
- 239000004332 silver Substances 0.000 claims 1
- 229910001923 silver oxide Inorganic materials 0.000 claims 1
- 238000001035 drying Methods 0.000 abstract description 9
- 239000002184 metal Substances 0.000 abstract description 8
- 239000000853 adhesive Substances 0.000 abstract description 3
- 230000001070 adhesive effect Effects 0.000 abstract description 3
- 239000010410 layer Substances 0.000 description 7
- 239000012790 adhesive layer Substances 0.000 description 6
- 239000011347 resin Substances 0.000 description 4
- 229920005989 resin Polymers 0.000 description 4
- 238000007796 conventional method Methods 0.000 description 2
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 2
- 238000000354 decomposition reaction Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000009969 flowable effect Effects 0.000 description 1
- 239000002648 laminated material Substances 0.000 description 1
- 238000010030 laminating Methods 0.000 description 1
- 238000000465 moulding Methods 0.000 description 1
- 239000002994 raw material Substances 0.000 description 1
- -1 tensioned and used Substances 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/50—Assembly of semiconductor devices using processes or apparatus not provided for in a single one of the subgroups H01L21/06 - H01L21/326, e.g. sealing of a cap to a base of a container
- H01L21/52—Mounting semiconductor bodies in containers
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/34—Arrangements for cooling, heating, ventilating or temperature compensation ; Temperature sensing arrangements
- H01L23/36—Selection of materials, or shaping, to facilitate cooling or heating, e.g. heatsinks
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- H—ELECTRICITY
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/03—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes
- H01L25/04—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers
- H01L25/07—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof all the devices being of a type provided for in the same subgroup of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N, e.g. assemblies of rectifier diodes the devices not having separate containers the devices being of a type provided for in group H01L29/00
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L25/00—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof
- H01L25/18—Assemblies consisting of a plurality of individual semiconductor or other solid state devices ; Multistep manufacturing processes thereof the devices being of types provided for in two or more different subgroups of the same main group of groups H01L27/00 - H01L33/00, or in a single subclass of H10K, H10N
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/32—Structure, shape, material or disposition of the layer connectors after the connecting process of an individual layer connector
- H01L2224/321—Disposition
- H01L2224/32151—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive
- H01L2224/32221—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked
- H01L2224/32225—Disposition the layer connector connecting between a semiconductor or solid-state body and an item not being a semiconductor or solid-state body, e.g. chip-to-substrate, chip-to-passive the body and the item being stacked the item being non-metallic, e.g. insulating substrate with or without metallisation
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2224/00—Indexing scheme for arrangements for connecting or disconnecting semiconductor or solid-state bodies and methods related thereto as covered by H01L24/00
- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/26—Layer connectors, e.g. plate connectors, solder or adhesive layers; Manufacturing methods related thereto
- H01L2224/31—Structure, shape, material or disposition of the layer connectors after the connecting process
- H01L2224/33—Structure, shape, material or disposition of the layer connectors after the connecting process of a plurality of layer connectors
- H01L2224/331—Disposition
- H01L2224/3318—Disposition being disposed on at least two different sides of the body, e.g. dual array
- H01L2224/33181—On opposite sides of the body
Definitions
- the present invention relates to a double-sided cooling (DUAL SIDE COOLING: DSC) power module of a power semiconductor package.
- the present invention relates to a manufacturing method for controlling the thickness of a package in which members are laminated inside, and a module thereof.
- Patent Document 1 discloses a double-sided cooling power module composed of a lower end terminal, a power semiconductor chip, a horizontal spacer, an upper end terminal, and a vertical spacer, and these members are laminated inside.
- the material thickness tolerance directly affects the thickness tolerance of the entire module, in order to control the stacking height of the double-sided cooling module, a die or the like is laminated and attached to the facing insulating substrates, and then the last attachment to the substrate is joined.
- the material adheresive
- the material is made into a buffer bonding layer (buffer adhesive layer) by a reflow process that uses a special metal jig and does not pre-dry.
- the variation in the stack height (H) of the double-sided cooling (dual side cooling module) of the power semiconductor can be made smaller than before.
- power semiconductors can optimize thermal performance for water jacket cooling systems. That is, a cheap member (a member that relaxes dimensional tolerances) can be used, and the package thickness of the power semiconductor can be made uniform.
- FIG. 1 (1) to (2) and FIGS. 2 (3) to 2 (4) are schematic cross-sectional views showing a state of manufacture. That is, it shows the assembly process flow for constructing the cushioning adhesive layer.
- FIG. 1 (1) is a first joining step in which the first joining material 5 is joined onto the first substrate 1, pre-dried, and then electronic components are mounted and joined.
- the die 4 is bonded to the spacer 3 by using the third bonding material 6.
- An insulating substrate can be used as the first substrate 1, and for example, it can be a DBC substrate or a TPC substrate in which a circuit pattern is arranged on one side.
- the spacer 3 is a conductive metal plate and can be Cu.
- the die 4 is a semiconductor chip, and can be made of SiC or GaN in addition to Si.
- the first bonding material 5 and the third bonding material 6 are similar sintered materials. Joining using a sintered material is usually performed by applying a sintered material, pre-drying, and then pressurizing and heating the object to be joined. Further, by pre-drying, the shape of the bonding material can be kept flat.
- FIG. 1 (2) is a second joining step of joining the second joining material 7 on the second substrate 2.
- the second substrate 2 an insulating substrate similar to that of the first substrate 1 can be used.
- the second bonding material 7 is a sintered material similar to the first bonding material 5 and the third bonding material 6, and can be manufactured by a method of printing a paste-like material and applying it to a substrate. Keep free of pre-drying process.
- FIG. 1 (3) shows a third portion in which the electronic components (spacer 3 and die 4) bonded to the first substrate 1 and the second bonding material 7 bonded to the second substrate 2 are bonded facing each other. It is a joining process.
- Each bonding material becomes a sintered bonding layer, but the first bonding material 5 and the third bonding material 6 are pre-dried, so that they can be hardened and maintain a flat shape. Also. Since the second bonding material 7 is not pre-dried, it remains in a softened state.
- the substrate formed in the third joining step described above is placed in the reflow lower jig 8 and covered with the reflow upper jig 9. Tension is applied between the first substrate 1 and the second substrate 2 from the inside using a special metal jig 10. Then, it is a fourth joining step of heating and joining.
- FIG. 3 shows a state taken out from the reflow jig after the above-mentioned fourth joining step.
- a double-sided cooling power module is completed by resin molding between the substrates with a mold resin.
- the mold resin and the external lead-out terminal are as seen in the prior art, and are not shown here.
- the second bonding material 7 when the second bonding material 7 is bonded in a softened state, it is crushed into a fillet shape and becomes a buffer bonding layer (buffer adhesive layer).
- the second bonding material 7 absorbs the dimensions as a buffer even if the thickness variation of the spacer 3 and the die 4 is large. , It is possible to maintain the thickness H of the target module (FIG. 3).
- the height of the stacked can be corrected. The same applies even if the stacking order of the spacers and dies is arbitrary.
- a location guide block In the case of a conventional reflow jig, it is called a location guide block and has a structure that is sandwiched between upper and lower jigs. Therefore, although the maximum height of the power module can be controlled, it is difficult to control the minimum height.
- the special metal jig 10 combines the reflow lower jig 8 and the reflow upper jig 9, and presses the substrate against the inner walls of the reflow lower jig 8 and the reflow upper jig 9 from the inside of the substrate.
- a special metal jig 10 is inserted inside each substrate, tensioned and used, and a buffer bonding layer (2nd bonding material 7 which is the last flowable adhesive layer under the die 4 is used.
- a buffer bonding layer 2nd bonding material 7 which is the last flowable adhesive layer under the die 4 is used.
- the double-sided cooling power module can be controlled to a certain height, it will not be affected by the variation in the thickness of the members to be laminated, and when it is incorporated into a unit or equipment, there will be no gap between it and the heat sink (water jacket). High thermal performance can be maintained because it can be contacted.
- the number of electronic components may be one or a plurality, and the combination of the spacer 3 and the die 4 and the stacking order may be freely changed.
- the second bonding material may be arranged between "board and die”, “die and spacer”, or “spacer and substrate”. The effect is the same.
- spacer As the spacer, Cu / Mo or the like can be applied in addition to Cu.
- a tape or paste type can be used as the bonding material before pre-drying.
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Abstract
【課題】両面冷却パワーモジュールにおいて、積み重ねられた材料の厚さのばらつきがあるため、1つずつ積み重ねることは、全体の積層厚さを一定に抑えることは困難である。 【解決手段】材料厚さ公差がモジュール全体の厚さ公差に直接影響する場合、両面冷却モジュールの積層高さを制御するために、向かいあう絶縁基板にダイなどを積層して取り付けた後、基板に最後に取り付ける接合材(接着剤)を、特殊金属治具を使用し、予備乾燥をしないリフロープロセスで、緩衝接合層(バッファー接着層)とすることである。
Description
本発明は、パワー半導体パッケージの両面冷却(デュアルサイドクーリング:DUAL SIDE COOLING:DSC)パワーモジュールに関する。特に、内部に部材が積層されたパッケージの厚さを制御する製造方法とそのモジュールに関する。
現在のパワー半導体市場において、高電圧および高電流を使用するハイエンドパワーモジュールは、より効率的な放熱を必要とされている。特に、パワー半導体パッケージの両面冷却パワーモジュールは、高い電力密度と高速による半導体チップの高い動作温度に応じて、より高い熱性能を必要とされる。
例えば、特許文献1には、下端ターミナル、パワー半導体チップ、水平スペーサ、上端ターミナル、垂直スペーサで構成され、内部にこれら部材が積層された両面冷却パワーモジュールが開示されている。
従来方法で部材を積層する場合は、ダイマウント工程の前に印刷された接合材(接着剤)を使用して乾式処理(ドライプロセス)を実行するが、印刷された接合材の表面の平坦性が不均一であるため、次工程でチップクラックや絶縁基板にクラックが発生する懸念がある。
また、積み重ねられた材料の厚さのばらつきがあるため、1つずつ積み重ねることは、接合材乾燥工程なしの従来方法では、全体の積層厚さを一定に抑えることは困難である。
材料厚さ公差がモジュール全体の厚さ公差に直接影響する場合、両面冷却モジュールの積層高さを制御するために、向かいあう絶縁基板にダイなどを積層して取り付けた後、基板に最後に取り付ける接合材(接着剤)を、特殊金属治具を使用し、予備乾燥をしないリフロープロセスで、緩衝接合層(バッファー接着層)とすることである。
乾式工程を含まない最後の接合材層は、特殊金属治具を使用して、原材料と積層材料の厚さのばらつきをすべて緩衝接合層として補正することができる。これにより、パワー半導体の両面冷却(デュアルサイドクーリングモジュール)のスタック高さ(H)のばらつきを従来よりも小さくすることがでる。
さらに、パワー半導体は、ウォータージャケット冷却システムに適合する熱性能を最適化できる。すなわち、安い部材(寸法公差を緩和部材)が使用でき、パワー半導体のパッケージ厚さを均一にできる。
以下、本発明を実施するための形態について、図を参照して詳細に説明する。ただし、本発明は以下の記載に何ら限定されるものではない。
本発明の実施例1に係る両面冷却パワーモジュールの製造方法を図1で説明する。図1(1)~(2)、図2(3)~(4)は、製造の状態を示した断面略図である。すなわち緩衝接着剤層を構築する組み立てプロセスフローを示している。
図1(1)は、第一の基板1上に第一の接合材5を接合し予備乾燥させた後、電子部品を搭載し接合する第一の接合工程である。ここで電子部品は、スペーサ3上に、ダイ4を第三の接合材6を用いて接合したのである。
第一の基板1は、絶縁基板が使用でき、例えば、一方に回路パターンが配置されたDBC基板やTPC基板とすることができる。スペーサ3は、導電性金属板であり、Cuとすることができる。ダイ4は、半導体チップであり、Siの他、SiC、GaNのとすることができる。
第一の接合材5と第三の接合材6とは同様な焼結材である。焼結材を用いた接合は、通常焼結材を塗布し、予備乾燥後に接合対象物を加圧加熱し接合するものである。また、予備乾燥することによって、接合材の形状が平坦に保てる。
図1(2)は、第二の基板2上に第二の接合材7を接合する第二の接合工程である。ここでは、第二の基板2は、第一の基板1と同様な絶縁基板が使用できる。第二の接合材7は、第一の接合材5、第三の接合材6とは同様な焼結材であり、ペースト状材料を印刷して基板に塗布する方法で製造することができ、予備乾燥プロセスを用いない状態を保つ。
図1(3)は、第一の基板1に接合された電子部品(スペーサ3とダイ4)と第二の基板2に接合された第二の接合材7を向かい合わせて接合する第三の接合工程である。
各接合材は焼結結合層となるが、第一の接合材5、第三の接合材6は、予備乾燥するので、硬化し平坦な形状を保つことができる。また。第二の接合材7は、予備乾燥しないので、軟化した状態を保っている。
図1(4)は、前述の第三の接合工程で形成された基板をリフロー下治具8に入れ、リフロー上治具9を覆いかぶせる。第一の基板1と第二の基板2との間に内側から特殊金属治具10を用いて、テンションを加える。そして、加熱し接合する第四の接合工程である。
図3は、前述の第四の接合工程後にリフロー治具から取り出した状態である。通常、基板間をモールド樹脂により樹脂成形をして両面冷却パワーモジュールが完成する。ここでは、モールド樹脂、外部導出端子は先行技術に見られるようなものであり、図示を省略している。
ここで、第二の接合材7は、軟化した状態で接合されると、押しつぶされフィレット形状となり、緩衝接合層(バッファー接着層)となる。
すなわち、第二の接合材7は、バッファーとしての予備乾燥されていない軟化状態の接着層を使用することにより、スペーサ3やダイ4の厚さばらつきが大きい場合でも、その寸法をバッファーとして吸収し、目標モジュールの厚さH(図3)を維持することが可能である。
スペーサやダイが複数の場合であっても、積み重ねた高さを補正することができる。また、スペーサやダイの積層順番が任意の場合であっても同様である。
完成した両面冷却パワーモジュールの樹脂分解と断面分析により、他のパワー半導体モジュールの積層構造とは、フィレット形状が異なることが確認できる。
従来のリフロー治具の場合、ロケーションガイドブロックと言われ、上下治具で挟み込む構造である。そのため、パワーモジュールの最大高さは制御できるが、最小高さを制御するのは困難である。
そのため、本発明は、特殊金属治具10は、リフロー下治具8とリフロー上治具9を組み合わせ、基板内側から基板をリフロー下治具8、リフロー上治具9の内壁に押し付けるように、特殊金属治具10をそれぞれの基板内側に挿入し、テンションをかけて使用し、ダイ4の下の流動可能な最後の接着層である第二の接合材7を使用して、緩衝接合層(バッファー接着層)とすることにより、積層厚さHを補正することにより、一定の高さに制御できる。
両面冷却パワーモジュールを一定の高さに制御できれば、の積層する部材の厚さのばらつきに左右されず、ユニットや機器に組み込む場合、ヒートシンク(ウォータージャケット)との間に隙間ができず、十分に接触できるため高い熱性能を維持できる。
電子部品は、ひとつでも複数でもよく、スペーサ3とダイ4の組み合わせや積層順番は自由に変えてもよい。
また、第二の接合材は、「基板とダイ」の他、「ダイとスペーサ」、または「スペーサと基板」の間に配置してもよい。その効果は同じである。
また、スペーサは、Cuの他、Cu / Moなどが適用することができる。
また、厚さのばらつきが補正されていれば、予備乾燥前の接合材はテープやペーストタイプを使用することができる。
1、第一の基板
2、第二の基板
3、スペーサ
4、ダイ(チップ)
5、第一の接合材
6、第三の接合材
7、第二の接合材(緩衝接合層)
8、リフロー下治具
9、リフロー上治具
10、特殊金属治具
11、パワーモジュール
2、第二の基板
3、スペーサ
4、ダイ(チップ)
5、第一の接合材
6、第三の接合材
7、第二の接合材(緩衝接合層)
8、リフロー下治具
9、リフロー上治具
10、特殊金属治具
11、パワーモジュール
Claims (5)
- 第一の基板上に第一の接合材を接合し予備乾燥させた後、電子部品を搭載し接合する第一の接合工程と、第二の基板上に第二の接合材を接合する第二の接合工程と、前記第一の基板に接合された前記電子部品と前記第二の基板に接合された前記第二の接合材を向かい合わせて接合する第三の接合工程と、前記第一の基板と前記第二の基板との間にテンションを加え、加熱し接合する第四の接合工程とからなる両面冷却パワーモジュールの製造方法。
- 前記第一ないし前記二の接合材は、焼結材料であり、銀、銅、酸化銀、および酸化銅からなり少なくとも一種を含み、ペースト状態、または、テープ状態からなることを特徴とする請求項1に記載の両面冷却パワーモジュールの製造方法。
- 前記電子部品は、半導体チップ、スペーサまたは、それらの組み合わせSiの他、SiC、GaNからなることを特徴とする請求項1ないし請求項2に記載の両面冷却パワーモジュールの製造方法。
- 前記第一の基板と前記第二の基板は、DBC(Direct Bonded Copper)基板からなることを特徴とする請求項1ないし請求項3に記載の両面冷却パワーモジュールの製造方法。
- 請求項1ないし請求項4に記載の製造方法で製造され、第一の接合材は平坦な形状からなる焼結結合層であり、第二の接合材はフィレット形状からなる緩衝接合層(バッファー接着層)であることを特徴とする両面冷却パワーモジュール。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/JP2020/033128 WO2022049641A1 (ja) | 2020-09-01 | 2020-09-01 | 両面冷却パワーモジュールの製造方法、および両面冷却パワーモジュール |
JP2022546754A JPWO2022049641A1 (ja) | 2020-09-01 | 2020-09-01 | |
CN202080103447.5A CN115868021A (zh) | 2020-09-01 | 2020-09-01 | 双面冷却功率模块的制造方法以及双面冷却功率模块 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
PCT/JP2020/033128 WO2022049641A1 (ja) | 2020-09-01 | 2020-09-01 | 両面冷却パワーモジュールの製造方法、および両面冷却パワーモジュール |
Publications (1)
Publication Number | Publication Date |
---|---|
WO2022049641A1 true WO2022049641A1 (ja) | 2022-03-10 |
Family
ID=80490759
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
PCT/JP2020/033128 WO2022049641A1 (ja) | 2020-09-01 | 2020-09-01 | 両面冷却パワーモジュールの製造方法、および両面冷却パワーモジュール |
Country Status (3)
Country | Link |
---|---|
JP (1) | JPWO2022049641A1 (ja) |
CN (1) | CN115868021A (ja) |
WO (1) | WO2022049641A1 (ja) |
Citations (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH10303228A (ja) * | 1997-04-23 | 1998-11-13 | Hitachi Ltd | 圧接型半導体装置 |
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- 2020-09-01 CN CN202080103447.5A patent/CN115868021A/zh active Pending
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JPWO2022049641A1 (ja) | 2022-03-10 |
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ENP | Entry into the national phase |
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NENP | Non-entry into the national phase |
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122 | Ep: pct application non-entry in european phase |
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