WO2012053473A1 - 液晶表示装置 - Google Patents

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WO2012053473A1
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liquid crystal
wirings
substrate
crystal display
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PCT/JP2011/073811
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田中 義規
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シャープ株式会社
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    • G09G3/3611Control of matrices with row and column drivers

Definitions

  • the present invention relates to a liquid crystal display device, and more particularly, to a liquid crystal display device configured to easily find a defective manufacturing location.
  • a liquid crystal panel of a liquid crystal display device is obtained by bonding an active matrix type liquid crystal display device substrate (TFT substrate) having a switching element for each pixel and a counter substrate (color filter substrate) disposed opposite to the substrate. It is formed with liquid crystal sealed between them.
  • TFT substrate active matrix type liquid crystal display device substrate
  • a plurality of gate bus lines and a plurality of source bus lines substantially orthogonal to the gate bus lines are formed on the substrate for the active matrix liquid crystal display device, and each pixel region defined by both bus lines serves as a switching element.
  • a thin film transistor TFT; Thin Film Transistor
  • TFTs, bus lines, and the like are formed by a photolithography process, and are formed by repeating a series of semiconductor processes of “film formation ⁇ resist application ⁇ exposure ⁇ development ⁇ etching ⁇ resist stripping”.
  • Patent Document 1 discloses a substrate for an active matrix liquid crystal display device and a liquid crystal display device including the same.
  • repair of the disconnection is performed using the repair wiring.
  • the repair wiring is formed in advance so as to bypass the display area.
  • the wiring is cut and connected using a laser. A defect position detection pixel region is provided so that it can be easily determined whether or not this repair work has succeeded.
  • a defect position detection pixel region is provided to easily determine whether or not the disconnection has been successfully repaired.
  • the liquid crystal panel becomes a defective product when a wiring defect occurs in a portion other than the portion in the display area.
  • An object of the present invention is to provide a liquid crystal display device capable of identifying a defective portion by a simple method.
  • the present invention provides a liquid crystal display device including a first substrate, a second substrate overlapping the first substrate via a liquid crystal layer, and a plurality of substrates formed on the second substrate.
  • Wiring a plurality of pseudo pixels electrically connected to the plurality of wirings and provided in a frame portion surrounding the periphery of the display area, and a plurality of openings provided in the frame portion corresponding to the plurality of pseudo pixels
  • a plurality of color filter sections arranged respectively.
  • colors are selected and arranged so as to generate different colors corresponding to a plurality of types of defects occurring in a plurality of wirings.
  • the plurality of color filter portions are arranged in a group including different colors to form one pseudo pixel portion.
  • the liquid crystal display device further includes a plurality of voltage application pads for directly applying electrical signals to the plurality of wirings.
  • a first voltage application pad is connected to the first wiring of the plurality of wirings in the vicinity of one end, and a second voltage application pad is connected to the vicinity of the other end of the plurality of wirings.
  • a third voltage application pad is connected in the vicinity of one end and a fourth voltage application pad is connected in the vicinity of the other end of the second wiring that runs parallel to the first wiring.
  • the liquid crystal display device includes a third wiring for electrically connecting an odd-numbered wiring group including the first wiring among the plurality of wirings to the first voltage application pad, and the plurality of wirings. And a fourth wiring for electrically connecting the even-numbered wiring group including the second wiring to the third voltage application pad.
  • the plurality of wirings are wirings for connecting a liquid crystal driver element mounted on the second substrate and a signal input / output terminal of the liquid crystal display device.
  • the liquid crystal display device further includes a sealing member arranged on the outer edge portion of the frame portion so as to be sandwiched between the first substrate and the second substrate and sealing the liquid crystal layer in the display region and the plurality of pseudo pixels.
  • a sealing member arranged on the outer edge portion of the frame portion so as to be sandwiched between the first substrate and the second substrate and sealing the liquid crystal layer in the display region and the plurality of pseudo pixels.
  • Each of the plurality of pseudo pixels is disposed so as to face the first transparent electrode disposed so as to cover the color filter portion and the first transparent electrode and the color filter portion with the liquid crystal layer interposed therebetween.
  • a second transparent electrode electrically connected to one.
  • the present invention it is possible to detect a defect in the wiring part in the panel simultaneously with the normal lighting inspection of the pixel part, and it is possible to shorten the process and prevent the outflow of the defect to the subsequent process.
  • FIG. 5 is a cross-sectional view taken along line VV in FIG. 4. It is a schematic diagram for demonstrating the application signal to the pads 22, 24, 26, and 28 for test voltage application. It is a wave form diagram for demonstrating the application signal to the pad for a test voltage application. It is a flowchart which shows the detail of a panel lighting test
  • FIG. 1 is a diagram showing the overall configuration of the liquid crystal display device of the present embodiment.
  • liquid crystal display device 1 includes a printed circuit board 2 for driving, FPC (Flexible Printed Circuit) 4, 6, and a TFT (Thin Film Transistor) substrate 8.
  • FPC Flexible Printed Circuit
  • TFT Thin Film Transistor
  • the liquid crystal display device 1 further includes a CF (Color Filter) substrate 10 mounted on the TFT substrate 8, COG chips 12, 14, 16, in-panel wiring 30, and inspection voltage application pads 22, 24, 26, 28, lead-out wiring 32, and pseudo pixel portions 34, 35.
  • CF Color Filter
  • the CF substrate 10 includes a display area 40 at the center.
  • a TFT matrix is formed in a portion of the TFT substrate facing the display area 40.
  • a characteristic configuration of the present embodiment is that in the in-panel wiring 30, the lead-out wiring 32 formed in different layers via the interlayer insulating film and the pseudo pixel portions 34 and 35 formed by the transparent electrodes connected thereto are provided. Is to have. Then, a defect (disconnection or short circuit) of the in-panel wiring 30 is detected by applying a specific signal from the inspection voltage application pads 22, 24, 26, and 28 during the lighting inspection of the liquid crystal panel.
  • FIG. 2 is a flowchart showing an example of the manufacturing process of the liquid crystal panel.
  • a liquid crystal pre-process S3 for bonding the TFT substrate and the CF substrate is performed.
  • the panel is divided, the liquid crystal is injected between the TFT substrate and the CF substrate, and the liquid crystal is sealed in the liquid crystal post-process S4. Thereafter, the defective product manufactured so far is selected by the panel lighting inspection step S5.
  • the laser cutting step S6 the polarizing plate bonding step S7, the COG chip and FPC mounting step S8, the driving printed wiring board mounting step S9, and the backlight mounting step S10 is sequentially executed.
  • module lighting inspection step S11 is performed.
  • a TFT substrate and a CF substrate are bonded together, and a signal is applied at the time of completion of the process of the liquid crystal cell in which liquid crystal is injected to perform lighting inspection.
  • FIG. 3 is a diagram for explaining the panel lighting inspection step S5 of FIG.
  • the FPCs 4 and 6, the driving printed board 2, the COG chip 12 and the TAB shown in FIG. 3 are not mounted on the panel.
  • each source wiring 43 is connected to an inspection short ring 44 and further connected to an inspection signal application pad 42.
  • a signal is applied from the pad 42 to detect a defect of the liquid crystal panel (a short circuit / disconnection, a point defect, unevenness, etc.).
  • FIG. 3 shows the source wiring side as an example, but the gate wiring side can also be selected simultaneously by a short ring.
  • the intra-panel wiring 30 is originally for supplying an input signal necessary for the gate driver from the FPC wiring 6 on the source side, and an FPC and a printed circuit board for driving are arranged around the TFT substrate on the gate terminal side.
  • the in-panel wiring 30 is used in the lighting inspection (module lighting inspection step S11) after mounting the FPC, the COG chip, and the printed circuit board for driving, it is not normally used in the panel lighting inspection step S5.
  • the panel wiring 30 is also inspected for defects at the same time during the panel inspection during the manufacturing.
  • FIG. 4 is a diagram showing the corner portion of the liquid crystal panel in more detail.
  • in-panel wiring 30 connects a connection terminal formed in COG chip mounting area 12A and terminals 46A to 46F for connecting to FPC.
  • Input signals from the outside of the TFT substrate 8 to the COG chip are applied to the terminals 46A to 46F for connection to the FPC.
  • Bumps 12B for inputting an output signal of the COG chip to the TFT substrate 8 are further formed in the COG chip mounting area 12A.
  • bumps 14C for transmitting input signals to the COG chip from the outside of the TFT substrate 8 are formed.
  • Bumps 14B for inputting an output signal of the COG chip to the TFT substrate 8 are further formed in the COG chip mounting area 14A.
  • the inspection voltage application pads 22 and 26 are connected to odd-numbered intra-panel wirings 30 counted from the right in FIG.
  • the test voltage application pads 24 and 28 are connected to the even-numbered in-panel wirings 30 counted from the right in FIG.
  • disconnection from the inspection voltage application pads 22 and 24 to the branch point of the lead-out wiring 32 can be detected. Further, when a voltage is applied from the inspection voltage application pads 26 and 28, disconnection from the inspection voltage application pads 26 and 28 to the branch point of the lead-out wiring 32 can be detected. The detection of disconnection can be determined by the display of the pseudo pixel portions 34 and 35.
  • the pseudo pixel unit 34 includes pseudo pixels 34A to 34C.
  • the pseudo pixel unit 35 includes pseudo pixels 35D to 35E.
  • an AC signal is applied in the same manner as the pixels in the display area 40. For example, if the liquid crystal panel is in a normally white mode (transmitted when no voltage is applied), it is determined that there is no disconnection mode if a black voltage is applied to the voltage application pad and the pseudo pixel portion is in black display.
  • the pseudo pixel 35 ⁇ / b> F is formed of the transparent electrode 52 and is disposed inside the seal member 48.
  • a common counter transparent electrode 54 is formed on the counter substrate 10 of the pseudo pixel 35F to sandwich the liquid crystal.
  • Visual determination can be made by converting the signals from the test voltage application pads 22, 24, 26, and 28 to be optically identifiable by the pseudo pixel 35F. It is necessary to provide an opening 58 in the BM (black matrix) light-shielding portion 60 on the counter substrate (CF substrate) side.
  • the other pseudo pixels 34A to 34C, 35D, and 35E have the same configuration.
  • FIG. 6 is a schematic diagram for explaining signals applied to the inspection voltage application pads 22, 24, 26 and 28. 6 shows an example in which input pads are separately provided for each of the in-panel wirings 30 for the pads LA to LF, but the number of pads may be reduced as shown in FIG.
  • FIG. 7 is a waveform diagram for explaining a signal applied to the test voltage application pad.
  • the voltage application to the inspection voltage application pads LA to LF applies an alternating current signal in the same manner as the pixels in the display area. For example, if the liquid crystal panel is in a normally white mode (transmitted when no voltage is applied), it is determined that there is no disconnection mode if a black voltage is applied to the voltage application pad and the pseudo pixel portion is in black display.
  • Signal SP is given to the pads LA, LC, LE.
  • a signal SN having a phase opposite to that of the signal SP is applied to the pads LB, LD, and LF.
  • the liquid crystal molecules are controlled by applying a sine wave signal having an amplitude of about 3 to 6 V to the pads LA and LB, which is the same as the signal used for normal panel inspection.
  • FIG. 8 is a flowchart showing details of the panel lighting inspection.
  • FIG. 9 is an enlarged view of the lower left corner for explaining the panel lighting inspection.
  • the voltage application pads 22, 24, 26 and 28 and the pseudo pixel portions 34 and 35 are arranged. To do.
  • the in-panel wiring 30 is electrically connected between the odd-numbered and even-numbered ones by wiring extending from the voltage application pad.
  • the panel wiring can be detected by supplying it to either the voltage application pads 26 and 28 side or the pads 22 and 24 side. Further, a short circuit between wirings can be detected by applying alternating signals having different phases to odd / even wirings. For this reason, even-numbered wires are bundled with wires (wires 23 and 25 in FIG. 4) connected to the pads 22 or 26, and odd-numbered wires are bundled with wires (wires 27 and 29 in FIG. 4) connected to the pads 24 or 28. . Note that the wiring for bundling odd-numbered wirings and the wiring for bundling even-numbered wirings are cut by the same method as the cutting of the short ring at the end of inspection. Further, if a selection signal and a transistor are used, it is not necessary to cut the wiring.
  • FIG. 10 is a diagram for explaining an example using a selection signal.
  • wiring group 30 includes wirings 30A-30D.
  • Wirings 23 and 25 are provided so as to intersect the wiring group 30, and a selection signal line LSEL is provided between the wirings 23 and 25.
  • the wirings 23 and 25 are connected to the pads 22 and 24, respectively, and the selection signal line LSEL is connected to the pad PSEL.
  • TFT transistors TRA to TRD are provided. When the selection signal line LSEL is activated to a high level, the TFT transistors TRA and TRC are turned on to electrically connect the wirings 30A and 30C to the wiring 23, respectively.
  • the selection signal line LSEL when the selection signal line LSEL is activated to a high level, the TFT transistors TRB and TRD are turned on to electrically connect the wirings 30B and 30D to the wiring 25, respectively.
  • the selection signal line LSEL becomes low level by a pull-down resistor (not shown), and the wirings 23 and 25 are electrically separated from the wirings 30A to 30D.
  • step S21 signals having opposite phase polarities are applied to the voltage application pads 26 and 28, respectively. Thereby, disconnection failure like position DB is detectable. Further, a short circuit failure as shown at position DC can also be detected.
  • step S22 signals having the same phase polarity are applied to the voltage application pads 26 and 28, respectively. Thereby, it can be discriminate
  • step S23 signals having opposite phase polarities are applied to the voltage application pads 22 and 24, respectively. Thereby, the disconnection defect like the position DA can be detected. Further, a short circuit failure as shown at position DC can also be detected.
  • step S24 signals having the same phase polarity are applied to the voltage application pads 22 and 24, respectively. Thereby, it can be discriminate
  • FIG. 11 is a diagram showing the display of the pseudo pixel portion when a signal having a reverse phase is given.
  • the result shown in FIG. 11 is a result produced when a signal as described in FIG. 7 is input when there are six wirings in the panel as shown in FIG.
  • pseudo pixels 34A to 34C and 35D to 35F are black in both pseudo pixel portions 34 and 35. .
  • the pseudo pixel 34A is lit red, while the pseudo pixels 34B and 34C are black, and the pseudo pixel portion 34 is red as a whole. appear. At this time, the pseudo pixel portion 35 looks black as a whole.
  • the pseudo pixel 34B is lit green, while the pseudo pixels 34A and 34C are black, and the pseudo pixel portion 34 is green as a whole. appear. At this time, the pseudo pixel portion 35 looks black as a whole.
  • the pseudo pixel 34C is lit blue, while the pseudo pixels 34A and 34B are black, and the pseudo pixel portion 34 is blue as a whole. appear. At this time, the pseudo pixel portion 35 looks black as a whole.
  • the pseudo pixel 35D is lit red, while the pseudo pixels 35E and 35F are black, and the pseudo pixel portion 35 is red as a whole. appear. At this time, the pseudo pixel portion 34 looks black as a whole.
  • the pseudo pixel 35E is lit green, while the pseudo pixels 35D and 35F are black, and the pseudo pixel portion 35 is green as a whole. appear. At this time, the pseudo pixel portion 34 looks black as a whole.
  • the pseudo pixel 35F is lit blue, while the pseudo pixels 35D and 35E are black, and the pseudo pixel portion 35 is blue as a whole. appear. At this time, the pseudo pixel portion 34 looks black as a whole.
  • the pseudo pixel 34A is lit red and the pseudo pixel 34B is lit green. At this time, the pseudo pixel 34C is black. As a result, the pseudo pixel portion 34 looks yellow as a whole. At this time, the pseudo pixel portion 35 looks black as a whole.
  • the pseudo pixel 34B is lit in green, and the pseudo pixel 34C is lit in blue.
  • the pseudo pixel 34A is black.
  • the pseudo pixel unit 34 looks light blue as a whole.
  • the pseudo pixel portion 35 looks black as a whole.
  • the pseudo pixel 34C is lit in blue, and the pseudo pixels 34A and 34B are black. As a result, the pseudo pixel portion 34 looks blue as a whole. Further, at this time, the pseudo pixel 35D is lit red, and the pseudo pixels 35E and 35F are black. As a result, the pseudo pixel portion 35 looks red as a whole.
  • the pseudo pixel 35D is lit in red and the pseudo pixel 35E is lit in green.
  • the pseudo pixel 35F is black.
  • the pseudo pixel portion 35 looks yellow as a whole.
  • the pseudo pixel portion 34 looks black as a whole.
  • the pseudo pixel 35E is lit in green and the pseudo pixel 35F is lit in blue. At this time, the pseudo pixel 35D is black. As a result, the pseudo pixel portion 35 looks light blue as a whole. At this time, the pseudo pixel portion 34 looks black as a whole.
  • pseudo pixels of a plurality of colors are arranged in each of the pseudo pixel portions 34 and 35, and wirings in the panel are connected thereto. Then, it is possible to immediately know what kind of defect has occurred by checking the color of the pseudo pixel portion.
  • FIG. 12 is a diagram for explaining an example in which a defect cannot be identified.
  • the pseudo pixel 34A is lit in red and the pseudo pixel 34B is lit in green.
  • the pseudo pixel 34C is black.
  • the pseudo pixel portion 34 looks yellow as a whole.
  • the pseudo pixel portion 35 looks black as a whole.
  • FIG. 13 is a diagram for explaining the display of the pseudo pixel portion when the polarity of the inspection waveform applied to the adjacent wiring is changed.
  • a signal having the same phase polarity is applied to the adjacent wirings LA and LB.
  • the pseudo pixel 34A is lit red and the pseudo pixel 34B is lit green.
  • the pseudo pixel 34C is black.
  • the pseudo pixel portion 34 looks yellow as a whole.
  • the pseudo pixel portion 35 looks black as a whole.
  • the wiring LA and the wiring LB are short-circuited, a different result is obtained.
  • the pseudo pixels 34A to 34C and 35D to 35F are all black.
  • the colors of the pseudo pixel portions 34 and 35 it becomes possible to distinguish between a short circuit failure and a disconnection failure.
  • the pseudo-pixel portions 34 and 35 are visually checked when the even-numbered and odd-numbered signals (reverse phase signals) of the wiring in the panel adjacent to each other are given and when the same signal (in-phase signal) is given It is possible to discover the cause of failure and the location at an early stage, whether it is a disconnection or a short circuit.
  • a wiring extending from the in-panel wiring portion to the vicinity of the display portion and the transparent electrode pad are provided, and a pseudo pixel portion with a liquid crystal interposed therebetween is provided.
  • the wiring part does not need to be significantly changed in structure, and the defect of the wiring part in the panel can be detected simultaneously with the normal lighting inspection of the pixel part, so that it becomes possible to shorten the process and prevent the outflow of the defect to the subsequent process. .
  • FIG. 14 is a diagram illustrating a first modification of the shape of the pseudo pixel unit.
  • each pseudo pixel of the pseudo pixel unit 134 is a square
  • each pseudo pixel of the pseudo pixel unit 135 is a triangle.
  • FIG. 15 is a diagram illustrating a second modification of the shape of the pseudo pixel unit.
  • each pseudo pixel of the pseudo pixel unit 234 is a vertically long rectangle
  • each pseudo pixel of the pseudo pixel unit 235 is a horizontally long rectangle.
  • FIG. 16 is a diagram illustrating a third modification of the shape of the pseudo pixel unit.
  • a symbol “1” is represented for each pseudo pixel of the pseudo pixel unit 334
  • a symbol “2” is represented for each pseudo pixel of the pseudo pixel unit 335.
  • this symbol makes the transparent electrode pattern on the TFT substrate side hollow. Note that the symbol may not be a number, and any symbol can be used as long as the pseudo pixel portion 334 and the pseudo pixel portion 335 are distinguished.
  • the two pseudo pixel portions can be distinguished at a glance, even if they appear to be the same color in FIG. 11, they can be easily distinguished at the manufacturing site. That is, when the wiring LA is disconnected, the pseudo pixel portion 34 looks red, and when the wiring LD is disconnected, the pseudo pixel portion 35 looks red, which is confusing. In the case shown in FIG. 14, it is easy to remember that the square red is the disconnection of the wiring LA and the triangular red is the disconnection of the wiring LD. Similarly, the cases shown in FIGS. 15 and 16 are easy to remember.
  • the liquid crystal display device of the present embodiment includes a first substrate 10, a second substrate 8 that overlaps the first substrate 10 via a liquid crystal layer, and a second substrate 10.
  • the plurality of color filter units 56 are arranged by selecting colors so as to generate different colors corresponding to a plurality of types of defects occurring in the plurality of wirings 30.
  • the plurality of color filter portions 56A to 56F are arranged in a group including a plurality of types of colors to form the pseudo pixel portions 34 and 35.
  • the liquid crystal display device further includes a plurality of voltage application pads 22, 24, 26, and 28 for directly applying electrical signals to the plurality of wirings 30.
  • a first voltage application pad 22 is connected in the vicinity of one end of the plurality of wirings 30, and a second voltage application pad 26 is connected in the vicinity of the other end.
  • a third voltage application pad 24 is connected in the vicinity of one end and the fourth voltage in the vicinity of the other end of the second wiring 30B that runs parallel to the first wiring 30A among the plurality of wirings.
  • An application pad 28 is connected.
  • a third wiring for bundling odd-numbered wirings 30A, 30C, and 30E including the first wiring among the plurality of wirings 30 to connect to the first voltage application pad 22 is bundled.
  • the third wiring 23 and the fourth wiring 25 are formed in a wiring layer above the wiring layer in which the first wiring 30A and the second wiring 30B are formed. Thereby, it becomes easy to cut
  • the plurality of wirings 30 are wirings for connecting liquid crystal driver elements mounted on the second substrate 8 and signal input / output terminals 46A to 46F of the liquid crystal display device.
  • the liquid crystal display device is preferably arranged in a state sandwiched between the first substrate 10 and the second substrate 8 at the outer edge portion of the frame portion 60 and the display area 40 and the plurality of display areas 40.
  • a seal member 48 for sealing the liquid crystal layers in the pseudo pixels 34A to 34C and 35D to 35F is further provided.
  • Each of the plurality of pseudo pixels 34A to 34C and 35D to 35F includes a first transparent electrode 54 disposed so as to cover the color filter portions 56A to 56F, and a liquid crystal layer in the first transparent electrode 54 and the color filter portion.
  • a second transparent electrode 52 which is disposed so as to be opposed to each other and electrically connected to one of the plurality of wirings 30.
  • 1 liquid crystal display device 2 printed circuit board, 6, 23, 25, 30A, 30C, 30E, 30B, 30D, 30F, LA, LB wiring, 8, 10 substrate, 12, 14, 16 chip, 12A, 14A chip Mounting area, 12B, 14B, 14C bump, 22, 26, 24, 28, 42 pad, 30 wiring in panel, 32 lead wiring, 34, 35, 134, 135, 234, 235, 334, 335 pseudo pixel section, 34A ⁇ 34C, 35D ⁇ 35F pseudo pixel, 40 display area, 43 source wiring, 44 inspection short ring, 46A ⁇ 46F terminal, 48 seal member, 52, 54 transparent electrode, 56, 56A ⁇ 56F color filter part, 58 opening 60 Black matrix.

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Abstract

 液晶表示装置は、第1の基板(10)と、第1の基板(10)に対して液晶層を介して重なり合う第2の基板(8)と、第2の基板(8)上に形成される複数の配線(30)と、複数の配線(30)にそれぞれ電気的に接続され、表示領域の周囲を囲む額縁部(ブラックマトリクス60)に設けられた複数の擬似画素(34A~34C,35D~35F)と、複数の擬似画素(35F)に対応して額縁部(60)に設けられた複数の開口にそれぞれ配置される複数の色フィルタ部(56)とを備える。複数の色フィルタ部(56)は、複数の配線(30)に生じる複数の不良の種類に対応して異なる発色となるように色が選択され配置される。簡便な方法で不良箇所の特定が可能な液晶表示装置を提供することができる。

Description

液晶表示装置
 この発明は、液晶表示装置に関し、特に、製造不良箇所の発見が容易に構成された液晶表示装置に関する。
 液晶表示装置の液晶パネルは、画素毎にスイッチング素子を有するアクティブマトリクス型液晶表示装置用基板(TFT基板)と、それに対向して配置される対向基板(カラーフィルタ基板)とを貼り合わせ、両基板間に液晶を封入して形成されている。アクティブマトリクス型液晶表示装置用基板上には、複数のゲートバスラインと、ゲートバスラインにほぼ直交する複数のソースバスラインとが形成され、両バスラインで画定された画素領域毎にスイッチング素子として薄膜トランジスタ(TFT;Thin Film Transistor)が形成されている。
 これらのTFTや各バスライン等は、フォトリソグラフィ工程で形成され、「成膜→レジスト塗布→露光→現像→エッチング→レジスト剥離」という一連の半導体プロセスを繰返して形成される。
 特開2003-043521号公報(特許文献1)は、アクティブマトリクス型液晶表示装置用基板及びそれを備えた液晶表示装置を開示する。製造工程でソースバスラインに断線不良が発生したしたときは、リペア配線を用いて断線のリペア(修復)が行なわれる。この液晶表示装置では、リペア配線は、あらかじめ表示エリアを迂回するように形成されている。断線したソースバスラインとリペア配線とを置換するために、レーザを使用して配線の切断および接続が行なわれる。この修復作業が成功したか否かを容易に判断できるように、欠陥位置検出用画素領域が設けられている。
特開2003-043521号公報
 特開2003-043521号公報に開示された技術では、断線の修復が成功したか否かを容易に判断するために欠陥位置検出用画素領域が設けられていた。しかしながら、表示エリア中の部分以外でも、配線欠陥が生じると液晶パネルは不良品となってしまう。
 このような不良品は、製造工程が最後まで進む前に、なるべく早期に発見して取り除いたり修復したりすることが望ましい。また、複雑な検査装置などが不要な簡便な方法で不良箇所が特定できることも望ましい。
 この発明の目的は、簡便な方法で不良箇所の特定が可能な液晶表示装置を提供することである。
 この発明は、要約すると、液晶表示装置であって、第1の基板と、第1の基板に対して液晶層を介して重なり合う第2の基板と、第2の基板上に形成される複数の配線と、複数の配線にそれぞれ電気的に接続され、表示領域の周囲を囲む額縁部に設けられた複数の擬似画素と、複数の擬似画素に対応して額縁部に設けられた複数の開口にそれぞれ配置される複数の色フィルタ部とを備える。複数の色フィルタ部は、複数の配線に生じる複数の不良の種類に対応して異なる発色となるように色が選択され配置される。
 好ましくは、複数の色フィルタ部は、種類の色を含んで集合配置され1つの擬似画素部を形成する。
 好ましくは、液晶表示装置は、複数の配線に電気信号を直接与えるための複数の電圧印加パッドをさらに備える。複数の配線のうち第1の配線には、一端の近傍に第1の電圧印加パッドが接続され、他端の近傍には第2の電圧印加パッドが接続され、複数の配線のうちの第1の配線と並走する第2の配線には、一端の近傍に第3の電圧印加パッドが接続され、他端の近傍には第4の電圧印加パッドが接続される。
 好ましくは、液晶表示装置は、複数の配線のうち第1の配線を含む奇数番目の配線群を電気的に第1の電圧印加パッドに接続するための第3の配線と、複数の配線のうち第2の配線を含む偶数番目の配線群を電気的に第3の電圧印加パッドに接続するための第4の配線とをさらに備える。
 好ましくは、複数の配線は、第2の基板上にマウントされる液晶ドライバ素子と液晶表示装置の信号入出力端子とを接続する配線である。
 好ましくは、液晶表示装置は、額縁部の外縁部に第1の基板と第2の基板とに挟まれた状態で配置され表示領域および複数の擬似画素にある液晶層をシールするシール部材をさらに備える。複数の擬似画素の各々は、色フィルタ部を覆うように配置された第1の透明電極と、第1の透明電極と色フィルタ部において液晶層を挟んで対向するように配置され複数の配線のひとつと電気的に接続された第2の透明電極とを含む。
 本発明によれば、通常の画素部の点灯検査と同時にパネル内配線部の不良を検出でき、工程短縮ならびに後工程への不良流出を防止することが可能となる。
本実施の形態の液晶表示装置の全体構成を示す図である。 液晶パネルの製造工程の例を示したフロー図である。 図2のパネル点灯検査工程S5について説明するための図である。 液晶パネルのコーナー部分をより詳細に示した図である。 図4のV-Vにおける断面図である。 検査電圧印加用のパッド22,24,26,28への印加信号を説明するための模式図である。 検査電圧印加用のパッドへの印加信号を説明するための波形図である。 パネル点灯検査の詳細を示すフローチャートである。 パネル点灯検査の説明をするための左下コーナー部の拡大図である。 選択信号を用いる例を説明するための図である。 逆相の信号を与えた場合の擬似画素部の表示を示した図である。 不良が特定できない例を説明するための図である。 隣接配線に与える検査波形の極性を変えた場合の擬似画素部の表示を説明するための図である。 擬似画素部の形状の第1の変形例を示した図である。 擬似画素部の形状の第2の変形例を示した図である。 擬似画素部の形状の第3の変形例を示した図である。
 以下において、本発明の実施の形態について図面を参照して詳しく説明する。なお、図中同一符号は同一または相当部分を示す。
 [全体構成の説明]
 図1は、本実施の形態の液晶表示装置の全体構成を示す図である。
 図1に示した例はCOG(Chip On Glass)実装パネルにおいてゲートチップに信号を供給する配線をソース側の駆動用プリント板から供給する例を示している。図1を参照して、液晶表示装置1は、駆動用プリント基板2と、FPC(Flexible Printed Circuit)4,6と、TFT(Thin Film Transistor)基板8とを含む。
 液晶表示装置1は、さらに、TFT基板8上に搭載されるCF(Color Filter)基板10と、COGチップ12,14,16と、パネル内配線30と、検査電圧印加用のパッド22,24,26,28と、引出し配線32と、擬似画素部34,35とを含む。
 CF基板10は、中央部に表示エリア40を含む。TFT基板の表示エリア40に対向する部分にはTFTのマトリクスが形成されている。
 本実施の形態の特徴的な構成は、パネル内配線30において、層間絶縁膜を介した異なるレイヤーで形成される引出し配線32と、これにつながる透明電極で形成される擬似画素部34,35を有することである。そして、液晶パネルの点灯検査時に検査電圧印加用のパッド22,24,26,28から特定の信号を印加することでパネル内配線30の欠陥(断線、短絡)を検出する。
 ここで、液晶パネルの点灯検査について理解を容易とするために、液晶パネルの製造工程を説明する。
 図2は、液晶パネルの製造工程の例を示したフロー図である。
 図2を参照して、TFT基板工程S1とCF基板工程S2がそれぞれ完了すると、TFT基板およびCF基板を貼り合せる液晶前工程S3が実行される。液晶前工程S3が完了すると、液晶後工程S4において、パネル間の分断、TFT基板とCF基板の間への液晶注入、液晶の封止が行なわれる。その後、パネル点灯検査工程S5によって、ここまでの製造不良品の選別が行なわれる。
 その後、パネル点灯検査工程S5で選別された良品に対してのみ、レーザーカット工程S6、偏光板貼り合わせ工程S7、COGチップおよびFPC搭載工程S8、駆動用プリント配線板搭載工程S9、バックライト取り付け工程S10が順次実行される。そして、最後にモジュール点灯検査工程S11が行なわれる。
 通常、パネル製造過程では、TFT基板とCF基板とを貼り合わせ、液晶を注入した液晶セルの工程完了時点で信号を印加して点灯検査を行なう。
 図3は、図2のパネル点灯検査工程S5について説明するための図である。
 パネル点灯検査時点では、パネルには図3に示すFPC4,6や駆動用プリント基板2、COGチップ12やTABは搭載されていない。図3で示すように、各ソース配線43は検査用ショートリング44に接続されており、さらに検査用信号印加パッド42に接続されている。点灯検査時にはこのパッド42より信号を印加することで液晶パネルの不良(配線の短絡・断線、点欠陥、ムラ等)を検出する。
 図3ではソース配線側を例に記載しているが、ゲート配線側も同様にショートリングにより一斉に選択することができる。
 一方、パネル内配線30は元々はゲートドライバに必要な入力信号をソース側のFPC配線6から供給するためのものであり、ゲート端子側のTFT基板の周囲部にFPCや駆動用プリント基板を配置しなくても液晶パネルを駆動ができるというようなメリットがある。
 このパネル内配線30はFPCやCOGチップや駆動用プリント基板を搭載後の点灯検査(モジュール点灯検査工程S11)にて使用するため、パネル点灯検査工程S5では通常使用しない。
 本実施の形態で実行するパネル点灯検査工程S5では、製造途中のパネル検査時に、このパネル内配線30の欠陥も同時に検査を行なう。
 本実施の形態を行なわない場合、液晶パネルのCOGチップ12,16またはTAB間をつなぐ信号配線(パネル内配線30)の断線/短絡不良が発生した場合、検査用ショートリングを使用するパネル点灯検査ではパネル内配線30は利用しないので、該当箇所に不良が存在しても検出されず、後工程(モジュール実装工程)に不良流出してしまう。
 また、配線30の不良を電気的な抵抗検査にて検出しようとした場合、抵抗検査用の新たな検出回路が必要となるばかりでなく、短絡モードの検出には配線部の設計が複雑な構造が必要となる。
 図4は、液晶パネルのコーナー部分をより詳細に示した図である。
 図4を参照して、パネル内配線30は、COGチップ搭載領域12Aに形成される接続端子と、FPCに接続するための端子46A~46Fを接続する。FPCに接続するための端子46A~46Fには、TFT基板8の外部からCOGチップへの入力信号が与えられる。COGチップ搭載領域12Aにはさらに、COGチップの出力信号をTFT基板8に入力するためのバンプ12Bが形成される。
 また、COGチップ搭載領域14Aには、TFT基板8の外部からCOGチップへの入力信号が伝達されるバンプ14Cが形成される。COGチップ搭載領域14Aにはさらに、COGチップの出力信号をTFT基板8に入力するためのバンプ14Bが形成される。
 検査電圧印加用のパッド22,26は、図4の右から数えて奇数本目のパネル内配線30に接続されている。検査電圧印加用のパッド24,28は、図4の右から数えて偶数本目のパネル内配線30に接続されている。
 検査電圧印加用のパッド22,24から電圧印加した場合には、検査電圧印加用のパッド22,24から引出し配線32の分岐点までの断線が検出できる。また、検査電圧印加用のパッド26,28から電圧印加した場合には、検査電圧印加用のパッド26,28から引出し配線32の分岐点までの断線が検出できる。断線の検出は、擬似画素部34,35の表示により判断ができる。
 擬似画素部34は、擬似画素34A~34Cを含む。擬似画素部35は、擬似画素35D~35Eを含む。
 検査電圧印加用のパッド22,24,26,28への電圧印加は、表示エリア40の画素と同様に交流信号を印加する。例えば液晶パネルがノーマリーホワイトモード(電圧無印加時に透過)であれば、電圧印加パッドに黒電圧を印加して擬似画素部が黒表示になっていれば断線モードはないと判断される。
 図5は、図4のV-Vにおける断面図である。
 図4、図5を参照して、擬似画素35Fは透明電極52で形成され、シール部材48の内側に配置される。擬似画素35Fの対向側基板10には共通の対向透明電極54が形成され、液晶を挟持する。擬似画素35Fによって検査電圧印加用のパッド22,24,26,28からの信号を光学的に識別可能に変換することで、目視判断が可能となる。なお対向基板(CF基板)側のBM(ブラックマトリクス)遮光部60には開口部58を設ける必要がある。なお、他の擬似画素34A~34C,35D,35Eについても同様な構成である。
 図6は、検査電圧印加用のパッド22,24,26,28への印加信号を説明するための模式図である。図6において、パッドLA~LFは、パネル内配線30の一本ずつ別々に入力パッドを設けた例を示したが、図4に示すようにすればパッド数を減らしてもよい。
 図7は、検査電圧印加用のパッドへの印加信号を説明するための波形図である。
 図6、図7を参照して、検査電圧印加用のパッドLA~LFへの電圧印加は、表示エリアの画素と同様に交流信号を印加する。例えば液晶パネルがノーマリーホワイトモード(電圧無印加時に透過)であれば、電圧印加パッドに黒電圧を印加して擬似画素部が黒表示になっていれば断線モードはないと判断される。
 信号SPをパッドLA,LC,LEに与える。そして信号SPと逆相の信号SNをパッドLB,LD,LFに与える。
 隣接する配線(例えばパッドLAとLBの接続される配線)が短絡した場合、信号が逆位相のため、上記の信号の振幅が小さくなり、擬似画素34A,34Bに電圧が印加されなくなる(=色が透過してくる)。通常のパネル検査に使う信号と同じで、パッドLAとLBに振幅3~6V程度の正弦波信号を印加することによって、液晶分子を制御する。
 図8は、パネル点灯検査の詳細を示すフローチャートである。
 図9は、パネル点灯検査の説明をするための左下コーナー部の拡大図である。
 ソース側チップ搭載領域14AのCOGチップ付近からゲート側チップ搭載領域12AのCOGチップへ延伸するパネル内配線30において、電圧印加用のパッド22,24,26,28と擬似画素部34,35を配置する。パネル内配線30は電圧印加用のパッドから延伸する配線にて奇数番目同士、偶数番目同士を電気的に接続する。
 パネル配線の断線は電圧印加用のパッド26,28側、もしくはパッド22,24側のいずれかに供給することで不良検出が可能である。また、配線間の短絡は奇数番/偶数番の配線に位相の異なる交流信号を与えることで検出が可能である。このため、偶数番配線をパッド22または26につながる配線(図4の配線23,25)で束ね、奇数番配線をパッド24または28につながる配線(図4の配線27,29)で束ねている。なお、奇数番配線を束ねる配線、偶数番配線を束ねる配線は、検査終了時にショートリングのカットと同様な方法で切断する。また、選択信号とトランジスタを用いれば配線の切断をしなくても良い。
 図10は、選択信号を用いる例を説明するための図である。図10を参照して、配線群30は配線30A~30Dを含む。配線群30と交差するように配線23,25が設けられ、配線23,25の間には選択信号線LSELが設けられる。配線23,25はそれぞれパッド22,24に接続され、選択信号線LSELはパッドPSELに接続される。TFTトランジスタTRA~TRDが設けられる。選択信号線LSELがハイレベルに活性化されると、TFTトランジスタTRA,TRCが導通してそれぞれ配線30A,30Cを配線23に電気的に接続する。同様に選択信号線LSELがハイレベルに活性化されると、TFTトランジスタTRB,TRDが導通してそれぞれ配線30B,30Dを配線25に電気的に接続する。なお、パッドPSELにハイレベルの信号を印加することをやめると、図示しないプルダウン抵抗などによって選択信号線LSELはロウレベルになり、配線23,25は、配線30A~30Dから電気的に分離される。このような構成とすれば検査後に配線をカットすることが不要となり工数を削減することができる。
 電圧印加用のパッド22,24(または電圧印加用のパッド26,28)より液晶を駆動できる交流信号を印加すると、この電圧が擬似画素にかかる。検査電圧の印加の有無を擬似画素部の光学状態で判断することができる。
 パネル内配線が複数ある場合、擬似画素部34,35に配置した対向側カラーフィルタの色配置を配線によって異なるように配置することで、どの配線が異常となっているかを判断できる。
 再び、図8、図9を参照して、まず、工程S21において、電圧印加用のパッド26、28に互いに逆相極性の信号を印加する。これにより、位置DBのような断線不良が検出できる。また、位置DCに示すような短絡不良も検出できる。
 次に、工程S22において、電圧印加用のパッド26、28に互いに同相極性の信号を印加する。これにより、工程S21で検出した不良が、短絡不良か断線不良かを判別することができる。
 さらに、工程S23において、電圧印加用のパッド22、24に互いに逆相極性の信号を印加する。これにより、位置DAのような断線不良が検出できる。また、位置DCに示すような短絡不良も検出できる。
 次に、工程S24において、電圧印加用のパッド22、24に互いに同相極性の信号を印加する。これにより、工程S23で検出した不良が、短絡不良か断線不良かを判別することができる。
 図11は、逆相の信号を与えた場合の擬似画素部の表示を示した図である。
 図11に示す結果は、図6に示したような6本のパネル内配線があった場合に図7で説明したような信号を入力した場合に生じる結果である。
 図6、図11を参照して、ノーマリーホワイトモードの液晶パネルの場合、全ラインが正常である場合には、擬似画素部34、35ともに擬似画素34A~34C、35D~35Fは黒となる。
 配線LA(パッドLAが接続されている配線)が断線していた場合には、擬似画素34Aが赤に点灯する一方で、擬似画素34B,34Cは黒となり、擬似画素部34は全体として赤に見える。このとき、擬似画素部35は全体として黒に見える。
 配線LB(パッドLBが接続されている配線)が断線していた場合には、擬似画素34Bが緑に点灯する一方で、擬似画素34A,34Cは黒となり、擬似画素部34は全体として緑に見える。このとき、擬似画素部35は全体として黒に見える。
 配線LC(パッドLCが接続されている配線)が断線していた場合には、擬似画素34Cが青に点灯する一方で、擬似画素34A,34Bは黒となり、擬似画素部34は全体として青に見える。このとき、擬似画素部35は全体として黒に見える。
 配線LD(パッドLDが接続されている配線)が断線していた場合には、擬似画素35Dが赤に点灯する一方で、擬似画素35E,35Fは黒となり、擬似画素部35は全体として赤に見える。このとき、擬似画素部34は全体として黒に見える。
 配線LE(パッドLEが接続されている配線)が断線していた場合には、擬似画素35Eが緑に点灯する一方で、擬似画素35D,35Fは黒となり、擬似画素部35は全体として緑に見える。このとき、擬似画素部34は全体として黒に見える。
 配線LF(パッドLFが接続されている配線)が断線していた場合には、擬似画素35Fが青に点灯する一方で、擬似画素35D,35Eは黒となり、擬似画素部35は全体として青に見える。このとき、擬似画素部34は全体として黒に見える。
 隣接する配線LAと配線LBとが短絡していた場合には、擬似画素34Aが赤に点灯し、擬似画素34Bが緑に点灯する。このとき擬似画素34Cは黒となる。その結果、擬似画素部34は全体として黄色に見える。このとき、擬似画素部35は全体として黒に見える。
 隣接する配線LBと配線LCとが短絡していた場合には、擬似画素34Bが緑に点灯し、擬似画素34Cが青に点灯する。このとき擬似画素34Aは黒となる。その結果、擬似画素部34は全体として水色に見える。このとき、擬似画素部35は全体として黒に見える。
 隣接する配線LCと配線LDとが短絡していた場合には、擬似画素34Cが青に点灯し、擬似画素34A,34Bは黒となる。その結果、擬似画素部34は全体として青色に見える。このときさらに、擬似画素35Dは赤に点灯し、擬似画素35E,35Fは黒となる。その結果、擬似画素部35は全体として赤に見える。
 隣接する配線LDと配線LEとが短絡していた場合には、擬似画素35Dが赤に点灯し、擬似画素35Eが緑に点灯する。このとき擬似画素35Fは黒となる。その結果、擬似画素部35は全体として黄色に見える。このとき、擬似画素部34は全体として黒に見える。
 隣接する配線LEと配線LFとが短絡していた場合には、擬似画素35Eが緑に点灯し、擬似画素35Fが青に点灯する。このとき擬似画素35Dは黒となる。その結果、擬似画素部35は全体として水色に見える。このとき、擬似画素部34は全体として黒に見える。
 このように、擬似画素部34,35の各々に複数色の擬似画素を配置しこれにパネル内配線を接続しておく。すると、擬似画素部の色をチェックすることにより、どのような不良が発生したのかを直ちに知ることができるようになる。
 図12は、不良が特定できない例を説明するための図である。
 図12を参照して、配線LAと配線LBが共に断線した場合と、配線LAと配線LBとが短絡した場合は、いずれも擬似画素34Aが赤に点灯し、擬似画素34Bが緑に点灯する。このとき擬似画素34Cは黒となる。その結果、擬似画素部34は全体として黄色に見える。このとき、擬似画素部35は全体として黒に見える。
 これでは、擬似画素部34,35を見ただけでは、どちらの場合の不良であるか判別できない。このような場合には、隣接する配線に同相極性の信号を与える。
 図13は、隣接配線に与える検査波形の極性を変えた場合の擬似画素部の表示を説明するための図である。
 図13を参照して、隣接する配線LA,LBに逆相極性の信号を与えた場合には、図12で説明したように、配線LAと配線LBが共に断線した場合と、配線LAと配線LBとが短絡した場合は同じ結果を示す。いずれの場合も、擬似画素34Aが赤に点灯し、擬似画素34Bが緑に点灯する。このとき擬似画素34Cは黒となる。その結果、擬似画素部34は全体として黄色に見える。このとき、擬似画素部35は全体として黒に見える。
 この場合、隣接する配線LA,LBに同相極性の信号を与える。すると、配線LAと配線LBが共に断線した場合、擬似画素34Aが赤に点灯し、擬似画素34Bが緑に点灯する。このとき擬似画素34Cは黒となる。その結果、擬似画素部34は全体として黄色に見える。このとき、擬似画素部35は全体として黒に見える。しかし、配線LAと配線LBが短絡していた場合は、これとは異なる結果となる。
 すなわち、擬似画素34A~34C、35D~35Fは全て黒となる。
 擬似画素部34,35の色を見ることによって、短絡故障と断線故障を見分けることができるようになる。つまり、互いに隣接するパネル内配線の偶数番目と奇数番目に異なる信号(逆相信号)与える場合と、同じ信号(同相信号)を与える場合とにおいて、擬似画素部34,35を目視チェックすれば、断線なのか短絡なのか不良原因と不良箇所を早期に発見することができる。
 以上説明したように、本実施の形態では、パネル内配線部から表示部近傍に延伸する配線および透明電極パッドを設け、これに液晶を介在させた擬似画素部を設ける。パネル内配線部に所定の信号を印加させ、擬似画素部の表示を確認することで該配線部の欠陥(断線モード/短絡モード)の検出が可能となる。
 また、擬似画素部のカラーフィルタパターンの組合せにより、目視検査にてどのパネル内配線が欠陥を有しているか容易に判断できる。
 配線部は構造的に大きく変更する必要がなく、通常の画素部の点灯検査と同時にパネル内配線部の不良を検出できることで、工程短縮ならびに後工程への不良流出を防止することが可能となる。
 [擬似画素部の変形例]
 擬似画素部34、35の形状には種々の変形例が考えられる。いくつかの変形例を示しておく。
 図14は、擬似画素部の形状の第1の変形例を示した図である。
 図14では、擬似画素部134の各擬似画素を正方形とし、擬似画素部135の各擬似画素を三角形としている。
 図15は、擬似画素部の形状の第2の変形例を示した図である。
 図15では、擬似画素部234の各擬似画素を縦長長方形とし、擬似画素部235の各擬似画素を横長長方形としている。
 図16は、擬似画素部の形状の第3の変形例を示した図である。
 図16では、擬似画素部334の各擬似画素に「1」という記号を表記し、擬似画素部335の各擬似画素に「2」という記号を表記している。この記号は、たとえばTFT基板側の透明電極パターンをくりぬき文字にする。なお、記号は数字でなくてもよく、擬似画素部334と擬似画素部335の区別が付けばどのようなものであってもよい。
 図14~図16に示したように、一見して2箇所の擬似画素部の区別が付くようにしておけば、図11で同じ色に見える場合も製造現場で容易に見分けが付く。すなわち、配線LAが断線した場合は擬似画素部34が赤に見え、配線LDが断線した場合は擬似画素部35が赤に見えるが、紛らわしい。図14に示した場合ならば、四角の赤は配線LAの断線、三角の赤は配線LDの断線であるというように、覚えやすくなる。同様に図15、図16に示した場合も覚えやすい。
 最後に、再び図を参照して、本実施の形態について総括する。主として図4に示されるように、本実施の形態の液晶表示装置は、第1の基板10と、第1の基板10に対して液晶層を介して重なり合う第2の基板8と、第2の基板8上に形成される複数の配線30と、複数の配線30にそれぞれ電気的に接続され、表示エリアの周囲を囲む額縁部(ブラックマトリクス60)に設けられた複数の擬似画素34A~34C,35D~35Fと、複数の擬似画素35Fに対応して額縁部60に設けられた複数の開口にそれぞれ配置される複数の色フィルタ部56とを備える。複数の色フィルタ部56は、複数の配線30に生じる複数の不良の種類に対応して異なる発色となるように色が選択され配置される。
 好ましくは、複数の色フィルタ部56A~56Fは、複数種類の色を含んで集合配置され擬似画素部34,35を形成する。
 より好ましくは、液晶表示装置は、複数の配線30に電気信号を直接与えるための複数の電圧印加用のパッド22,24,26,28をさらに備える。複数の配線30のうち第1の配線30Aには、一端の近傍に第1の電圧印加用のパッド22が接続され、他端の近傍には第2の電圧印加用のパッド26が接続される。複数の配線のうちの第1の配線30Aと並走する第2の配線30Bには、一端の近傍に第3の電圧印加用のパッド24が接続され、他端の近傍には第4の電圧印加用のパッド28が接続される。
 好ましくは、液晶表示装置は、複数の配線30のうち第1の配線を含む奇数番目の配線30A,30C,30Eを束ねて第1の電圧印加用のパッド22に接続するための第3の配線23と、複数の配線30のうち第2の配線を含む偶数番目の配線30B,30D,30Fを束ねて第3の電圧印加用のパッド24に接続するための第4の配線25とをさらに備える。第3の配線23および第4の配線25は、第1の配線30Aおよび第2の配線30Bが形成される配線層よりも上層の配線層で形成される。これにより、後工程で配線23,25を切断することが容易となる。
 好ましくは、複数の配線30は、第2の基板8上にマウントされる液晶ドライバ素子と液晶表示装置の信号入出力用の端子46A~46Fとを接続する配線である。
 図4、図5に示すように、好ましくは、液晶表示装置は、額縁部60の外縁部に第1の基板10と第2の基板8とに挟まれた状態で配置され表示エリア40および複数の擬似画素34A~34C,35D~35Fにある液晶層をシールするシール部材48をさらに備える。複数の擬似画素34A~34C,35D~35Fの各々は、色フィルタ部56A~56Fを覆うように配置された第1の透明電極54と、第1の透明電極54と色フィルタ部において液晶層を挟んで対向するように配置され複数の配線30のひとつと電気的に接続された第2の透明電極52とを含む。
 今回開示された実施の形態はすべての点で例示であって制限的なものではないと考えられるべきである。本発明の範囲は上記した説明ではなくて請求の範囲によって示され、請求の範囲と均等の意味および範囲内でのすべての変更が含まれることが意図される。
 1 液晶表示装置、2 駆動用プリント基板、6,23,25,30A,30C,30E,30B,30D,30F,LA,LB 配線、8,10 基板、12,14,16 チップ、12A,14A チップ搭載領域、12B,14B,14C バンプ、22,26,24,28,42 パッド、30 パネル内配線、32 引出し配線、34,35,134,135,234,235,334,335 擬似画素部、34A~34C,35D~35F 擬似画素、40 表示エリア、43 ソース配線、44 検査用ショートリング、46A~46F 端子、48 シール部材、52,54 透明電極、56,56A~56F 色フィルタ部、58 開口部、60 ブラックマトリクス。

Claims (6)

  1.  第1の基板(10)と、
     前記第1の基板(10)に対して液晶層を介して重なり合う第2の基板(8)と、
     前記第2の基板(8)上に形成される複数の配線(30)と、
     前記複数の配線(30)にそれぞれ電気的に接続され、表示領域の周囲を囲む額縁部(60)に設けられた複数の擬似画素(34A~34C,35D~35F)と、
     前記複数の擬似画素(34A~34C,35D~35F)に対応して前記額縁部(60)に設けられた複数の開口にそれぞれ配置される複数の色フィルタ部(56)とを備え、
     前記複数の色フィルタ部(56)は、前記複数の配線(30)に生じる複数の不良の種類に対応して異なる発色となるように色が選択され配置される、液晶表示装置。
  2.  前記複数の色フィルタ部(56A~56F)は、複数種類の色を含んで集合配置され1つの擬似画素部(34,35)を形成する、請求項1に記載の液晶表示装置。
  3.  前記複数の配線(30)に電気信号を直接与えるための複数の電圧印加パッド(22,24,26,28)をさらに備え、
     前記複数の配線(30)のうち第1の配線(30A)には、一端の近傍に第1の電圧印加パッド(22)が接続され、他端の近傍には第2の電圧印加パッド(26)が接続され、
     前記複数の配線のうちの前記第1の配線(30A)と並走する第2の配線(30B)には、一端の近傍に第3の電圧印加パッド(24)が接続され、他端の近傍には第4の電圧印加パッド(28)が接続される、請求項2に記載の液晶表示装置。
  4.  前記複数の配線(30)のうち前記第1の配線を含む奇数番目の配線群(30A,30C,30E)を電気的に前記第1の電圧印加パッド(22)に接続するための第3の配線(23)と、
     前記複数の配線(30)のうち前記第2の配線を含む偶数番目の配線群(30B,30D,30F)を電気的に前記第3の電圧印加パッド(24)に接続するための第4の配線(25)とをさらに備える、請求項3に記載の液晶表示装置。
  5.  前記複数の配線(30)は、前記第2の基板(8)上にマウントされる液晶ドライバ素子と前記液晶表示装置の信号入出力端子(46A~46F)とを接続する配線である、請求項1に記載の液晶表示装置。
  6.  前記額縁部(60)の外縁部に前記第1の基板(10)と前記第2の基板(8)とに挟まれた状態で配置され前記表示領域(40)および前記複数の擬似画素(34A~34C,35D~35F)にある前記液晶層をシールするシール部材(48)をさらに備え、
     前記複数の擬似画素(34A~34C,35D~35F)の各々は、
     前記色フィルタ部(56A~56F)を覆うように配置された第1の透明電極(54)と、
     前記第1の透明電極(54)と前記色フィルタ部において前記液晶層を挟んで対向するように配置され前記複数の配線(30)のひとつと電気的に接続された第2の透明電極(52)とを含む、請求項1に記載の液晶表示装置。
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