WO2010064369A1 - 半導体装置及びその製造方法 - Google Patents
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 36
- 238000004519 manufacturing process Methods 0.000 title claims description 10
- 238000009792 diffusion process Methods 0.000 claims abstract description 60
- 239000012535 impurity Substances 0.000 claims abstract description 21
- 238000009826 distribution Methods 0.000 claims abstract description 19
- 238000005468 ion implantation Methods 0.000 claims abstract description 19
- 230000003287 optical effect Effects 0.000 abstract description 17
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 21
- 229910052710 silicon Inorganic materials 0.000 description 21
- 239000010703 silicon Substances 0.000 description 21
- 238000004364 calculation method Methods 0.000 description 13
- 230000006798 recombination Effects 0.000 description 9
- 238000005215 recombination Methods 0.000 description 9
- 239000000969 carrier Substances 0.000 description 8
- 230000007423 decrease Effects 0.000 description 8
- 230000005684 electric field Effects 0.000 description 8
- 230000015556 catabolic process Effects 0.000 description 7
- 230000004044 response Effects 0.000 description 7
- 239000000758 substrate Substances 0.000 description 7
- 238000002955 isolation Methods 0.000 description 6
- 238000002513 implantation Methods 0.000 description 5
- 230000006872 improvement Effects 0.000 description 5
- 229910052785 arsenic Inorganic materials 0.000 description 4
- RQNWIZPPADIBDY-UHFFFAOYSA-N arsenic atom Chemical compound [As] RQNWIZPPADIBDY-UHFFFAOYSA-N 0.000 description 4
- 230000008859 change Effects 0.000 description 4
- OAICVXFJPJFONN-UHFFFAOYSA-N Phosphorus Chemical compound [P] OAICVXFJPJFONN-UHFFFAOYSA-N 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 230000031700 light absorption Effects 0.000 description 3
- 238000000034 method Methods 0.000 description 3
- 229910052698 phosphorus Inorganic materials 0.000 description 3
- 239000011574 phosphorus Substances 0.000 description 3
- 230000009471 action Effects 0.000 description 2
- 230000003247 decreasing effect Effects 0.000 description 2
- 230000006866 deterioration Effects 0.000 description 2
- 238000005457 optimization Methods 0.000 description 2
- 230000008569 process Effects 0.000 description 2
- 235000012431 wafers Nutrition 0.000 description 2
- 238000010521 absorption reaction Methods 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 239000013078 crystal Substances 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
- 238000005530 etching Methods 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
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- H01L29/70—Bipolar devices
- H01L29/72—Transistor-type devices, i.e. able to continuously respond to applied control signals
- H01L29/73—Bipolar junction transistors
- H01L29/732—Vertical transistors
- H01L29/7322—Vertical transistors having emitter-base and base-collector junctions leaving at the same surface of the body, e.g. planar transistor
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L27/00—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
- H01L27/14—Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components sensitive to infrared radiation, light, electromagnetic radiation of shorter wavelength or corpuscular radiation and specially adapted either for the conversion of the energy of such radiation into electrical energy or for the control of electrical energy by such radiation
- H01L27/144—Devices controlled by radiation
- H01L27/146—Imager structures
- H01L27/14601—Structural or functional details thereof
- H01L27/14609—Pixel-elements with integrated switching, control, storage or amplification elements
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- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L29/00—Semiconductor devices specially adapted for rectifying, amplifying, oscillating or switching and having potential barriers; Capacitors or resistors having potential barriers, e.g. a PN-junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof ; Multistep manufacturing processes therefor
- H01L29/02—Semiconductor bodies ; Multistep manufacturing processes therefor
- H01L29/06—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions
- H01L29/10—Semiconductor bodies ; Multistep manufacturing processes therefor characterised by their shape; characterised by the shapes, relative sizes, or dispositions of the semiconductor regions ; characterised by the concentration or distribution of impurities within semiconductor regions with semiconductor regions connected to an electrode not carrying current to be rectified, amplified or switched and such electrode being part of a semiconductor device which comprises three or more electrodes
- H01L29/1004—Base region of bipolar transistors
Definitions
- the present invention relates to a semiconductor device and a manufacturing method thereof, and more particularly to a semiconductor device in which transistors and light receiving elements are monolithically integrated on a semiconductor substrate and a manufacturing method thereof.
- CD Compact Disc
- DVD Digital Versatile Disc
- Blu-ray and optical disc apparatuses have been increased in density and have been put to practical use.
- the reading speed and the writing speed are further increased.
- the PDIC Photodiode Integrated Circuit
- the laser output is also increased, so that the speeding up of the PDIC must be achieved even under a high light input.
- FIG. 7 shows a PDIC described in FIG.
- a p-type silicon substrate 1 includes a p-type silicon substrate 1, a p + -type silicon layer 2, a p ⁇ -type epitaxial layer 3 and an n-type epitaxial layer 6, and a p-type buried diffusion layer 4 and an n-type buried diffusion in the course of epitaxial growth.
- Layer 5 is formed.
- a p-type isolation diffusion layer 7 is formed for element isolation between the PD and the bipolar transistor, a PD portion n-type diffusion layer 8 is formed in the PD region, and an n-type diffusion layer 9 and a p-type in the bipolar transistor region.
- a base diffusion layer 10 and an n-type emitter diffusion layer 11 are formed.
- a dielectric film 12 and an electrode 13 are formed on such a silicon substrate.
- an n-type PD and a bipolar transistor are monolithically integrated on a p-type silicon substrate 1.
- the n-type epitaxial layer 6 needs a thickness of about 1 ⁇ m or more because of the bipolar transistor structure (see, for example, Patent Document 2).
- the pn junction position of the PD becomes as deep as 1 ⁇ m or more from the silicon surface, leading to a decrease in efficiency and a deterioration in response speed.
- the cause of the deterioration is that the blue light used in the Blu-ray optical disc apparatus has a large absorption coefficient of silicon, and the depth at which the incident light intensity becomes 1 / e is as shallow as about 0.15 ⁇ m.
- Patent Documents 3 to 5 employs means for etching the PD region and shallowing the pn junction position.
- unplanarized wafers are not practical because semiconductor processing becomes difficult.
- Patent Documents 6 and 7 means for inverting the lower layer portion of the n-type epitaxial layer 6 to p-type by diffusion and shallowing the pn junction position is used.
- the p ⁇ -type epitaxial layer 3 has a low concentration of, for example, about 1 ⁇ 10 14 cm ⁇ 3 in order to keep the capacitance of the PD low. It is extremely difficult to invert the n-type semiconductor layer to p-type by diffusion and control it to such a low concentration.
- the n-type epitaxial layer has a thickness of 2 ⁇ m, and a high-concentration region is provided so that there is a peak at a depth of 0.3 to 0.7 ⁇ m.
- hole carriers generated on the surface side from the concentration peak are less likely to move to the p-type region, and the probability of pair annihilation due to surface recombination increases. For this reason, efficiency is bad.
- the thickness of the n-type epitaxial layer is set to about 0.8 ⁇ m to 1.0 ⁇ m, the n-type impurity concentration by ion implantation is specified, and a quantum efficiency of 90% or more is achieved.
- the n-type impurity concentration distribution in the PD portion is important.
- the PD part n-type diffusion layer 8 prevents the surface recombination of hole carriers generated by light absorption, as described in Patent Document 9, and contributes to improving the efficiency. Further, as described in Patent Document 8, the sheet resistance of the n layer on the surface of the PD affects the response speed of the PD. The existence of the PD n-type diffusion layer 8 is also effective for reducing the resistance. Further, the PD portion n-type diffusion layer 8 may have a double ion implantation structure as disclosed in Patent Document 10. If the concentration profile has a gradient, an electric field is applied to the photo-generated hole carrier, and the response speed can be improved.
- the n-type doping profile of the PD portion n-type diffusion layer 8 is preferably set as follows.
- the maximum surface concentration may be set to 1 ⁇ 10 20 cm ⁇ 3 or less.
- the maximum surface concentration may be 1 ⁇ 10 19 cm ⁇ 3 or less.
- a good response speed can be obtained by reducing the thickness of the n-type epitaxial layer 6 (pn junction depth) to about 0.8 to 1.0 ⁇ m. In the 3 dB band of a single PD, 500 MHz or more can be obtained. When such a high-speed response is realized, it is possible to cope with the 12 times speed of the Blu-ray optical disc apparatus.
- JP 2004-087979 A Japanese Patent No. 4058034 Japanese Patent Laid-Open No. 2002-064218 JP 2003-037259 A JP 2006-210494A JP 2007-317767 A JP 2007-317768 A JP 2003-197949 A Japanese Patent Laid-Open No. 4-249382 Japanese Patent Application Laid-Open No. 2002-203954 (Pages 8-9, FIGS. 5 and 6) Japanese Patent Laid-Open No. 2003-051607
- the thickness of the n-type epitaxial layer 6 is preferably thicker for the bipolar transistor, preferably thinner for the PD, and the appropriate range is narrow.
- silicon epitaxial growth there are layer thickness reproducibility, wafer-to-wafer variations, and wafer-to-wafer variations. Therefore, it is desirable to design in consideration of variations of about ⁇ 0.1 ⁇ m.
- the n-type epitaxial layer 6 is too thin, the yield deteriorates due to a decrease in the breakdown voltage of the bipolar transistor.
- a layer thickness of 1 ⁇ m or more at the design center and 0.9 ⁇ m or more at the lower limit of variation is desirable.
- the n-type epitaxial layer 6 is thinner.
- the n-type epitaxial layer thickness is set to 0.8 to 1.0 ⁇ m. In this case, the target center of the n-type epitaxial layer thickness is 0.9 ⁇ m. For this reason, it is difficult to ensure the breakdown voltage yield of the bipolar transistor.
- the optimum layer thickness range of the n-type epitaxial layer that can achieve both the PD bandwidth and the transistor breakdown voltage is narrow, and the yield is poor.
- the 3 dB band of the PD is desirable from the viewpoint of further speeding up the Blu-ray optical disc apparatus. For example, when aiming at 16 ⁇ speed, a 3 dB band of about 600 MHz is required. On the other hand, even if the speed is still 12 times, if the bandwidth of the single PD is improved, there is a margin in the IC design. Further, although the 3 dB band of 500 MHz is achieved with a low optical input, the band decreases as the light incident power increases. High-power light is incident on the PDIC when writing to the optical disk apparatus, but it is required that the settling time after the light is turned off be short.
- the PD bandwidth is insufficient. This is because, as described above, the thickness of the n-type epitaxial layer cannot be reduced in order to secure the breakdown voltage yield of the integrated bipolar transistor.
- the present invention has been made in view of the above, and an object thereof is to provide a semiconductor device that is excellent in the breakdown voltage yield of a bipolar transistor, the band of a light receiving element, and the quantum efficiency.
- An optical semiconductor device includes: A transistor, A light receiving element monolithically integrated with the transistor, The light receiving element is a p-type semiconductor layer; An n-type epitaxial layer formed on the p-type semiconductor layer; An n-type diffusion layer formed on the n-type epitaxial layer, The n-type impurity concentration distribution in the depth direction of the n-type diffusion layer is formed by double ion implantation, and The interface position between the p-type semiconductor layer and the n-type epitaxial layer has a depth of 0.9 ⁇ m or more and 1.5 ⁇ m or less from the surface of the n-type diffusion layer.
- a method for manufacturing an optical semiconductor device includes: A method of manufacturing a semiconductor device in which a transistor and a light receiving element are monolithically integrated, forming an n-type epitaxial layer having a thickness of 0.9 ⁇ m or more and 1.5 ⁇ m or less on the p-type semiconductor layer; On the n-type epitaxial layer, an n-type diffusion layer is formed by double ion implantation in the formation region of the light receiving element.
- the present invention it is possible to provide a semiconductor device excellent in the breakdown voltage yield of the bipolar transistor, the band of the light receiving element and the quantum efficiency.
- FIG. 1 is a sectional view of a PDIC according to the first embodiment of the present invention.
- a p + type silicon layer 102, a p ⁇ type epitaxial layer 103, and an n type epitaxial layer 106 are formed on a p type silicon substrate 101.
- the p ⁇ type epitaxial layer 103 has a p type impurity concentration of 1 ⁇ 10 14 cm ⁇ 3 .
- the layer thickness of the n-type epitaxial layer 106 is 1.2 ⁇ 0.1 ⁇ m, and the n-type impurity concentration is 3 to 6 ⁇ 10 15 cm ⁇ 3 .
- the thickness of the n-type epitaxial layer 106 may be 1.0 to 1.4 ⁇ m, and the n-type impurity concentration may be 1 to 8 ⁇ 10 15 cm ⁇ 3 .
- the thickness of the n-type epitaxial layer 106 is preferably within a range from 0.9 ⁇ m to 1.5 ⁇ m even when variations are taken into consideration.
- a p-type buried diffusion layer 104 and an n-type buried diffusion layer 105 are formed in the process of epitaxial growth.
- a p-type isolation diffusion layer 107 is formed for element isolation between the PD and the bipolar transistor.
- a PD portion n-type diffusion layer 108 is formed, and in the bipolar transistor region, an n-type diffusion layer 109, a p-type base diffusion layer 110, and an n-type emitter diffusion layer 111 are formed.
- a dielectric film 112 is formed on such a silicon crystal, and an electrode 113 is provided.
- FIG. 2 shows two doping profiles A and B.
- FIG. 3 shows the result of calculating the light incident power dependency in the 3 dB band assuming these doping profiles.
- the 3 dB band at 10 ⁇ W incidence is 489 MHz.
- this band is 522 MHz when the thickness of the n-type epitaxial layer 106 is changed to 1.16 ⁇ m, and is decreased to 461 MHz when the thickness is 1.24 ⁇ m.
- profile B the 3 dB band at 10 ⁇ W incidence is improved to 668 MHz, which is about 1.4 times that of profile A.
- the band decreases as the light incident power increases, in the profile B, the band of 500 MHz or higher is maintained up to 70 ⁇ W, and the maximum incident power that can maintain the band of 500 MHz is significantly improved with respect to the profile A.
- the quantum efficiency when the surface recombination velocity is calculated on the assumption that the surface recombination velocity is 1 ⁇ 10 4 cm / s, it is improved to 99.3% in profile B compared to 95.6% in profile A.
- profile B is clearly superior to profile A. This is because profile B satisfies the following conditions for realizing high efficiency and high bandwidth, while profile A does not satisfy it.
- c 1 ⁇ c ⁇ c 2 (Formula 1)
- c 1 [cm ⁇ 3 ] is given by Equation 2.
- c 1 6 ⁇ 10 17 ⁇ exp ( ⁇ x 2 /(2 ⁇ 0.03 2 )) + 6 ⁇ 10 16 ⁇ exp ( ⁇ (x ⁇ 0.12) 2 /(2 ⁇ 0.15 2 )) + 1 ⁇ 10 15
- c 2 [cm ⁇ 3 ] is given by Equation 3.
- Double ion implantation may be performed, or the lower concentration distribution may be formed by controlling the doping amount of epitaxial growth.
- shallow implantation functions to obtain a high quantum efficiency by forming a doping profile that sharply decreases on the surface.
- deep implantation contributes to the achievement of a high bandwidth by allowing the concentration gradient to reach the end of the depletion layer and sufficiently narrowing or eliminating the region where no electric field is applied.
- the inventor conducted a quantitative study in order to improve the 3 dB bandwidth of the PD integrated with the bipolar IC from 500 MHz and bring the quantum efficiency as close to 100% as possible.
- a quantitative study in order to improve the 3 dB bandwidth of the PD integrated with the bipolar IC from 500 MHz and bring the quantum efficiency as close to 100% as possible.
- quantum efficiency it is known that a quantum efficiency of 90% or more can be obtained if the maximum surface concentration of n-type impurities is 1 ⁇ 10 19 cm ⁇ 3 or less.
- concentration 1 ⁇ 10 19 cm ⁇ 3 or less
- special concentration dependency is not observed. More specifically, it also depends on the diffusion depth of the n-type impurity. This is because the electric field acting on the photo-generated hole carrier is changed by changing the concentration gradient, and the surface recombination probability is changed. According to FIG.
- the maximum surface concentration at which the quantum efficiency is sufficiently high and the concentration dependency is eliminated is 1 ⁇ 10 20 cm ⁇ 3 or less when the n-type impurity diffusion layer depth is 0.3 ⁇ m.
- the n-type impurity diffusion layer depth is 1.2 ⁇ m, it is 1 ⁇ 10 19 cm ⁇ 3 or less.
- Patent Document 8 discloses a band change due to resistance.
- the band greatly depends not only on the resistance but also on the time for which the photo-generated hole carriers are transported to the p-layer, a quantitative examination is desired. From the viewpoint of the hole carrier transport phenomenon, the band improves as the pn junction position becomes shallower. When it is necessary to deepen the pn junction position for other reasons, it is very difficult to obtain a high band. Therefore, it is necessary to deeply analyze the transport phenomenon of hole carriers and strictly study the n-type impurity concentration distribution.
- the inventor intends to sufficiently increase the yield of a monolithically integrated bipolar transistor in consideration of the variation in the thickness of the n-type epitaxial layer 106.
- the design center of the layer thickness of the n-type epitaxial layer 106 is 1. Set to 2 ⁇ m. If it is so thick, it is not easy to obtain a band of 500 MHz or more. Therefore, numerical calculations were performed to analyze the carrier transport phenomenon in detail.
- the surface recombination velocity governing the quantum efficiency was set to 1 ⁇ 10 4 cm / s as described above. Although this value may change depending on the process conditions, the magnitude relationship between the quantum efficiencies does not change, so it is possible to know the direction of quantum efficiency improvement.
- FIG. 4 shows the calculation result of the ⁇ 1 dependence of the quantum efficiency
- FIG. 5 shows the calculation result of the ⁇ 1 dependence of the 3 dB band of the PD.
- n-type impurity concentration (doping profile) c by double ion implantation, the sum of Gaussian distributions expressed by Formula 4 was assumed.
- c n 1 ⁇ exp ( ⁇ (xd 1 ) 2 / (2 ⁇ 1 2 )) + N 2 ⁇ exp ( ⁇ (x ⁇ d 2 ) 2 / (2 ⁇ 2 2 )) (Formula 4)
- x is a depth from the silicon surface.
- n 1 , n 2 , d 1 , d 2 , ⁇ 1 , and ⁇ 2 are parameters.
- n 1 and n 2 indicate the maximum density in each Gaussian distribution.
- d 1 and d 2 indicate the depths that give the maximum densities n 1 and n 2 in each Gaussian distribution.
- ⁇ 1 and ⁇ 2 are depth deviations. Further, d 1 ⁇ d 2 is set.
- FIG. 4 shows the calculation result of the ⁇ 1 dependence of the quantum efficiency.
- ⁇ 1 is fairly narrow and is preferably about 0.03 to 0.06 ⁇ m.
- FIG. 5 shows the calculation result of the ⁇ 1 dependency of the 3 dB band of PD.
- the factor that determines the band depends on how short the length of the region where the electric field is zero or the electric field is reversed in the n-type epitaxial layer 106 is suppressed.
- an electric field is applied due to depletion.
- a region of the n-type epitaxial layer 106 that is not depleted must be subjected to an electric field due to a concentration gradient.
- the distribution Does not grow. For this reason, the region without the concentration gradient becomes longer, and the band is greatly deteriorated.
- the second Gaussian distribution that is, n 2 ⁇ exp ( ⁇ (x ⁇ d 2 ) 2 / (2 ⁇ 2 2 )) in Equation 4 solves this dilemma.
- the second Gaussian distribution may be such that the concentration gradient reaches the depletion region end near the pn junction so as not to disturb the steep profile near the surface of the first Gaussian distribution.
- n 2 is somewhat lower than n 1 and somewhat higher than the concentration of the n-type epitaxial layer 106, so that the concentration gradient continues from the silicon surface to about 0.6 ⁇ 0.2 ⁇ m.
- d 2 and ⁇ 2 may be determined.
- the depth position where the concentration decreases to 1 ⁇ 10 16 cm ⁇ 3 is preferably about 0.6 ⁇ 0.2 ⁇ m.
- the concentration of the n-type epitaxial layer 106 is preferably about 1 ⁇ 10 15 to 8 ⁇ 10 15 cm ⁇ 3 .
- n 1 if it is too high, the efficiency deteriorates, and if it is too low, there arises a problem that the resistance of the n layer between the light incident position and the n electrode increases. The necessity to limit from such a viewpoint arises.
- the pn junction depth is within a certain range.
- the lower limit is determined by the bipolar transistor structure, but it is preferably 0.9 ⁇ m or more. More desirably, the thickness is 1.0 ⁇ m or more. Even more desirably, the thickness is 1.1 ⁇ m or more.
- the upper limit of the pn junction depth is determined by the PD band for blue light, but is preferably 1.5 ⁇ m or less. More desirably, the thickness is 1.4 ⁇ m or less. More preferably, it is 1.3 ⁇ m or less.
- a p + type silicon layer 102 and a p ⁇ type epitaxial layer 103 are formed on a p type silicon substrate 101.
- a p-type buried diffusion layer 104 and an n-type buried diffusion layer 105 are formed.
- the n-type epitaxial layer 106 is crystal-grown on the entire surface.
- a p-type isolation diffusion layer 107 is formed, and a PD portion n-type diffusion layer 108 is formed in the PD region by double ion implantation of phosphorus or arsenic.
- n-type diffusion layer 109, a p-type base diffusion layer 110, and an n-type emitter diffusion layer 111 are formed in the bipolar transistor region.
- a dielectric film 112 is formed over the entire surface of the silicon to form an opening.
- an electrode 113 is formed in each opening to obtain a PDIC.
- the ion implantation for forming the n-type diffusion layer 109 in the bipolar transistor region is performed separately from the ion implantation for forming the PD portion n-type diffusion layer 108, the PD portion n is employed.
- the doping profile of the mold diffusion layer 108 can be designed independently of the bipolar transistor. Therefore, a detailed design for improving the bandwidth and efficiency of the PD becomes possible, and a significant improvement in performance can be achieved by making full use of multiple ion implantation. Further, the concentration distribution may be formed in combination with the doping flow rate control when growing the n-type epitaxial layer 106.
- the doping profile of the PD n-type diffusion layer 108 can be configured between C and D shown in FIG.
- the lower limit and the upper limit profile C and profile D are employed.
- FIG. 3 shows the calculation results of the light incident power dependence of these profiles C and D in the 3 dB band.
- the 3 dB band is 922 MHz
- profile D is 742 MHz.
- the profile A is improved by 1.9 times and 1.5 times, respectively.
- the profile C achieves a high band of 500 MHz or higher up to 70 ⁇ W and the profile D reaches 80 ⁇ W input, and the light incident power capable of maintaining the 500 MHz band is significantly improved over the profile A.
- the calculated values of quantum efficiency are 99.6% for profile C and 98.4% for profile D, both of which are 98% or more. If the concentration is higher than that of profile D, high quantum efficiency cannot be maintained, which is undesirable.
- a ring electrode having an inner diameter of 84 ⁇ m ⁇ is assumed as the n electrode of the PD, and it is assumed that light having a diameter of 5 ⁇ m ⁇ (spot diameter is defined by a diameter where the light intensity is 1 / e) is incident on the center.
- spot diameter is defined by a diameter where the light intensity is 1 / e
- the resistance between the light incident position and the n electrode is 1300 ⁇ for the profile C and 300 ⁇ for the profile D.
- Lowering the density than profile C is not preferable because the resistance value increases and the band at the time of high light input decreases as can be seen from FIG.
- the profile C is represented by c 1 [cm ⁇ 3 ] in the above formula 2
- the profile D is represented by c 2 [cm ⁇ 3 ] in the above formula 3.
- the doping profile between the two satisfies all of a good band of 600 MHz or more, a good efficiency of 98% or more, and a low resistance of 1.4 k ⁇ or less. As compared with a profile that does not fall within the range, excellent performance can be obtained.
- profiles C and D can be used properly according to the application.
- the profile C may be used because only a low light input bandwidth is required.
- a profile of D having a high band at the time of high light input is suitable.
- the n-type epitaxial layer 106 is defined to have an n-type impurity concentration distribution in which the thickness of the n-type epitaxial layer 106 is 1.2 ⁇ 0.2 ⁇ m and the newly discovered relationship between the bandwidth and the efficiency is broken.
- the n-type impurity concentration distribution in which the thickness of the n-type epitaxial layer 106 is 1.2 ⁇ 0.2 ⁇ m and the newly discovered relationship between the bandwidth and the efficiency is broken.
- the incident light power is as high as 70 ⁇ W, it is possible to provide a PDIC that realizes a 3 dB band of 500 MHz or more.
- the present invention can be applied to, for example, a PDIC mounted on an optical pickup.
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Abstract
バイポーラトランジスタの耐圧歩留まりと受光素子の帯域及び量子効率とに優れる半導体装置を提供する。本発明に係る光半導体装置は、モノリシック集積されたトランジスタと受光素子とを有する。前記受光素子は、p型半導体層と、前記p型半導体層上に形成されたn型エピタキシャル層と、前記n型エピタキシャル層上に形成されたn型拡散層と、を備える。前記n型拡散層の深さ方向のn型不純物濃度分布が、二重イオン注入によって形成される分布であり、かつ、前記p型半導体層と前記n型エピタキシャル層との界面位置が、前記n型拡散層の表面から深さ0.9μm以上1.5μm以下である。
Description
本発明は、半導体装置及びその製造方法に関し、特に半導体基板上にトランジスタと受光素子とがモノリシック集積された半導体装置及びその製造方法に関する。
近年、CD(Compact Disc)、DVD(Digital Versatile Disc)、ブルーレイと、光ディスク装置の高密度化が進展し、実用化されてきた。ブルーレイ光ディスク装置においては、さらに読み出し速度、書き込み速度の高速化が進展している。高速化に伴い、光ピックアップに搭載されるPDIC(Photodiode Integrated Circuit)の高速化が要請されている。高速化においては、レーザ出力も高出力化されるため、PDICの高速化は高光入力下においても達成されなければならない。また、シリコンは青色光の吸収係数が高いため、光吸収により生成されるキャリアが、シリコン表面に集中することになる。このため、表面再結合によりフォト生成キャリアが対消滅する確率が高くなり、効率(=光電流/入射光パワー)の確保も重要な課題となる。
光ピックアップに搭載される受光素子(PD:Photodiode)は、小型化、低コストのためにIC(Integrated Circuit)にモノリシック集積されるのが一般的である。このため、上記の課題に対するPDの最適化設計には制約が加わることになる。例えば、特許文献1の図1に記載されているPDICを図7に示す。
図7のPDICは、p型シリコン基板1、p+型シリコン層2、p-型エピタキシャル層3、n型エピタキシャル層6から構成され、エピタキシャル成長の途中でp型埋込み拡散層4、n型埋込み拡散層5が形成されている。PDとバイポーラトランジスタの素子分離のためにp型分離拡散層7が形成されており、PD領域では、PD部n型拡散層8が形成され、バイポーラトランジスタ領域では、n型拡散層9、p型ベース拡散層10、n型エミッタ拡散層11が形成されている。このようなシリコン基板の上に誘電体膜12と電極13が形成されている。
このPDICでは、p型シリコン基板1上に、表面がn型のPDとバイポーラトランジスタとをモノリシック集積している。n型エピタキシャル層6は、バイポーラトランジスタ構造のために1μm程度以上の厚さが必要である(例えば、特許文献2参照)。このような構造では、PDのpn接合位置がシリコン表面から1μm以上と深くなるため、効率の低下や応答速度の悪化を招くことになる。悪化の原因は、ブルーレイ光ディスク装置で用いられる青色光に対して、シリコンの吸収係数が大きく、入射光強度が1/eになる深さが約0.15μmと浅いためである。
このような問題に対して、特許文献3~5に記載されているPDICでは、PD領域をエッチングし、pn接合位置を浅くする手段をとっている。しかし、平坦化されていないウェハーは、半導体プロセスが困難になるため実用的ではない。特許文献6、7においては、拡散によりn型エピタキシャル層6の下層部分をp型に反転させ、pn接合位置を浅くする手段を用いている。しかし、pnの差し引きにより濃度制御するのは困難である。p-型エピタキシャル層3は、PDのキャパシタンスを低く抑えるために、例えば1×1014cm-3程度の低い濃度としている。n型半導体層を拡散によりp型に反転させ、このような低い濃度に制御することは極めて困難である。
従って、通常は、バイポーラトランジスタに合わせ、pn接合位置がある程度深いことを前提に、PDの最適化が図られる。特許文献2では、n型エピタキシャル層の厚さを2μmとした上で、深さ0.3~0.7μmにピークがあるように、高濃度領域を設けている。しかし、濃度ピークより表面側で生成されたホールキャリアは、p型領域へ移動しにくくなり、表面再結合によって対消滅する確率が高くなる。このため効率が悪い。
特許文献8では、n型エピタキシャル層の層厚を0.8μm~1.0μm程度とし、イオン注入によるn型不純物濃度を規定して、90%以上の量子効率を達成している。このように、PD部のn型不純物濃度分布は重要である。
PD部n型拡散層8は、特許文献9に述べられているように、光吸収により生成されたホールキャリアが表面再結合するのを防ぎ、効率を向上させることに寄与する。また、特許文献8に述べられているように、PD表面のn層のシート抵抗はPDの応答速度に影響を及ぼす。抵抗低減のためにもPD部n型拡散層8の存在は有効である。また、PD部n型拡散層8は、特許文献10にあるように二重イオン注入構造であってもよい。濃度プロファイルに勾配があれば、フォト生成ホールキャリアに電界がかかり応答速度を向上させることができる。
特許文献1、8、11から、量子効率90%以上を達成するには、PD部n型拡散層8のn型ドーピングプロファイルを次のようにするとよい。イオン注入にヒ素を用い、拡散深さが浅い場合、表面最大濃度を1×1020cm-3以下にすればよい。イオン注入にリンを用い、拡散深さが深い場合、表面最大濃度を1×1019cm-3以下にすればよい。また、n型エピタキシャル層6の厚さ(pn接合深さ)を0.8~1.0μm程度と薄くすることにより、良好な応答速度が得られる。PD単体の3dB帯域では500MHz以上が得られる。この程度の高速応答が実現されると、ブルーレイ光ディスク装置の12倍速に対応することができる。
ここで、n型エピタキシャル層6の層厚が、バイポーラトランジスタにとっては厚い方がよく、PDにとっては薄い方がよく、適切な範囲が狭いことが問題となる。なお、シリコンのエピタキシャル成長では、層厚の再現性、ウェハー間ばらつき、ウェハー内ばらつきがあるため、±0.1μm程度のばらつきを考慮した設計を行うことが望ましい。
具体的には、n型エピタキシャル層6が薄過ぎると、バイポーラトランジスタの耐圧低下により歩留まりが悪化する。この歩留まりを改善するためには、設計中心で1μm以上、ばらつきの下限で0.9μm以上の層厚が望ましい。
一方、PDの帯域にとっては、n型エピタキシャル層6の層厚は薄い方が良い。例えば、特許文献8では、n型エピタキシャル層厚を0.8~1.0μmとしている。この場合、n型エピタキシャル層厚の狙いの中心は0.9μmになる。そのため、上記のバイポーラトランジスタの耐圧歩留まりの確保が難しくなる。
つまり、PDの帯域とトランジスタの耐圧とを両立できるn型エピタキシャル層の最適層厚範囲が狭く、歩留まりが悪い。
ここで、PDの3dB帯域の更なる向上は、ブルーレイ光ディスク装置の更なる高速化の観点から望ましい。例えば、16倍速を目指す場合、600MHz程度の3dB帯域が必要となる。一方、12倍速のままであったとしても、PD単体の帯域が向上すれば、ICの設計に余裕ができる。また、3dB帯域500MHzは、低光入力では達成されているが、光入射パワーが増大するとともに帯域が低下する。光ディスク装置の書き込み時にはPDICに高パワーの光が入射するが、この光がオフした後のセトリングタイムは短いことが要求される。
つまり、高光入力時の応答速度などを考えると、PDの帯域が不足している。これは、上述の通り、集積するバイポーラトランジスタの耐圧歩留まりを確保するため、n型エピタキシャル層の厚さを薄くできないからである。
本発明は以上を鑑みなされたものであり、バイポーラトランジスタの耐圧歩留まりと受光素子の帯域及び量子効率とに優れる半導体装置を提供することを目的とする。
本発明に係る光半導体装置は、
トランジスタと、
前記トランジスタとモノリシック集積された受光素子と、を有し、
前記受光素子が、
p型半導体層と、
前記p型半導体層上に形成されたn型エピタキシャル層と、
前記n型エピタキシャル層上に形成されたn型拡散層と、を備え、
前記n型拡散層の深さ方向のn型不純物濃度分布が、二重イオン注入によって形成されたものであり、かつ、
前記p型半導体層と前記n型エピタキシャル層との界面位置が、前記n型拡散層の表面から深さ0.9μm以上1.5μm以下であるものである。
トランジスタと、
前記トランジスタとモノリシック集積された受光素子と、を有し、
前記受光素子が、
p型半導体層と、
前記p型半導体層上に形成されたn型エピタキシャル層と、
前記n型エピタキシャル層上に形成されたn型拡散層と、を備え、
前記n型拡散層の深さ方向のn型不純物濃度分布が、二重イオン注入によって形成されたものであり、かつ、
前記p型半導体層と前記n型エピタキシャル層との界面位置が、前記n型拡散層の表面から深さ0.9μm以上1.5μm以下であるものである。
本発明に係る光半導体装置の製造方法は、
トランジスタと受光素子とがモノリシック集積された半導体装置の製造方法であって、
p型半導体層上に厚さ0.9μm以上1.5μm以下のn型エピタキシャル層を形成し、
前記n型エピタキシャル層上であって、前記受光素子の形成領域にn型拡散層を二重イオン注入によって形成するものである。
トランジスタと受光素子とがモノリシック集積された半導体装置の製造方法であって、
p型半導体層上に厚さ0.9μm以上1.5μm以下のn型エピタキシャル層を形成し、
前記n型エピタキシャル層上であって、前記受光素子の形成領域にn型拡散層を二重イオン注入によって形成するものである。
本発明によれば、バイポーラトランジスタの耐圧歩留まりと受光素子の帯域及び量子効率とに優れる半導体装置を提供するができる。
以下、本発明を適用した具体的な実施の形態について、詳細に説明する。ただし、本発明が以下の実施の形態に限定される訳ではない。また、説明を明確にするため、以下の記載及び図面は、適宜、簡略化されている。
実施の形態1
図1は本発明の第1の実施の形態であるPDICの断面図である。このPDICでは、p型シリコン基板101上に、p+型シリコン層102、p-型エピタキシャル層103、n型エピタキシャル層106が形成されている。p-型エピタキシャル層103のp型不純物濃度は1×1014cm-3である。
図1は本発明の第1の実施の形態であるPDICの断面図である。このPDICでは、p型シリコン基板101上に、p+型シリコン層102、p-型エピタキシャル層103、n型エピタキシャル層106が形成されている。p-型エピタキシャル層103のp型不純物濃度は1×1014cm-3である。
n型エピタキシャル層106の層厚は1.2±0.1μmでありn型不純物濃度は3~6×1015cm-3である。ここで、n型エピタキシャル層106の層厚は1.0~1.4μm、n型不純物濃度は1~8×1015cm-3であればよい。エピタキシャル成長では、成長層厚の再現性、ウェハー間ばらつき、ウェハー面内ばらつきがある。n型エピタキシャル層106の層厚は、ばらつきを考慮しても、0.9μm以上1.5μm以下に収まっていることが望ましい。
エピタキシャル成長の過程でp型埋込み拡散層104、n型埋込み拡散層105が形成されている。PDとバイポーラトランジスタの素子分離のために、p型分離拡散層107が形成されている。PD領域では、PD部n型拡散層108が形成され、バイポーラトランジスタ領域では、n型拡散層109、p型ベース拡散層110、n型エミッタ拡散層111が形成されている。このようなシリコン結晶の上に誘電体膜112が形成され、電極113が設けられている。
このPDICでは、PD部n型拡散層108のn型不純物濃度分布が、PDの帯域と効率に大きな影響を与える。図2は、2通りのドーピングプロファイルA及びBを示している。図3は、これらのドーピングプロファイルを仮定して3dB帯域の光入射パワー依存性を計算した結果を示している。
プロファイルAの場合、10μW入射時の3dB帯域は489MHzである。ただしこの帯域は、n型エピタキシャル層106の層厚が1.16μmに変化すると522MHzになり、1.24μmになると461MHzまで低下する。このように、敏感に変化するので、十分高い歩留まりを確保するためには、設計中心において余裕のある帯域を実現していることが望ましい。プロファイルBにおいては、10μW入射時の3dB帯域は668MHzとプロファイルAの約1.4倍に向上する。
さらに、帯域は光入射パワーの増大とともに低下するが、プロファイルBにおいては、70μWまで帯域500MHz以上を維持しており、帯域500MHzを維持できる最大入射パワーが、プロファイルAに対して格段に向上していることが分かる。量子効率に関しては、表面再結合速度を1×104cm/sと仮定して計算した場合、プロファイルAの95.6%に対し、プロファイルBでは99.3%に向上している。
以上、帯域と効率の両方の計算結果から鑑みて、プロファイルAよりプロファイルBが明らかに優れている。これは、プロファイルBが高効率高帯域を実現するための次に述べる条件を満たしているからであって、一方、プロファイルAはそれを満たしていないからである。
具体的に、プロファイルBでは、シリコン表面からの深さx[μm]が0≦x≦0.8の場合、n型不純物濃度c[cm-3]が以下の式1の条件を満足している。
c1≦c≦c2・・・(式1)
ここで、c1[cm-3]は式2で与えられる。
c1=6×1017×exp(-x2/(2×0.032))
+6×1016×exp(-(x-0.12)2/(2×0.152))
+1×1015・・・(式2)
ここで、c2[cm-3]は式3で与えられる。
c2=1×1019×exp(-x2/(2×0.062))
+4×1017×exp(-(x-0.24)2/(2×0.172))
+8×1015・・・(式3)
c1≦c≦c2・・・(式1)
ここで、c1[cm-3]は式2で与えられる。
c1=6×1017×exp(-x2/(2×0.032))
+6×1016×exp(-(x-0.12)2/(2×0.152))
+1×1015・・・(式2)
ここで、c2[cm-3]は式3で与えられる。
c2=1×1019×exp(-x2/(2×0.062))
+4×1017×exp(-(x-0.24)2/(2×0.172))
+8×1015・・・(式3)
このドーピングプロファイルを1回のイオン注入によって形成するのは難しい。二重イオン注入を行うか、または、低い方の濃度分布は、エピタキシャル成長のドーピング量制御で形成すればよい。
二重イオン注入を前提にして述べると、浅い注入は、表面に急峻に低下するドーピングプロファイルを形成することにより、高量子効率を得る機能を果たす。一方、深い注入は、濃度勾配が空乏層端まで届くようにして、電界のかからない領域を十分狭くするか無くし、高帯域達成に寄与する。
次に、上記計算手法について説明する。
発明者は、バイポーラICと集積されるPDの3dB帯域を500MHzから向上させ、量子効率を100%に極力近づけるために、定量的な検討を行った。その結果、バイポーラICと集積することを前提とし、表面がn型シリコンの光ピックアップ用青色PDにおいて、600MHzを超える3dB帯域と98%を超える量子効率を両立させることに成功した。
発明者は、バイポーラICと集積されるPDの3dB帯域を500MHzから向上させ、量子効率を100%に極力近づけるために、定量的な検討を行った。その結果、バイポーラICと集積することを前提とし、表面がn型シリコンの光ピックアップ用青色PDにおいて、600MHzを超える3dB帯域と98%を超える量子効率を両立させることに成功した。
量子効率に関しては、n型不純物の表面最大濃度を1×1019cm-3以下にすれば、量子効率90%以上が得られることが知られている。特許文献1、8、11の実験データによれば、1×1019cm-3以下になれば、特段の濃度依存性が見られなくなる。さらに詳しく述べると、n型不純物の拡散深さにも依存する。これは濃度勾配が変わることにより、フォト生成ホールキャリアに働く電界が変わり、表面再結合確率が変化するためである。特許文献1の図4によれば、量子効率が十分高く、かつ、濃度依存性がなくなる表面最大濃度は、n型不純物拡散層深さが0.3μmの場合、1×1020cm-3以下であるのに対し、n型不純物拡散層深さが1.2μmの場合、1×1019cm-3以下である。
また、帯域に関しては、n型の濃度分布を、表面では高く、ある深さ以上では勾配をつけて濃度を下げることより向上することが知られている。また、pn接合位置を浅くすることによっても向上することが知られている。ただし、これらは定性的な知見であって、定量的な知見ではない。定量的な検討については、特許文献8により、抵抗起因の帯域変化が開示されている。
しかし、帯域は、抵抗のみならず、フォト生成ホールキャリアがp層まで輸送される時間にも大きく依存するため、その定量的な検討が望まれる。ホールキャリアの輸送現象の観点からは、pn接合位置は浅いほど帯域が向上する。他の理由によりpn接合位置を深くする必要がある場合、高い帯域を得ることは非常に困難となる。そこで、ホールキャリアの輸送現象を深く解析し、n型不純物濃度分布を厳密に検討する必要がある。
発明者は、n型エピタキシャル層106の層厚のばらつきを考慮した上で、モノリシック集積するバイポーラトランジスタの歩留まりを十分高くすることを意図し、n型エピタキシャル層106の層厚の設計中心を1.2μmと設定した。これだけ厚いと500MHz以上の帯域を得ることは容易でない。そこで、数値計算を行って、キャリアの輸送現象を詳細に解析した。
計算では、量子効率を支配する表面再結合速度を、上述の通り、1×104cm/sとした。この値は、プロセス条件によっても変化し得るが、量子効率の大小関係は変わらないので、量子効率向上の方向性を知ることはできる。
図4は量子効率のσ1依存性の計算結果を、図5はPDの3dB帯域のσ1依存性の計算結果を示している。二重イオン注入によるn型不純物濃度(ドーピングプロファイル)cの一般式として、式4で表されるガウス分布の和を仮定した。
c=n1×exp(-(x-d1)2/(2σ1 2))
+n2×exp(-(x-d2)2/(2σ2 2))・・・(式4)
ここで、xはシリコン表面からの深さとする。ここで、n1、n2、d1、d2、σ1、σ2がパラメータである。n1、n2は各ガウス分布における最大濃度を示している。d1、d2は各ガウス分布における最大濃度n1、n2を与える深さを示している。σ1、σ2は深さの偏差である。また、d1<d2とする。
c=n1×exp(-(x-d1)2/(2σ1 2))
+n2×exp(-(x-d2)2/(2σ2 2))・・・(式4)
ここで、xはシリコン表面からの深さとする。ここで、n1、n2、d1、d2、σ1、σ2がパラメータである。n1、n2は各ガウス分布における最大濃度を示している。d1、d2は各ガウス分布における最大濃度n1、n2を与える深さを示している。σ1、σ2は深さの偏差である。また、d1<d2とする。
計算の結果、最大濃度が1×1019cm-3以下になっても、効率はなお最大濃度に依存することを新たに見出した。これは、表面再結合により対消滅する相手の電子濃度が変わるためである。また、帯域と効率は、パラメータn1、n2、σ1に対してトレードオフの関係にあることが新たに判った。これまでは、ホールキャリアの動きやすさが、帯域向上、効率向上の両方に関連することは知られていた。しかしながら、帯域と効率の間にトレードオフの関係があるということは知られていなかった。
このような新たな知見から、高い量子効率と高い帯域を両立させるためには、ドーピングプロファイルを厳密に限定することが有効であることが新たに判った。パラメータn1、n2、d1、d2、σ1、σ2を変化させて計算した結果、発明者は、n型不純物濃度c[cm-3]が、深さx[μm]が0≦x≦0.8の場合、上記式1~3の条件を満足すると好ましいことを見出した。
このようなn型不純物濃度分布が良い理由を以下に述べる。まず、図4は量子効率のσ1依存性の計算結果を示している。図4中に示しているように、●で示された折れ線グラフはパラメータn1=4×1018[cm-3]、n2=2×1017[cm-3]の場合、■で示された折れ線グラフはパラメータn1=2×1018[cm-3]、n2=1×1017[cm-3]の場合を示している。その他のパラメータd1=0[μm]、σ2=0.14[μm]は共通である。また、d2については、それぞれの折れ線グラフについて、d2=0.2、0.24、0.28[μm]の3つ場合が示されている。いずれの折れ線グラフにおいても、d2による変化はほとんど見られない。さらに、光入射パワーPin=1[μW]で共通である。
図4から、最大濃度が1×1019cm-3以下であるにもかかわらず、効率はσ1に強く依存することが判る。σ1が狭くなれば、濃度勾配が急峻になるため、フォト生成ホールキャリアにかかる電界が大きくなって表面から引き離され、表面再結合確率が減少するためである。よって、σ1はかなり狭く0.03~0.06μm程度がよい。
しかし、一方、図5から、σ1が狭くなり過ぎると帯域が悪化する。図5はPDの3dB帯域のσ1依存性の計算結果を示している。図5中に示しているように、●で示された折れ線グラフはパラメータn1=4×1018[cm-3]、n2=2×1017[cm-3]の場合、■で示された折れ線グラフはパラメータn1=2×1018[cm-3]、n2=1×1017[cm-3]の場合を示している。その他のパラメータd1=0[μm]、d2=0.24[μm]、σ2=0.14[μm]は共通である。さらに、光入射パワーPin=1[μW]で共通である。
帯域を決定づける要因は、n型エピタキシャル層106の中で、電界が0または電界が逆転する領域の長さがいかに短く抑えられるかによる。p-型エピタキシャル層103に接する領域では、空乏化により電界がかかる。n型エピタキシャル層106のうち空乏化していない領域は、濃度勾配により電界がかかるようにしなければならない。第1のガウス分布すなわち式4におけるn1×exp(-(x-d1)2/(2σ1
2))しかない場合、σ1を0.03~0.06μm程度に狭くすれば、分布が伸びない。そのため、濃度勾配の無い領域が長くなり、帯域が大幅に悪化する。
このジレンマを解決するのが第2のガウス分布すなわち式4におけるn2×exp(-(x-d2)2/(2σ2
2))である。第2のガウス分布は、第1のガウス分布の表面近傍の急峻なプロファイルを阻害しないように、濃度勾配がpn接合近傍の空乏化領域端まで届くようにすればよい。このために、n2は、n1よりある程度低く、かつ、n型エピタキシャル層106の濃度よりもある程度高くした上で、濃度勾配がシリコン表面から0.6±0.2μm程度まで続くように、d2、σ2を決定すればよい。具体的な目安は、1×1016cm-3まで濃度が下がる深さ位置が0.6±0.2μm程度とするのがよい。
また、n型エピタキシャル層106の濃度は、高過ぎると空乏層が伸びにくくなるため、応答が悪化する。一方、低過ぎると、集積されているバイポーラトランジスタのコレクタ抵抗が高くなるという問題が発生する。また、計算の結果、n型エピタキシャル層106の濃度が低いと、高光入力時のPDの帯域が悪化する。例えば、これは図3及び図6における曲線C及びDを比較することにより分かる。このような理由により、n型エピタキシャル層6の濃度は、1×1015~8×1015cm-3程度が好ましい。
n1に関しては、高過ぎると効率が悪化し、低過ぎると、光入射位置とn電極間のn層の抵抗が上がるという問題が発生する。このような観点で限定する必要性が生じる。
さらに、pn接合深さも一定の範囲内にあることが望ましい。下限はバイポーラトランジスタ構造から決まるが、0.9μm以上が良い。より望ましくは1.0μm以上が良い。さらにより望ましくは1.1μm以上が良い。また、pn接合深さの上限は、青色光に対するPDの帯域から決まるが、1.5μm以下が良い。より望ましくは1.4μm以下が良い。さらに望ましくは1.3μm以下が良い。
次に、図6を参照して第1の実施の形態の製造方法を説明する。
まず、p型シリコン基板101上にp+型シリコン層102、p-型エピタキシャル層103を形成する。次に、p型埋込み拡散層104とn型埋込み拡散層105を形成する。次に、全面にn型エピタキシャル層106を結晶成長する。次に、p型分離拡散層107を形成し、PD領域にはリンまたはヒ素の二重イオン注入によりPD部n型拡散層108を形成する。浅いイオン注入は拡散係数が低いヒ素の注入がよいが、深い注入はリン、またはイオン注入エネルギーを高めたヒ素の注入がよい。バイポーラトランジスタ領域には、n型拡散層109、p型ベース拡散層110、n型エミッタ拡散層111を形成する。次に、シリコン表面全面にわたって誘電体膜112を形成し、開口部を形成する。最後に、それぞれの開口部に電極113を形成しPDICを得る。
まず、p型シリコン基板101上にp+型シリコン層102、p-型エピタキシャル層103を形成する。次に、p型埋込み拡散層104とn型埋込み拡散層105を形成する。次に、全面にn型エピタキシャル層106を結晶成長する。次に、p型分離拡散層107を形成し、PD領域にはリンまたはヒ素の二重イオン注入によりPD部n型拡散層108を形成する。浅いイオン注入は拡散係数が低いヒ素の注入がよいが、深い注入はリン、またはイオン注入エネルギーを高めたヒ素の注入がよい。バイポーラトランジスタ領域には、n型拡散層109、p型ベース拡散層110、n型エミッタ拡散層111を形成する。次に、シリコン表面全面にわたって誘電体膜112を形成し、開口部を形成する。最後に、それぞれの開口部に電極113を形成しPDICを得る。
本実施の形態では、バイポーラトランジスタ領域のn型拡散層109を形成するイオン注入を、PD部n型拡散層108を形成するイオン注入とは別に行うという工程を採用しているので、PD部n型拡散層108のドーピングプロファイルをバイポーラトランジスタとは独立して設計できる。従って、PDの帯域、効率を向上させるための詳細設計が可能になり、多重イオン注入を駆使して大幅に性能向上を達成できる。また、n型エピタキシャル層106を成長するときのドーピング流量制御と組み合わせて濃度分布を形成しても良い。
実施の形態2
上記実施の形態1において、PD部n型拡散層108のドーピングプロファイルを、図6に示すCとDの間で構成することができる。第2の実施の形態では、下限、上限であるプロファイルC、プロファイルDを採用する。これらのプロファイルC及びDの3dB帯域の光入射パワー依存性の計算結果を図3に示す。プロファイルCの10μW入力時3dB帯域は922MHzで、プロファイルDは742MHzである。プロファイルAに対し、それぞれ、1.9倍、1.5倍に向上している。また、プロファイルCは70μWまで、プロファイルDは80μW入力まで帯域500MHz以上の高帯域を達成しており、500MHz帯域を維持できる光入射パワーがプロファイルAよりも格段と向上している。量子効率の計算値は、プロファイルCが99.6%、プロファイルDが98.4%であり、いずれも98%以上を確保できている。プロファイルDよりも濃度を上げると、高量子効率が維持できず望ましくない。
上記実施の形態1において、PD部n型拡散層108のドーピングプロファイルを、図6に示すCとDの間で構成することができる。第2の実施の形態では、下限、上限であるプロファイルC、プロファイルDを採用する。これらのプロファイルC及びDの3dB帯域の光入射パワー依存性の計算結果を図3に示す。プロファイルCの10μW入力時3dB帯域は922MHzで、プロファイルDは742MHzである。プロファイルAに対し、それぞれ、1.9倍、1.5倍に向上している。また、プロファイルCは70μWまで、プロファイルDは80μW入力まで帯域500MHz以上の高帯域を達成しており、500MHz帯域を維持できる光入射パワーがプロファイルAよりも格段と向上している。量子効率の計算値は、プロファイルCが99.6%、プロファイルDが98.4%であり、いずれも98%以上を確保できている。プロファイルDよりも濃度を上げると、高量子効率が維持できず望ましくない。
計算の便宜上、PDのn電極として内径84μmφのリング電極を仮定し、中心に5μmφ(スポット径は光強度が1/eとなる径で規定する)の光を入射すると仮定する。この場合、光入射位置とn電極間の抵抗は、プロファイルCの場合1300Ω、プロファイルDの場合300Ωである。プロファイルCよりも濃度を低下させると、抵抗値が上がる上に、図5から判るように高光入力時の帯域が低下するので好ましくない。
プロファイルCは上記式2のc1[cm-3]、プロファイルDは上記式3のc2[cm-3]で表される。この両者の間のドーピングプロファイルであれば、600MHz以上の良好な帯域と、98%以上の良好な効率と、1.4kΩ以下の低い抵抗のすべてを満足し、プロファイルAのように、CとDの範囲内に入っていないプロファイルよりも、格段と向上した良好な性能が得られる。
また、用途に応じて、プロファイルC、Dを使い分けることもできる。再生専用の光ディスク装置においては、低光入力の帯域さえ高ければよいので、プロファイルCを用いればよい。記録用光ディスク装置においては、高光入力オフ後のセトリングタイムを短縮することが望まれるので、高光入力時の帯域が高いDのプロファイルが適している。
以上説明したように、n型エピタキシャル層106の層厚を1.2±0.2μmとした上で、新たに見出した帯域と効率のトレードオフの関係を打破したn型不純物濃度分布を規定することにより、集積するバイポーラトランジスタの耐圧と、600MHz以上のPD帯域と、98%以上の量子効率をすべて満足する歩留まりを十分高くし、低コスト化を実現したPDICを提供することができる。また、入射光パワーが70μWと高くなっても500MHz以上の3dB帯域を実現したPDICを提供することができる。
以上、実施の形態を参照して本願発明を説明したが、本願発明は上記によって限定されるものではない。本願発明の構成や詳細には、発明のスコープ内で当業者が理解し得る様々な変更をすることができる。
この出願は、2008年12月1日に出願された日本出願特願2008-306150を基礎とする優先権を主張し、その開示の全てをここに取り込む。
本発明は、例えば光ピックアップに搭載されるPDICに適用可能である。
101 p型シリコン基板
102 p+型シリコン層
103 p-型エピタキシャル層
104 p型埋込み拡散層
105 n型埋込み拡散層
106 n型エピタキシャル層
107 p型分離拡散層
108 PD部n型拡散層
109 n型拡散層
110 p型ベース拡散層
111 n型エミッタ拡散層
112 誘電体膜
113 電極
102 p+型シリコン層
103 p-型エピタキシャル層
104 p型埋込み拡散層
105 n型埋込み拡散層
106 n型エピタキシャル層
107 p型分離拡散層
108 PD部n型拡散層
109 n型拡散層
110 p型ベース拡散層
111 n型エミッタ拡散層
112 誘電体膜
113 電極
Claims (7)
- トランジスタと、
前記トランジスタとモノリシック集積された受光素子と、を有し、
前記受光素子が、
p型半導体層と、
前記p型半導体層上に形成されたn型エピタキシャル層と、
前記n型エピタキシャル層上に形成されたn型拡散層と、を備え、
前記n型拡散層の深さ方向のn型不純物濃度分布が、二重イオン注入によって形成されたものであり、かつ、
前記p型半導体層と前記n型エピタキシャル層との界面位置が、前記n型拡散層の表面から深さ0.9μm以上1.5μm以下である半導体装置。 - 前記トランジスタがバイポーラトランジスタであることを特徴とする請求項1に記載の半導体装置。
- 前記n型拡散層の表面からの深さx[μm]におけるn型不純物濃度c[cm-3]が、0≦x≦0.8の場合、c1≦c≦c2(ただし、c1、c2[cm-3]は下記の各式で与えられる。)を満足していることを特徴とする請求項1又は2に記載の半導体装置。
c1=6×1017×exp(-x2/(2×0.032))
+6×1016×exp(-(x-0.12)2/(2×0.152))
+1×1015
c2=1×1019×exp(-x2/(2×0.062))
+4×1017×exp(-(x-0.24)2/(2×0.172))
+8×1015 - 前記p型半導体層と前記n型エピタキシャル層との界面位置が、前記n型拡散層の表面から深さ1.0μm以上1.4μm以下であることを特徴とする請求項1~3のいずれか一項に記載の半導体装置。
- トランジスタと受光素子とがモノリシック集積された半導体装置の製造方法であって、
p型半導体層上に厚さ0.9μm以上1.5μm以下のn型エピタキシャル層を形成し、
前記n型エピタキシャル層上であって、前記受光素子の形成領域にn型拡散層を二重イオン注入によって形成する半導体装置の製造方法。 - 前記n型拡散層の表面からの深さx[μm]におけるn型不純物濃度c[cm-3]が、0≦x≦0.8において、c1≦c≦c2(ただし、c1、c2[cm-3]は下記の各式で与えられる)を満足するように前記n型拡散層を形成することを特徴とする請求項5に記載の半導体装置の製造方法。
c1=6×1017×exp(-x2/(2×0.032))
+6×1016×exp(-(x-0.12)2/(2×0.152))
+1×1015
c2=1×1019×exp(-x2/(2×0.062))
+4×1017×exp(-(x-0.24)2/(2×0.172))
+8×1015 - p型半導体層上に厚さ1.0μm以上1.4μm以下のn型エピタキシャル層を形成することを特徴とする請求項5又は6に記載の半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2010541201A JPWO2010064369A1 (ja) | 2008-12-01 | 2009-11-18 | 半導体装置及びその製造方法 |
Applications Claiming Priority (2)
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Publications (1)
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Family
ID=42233028
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JP (1) | JPWO2010064369A1 (ja) |
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Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0897392A (ja) * | 1994-09-21 | 1996-04-12 | Matsushita Electron Corp | Ccd固体撮像装置およびその製造方法 |
JPH1168077A (ja) * | 1997-08-19 | 1999-03-09 | Toshiba Corp | 固体撮像装置及びその製造方法 |
JP2002203954A (ja) * | 2000-10-31 | 2002-07-19 | Sharp Corp | 回路内蔵受光素子 |
JP2004087979A (ja) * | 2002-08-28 | 2004-03-18 | Sharp Corp | 受光素子およびその製造方法並びに回路内蔵型受光素子 |
-
2009
- 2009-11-18 WO PCT/JP2009/006182 patent/WO2010064369A1/ja active Application Filing
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JPH0897392A (ja) * | 1994-09-21 | 1996-04-12 | Matsushita Electron Corp | Ccd固体撮像装置およびその製造方法 |
JPH1168077A (ja) * | 1997-08-19 | 1999-03-09 | Toshiba Corp | 固体撮像装置及びその製造方法 |
JP2002203954A (ja) * | 2000-10-31 | 2002-07-19 | Sharp Corp | 回路内蔵受光素子 |
JP2004087979A (ja) * | 2002-08-28 | 2004-03-18 | Sharp Corp | 受光素子およびその製造方法並びに回路内蔵型受光素子 |
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