TWI688812B - 顯示裝置 - Google Patents

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Abstract

一種顯示裝置，包括第一基底、多個畫素結構、第二基底、多條第一訊號線及多條第二訊號線。多個畫素結構設置於第一基底的第一表面上。每一畫素結構包括開關元件及畫素電極。開關元件具有第一端、第二端和控制端。畫素電極與開關元件的第二端電性連接。第二基底設置於第一基底的第二表面下。多條第一訊號線及多條第二訊號線設置於第二基底上。多個畫素結構的多個開關元件的多個第一端及多個控制端分別與多條第一訊號線及多條第二訊號線電性連接，其中多條第一訊號線與多條第二訊號線實質上平行。

Description

顯示裝置
本發明是有關於一種光電裝置，且特別是有關於一種顯示裝置。
為了滿足消費者追求高品質的觀賞體驗，顯示裝置的屏佔比與日俱增。然而，隨著解析度的提高，設置於顯示區域周圍的線路大幅增加，使顯示區域周圍的空間更顯侷促，嚴重阻礙高屏佔比的實現。另外，在對顯示裝置的多個畫素結構輸入閘極訊號時，因設計傳遞閘極訊號之訊號線的長短不一，造成輸入至顯示面板各處之畫素結構的閘極訊號難以穩定均一。舉例而言，此問題於具有圓形顯示區的顯示裝置(例如：手錶)中尤為明顯，導致輸入於畫素結構的訊號失真，顯示品質降低。
本發明提供一種顯示裝置，具有高屏佔比。
本發明的一實施例的顯示裝置，包括第一基底、多個畫素結構、第二基底、多條第一訊號線以及多條第二訊號線。第一 基底具有相對的第一表面及第二表面。多個畫素結構設置於第一基底，其中多個畫素結構的每一個包括開關元件以及畫素結構。開關元件設置於第一基底的第一表面上且具有第一端、第二端和控制端。畫素結構設置於第一基底的第一表面上，且與開關元件的第二端電性連接。第二基底設置於第一基底的第二表面下。多條第一訊號線以及多條第二訊號線設置於第二基底上，其中多個畫素結構的多個開關元件的多個第一端與多條第一訊號線電性連接，多個畫素結構的多個開關元件的多個控制端與多條第二訊號線電性連接，其中多條第一訊號線與多條第二訊號線實質上平行。
本發明的另一實施例的顯示裝置，包括第一基底、多個畫素結構、第二基底、多條第一訊號線、多條第二訊號線以及至少一閘極驅動電路。第一基底具有相對的第一表面及第二表面。多個畫素結構設置於第一基底，其中多個畫素結構的每一個包括開關元件設置於第一基底的第一表面且具有第一端、第二端和控制端。畫素電極設置於第一基底的第一表面且與開關元件的第二端電性連接。第二基底設置於第一基底的第二表面下。多條第一訊號線設置於第二基底上，且與多個畫素結構的多個開關元件的多個第一端電性連接。多條第二訊號線設置於第二基底上，且與多個畫素結構的多個開關元件的多個控制端電性連接，其中多個第二訊號線包括至少一第二訊號線組。至少一閘極驅動電路設置於第二基底上，位於相鄰的兩條第一訊號線之間，且與至少一第二訊號線組電性連接。
為讓本發明的上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
100A、100B、100C、100D、100E、100F、100G:顯示裝置
110:第一基底
111、112、113:絕緣層
110a、130a:第一表面
110b、130b:第二表面
120:畫素結構
120a:第一畫素結構
120b:第二畫素結構
120G、120G1:畫素結構組
120c1:第一接頭
120c2:第二接頭
120t1:第一貫孔
120t2:第二貫孔
120t3、120t4、120t5:貫孔
122:開關元件
122a、122a1、122a2、122a3:第一端
122b:第二端
122c、122c1、122c2、122c3:控制端
122d:半導體圖案
124:畫素電極
126:顯示介質
128:共用電極
130:第二基底
130i:內部
130e:邊緣
140、140-1、140-2:第一訊號線
140a:弧狀第一訊號線
140c:環狀第一訊號線
150、150-1、150-2、150-3:第二訊號線
150G、150G1、150G2、150G3:第二訊號線組
160:電性連接層
170、170-1、170A、170M、170N:閘極驅動電路
170t:薄膜電晶體
180:第一連接線
190:第二連接線
A-A’、B-B’、C-C’、D-D’:剖線
F:軟性電路板
d1:第一方向
d2:第二方向
L1:第一走線
L2:第二走線
P1:第一接墊
P2:第二接墊
圖1A為本發明的一實施例的顯示裝置的立體***示意圖。
圖1B為本發明的一實施例的顯示裝置的俯視示意圖。
圖1C為本發明的一實施例的顯示裝置的剖面示意圖。
圖2為本發明的另一實施例的顯示裝置的立體***示意圖。
圖3為本發明的又一實施例的顯示裝置的立體***示意圖。
圖4為本發明的再一實施例的顯示裝置的立體***示意圖。
圖5A為本發明的一實施例的顯示裝置的俯視示意圖。
圖5B為本發明的一實施例的顯示裝置的剖面示意圖。
圖6A為本發明的另一實施例的顯示裝置的俯視示意圖。
圖6B為本發明的另一實施例的顯示裝置的剖面示意圖。
圖7為本發明的另一實施例的顯示裝置的俯視示意圖。
在附圖中，為了清楚起見，放大了層、膜、面板、區域等的厚度。在整個說明書中，相同的附圖標記表示相同的元件。應當理解，當諸如層、膜、區域或基板的元件被稱為在另一元件“上”或“連接到”另一元件時，其可以直接在另一元件上或與 另一元件連接，或者中間元件可以也存在。相反，當元件被稱為“直接在另一元件上”或“直接連接到”另一元件時，不存在中間元件。如本文所使用的，“連接”可以指物理及/或電性連接。再者，“電性連接”或“耦合係可為二元件間存在其它元件。
此外，諸如“下”或“底部”和“上”或“頂部”的相對術語可在本文中用於描述一個元件與另一元件的關係，如圖所示。應當理解，相對術語旨在包括除了圖中所示的方位之外的裝置的不同方位。例如，如果一個附圖中的裝置翻轉，則被描述為在其他元件的“下”側的元件將被定向在其他元件的“上”側。因此，示例性術語“下”可以包括“下”和“上”的取向，取決於附圖的特定取向。類似地，如果一個附圖中的裝置翻轉，則被描述為在其它元件“下方”或“下方”的元件將被定向為在其它元件“上方”。因此，示例性術語“下面”或“下面”可以包括上方和下方的取向。
本文使用的“約”、“近似”、或“實質上”包括所述值和在本領域普通技術人員確定的特定值的可接受的偏差範圍內的平均值，考慮到所討論的測量和與測量相關的誤差的特定數量(即，測量系統的限制)。例如，“約”可以表示在所述值的一個或多個標準偏差內，或±30%、±20%、±10%、±5%內。再者，本文使用的“約”、“近似”或“實質上”可依光學性質、蝕刻性質或其它性質，來選擇較可接受的偏差範圍或標準偏差，而可不用一個標準偏差適用全部性質。
本文參考作為理想化實施例的示意圖的截面圖來描述示例性實施例。因此，可以預期到作為例如製造技術及/或公差的結果的圖示的形狀變化。因此，本文所述的實施例不應被解釋為限於如本文所示的區域的特定形狀，而是包括例如由製造導致的形狀偏差。例如，示出或描述為平坦的區域通常可以具有粗糙及/或非線性特徵。此外，所示的銳角可以是圓的。因此，圖中所示的區域本質上是示意性的，並且它們的形狀不是旨在示出區域的精確形狀，並且不是旨在限制權利要求的範圍。
現將詳細地參考本發明的示範性實施例，示範性實施例的實例說明於圖式中。只要有可能，相同元件符號在圖式和描述中用來表示相同或相似部分。
圖1A為本發明的一實施例的顯示裝置的立體***示意圖。圖1B為本發明的一實施例的顯示裝置的俯視示意圖。為清楚表達起見，圖1A及圖1B繪出部分畫素結構120的開關元件122，而省略其餘畫素結構120的開關元件122；圖1A及圖1B省略圖1C的電性連接層160、絕緣層111、絕緣層112、絕緣層113、畫素電極124、顯示介質126及共用電極128的繪示。圖1C為本發明的一實施例的顯示裝置的剖面示意圖。圖1C對應圖1B的顯示裝置100A的剖線A-A’及剖線B-B’。
請參見圖1A至1C，在本實施例中，顯示裝置100A包括第一基底110、多個畫素結構120及第二基底130。第一基底110具有相對的第一表面110a及第二表面110b。多個畫素結構120設 置於第一基底110。多個畫素結構120的每一個包括開關元件122及畫素電極124。開關元件122設置於第一基底110的第一表面110a上，且具有第一端122a、第二端122b和控制端122c。畫素電極124設置於第一基底110的第一表面110a上，且與開關元件122的第二端122b電性連接。舉例而言，在本實施例中，示意性地以六邊形代表畫素結構120的發光區，但本發明不限於此，根據其它實施例，畫素結構120的發光區也可以是其它形狀。
在本實施例中，開關元件122例如但不限於薄膜電晶體(Thin-film transistor,TFT)。開關元件122的第一端122a、第二端122b及控制端122c可分別為薄膜電晶體的源極(Source)、汲極(drain)及閘極(Gate)，但本發明不加以限制。在本實施例中，多個畫素結構120的每一個開關元件122還包括半導體圖案122d(繪於圖1C)。舉例而言，開關元件122的第一端122a及第二端122b可分別透過多個絕緣層111、112的多個貫孔120t3、120t4與半導體圖案122d的不同兩區電性連接。在本實施例中，多個畫素結構120的每一個更包括顯示介質126以及共用電極128，畫素電極124透過貫孔120t5與開關元件122的第二端122b電性連接，且畫素電極124與共用電極128之間的電位差用以驅動顯示介質126。在本實施例中，顯示介質126例如是有機發光二極體(Organic light-emitting diode,OLED)。然而，本發明不限於此，在另一實施中，顯示介質126也可以是液晶(Liquid crystal)、微型發光二極體(μLED)或其它適當材料。
第二基底130設置於第一基底110的第二表面110b下。多條第一訊號線140及多條第二訊號線150設置於第二基底130上。多個畫素結構120的多個開關元件122的多個第一端122a與多條第一訊號線140電性連接，多個畫素結構120的多個開關元件122的多個控制端122c與多條第二訊號線150電性連接，其中多條第一訊號線140與多條第二訊號線150實質上平行。也就是說，多條第一訊號線140與多條第二訊號線150不交錯。舉例而言，在本實施例中，一條第一訊號線140可以是環狀線段(例如：環狀第一訊號線140c)或第一弧線段(例如：弧狀第一訊號線140a)，而至少一條第二訊號線150可以是平行於所述環狀線段之一部分的第二弧線段或平行於所述第一弧線段的第二弧線段，但本發明不以此為限。
此外，需說明的是，第一訊號線140的型態及/或第二訊號線150的型態不限於弧線段或直線段；在其它實施例中，第一訊號線140及/或第二訊號線150也可以是其它型態的線段，例如但不限於：折線。
再者，本發明也不限制第一訊號線140的型態及/或第二訊號線150的型態必須完全相同；舉例而言，在一實施例中，一條第一訊號線140可以是在一個第一弧線方向上延伸的一個弧線段，而一條第二訊號線150可以是配置在一個第二弧線方向上的一個折線段，其中所述第一弧線方向與所述第二弧線方向實質上平行；在一實施例中，一條第一訊號線140可以是配置在一個第 一弧線方向上的一個折線段，而一條第二訊號線150可以是在一個第二弧線方向上延伸的一個弧線段，其中所述第一弧線方向與所述第二弧線方向實質上平行；在一實施例中，一條第一訊號線140可以是配置在一個第一弧線方向上的一個折線段，而一條第二訊號線150可以是配置在一個第二弧線方向上的另一個折線段，其中所述第一弧線方向與所述第二弧線方向實質上平行；在一實施例中，一條第一訊號線140可以是在一個第一直線方向上延伸的一個直線段，而一條第二訊號線150可以是配置在一個第二直線方向上的一個折線段，其中所述第一直線方向與所述第二直線方向實質上平行；在一實施例中，一條第一訊號線140可以是配置在一個第一直線方向上的一個折線段，而一條第二訊號線150可以是配置在一個第二直線方向上的一個折線段，其中所述第一直線方向與所述第二直線方向實質上平行；在一實施例中，一條第一訊號線140可以是配置在一個第一直線方向上的一個折線段，而一條第二訊號線150可以是在一個第二直線方向上延伸的一個折線段，其中所述第一直線方向與所述第二直線方向實質上平行。
請參見圖1C，在本實施例中，多個畫素結構120的每一個可包括第一接頭120c1及第二接頭120c2。第一基底110具有由第一基底110之第一表面110a延伸至第一基底110之第二表面110b的第一貫孔120t1，第一接頭120c1設置於第一貫孔120t1且與開關元件122的第一端122a電性連接。第一基底110具有由第 一基底110之第一表面110a延伸至第一基底110之第二表面110b的第二貫孔120t2，第二接頭120c2設置於第二貫孔120t2且與開關元件122的控制端122c電性連接。在本實施例中，多個畫素結構120的多個開關元件122的多個第一端122a透過多個畫素結構120的多個第一接頭120c1與多個第一訊號線140電性連接。多個畫素結構120的多個開關元件122的多個控制端122c透過多個畫素結構120的多個第二接頭120c2與多條第二訊號線150電性連接。
舉例而言，在本實施例中，顯示裝置100A可選擇性地包括電性連接層160(繪於圖1C)，設置於第一基底110之第二表面110b與第二基底130之間，其中多個畫素結構120的多個第一接頭120c1及多個第二接頭120c2可透過電性連接層160與多條第一訊號線140及多條第二訊號線150電性連接。在本實施例中，電性連接層160例如是異方性導電膠(Anisotropic conductive adhesive)。然而，本發明不限於此，根據其它實施例，電性連接層160也可以是焊接層或其它適當構件。
在本實施例中，位於第二基底130之第一訊號線140所具有資料訊號(未標示)可依序透過電性連接層160及第一接頭120c1傳遞至位於第一基底110的開關元件122的第一端122a。類似地，位於第二基底130之第二訊號線150所具有的閘極訊號(未標示)可依序透過電性連接層160及第二接頭120c2傳遞至位於第一基底110的開關元件122的控制端122c。
值得一提的是，顯示裝置100A將多個畫素結構120設置於第一基底110，而將用以與多個畫素結構120電性連接的第一訊號線140及第二訊號線150設置於第二基底130。藉此，第一訊號線140及第二訊號線150便無需設置於第一基底110的周邊區，第一基底110的大部分面積可用以設置多個畫素結構120，進而達成高屏佔比。
請參見圖1A及圖1B，在本實施例中，多條第二訊號線150包括至少一第二訊號線組150G，設置於多條第一訊號線140的相鄰兩條第一訊號線140之間。在本實施例中，顯示裝置100A更包括至少一閘極驅動電路170，設置於第二基底130上，位於所述相鄰兩條第一訊號線140之間，且與至少一第二訊號線組150G電性連接。請參見圖1B，舉例而言，在本實施例中，第二訊號線組150G1例如但不限於包括第二訊號線150-1、150-2、150-3，設置於相鄰的第一訊號線140-1及第一訊號線140-2之間。閘極驅動電路170-1位於相鄰的第一訊號線140-1及第一訊號線140-2之間，且與第二訊號線組150G1電性連接。在本實施例中，一個第二訊號線組150G之多條第二訊號線150的數量可依實際情況選擇性地增加或減少，一個第二訊號線組150G之多條第二訊號線150的數量不限於發明圖示所繪。此外，需說明的是，本實施例僅示例性地繪示出位於相鄰的兩條第一訊號線140之間的閘極驅動電路170之數量為一個。然而，本發明具有通常知識者應理解本實施例之位於相鄰的兩條第一訊號線140之間的閘極驅動電路170 之數量可依實際情況選擇性地為一個或多個。在本實施例中，閘極驅動電路170例如但不限於為移位暫存器(Shift register)。在本實施例中，多個閘極驅動電路170的每一者可包括薄膜電晶體170t，用以控制閘極訊號於不同時序輸出。
請參見圖1B，在本實施例中，多個畫素結構120包括至少一畫素結構組120G。至少一畫素結構組120G於第二基底130上的垂直投影位於相鄰的兩條第一訊號線140於第二基底130上的多個垂直投影之間。在本實施例中，至少一畫素結構組120G之多個畫素結構120的多個第一端122a電性連接至相鄰的兩條第一訊號線140的其中一者，而至少一畫素結構組120G之多個畫素結構120的多個控制端122c分別與至少一第二訊號線組150G的多條第二訊號線150電性連接。藉此，同一畫素結構組120G之多個畫素結構120能獨立地被控制。
舉例而言，請參見圖1B，在本實施例中，畫素結構組120G1例如但不限於包括畫素結構120-1、120-2、120-3，畫素結構組120G1於第二基底130上的垂直投影位於相鄰的第一訊號線140-1及第一訊號線140-2於第二基底130上的多個垂直投影之間。畫素結構組120G1之畫素結構120-1、120-2、120-3分別具有第一端122a1、122a2、122a3，其中畫素結構120-1、120-2、120-3的第一端122a1、122a2、122a3皆電性連接至第一訊號線140-1。畫素結構組120G1之畫素結構120-1、120-2、120-3分別具有控制端122c1、122c2、122c3，其中控制端122c1、122c2、122c3分別 與第二訊號線組150G1的第二訊號線150-1、150-2、150-3電性連接。一個閘極驅動電路170透過多個第二訊號線組150G的多條第二訊號線150電性連接至一個畫素結構組120G的多個畫素結構120的多個控制端120c。此外，需說明的是，本實施例僅示例性地繪示出位於相鄰的兩條第一訊號線140之間的第二訊號線組150G之數量為一個。然而，本發明具有通常知識者應理解本實施例位於相鄰的兩條第一訊號線140之間的第二訊號線組150G之數量可依實際情況選擇性地為一個或多個。
值得一提的是，在本實施例中，至少一閘極驅動電路170設置於第二基底130，且至少一閘極驅動電路170位於相鄰的兩條第一訊號線140之間。藉此，至少一閘極驅動電路170能分別透過長度差異不大的多條第二訊號線150與多個畫素結構120的多個控制端122c電性連接。也就是說，分別與多個畫素結構120電性連接的多條第二訊號線150的多個阻抗的差異不大。如此一來，輸入至位於顯示裝置100A各處之畫素結構120的多個閘極訊號易維持穩定且均一，而有助於提升顯示裝置100A的性能。
在本實施例中，多個畫素結構120包括第一畫素結構120a以及環繞第一畫素結構120a的多個第二畫素結構120b，多個第二畫素結構120b與環狀第一訊號線140c電性連接。在本實施例中，顯示裝置100A更包括第一連接線180，設置於第二基底130上。第一連接線180與環狀第一訊號線140c交錯設置且彼此電性連接，其中第一畫素結構120a的第一端122a與第一連接線180電 性連接。藉此，被多個第二畫素結構120b環繞之第一畫素結構120a的第一端122a可透過第一連接線180電性連接至環狀第一訊號線140c。
在本實施例中，顯示裝置100A更包括第二連接線190，設置於第二基底130上。第二連接線190與多條第二訊號線150的一者交錯設置且彼此電性連接，其中第一畫素結構120a的控制端122c與第二連接線190電性連接。藉此，被多個第二畫素結構120b環繞之第一畫素結構120a的控制端122c可透過第二連接線190及一條第二訊號線150電性連接至閘極驅動電路170。在本實施例中，第二連接線190可跨越第一訊號線140，而第二連接線190與第一訊號線140可分別形成於不同的兩膜層，所述兩膜層之間可設有絕緣層(未繪示)。
在本實施例中，多條第一訊號線140在第一方向d1(例如但不限於：順時針或逆時針方向)上延伸，多條第一訊號線140與多條第二訊號線組150G在第二方向d2(例如但不限於：徑向方向)上交替排列，第二方向d2與第一方向d1交錯且由第二基底130的內部130i指向第二基底130的邊緣130e。在本實施例中，多條第一訊號線140包括環狀第一訊號線140c以及多條弧狀第一訊號線140a，弧狀第一訊號線140a彼此分離且設置於環狀第一訊號線140c與第二基底130的邊緣130e之間。也就是說，若顯示裝置100A具有圓形的顯示區，弧狀第一訊號線140a為設置於圓形顯示區周邊的第一訊號線140，而環狀第一訊號線140c為設置 於圓形顯示區內部的第一訊號線140。在本實施例中，靠近第二基底130之邊緣130e的一條弧狀第一訊號線140a的長度與遠離第二基底130之邊緣130e的一條環狀第一訊號線140c的長度可實質上相同或相近；亦即，一條弧狀第一訊號線140a的阻抗與一條環狀第一訊號線140c的阻抗可實質上相同或相近，而有助於顯示裝置100A的性能提升。
圖2為本發明的另一實施例的顯示裝置的立體***示意圖。圖2繪出部分畫素結構120的開關元件122為示例，而省略其餘畫素結構120的開關元件122。請參見圖1A及圖2，本實施例的顯示裝置100B與圖1A的顯示裝置100A類似，以下就顯示裝置100B與顯示裝置100A的差異加以說明，便不再重述顯示裝置100B與顯示裝置100A相同或相似處。在本實施例中，第一連接線180可跨越至少一條第二訊號線150，而第一連接線180與第二訊號線150分別形成於不同的兩膜層；第二連接線190可跨越第一訊號線140，而第二連接線190與第一訊號線140分別形成於不同的兩膜層。
圖3為本發明的又一實施例的顯示裝置的立體***示意圖。圖3繪出部分畫素結構120的開關元件122為示例，而省略其餘畫素結構120的開關元件122。請參見圖1A及圖3，本實施例的顯示裝置100C與圖1A的顯示裝置100A類似，以下就圖3的顯示裝置100C與圖1A的顯示裝置100A的差異處加以說明，便不再重述顯示裝置100C與顯示裝置100A相同或相似處。在本 實施例中，顯示裝置100C的第二基底130上可不具有弧狀第一訊號線。顯示裝置100C的第二基底130上的多條第一訊號線140可選擇性為同心設置的多條環狀第一訊號線140c。
圖4為本發明的再一實施例的顯示裝置的立體***示意圖。請參見圖2及圖4，本實施例的顯示裝置100D與圖2的顯示裝置100B類似，以下就圖4的顯示裝置100D與圖2的顯示裝置100B的差異處加以說明，便不再重述顯示裝置100D與顯示裝置100B相同或相似處。在本實施例中，顯示裝置100D的第二基底130上不可具有弧狀第一訊號線。顯示裝置100D的第二基底130上的多條第一訊號線140可選擇性地為同心設置的多條環狀第一訊號線140c。
圖5A為本發明的一實施例的顯示裝置的俯視示意圖。圖5B為本發明的一實施例的顯示裝置的剖面示意圖。圖5B對應圖5A的剖線C-C’。
請參見圖1B及圖5A，本實施例的顯示裝置100E與圖1B的顯示裝置100A類似，以下就圖5A的顯示裝置100D與圖1B的顯示裝置100A的差異處加以說明，便不再重述顯示裝置100E與顯示裝置100A相同或相似處。在本實施例中，多條第一訊號線140在第一方向d1上延伸，第二方向d2與第一方向d1交錯且由第二基底130的內部130i指向第二基底130的邊緣130e，多條第二訊號線150包括沿第二方向d2依序排列的第1~N個第二訊號線組150G1、150G2、150G3，N為大於或等於2的正整數，多條 第一訊號線140與第1~N個第二訊號線組150G1、150G2、150G3在第二方向d2上交替排列。顯示裝置100E更包括第1~N個閘極驅動電路170A、170M、170N，分別與第1~N個第二訊號線組150G1、150G2、150G3電性連接。特別是，第N個閘極驅動電路170的尺寸大於第1個閘極驅動電路170的尺寸。舉例而言，N=2時，與第二個第二訊號線組150G2電性連接的第二個閘極驅動電路170M的尺寸大於與第一個第二訊號線組150G1電性連接的第一個閘極驅動電路170A的尺寸；N=3時，與第三個第二訊號線組150G3電性連接的第三個閘極驅動電路170N的尺寸大於與第一個第二訊號線組150G1電性連接的第一個閘極驅動電路170A的尺寸。在本實施例中，較佳的是，第N個閘極驅動電路170的尺寸大於第(N-1)個閘極驅動電路170的尺寸。舉例而言，與第三個第二訊號線組150G3電性連接的第三個閘極驅動電路170N的尺寸大於與第二個第二訊號線組150G2電性連接的第二個閘極驅動電路170M的尺寸，與第二個第二訊號線組150G2電性連接的第二個閘極驅動電路170M的尺寸大於與第1個第二訊號線組150G1電性連接的第一個閘極驅動電路170A的尺寸。
尺寸越大之閘極驅動電路170的驅動能力越強，而能透過更多條的第二訊號線150驅動更多個畫素結構120。舉例而言，多個閘極驅動電路170A、170M、170N的每一個包括至少一薄膜電晶體170t，第N個閘極驅動電路170之薄膜電晶體170t的尺寸大於第一個閘極驅動電路170之薄膜電晶體170t的尺寸，其中薄 膜電晶體170t的尺寸例如是指薄膜電晶體170t的半導體圖案122d的面積，但本發明不以此為限。具體而言，N=2時，與第二個第二訊號線組150G2電性連接的第二個閘極驅動電路170M的薄膜電晶體170t的尺寸大於與第一個第二訊號線組150G1電性連接的第一個閘極驅動電路170A的薄膜電晶體170t尺寸；N=3時，與第三個第二訊號線組150G3電性連接的第三個閘極驅動電路170N的薄膜電晶體170t的尺寸大於與第1個第二訊號線組150G1電性連接的第一個閘極驅動電路170A的薄膜電晶體170t的尺寸。在本實施例中，較佳的是，第N個閘極驅動電路170的薄膜電晶體170t的尺寸大於第(N-1)個閘極驅動電路170的薄膜電晶體170t的尺寸。舉例而言，與第三個第二訊號線組150G3電性連接的第三個閘極驅動電路170N的薄膜電晶體170t的尺寸大於與第二個第二訊號線組150G2電性連接的第二個閘極驅動電路170M的薄膜電晶體170t的尺寸，與第二個第二訊號線組150G2電性連接的第二個閘極驅動電路170M的薄膜電晶體170t的尺寸大於與第一個第二訊號線組150G1電性連接的第一個閘極驅動電路170A的薄膜電晶體170t的尺寸。
在本實施例中，與第N個閘極驅動電路170N電性連接的多個第二訊號線組150G之一者所包括的多條第二訊號線150的數量大於與第一個閘極驅動電路170A電性連接的多個第二訊號線組150G之另一者所包括的多條第二訊號線150的數量。舉例而言，與第二個閘極驅動電路170M電性連接的第二訊號線組150G2 所包括的多條第二訊號線150的數量(例如但不限於：4)大於與第一個閘極驅動電路170A電性連接的第二訊號線組150G1所包括的多條第二訊號線150的數量(例如但不限於：3)；與第三個閘極驅動電路170N電性連接的第二訊號線組150G3所包括的多條第二訊號線150的數量(例如但不限於：5)大於與第一個閘極驅動電路170A電性連接的第二訊號線組150G1所包括的多條第二訊號線150的數量(例如但不限於：3)。在本實施例中，較佳的是，與第N個閘極驅動電路170M電性連接的多個第二訊號線組150G之一者所包括的多條第二訊號線150的數量大於與第N-1個閘極驅動電路170電性連接的多個第二訊號線組150G之另一者所包括的多條第二訊號線150的數量。舉例而言，與第三個閘極驅動電路170N電性連接的第二訊號線組150G3所包括的多條第二訊號線150的數量(例如但不限於：5)大於與第二個閘極驅動電路170M電性連接的第二訊號線組150G2所包括的多條第二訊號線150的數量(例如但不限於：4)；與第二個閘極驅動電路170M電性連接的第二訊號線組150G2所包括的多條第二訊號線150的數量(例如但不限於：4)大於與第一個閘極驅動電路170A電性連接的第二訊號線組150G1所包括的多條第二訊號線150的數量(例如但不限於：3)。
在本實施例中，顯示裝置100E還包括多條第一走線L1、第二走線L2、多個第一接墊P1以及多個第二接墊P2。多條第一走線L1設置於第二基底130上，與多條第一訊號線140交錯設置 且分別與多條第一訊號線140電性連接。多條第二走線L2設置於第二基底130上，且分別與多個閘極驅動電路170電性連接。多個第一接墊P1設置於於第二基底130上，且分別與多條第一走線L1電性連接。多個第二接墊P2設置於於第二基底130上，且分別與多條第二走線L2電性連接。多個第一接墊P1以及多個第二接墊P2用以與外部軟性電路板F接合。外部軟性電路板F例如但不限於是薄膜覆晶封裝(Chip on film,COF)。
第二基底130具有面向第一基底110的第一表面130a及背向第一基底110的第二表面130b。在本實施例中，多條第一走線L1、多條第二走線L2、多個第一接墊P1及多個第二接墊P2可設置於第二基底130的第一表面130a或第二基底130的第二表面130b。舉例而言，多條第一走線L1、多條第二走線L2、多個第一接墊P1及多個第二接墊P2可設置於第二基底130的第一表面130a上。也就是說，在本實施例中，多條第一走線L1、多條第二走線L2、多個第一接墊P1及多個第二接墊P2可以選擇性地設置於第二基底130的同一表面，但本發明不以此為限。
圖6A為本發明的另一實施例的顯示裝置的俯視示意圖。圖6B為本發明的另一實施例的顯示裝置的剖面示意圖。圖6B對應圖6A的剖線D-D’。請參見圖5A及圖6A，本實施例的顯示裝置100F與圖5A的顯示裝置100E類似，其差別在於：多條第一走線L1、多條第二走線L2可設置於第二基底130的第二表面130b，而多個第一接墊P1及多個第二接墊P2可分別設置於第 二基底130的第一表面130a上。也就是說，在本實施例中，多條第一走線L1及多條第二走線L2與多個第一接墊P1及多個第二接墊P2可以選擇性地分別設置於第二基底130相對兩表面。
圖7為本發明的另一實施例的顯示裝置的俯視示意圖。請參見圖7，本實施例的顯示裝置100G與圖5A的顯示裝置100E類似，以下就顯示裝置100G與顯示裝置100E的差異加以說明。請參見圖7，與前述至少一實施例類似，相鄰的兩條第一訊號線140在第一方向d1上延伸，而位於相鄰的兩條第一訊號線140之間的多個閘極驅動電路170沿第一方向d1依序排列。位於相鄰的兩條第一訊號線140之間的多個閘極驅動電路170以及多個第二訊號線組150G在第一方向d1上交替排列。與前述實施例不同的是，在本實施例中，顯示裝置100G的第一基底110與第二基底130可以是矩形基底，並示例性地以矩形代表畫素結構120的發光區。本實施例的顯示裝置100G與圖5A的顯示裝置100E的差異在於，本實施例的顯示裝置100G具有矩形的顯示區，而圖5A的顯示裝置100E具有異形(free-form)，例如但不限於：圓形，的顯示區。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
100A:顯示裝置
110:第一基底
110a:第一表面
110b:第二表面
120:畫素結構
120a:第一畫素結構
120b:第二畫素結構
130:第二基底
130i:內部
130e:邊緣
140:第一訊號線
140a:弧狀第一訊號線
140c:環狀第一訊號線
150:第二訊號線
150G:第二訊號線組
170:閘極驅動電路
170t:薄膜電晶體
180:第一連接線
190:第二連接線
d1:第一方向
d2:第二方向

Claims (20)

  1. 一種顯示裝置，包括：一第一基底，具有相對的一第一表面及一第二表面；多個畫素結構，設置於該第一基底，其中該些畫素結構的每一個包括：一開關元件，設置於該第一基底的該第一表面，且具有一第一端、一第二端和一控制端；一畫素電極，設置於該第一基底的該第一表面，且與該開關元件的該第二端電性連接；以及一顯示介質，設置於該畫素電極上；一第二基底，設置於該第一基底的該第二表面下；一電性連接層，設置於該第一基底與該第二基底之間；多條第一訊號線以及多條第二訊號線，設置於該第二基底上，其中該些畫素結構的多個開關元件的多個第一端透過該電性連接層與該些第一訊號線電性連接，該些畫素結構的該些開關元件的多個控制端透過該電性連接層與該些第二訊號線電性連接，其中該些第一訊號線與該些第二訊號線實質上平行。
  2. 如申請專利範圍第1項所述的顯示裝置，其中該些第二訊號線包括至少一第二訊號線組，設置於該些第一訊號線之相鄰的兩條第一訊號線之間，而該顯示裝置更包括： 至少一閘極驅動電路，設置於該第二基底上，位於相鄰的該兩條第一訊號線之間，且與該至少一第二訊號線組電性連接。
  3. 如申請專利範圍第2項所述的顯示裝置，其中該些畫素結構包括至少一畫素結構組，該至少一畫素結構組於該第二基底上的垂直投影位於相鄰的該兩條第一訊號線於該第二基底上的多個垂直投影之間；該至少一畫素結構組之多個畫素結構的多個第一端電性連接至相鄰的該兩條第一訊號線的其中一者，而該至少一畫素結構組之該些畫素結構的多個控制端分別與該至少一第二訊號線組的多條第二訊號線電性連接。
  4. 如申請專利範圍第3項所述的顯示裝置，其中該至少一第二訊號線組為多個第二訊號線組，該至少一閘極驅動電路為多個閘極驅動電路；該些第二訊號線組分別與該些閘極驅動電路電性連接，相鄰的該兩條第一訊號線在一第一方向上延伸，而該些閘極驅動電路沿該第一方向依序排列。
  5. 如申請專利範圍第4項所述的顯示裝置，其中該些閘極驅動電路與該些第二訊號線組在該第一方向上交替排列。
  6. 如申請專利範圍第1項所述的顯示裝置，其中該些第一訊號線在一第一方向上延伸，一第二方向與該第一方向交錯且由該第二基底的一內部指向該第二基底的一邊緣，該些第二訊號線包括沿該第二方向依序排列的第1~N個第二訊號線組，N為大於或等於2的正整數，該些第一訊號線與該第1~N個第二訊號線組 在該第二方向上交替排列，而該顯示裝置更包括：第1~N個閘極驅動電路，分別與該第1~N個第二訊號線組電性連接，其中該第N個閘極驅動電路的尺寸大於第1個閘極驅動電路的尺寸。
  7. 如申請專利範圍第6項所述的顯示裝置，其中與該第N個閘極驅動電路電性連接的該些第二訊號線組之一者所包括的多條第二訊號線的數量大於與該第1個閘極驅動電路電性連接的該些第二訊號線組之另一者所包括的多條第二訊號線的數量。
  8. 如申請專利範圍第6項所述的顯示裝置，其中該些閘極驅動電路的每一個包括一薄膜電晶體，該第N個閘極驅動電路之一薄膜電晶體的尺寸大於第1個閘極驅動電路之一薄膜電晶體的尺寸。
  9. 如申請專利範圍第1項所述的顯示裝置，其中該些第一訊號線包括一環狀第一訊號線以及多條弧狀第一訊號線，該些弧狀第一訊號線彼此分離且設置於該環狀第一訊號線與該第二基底的一邊緣之間。
  10. 如申請專利範圍第1項所述的顯示裝置，其中該些第一訊號線包括一環狀第一訊號線，該些畫素結構包括一第一畫素結構以及環繞該第一畫素結構的多個第二畫素結構，該些第二畫素結構與該環狀第一訊號線電性連接，而該顯示裝置更包括： 一第一連接線，設置於該第二基底上，與該環狀第一訊號線交錯設置且彼此電性連接，其中該第一畫素結構的一第一端與該第一連接線電性連接。
  11. 如申請專利範圍第10項所述的顯示裝置，其中該些第二訊號線與該些第二畫素結構的多個控制端電性連接，而該第一連接線跨過該些第二訊號線。
  12. 如申請專利範圍第10項所述的顯示裝置，更包括：一第二連接線，設置於該第二基底上，與該些第二訊號線的一者交錯設置且彼此電性連接，其中該第一畫素結構的一控制端與該第二連接線電性連接。
  13. 一種顯示裝置，包括：一第一基底，具有相對的一第一表面及一第二表面；多個畫素結構，設置於該第一基底，其中該些畫素結構的每一個包括：一開關元件，設置於該第一基底的該第一表面，且具有一第一端、一第二端和一控制端；一畫素電極，設置於該第一基底的該第一表面，且與該開關元件的該第二端電性連接；以及一顯示介質，設置於該畫素電極上；一第二基底，設置於該第一基底的該第二表面下；一電性連接層，設置於該第一基底與該第二基底之間； 多條第一訊號線，設置於該第二基底上，且透過該電性連接層與該些畫素結構的多個開關元件的多個第一端電性連接；多條第二訊號線，設置於該第二基底上，且透過該電性連接層與該些畫素結構的該些開關元件的多個控制端電性連接，其中該些第二訊號線包括至少一第二訊號線組；以及至少一閘極驅動電路，設置於該第二基底上，位於相鄰的該兩條第一訊號線之間，且與該至少一第二訊號線組電性連接。
  14. 如申請專利範圍第13項所述的顯示裝置，其中該些畫素結構包括至少一畫素結構組，該至少一畫素結構組於該第二基底上的垂直投影位於相鄰的該兩條第一訊號線於該第二基底上的多個垂直投影之間；該至少一畫素結構組之多個畫素結構的多個第一端電性連接至相鄰的該兩條第一訊號線的其中一者，而該至少一畫素結構組之該些畫素結構的多個控制端分別與該至少一第二訊號線組的多條第二訊號線電性連接。
  15. 如申請專利範圍第14項所述的顯示裝置，其中該至少一第二訊號線組為多個第二訊號線組，該至少一閘極驅動電路為多個閘極驅動電路；該些第二訊號線組分別與該些閘極驅動電路電性連接，相鄰的該兩條第一訊號線在一第一方向上延伸，而該些閘極驅動電路沿該第一方向依序排列。
  16. 如申請專利範圍第15項所述的顯示裝置，其中該些閘極驅動電路與該些第二訊號線組在該第一方向上交替排列。
  17. 如申請專利範圍第13項所述的顯示裝置，其中該些第一訊號線在一第一方向上延伸，一第二方向與該第一方向交錯且由該第二基底的一內部指向該第二基底的一邊緣，該些第二訊號線包括沿該第二方向依序排列的第1~N個第二訊號線組，N為大於或等於2的正整數，該些第一訊號線與該第1~N個第二訊號線組在該第二方向上交替排列，而該至少一閘極驅動電路包括：第1~N個閘極驅動電路，分別與該第1~N個第二訊號線組電性連接，其中該第N個閘極驅動電路的尺寸大於第1個閘極驅動電路的尺寸。
  18. 如申請專利範圍第17項所述的顯示裝置，其中與該第N個閘極驅動電路電性連接的該些第二訊號線組之一者所包括的多條第二訊號線的數量大於與該第1個閘極驅動電路電性連接的該些第二訊號線組之另一者所包括的多條第二訊號線的數量。
  19. 如申請專利範圍第17項所述的顯示裝置，其中該些閘極驅動電路的每一個包括一薄膜電晶體，該第N個閘極驅動電路之一薄膜電晶體的尺寸大於第1個閘極驅動電路之一薄膜電晶體的尺寸。
  20. 如申請專利範圍第13項所述的顯示裝置，其中該些第一訊號線包括一環狀第一訊號線以及多條弧狀第一訊號線，該些弧狀第一訊號線彼此分離且設置於該環狀第一訊號線與該第二基底的一邊緣之間。
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