TWI636446B - 顯示面板 - Google Patents
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Abstract
一種顯示面板,包括基板、開口、第一閘極驅動電路、第二閘極驅動電路、多個第一閘極線、多個第二閘極線及多個第三閘極線。基板具有顯示區、第一週邊區及第二週邊區。開口位於顯示區。第一閘極驅動電路位於第一週邊區。第二閘極驅動電路位於第二週邊區。第一閘極線位於開口與第一閘極驅動電路之間。第二閘極線位於開口與第二閘極驅動電路之間。第三閘極線位於第一閘極驅動電路與第二閘極驅動電路之間。
Description
本發明是有關於一種顯示面板,且特別是有關於一種具有開口的顯示面板。
在現在,智慧型手機螢幕越來越大,並且在不增加手機體積的前提之外,多手機大廠都採用窄邊框或超窄邊框的高解析度顯示面板,以提高顯示部分佔比,進而使顯示部份加大,其中顯示佔比整體上至少超過80%以上,儼然已成為手機標準配備的主流趨勢。然而,受限於手機上的聲光元件(如鏡頭、揚聲器等),限制了矩形的顯示面板的可佔比。於是,具有開口的顯示面板被開發,以進一步提高顯示面板的可佔比。然而,由於開口部分無法配置線路,因此具有開口的顯示面板需要一種新的佈局方式,以使顯示面板上畫素可以正常驅動。
本發明提供一種顯示面板,可使開口附近的畫素不會被擠壓,進而避免影響了這些畫素的顯示效果。
本發明的顯示面板,包括基板、開口、第一閘極驅動電路、第二閘極驅動電路、多個第一閘極線、多個第二閘極線及多個第三閘極線。基板具有顯示區、第一週邊區及第二週邊區,其中第一週邊區位於顯示區的第一側,第二週邊區位於顯示區相對於第一側的第二側。開口位於顯示區。第一閘極驅動電路位於第一週邊區。第二閘極驅動電路位於第二週邊區。第一閘極線位於開口與第一閘極驅動電路之間,與第一閘極驅動電路電性連接,且與第二閘極驅動電路電性絕緣。第二閘極線位於開口與第二閘極驅動電路之間,與第二閘極驅動電路電性連接,且與第一閘極驅動電路電性絕緣。第三閘極線位於第一閘極驅動電路與第二閘極驅動電路之間,各個第三閘極線與第一閘極驅動電路及第二閘極驅動電路的至少其一電性連接。
基於上述,本發明實施例的顯示面板,第一閘極線及第二閘極線分別電性連接至第一閘極電路及第二閘極電路,因此不需要額外的走線(或導線),亦即不會擠壓開口附近的畫素,進而避免影響了畫素的顯示效果。
為讓本發明的上述特徵和優點能更明顯易懂,下文特舉實施例,並配合所附圖式作詳細說明如下。
100、200、300、400‧‧‧顯示面板
101‧‧‧基板
AA‧‧‧顯示區
F11~F16、F21~F26‧‧‧扇出線
GD1、GD1a‧‧‧第一閘極驅動電路
GD2、GD2a‧‧‧第二閘極驅動電路
LG11~LG13、LG11a~LG13a、LG11b~LG13b‧‧‧第一閘極線
LG21~LG23、LG21a~LG23a、LG21b~LG23b‧‧‧第二閘極線
LG31~LG36、LG31a、LG32a‧‧‧第三閘極線
OP1、OP2、OP3‧‧‧開口
PH1‧‧‧第一週邊區
PH2‧‧‧第二週邊區
PX‧‧‧畫素
S1‧‧‧第一側
S2‧‧‧第二側
S3‧‧‧第三側
LSR1~LSR6、RSR1~RSR6、LSR1a~LSR9a、RSR1a~RSR9a‧‧‧位移暫存器
圖1為依據本發明第一實施例的顯示面板的系統示意圖。
圖2A至圖2D分別為依據本發明的第一實施例的顯示面板的驅動波形示意圖。
圖3為依據本發明第一實施例的顯示面板的系統示意圖。
圖4為依據本發明第一實施例的顯示面板的系統示意圖。
圖5為依據本發明第一實施例的顯示面板的系統示意圖。
圖1為依據本發明第一實施例的顯示面板的系統示意圖。請參照圖1,在本實施例中,顯示面板100包括基板101、開口OP1、第一閘極驅動電路GD1、第二閘極驅動電路GD2、多個第一閘極線(如LG11~LG13)、多個第二閘極線(如LG21~LG23)、多個第三閘極線(如LG31~LG36)及多個扇出線(如F11~F16、F21~F26)。要說明的是,在此以有限的數目舉例來說明,但本發明實施例不以此為限。
基板101具有顯示區AA、第一週邊區PH1及第二週邊區PH2,其中第一週邊區PH1位於顯示區AA的第一側S1(在此以圖式的左側為例),第二週邊區PH1位於顯示區AA相對於第一側S1的第二側S2(在此以圖式的右側為例),並且顯示區AA中配置有多個畫素PX,在一些實施例中第一週邊區PH1與第二週邊區PH2可在基板101的側邊或背面。
第一閘極驅動電路GD1位於第一週邊區PH1中,並且具有配置於第一週邊區PH1的多個位移暫存器(在此以6個位移暫
存器LSR1~LSR6為例)。第二閘極驅動電路GD2位於第二週邊區PH2,並且具有多個配置於第二週邊區PH2的多個位移暫存器(在此以6個位移暫存器RSR1~RSR6為例)。開口OP1位於顯示區AA中,其中開口OP1對齊顯示區AA中不同於第一側S1及第二側S2的第三側S3(在此以圖式上側為例),並且開口OP1是位於第三側S3的中間處。
第一閘極線(如LG11~LG13)位於顯示區AA中,並且位於開口OP1與第一閘極驅動電路GD1之間,亦即第一閘極線(如LG11~LG13)的水平位置相同於開口OP1的水平位置。其中第一閘極線(如LG11~LG13)與第一閘極驅動電路GD1電性連接,且與第二閘極驅動電路GD2電性絕緣。亦即,第一閘極線(如LG11~LG13)僅分別電性連接對應的位移暫存器LSR1~LSR3,而不會電性連接至位移暫存器RSR1~RSR6)。
第二閘極線(如LG21~LG23)位於顯示區AA中,並且位於開口OP1與第二閘極驅動電路GD2之間,亦即第二閘極線(如LG21~LG23)的水平位置相同於開口OP1的水平位置,其中第二閘極線(如LG21~LG23)與第二閘極驅動電路GD2電性連接,且與第一閘極驅動電路GD1電性絕緣。亦即,第二閘極線(如LG21~LG23)僅分別電性連接對應的位移暫存器RSR1~RSR3,而不會電性連接至位移暫存器LSR1~LSR6。
第三閘極線(如LG31~LG36)位於顯示區AA中,並且位於第一閘極驅動電路GD1與第二閘極驅動電路GD2之間,亦即
第三閘極線(如LG31~LG36)的水平位置不同於開口OP1的水平位置。各個第三閘極線(如LG31~LG36)交替地與第一閘極驅動電路GD1及第二閘極驅動電路GD2的其中之一電性連接,例如部分第三閘極線LG32、LG34、LG36...等分別電性連接至位移暫存器LSR4~LSR6,部分第三閘極線LG31、LG33、LG35...等分別電性連接至位移暫存器RSR4~RSR6,其餘則以此類推,並且可參照圖式所示。換言之,與第一閘極驅動電路GD1的位移暫存器LSR4~LSR6電性連接的第三閘極線(如LG32、LG34、LG36...等)彼此不相鄰,與第二閘極驅動電路GD2的位移暫存器RSR4~RSR6電性連接的第三閘極線(LG31、LG33、LG35...等)也彼此不相鄰。
此外,在本實施例中,第一閘極驅動電路GD1的位移暫存器(如LSR1~LSR6)的數量(相同於第二閘極驅動電路GD2的位移暫存器(如RSR1~RSR6)的數量)小於畫素PX的列數,因此位移暫存器LSR1~LSR6及位移暫存器RSR1~RSR6可朝垂直方向延伸,亦即位移暫存器LSR1~LSR6可平均分配第一週邊區PH1的空間,位移暫存器RSR1~RSR6可平均分配第二週邊區PH2的空間。藉此,位移暫存器LSR1~LSR6及位移暫存器RSR1~RSR6的寬度(即水平方向上的長度)可縮小,以窄化顯示面板100的邊框。
另一方面,也因為第一閘極驅動電路GD1的位移暫存器(如LSR1~LSR6)的數量(相同於位第二閘極驅動電路GD2的移暫存器(如RSR1~RSR6)的數量)小於畫素PX的列數,位移暫
存器LSR1~LSR6及RSR1~RSR6無法與對應的第一閘極線(如LG11~LG13)、第二閘極線(如LG21~LG23)、或第三閘極線(如LG31~LG36)對齊,因此第一閘極線(如LG11~LG13)及第三閘極線(如LG32、LG34、LG36)會分別透過扇出線F11~F16電性連接至對應的位移暫存器LSR1~LSR6,並且第二閘極線(如LG21~LG23)及第三閘極線(如LG31、LG35、LG35)會分別透過扇出線F21~F26電性連接至對應的位移暫存器RSR1~RSR6。
在本實施例中,是繪示為各個第一閘極線(如LG11~LG13)對齊對應的第二閘極線(如LG21~LG23),但依據電路設計的不同,第一閘極線(如LG11~LG13)可不用與第二閘極線(如LG21~LG23)對齊,此可依據顯示面板100的結構而定,本發明實施例不以此為限。
在本實施例中,第一週邊區PH1及第二週邊區PH1與顯示區AA是位於基板101的同一表面,但在其他實施例中,第一週邊區PH1及第二週邊區PH1也可以為基板101的側邊或背面(亦即相對於配置顯示區AA的表面的其他表面)。
依據上述,由於第一閘極線(如LG11~LG13)及第二閘極線(如LG21~LG23)分別由第一閘極電路GD1及第二閘極電路GD2所驅動,因此不需要額外的走線(或導線),亦即不會擠壓開口OP1附近的畫素PX,進而避免影響了畫素PX的顯示效果。
圖2A至圖2D分別為依據本發明的第一實施例的顯示面板的驅動波形示意圖。請參照圖1及圖2A,在本實施例中,第一
閘極線(如LG11~LG13)依序致能、第二閘極線(如LG21~LG23)依序致能及第三閘極線(如LG31~LG36)依序致能。第一閘極線(如LG11~LG13)與第二閘極線(如LG21~LG23)同步致能,並且第三閘極線(如LG31~LG36)接續於第一閘極線(如LG11~LG13)後致能。其中,第一閘極線(如LG11~LG13)、第二閘極線(如LG21~LG23)及第三閘極線(如LG11~LG13)的致能時間彼此相同地設定為2個水平掃描時間(標示為2h)。
請參照圖1及圖2B,在本實施例中,第一閘極線(如LG11~LG13)依序致能、第二閘極線(如LG21~LG23)依序致能及第三閘極線(如LG31~LG36)依序致能。第一閘極線(如LG11~LG13)與第二閘極線(如LG21~LG23)同步致能,並且第三閘極線(如LG31~LG36)接續於第一閘極線(如LG11~LG13)後致能。其中,第一閘極線(如LG11~LG13)、第二閘極線(如LG21~LG23)及第三閘極線(如LG11~LG13)的致能時間彼此相同地設定為1個水平掃描時間(標示為1h)。
請參照圖1及圖2C,在本實施例中,第一閘極線(如LG11~LG13)依序致能、第二閘極線(如LG21~LG23)依序致能及第三閘極線(如LG31~LG36)依序致能。第一閘極線(如LG11~LG13)與第二閘極線(如LG21~LG23)同步致能,並且第三閘極線(如LG31~LG36)接續於第一閘極線(如LG11~LG13)後致能。其中,第一閘極線(如LG11~LG13)及第二閘極線(如LG21~LG23)的致能時間彼此相同地設定為1個水平掃描時間(標
示為1h),而第三閘極線(如LG11~LG13)的致能時間則不同於第二閘極線(如LG21~LG23)的致能時間而設定為2個水平掃描時間(標示為2h)。
請參照圖1及圖2D,在本實施例中,第一閘極線(如LG11~LG13)依序致能、第二閘極線(如LG21~LG23)依序致能及第三閘極線(如LG31~LG36)依序致能。第一閘極線(如LG11~LG13)與第二閘極線(如LG21~LG23)同步致能,並且第三閘極線(如LG31~LG36)接續於第一閘極線(如LG11~LG13)後致能。其中,第一閘極線(如LG11~LG13)及第二閘極線(如LG21~LG23)的致能時間彼此相同地設定為2個水平掃描時間(標示為2h),而第三閘極線(如LG11~LG13)的致能時間則不同於第二閘極線(如LG21~LG23)的致能時間而設定為1個水平掃描時間(標示為1h)。
圖3為依據本發明第一實施例的顯示面板的系統示意圖。請參照圖1及圖3,在本實施例中,顯示面板200大致相同於顯示面板100,其不同之處在於開口OP2的位置。在本實施例中,開口OP1仍對齊顯示區AA的第三側S3,但是往第一側S1靠近,因此第一閘極線(如LG11a~LG13a)顯得較短,而第二閘極線(如LG21a~LG23a)顯得較長。
圖4為依據本發明第一實施例的顯示面板的系統示意圖。請參照圖1及圖4,在本實施例中,顯示面板300大致相同於顯示面板100,其不同之處在於開口OP3的位置。在本實施例中,
開口OP3遠離顯示區AA的側邊(如S1、S2),亦即開口OP3沒有對齊顯示區AA的任何一個側邊(如S1、S2)。因此,第三閘極線LG31a及LG32a會位於開口OP3之上,亦即第一閘極線(如LG11b~LG13b)及第二閘極線(如LG21b~LG23b)會位於第三閘極線LG32a與LG33之間。
圖5為依據本發明第一實施例的顯示面板的系統示意圖。請參照圖1及圖5,在本實施例中,顯示面板400大致相同於顯示面板100,其不同之處在於位移暫存器LSR1a~LSR9a及RSR1a~RSR9a的數量(在此皆以9個為例)。在本實施例中,第一閘極線(如LG11~LG13)僅分別電性連接對應的位移暫存器LSR1a~LSR3a,第二閘極線(如LG21~LG23)僅分別電性連接對應的位移暫存器RSR1a~RSR3a,而各個第三閘極線(如LG31~LG36)同時與第一閘極驅動電路GD1a及第二閘極驅動電路GD2a電性連接,亦即各個第三閘極線(如LG31~LG36)同時電性連接第一閘極驅動電路GD1a中對應的位移暫存器(如LSR4a~LSR9a)及第二閘極驅動電路GD2a中對應的位移暫存器(如RSR4a~RSR9a)。
在本實施例中,第一閘極驅動電路GD1a的位移暫存器(如LSR1a~LSR9a)的數量(相同於第二閘極驅動電路GD2a的位移暫存器(如RSR1a~RSR9a)的數量)等於畫素PX的列數,因此位移暫存器LSR1a~LSR9a個別對齊對應的第一閘極線(如LG11~LG13)或對應的第三閘極線(如LG31~LG36),位移暫存
器RSR1a~RSR9a個別對齊對應的第二閘極線(如LG21~LG23)或對應的第三閘極線(如LG31~LG36)。因此,第一閘極線(如LG11~LG13)及第三閘極線(如LG31~LG36)不需要透過扇出線電性連接至對應的位移暫存器LSR1a~LSR9a,並且第二閘極線(如LG21~LG23)及第三閘極線(如LG31~LG36)不需要透過扇出線電性連接至對應的位移暫存器RSR1a~RSR9a。
依據上述,本發明實施例的顯示面板,至少包括基板101、開口(如OP1~OP3)、第一閘極驅動電路(如GD1、GD1a)、第二閘極驅動電路(如GD2、GD2a)、多個第一閘極線(如LG11~LG13、LG11a~LG13a、LG11b~LG13b)、多個第二閘極線(如LG21~LG23、LG21a~LG 23a、LG21b~LG23b)及多個第三閘極線(如LG31~LG36、LG31a、LG32a)。基板具有顯示區AA、第一週邊區PH1及第二週邊區PH2。開口(如OP1~OP3)位於顯示區AA。第一閘極驅動電路(如GD1、GD1a)位於第一週邊區PH1。第二閘極驅動電路(如GD2、GD2a)位於第二週邊區PH2。第一閘極線(如LG11~LG13、LG11a~LG 13a、LG11b~LG 13b)位於開口(如OP1~OP3)與第一閘極驅動電路(如GD1、GD1a)之間,與第一閘極驅動電路(如GD1、GD1a)電性連接,且與第二閘極驅動電路(如GD2、GD2a)電性絕緣。第二閘極線(如LG21~LG23、LG21a~LG 23a、LG21b~LG23b)位於開口(如OP1~OP3)與第二閘極驅動電路(如GD2、GD2a)之間,與第二閘極驅動電路(如GD2、GD2a)電性連接,且與第一閘極驅動電
路(如GD1、GD1a)電性絕緣。第三閘極(如LG31~LG36、LG31a、LG32a)線位於第一閘極驅動電路(如GD1、GD1a)與第二閘極驅動電路(如GD2、GD2a)之間,各個第三閘極線(如LG31~LG36、LG31a、LG32a)與第一閘極驅動電路(如GD1、GD1a)及第二閘極驅動電路(如GD2、GD2a)的至少其一電性連接。
綜上所述,本發明實施例的顯示面板,第一閘極線及第二閘極線分別電性連接至第一閘極電路及第二閘極電路,因此不需要額外的走線(或導線),亦即不會擠壓開口附近的畫素,進而避免影響了畫素的顯示效果。
雖然本發明已以實施例揭露如上,然其並非用以限定本發明,任何所屬技術領域中具有通常知識者,在不脫離本發明的精神和範圍內,當可作些許的更動與潤飾,故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
Claims (8)
- 一種顯示面板,包括:一基板,具有一顯示區、一第一週邊區及一第二週邊區,其中該第一週邊區位於該顯示區的一第一側,該第二週邊區位於該顯示區相對於該第一側的一第二側;一開口,位於該顯示區;一第一閘極驅動電路,位於該第一週邊區;一第二閘極驅動電路,位於該第二週邊區;多個第一閘極線,位於該開口與該第一閘極驅動電路之間,與該第一閘極驅動電路電性連接,且與該第二閘極驅動電路電性絕緣;多個第二閘極線,位於該開口與該第二閘極驅動電路之間,與該第二閘極驅動電路電性連接,且與該第一閘極驅動電路電性絕緣;以及多個第三閘極線,位於該第一閘極驅動電路與該第二閘極驅動電路之間,各該些第三閘極線與該第一閘極驅動電路及該第二閘極驅動電路的其中之一電性連接,其中與該第一閘極驅動電路電性連接的該些第三閘極線彼此不相鄰。
- 如申請專利範圍第1項所述的顯示面板,其中該些第一閘極線依序致能、該些第二閘極線依序致能及該些第三閘極線依序致能,該些第一閘極線及與對應的該些第二閘極線同步致能,且該些第三閘極線接續於該些第一閘極線後致能,其中該些第一 閘極線、該些第二閘極線及該些第三閘極線的多個致能時間彼此相同。
- 如申請專利範圍第1項所述的顯示面板,其中該些第一閘極線依序致能、該些第二閘極線依序致能及該些第三閘極線依序致能,該些第一閘極線及對應的該些第二閘極線同步致能,且該些第三閘極線接續於該些第一閘極線後致能,其中該些第一閘極線的多個致能時間相同於該些第二閘極線的多個致能時間,並且該些第二閘極線的該些致能時間不同於該些第三閘極線的多個致能時間。
- 如申請專利範圍第1項所述的顯示面板,其中該第一閘極驅動電路的多個位移暫存器配置於該第一週邊區中,並且該第二閘極驅動電路的多個位移暫存器配置於該第二週邊區中。
- 如申請專利範圍第1項所述的顯示面板,其中各該些第一閘極線對齊對應的第二閘極線。
- 如申請專利範圍第1項所述的顯示面板,其中該開口對齊該顯示區中不同於該第一側及該第二側的一第三側。
- 如申請專利範圍第1項所述的顯示面板,其中該開口遠離該顯示區的側邊。
- 一種顯示面板,包括:一基板,具有一顯示區、一第一週邊區及一第二週邊區,其中該第一週邊區位於該顯示區的一第一側,該第二週邊區位於該顯示區相對於該第一側的一第二側; 一開口,位於該顯示區;一第一閘極驅動電路,位於該第一週邊區;一第二閘極驅動電路,位於該第二週邊區;多個第一閘極線,位於該開口與該第一閘極驅動電路之間,與該第一閘極驅動電路電性連接,且與該第二閘極驅動電路電性絕緣;多個第二閘極線,位於該開口與該第二閘極驅動電路之間,與該第二閘極驅動電路電性連接,且與該第一閘極驅動電路電性絕緣;以及多個第三閘極線,位於該第一閘極驅動電路與該第二閘極驅動電路之間,其中各該些第三閘極線同時與該第一閘極驅動電路及該第二閘極驅動電路電性連接,該第一閘極驅動電路的多個位移暫存器個別對齊對應的第一閘極線或對應的第三閘極線,該第二閘極驅動電路的多個位移暫存器個別對齊對應的第二閘極線或對應的第三閘極線。
Priority Applications (3)
Application Number | Priority Date | Filing Date | Title |
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