TWI433088B - 顯示裝置及驅動方法 - Google Patents
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Description
本發明是有關於一種顯示裝置及驅動方法，且特別是有關於一種可抑制顯示異常的顯示裝置及驅動方法。
近年來，隨著半導體科技蓬勃發展，攜帶型電子產品及平面顯示器產品也隨之興起。而在眾多平面顯示器的類型當中，液晶顯示器(Liquid Crystal Display,LCD)基於其低電壓操作、無輻射線散射、重量輕以及體積小等優點，隨即已成為顯示器產品之主流。
為了要將液晶顯示器的製作成本壓低，已有部份廠商提出直接在玻璃基板上利用薄膜電晶體(thin film transistor,TFT)製作成多級移位暫存器(shift register)，藉以來取代習知所慣用的閘極驅動晶片(Gate driving chip)，以降低液晶顯示器的製作成本。
由於製程的影響，會導致所製造薄膜電晶體可能有輸出能力過低的情況。此時，若移位暫存器由輸出能力過低的薄膜電晶體所組成，則在顯示初期中移位暫存器的信號會無法正常位移，以至於畫面無法正常顯示。並且，在等待一段時間後，薄膜電晶體的輸出能力會因溫度升高而提高，此時移位暫存器的信號則能正常的位移，但在上述顯示初期畫面無法正常顯示的問題仍然存在。
本發明提供一種顯示裝置及驅動方法，可抑制顯示異常的現象。
本發明提出一種顯示裝置，包括第一電壓產生器、第二電壓產生器、時序控制器、位準移位器及顯示面板。第一電壓產生器用以產生一閘極高電壓。在一第一期間中，閘極高電壓為一第一電壓。在第一期間後，閘極高電壓為第二電壓。第一電壓高於第二電壓。第二電壓產生器用以產生閘極低電壓。時序控制器產生啟動信號、時脈信號及其反相信號。位準移位器耦接第一電壓產生器、第二電壓產生器及時序控制器，以依據閘極高電壓及閘極低電壓位移啟動信號、時脈信號及反相信號的電壓準位。顯示面板包括基板、畫素陣列及多個移位暫存器。畫素陣列設置在基板。這些移位暫存器設置在基板，且這些移位暫存器分別耦接位準移位器。這些移位暫存器依據電壓準位位移後之啟動信號、時脈信號及其反相信號依序輸出多個掃描信號以驅動畫素陣列。
在本發明之一實施例中，上述之第一電壓產生器包括第一脈寬調變器、第一電荷幫浦電路、第一電阻、第二電阻及調整電路。第一脈寬調變器具有第一輸入端、第二輸入端及輸出端，第一脈寬調變器的第一輸入端耦接第一參考電壓，第一脈寬調變器依據第一參考電壓及其第二輸入端的電壓於其輸出端輸出第一驅動信號。第一電荷幫浦電路具有輸入端及輸出端，第一電荷幫浦電路的輸入端耦接
第一脈寬調變器以接收第一驅動信號，並依據第一驅動信號於第一電荷幫浦電路的輸出端輸出閘極高電壓。第一電阻耦接於第一電荷幫浦電路的輸出端與第一脈寬調變器的第二輸入端之間。第二電阻耦接於第一脈寬調變器的第二輸入端與接地電壓之間。調整電路耦接第一脈寬調變器的第二輸入端，用以於第一期間中降低第一脈寬調變器的第二輸入端的電壓，並且於第一期間後恢復第一脈寬調變器的第二輸入端的電壓。
在本發明之一實施例中，上述之調整電路包括電晶體、第三電阻、第四電阻及第一電容。電晶體具有第一端、第二端及控制端，第一端耦接第一脈寬調變器的第二輸入端，控制端接收第二參考電壓。第三電阻耦接於電晶體的第二端與接地電壓之間。第四電阻耦接電晶體的控制端與接地電壓之間。第一電容並聯耦接第四電阻。
在本發明之一實施例中，上述之第一電壓產生器更包括第一熱敏電阻，並聯耦接第一電阻。
在本發明之一實施例中，上述之第一熱敏電阻為負溫度係數的熱敏電阻。
在本發明之一實施例中，上述之電晶體為PMOS電晶體。
在本發明之一實施例中，上述之第二電壓產生器包括第二脈寬調變器、第二電荷幫浦電路、第五電阻、第六電阻及第二電容。第二脈寬調變器具有第一輸入端、第二輸入端及輸出端，第二脈寬調變器的第一輸入端耦接第三參
考電壓。第二脈寬調變器依據第三參考電壓及其第二輸入端的電壓於其輸出端輸出第二驅動信號。第五電阻耦接於第二脈寬調變器的第一輸入端及其第二輸入端之間。第二電荷幫浦電路具有輸入端及輸出端，第二電荷幫浦電路依據其輸入端的信號於其輸出端輸出閘極低電壓。第六電阻耦接於第二脈寬調變器的第二輸入端與第二電荷幫浦電路的輸出端之間。第二電容耦接於第二脈寬調變器的輸出端與第二電荷幫浦電路的輸入端。
在本發明之一實施例中，上述之第二電壓產生器更包括一第二熱敏電阻，並聯耦接第五電阻。
在本發明之一實施例中，上述之第二熱敏電阻為一負溫度係數的熱敏電阻。
在本發明之一實施例中，上述之閘極低電壓為第三電壓。
在本發明之一實施例中，上述之在第一期間中，閘極低電壓為接地電壓，在第一期間後，閘極低電壓為第三電壓。
在本發明之一實施例中，上述之第一電壓與第二電壓間的壓差為大於等於2伏特。
在本發明之一實施例中，上述之第一期間為起始於顯示裝置開機時。
本發明亦提出一種驅動方法，適於驅動一顯示面板。驅動方法包括下列步驟。在一第一期間中，提供電壓準位為第一電壓的一閘極高電壓，以及提供閘極低電壓。在第
一期間後，提供電壓準位為一第二電壓的閘極高電壓，以及提供閘極低電壓。依據閘極高電壓及閘極低電壓位移啟動信號、時脈信號及反相信號的電壓準位。以電壓準位位移後的啟動信號、時脈信號及反相信號驅動顯示面板。
在本發明之一實施例中，上述之閘極低電壓的電壓準位為第三電壓。
在本發明之一實施例中，上述之閘極低電壓的電壓準位於第一期間為接地電壓，在第一期間後，閘極低電壓的電壓準位為第三電壓。
在本發明之一實施例中，上述之第三電壓反比於溫度。
在本發明之一實施例中，上述之第一電壓及第二電壓反比於溫度。
基於上述，本發明的顯示裝置，其於第一期間以較高的閘極高電壓驅動移位暫存器，以抑制因薄膜電晶體輸出能力過低而造成移位暫存器無法正常運作的問題。
為讓本發明之上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
圖1為依據本發明一實施例的顯示裝置的系統示意圖。請參照圖1，顯示裝置100包括時序控制器(timing controller)110、源極驅動器(source driver)120、顯示面板130、第一電壓產生器140、第二電壓產生器150及位準
移位器160。顯示面板130包括基板131、畫素陣列133以及閘極驅動電路135。在本實施例中，閘極驅動電路135設置於基板131上，且位於畫素陣列133的左側，但在其他實施例中，閘極驅動電路135可設置於於畫素陣列120的右側、上側或下側。並且，在基板131上的畫素陣列133即為顯示面板130的顯示區域，而閘極驅動電路135的設置區域則為顯示面板130的非顯示區域。
第一電壓產生器140用以產生閘極高電壓VGH，第二電壓產生器150用以產生閘極低電壓VGL。時序控制器110用以產生啟動信號STV、時脈信號CK及CKB，其中時脈信號CKB為時脈信號CK的反相信號。位準移位器160耦接第一電壓產生器140、第二電壓產生器150及時序控制器110以接收閘極高電壓VGH、閘極低電壓VGL、啟動信號STV、時脈信號CK及CKB，並且位準移位器160依據閘極高電壓VGH及閘極低電壓VGL位移啟動信號STV、時脈信號CK及CKB的電壓準位後輸出啟動信號STV’、時脈信號CK’及CKB’。閘極驅動電路135依據啟動信號STV’、時脈信號CK’及CKB’而依序輸出掃描信號SC1、SC2、SC3、SC4、.....等，以驅動畫素陣列133中的每一列畫素(未繪示)。源極驅動器120受控於時序控制器110而輸出對應的顯示資料至被驅動的畫素。
閘極驅動電路135包括移位暫存器SR1、SR2、SR3、SR4、...等。移位暫存器SR1、SR2、SR3、SR4、...等同時接收時脈信號CK’及時脈信號CKB’。其中，時脈信號
CK’透過基板131上的信號配線LS1傳送至移位暫存器SR1、SR2、SR3、SR4、...等，時脈信號CKB’透過基板131上的信號配線LS2傳送至移位暫存器SR1、SR2、SR3、SR4、...等。並且，信號配線LS1及LS2可設置於閘極驅動電路135中。
圖2為依據本發明一實施例的閘極高電壓及閘極低電壓的波形示意圖。請參照圖1及圖2，在本實施例中，第一期間T1起始的時間點a為顯示裝置開機的時候。在第一期間T1中，閘極高電壓VGH由接地電壓GND上升至第一電壓V1，並維持於第一電壓V1。而閘極低電壓VGL可由接地電壓下降至第三電壓V3(如波形210所示)，或者維持於接地電壓(如波形220所示)。在第一期間T1後(如圖示第二期間T2)，閘極高電壓VGH由第一電壓V1下降至第二電壓V2，並維持於第二電壓V2。而閘極低電壓VGL可維持於第三電壓V3(如波形210所示)，或者可由接地電壓下降至第三電壓V3(如波形220所示)。
如圖2所示，第二電壓V2在此為習知的閘極高電壓VGH，亦即啟動信號STV’、時脈信號CK’及CKB’的高電壓準位。由於製程的關係，移位暫存器(如SR1~SR4)中的薄膜電晶體可能會有輸出能力較低的情況，並且在顯示開機初期(即第一期間T1中)，閘極驅動電路135的溫度大約相同於室溫，以致於以習知的閘極高電壓VGH來驅動移位暫存器(如SR1~SR4)會無法正常運作。因此，在第一期間T1中，本發明的實施例以高於第二電壓V2的
第一電壓V1作為閘極高電壓VGH，藉由較高的電壓可提高薄膜電晶體的輸出能力，並且較高的電壓可加速溫度的提升，因此可降低畫面顯示異常的時間，甚或在開機即可正常顯示，其中本實施例不用更改移位暫存器(如SR1~SR4)的設計。
一般而言，理想的第一電壓V1可能越高越好，並且第一電壓V1與第二電壓V2間的壓差大於等於2伏特時抑制效果才會明顯，但於實際應用上，第一電壓V1與第二電壓V2間的壓差可設計為2~5伏特，此為依據所使用的薄膜電晶體的結構不同所致。並且，在第一期間T1後，由於閘極驅動電路135的溫度升高而使薄膜電晶體的輸出能力提高，因此可降低閘極高電壓VGH為第二電壓V2而不致於影響畫面顯示，並且可避免長時間的高壓加速薄膜電晶體的退化及破壞薄膜電晶體。
請再參照圖1，進一步來說，當移位暫存器SR1接收到啟動信號STV’時，移位暫存器SR1會被設定以處於驅動狀態。接著，移位暫存器SR1會依據啟動信號STV’、時脈信號CK’及CKB’輸出掃描信號SC1。並且，掃描信號SC1會傳送至移位暫存器SR2。
當移位暫存器SR2接收到掃描信號SC1時，移位暫存器SR2會被設定以處於驅動狀態。接著，移位暫存器SR2會依據掃描信號SC1、時脈信號CK’及CKB’輸出掃描信號SC2。並且，掃描信號SC2會傳送至移位暫存器SR1及SR3。此時，當移位暫存器SR1接收到掃描信號SC2時，
移位暫存器SR1會處於停止狀態以停止輸出掃描信號SC1，以此避免掃描信號SC1與掃描信號SC2重疊。
當移位暫存器SR3接收到掃描信號SC2時，移位暫存器SR3會被設定以處於驅動狀態。接著，移位暫存器SR3會依據掃描信號SC2、時脈信號CK’及CKB’輸出掃描信號SC3。並且，掃描信號SC3會傳送至移位暫存器SR2及SR4。此時，當移位暫存器SR2接收到掃描信號SC3時，移位暫存器SR2會處於停止狀態以停止輸出掃描信號SC2，以此避免掃描信號SC2與掃描信號SC3重疊。
其餘移位暫存器(如SR4等)可依據上述說明的順序推知其運作方式，並依此輸出對應的掃描信號(如SC4等)。藉此，閘極驅動電路135會依序輸出掃描信號SC1、SC2、SC3、...等以分別驅動畫素陣列中的每一列畫素(未繪示)。
圖3為圖1依據本發明一實施例的第一電壓產生器140的電路示意圖。請參照圖3，在本實施例中，第一電壓產生器140包括第一脈寬調變器310、第一電荷幫浦電路320、第一電阻R1、第二電阻R2、第三電阻R3、第四電阻R4、電晶體M1及第一電容C1，其中電晶體M1在此以PMOS電晶體為例。第一脈寬調變器310具有第一輸入端310a、第二輸入端310b及輸出端310c，第一輸入端310a耦接第一參考電壓VR1。第一脈寬調變器310比較第二輸入端310b的電壓Vd1與第一參考電壓VR1，並根據比較結果於輸出端310c輸出第一驅動信號DRVP1。
第一電荷幫浦電路320具有電源端320p、輸入端320a及輸出端320b，電源端320p耦接系統電壓VDD，輸入端320a耦接第一脈寬調變器310以接收第一驅動信號DRVP1。第一電荷幫浦電路320依據第一驅動信號DRVP1於第一電荷幫浦電路320的輸出端320b輸出閘極高電壓VGH。第一電阻R1耦接於第一電荷幫浦電路320的輸出端320b與第一脈寬調變器310的第二輸入端310b之間。第二電阻R2耦接於第一脈寬調變器310的第二輸入端310b與接地電壓之間。其中，第一電阻R1與第二電阻R2進行分壓而產生電壓Vd1。
電晶體M1的源極(即第一端)耦接第一脈寬調變器310的第二輸入端310b，電晶體M1的閘極(即控制端)接收第二參考電壓VR2。第三電阻R3耦接於電晶體M1的汲極(即第二端)與接地電壓之間。第四電阻R4耦接電晶體的閘極與接地電壓之間。第一電容C1並聯耦接第四電阻R4。
依據上述，當顯示裝置100開機時，參考電壓VR2會對電容C1充電，而充電的速度決定於電阻R4的電阻值及電容C1的電容值。此時，電晶體M1的閘極的電壓遠小於電晶體M1的源極的電壓，因此電晶體M1會呈現導通。而閘極高電壓VGH的電壓(即第一電壓V1)決定於下列關係式：
其中，關係式中的R1、R2及R3為分別表示電阻R1、
R2及R3的電阻值。接著，當電晶體M1的閘極與源極間的電壓小於導通的臨界電壓時，則電晶體M1會呈現不導通。此時，閘極高電壓VGH的電壓(即第二電壓V2)決定於下列關係式：
依據上述關係式(1)及(2)，由於關係式(1)中電阻R2並聯電阻R3，因此第一電壓V1會大於第二電壓V2。而閘極高電壓VGH由第一電壓V1切換至第二電壓V2的時間點決定於第二參考電壓VR2的大小、電阻R4的電阻值大小及第一電容C1的電容值大小，亦即第一期間T1的長短決定於第二參考電壓VR2的大小、電阻R4的電阻值大小及第一電容C1的電容值大小，並且第一期間T1的長短可設計為一個畫面期間或多個畫面期間，此可依據本領域通常知識者自行調整，本發明則不以此為限。
再者，上述電晶體M1、第三電阻R3、第四電阻R4及第一電容C1所構成的電路可視為一調整電路330，其於第一期間T1中昇高電壓Vd1的大小，以使閘極高電壓VGH為第一電壓V1，並且於第一期間T1後恢復電壓Vd1的大小，以使閘極高電壓VGH為第二電壓V2。
圖4為圖1依據本發明一實施例的第二電壓產生器150的電路示意圖。請參照圖4，在本實施例中，第二電壓產生器150包括第二脈寬調變器410、第二電荷幫浦電路420、第五電阻R5、第六電阻R6及第二電容C2。第二脈寬調變器410具有第一輸入端410a、第二輸入端410b及
輸出端410c，第二脈寬調變器410的第一輸入端410a耦接第三參考電壓VR3，第二脈寬調變器410比較第三參考電壓VR3及第二輸入端410b的電壓Vd2，並依據比較結果於輸出端410c輸出第二驅動信號DRVP2。
第五電阻R5耦接於第二脈寬調變器410的第一輸入端410a及第二輸入端410b之間。第二電荷幫浦電路420具有電源端420p、輸入端420a及輸出端420b，第二電荷幫浦電路420的電源端420p耦接接地電壓，第二電荷幫浦電路420依據其輸入端420a接收的第二驅動信號DRVP2於其輸出端420b輸出閘極低電壓VGL。
第六電阻R6耦接於第二脈寬調變器410的第二輸入端410b與第二電荷幫浦電路420的輸出端420b之間，並且第五電阻R5與第六電阻R6進行分壓而產生電壓Vd2。第二電容C2耦接於第二脈寬調變器410的輸出端410c與第二電荷幫浦電路420的輸入端420a，以傳送第二驅動信號DRVP2至第二電荷幫浦電路420的輸入端420a。
依據上述，閘極低電壓VGL的電壓V3決定於下列關係式：
若第三參考電壓VR3=1.25伏特，電壓Vd2=0.25伏特，則關係式(3)會變成下列關係式：
再者，若要實現圖2中波形210所示電壓波形，則在
顯示裝置100開機時即讓脈寬調變器410正常運作。另一方面，若要實現圖2中波形220所示電壓波形，則控制脈寬調變器410於第一期間T1後才正常運作。
圖5為圖1依據本發明另一實施例的第一電壓產生器140的電路示意圖。請參照圖3及圖5，在本實施例中，第一電壓產生器140更包括第一熱敏電阻HR1，其並聯耦接第一電阻R1，其中第一熱敏電阻HR1在此假設為負溫度係數的熱敏電阻，即溫度越低電阻值越大，溫度越高電阻值越小。在加入第一熱敏電阻HR1後，關係式(1)及(2)會分別變成下列關係式(5)及(6)：
依據關係式(5)及(6)，當溫度越高，則第一電壓V1及第二電壓V2會越小，當溫度越低，則第一電壓V1及第二電壓V2會越高。而此可因應溫度越高時薄膜電晶體的輸出能力越高的狀況，藉此抑制薄膜電晶體的輸出能力過高。並且，可因應溫度越低時薄膜電晶體的輸出能力越低的狀況，藉由更高的閘極高電壓VGH來提高薄膜電晶體的輸出能力，以避免因移位暫存器無法正常運作而造成顯示異常。
此外，第一熱敏電阻HR1除了與第一電阻R1並聯外，亦可與第二電阻R2串聯，同樣可依據溫度調整第一電壓V1及第二電壓V2。再者，若第一熱敏電阻HR1為正溫度係數的熱敏電阻，即溫度越高電阻值越大，溫度越
低電阻值越小，則第一熱敏電阻HR1可串聯第一電阻R1或並聯第二電阻R2。而第一熱敏電阻HR1的其他耦接方式並不限於上述，此可依據依據本領域通常知識者自行變更設計，甚至可應用多顆熱敏電阻來達到依據溫度調整第一電壓V1及第二電壓V2的目的。
圖6為圖1依據本發明另一實施例的第二電壓產生器150的電路示意圖。請參照圖4及圖6，在本實施例中，第二電壓產生器150更包括第二熱敏電阻HR2，其並聯耦接第五電阻R5，其中第二熱敏電阻HR2在此假設為負溫度係數的熱敏電阻。在加入第二熱敏電阻HR2後，關係式(4)會變成下列關係式：
依據關係式(7)，當溫度越高，則第三電壓V3越小，當溫度越低，則第三電壓V3會越高。而此可因應溫度越高時薄膜電晶體的輸出能力越高的狀況，藉由更低的閘極低電壓VGL來抑制薄膜電晶體因溫度升高而增加的漏電流。
此外，第二熱敏電阻HR2除了與第五電阻R5並聯外，亦可與第六電阻R6串聯，同樣可依據溫度調整第三電壓V3。再者，若第二熱敏電阻HR2為正溫度係數的熱敏電阻，則第二熱敏電阻HR2可串聯第五電阻R5或並聯第六電阻R6。而第二熱敏電阻HR2的其他耦接方式並不限於上述，此可依據依據本領域通常知識者自行變更設計，甚至可應用多顆熱敏電阻來達到依據溫度調整第三電
壓V3的目的。
圖7為依據本發明另一實施例的閘極高電壓及閘極低電壓的波形示意圖。請參照圖5至圖7，在本實施例中，透過於第一電壓產生器140及第二電壓產生器150分別加入第一熱敏電阻HR1及第二熱敏電阻HR2，使得閘極高電壓VGH及閘極低電壓VGL可依據溫度而調整。如圖7所示，波形710、720及730分別為閘極高電壓VGH對應不同溫度的電壓波形，其中依據所對應的溫度由低至高排列為波形710、720、730。波形740、750及760分別為閘極低電壓VGL對應不同溫度的電壓波形，其中依據所對應的溫度由低至高排列為波形740、750、760。
依據上述，可彙整應用於顯示面板130的驅動方法。圖8為依據本發明一實施例的顯示面板的驅動方法。請參照圖8，在第一期間中，提供電壓準位為第一電壓的閘極高電壓，以及提供閘極低電壓(步驟S810)。接著，依據閘極高電壓及閘極低電壓位移啟動信號、時脈信號及反相信號的電壓準位(步驟S820)。再來以電壓準位位移後的啟動信號、時脈信號及反相信號驅動顯示面板130(步驟S830)。在第一期間後，提供電壓準位為第二電壓的閘極高電壓，以及提供閘極低電壓(步驟S840)。接著，同樣依據閘極高電壓及閘極低電壓位移啟動信號、時脈信號及反相信號的電壓準位(步驟S850)。再來，同樣以電壓準位位移後的啟動信號、時脈信號及反相信號驅動顯示面板(步驟S860)。上述步驟的細節可參照上述顯示裝置100
的說明，在此則不再贅述。
綜上所述，本發明實施例的顯示裝置及驅動方法，其於第一期間以較高的閘極高電壓驅動移位暫存器，以抑制因薄膜電晶體輸出能力過低而造成移位暫存器無法正常運作的問題。並且，在第一電壓產生器及第二電壓產生器中分別加入一熱敏電阻，使得閘極高電壓及閘極低電壓會反比於溫度來調整，藉以避免溫度過高所造成薄膜電晶體的輸出能力過高及漏電流過高的問題，以及溫度過低而致使移位暫存器無法正常運作的問題。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明之精神和範圍內，當可作些許之更動與潤飾，故本發明之保護範圍當視後附之申請專利範圍所界定者為準。
100‧‧‧顯示裝置
110‧‧‧時序控制器
120‧‧‧源極驅動器
130‧‧‧顯示面板
131‧‧‧基板
133‧‧‧畫素陣列
135‧‧‧閘極驅動電路
140‧‧‧第一電壓產生器
150‧‧‧第二電壓產生器
160‧‧‧位準移位器
210、220、710~760‧‧‧波形
310、410‧‧‧脈寬調變器
310a、310b、320a、410a、410b、420a‧‧‧輸入端
310c、320b、410c、420b‧‧‧輸出端
320、420‧‧‧電荷幫浦電路
320p、420p‧‧‧電源端
330‧‧‧調整電路
a‧‧‧時間點
C1、C2‧‧‧電容
CK、CK’‧‧‧時脈信號
CKB、CKB’‧‧‧反相信號
DRVP1、DRVP2‧‧‧驅動信號
HR1、HR2‧‧‧熱敏電阻
LS1、LS2‧‧‧信號配線
M1‧‧‧電晶體
R1~R6‧‧‧電阻
SC1~SC4‧‧‧掃描信號
STV、STV’‧‧‧啟動信號
SR1~SR4‧‧‧移位暫存器
T1、T2‧‧‧期間
V1、V2、V3、Vd1、Vd2‧‧‧電壓
VDD‧‧‧系統電壓
VGL‧‧‧閘極低電壓
VGH‧‧‧閘極高電壓
VR1、VR2、VR3‧‧‧參考電壓
S810、S820、S830、S840、S850、S860‧‧‧步驟
圖1為依據本發明一實施例的顯示裝置的系統示意圖。
圖2為依據本發明一實施例的閘極高電壓及閘極低電壓的波形示意圖。
圖3為圖1依據本發明一實施例的第一電壓產生器140的電路示意圖。
圖4為圖1依據本發明一實施例的第二電壓產生器150的電路示意圖。
圖5為圖1依據本發明另一實施例的第一電壓產生器
140的電路示意圖。
圖6為圖1依據本發明另一實施例的第二電壓產生器150的電路示意圖。
圖7為依據本發明另一實施例的閘極高電壓及閘極低電壓的波形示意圖。
圖8為依據本發明一實施例的顯示面板的驅動方法
140‧‧‧電壓產生器
310‧‧‧脈寬調變器
310a、310b、320a‧‧‧輸入端
310c、320b‧‧‧輸出端
320‧‧‧電荷幫浦電路
320p‧‧‧電源端
330‧‧‧調整電路
C1‧‧‧電容
DRVP1‧‧‧驅動信號
M1‧‧‧電晶體
R1~R4‧‧‧電阻
Vd1‧‧‧電壓
VDD‧‧‧系統電壓
VGH‧‧‧閘極高電壓
VR1、VR2‧‧‧參考電壓
Claims (12)
- 一種顯示裝置，包括：一第一電壓產生器，用以產生一閘極高電壓，在一第一期間中，該閘極高電壓為一第一電壓，在該第一期間後，該閘極高電壓為一第二電壓，其中該第一電壓高於該第二電壓，其中該第一電壓產生器包括：一第一脈寬調變器，具有一第一輸入端、一第二輸入端及一輸出端，該第一脈寬調變器的該第一輸入端耦接一第一參考電壓，該第一脈寬調變器依據該第一參考電壓及其該第二輸入端的電壓於其該輸出端輸出一第一驅動信號；一第一電荷幫浦電路，具有一輸入端及一輸出端，該第一電荷幫浦電路的該輸入端耦接該第一脈寬調變器以接收該第一驅動信號，並依據該第一驅動信號於該第一電荷幫浦電路的該輸出端輸出該閘極高電壓；一第一電阻，耦接於該第一電荷幫浦電路的該輸出端與該第一脈寬調變器的該第二輸入端之間；一第二電阻，耦接於該第一脈寬調變器的該第二輸入端與一接地電壓之間；以及一調整電路，耦接該第一脈寬調變器的該第二輸入端，用以於該第一期間中降低該第一脈寬調變器的該第二輸入端的電壓，並且於該第一期間後恢復該第一脈寬調變器的該第二輸入端的電壓；一第二電壓產生器，用以產生一閘極低電壓； 一時序控制器，產生一啟動信號、一時脈信號及一反相信號；一位準移位器，耦接該第一電壓產生器、該第二電壓產生器及該時序控制器，以依據該閘極高電壓及該閘極低電壓位移該啟動信號、該時脈信號及該反相信號的電壓準位；以及一顯示面板，包括：一基板；一畫素陣列，設置在該基板；以及多個移位暫存器，設置在該基板，該些移位暫存器分別耦接該位準移位器，該些移位暫存器依據電壓準位位移後之該啟動信號、該時脈信號及該反相信號依序輸出多個掃描信號以驅動該畫素陣列。
- 如申請專利範圍第1項所述之顯示裝置，其中該調整電路包括：一電晶體，具有一第一端、一第二端及一控制端，該第一端耦接該第一脈寬調變器的該第二輸入端，該控制端接收一第二參考電壓；一第三電阻，耦接於該電晶體的該第二端與該接地電壓之間；一第四電阻，耦接該電晶體的該控制端與該接地電壓之間；以及一第一電容，並聯耦接該第四電阻。
- 如申請專利範圍第2項所述之顯示裝置，其中該電 晶體為PMOS電晶體。
- 如申請專利範圍第1項所述之顯示裝置，其中該第一電壓產生器更包括一第一熱敏電阻，並聯耦接該第一電阻。
- 如申請專利範圍第4項所述之顯示裝置，其中該第一熱敏電阻為一負溫度係數的熱敏電阻。
- 如申請專利範圍第1項所述之顯示裝置，其中該第二電壓產生器包括：一第二脈寬調變器，具有一第一輸入端、一第二輸入端及一輸出端，該第二脈寬調變器的該第一輸入端耦接一第三參考電壓，該第二脈寬調變器依據該第三參考電壓及其該第二輸入端的電壓於其該輸出端輸出一第二驅動信號；一第五電阻，耦接於該第二脈寬調變器的該第一輸入端及其該第二輸入端之間；一第二電荷幫浦電路，具有一輸入端及一輸出端，該第二電荷幫浦電路依據其該輸入端的信號於其該輸出端輸出該閘極低電壓；一第六電阻，耦接於該第二脈寬調變器的該第二輸入端與該第二電荷幫浦電路的該輸出端之間；一第二電容，耦接於該第二脈寬調變器的該輸出端與該第二電荷幫浦電路的該輸入端。
- 如申請專利範圍第6項所述之顯示裝置，其中該第二電壓產生器更包括一第二熱敏電阻，並聯耦接該第五電 阻。
- 如申請專利範圍第7項所述之顯示裝置，其中該第二熱敏電阻為一負溫度係數的熱敏電阻。
- 如申請專利範圍第1項所述之顯示裝置，其中該閘極低電壓為一第三電壓。
- 如申請專利範圍第1項所述之顯示裝置，其中在該第一期間中，該閘極低電壓為一接地電壓，在該第一期間後，該閘極低電壓為一第三電壓。
- 如申請專利範圍第1項所述之顯示裝置，其中該第一電壓與該第二電壓間的壓差為大於等於2伏特。
- 如申請專利範圍第1項所述之顯示裝置，其中該第一期間為起始於該顯示裝置開機時。
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