TWI421849B - 液晶顯示裝置 - Google Patents

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TWI421849B TW99147051A TW99147051A TWI421849B TW I421849 B TWI421849 B TW I421849B TW 99147051 A TW99147051 A TW 99147051A TW 99147051 A TW99147051 A TW 99147051A TW I421849 B TWI421849 B TW I421849B
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Chun Hsin Liu
Kuo Chang Su
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Description

液晶顯示裝置
本發明係有關於一種液晶顯示裝置，尤指一種可減少像素驅動電路輸出端的薄膜電晶體尺寸的液晶顯示裝置。
在目前的液晶面板中，閘極驅動電路逐漸以和面板一同形成在玻璃基板上的方式在玻璃基板上設置積體電路晶片。閘極驅動陣列(gate driver on array,GOA)為一節省成本且不佔空間之技術，隨著面板的製造過程中，可利用非晶矽薄膜電晶體(a-Si TFT)來實現閘極驅動陣列，節省購置積體電路晶片的費用。但非晶矽薄膜電晶體的電氣特性不佳，具有載子遷移率(μ)過低、閥值電壓(Vth)的不穩定及驅動電流不足的缺點。
在新世代的顯示裝置中，高畫面更新率為一主要的趨勢，一級閘極驅動電路必須同時電連接兩條閘極驅動線，另外為了要解決色偏(washout)的問題，則必須另外再電連接兩條分配驅動線。因此，一級閘極驅動電路必須同時電連接四條驅動線，則輸出端的負載電容可能過大，造成閘極驅動電路設計上的困難。
本發明的一實施例提供一種液晶顯示裝置，此液晶顯示裝置包含複數級像素驅動電路及一個像素陣列，此複數級像素驅動電路中的每一個像素驅動電路具有四個輸出端，分別耦接於二條閘極線與二條分享線，以輸出二個主要輸出訊號及二個分配輸出訊號。每一個像素驅動電路包含一個閘極驅動電路及四個薄膜電晶體，此閘極驅動電路具有一個輸出端，用以提供一個輸出訊號，這四個薄膜電晶體的閘極係耦接於此閘極驅動電路的輸出端，這四個薄膜電晶體根據一個時脈訊號及此閘極驅動電路的輸出訊號，分別驅動這二個主要輸出訊號及這二個分配輸出訊號，其中這二個主要輸出訊號及這二個分配輸出訊號的相位、時序皆相同。此像素陣列包含複數級像素，其中每一個像素包含一個第一像素及一個第二像素，第一像素係用以接收這二個主要輸出訊號中的一個主要輸出訊號、一個分配輸出訊號及耦接於一條資料線；第二像素係用以接收和第一像素相同的主要輸出訊號，及耦接於此條資料線和第一像素，用以補償第一像素的電位。
本發明的另一實施例提供一種液晶顯示裝置。此液晶顯示裝置包含複數級像素驅動電路及一個像素陣列。此複數級像素驅動電路中的每一個像素驅動電路具有四個輸出端，分別耦接於二條閘極線與二條分享線，以輸出二個主要輸出訊號及二個分配輸出訊號。每一個像素驅動電路包含一個第一次像素驅動電路及一個第二次像素驅動電路。第一次像素驅動電路包含一個第一閘極驅動電路及二個第一薄膜電晶體，這二個第一薄膜電晶體的閘極係耦接於第一閘極驅動電路的輸出端。第二次像素驅動電路包含一個第二閘極驅動電路及二個第二薄膜電晶體，這二個第二薄膜電晶體的閘極係耦接於第二閘極驅動電路的輸出端，其中這二個主要輸出訊號及這二個分配輸出訊號的相位、時序皆相同。此像素陣列包含複數級像素，其中每一像素包含一個第一像素及一個第二像素。第一像素係用以接收這二個主要輸出訊號中的一個主要輸出訊號、一個分配輸出訊號及耦接於一條資料線；第二像素係用以接收和第一像素相同的主要輸出訊號，及耦接於此條資料線和第一像素，用以補償第一像素的電位。其中第一閘極驅動電路和第二閘極驅動電路相同。
本發明的另一實施例提供一種液晶顯示裝置，此液晶顯示裝置包含複數級像素驅動電路及一個像素陣列，此複數級像素驅動電路中的每一個像素驅動電路具有四個輸出端，分別耦接於二條閘極線與二條分享線，以輸出二個主要輸出訊號及二個分配輸出訊號，其中這二個主要輸出訊號及這二個分配輸出訊號的相位、時序皆相同。每一個像素驅動電路包含一個第一次像素驅動電路，第一次像素驅動電路包含一個第一閘極驅動電路及一個第一薄膜電晶體，第一薄膜電晶體具有一閘極，耦接於第一閘極驅動電路的輸出端，第一薄膜電晶體根據一個時脈訊號及此第一閘極驅動電路的輸出訊號，輸出一個主要輸出訊號。此像素陣列包含複數級像素，其中每一個像素包含一個第一像素及一個第二像素，第一像素係用以接收這二個主要輸出訊號中的一個主要輸出訊號、一個分配輸出訊號及耦接於一條資料線，第二像素係用以接收和第一像素相同的主要輸出訊號，及耦接於此條資料線和第一像素，用以補償第一像素的電位。
請參照第1圖，第1圖係為本發明的一實施例說明液晶顯示裝置100的示意圖。液晶顯示裝置100包含複數級像素驅動電路及像素陣列。如第1圖所示，像素驅動電路1020具有四個輸出端分別連接於兩條閘極線與兩條分享線，以輸出二主要輸出訊號Gn-1與Gn-2及二分配輸出訊號Sn-3與Sn-4；其中二主要輸出訊號Gn-1與Gn-2係用以開啟像素1039、1037，二分配輸出訊號Sn-3與Sn-4係用以對像素1035，1033執行電荷分享，且二主要輸出訊號Gn-1與Gn-2及二分配輸出訊號Sn-3與Sn-4的相位、時序皆相同。但本發明並不受限於二分配輸出訊號Sn-3與Sn-4對像素1035，1033執行電荷分享，像素1035、1033亦可由其他分配輸出訊號執行電荷分享。像素驅動電路1021具有四個輸出端分別連接兩條閘極線與兩條分享線，以輸出二主要輸出訊號Gn與Gn+1及二分配輸出訊號Sn-1與Sn-2；其中二主要輸出訊號Gn與Gn+1係用以驅動像素1041，1043，二分配輸出訊號Sn-1與Sn-2係用以對像素1039、1037執行電荷分享，但本發明並不受限於二分配輸出訊號Sn-1與Sn-2對像素1039、1037執行電荷分享，像素1039、1037亦可由其他分配輸出訊號執行電荷分享，且二主要輸出訊號Gn與Gn+1及二分配輸出訊號Sn-1與Sn-2的相位、時序皆相同。但本發明並不受限於二個像素驅動電路，以及六個像素。此外，如第1圖所示，D1和D2係為資料線，用以當像素被閘極線與分享線開啟時，將顯示資料所對應的電壓，對像素充電，以使像素呈現對應於顯示資料的亮度與色彩。
請參照第2圖和第3圖，第2圖係說明像素驅動電路1021的示意圖，第3圖係說明像素驅動電路1020的二主要輸出訊號Gn-1與Gn-2及二分配輸出訊號Sn-3與Sn-4的時序與像素驅動電路1021的二主要輸出訊號Gn與Gn+1及二分配輸出訊號Sn-1與Sn-2的時序之示意圖。如第2圖所示，像素驅動電路1021包含閘極驅動電路1022及四薄膜電晶體1024。閘極驅動電路1022包含上拉電路10222、下拉控制電路10224及下拉電路10226。上拉電路10222係用以接收像素驅動電路1020的主要輸出訊號Gn-1，並輸出閘極訊號GS至四薄膜電晶體1024的閘極；下拉控制電路10224係用以接收閘極訊號GS；下拉電路10226係用以根據下拉控制電路10224的輸出訊號，將四薄膜電晶體1024的源極的電位下拉至參考低電位，以關閉四薄膜電晶體1024。四薄膜電晶體1024的閘極皆耦接於閘極驅動電路1022的輸出端，四薄膜電晶體1024根據時脈訊號CK及閘極驅動電路1022輸出的閘極訊號GS，分別驅動二主要輸出訊號Gn與Gn+1及二分配輸出訊號Sn-1與Sn-2。因此，如第3圖所示，因為四薄膜電晶體1024皆耦接於閘極驅動電路1022的輸出端，所以其中二第n級主要輸出端Gn及二第m級分配輸出端Sm的輸出訊號的相位、時序皆相同，同理像素驅動電路1020的二主要輸出訊號Gn-1與Gn-2及二分配輸出訊號Sn-3與Sn-4的相位、時序亦皆相同。
請參照第4圖，第4圖係說明像素1039的示意圖。像素1039包含第一像素1042和第二像素1044。第一像素1042係用以接收像素驅動電路1020的主要輸出訊號Gn-1、像素驅動電路1021的分配輸出訊號Sn-1及耦接於資料線Dm，但像素1039並不受限於由分配輸出訊號Sn-1執行電荷分享；第二像素1044係用以接收像素驅動電路1020的主要輸出訊號Gn-1及耦接於資料線Dm和第一像素1042，用以補償第一像素1042的電位。第一像素1042包含二第二電容10422、二第三電容10424、第二開關10426及第三開關10428。第二像素1044包含二第一電容10442及第一開關10444。另外，像素1043、1041、1037、1035、1033和像素1039的結構相同，在此不再贅述。
請參照第5圖和第6圖，第5圖和第6圖係說明第一像素1042和第二像素1044的充電過程的示意圖。如第5圖所示，當主要輸出訊號Gn-1從邏輯低電位轉變成邏輯高電位時，第一開關10444被開啟，因此，資料線Dm的訊號透過第一開關10444將二第一電容10442充電至第一電位V1。此時，節點A的電位為第一電位V1。同理，第二開關10426被開啟。因此，資料線Dm的訊號透過第二開關10426對二第二電容10422充電至第一電位V1。此時，節點B的電位亦為第一電位V1。另外，第三開關10428係受分配輸出訊號Sn-1控制，此時分配輸出訊號Sn-1尚未致能，所以第三開關10428係為關閉狀態。如第6圖所示，當分配輸出訊號Sn-1的訊號從邏輯低電位轉變成邏輯高電位時(主要輸出訊號Gn-1已從邏輯高電位轉變成邏輯低電位，所以第一開關10444和第二開關10426被關閉)，第三開關10428被開啟，此時透過第三開關10428重新分配該二第一電容10442儲存的電荷及該二第三電容10424的電荷，導致節點A的電位下降以及節點B的電位提升。所以，藉由節點A的電位和節點B的電位不同，可解決液晶面板色偏(washout)的問題。
請參照第7圖，第7圖係為本發明的第二實施例說明像素驅動電路7021的示意圖。像素驅動電路7021包含第一次像素驅動電路7022及第二次像素驅動電路7024。第一次像素驅動電路7022包含第一閘極驅動電路70222及二第一薄膜電晶體70224，其中第一閘極驅動電路70222和閘極驅動電路1022相同，在此不再贅述。二第一薄膜電晶體70224的閘極係耦接於第一閘極驅動電路70222的輸出端，二第一薄膜電晶體70224根據時脈訊號CK及第一閘極驅動電路70222輸出的閘極訊號GS1，分別驅動主要輸出訊號Gn及分配輸出訊號Sn-1。第二次像素驅動電路7024包含第二閘極驅動電路70242及二第二薄膜電晶體70244，其中第二閘極驅動電路70242和閘極驅動電路1022相同，在此不再贅述。二第二薄膜電晶體70244的閘極係耦接於第二閘極驅動電路70242的輸出端，第二薄膜電晶體70244根據時脈訊號CK及第二閘極驅動電路70242輸出的閘極訊號GS2，分別驅動主要輸出訊號Gn+1及分配輸出訊號Sn-2。其中二第一薄膜電晶體70224和二第二薄膜電晶體70244的閘極所驅動的二主要輸出訊號Gn與Gn+1及二分配輸出訊號Sn-1與Sn-2的時序圖，請參照第3圖。但像素驅動電路7021並不受限於上述輸出訊號的方式，像素驅動電路7021的另一輸出訊號的方式係為第一次像素驅動電路7022輸出主要輸出訊號Gn及分配輸出訊號Sn-2和第二次像素驅動電路7024輸出主要輸出訊號Gn+1及分配輸出訊號Sn-1，或第一次像素驅動電路7022輸出主要輸出訊號Gn及Gn+1和第二次像素驅動電路7024輸出分配輸出訊號Sn-1及Sn-2。
請參照第8圖，第8圖係為本發明的第三實施例說明像素驅動電路9021的示意圖。第n級像素驅動電路9021包含第一次像素驅動電路9022、第二次像素驅動電路9024、第三次像素驅動電路9026及第四次像素驅動電路9028。第一次像素驅動電路9022包含第一閘極驅動電路90222及第一薄膜電晶體90224，其中第一閘極驅動電路90222和閘極驅動電路1022相同，在此不再贅述。第一薄膜電晶體90224具有一閘極，耦接於第一閘極驅動電路90222的輸出端，第一薄膜電晶體90224係根據時脈訊號CK及第一閘極驅動電路90222的輸出訊號GS1，驅動主要輸出訊號Gn。第二次像素驅動電路9024包含第二閘極驅動電路90242及第二薄膜電晶體90244，其中第二閘極驅動電路90242和閘極驅動電路1022相同，在此不再贅述。第二薄膜電晶體90244具有一閘極，耦接於第二閘極驅動電路90242的輸出端，第二薄膜電晶體90244根據時脈訊號CK及第二閘極驅動電路90242的輸出訊號GS2，驅動分配輸出訊號Sn-1。第三次像素驅動電路9026包含第三閘極驅動電路90262及第三薄膜電晶體90264，其中第三閘極驅動電路90262和閘極驅動電路1022相同，在此不再贅述。第三薄膜電晶體90264具有閘極，耦接於第三閘極驅動電路90262的輸出端，第三薄膜電晶體90264根據時脈訊號CK及第三閘極驅動電路90262的輸出訊號GS3，驅動主要輸出訊號Gn+1。第四次像素驅動電路9028包含第四閘極驅動電路90282及第四薄膜電晶體90284，其中第四閘極驅動電路90282和閘極驅動電路1022相同，在此不再贅述。第四薄膜電晶體90284具有閘極，耦接於第四閘極驅動電路90282的輸出端，第四薄膜電晶體90284根據時脈訊號CK及第四閘極驅動電路90282的輸出訊號GS4，驅動分配輸出訊號Sn-2。其中第一薄膜電晶體90224、第二薄膜電晶體90244、第三薄膜電晶體90264、第四薄膜電晶體90284的閘極所驅動的二主要輸出訊號Gn與Gn+1及二分配輸出訊號Sn-1與Sn-2的時序圖，請參照第3圖。但像素驅動電路9021並不受限於上述輸出訊號的方式。
請參照第9圖，第9圖係為本發明的第四實施例說明像素驅動電路10021的示意圖。第9圖的像素驅動電路10021包含第一次像素驅動電路10022、第二次像素驅動電路10024及第三次像素驅動電路10026。第一次像素驅動電路10022包含第一閘極驅動電路100222及第一薄膜電晶體100224，其中第一閘極驅動電路100222和閘極驅動電路1022相同，在此不再贅述。第一薄膜電晶體100224具有一閘極，耦接於第一閘極驅動電路100222的輸出端，第一薄膜電晶體100224係根據時脈訊號CK及第一閘極驅動電路100222的輸出訊號GS1，驅動主要輸出訊號Gn。第二次像素驅動電路10024包含第二閘極驅動電路100242及第二薄膜電晶體100244，其中第二閘極驅動電路100242和閘極驅動電路1022相同，在此不再贅述。第二薄膜電晶體100244具有一閘極，耦接於第二閘極驅動電路100242的輸出端，第二薄膜電晶體100244根據時脈訊號CK及第二閘極驅動電路100242的輸出訊號GS2，驅動分配輸出訊號Sn-1。第三次像素驅動電路10026包含第三閘極驅動電路100262及二第三薄膜電晶體100264，其中第三閘極驅動電路100262和閘極驅動電路1022相同，在此不再贅述。二第三薄膜電晶體100264具有閘極，耦接於第三閘極驅動電路100262的輸出端，二第三薄膜電晶體100264根據時脈訊號CK及第三閘極驅動電路100262的輸出訊號GS3，驅動主要輸出訊號Gn+1與Sn-2。其中第一薄膜電晶體100224、第二薄膜電晶體100244及二第三薄膜電晶體100264的閘極所驅動的二主要輸出訊號Gn與Gn+1及二分配輸出訊號Sn-1與Sn-2的時序圖，請參照第3圖。但像素驅動電路10021並不受限於上述輸出訊號的方式。
綜上所述，本發明所提供的液晶顯示裝置，係利用每一閘極驅動電路搭配四個薄膜電晶體、每一閘極驅動電路搭配二個薄膜電晶體或每一閘極驅動電路搭配一個薄膜電晶體，其中上述每一薄膜電晶體僅驅動像素驅動電路中的二主要輸出訊號及二分配輸出訊號的其中之一，且二主要輸出訊號及二分配輸出訊號的相位、時序皆相同。如此，可解決先前技術中輸出端的負載電容過大的問題，因此，本發明係將輸出端的薄膜電晶體一分為多，以縮小輸出端的薄膜電晶體的尺寸。
以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
100．．．液晶顯示裝置
1020、1021、7021、9021、10021．．．像素驅動電路
1043、1041、1039、1037、1035、1033．．．像素
1022．．．閘極驅動電路
1024．．．薄膜電晶體
70222、90222、100222．．．第一閘極驅動電路
70242、90242、100242．．．第二閘極驅動電路
90262、100262．．．第三閘極驅動電路
90282．．．第四閘極驅動電路
70224、90224、100224．．．第一薄膜電晶體
70244、90244、100244．．．第二薄膜電晶體
90264、100264．．．第三薄膜電晶體
90284．．．第四薄膜電晶體
10222．．．上拉電路
10224．．．下拉控制電路
10226．．．下拉電路
1042．．．第一像素
1044．．．第二像素
10442．．．第一電容
10422．．．第二電容
10424．．．第三電容
10444．．．第一開關
10426．．．第二開關
10428．．．第三開關
7022、9022、10022．．．第一次像素驅動電路
7024、9024、10024．．．第二次像素驅動電路
9026、10026．．．第三次像素驅動電路
9028．．．第四次像素驅動電路
A、B．．．節點
CK．．．時脈訊號
D1、D2、Dm．．．資料線
Gn+1、Gn、Gn-1、Gn-2．．．主要輸出訊號
Sn-1、Sn-2、Sn-3、Sn-4．．．分配輸出端
GS、GS1、GS2、GS3、GS4．．．閘極訊號
第1圖係為本發明的一實施例說明液晶顯示裝置的示意圖。
第2圖係說明像素驅動電路的示意圖。
第3圖係說明像素驅動電路的二主要輸出訊號及二分配輸出訊號的時序之示意圖。
第4圖係說明像素的示意圖。
第5圖和第6圖係說明第一像素和第二像素的充電過程的示意圖。
第7圖係為本發明的第二實施例說明像素驅動電路的示意圖。
第8圖係為本發明的第三實施例說明像素驅動電路的示意圖。
第9圖係為本發明的第四實施例說明像素驅動電路的示意圖。
1021．．．像素驅動電路
1022．．．閘極驅動電路
1024．．．薄膜電晶體
10222．．．上拉電路
10224．．．下拉控制電路
10226．．．下拉電路
CK．．．時脈訊號
Gn、Gn+1．．．主要輸出訊號
GS．．．閘極訊號
Sn-1、Sn-2．．．分配輸出訊號

Claims (16)

  1. 一種液晶顯示裝置，包含：複數級像素驅動電路，其中每一像素驅動電路具有四輸出端，分別耦接於二閘極線與二分享線，以輸出二主要輸出訊號及二分配輸出訊號，該像素驅動電路包含：一閘極驅動電路，具有一輸出端，用以提供一輸出訊號；及四薄膜電晶體，該四薄膜電晶體的閘極耦接於該閘極驅動電路的輸出端，該四薄膜電晶體根據一時脈訊號及該閘極驅動電路的輸出訊號，分別輸出該二主要輸出訊號及該二分配輸出訊號，其中該二主要輸出訊號及該二分配輸出訊號的相位、時序皆相同；及一像素陣列，包含複數級像素，其中每一像素包含：一第一像素，用以接收該二主要輸出訊號中的一主要輸出訊號、該像素驅動電路的下一級像素驅動電路之二分配輸出訊號中的一分配輸出訊號及耦接於一資料線；及一第二像素，用以接收該二主要輸出訊號中的該主要輸出訊號，及耦接於該資料線和該第一像素，以補償該第一像素的電位。
  2. 如請求項1所述之液晶顯示裝置，其中該第二像素包含：二第一電容；及一第一開關，具有一控制端，用以根據該主要輸出訊號和該資料線的訊號，以對該二第一電容充電至一第一電位。
  3. 如請求項1所述之液晶顯示裝置，其中該第一像素包含：二第二電容；二第三電容；一第二開關，具有一控制端，用以根據該主要輸出訊號和該資料線的訊號對該二第二電容充電至該第一電位；及一第三開關，具有一控制端，用以根據該下一級像素驅動電路之該分配輸出訊號，藉由該二第三電容，重新分配該二第一電容儲存的電荷及該二第三電容的電荷。
  4. 如請求項1所述之液晶顯示裝置，其中該閘極驅動電路包含：一上拉電路，用以接收一前一級像素驅動電路的主要輸出訊號，並輸出一閘極訊號至該四薄膜電晶體的閘極；一下拉控制電路，用以接收該閘極訊號；一下拉電路，用以根據該下拉控制電路的輸出訊號，以關閉該四薄膜電晶體。
  5. 一種液晶顯示裝置，包含：複數級像素驅動電路，其中每一像素驅動電路具有四輸出端，分別耦接於二閘極線與二分享線，以輸出二主要輸出訊號及二分配輸出訊號，其中該二主要輸出訊號及該二分配輸出訊號的相位、時序皆相同，該像素驅動電路包含：一第一次像素驅動電路，包含：一第一閘極驅動電路；及二第一薄膜電晶體，該二第一薄膜電晶體的閘極耦接於該第一閘極驅動電路的輸出端；及一第二次像素驅動電路，包含：一第二閘極驅動電路；及二第二薄膜電晶體，該二第二薄膜電晶體的閘極耦接於該第二閘極驅動電路的輸出端；及一像素陣列，包含複數級像素，其中每一像素包含：一第一像素，用以接收該二主要輸出訊號中的一主要輸出訊號、該像素驅動電路的下一級像素驅動電路之二分配輸出訊號中的一分配輸出訊號及耦接於一資料線；及一第二像素，用以接收該二主要輸出訊號中的該主要輸出訊號、及耦接於該資料線和該第一像素，用以補償該第一像素的電位。
  6. 如請求項5所述之液晶顯示裝置，其中該二第一薄膜電晶體係根據一時脈訊號及該第一閘極驅動電路的輸出訊號，分別輸出該二主要輸出訊號中的一主要輸出訊號及該二分配輸出訊號中的一分配輸出訊號，以及該二第二薄膜電晶體根據該時脈訊號及該第二閘極驅動電路的輸出訊號，分別輸出該二主要輸出訊號中的另一主要輸出訊號及該二分配輸出訊號中的另一分配輸出訊號。
  7. 如請求項5所述之液晶顯示裝置，其中該二第一薄膜電晶體係根據一時脈訊號及該第一閘極驅動電路的輸出訊號，輸出該二主要輸出訊號，以及該二第二薄膜電晶體根據該時脈訊號及該第二閘極驅動電路的輸出訊號，輸出該二分配輸出訊號。
  8. 如請求項5所述之液晶顯示裝置，其中該第二像素包含：二第一電容；及一第一開關，具有一控制端，用以根據該主要輸出訊號和該資料線的訊號對該二第一電容充電至一第一電位。
  9. 如請求項5所述之液晶顯示裝置，其中該第一像素包含：二第二電容；二第三電容；一第二開關，具有一控制端，用以根據該主要輸出訊號和該資料線的訊號，對該二第二電容充電至該第一電位；及一第三開關，具有一控制端，用以根據該下一級像素驅動電路之該分配輸出訊號，藉由該二第三電容，重新分配該二第一電容儲存的電荷及該二第三電容的電荷。
  10. 如請求項5所述之液晶顯示裝置，其中該第一閘極驅動電路包含：一上拉電路，用以接收一前一級像素驅動電路的主要輸出訊號，並輸出一閘極訊號至該二第一薄膜電晶體的閘極；一下拉控制電路，用以接收該閘極訊號；一下拉電路，用以根據該下拉控制電路的輸出訊號，以關閉該二第一薄膜電晶體。
  11. 一種液晶顯示裝置，包含：複數級像素驅動電路，其中每一像素驅動電路具有四輸出端，分別耦接於二閘極線與二分享線，以輸出二主要輸出訊號及二分配輸出訊號，其中該二主要輸出訊號及該二分配輸出訊號的相位、時序皆相同，該像素驅動電路包含：一第一次像素驅動電路，包含：一第一閘極驅動電路；及一第一薄膜電晶體，具有一閘極，耦接於該第一閘極驅動電路的輸出端，該第一薄膜電晶體根據一時脈訊號及該第一閘極驅動電路的輸出訊號，輸出該二主要輸出訊號中的一主要輸出訊號；及一像素陣列，包含複數級像素，其中每一像素包含：一第一像素，用以接收該二主要輸出訊號中的一主要輸出訊號、該像素驅動電路的下一級像素驅動電路之二分配輸出訊號中的一分配輸出訊號及耦接於一資料線；及一第二像素，用以接收該二主要輸出訊號中的該主要輸出訊號、及耦接於該資料線和該第一像素，用以補償該第一像素的電位。
  12. 如請求項11所述之液晶顯示裝置，其中該像素驅動電路另包含：一第二次像素驅動電路，包含：一第二閘極驅動電路；及一第二薄膜電晶體，具有一閘極，耦接於該第二閘極驅動電路的輸出端，該第二薄膜電晶體根據該時脈訊號及該第二閘極驅動電路的輸出訊號，輸出該二分配輸出訊號中的一分配輸出訊號；一第三次像素驅動電路，包含：一第三閘極驅動電路；及一第三薄膜電晶體，具有一閘極，耦接於該第三閘極驅動電路的輸出端，該第三薄膜電晶體根據該時脈訊號及該第三閘極驅動電路的輸出訊號，輸出該二主要輸出訊號中的另一主要輸出訊號；及一第四次像素驅動電路，包含：一第四閘極驅動電路；及一第四薄膜電晶體，具有一閘極，耦接於該第四閘極驅動電路的輸出端，該第四薄膜電晶體根據該時脈訊號及該第四閘極驅動電路的輸出訊號，輸出該二分配輸出訊號中的另一分配輸出訊號。
  13. 如請求項11所述之液晶顯示裝置，其中該第n級像素驅動電路另包含：一第二次像素驅動電路，包含：一第二閘極驅動電路；及一第二薄膜電晶體，具有一閘極，耦接於該第二閘極驅動電路的輸出端，該第二薄膜電晶體根據該時脈訊號及該第二閘極驅動電路的輸出訊號，輸出該二主要輸出訊號中的另一主要輸出訊號；一第三次像素驅動電路，包含：一第三閘極驅動電路；及二第三薄膜電晶體，具有一閘極，耦接於該第三閘極驅動電路的輸出端，該二第三薄膜電晶體根據該時脈訊號及該第三閘極驅動電路的輸出訊號，輸出該二分配輸出訊號。
  14. 如請求項11所述之液晶顯示裝置，其中該第二像素包含：二第一電容；及一第一開關，具有一控制端，用以根據該主要輸出訊號和該資料線的訊號對該二第一電容充電至一第一電位。
  15. 如請求項11所述之液晶顯示裝置，其中該第一像素包含：二第二電容；二第三電容；一第二開關，具有一控制端，用以根據該主要輸出訊號和該資料線的訊號對該二第二電容充電至該第一電位；及一第三開關，具有一控制端，用以根據該下一級像素驅動電路之該分配輸出訊號，藉由該二第三電容，重新分配該二第一電容儲存的電荷及該二第三電容的電荷。
  16. 如請求項11所述之液晶顯示裝置，其中該第一閘極驅動電路包含：一上拉電路，用以接收一前一級像素驅動電路的主要輸出端的輸出訊號，並輸出一閘極訊號至該第一薄膜電晶體的閘極；一下拉控制電路，用以接收該閘極訊號；一下拉電路，用以根據該下拉控制電路的輸出訊號，以關閉該第一薄膜電晶體。
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