TW525120B - Method for driving an AC type PDP - Google Patents

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TW525120B TW089124390A TW89124390A TW525120B TW 525120 B TW525120 B TW 525120B TW 089124390 A TW089124390 A TW 089124390A TW 89124390 A TW89124390 A TW 89124390A TW 525120 B TW525120 B TW 525120B
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Akira Otsuka
Takashi Sasaki
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Fujitsu Hitachi Plasma Display
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Description

525120 A7 __B7 五、發明說明（1 本發明係有關於一種AC型PDP(電漿顯示面板Plasma Display Panel)之驅動方法。 就PDP而言，隨著大型化與高精密化之所致，消耗電 力之增加已成為其驅動$置之設計及發熱對策上之一大問 題。於今實有必要在維持亮度下，將其消耗電力抑制於與 CRT相同之程度。 AC型PDP係藉介電體覆蓋顯示電極而構成，以使其在 構造上具有記憶機能者。而所謂顯示電極則為：於顯示放 電一即為點亮（發光）而放電一時構成陽極或陰極之電極。 而於衫色PDP之代表例「3電極面放電型」中，則配設有一 與此等顯示電極相交叉以供編址用之位址電極。 第10圖係習知之AC型PDP驅動方法之概念圖，圖中例 示了顯示放電之電壓推移情形。 以AC型PDP遂行顯示時，係先進行編址（以心以“即）， 而僅使須點亮之胞元形成充分帶電之狀態，其後，再對胞 拳 元施加交變極性之維持脈衝列。 習知之維持脈衝，其波高值一即維持電壓一 Vs，係滿 足下式者。
Vf — Vw < Vs < Vf Vf ·放電開始電壓 V w :壁電壓 在壁電荷存在之胞元中，由於壁電壓Vw重疊於外加電 壓乂丨’故，加於胞元之胞元電壓（亦稱有效電壓）vc將超越 放電開始電壓Vf、引起放電，而行發光。由於因放電而再 表纸張义度ϋ另國家標準（CNS)A4規格（21〇x 297公查~ 525120
發明說明（ 形成之壁電荷其極性與前此之極性相反，因此，隨著此壁 電荷·之再形成，胞元電壓V c將降低而停止放電。然而，因 其後外加私壓Vi仍將暫時保持於維持電壓Vs，故，空間電 何將被吸引而向顯示電極靠近，進行壁電荷之蓄積。習知 方法之特徵在於’為使其帶有充足之壁電荷，故將維持脈 衝之脈衝幅度Tc’置於3〜4 # s程度之較長時間。在隨放電 而發生空間電荷（亞穩粒子）下雖會使放電開始電壓Vf表面 上下降一紐暫時間，但當維持脈衝下降時，即回復至約為 原本之程度其後，若施加與前此相反極性之維持脈衝， 則將再-人產生放電，開始壁電荷之再形成。之後，每次施 加同樣之維持脈衝時均將產生放電。因放電之週期為4〜5 V s程度，故，視覺上為連續點亮。 另一方面，DC型PDP係將充分之高電壓施加於胞元以 產生放電後，施加一週期較空間電荷之消失時間更短之脈 衝列以維持其於點壳之狀態，即，使用所謂脈衝記憶驅 動^法。兩，曰本專利公開公報特開平丨丨一 2824丨5號中則載 有種將此脈衝記憶驅動法應用於ac：型pop上之技術，其 中段洛號碼01 12〜01 16及第6圖即明確指出了一種施加脈 衝幅度為1.3 W休止期間〇·7 v s之交變極性之維持脈衝列 的驅動形態。最初由於維持脈衝之突昇（前緣）而產生放 包、形成壁電荷，又由於突降（後緣）而藉壁電荷產生自己 消去放電。而於仍殘留有藉該自己消去放電而形成之空間 電荷時，施加第二個維持脈衝，而依次產生實質上並未依 賴壁電荷之前緣放電及藉壁電荷放電之後緣放電。之後， --------^---------^ (請先閱讀背面之注意事項再填寫本頁)
525120 A7
經-部智"財產局員工^費人口作:1口別代 而 相同的於施加每-維持脈衝時皆各產生2次放電。 AC型潰有-已知之事實，即「若將顯示放電之外加 電壓減低’而使放電強度變小，則發光效轉提高」。提 高之理由可列舉如下’即：因驅動回路及顯示電極之電阻 所造成之電力損失將減少，以及氣體發光或螢光體發光之 激發飽和將減輕.·等。然而，若單純的將外加電壓降低， 則將損及顯示之安定性。|以低外加電壓確實驅動此^型 PDP ’則胞元構造及材料之選定勢必要大幅修正，即，實 際上，單純將外加電壓減低實難提高發光效率。 在使用第_所說明之習知AC型⑽驅動方法（以下 稱為壁電荷記憶驅動法）時，為避免產生顯示放電時造成面 板及驅動回路過熱，每丨影面僅能施加1〇〇〇對程度（將第ι 極性之脈衝與其次之第2極性之脈衝作為丨對計算）之維持 脈衝。為確保維持脈衝之脈衝幅度的脈衝數，其上限亦為 1000對程度。因有此種脈衝數之限制，因此，無法，中'麻的 再現亮度範圍之階調，尤其是低亮度者。 ， 又，依該日本專利公開公報特開平1 1 — 28241 5號所載 之驅動方法，為形成自己消去放電所產生之多量壁電荷’ 勢須設定與其相稱之脈衝幅度及波高值。就脈衝幅度 =與壁電荷记憶驅動法相較，雖可大幅縮短，但就外办 電壓之減低（發光效率之提高）而言，則難有顯著之效果。 有鑑於此，本發明之目的即在於盡量以低電壓產生顯 示放電而減低消耗電力，藉此提高發光效率。另一目的則 在於使動畫之偽輪廓不明顯，以實現顯示時之高品位化。 (210x297 公釐） •裝--------訂--------- (請先閱讀背面之；Η意事項再填寫本頁) 525120
本發明係如第1圖所示’利用壁電荷與空間電荷雙方連 Μ產生複數次之顯示放電。由於利用了壁電荷，故可於顯 不電極間施加波形為交變極性之電壓脈衝列之驅動電壓 Vi，且於每次產生顯示放電時，使該顯示電極間之壁電壓 Vw極性反轉。於典型之胞元構造條件中，若各次之顯示放 電後之電荷蓄積時間Ta為〇.3/zs以上’則可於下次之顯示 放電开y成必要薏之壁電荷。若放電後之經過時間約為2以S 以内，則可藉足夠量之空間電荷產生有效充注效果。因此， 顯示放電之週期TC之值宜為0.3〜2/zs之範圍内。又，譬如 為防止驅動裝置之短路而設置—休止期間Tb，於此期間中 經濟部智慧財產局§'工消費合泎社.印 將外加電壓置於接地水準時，為避免壁電荷中和而消失， 則須將休止期間Tb置於〇·3//S以下。 使用AC型PDP%，因壁電荷之形成會使胞元電壓下 降，故顯示放電無法持續。因此，即使將適用sDc型之脈 衝記憶驅動法直接使用於从型，亦難獲得安定之驅動。皇 係因空間電荷量易產生偏差之故。且壁電荷之存在亦構成 了不安定之原因。而於本發明中，則積極利用壁電荷，以 發揮AC型之特質。 如第1圖所示，放電開始電壓Vf之值因空間電荷而由 Vfl降至Vf2’且於產生適度壁電壓^之狀態下，開始施加 電魏衝列（Vi)。僅放電開始電㈣降低之部分，以較壁 電荷記憶㈣法更低之電壓引起顯示放電。即，可減低放 電強度以提高發光效率。因脈衝後緣之 多，因此，並不會引起自己消去放電，而殘留有壁電;:甚 ^--------^---------^ (請先閱讀背面之注意事項再填寫本頁)
(cns)A4 297公釐） 525120 經濟部智慧財產局員工消費合作让印裂 A7 B7 五、發明說明（5 ) 若由於顯示放電所產生之空間電荷而於放電開始電壓Vf 保持於低電壓之狀態下施加與前此相反極性之脈衝，則將 再次以較壁電荷記憶驅動法更低之電壓引起顯示放電。以 下則將本發明可如此地產生依亮度所需回數之顯示放電的 驅動方法稱為“ AC脈衝記憶驅動法”。 使用AC脈衝記憶驅動法時，因顯示放電之週期Tc，即 使為最大值，亦僅為2 // s程度，可將放電強度減小以抑制 其發熱，故不論是時間上或電力上，脈衝數之限制皆甚為 溫和。具體而言，每1影面可施加2〇〇〇對之脈衝。此舉將可 大幅改善其階調性。 施加於PDP之電壓脈衝之波形雖將因電阻•電感•浮 遊容量等而變形，但放電電流越小，變形將越輕微，動作 電壓界限及亮度對顯示負荷率之依存關係將減小。使用Ac 脈衝記憶驅動時，與壁電荷記憶驅動相較，其丨次之放電電 流可減小30〜50%程度，尖峰電流亦可減小至相同程度。若 尖峰電流減小，就算驅動回路及面板之電阻增大，亦可得 良好之動作/顯示特性，故，可使用更小型之電源/驅動零 件，或使電極之膜厚薄化··等，以使顯示裝置之價格降 低。 〔裝置構成〕 第2圖係有關於本發明之顯示裝置之構成圖。 顯不裝置1〇〇係由AC型PDP1及傳動裝置7〇所組成，而 AC型PDP1具有一 3電極面放電構造面之畫面，其係由n 個胞tl所構成，而傳動裝置7〇則係使各個胞元選擇的發光 財國 S 家標準---- I *ϋ n an amat n ·ϋ an n ί · I 1« §mMmm ϋ n n 一 0, · mub μη mm mb am· mim 確 Φ. (請先閱讀背面之注意事項再填寫本頁) 發明說明（6 ) 者，利用於壁式電視螢光屏、電腦系統之螢幕等。 PDP1之顯示電極χ及顯示電極γ皆向同一方向（在此為 水平方向）㈣，藉互相相鄰之—對的顯示電極χ、γ進行i 個顯示列之發光控制。並且，為選擇顯示列的各個胞元， 位址電極A以與顯示電極***叉之狀配置。 傳動衣置70具有擔任驅動控制之控制回路”、電源回 路73、X傳動器74、Y傳動器77 置70中，由電視頻道選擇器、電 、及位址傳動器80。傳動裝 腦等外部裝置所顯示之r、 G B一色度程度之多值畫像資料，即框架資料d卜係與 各種同期信號共同輸入。控制回路71具有可暫時記憶框架 資料Df之框架記憶711 m憶驅動電壓控制資料之波 形記憶7 12。 眾所周知藉PDP之顯示中，因以2值之發光控制進行 階調再現，故將輸入畫像之時序框架或構成該者之影面（輸 入為夾層形式之場合）分割為規定數之副影面。框架資料 Df收藏於框架記憶71丨一短暫時間後，將變換為階調顯示 之副影面資料Dsf，且轉送至位址傳動器8〇。副影面資料 Dsf係表示q個副影面之q位元顯示資料（可說每丨胞元中，i 位το之顯不貧料聚集q畫面分），而副影面為析像清晰度⑺ X η之2值畫像。副影面資料Dsf之各位元值係表示於符合之 1個副影面中胞元之發光與否，嚴格為表示位址放電與否。 X傳動為7 4係總括控制n根顯示電極X之電位。γ傳動 裝置77仏由編址之掃瞒回路π及顯示放電之共通傳動器乃 所構成。掃猫回路7 8係選擇顯示列之掃瞄脈衝施加裝置。 經濟部智慧时4局_'工消f合作让0-¾ 525120 A7 --------B7 五、發明說明（7 ) 位址傳動器80係基於副影面資料Dsf控制總計爪根位址電 極A之電位。此等傳動器係由電源回路73透過配線導體（無 圖示）供給預定之電力。 第3圖係表示本發明之pDp胞元構造之圖。於第3圖 中，為顯示内部構造，故將一對之基板構體以分離狀態來 描緣。 P D P 1係由對之基板構體（於基板上設置放電胞元之 構成要素的構造體）1〇、2〇所構成。顯示電極χ、γ配置於 前面惻玻璃基板1 1之内部，分別皆由形成面放電間隙之透 月導私膜4 1及検跨畫面水平方向全長延伸的金屬膜（匯流 排）42所構成。設置厚度為3〇〜5〇//111程度之介電體層η以 覆蓋顯示電極X、Υ，介電體層17表面黏附有作為保護膜18 之氧化鎂（M g Ο)。位址電極Α配置於背面側玻璃基板2丨之内 部，亚以介電體層24覆蓋。介電體層24上排列有高度為15〇 Am程度之帶狀間壁29，並藉該等間壁”於每列區劃放電 空間。相對應於放電空間中各列之列空間31跨過所有的顯 示列且連續。設置彩色顯示之R、G、B三色營光體層2叹、 2 8G、28B ’以覆蓋包含間壁29側面之背面側的内面。圖中 之斜體字母R、G、B係表示螢光體之發光色。螢光體層 28R、28G、28B係因放電氣體所放出之紫外線而局部❹ 發、發光。又，就間壁而言，亦可以放電胞元將放電空間 區劃成格子形狀。 〔驅動方法〕 【貫施例1】 (請先閱讀背面之注意事項再填寫本頁) --------訂---------
P
525120
^-----------------線 (請先閱讀背面之注意事項再填寫本頁) 525120 經濟部智祛財產局員工消費合作钍印製 時 A7 五、發明說明（9 ) 後的脈衝％加相配合，迅速開始放電。於安定化期間TSs 的最後施加脈衝幅度為1 # S之維持電壓脈衝Psd，並以壁電 荷記憶驅動形式確實引起發電後，立即於X— Y間施加相反 極性之電壓脈衝¥(1，且移行至AC脈衝記憶驅動。由於放電 後空間電荷即立刻存在，因此，可以較壁電荷記憶驅動之 維持電壓Vs低10〜30%之低電壓引起放電。若以2^s以下 之週期施加交變極性之電壓脈衝列，則顯示放電將持續。i 次顯示放電之發光強度雖為壁電荷記憶驅動之發光強度的 一半程度，但因放電週期短，故可藉增加脈衝數以得較壁 電荷記憶驅動更高之高亮度。 本實施例與習知之壁電荷記憶驅動法同樣的經過初期 化/編址/顯示放電之過程，但因放電條件安定的移行至AC 脈衝記憶驅動，故雖使用與習知者幾乎相同之驅動回路， 但仍可藉AC脈衝記憶驅動的優點，即發光效率之提昇· + 峰電流減低·補充脈衝數等，謀求階調特性之提高。 第5圖係表示副影面顯示順序其中一例之圖。以圖中之 四角形所框圍之數字（1，2,4,8，16,32)及添加於保持期間參 照符號TS之數字（1，2,4,8，16,32)，係表示相當於副影面亮产
之重度。 X 一般，ADS型式之階調顯示係同時顯示各副影面丨畫面 分之全體。相對於Λ，圖*之保持係以各副影面所表:之 列單位區分為複數部分，並以部分單位錯開顯示時間。· 將顯示列分為與副影面數（此處為6)相同數目之組。此 雖可照排列順序分別分為一定之數， 仁各組所屬之顯 义纸張（变由㈣國家標準（CNS)A4i格（210 X 297公爱 裝--------訂--------- (請先閲讀背面之注意事項再填寫本頁) 525120 A7 B7 Φ 五、發明說明（ 不列順位宜不照順序。使用構成為可變更施加於每組χ — γ 間之脈衝數的傳動裝置，將1副影面分之分配期間Tf分割為 T1〜T6六個期間。 T1〜T6各期間係顯示各組中，由副影面各自相異之6個 副影面挑選出與各組相對應之部分，且組合成畫像資料（將 此稱為“混成副影面”）。τ 1〜T6各期間係與第4圖之副影 面期間Tsf相當，且係由重整期間tr、位址期間τα、及保 持期間TS所構成。不過，保持期間丁5之長度為每組皆相異。 對於組1，2,3,4,5,6，將於保持期間所施加之電壓脈衝數 之比率轉換為 T1 期間 1/2/4/8/16/32、T2期間 32/1/2/4/8/16、 T3期間1 6/3 2/1/24，並以T1〜T6六個期間之總和進行64階調 顯示。若依此，因每組動畫偽輪廓之顯現方式皆相異，故 可以組群相互打消動晝偽輪廓，結果將使顯示品質改善。 不過，因六個期間T1〜丁6之任一者皆須以最大亮度之副影 面表示時間，故，若顯示列數目變多則驅動時間將不足。 此犄，有效之解決方法為將組數減少，並分散動晝偽輪廓 最易發生之階調範圍。組數不需與副影面數相同。譬如， 為將驅動回路簡單化，分為奇數數目之顯示列組與偶數數 目之顯示列組，即使其中一組以重量表示為1/8/16/32/4/2 之順序的6個副影面，另一組以2/4/32/16/8/1之順序顯示副 影面亦可減低動畫偽輪廓。 【實施例2】 第6圖係實施例2之電壓波形圖。 副影面期間Tsf係由重整期間TR、及與編址並行且進 -------------裝·-------訂---------線 (請先閱讀背面之注意事項再填寫本頁) Φ 關緖準（CNS)A4 規格（210— X 297公釐） -13- 525120 A7 五、發明說明（U ). 行AC脈衝記憶驅動之位，止·保持期間咖斤構成。 於重整期間TR中，譬如藉由於顯示電極X施加脈衝 Pr’於所有χ—γ間添加較放電開始電壓高甚多之高電壓 (譬如3〇0伏特）、產生放電後，花3〇心以上之時間使施加 電[緩杈下降。藉此’於覆蓋顯示電極X、Y之介電體層形 成多量壁電荷，且產生接近於放電開始電壓之壁電壓。以 此狀態移行至位址•保持期間Τη。 位址•保持期間TH係於位址之選擇順序上將時間錯 開，且對各顯示列開始電壓脈衝（波高值13〇伏特/脈衝幅度 S)之屹加。雖開始後立即產生過剩放電，但將漸成為恰 當之顯示放電。最初數發脈衝電壓以將使放電安定化。錯 開施加開始且使安定化之脈衝數一致，則可謀求顯示列群 允度之均勻化。若所有的顯示列皆同時開始安定化，則位 址順位越下位者安定化之脈衝數越增加，背景發光亦將增 大。如此進行放電之安定化後，施加波高值較電壓脈衝pd 約低2/3之掃瞄脈衝Py a，且進行顯示列之選擇，與此同期 且隨選擇顯示列之副影面資料，於位址電極A施加波高值 約60伏特之位址脈衝Pa。此係消去形式之編址。僅施加位 址脈衝Pa之胞元將持續顯示放電，其他胞元則停止放電。 若將1 >肖去壁電荷之非發光胞元儲有與發光胞元相反極性之 壁電荷’則’即使於非發光胞元以半選施加位址電壓Va亦 不會引起放電。顯示電極X於該期間TH中施加恆常的電壓 脈衝Pd ’改變施加於顯示電極γ之電壓脈衝pd數’且控制 亮度。 夂纸5义艾適冃由國國豕標準（CNS)A4規格（21〇 X 297公釐） -14- -----------1^1^·裝--------訂--------- (請先閱讀背面之注意事項再填寫本頁) 525120
【實施例3】 第7圖係實施例3之電壓波形圖。 (請先閒讀背面之注意事項再填寫本頁) 進行與實施例2相同之消去形式編址後，進而進行至少 一次之編址（消去形式）。於圖示之例中，第丨次電荷未消去 而第2次消去之胞元的顯示亮度係以施加於消去前之電極 脈衝Pd數決定。不論第1次或第2次任一次之編址，壁電荷 皆未消去之胞元的顯示亮度係以施加於位址•保持期間丁H 之電極脈衝Pd總數決定。顯示之階調數為以副影面分割所 决疋之數乘以母一副影面之編址次數之值。 於本實.施例，每一編址與進行初期化之場合相較，因 母1框木之初期化數減少，故，背景發光之亮度將低下且對 比提升。 【實施例4】 第8圖係表示實施例4之副影面顯示順序之圖。 經濟部智慧財產局員工消費合汴社印 與第5圖相同，將顯示列分為與副影面數同樣數目（此 為6 )之組’由6個副影面挑選出與各組對應之部分且組合。 即’將6個副影面重組為6個混成副影面msfl〜msf6，且以 此顯示。第5圖之例中，每一混成副影面皆分配獨立之期間 T1〜T6，但本實施例則依次連續進行混成副影面msfl〜msf6 之編址’且由結束之顯示列逐次的開始A C脈衝記憶驅動。 各混成副影面與其次之混成副影面之顯示時期皆重疊。 影面期間丁f之長度係由計6次編址所需之時間，及於最 後顯示之混成副影面msf6中，被編址之組6的保持期間ts 1 長度之和所構成。因此，當設定顯示順序時，將最後之混 -15· 大紙張適用由國國家標準（CNS)A4規格（210 X 297公釐） 525120 五、發明說明（13 ) 成副影面msf6的最後之組6設定為亮度重度最小之副影 面。藉此，因分配編址之可能時間變長，故可增加副影面 數、進行更多階調。 第9圖係實施例4之電壓波形圖。 於X— Y間施加重整脈衝prw，且於自己消去後立刻施 加AC脈衝記憶驅動用之電壓脈衝Vd。停止放電一短暫時間 後，於顯示電極X施加電壓脈衝Vd、於顯示電極丫施加脈 衝掃聪脈衝Py、於以副影面決定之特定位址電極A施加位 址脈衝Pa ’產生位址放電。且’於因位址放電之空間電荷 而變為易產生放電之期間内，開始電壓脈衝列之施加，且 產生對應亮度次數之顯示放電。 於本例中，因同時進行於一個組產生放電和其他組之 編址，故與ADS形式相較其可高速驅動。位址速度為h 列2// s程度，若顯示列數為1〇〇〇時，不將畫面上下分割， 而可於1 6.7ms之影面期間進行8副影面256階調顯示。 於混成副影面重組且分散副影面有一優點，即：添加 於動晝偽輪廓之低減，副影面期間Tf的一個時期之電力耗 經濟部智慧財產局3、工消費合作社印製 費偏頗將使電流集中現象將消失。即，藉電容器之瞬時電 2供給將是為可能，且，因對變壓器與晶體管之電流供給 (1疋負何）之要求緩和，故可藉小型電源回路且低價 格化之裝置構成。 二防止半選之失决玫電，宜於編址前及電壓脈衝 列之施加結束時，將帶電狀沉盡量設定為同樣之電壓。又， 於利用壁電荷之从脈衝記憶驅動中，對應亮度之次數顯示 525120
^濟部%*1〕^4局3'工消費合作社^U A7 B7 五、發明說明（） 放電結束後所殘留之壁電荷將招致失誤動作。尤其由放電 領缚剝離之附著於壁面的壁電荷，於初期化中並未中和而 易於殘留。將殘留壁電荷抑制於微量之有效對策為，使重 整脈壓Ρην之極性於每一影面反轉，或使電壓脈衝列之最 終脈衝極性定期反轉等。 【發明效果】 如依申請專利範圍第丨至第10項，本發明係以較習知者 更低之電壓產生顯示放電、減低耗費電力，藉此可提高發 光效率。 如依申請專利範圍第5至第9項，本發明於使動畫之偽 輪廓不明顯，以實現顯示時之高品味化。 如依申請專利範圍第6項，本發明將框架分割為更多之 副影面，且可提高階調性。 如依申請專利範圍第8項，本發明減少隨不需要發光之 初期化次數，且可減低背景發光、提高對比。 如依申請專利範圍第10項，本發明可將動畫之偽輪廓 更確實的減低。 【圖式之簡單說明】 第1圖係本發明AC脈衝記憶驅動之概念圖。 第2圖係本發明顯示裝置之構成圖。 第3圖係表示本發明p]DP之胞元構造之圖。 第4圖係實施例1之電壓波形圖。 第5圖係表示副影面顯示順序之其中一例之圖。 (CNS)A4 (210 x 297 ) --- ^--------^---------^ (請先閱讀背面之注意事項再填寫本頁) 525120 A7 ------— B7______五、發明說明（15 ) 第6圖係實施例2之電壓波形圖。 第7圖係實施例3之電壓波形圖。 第8圖係表示實施例4副影面顯示順序之圖。 第9圖係實施例4之電壓波形圖。 第10圖係習知之AC型PDP驅動方法之概念圖。 【元件標號對照表】 經濟部智慧財產局員工消費合作社印製 1...PDP 711…框架記憶 10…基板構體 712···波形記憶 11·.·前面側玻璃基板 73···電源回路 17··.介電體層 74.··Χ傳動器 18…保護膜 77…Υ傳動器 20···基板構體 78·.·掃瞄回路 21…背面側玻璃基板 79…共通傳動器 24···介電體層 80···位址傳動器 28B…螢光體層 100···顯示裝置 28G···螢光體層 A · · ·位址電極 28R···螢光體層 B…螢光體之發光色 29…間壁 G···螢光體之發光色 31.··列空間 R.··螢光體之發光色 41…透明導電膜 X、Y…顯示電極 42···金屬膜 Df···框架資料 70…傳動裝置 Dsf···副影面資料 71…控制回路 msf…混成副影面 衣纸張己1適用由國國家標準（CNS)A4規格（210 X 297公釐） -18- (請先閱讀背面之注意事項再填寫本頁) law· ---- 參 525120 五、發明說明（16 )
Ta···壁電荷蓄積時間 丁 b · · ·施加休止期間 Tc••週期（時間間隔） Tf···影面期間 Tsf·.·副影面期間 TA···位址期間 TH…位址•保持期間 TR…重整期間 TS···保持其間(顯示期間) TSs...安定化期間
Pa···位址脈衝 Pd···電壓脈衝 Pr···脈衝 Prw···重整脈衝 Prx···脈衝 Pry··.脈衝 Ps…維持脈衝 Psd…維持脈衝 P y…掃瞒脈衝 Pya…掃瞄脈衝 Tsd…AC脈衝記憶驅動期間 V a…波yfj值 Vc···胞元電壓
Vd…較放電開始電壓更低之電壓 Vf···放電開始電壓 Vi···電壓脈衝列 -部智迖时產局員工消費合卞、土 口
Vr…較放電開始電壓更高之電壓 Vs···維持脈衝 Vw···壁電壓 Vx···電位 V y…波南值 衣纸張尺度適用由國國家標準（CNS)A4規格（210 X 297公釐

Claims (1)

  1. 525120 A8 B8 C8 D8 六、申請專利範圍 經濟部智慧財產局員工消費合作社印製 1·種AC型PDP之驅動方法，其係利用壁電荷造成放電 •以供顯示（以下稱顯示放電）者，即，於顯示用之電2 (以下稱顯示電極）間施加交變極性之電壓脈衝列，而 以二間包荷可產生有效充注（priming )效果之時間間 隔造成顯示放電，且於每次產生顯示放電時，使該顯示 電極間之壁電壓極性反轉者。 2·如申请專利範圍第1項之AC型PDp之驅動方法，其每1 脈衝之壁電荷蓄積時間為〇.3#s以上，且，丨個脈衝與 其下個脈衝間之施加休止期間為〇3/is以下，又，前述 時間間隔之值在0.3# s〜2 之範圍内。 一種AC型PDP之驅動方法，其係利用壁電荷造成顯示 放黾者，即，於顯示電極間施加較放電開始電壓更高之 電壓，使其產生放電，並利用藉此形成之壁電荷，而施 加較放電開始電壓更低之電壓使其產生放電後，於顯示 電極間施加交變極性之電壓脈衝列，而以空間電荷可產 生有效充注效果之時間間隔造成顯示放電，且於每次產 生顯不放電時，使該顯示電極間之壁電壓極性反轉者。 一種AC型PDP之驅動方法，其係為進行階調顯示雨將 框架分割成複數個副影面，且將各個副影面分配成時間 上相互分離之位址期間及顯示期間，並利用壁電荷於該 顯示期間中造成顯示放電者； 又，該方法並於該位址期間中，於應於其後之前述 顯示期間中點亮之胞元形成壁電荷； 且，於忒顯不期間中，於顯示電極間施加較放電開 3. 4. (請先閱讀背面之注意事項再填寫本頁) --------訂------I--- -20- 525120 經濟部智兹 / 財產局員工消費合作社印製
    申請專利範圍 始電壓低之電壓造成放電後，於顯示電極間施加波高值 較前述電壓低之交變極性電壓脈衝列，而以空間電荷可 產生有效充注效果之時間間隔造成顯示放電，且於每次 產生顯示放電時，使顯示電極間之壁電墨極性反轉。 5·如申請專利範圍第4項之从型卿之驅動方*，其係將 顯示列分為複數組H组皆以與其他組相異之順序來 表示前述複數之副者影面者。 6· - ^AC型PDP之驅動方法，其係利用壁電荷造成顯示 放電者，gP，邊以設定順序選擇顯*列進行編址，邊於 顯示電極間施加交變極性之電壓脈衝列，而由已結束編 址之顯示列開始逐次地以空間電荷可造成有效充注效 果之時間間隔造成顯示放電，且於每次產生顯示放電 時’使該顯示電極間之壁電壓極性反轉者。 7.如申請專利範圍第6項之AC型pDp之驅動方法，其係於 施加較放電開始電壓更高之電壓，使其產生放電後，將 該施加之電壓緩慢降低，以形成放電開始前刻之帶電狀 悲’而進行消去形式之編址。 8·如申請專利範圍第6項之AC型PDP之驅動方法，其於前 述電壓脈衝列之施加途中亦進行至少一次之編址，以進 行階調顯示。 9·如申凊專利範圍第6項之AC型PDP之驅動方法，其係將 框架分割為複數個副影面，且對各副影面附加亮度重 量，並按照各副影面之亮度重量產生數次之顯示放電， 以進行階調顯示，又，於此階調顯示時，則將顯示列分 本紙張尺度過用甲國國豕知準（CNS)A4規格（210 X 297公爱） -21- 525120 Αδ Β8 C8 D8 六、申請專利範圍 為數組，且各組並皆以與其他組相異之順序來表示前述 複數之副影面。 10·如申請專利範圍第7項之AC型PDP之驅動方法，其係將 '相鄰之顯示列分到互相相異之組。 • -- (請先閱讀背面之注意事項再填寫本頁) -_線- 經濟部智慧財產局員工消費合作社印製 * 本紙張尺度適用中國國家標準（CNS)A4規格（210 X 297公釐） -22-
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