TW201434028A - 位準移位電路及其驅動方法 - Google Patents

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Abstract

位準移位電路包含輸入端，解碼電路，控制電路及複數個輸出電路。該輸入端用以接收訊號串，該訊號串包含起始協定碼，設定碼，時脈基準訊號，及結束協定碼。該解碼電路耦接於該輸入端，用以解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼。該控制電路耦接於該解碼電路，用以於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號。該些輸出電路耦接於該控制電路，用以根據相對應之邏輯驅動訊號輸出複數個時脈訊號。

Description

位準移位電路及其驅動方法
本發明係相關於一種位準移位電路，尤指一種可簡化訊號傳輸介面之位準移位電路。
請同時參考第1圖及第2圖。第1圖為習知顯示裝置100的示意圖。第2圖為習知位準移位電路110的示意圖。位準移位電路110係用以根據顯示裝置100之時序控制器130傳來的驅動訊號產生複數個時脈訊號。顯示裝置100之閘極驅動電路140再根據位準移位電路110之時脈訊號依序產生複數個掃描訊號，以進一步驅動顯示模組120。如第2圖所示，習知位準移位電路110包含複數個輸入端Pi(例如8個輸入端)及複數個設定端Ps(例如4個設定端)。輸入端Pi是耦接於時序控制器130，用以分別接收時序控制器130傳來的驅動訊號，例如起始訊號、時脈訊號、終止訊號等。設定端Ps是用以接收設定訊號，以控制位準移位電路110根據接收之驅動訊號產生複數個相異之時脈訊號，例如高頻時脈訊號及低頻時脈訊號。
然而，習知位準移位電路110和時序控制器130之間的訊號傳輸介面102至少需設置8條訊號線以分別傳輸不同之驅動訊號，再者，習知位準移位電路110亦需要另外經由4條訊號線以接收設定訊號，因此習知位準移位電路的訊號線佔據電路板過多的空間，進而增加電路板佈線設計的困難度及複雜性。
本發明提供一種位準移位電路，包含輸入端，解碼電路，控制電路及複數個輸出電路。該輸入端用以接收訊號串，該訊號串包含起始協定碼，設定碼，時脈基準訊號，及結束協定碼。該解碼電路耦接於該輸入端，用以解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼。該控制電路耦接於該解碼電路，用以於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號之邏輯位準。該複數個輸出電路耦接於該控制電路，用以根據相對應之邏輯驅動訊號輸出複數個時脈訊號。
本發明另提供一種顯示驅動系統，包含時序控制器，位準移位電路，及閘極驅動電路。該時序控制器用以根據時序訊號產生訊號串，該訊號串包含起始協定碼，設定碼，時脈基準訊號，及結束協定碼。該位準移位電路包含輸入端，解碼電路，控制電路，及複數個輸出電路。該輸入端用以接收該訊號串。該解碼電路耦接於該輸入端，用以解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼。該控制電路耦接於該解碼電路，用以於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號之邏輯位準。該些輸出電路耦接於該控制電路，用以根據相對應之邏輯驅動訊號輸出複數個時脈訊號。該閘極驅動電路用以根據該些時脈訊號依序產生複數個掃描訊號。
本發明另提供一種位準移位電路之驅動方法，包含提供位準移位電路，該位準移位電路包含輸入端，解碼電路，控制電路，及複數 個輸出電路；該輸入端接收訊號串，該訊號串包含起始協定碼，設定碼，時脈基準訊號，及結束協定碼；該解碼電路解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼至該控制電路；該控制電路於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號之邏輯位準；及該些輸出電路根據相對應之邏輯驅動訊號輸出複數個時脈訊號。
本發明另提供一種顯示裝置，包含顯示模組，時序控制器，位準移位電路，及閘極驅動電路。該顯示模組用以根據影像資料顯示影像。該時序控制器用以根據時序訊號產生訊號串，該訊號串包含起始協定碼，設定碼，時脈基準訊號，及結束協定碼。該位準移位電路包含輸入端，解碼電路，控制電路，及複數個輸出電路。該輸入端用以接收該訊號串。該解碼電路耦接於該輸入端，用以解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼。該控制電路耦接於該解碼電路，用以於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號之邏輯位準。該些輸出電路耦接於該控制電路，用以根據相對應之邏輯驅動訊號輸出複數個時脈訊號。該閘極驅動電路耦接於該位準移位電路與該顯示模組之間，用以根據該些時脈訊號依序產生複數個掃描訊號並輸出至該顯示模組。
100‧‧‧習知顯示裝置
102‧‧‧傳輸介面
110‧‧‧習知位準移位電路
120‧‧‧顯示模組
130‧‧‧時序控制器
140‧‧‧閘極驅動電路
200‧‧‧顯示裝置
202‧‧‧訊號線
210‧‧‧位準移位電路
212‧‧‧解碼電路
214‧‧‧控制電路
216‧‧‧輸出電路
220‧‧‧顯示模組
230‧‧‧時序控制器
240‧‧‧閘極驅動電路
LC1-LC2‧‧‧低頻時脈訊號
HC1-HC8‧‧‧高頻時脈訊號
Pi‧‧‧輸入端
Ps‧‧‧設定端
Po‧‧‧輸出端
P1-P9‧‧‧脈波寬度
SL‧‧‧邏輯驅動訊號
STH‧‧‧水平起始訊號
VGH‧‧‧第一電壓位準
VGL‧‧‧第二電壓位準
700‧‧‧流程圖
710-750‧‧‧步驟
第1圖為習知顯示裝置100的示意圖。
第2圖為習知位準移位電路的示意圖。
第3圖為本發明顯示裝置的示意圖。
第4圖為本發明位準移位電路的功能方塊示意圖。
第5圖為本發明位準移位電路之輸出電路的實施例的示意圖。
第6圖為本發明顯示驅動系統的相關訊號的示意圖。
第7圖為本發明位準移位電路之驅動方法之流程圖。
請參考第3圖，第3圖為本發明顯示裝置200的示意圖。如第3圖所示，本發明顯示裝置200包含顯示模組220，時序控制器230，位準移位電路210，及閘極驅動電路240。顯示模組220是用以根據影像資料顯示影像。時序控制器230用以根據時序訊號產生訊號串以驅動位準移位電路210，訊號串可依序包含起始協定碼，設定碼，時脈基準訊號，及結束協定碼。位準移位電路210是耦接於時序控制器230，用以根據時序控制器230之訊號串產生複數個時脈訊號。閘極驅動電路240是耦接於位準移位電路210與顯示模組220之間，用以根據位準移位電路210產生之複數個時脈訊號依序產生複數個掃描訊號並輸出至顯示模組220，以驅動顯示模組220顯示畫面。
請參考第4圖，並一併參考第3圖。第4圖為本發明位準移位電路210的功能方塊示意圖。如第4圖所示，位準移位電路210包含輸入端Pi，解碼電路212，控制電路214，及複數個輸出電路216。輸入端Pi用以經由單一訊號線202接收時序控制器230傳來之訊號串。解碼電路212是耦接於輸入端Pi，用以解碼訊號串以分別輸出起始協定碼，設定碼，時脈基準訊號，及結束協定碼。控制電路214是耦接於解碼電路212，用以於接收到起始協定碼後開始根據設定碼及時脈基準訊號控制複數個邏輯驅動訊號SL之邏輯位準，及於接收到結束協定碼後停止改變複數個邏輯驅動訊號SL之邏輯位準。複數個輸出電路216是耦接於控制 電路214，用以根據相對應之邏輯驅動訊號SL輸出複數個時脈訊號，例如高頻時脈訊號及低頻時脈訊號。
請參考第5圖，並一併參考第4圖。第5圖為本發明位準移位電路之輸出電路216的實施例的示意圖。如第5圖所示，每一輸出電路216可根據邏輯驅動訊號SL之邏輯位準輸出介於第一電壓位準VGH及第二電壓位準VGL之間的時脈訊號。
依據上述配置，本發明位準移位電路210和時序控制器230之間的訊號傳輸介面只需設置單一訊號線202以傳輸訊號串，由於本發明位準移位電路210不需配置設定端，因此本發明位準移位電路210的訊號線只會佔據電路板(例如印刷電路板及軟性電路板)小部分的空間。位準移位電路210可進一步根據訊號串產生閘極驅動電路240及/或其他驅動電路需要之時脈訊號。
舉例來說，請參考第6圖，並一併參考第3圖至第5圖，第6圖為本發明顯示驅動系統的相關訊號的示意圖。如第6圖所示，訊號串依序包含起始協定碼、設定碼、時脈基準訊號及結束協定碼。且起始協定碼、設定碼、時脈基準訊號及結束協定碼之間具有時間間隔T1-T4，以讓解碼電路212能根據時間間隔T1-T4分別將訊號串解碼為起始協定碼、設定碼、時脈基準訊號及結束協定碼。當解碼電路212偵測到第一時間間隔T1時，代表起始協定碼已接收完成，解碼電路212進而將起始協定碼從訊號串中解碼出來並輸出至控制電路214，以通知控制電路214開始運作。當解碼電路偵測到第二時間間隔T2時，代表設定碼已接收完成，解碼電路212進而將設定碼從訊號串中解碼出來並輸出至控制電路214。時脈基準訊號位於第二時間間隔T2及第三時間間隔T3之間，當解 碼電路212將時脈基準訊號從訊號串中解碼出來並輸出至控制電路214時，控制電路214可根據設定碼之內容及時脈基準訊號分別控制輸出至輸出電路216的複數個邏輯驅動訊號SL之邏輯位準。輸出電路216再於第二時間間隔T2及第三時間間隔T3之間根據相對應之邏輯驅動訊號SL之邏輯位準輸出相異之時脈訊號，例如輸出高頻時脈訊號HC1-HC8及低頻時脈訊號LC1-LC2。當解碼電路212偵測到第四時間間隔T4時，代表結束協定碼已接收完成，解碼電路212進而將結束協定碼從訊號串中解碼出來並輸出至控制電路214，以通知控制電路214停止改變邏輯驅動訊號之邏輯位準。位準移位電路210會再於接收到起始協定碼時重複上述流程。
另外，設定碼之長度可為複數個脈波之寬度(在第6圖之實施例中為9個脈波寬度)，以包含不同之設定參數。舉例來說，前兩個脈波寬度P1-P2可包含時脈訊號之相位的設定參數，第三個脈波寬度P3可包含高頻時脈訊號之時間間隔的設定參數，第四至五個脈波寬度P4-P5可包含電荷分享(charge sharing)模式的設定參數、第六個脈波寬度P6可包含半源極驅動(half source driving,HSD)模式的設定參數、第七至八個脈波寬度P7-P8可包含預充電設定參數等。設定碼可根據設計需求而定義其他設定參數。再者，第一至第四時間間隔T1-T4的長度可以相異，以方便解碼電路212判斷訊號串之內容。
第6圖之訊號串格式只是用以說明本發明之實施例，本發明之訊號串格式並不以第6圖為限。
請參考第7圖，第7圖為本發明位準移位電路之驅動方法之流程圖700。本發明位準移位電路之驅動方法之流程如下列步驟： 步驟710：提供位準移位電路，該位準移位電路包含輸入端，解碼電路，控制電路，及複數個輸出電路；步驟720：該輸入端接收訊號串，該訊號串包含起始協定碼，設定碼，時脈基準訊號，及結束協定碼；步驟730：該解碼電路解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼至該控制電路；步驟740：該控制電路於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號之邏輯位準；及步驟750：該些輸出電路根據相對應之邏輯驅動訊號輸出複數個時脈訊號。
相較於先前技術，本發明位準移位電路可經由單一訊號線接收從時序控制器傳來之訊號串，以進一步產生顯示裝置之驅動電路需要之各種時脈訊號。因此本發明位準移位電路的訊號線只會佔據電路板小部分的空間，進而減少電路板佈線設計的困難度及複雜性。
210‧‧‧位準移位電路
212‧‧‧解碼電路
214‧‧‧控制電路
216‧‧‧輸出電路
Pi‧‧‧輸入端
Po‧‧‧輸出端
SL‧‧‧邏輯驅動訊號

Claims (15)

  1. 一種位準移位電路，包含：一輸入端，用以接收一訊號串，該訊號串包含一起始協定碼，一設定碼，一時脈基準訊號，及一結束協定碼；一解碼電路，耦接於該輸入端，用以解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼；一控制電路，耦接於該解碼電路，用以於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號之邏輯位準；及複數個輸出電路，耦接於該控制電路，用以根據相對應之邏輯驅動訊號輸出複數個時脈訊號。
  2. 如請求項1所述之位準移位電路，其中該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼之間具有時間間隔。
  3. 如請求項1所述之位準移位電路，其中該訊號串係根據一時序控制器之時序訊號所產生。
  4. 如請求項1所述之位準移位電路，其中該些時脈訊號係為相異之時脈訊號。
  5. 一種顯示驅動系統，包含：一時序控制器，用以根據一時序訊號產生一訊號串，該訊號串包含一起始協定碼，一設定碼，一時脈基準訊號，及一結束協定碼；一位準移位電路，包含：一輸入端，用以接收該訊號串； 一解碼電路，耦接於該輸入端，用以解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼；一控制電路，耦接於該解碼電路，用以於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號之邏輯位準；及複數個輸出電路，耦接於該控制電路，用以根據相對應之邏輯驅動訊號輸出複數個時脈訊號；及一閘極驅動電路，用以根據該些時脈訊號依序產生複數個掃描訊號。
  6. 如請求項5所述之顯示驅動系統，其中該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼之間具有時間間隔。
  7. 如請求項5所述之顯示驅動系統，其中該些時脈訊號係為相異之時脈訊號。
  8. 一種位準移位電路之驅動方法，包含：提供一位準移位電路，該位準移位電路包含一輸入端，一解碼電路，一控制電路，及複數個輸出電路；該輸入端接收一訊號串，該訊號串包含一起始協定碼，一設定碼，一時脈基準訊號，及一結束協定碼；該解碼電路解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼至該控制電路；該控制電路於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號之邏輯位準；及該些輸出電路根據相對應之邏輯驅動訊號輸出複數個時脈訊號。
  9. 如請求項8所述之驅動方法，其中該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼之間具有時間間隔。
  10. 如請求項8所述之驅動方法，另包含根據一時序控制器之時序訊號產生該訊號串。
  11. 如請求項8所述之驅動方法，其中該些時脈訊號係為相異之時脈訊號。
  12. 如請求項8所述之驅動方法，其中該些時脈訊號係輸出至一閘極驅動電路，該閘極驅動電路係根據該些時脈訊號依序產生複數個掃描訊號。
  13. 一種顯示裝置，包含：一顯示模組，用以根據一影像資料顯示影像；一時序控制器，用以根據一時序訊號產生一訊號串，該訊號串包含一起始協定碼，一設定碼，一時脈基準訊號，及一結束協定碼；一位準移位電路，包含：一輸入端，用以接收該訊號串；一解碼電路，耦接於該輸入端，用以解碼該訊號串以分別輸出該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼；一控制電路，耦接於該解碼電路，用以於接收到該起始協定碼後開始根據該設定碼及該時脈基準訊號控制複數個邏輯驅動訊號之邏輯位準，及於接收到該結束協定碼後停止改變該些邏輯驅動訊號之邏輯位準；及複數個輸出電路，耦接於該控制電路，用以根據相對應之邏輯驅動訊號輸出複數個時脈訊號；及 一閘極驅動電路，耦接於該位準移位電路與該顯示模組之間，用以根據該些時脈訊號依序產生複數個掃描訊號並輸出至該顯示模組。
  14. 如請求項13所述之顯示裝置，其中該起始協定碼，該設定碼，該時脈基準訊號，及該結束協定碼之間具有時間間隔。
  15. 如請求項13所述之顯示裝置，其中該些時脈訊號係為相異之時脈訊號。
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